JPH0520414U - Limit circuit using transistors - Google Patents
Limit circuit using transistorsInfo
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- JPH0520414U JPH0520414U JP6675991U JP6675991U JPH0520414U JP H0520414 U JPH0520414 U JP H0520414U JP 6675991 U JP6675991 U JP 6675991U JP 6675991 U JP6675991 U JP 6675991U JP H0520414 U JPH0520414 U JP H0520414U
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Abstract
(57)【要約】
【目的】 この考案はトランジスタのエミッタフォロア
回路を用い正確でかつ自由にリミット電圧を設定できる
ようなトランジスタを用いたリミット回路を提供するこ
とを主要な特徴とする。
【構成】 可変抵抗器VR1に上限リミット電圧を設定
してトランジスタTR1のベースに与え、可変抵抗器V
R2によって下限リミット電圧を設定してトランジスタ
TR2のベースに与え、トランジスタTR1とTR2の
それぞれのエミッタから上限リミット電圧と下限リミッ
ト電圧とを出力し、抵抗R1の一端に入力された入力電
圧を上限リミット電圧と下限リミット電圧でリミットし
て出力する。
(57) [Abstract] [Purpose] The main feature of the present invention is to provide a limit circuit using a transistor in which an emitter follower circuit of the transistor can be used to set the limit voltage accurately and freely. [Structure] An upper limit voltage is set to the variable resistor VR1 and is given to the base of the transistor TR1.
The lower limit voltage is set by R2 and given to the base of the transistor TR2, the upper limit voltage and the lower limit voltage are output from the emitters of the transistors TR1 and TR2, and the input voltage input to one end of the resistor R1 is limited to the upper limit. Output with voltage and lower limit voltage.
Description
【0001】[0001]
この考案はトランジスタを用いたリミット回路に関し、特に、電圧出力型セン サの出力電圧をリミットするようなトランジスタを用いたリミット回路に関する 。 The present invention relates to a limit circuit using a transistor, and particularly to a limit circuit using a transistor that limits the output voltage of a voltage output type sensor.
【0002】[0002]
図5は従来のリミット回路を示す図である。図5を参照して、入力電圧Vinが 抵抗R1の一端に入力され、抵抗R1の他端と接地間にはツェナーダイオードD 1,D2が接続され、入力電圧がツェナーダイオードD1,D2でリミットされ 、出力電圧Vout が出力される。図5に示すリミット回路において、リミット電 圧Vlim は次式で表わされる。FIG. 5 is a diagram showing a conventional limit circuit. Referring to FIG. 5, the input voltage V in is input to one end of a resistor R1, a Zener diode D 1, D2 is connected between the other end of the resistor R1 and the ground, the input voltage limit Zener diodes D1, D2 Then, the output voltage V out is output. In the limit circuit shown in FIG. 5, the limit voltage V lim is expressed by the following equation.
【0003】 Vlim =Vz +VF Vz :ツェナー電圧 VF :順方向電圧V lim = V z + V F V z : Zener voltage V F : Forward voltage
【0004】[0004]
上述のごとく、図5に示したリミット回路は、ツェナー電圧Vz と順方向電圧 VF とによって決定されるため、リミット値を自由に選択することができず、リ ミット値も正確でないという欠点があった。オペアンプを使用したリミット回路 も考えられているが、回路が複雑になり、コスト高になるという問題点があった 。As described above, since the limit circuit shown in FIG. 5 is determined by the Zener voltage V z and the forward voltage V F , the limit value cannot be freely selected, and the limit value is not accurate. was there. A limit circuit using an operational amplifier is also considered, but it has a problem that the circuit becomes complicated and the cost becomes high.
【0005】 それゆえに、この考案の主たる目的は、トランジスタのエミッタフォロア回路 を用いて、正確でかつ自由にリミット値を設定できるようなトランジスタを用い たリミット回路を提供することである。Therefore, a main object of the present invention is to provide a limit circuit using a transistor in which an emitter follower circuit of the transistor can be used to set a limit value accurately and freely.
【0006】[0006]
請求項1にかかる考案はトランジスタを用いて入力電圧をリミットするリミッ ト回路であって、入力電圧の上限リミッタ電圧を設定するための可変抵抗と、こ の可変抵抗で設定された上限リミット電圧をそのベースに受け、そのエミッタか ら入力電圧の上限値をリミットするリミット電圧を出力するトランジスタを備え て構成される。 The invention according to claim 1 is a limit circuit for limiting an input voltage by using a transistor, and includes a variable resistor for setting an upper limiter voltage of the input voltage and an upper limit voltage set by the variable resistor. It is configured with a transistor that receives at its base and outputs a limit voltage that limits the upper limit of the input voltage from its emitter.
【0007】 請求項2にかかる考案は、入力電圧の下限リミット電圧を設定するための可変 抵抗と、可変抵抗で設定された下限リミット電圧をそのベースに受け、そのエミ ッタから入力電圧の可変値をリミットするリミット電圧を出力するトランジスタ とを備えて構成される。According to a second aspect of the present invention, a variable resistor for setting a lower limit voltage of the input voltage and a lower limit voltage set by the variable resistor are received at its base, and the input voltage is changed from the emitter. And a transistor that outputs a limit voltage that limits the value.
【0008】 請求項3にかかる考案は、入力電圧の上限リミット電圧を設定するための第1 の可変抵抗と、下限リミット電圧を設定するための第2の可変抵抗と、第1の可 変抵抗によって設定された上限リミット電圧をそのベースに受け、そのエミッタ から入力電圧の上限値をリミットするリミット電圧を出力する第1のトランジス タと、第2の可変抵抗によって設定された下限リミット電圧をそのベースに受け 、そのエミッタから入力電圧の下限値をリミットするリミット電圧を出力する第 2のトランジスタを備えて構成される。According to a third aspect of the invention, a first variable resistor for setting an upper limit voltage of the input voltage, a second variable resistor for setting a lower limit voltage, and a first variable resistor. It receives the upper limit voltage set by the base and outputs the limit voltage that limits the upper limit of the input voltage from its emitter, and the lower limit voltage set by the second variable resistor. It is configured to include a second transistor which receives at the base and outputs a limit voltage from the emitter that limits the lower limit value of the input voltage.
【0009】[0009]
この考案にかかるトランジスタを用いたリミット回路は、可変抵抗器でリミッ ト電圧の上限値または下限値を設定してトランジスタのベースに与え、エミッタ からリミット電圧を出力することにより、回路構成を簡単にできるばかりでなく 、リミット電圧を可変抵抗によって設定されたベース電圧とトランジスタのベー スとエミッタ間電圧VBEによって正確に設定できる。The limit circuit using a transistor according to the present invention simplifies the circuit configuration by setting the upper limit value or the lower limit value of the limit voltage with a variable resistor, giving it to the base of the transistor, and outputting the limit voltage from the emitter. Not only can the limit voltage be set, but the limit voltage can be accurately set by the base voltage set by the variable resistance, the transistor base and the emitter-to-emitter voltage V BE .
【0010】[0010]
図1はこの考案の一実施例の上限リミット回路を示す電気回路図である。図1 において、電源+Vccと−Vccとの間には可変抵抗器VR1が接続される。 この可変抵抗器VRによって上限リミット電圧を設定する。可変抵抗器VR1の 設定電圧はトランジスタTR1のベースに与えられる。トランジスタTR1のコ レクタには電源−Vccが与えられる。抵抗R1の−端には入力電圧Vinが与え られ、他端はトランジスタTR1のエミッタに接続されるとともに、そこからリ ミットされた電圧が出力される。FIG. 1 is an electric circuit diagram showing an upper limit circuit of an embodiment of the present invention. In FIG. 1, a variable resistor VR1 is connected between the power supplies + Vcc and -Vcc. The variable resistor VR sets the upper limit voltage. The set voltage of the variable resistor VR1 is given to the base of the transistor TR1. The power supply -Vcc is applied to the collector of the transistor TR1. The input voltage V in is applied to the negative terminal of the resistor R1, and the other terminal is connected to the emitter of the transistor TR1 and the limited voltage is output from there.
【0011】 図1に示した上限リミット回路において、上限リミット電圧VHlimは次式で表 わされる。In the upper limit circuit shown in FIG. 1, the upper limit voltage V Hlim is expressed by the following equation.
【0012】 VHlim=VB1+VBE1 VB1:トランジスタTR1のベース電位(可変抵抗器VR1により任意に設定 される。) VBE1 :トランジスタTR1のON動作時におけるエミッタベース間電圧(約 0.6V) したがって、入力電圧VinがVB1+VBE1 より大きくなると、トランジスタT R1のベース電流が流れてトランジスタTR1がONし、出力電圧はVout =V B1 +VBE1 =VHlimとなる。 したがって、上限リミットは Vin≦VHlim TR1:OFF動作 Vout =Vin Vin>VHlim TR1:ON動作 Vout =VHlim となる。VHlim= VB1+ VBE1 VB1: Base potential of the transistor TR1 (set arbitrarily by the variable resistor VR1) VBE1: Voltage between emitter and base when transistor TR1 is ON (about 0.6V) Therefore, input voltage VinIs VB1+ VBE1When it becomes larger, the base current of the transistor TR1 flows, the transistor TR1 is turned on, and the output voltage is Vout= V B1 + VBE1= VHlimBecomes Therefore, the upper limit is Vin≤VHlim TR1: OFF operation Vout= Vin Vin> VHlim TR1: ON operation Vout= VHlim Becomes
【0013】 図2はこの考案の他の実施例の下限リミット回路を示す電気回路図である。図 2を参照して、電源+Vccと−Vccとの間には可変抵抗器VR2が接続され る。可変抵抗器VR2は下限リミット電圧を設定する。可変抵抗器VR2の設定 電圧はトランジスタTR2のベースに与えられる。トランジスタTR2のコレク タには電源+Vccが与えられる。抵抗R1の一端には入力電圧Vinが与えられ 、他端はトランジスタTR2のエミッタに接続されるとともに、そこから下限の リミットされた電圧が出力される。FIG. 2 is an electric circuit diagram showing a lower limit circuit of another embodiment of the present invention. Referring to FIG. 2, variable resistor VR2 is connected between power supplies + Vcc and -Vcc. The variable resistor VR2 sets the lower limit voltage. The set voltage of the variable resistor VR2 is given to the base of the transistor TR2. The power supply + Vcc is applied to the collector of the transistor TR2. One end of the resistor R1 is given an input voltage V in, the other end is connected to the emitter of the transistor TR2, the lower limit of the limit voltage therefrom is output.
【0014】 図2に示した下限リミット回路において、下限リミット電圧VLlimは、 VLlim=VB2−VBE2 VB2:トランジスタTR2のベース電位(可変抵抗器VR2によって任意に設 定される。) VBE2 :トランジスタTR2のON動作時のエミッタベース間電圧(約0.6 V) で示される。したがって、入力電圧VinがVB2−VBE2 よりも小さくなると、ト ランジスタTR2のベース電流が流れ、トランジスタTR2がONし、出力電圧 はVout =VB2−VBE2 =VLlimとなる。[0014] In the lower limit circuit shown in FIG. 2, the lower limit voltage V Llim is, V Llim = V B2 -V BE2 V B2: base potential of the transistor TR2 (is set arbitrarily by the variable resistor VR2.) V BE2 : It is represented by the emitter-base voltage (about 0.6 V) when the transistor TR2 is turned on . Therefore, when the input voltage V in is smaller than V B2 -V BE2, flows the base current of the bets transistor TR2, transistor TR2 is turned ON, the output voltage is V out = V B2 -V BE2 = V Llim.
【0015】 したがって、下限リミットは、 Vin≧VLlim TR2:OFF動作 Vout =Vin Vin<VLlim TR2:ON動作 Vout =VLlim となる。Accordingly, the lower limit is: V in ≧ V Llim TR2: OFF operation V out = V in Vin in <V Llim TR2: ON operation V out = V Llim
【0016】 図3はこの考案のさらに他の実施例を示す電気回路図である。この図3に示し た実施例は、図1に示した上限リミット回路と図2に示した下限リミット回路を 組合わせたものである。FIG. 3 is an electric circuit diagram showing still another embodiment of the present invention. The embodiment shown in FIG. 3 is a combination of the upper limit circuit shown in FIG. 1 and the lower limit circuit shown in FIG.
【0017】 図4は図3に示した上限リミット回路および下限リミット回路によってリミッ トされた電圧を示す図である。図4から明らかなように、入力電圧Vinが下限リ ミット電圧VLlimより小さい場合には、出力電圧はVLlimに設定され、入力電圧 Vinが上限リミット電圧VHlimを越えると、出力電圧Vout は上限リミット電圧 VHlimとなる。FIG. 4 is a diagram showing the voltage limited by the upper limit circuit and the lower limit circuit shown in FIG. As apparent from FIG. 4, when the input voltage V in is lower Limit voltage V Llim smaller than the output voltage is set to V Llim, the input voltage V in exceeds the upper limit voltage V Hlim, the output voltage V out becomes the upper limit voltage V Hlim .
【0018】[0018]
以上のように、この考案によれば、可変抵抗器によってリミット電圧の上限値 または下限値を設定してトランジスタのベースに与え、トランジスタのエミッタ フォロアからエミッタ電圧を出力することにより、回路構成を簡単にできるばか りでなく、リミット電圧を可変抵抗によって設定されたベース電圧とトランジス タのベースとエミッタ間電圧によって正確に設定することができる。 As described above, according to the present invention, the upper limit value or the lower limit value of the limit voltage is set by the variable resistor and is given to the base of the transistor, and the emitter follower of the transistor outputs the emitter voltage, thereby simplifying the circuit configuration. Not only that, but the limit voltage can be set accurately by the base voltage set by the variable resistor and the base-emitter voltage of the transistor.
【図1】この考案の一実施例の上限リミット回路を示す
電気回路図である。FIG. 1 is an electric circuit diagram showing an upper limit circuit of an embodiment of the present invention.
【図2】この考案の他の実施例を示す下限リミット回路
の電気回路図である。FIG. 2 is an electric circuit diagram of a lower limit circuit showing another embodiment of the present invention.
【図3】この考案のさらに他の実施例を示す電気回路図
である。FIG. 3 is an electric circuit diagram showing still another embodiment of the present invention.
【図4】図3に示したリミット回路における入力電圧と
出力電圧との関係を示す図である。4 is a diagram showing a relationship between an input voltage and an output voltage in the limit circuit shown in FIG.
【図5】従来のリミット回路の一例を示す図である。FIG. 5 is a diagram showing an example of a conventional limit circuit.
VR1,VR2 可変抵抗器 TR1,TR2 トランジスタ R1 抵抗 VR1, VR2 Variable resistor TR1, TR2 Transistor R1 Resistance
Claims (3)
ットするリミット回路であって、 入力電圧の上限リミッタ電圧を設定するための可変抵
抗、および前記可変抵抗で設定された上限リミット電圧
をそのベースに受け、そのエミッタから前記入力電圧の
上限値をリミットするリミット電圧を出力するトランジ
スタを備えた、トランジスタを用いたリミット回路。1. A limit circuit for limiting input data using a transistor, comprising: a variable resistor for setting an upper limit limiter voltage of an input voltage, and an upper limit voltage set by the variable resistor at its base. A limit circuit using a transistor, comprising a transistor that outputs a limit voltage that limits the upper limit value of the input voltage from its emitter.
トするリミット回路であって、 入力電圧の下限リミット電圧を設定するための可変抵
抗、および前記可変抵抗で設定された下限リミット電圧
をそのベースに受け、そのエミッタから前記入力電圧の
可変値をリミットするリミット電圧を出力するトランジ
スタを備えた、トランジスタを用いたリミット回路。2. A limit circuit for limiting an input voltage using a transistor, comprising: a variable resistor for setting a lower limit voltage of the input voltage, and a lower limit voltage set by the variable resistor at its base. A limit circuit using a transistor, the transistor including a transistor outputting a limit voltage for limiting a variable value of the input voltage from its emitter.
って、 入力電圧の上限リミット電圧を設定するための第1の可
変抵抗、 入力電圧の下限リミット電圧を設定するための第2の可
変抵抗、 前記第1の可変抵抗によって設定された上限リミット電
圧をそのベースに受け、そのエミッタから前記入力電圧
の上限値をリミットするリミット電圧を出力する第1の
トランジスタ、および前記第2の可変抵抗によって設定
された下限リミット電圧をそのベースに受け、そのエミ
ッタから前記入力電圧の下限値をリミットするリミット
電圧を出力する第2のトランジスタを備えた、トランジ
スタを用いたリミット回路。3. A limit circuit using a transistor, comprising: a first variable resistor for setting an upper limit voltage of an input voltage; a second variable resistor for setting a lower limit voltage of an input voltage; A first transistor that receives the upper limit voltage set by the first variable resistor at its base and outputs a limit voltage that limits the upper limit value of the input voltage from its emitter, and the second variable resistor. A limit circuit using a transistor, comprising a second transistor that receives a lower limit voltage at its base and outputs a limit voltage that limits the lower limit value of the input voltage from its emitter.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6675991U JPH0520414U (en) | 1991-08-22 | 1991-08-22 | Limit circuit using transistors |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6675991U JPH0520414U (en) | 1991-08-22 | 1991-08-22 | Limit circuit using transistors |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0520414U true JPH0520414U (en) | 1993-03-12 |
Family
ID=13325135
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6675991U Pending JPH0520414U (en) | 1991-08-22 | 1991-08-22 | Limit circuit using transistors |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0520414U (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS52156231A (en) * | 1976-06-23 | 1977-12-26 | Hitachi Ltd | Carburetors |
JPS63314011A (en) * | 1987-06-17 | 1988-12-22 | Matsushita Electric Ind Co Ltd | Limiter circuit |
-
1991
- 1991-08-22 JP JP6675991U patent/JPH0520414U/en active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS52156231A (en) * | 1976-06-23 | 1977-12-26 | Hitachi Ltd | Carburetors |
JPS63314011A (en) * | 1987-06-17 | 1988-12-22 | Matsushita Electric Ind Co Ltd | Limiter circuit |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19970513 |