JP2574200Y2 - Voltage comparison circuit - Google Patents

Voltage comparison circuit

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JP2574200Y2 JP1991010221U JP1022191U JP2574200Y2 JP 2574200 Y2 JP2574200 Y2 JP 2574200Y2 JP 1991010221 U JP1991010221 U JP 1991010221U JP 1022191 U JP1022191 U JP 1022191U JP 2574200 Y2 JP2574200 Y2 JP 2574200Y2
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Description

【考案の詳細な説明】[Detailed description of the invention]

【0001】[0001]

【産業上の利用分野】本考案は電圧比較回路に係り、特
に、入力電圧のレベルにより出力の切換を行う電圧比較
回路に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a voltage comparison circuit, and more particularly, to a voltage comparison circuit for switching an output according to an input voltage level.

【0002】[0002]

【従来の技術】電圧比較回路は、電源の電圧の異常変動
によって起る誤動作を防止するためのシステムリセット
や電池等の消耗度を知るバッテリチェッカ等に使用され
ており、一般に基準電圧源とコンパレータとにより構成
されている。
2. Description of the Related Art A voltage comparison circuit is used for a system reset for preventing a malfunction caused by an abnormal fluctuation of a power supply voltage or a battery checker for knowing a degree of consumption of a battery or the like. Generally, a reference voltage source and a comparator are used. It is composed of

【0003】図5に、従来の電圧比較回路の回路図を示
す。図5(A)において、入力電圧Vinが印加される入
力端子50とグランド(GND)端子51間に、コンパ
レータ52が接続される。この入力電圧Vinの抵抗
50,R51による分圧電圧がコンパレータ52の一方の
入力端子に入力され、定電流源53及びツェナダイオー
ドZ1 による基準電圧がコンパレータ52の他方の入力
端子に入力される。コンパレータ52の出力が負荷駆動
用のトランジスタQ50をバイアスして出力端子54(V
out )より出力する。
FIG. 5 shows a circuit diagram of a conventional voltage comparison circuit. In FIG. 5 (A), between an input terminal 50 to the input voltage V in is applied ground (GND) terminal 51, the comparator 52 is connected. Resistance R 50 of the input voltage V in, the divided voltage by R 51 is input to one input terminal of the comparator 52, the other input terminal of the constant current source 53 and the Zener diode Z reference voltage by 1 comparator 52 Is done. The output of comparator 52 is to bias the transistor Q 50 for load drive output terminal 54 (V
out ).

【0004】このような電圧比較回路は、コンパレータ
52が上述の基準電圧と抵抗R50,R51による分圧電圧
を比較し、入力電圧Vinのある電圧レベルを境としてオ
ン、オフ動作を行ない、トランジスタQ50を動作させて
出力端子54に接続された負荷を駆動するものである。
[0004] Such voltage comparator circuit includes a comparator 52 compares the divided voltage with the reference voltage above the resistor R 50, R 51, performs on and off operations of the voltage level of the input voltage V in as a border it is intended to drive a load connected to the output terminal 54 by operating the transistor Q 50.

【0005】また、電圧比較回路において低消費電力化
が望まれており、図5(B)のような回路が知られてい
る。図5(B)において、トランジスタQ51〜Q54によ
りコンパレータを構成しており、トランジスタQ55,Q
56により該コンパレータの定電流源のバンドギャップ回
路を構成する。また、トランジスタQ57〜Q59は該コン
パレータ出力を増幅し、負荷駆動用のトランジスタQ60
を動作させるものである。
[0005] Further, it is desired to reduce the power consumption of the voltage comparison circuit, and a circuit as shown in FIG. 5B is known. In FIG. 5B, a comparator is constituted by transistors Q 51 to Q 54 , and transistors Q 55 and Q 55
56 constitutes a band gap circuit of a constant current source of the comparator. The transistor Q 57 to Q 59 amplifies the comparator output, transistor Q 60 for a load driving
Is to operate.

【0006】この場合、トランジスタQ55のベース・エ
ミッタ間電圧VBEは負の温度特性を有し、トランジスタ
51とQ52とのベース・エミッタ間電圧との差△VBE
抵抗R53の両端に表われ、正の温度特性を有する。従っ
て、温度変化に対して、VBEと△VBEとの変化が相殺さ
れ、特にこの両電位の和がシリコン(上記トラジスタの
構成部材)のエネルギーバンドギャップ電圧と等しくな
るように抵抗R3 ,R4 の抵抗値を設定すると零温度特
性を得ることができる。
In this case, the base-emitter voltage V BE of transistor Q 55 has a negative temperature characteristic, and the difference ΔV BE between the base-emitter voltage of transistors Q 51 and Q 52 is equal to the resistance of resistor R 53 . Appears at both ends and has positive temperature characteristics. Thus, a temperature change, V BE and △ V varies with BE are canceled, in particular the resistance R 3 to be equal to the energy band gap voltage of silicon sum of both potential (components of the Torajisuta) , it is possible to obtain a zero temperature characteristic by setting the resistance value of R 4.

【0007】すなわち、トランジスタQ51〜Q54で構成
されるコンパレータに定電流を供給しており、図5
(A)における定電流源53及びツェナーダイオードZ
1 を省略することができ、低消費電力化を図っているも
のである。
That is, a constant current is supplied to a comparator composed of transistors Q 51 to Q 54 , and FIG.
(A) Constant current source 53 and Zener diode Z
1 can be omitted to reduce power consumption.

【0008】図6の回路では端子T6 とT7 間の電圧V
ref をトランジスタQ14を構成するシリコンのエネルギ
ーバンドギャップに相当する電圧Vgoと等しくすること
によってVref が零温度係数を有する温度特性とするこ
とができ、温度が変動した場合にもVref を安定に保つ
ことができる構成とされていた。
In the circuit of FIG. 6, the voltage V between terminals T 6 and T 7
ref to can Vref by equal to the voltage Vgo corresponding to the energy band gap of silicon in the transistor Q 14 is a temperature characteristic having a zero temperature coefficient, kept stably Vref even if the temperature fluctuates It was configured to be able to.

【0009】[0009]

【考案が解決しようとする課題】しかるに、従来の電圧
比較回路では基準電圧Vref は温度の変動に対して安定
であり良好な定電圧電源となるが、Vref はシリコンの
エネルギーバンドギャップに相当する約1.2Vに設定
しなければならない。従って近年増加しつつある1.2
V以下の低電圧で動作する種々の機器に対して対応がで
きず、また、1.2V以下の低電圧で動作させるために
は回路が複雑なものとなってしまう等の問題点があっ
た。
However, in the conventional voltage comparison circuit, the reference voltage Vref is stable against temperature fluctuation and is a good constant voltage power supply. However, Vref is approximately equal to the energy band gap of silicon. Must be set to 1.2V. Therefore, it is increasing in recent years.
There is a problem that it cannot cope with various devices operating at a low voltage of less than V, and the circuit becomes complicated to operate at a low voltage of 1.2 V or less. .

【0010】本発明は、上記の点に鑑みてなされたもの
であり、比較的簡単な回路で零温度係数を有し、基準電
圧が自由に設定できる電圧比較回路を提供することを目
的とする。
The present invention has been made in view of the above points, and has as its object to provide a voltage comparison circuit which has a zero temperature coefficient with a relatively simple circuit and can freely set a reference voltage. .

【0011】[0011]

【課題を解決するための手段】本考案は上記の課題を解
決するために、第1の入力端子に電源電圧に応じた入力
電圧が供給され、第2の入力端子に基準電圧が供給さ
れ、該入力電圧と該基準電圧との比較結果に応じて出力
を反転させる比較手段を有する電圧比較回路において、
前記入力電圧に直列に接続され、前記電源電圧を分圧し
てバイアス電圧を生成するバイアス回路と、 前記バイア
ス回路で生成された前記バイアス電圧がベースに供給さ
れ、前記バイアス電圧に応じてエミッタ−コレクタ間に
所定の電圧を発生するとともに、前記バイアス回路で生
成された前記バイアス電圧に応じた電流を前記コレクタ
から引き込むトランジスタと、 前記トランジスタのコレ
クタと前記電源電圧との間に接続されたPN接合素子
と、 前記トランジスタのコレクタに引き込まれる電流を
検出し、検出電流に応じた電流を出力する電流制御手段
と、 前記電流制御手段の出力電流を電圧に変換し、前記
電源電圧に応じた前記入力電圧を発生する入力電圧生成
用抵抗とを具備し、 前記トランジスタのコレクタと前記
PN接合素子との接続点に前記比較手段の前記第2の入
力端子を接続し、前記電流制御手段と前記入力電圧生成
用抵抗との接続点に前記比較手段の前記第1の入力端子
を接続した構成としてなる。
This invention SUMMARY OF THE INVENTION To solve the above issues, the input corresponding to the power supply voltage to the first input terminal
Voltage is supplied and the reference voltage is supplied to the second input terminal.
Output according to the comparison result between the input voltage and the reference voltage.
In a voltage comparison circuit having comparison means for inverting
Is connected in series with the input voltage to divide the power supply voltage
A bias circuit for generating the bias voltage Te, said via
The bias voltage generated by the bias circuit is supplied to the base.
Between the emitter and collector according to the bias voltage.
A predetermined voltage is generated, and the voltage is generated by the bias circuit.
A current corresponding to the generated bias voltage is supplied to the collector.
And the transistor to draw from, Kore of the transistor
Junction device connected between a power supply voltage and the power supply voltage
And the current drawn into the collector of the transistor
Current control means for detecting and outputting a current according to the detected current
If, converts the output current of the current control means to a voltage, the
Input voltage generation for generating the input voltage according to a power supply voltage
And a collector of the transistor and the
The second input of the comparing means is provided at a connection point with the PN junction element.
Input terminal to connect the current control means and the input voltage generation.
A first input terminal of the comparing means at a connection point with the first resistor;
Are connected.

【0012】[0012]

【作用】本考案によれば、基準電圧はPN接合素子とト
ランジスタとの接続点より取り出される。従って、基準
電圧はPN接合素子の接合間電圧とトランジスタの結合
間電圧との差に応じた電圧となる。PN接合素子とトラ
スタとは共に略同一の温度係数を有するとすれば、
温度変化によりPN接合素子の接合間電圧とトランジス
タの接合間電圧との差電圧は変化しないことになる。従
って、温度に対して安定した出力を得ることができる。
また、バイアス回路のバイアス値を変えるとによりトラ
ンジスタの接合間電圧を変化させることにより出力電圧
を可変するとができる。入力電圧はPN接合素子に流れ
る電流に応じた電流を得ることにより取り出されるた
め、零温度係数での検出が可能となる。
According to the present invention, the reference voltage is obtained from the connection point between the PN junction element and the transistor. Therefore, the reference voltage is a voltage corresponding to the difference between the junction voltage of the PN junction element and the voltage between the transistors. If both the PN junction element and the tiger <br/> down di Star has a temperature coefficient substantially the same,
The difference voltage between the junction voltage of the PN junction element and the junction voltage of the transistor does not change due to the temperature change. Therefore, a stable output with respect to temperature can be obtained.
Further, the output voltage can be varied by changing the bias voltage of the bias circuit to change the junction voltage of the transistor. Since the input voltage is obtained by obtaining a current corresponding to the current flowing through the PN junction element, detection at a zero temperature coefficient is possible.

【0013】[0013]

【実施例】図1は本考案の一実施例のブロック図を示
す。同図中、1はバイアス回路で、抵抗R1 ,R2 を直
列に接続してなる。バイアス回路1は抵抗R3 を介して
直流電源2に接続されている。
FIG. 1 is a block diagram showing an embodiment of the present invention. In FIG. 1, reference numeral 1 denotes a bias circuit which is formed by connecting resistors R 1 and R 2 in series. Bias circuit 1 is connected to the DC power source 2 via the resistor R 3.

【0014】Q1 は電流制御用トランジスタで、NPN
トランジスタで構成され、コレクタはPN接合素子とな
るトランジスタQ2 に接続され、ベースはバイアス回路
1を構成する抵抗R1 と抵抗R2 との接続点に接続さ
れ、エミッタは電源2とバイアス回路1との接続点に接
続される。PN接合素子となるトランジスタQ2 はPN
Pトランジスタで構成され、ベースとコレクタとが短絡
するよう結線され、ベースとコレクタとの接続点にトラ
ンジスタQ2 のコレクタが接続され、エミッタはバイア
ス回路1と抵抗R3 との接続点に接続される。トランジ
スタQ1 ,Q2 及びバイアス回路1により基準電圧が生
成され、基準電圧はトランジスタQ1 とトランジスタQ
2 との接続点より取り出され、図3に示すようにトラン
ジスタQ4〜Q13及び抵抗R6 〜R8 よりなるコンパレ
ータ4に供給される。
Q 1 is a current control transistor, which is NPN
Is a transistor, the collector is connected to the transistor Q 2 to which a PN junction element, the base is connected to the connection point between the resistor R 1 which constitutes a bias circuit 1 and the resistor R 2, the emitter power 2 and the bias circuit 1 Is connected to the connection point. Transistor Q 2 which is a PN junction element is PN
Formed of a P transistor, is connected to the base and the collector are short-circuited, the base and collector of the transistor Q 2 to a connection point between the collector connected, the emitter is connected to the connection point of the bias circuit 1 and the resistor R 3 You. The reference voltage is generated by the transistor Q 1, Q 2 and the bias circuit 1, a reference voltage transistor Q 1 and the transistor Q
Taken out from a connection point between 2 and is supplied to a comparator 4 consisting of transistors Q 4 to Q 13 and resistors R 6 to R 8 as shown in FIG.

【0015】3は検出手段でPNPトランジスタQ3
び抵抗R4 よりなる。トランジスタQ3 のエミッタはバ
イアス回路1と抵抗R3 との接続点に接続され、ベース
はトランジスタQ2 のベースに接続されコレクタは抵抗
4 を介してバイアス回路1と電源2との接続点に接続
される。トランジスタQ3 と抵抗R4 との接続点が出力
となり、電源電圧に応じた信号が出力され、コンパレー
タ4に供給される。
Reference numeral 3 denotes a detecting means, which comprises a PNP transistor Q 3 and a resistor R 4 . The emitter of the transistor Q 3 are connected to the connection point of the bias circuit 1 and the resistor R 3, the base collector connected to the base of the transistor Q 2 is through a resistor R 4 to the connection point of the bias circuit 1 and the power supply 2 Connected. Becomes a connection point of the transistor Q 3 and the resistor R 4 is output, a signal corresponding to the power supply voltage is output and supplied to the comparator 4.

【0016】次に回路の動作について説明する。図1に
おいて、電源2の電圧をVCC,抵抗R3 に流れる電流を
1 抵抗R1 に流れる電流をI2 ,抵抗R2 に流れる電
流をI3 とすると、 VCC=R3 1 +R1 2 +R2 3 …(1) で表わされる。また、トランジスタQ1 のベース・エミ
ッタ間電圧をVBE2 とすると、 I3 =VBE2 /R2 …(2) となる。さらに、トランジスタQ1 のベース電流をiB2
とすると、 I2 =I3 +iB2 …(3) ここで、iB3≪I3 とすると I2 ≒I3 …(4) 従って、 VCC=R3 1 +(R1 +R2 )I3 …(5) よって、バイアス回路1に印加される電圧V1 は V1 =VBE2 ・(1+(R1 /R2 ) …(6) また、トランジスタQ1 とトランジスタQ2 及びトラン
ジスタQ1 とトランジスタQ3 のエミッタの接合面積比
をn1 :1,及び1:n2 とすると、基準電圧VS は VS =△VBE+(R1 /R2 )・VBE2 …(7) ただし、△VBEはVBE2 −VBEとする。
Next, the operation of the circuit will be described. In Figure 1, the voltage V CC power source 2, a current flowing through the resistor R 3 I 1 resistor R 1 current flowing through the I 2, the current flowing through the resistor R 2 When I 3, V CC = R 3 I 1 + R 1 I 2 + R 2 I 3 (1) Further, when the base-emitter voltage of the transistor Q 1 and V BE2, a I 3 = V BE2 / R 2 ... (2). In addition, the base current of the transistor Q 1 i B2
I 2 = I 3 + i B2 (3) where i B3 ≪I 3 , I 2 I 3 (4) Therefore, V CC = R 3 I 1 + (R 1 + R 2 ) I 3 (5) Therefore, the voltage V 1 applied to the bias circuit 1 is V 1 = V BE2 · (1+ (R 1 / R 2 )) (6) Further, the transistors Q 1 and Q 2 and the transistor Q 1 a transistor Q 3 of n 1 the junction area ratio of the emitter: 1, and 1: When n 2, the reference voltage V S is V S = △ V bE + ( R 1 / R 2) · V BE2 ... (7) However, ΔV BE is V BE2 −V BE .

【0017】△VBEは一般に △VBE=(KT/q)1n n1 …(8) で表わされる。さらに、VBE2 [0017] △ V BE is represented by the general to △ V BE = (KT / q ) 1n n 1 ... (8). In addition, V BE2

【0018】[0018]

【数1】 (Equation 1)

【0019】で表わされる。ここでVgoはトランジスタ
1 を構成するシリコンのエネルギーバンドギャップに
相当する電圧(約1.2V),Tは温度、T0 と基準と
なる動作温度、VBE0 はT=T0 のときのトランジスタ
1 のベース・エミッタ間電圧である。
## EQU1 ## Here Vgo the voltage corresponding to the energy band gap of silicon in the transistor Q 1 (about 1.2V), T is the temperature, T 0 and serving as a reference operating temperature, transistor when the V BE0 is T = T 0 it is the base-emitter voltage of Q 1.

【0020】[0020]

【数2】 (Equation 2)

【0021】となる。次に IS =I4 +I5 …(11) である。Q1 ,Q3 の接合面積比より I5 =n2 4 …(12) であるので、(11)式はIS =(1+n2 )I4 これよりI4 =IS /(1+n2 ) …(13) I5 =(n2 /(1+n2 ))・Is …(14) となる。よって V0ut =R4 5 =R4 ・(n2 /(1+n2 )) …(15) I2 ,I3 ≪IS に設定すれば IS ≒I1 =I4 +I5 となる。## EQU1 ## Next, I S = I 4 + I 5 (11). From the junction area ratio of Q 1 and Q 3 , I 5 = n 2 I 4 ... (12) Therefore, the equation (11) is given by I S = (1 + n 2 ) I 4, so that I 4 = I S / (1 + n 2) ) (13) I 5 = (n 2 / (1 + n 2 )) · I s (14) Therefore, V 0ut = R 4 I 5 = R 4 · (n 2 / (1 + n 2 )) (15) If I 2 , I 3 ≪I S , then I S ≒ I 1 = I 4 + I 5 .

【0022】これより(15)式は Vout ≒(n2 /(1+n2 ))・R4 ・I1 …(16) (5)式よりFrom this, the equation (15) is obtained by the following equation: V out ≒ (n 2 / (1 + n 2 )) · R 4 · I 1 (16)

【0023】[0023]

【数3】 (Equation 3)

【0024】これよりFrom this

【0025】[0025]

【数4】 (Equation 4)

【0026】(16),(18)式よりFrom equations (16) and (18),

【0027】[0027]

【数5】 (Equation 5)

【0028】コンパレータ4の比較電圧Vinは(7),
(19)式より
[0028] The comparison voltage V in the comparator 4 (7),
From equation (19)

【0029】[0029]

【数6】 (Equation 6)

【0030】VBE2 ,△VBEを書き換るとWhen V BE2 and ΔV BE are rewritten,

【0031】[0031]

【数7】 (Equation 7)

【0032】Vinの温度係数を零にするにはTo make the temperature coefficient of V in zero

【0033】[0033]

【数8】 (Equation 8)

【0034】になる様に設定すれば零温度係数でのVCC
の電圧検出が可能である。また、T=T0 時VOUT
If it is set so that V CC at zero temperature coefficient
Can be detected. When T = T 0 , V OUT is

【0035】[0035]

【数9】 (Equation 9)

【0036】これよりFrom this

【0037】[0037]

【数10】 (Equation 10)

【0038】でありまたVout =VS であるのでAnd V out = V S ,

【0039】[0039]

【数11】 [Equation 11]

【0040】すなわち(26)式を満足するVCCがスレ
ッシホールド電圧となる。図2は本考案の第2の実施例
のブロック図を示す。同図中、図1と同一構成部分には
同一符号を付し、その説明は省略する。
That is, V CC that satisfies the expression (26) becomes the threshold voltage. FIG. 2 shows a block diagram of a second embodiment of the present invention. In the figure, the same components as those of FIG. 1 are denoted by the same reference numerals, and description thereof will be omitted.

【0041】本実施例ではトランジスタQ1 とトランジ
スタQ2 との間に抵抗R5 を設け、抵抗R5 とトランジ
スタQ1 との接続点より基準電圧を得ている。また、抵
抗R11を付加している。
[0041] The resistor R 5 between the transistor Q 1, the transistor Q 2 is provided in this embodiment, it is obtained a reference voltage from the connection point between the resistor R 5 and the transistor Q 1. Also, by adding a resistor R 11.

【0042】このように、抵抗R5 を設けることにより
第1の実施例と同様な効果が得られると共に減電圧特性
を改善することができる。
[0042] Thus, reduced voltage characteristic with the same effect as in the first embodiment can be obtained by providing the resistor R 5 can be improved.

【0043】なお、図4は本考案の第3の実施例の回路
図を示す。同図中、図1,図2と同一構成部分には同一
符号を付し、その説明は省略する。図4に示すように、
バイアス回路1の両端に抵抗R3 ,R9 を設ける構成と
しており、また、検出手段3はPNPトランジスタ
14,PNPトランジスタQ15,抵抗R10により構成さ
れている。
FIG. 4 is a circuit diagram of a third embodiment of the present invention. In the figure, the same components as those in FIGS. 1 and 2 are denoted by the same reference numerals, and description thereof will be omitted. As shown in FIG.
The resistors R 3 and R 9 are provided at both ends of the bias circuit 1, and the detecting means 3 is composed of a PNP transistor Q 14 , a PNP transistor Q 15 and a resistor R 10 .

【0044】このような構成とすることにより、第1の
実施例と同様な効果を奏する。なお、第1〜第3の実施
例でトランジスタの極性を逆にしても構成できる。
With such a configuration, the same effects as in the first embodiment can be obtained. In the first to third embodiments, the configuration can be such that the polarity of the transistor is reversed.

【0045】[0045]

【考案の効果】上述の如く、本考案によれば、PN接合
素子に直列にトランジスタを接続し、PN接合素子と電
流制御用トランジスタの接続点より基準電圧を取り出す
構成とすることにより基準電圧はPN接合素子とトラン
ジスタとの差電圧に応じた電圧となるため、PN接合素
子とトランジスタとが同じ温度係数を持てば温度変化に
対して安定した基準電圧が得られ、また、トランジスタ
のバイアス電圧を変化させることによりPN接合素子と
トランジスタとの差電圧を変化させ出力電圧を自由に設
定することができる。また、PN接合素子に流れる電流
に応じた電流より入力信号を生成しているため、零温度
係数での電源電圧の検出が可能となる等の特長を有す
る。
As described above, according to the present invention, the transistor is connected in series to the PN junction element, and the reference voltage is obtained from the connection point between the PN junction element and the current control transistor. Since the voltage becomes a voltage corresponding to the difference voltage between the PN junction element and the transistor, if the PN junction element and the transistor have the same temperature coefficient, a stable reference voltage with respect to a temperature change can be obtained. The output voltage can be set freely by changing the difference voltage between the PN junction element and the transistor. Further, since the input signal is generated from a current corresponding to the current flowing through the PN junction element, it has a feature that the power supply voltage can be detected at a zero temperature coefficient.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本考案の第1の実施例のブロック図である。FIG. 1 is a block diagram of a first embodiment of the present invention.

【図2】本考案の第2の実施例のブロック図である。FIG. 2 is a block diagram of a second embodiment of the present invention.

【図3】本考案の第2の実施例の回路図である。FIG. 3 is a circuit diagram of a second embodiment of the present invention.

【図4】本考案の第3の実施例のブロック図である。FIG. 4 is a block diagram of a third embodiment of the present invention.

【図5】従来の一例のブロック図である。FIG. 5 is a block diagram of an example of the related art.

【符号の説明】 1 バイアス回路 2 直流電源 3 検出手段 Q1 ,Q2 トランジスタ[Description of Signs] 1 Bias circuit 2 DC power supply 3 Detecting means Q 1 , Q 2 transistor

Claims (1)

(57)【実用新案登録請求の範囲】(57) [Scope of request for utility model registration] 【請求項1】 第1の入力端子に電源電圧に応じた入力
電圧が供給され、第2の入力端子に基準電圧が供給さ
れ、該入力電圧と該基準電圧との比較結果に応じて出力
を反転させる比較手段を有する電圧比較回路において、 前記入力電圧に直列に接続され、前記電源電圧を分圧し
てバイアス電圧を生成するバイアス回路と、 前記バイアス回路で生成された前記バイアス電圧がベー
スに供給され、前記バイアス電圧に応じてエミッタ−コ
レクタ間に所定の電圧を発生するとともに、前記バイア
ス回路で生成された前記バイアス電圧に応じた電流を前
記コレクタから引き込むトランジスタと、 前記トランジスタのコレクタと前記電源電圧との間に接
続されたPN接合素子と、 前記トランジスタのコレクタに引き込まれる電流を検出
し、検出電流に応じた電流を出力する電流制御手段と、 前記電流制御手段の出力電流を電圧に変換し、前記電源
電圧に応じた前記入力電圧を発生する入力電圧生成用抵
抗とを具備し、 前記トランジスタのコレクタと前記PN接合素子との接
続点に前記比較手段の前記第2の入力端子を接続し、前
記電流制御手段と前記入力電圧生成用抵抗との接続点に
前記比較手段の前記第1の入力端子を接続した 構成とし
てなる電圧比較回路。
An input corresponding to a power supply voltage is input to a first input terminal.
Voltage is supplied and the reference voltage is supplied to the second input terminal.
Output according to the comparison result between the input voltage and the reference voltage.
A voltage comparison circuit having a comparison means for inverting the power supply voltage, the voltage comparison circuit being connected in series with the input voltage and dividing the power supply voltage.
Base bias circuit for generating the bias voltage Te, the bias voltage generated by the bias circuit
To the emitter and the emitter-core in accordance with the bias voltage.
A predetermined voltage is generated between the
Current corresponding to the bias voltage generated by the
A transistor drawn from the collector, and a contact between the collector of the transistor and the power supply voltage.
Detects current drawn into the connected PN junction element and the collector of the transistor
Current control means for outputting a current corresponding to the detected current; and converting the output current of the current control means into a voltage,
An input voltage generating resistor for generating the input voltage according to a voltage;
Comprising an anti-city, contact between the collector and the PN junction element of said transistor
Connecting the second input terminal of the comparing means to a continuation point;
At the connection point between the current control means and the input voltage generating resistor.
A voltage comparison circuit configured to connect the first input terminal of the comparison means .
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