JPS6042520Y2 - current limit circuit - Google Patents
current limit circuitInfo
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- JPS6042520Y2 JPS6042520Y2 JP5256181U JP5256181U JPS6042520Y2 JP S6042520 Y2 JPS6042520 Y2 JP S6042520Y2 JP 5256181 U JP5256181 U JP 5256181U JP 5256181 U JP5256181 U JP 5256181U JP S6042520 Y2 JPS6042520 Y2 JP S6042520Y2
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Description
【考案の詳細な説明】
本考案は、負荷をスイッチング制御するための出力トラ
ンジスタに過大な電流が流れて焼損・破壊することを防
ぐための電流制限回路に関する。[Detailed Description of the Invention] The present invention relates to a current limiting circuit for preventing burnout and destruction due to excessive current flowing through an output transistor for controlling switching of a load.
第１図は、先行技術の電気回路図である。FIG. 1 is a prior art electrical circuit diagram.
スイッチＳＷを導通することによって出力トランジスタ
ＴＲｌが導通し、これによって直流電源Ｐから抵抗Ｒ１
、出力トランジスタＴＲ１およびソレノイドなどの負荷
ＲＬに負荷電流が流れる。By making the switch SW conductive, the output transistor TRl becomes conductive, and thereby the DC power supply P is connected to the resistor R1.
, a load current flows through the output transistor TR1 and the load RL such as a solenoid.
この負荷電流が増大すると、抵抗Ｒ１の電圧降下が大き
くなる。As this load current increases, the voltage drop across resistor R1 increases.
この抵抗Ｒ１の電圧降下は、制御トランジスタＴＲ２の
ベース・エミッタ間の電圧である。The voltage drop across this resistor R1 is the voltage between the base and emitter of the control transistor TR2.
したがって過大な電流が流れることによって、制御トラ
ンジスタＴＲ２のベース・エミッタ間の電圧が増大し、
これによって制御トランジスタＴＲ２が導通する。Therefore, as an excessive current flows, the voltage between the base and emitter of the control transistor TR2 increases.
This makes the control transistor TR2 conductive.
したがって出力トランジスタＴＲｌのベースはハイレベ
ルとなり、出力トランジスタＴＲ１が遮断する。Therefore, the base of the output transistor TR1 becomes high level, and the output transistor TR1 is cut off.
このようにして負荷ＲＬおよび出力トランジスタＴＲ１
に過大な電流が流れることが防がれる。In this way, load RL and output transistor TR1
This prevents excessive current from flowing through.
このような先行技術では、抵抗Ｒ１に電流が流れること
によって制御トランジスタＴＲ２のベース・エミッタ間
の電圧を得ているので、この制御トランジスタＴＲ２を
導通して出力トランジスタＴＲＩを遮断するには、その
抵抗Ｒ１の電圧降下が例えば０．７Ｖ以上でなければな
らない。In such prior art, the voltage between the base and emitter of the control transistor TR2 is obtained by current flowing through the resistor R1. Therefore, in order to conduct the control transistor TR2 and cut off the output transistor TRI, the resistor R1 must be turned on. The voltage drop across R1 must be, for example, 0.7V or more.
したがって抵抗Ｒ１の抵抗値は比較的大きくする必要が
ある。Therefore, the resistance value of resistor R1 needs to be relatively large.
このため抵抗Ｒ１の電力損失は大きく、また負荷ＲＬに
印加される電力が低下する。Therefore, the power loss of the resistor R1 is large, and the power applied to the load RL is reduced.
本考案の目的は、電力損失が少なく、しかも負荷に高い
電圧を印加することができる電流制御回路を提供するこ
とである。An object of the present invention is to provide a current control circuit that has low power loss and can apply a high voltage to a load.
本考案は、過負荷時に負荷に流れる電流を制限する電流
制限回路において、
直流電源Ｐに、第１抵抗Ｒ１と、出力トランジスタＴＲ
ｌのエミッタ・コレクタと、負荷ＲＬとを直列に接続し
、
その直流電源Ｐに々第２抵抗ＲＥと第３抵抗ＲＣとを含
む直列回路１とを接続し、
第２抵抗ＲＥと第３抵抗ＲＣとの第１接続点２には、制
御トランジスタＴＲ２のエミッタを接続腰
制御トランジスタＴＲ２のコレクタには第４抵抗Ｒ３の
一方端を接続し、第４抵抗Ｒ３の他方端を第３抵ｙｃの
前記第１接続点２とは反対側に接続し、
第１抵抗Ｒ１と出力トランジスタＴＲ１との第２接続点
３と、制御トランジスタＴＲ２のベースとの間に順方向
にダイオードＤを接続し、制御トランジスタＴＲ２のベ
ースと、第３抵抗ＲＣの前記第１接続点２とは反対側と
の間に第５抵抗ＲＢを接続し、
制御トランジスタＴＲ２のコレクタと第４抵抗Ｒ８との
第３接続点４に、出力トランジスタＴＲｌのベースを接
続したことを特徴とする電流制限回路である。The present invention provides a current limiting circuit that limits the current flowing to the load during overload, which includes a DC power supply P, a first resistor R1, and an output transistor TR.
The emitter-collector of l and the load RL are connected in series, and a series circuit 1 including a second resistor RE and a third resistor RC is connected to the DC power supply P, and the second resistor RE and the third resistor RC are connected in series. The emitter of the control transistor TR2 is connected to the first connection point 2 with RC, and one end of the fourth resistor R3 is connected to the collector of the control transistor TR2, and the other end of the fourth resistor R3 is connected to the third resistor yc. A diode D is connected to the side opposite to the first connection point 2, and is connected in the forward direction between a second connection point 3 between the first resistor R1 and the output transistor TR1 and the base of the control transistor TR2. A fifth resistor RB is connected between the base of the transistor TR2 and the opposite side of the third resistor RC from the first connecting point 2, and a third connecting point 4 between the collector of the control transistor TR2 and the fourth resistor R8. This current limiting circuit is characterized in that the base of the output transistor TRl is connected to the base of the output transistor TRl.
第２図は、本考案の一実施例の電気回路図である。FIG. 2 is an electrical circuit diagram of an embodiment of the present invention.
直流電源Ｐには、第１抵抗Ｒ１、出力トランジスタＴＲ
１、および負荷ＲＬが直列に接続される。The DC power supply P includes a first resistor R1 and an output transistor TR.
1, and a load RL are connected in series.
この直流電源Ｐには、第２抵抗ＲＥおよび第３抵抗ＲＣ
を含む直列回路１が接続される。This DC power supply P includes a second resistor RE and a third resistor RC.
A series circuit 1 including the following is connected.
第２抵抗ＲＥおよび第３抵抗ＲＣの接続点２には、制御
トランジスタＴＲ２および第４抵抗Ｒ３が直列に接続さ
れる。A control transistor TR2 and a fourth resistor R3 are connected in series to a connection point 2 between the second resistor RE and the third resistor RC.
この抵抗Ｒ３には、スイッチＳＷが接続される。A switch SW is connected to this resistor R3.
第１抵抗Ｒ１および出力トランジスタＴＲ１の接続点３
ならびに制御トランジスタＴＲ２のベースの間に、順方
向にダイオードＤが接続される。Connection point 3 between first resistor R1 and output transistor TR1
A diode D is connected in the forward direction between the control transistor TR2 and the base of the control transistor TR2.
制御トランジスタＴＲ２および第４抵稙Ｒ３の接続点４
には、出力トランジスタＴＲ１のベースが接続される。Connection point 4 between control transistor TR2 and fourth resistor R3
is connected to the base of the output transistor TR1.
ダイオードＤと制御トランジスタＴＲ２のベースとの接
続点５には、第５抵抗ＲＢが接続される。A fifth resistor RB is connected to a connection point 5 between the diode D and the base of the control transistor TR2.
スイッチＳＷを導通すると、出力トランジスタＴＲｌの
ベースはローレベルとなり、そのため出力トランジスタ
ＴＲ１が導通する。When the switch SW is turned on, the base of the output transistor TR1 becomes low level, and therefore the output transistor TR1 is turned on.
したがって直流電源Ｐから抵抗Ｒ１および出力トランジ
スタＴＲｌを経て負荷ＲＬに負荷電流が流れる。Therefore, a load current flows from the DC power supply P to the load RL via the resistor R1 and the output transistor TRl.
負荷ＲＬおよび出力トランジスタＴＲ１に大きな電流が
流れると、第１抵抗Ｒ１の電圧降下が増大する。When a large current flows through the load RL and the output transistor TR1, the voltage drop across the first resistor R1 increases.
これによって接続点５したがって制御トランジスタＴＲ
２のベース電圧が降下する。This results in connection point 5 and therefore control transistor TR
2's base voltage drops.
こうして制御トランジスタＴＲ２が導通する。In this way, control transistor TR2 becomes conductive.
そのため接続点４したがって出力トランジスタＴＲｌの
ベース電圧が上昇し、出力トランジスタＴＲｌが遮断す
る。Therefore, the base voltage of the connection point 4 and therefore the output transistor TRl increases, and the output transistor TRl is cut off.
こうして負荷ＲＬおよび出力トランジスタＴＲ１に過大
な電流が流れることが阻止される。In this way, excessive current is prevented from flowing through the load RL and the output transistor TR1.
ダイオードＤおよび制御トランジスタＴＲ２は、例えば
シリコンなどの同一材料から戊り、ダイオードＤの順方
向電圧降下は例えば０．７Ｖであり、制御トランジスタ
ＴＲ２が導通するのに要するベース・エミッタ間電圧Ｖ
ＢＥもまたダイオードＤの順方向電圧降下にほぼ等しい
値０．７■である。The diode D and the control transistor TR2 are made of the same material, such as silicon, and the forward voltage drop of the diode D is, for example, 0.7V, and the base-emitter voltage V required for the control transistor TR2 to conduct.
BE also has a value approximately equal to the forward voltage drop of diode D, 0.7 .
したがって抵抗Ｒ１による電圧降下ＶＲ１が、電源電圧
■Ｐの抵抗ＲＥ、 ＲＣによって分圧された接続点２の
電圧にほぼ等しくなったとき、すなわち第１式が成立す
るとき、制御トランジスタＴＲ２が導通する。Therefore, when the voltage drop VR1 caused by the resistor R1 becomes approximately equal to the voltage at the connection point 2 obtained by dividing the power supply voltage P by the resistors RE and RC, that is, when the first equation holds, the control transistor TR2 becomes conductive. .
ＲＣ
ＶＲ１＝ＶＰｘＲＥ＋Ｒｃ°曲°（１）
したがって抵抗Ｒ１の抵抗値を小さい値、例えば０．１
Ω程度に選ぶことが可能になる。RC VR1=VPxRE+Rc° (1) Therefore, set the resistance value of resistor R1 to a small value, for example 0.1
It becomes possible to select approximately Ω.
そのため抵抗Ｒ１による電力損失が減少し、応じて負荷
ＲＬに直流電源Ｐの高い電圧を印加することが可能にな
る。Therefore, the power loss caused by the resistor R1 is reduced, and accordingly, it becomes possible to apply a high voltage from the DC power supply P to the load RL.
本考案では、トランジスタＴＲ１，ＴＲ２はＮＰＮ形で
あってもよく、このとき電源ＰとダイオードＤとは逆極
性に接続される。In the present invention, the transistors TR1 and TR2 may be of NPN type, and in this case, the power source P and the diode D are connected with opposite polarities.
以上のように本考案によれば、電力損失の抵減された、
しかも負荷に高電圧を印加することが可能な電流制限回
路が実現される。As described above, according to the present invention, power loss is reduced.
Moreover, a current limiting circuit capable of applying a high voltage to the load is realized.
【図面の簡単な説明】
第１図は先行技術の電気回路図、第２図は本考案の一実
施例の電気回路図である。
Ｒ１・・・・・・第１抵抗、ＲＥ・・・・・・第２抵抗
、ＲＣ・・・・・・第３抵抗、Ｒ３・・・・・・第４抵
抗、ＲＢ・・・・・・第５抵抗、ＲＬ−・・・・・負荷
、Ｐ・・・・・・直流電源、ＴＲｌ・・・・・・出力ト
ランジスタ、ＴＲ２・・・・・・制御トランジスタ。BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is an electrical circuit diagram of the prior art, and FIG. 2 is an electrical circuit diagram of an embodiment of the present invention. R1...First resistor, RE...Second resistor, RC...Third resistor, R3...Fourth resistor, RB... - Fifth resistor, RL-...Load, P...DC power supply, TRl...Output transistor, TR2...Control transistor.
Claims (1)
おいて、 直流電源Ｐに、第１抵抗Ｒ１と、出力トランジスタＴＲ
１のエミッタ・コレクタと、負荷ＲＬとを直列に接続し
、 その直流電源Ｐに、第２抵抗ＲＥと第３抵抗ＲＣとを含
む直列回路１とを接続し、 第２抵抗ＲＥと第３抵抗ＲＣとの第１接続点２には、制
御トランジスタＴＲ２のエミッタを接続し、 制御トランジスタＴＲ２のコレクタには第４抵抗Ｒ３の
一方端を接続し、第４抵抗Ｒ５の他方端を第３抵初パＣ
の前記第１接続点２とは反対側に接続し、 第１抵抗Ｒ１と出力トランジスタＴＲ１との第２接続点
３と、制御トランジスタＴＲ２のベースとの間に順方向
にダイオードＤを接続腰 制御トランジスタＴＲ２のベースと、第３抵抗ＲＣの前
記第１接続点２とは反対側との間に第５抵抗ＲＢを接続
し、 制御トランジスタＴＲ２のコレクタと第４抵抗Ｒ３との
第３接続点４に、出力トランジスタＴＲｌのベースを接
続したことを特徴とする電流制限回路。[Claims for Utility Model Registration] In a current limiting circuit that limits the current flowing to a load during overload, a DC power supply P includes a first resistor R1 and an output transistor TR.
The emitter-collector of No. 1 and the load RL are connected in series, and the DC power supply P is connected to a series circuit 1 including a second resistor RE and a third resistor RC. The emitter of the control transistor TR2 is connected to the first connection point 2 with RC, one end of the fourth resistor R3 is connected to the collector of the control transistor TR2, and the other end of the fourth resistor R5 is connected to the third resistor. PaC
A diode D is connected in the forward direction between the second connection point 3 between the first resistor R1 and the output transistor TR1 and the base of the control transistor TR2. A fifth resistor RB is connected between the base of the transistor TR2 and the opposite side of the third resistor RC from the first connecting point 2, and a third connecting point 4 between the collector of the control transistor TR2 and the fourth resistor R3. A current limiting circuit characterized in that the base of the output transistor TRl is connected to the base of the output transistor TRl.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5256181U JPS6042520Y2 (en) | 1981-04-11 | 1981-04-11 | current limit circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5256181U JPS6042520Y2 (en) | 1981-04-11 | 1981-04-11 | current limit circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57166445U JPS57166445U (en) | 1982-10-20 |
| JPS6042520Y2 true JPS6042520Y2 (en) | 1985-12-27 |
Family
ID=29849235
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5256181U Expired JPS6042520Y2 (en) | 1981-04-11 | 1981-04-11 | current limit circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6042520Y2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61234413A (en) * | 1985-04-11 | 1986-10-18 | Mitsubishi Electric Corp | Current limiter |
-
1981
- 1981-04-11 JP JP5256181U patent/JPS6042520Y2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57166445U (en) | 1982-10-20 |
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