JPH05200153A - 遊技機用マイクロプロセッサー - Google Patents
遊技機用マイクロプロセッサーInfo
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- JPH05200153A JPH05200153A JP4129481A JP12948192A JPH05200153A JP H05200153 A JPH05200153 A JP H05200153A JP 4129481 A JP4129481 A JP 4129481A JP 12948192 A JP12948192 A JP 12948192A JP H05200153 A JPH05200153 A JP H05200153A
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- code
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Abstract
(57)【要約】 （修正有）
【目的】 パチンコ遊技機等の制御基板に装着されるマ
イクロプロセッサーにおいて、認証を受けたプログラム
及びデータでないと装置が作動しないように制御するこ
とによりプログラムの改変等の不正行為を防止する。 【構成】 中央処理装置１が比較した結果認証コードが
一致しなかった時にアプリケーションプログラムの実行
アドレスを監視する手段２及びアプリケーションプログ
ラムの実行時間を監視する手段３を作動させると共にア
プリケーションプログラムを実行させ、プログラムが領
域を越えた時又はプログラム実行時間が所定時間経過し
た時に装置の作動を停止させ、認証コードが比較により
一致した時にアプリケーションプログラムを実行させる
ように構成された遊技機用マイクロプロセッサー。
イクロプロセッサーにおいて、認証を受けたプログラム
及びデータでないと装置が作動しないように制御するこ
とによりプログラムの改変等の不正行為を防止する。 【構成】 中央処理装置１が比較した結果認証コードが
一致しなかった時にアプリケーションプログラムの実行
アドレスを監視する手段２及びアプリケーションプログ
ラムの実行時間を監視する手段３を作動させると共にア
プリケーションプログラムを実行させ、プログラムが領
域を越えた時又はプログラム実行時間が所定時間経過し
た時に装置の作動を停止させ、認証コードが比較により
一致した時にアプリケーションプログラムを実行させる
ように構成された遊技機用マイクロプロセッサー。
Description
【０００１】
【産業上の利用分野】本発明は、遊技機械のパチンコ遊
技機、回胴式遊技機、アレンジボール、ジャン球遊技機
等に搭載されその遊技機制御に使用されるアプリケーシ
ョンプログラム（機器制御プログラムやデータ）を起動
するための半導体チップに関するもので、かかる半導体
チップが認定後に法定基準外で作動するようにプログラ
ムが改変されるのを防ぐように構成されたものである。
技機、回胴式遊技機、アレンジボール、ジャン球遊技機
等に搭載されその遊技機制御に使用されるアプリケーシ
ョンプログラム（機器制御プログラムやデータ）を起動
するための半導体チップに関するもので、かかる半導体
チップが認定後に法定基準外で作動するようにプログラ
ムが改変されるのを防ぐように構成されたものである。
【０００２】パチンコ機械等遊技機は、風俗営業法の規
則に基づく国家公安委員会の規則に従い遊技機の認定及
び型式の検定を受けなければ販売することができない製
品であり、マイクロプロセッサーを使用したものも保安
電子通信技術協会の型式試験に合格しなければならず、
この型式認定を受けたものがパチンコホール等で営業に
供することができる仕組みとなっている。
則に基づく国家公安委員会の規則に従い遊技機の認定及
び型式の検定を受けなければ販売することができない製
品であり、マイクロプロセッサーを使用したものも保安
電子通信技術協会の型式試験に合格しなければならず、
この型式認定を受けたものがパチンコホール等で営業に
供することができる仕組みとなっている。
【０００３】しかしながら、型式認定を受けた後にメー
カーや、ホール側にて種々の手段を講じてマイクロプロ
セッサーを改造したり、プログラムを改変して、不正遊
技機として使用されるケースが考えられ、型式認定後の
改造を防止することが今日の課題である。
カーや、ホール側にて種々の手段を講じてマイクロプロ
セッサーを改造したり、プログラムを改変して、不正遊
技機として使用されるケースが考えられ、型式認定後の
改造を防止することが今日の課題である。
【０００４】
【従来技術】従来のこの種の遊技機は、マイクロプロセ
ッサーと一体となった回路を組み、電動役物を連続して
作動させる装置や、電動役物等を電気的にコントロール
するものや、回胴式遊技機において回転する回胴の回転
制御するものなどが知られており、これらの回路では保
安電子通信技術協会の型式試験を合格したものは所定の
確率で、利用者に勝利球を放出するように構成されてい
る。また遊技機の場合は、所定のアドレス領域内にプロ
グラム及びデータを格納することが義務付けられてい
る。
ッサーと一体となった回路を組み、電動役物を連続して
作動させる装置や、電動役物等を電気的にコントロール
するものや、回胴式遊技機において回転する回胴の回転
制御するものなどが知られており、これらの回路では保
安電子通信技術協会の型式試験を合格したものは所定の
確率で、利用者に勝利球を放出するように構成されてい
る。また遊技機の場合は、所定のアドレス領域内にプロ
グラム及びデータを格納することが義務付けられてい
る。
【０００５】
【発明が解決しようとする課題】しかしながら、かかる
従来の回路の場合は、型式認定をとった後に回路内の制
御プログラムやデータを改変した場合には、認定製品と
区別がつきにくく外見だけでは認定製品として取り扱わ
れる可能性が高い。そのためかかる不正を充分に阻止出
来ないといった不都合がある。かかる不正を野放しにす
れば、遊技者が不利益を被ると共に、型式認定製品を取
り扱っている者の信用も毀損されることになり、ひいて
は型式試験を行う意義が薄れてくるおそれがある。そこ
で本発明はかかる従来技術の欠点に鑑みなされたもの
で、遊技機内の不正改造を困難にするための仕組みを設
けると共に、遊技機内のマイクロプロセッサー内にプロ
グラムやデータの改竄等を防止するための機能を持たせ
ることを目的とする。
従来の回路の場合は、型式認定をとった後に回路内の制
御プログラムやデータを改変した場合には、認定製品と
区別がつきにくく外見だけでは認定製品として取り扱わ
れる可能性が高い。そのためかかる不正を充分に阻止出
来ないといった不都合がある。かかる不正を野放しにす
れば、遊技者が不利益を被ると共に、型式認定製品を取
り扱っている者の信用も毀損されることになり、ひいて
は型式試験を行う意義が薄れてくるおそれがある。そこ
で本発明はかかる従来技術の欠点に鑑みなされたもの
で、遊技機内の不正改造を困難にするための仕組みを設
けると共に、遊技機内のマイクロプロセッサー内にプロ
グラムやデータの改竄等を防止するための機能を持たせ
ることを目的とする。
【０００６】
【課題を解決するための手段】すなわち本発明は、所定
の領域に記憶されたアプリケーションプログラム及び該
アプリケーションプログラムから所定のアルゴリズムの
基に暗号化された認証コード等が格納された外部記憶手
段と、前記アプリケーションプログラムから認証コード
を算出するアルゴリズム及び認証コード算出用の単数又
は複数のキーコードが格納された内蔵記憶手段と、前記
外部記憶手段からユーザーデータ等が読み込まれ格納さ
れるアプリケーションプログラム作業用記憶手段と、前
記内蔵記憶手段に格納されたアルゴリズムの一部又は全
部が格納されるシステム制御用記憶手段と、アプリケー
ションプログラムのアドレス領域を走査しこれが外部記
憶手段のデータ格納規定に違反している時に装置の作動
の停止させ、外部記憶手段から入力されるアプリケーシ
ョンプログラムと、内部記憶手段に格納された認証コー
ド算出プログラム及びキーコードから認証コードを算出
すると共に、該認証コードと予め外部記憶手段から読み
込んだ認証コードとを比較する中央処理装置（ＣＰＵ）
とからなり、中央処理装置が比較した結果認証コードが
一致しなかった時にアプリケーションプログラムの実行
アドレスを監視する手段及びアプリケーションプログラ
ムの実行時間を監視する手段を作動させると共にアプリ
ケーションプログラムを実行させ、プログラムが領域を
越えた時又はプログラム実行時間が所定時間経過した時
に装置の作動を停止させ、認証コードが比較により一致
した時にアプリケーションプログラムを実行させるよう
に構成された遊技機用マイクロプロセッサーにより本目
的を達成する。
の領域に記憶されたアプリケーションプログラム及び該
アプリケーションプログラムから所定のアルゴリズムの
基に暗号化された認証コード等が格納された外部記憶手
段と、前記アプリケーションプログラムから認証コード
を算出するアルゴリズム及び認証コード算出用の単数又
は複数のキーコードが格納された内蔵記憶手段と、前記
外部記憶手段からユーザーデータ等が読み込まれ格納さ
れるアプリケーションプログラム作業用記憶手段と、前
記内蔵記憶手段に格納されたアルゴリズムの一部又は全
部が格納されるシステム制御用記憶手段と、アプリケー
ションプログラムのアドレス領域を走査しこれが外部記
憶手段のデータ格納規定に違反している時に装置の作動
の停止させ、外部記憶手段から入力されるアプリケーシ
ョンプログラムと、内部記憶手段に格納された認証コー
ド算出プログラム及びキーコードから認証コードを算出
すると共に、該認証コードと予め外部記憶手段から読み
込んだ認証コードとを比較する中央処理装置（ＣＰＵ）
とからなり、中央処理装置が比較した結果認証コードが
一致しなかった時にアプリケーションプログラムの実行
アドレスを監視する手段及びアプリケーションプログラ
ムの実行時間を監視する手段を作動させると共にアプリ
ケーションプログラムを実行させ、プログラムが領域を
越えた時又はプログラム実行時間が所定時間経過した時
に装置の作動を停止させ、認証コードが比較により一致
した時にアプリケーションプログラムを実行させるよう
に構成された遊技機用マイクロプロセッサーにより本目
的を達成する。
【０００７】尚、本発明にかかる装置では、外部記憶手
段に格納されたアプリケーションプログラムから算出さ
れる認証コードＣを所定の暗号化のキーコードＫを与え
た状態で暗号化する手段として日本電信電話株式会社
が、開発した暗号装置及び暗号方法（通称フィール特許
(特開昭62-109083号、特開昭63-204289号、特開平01-14
7585号)）に基づいて算出し、該暗号化方法を内蔵記憶
手段に格納させておくようにすると良い。暗号か方法は
これらの方法に限定されるものでない。また認証コード
が一致したときに、アプリケーションプログラムの実行
アドレスを監視する手段を作動させ、プログラムが所定
の領域を越えた時に装置の作動を停止するように構成す
ると良い。
段に格納されたアプリケーションプログラムから算出さ
れる認証コードＣを所定の暗号化のキーコードＫを与え
た状態で暗号化する手段として日本電信電話株式会社
が、開発した暗号装置及び暗号方法（通称フィール特許
(特開昭62-109083号、特開昭63-204289号、特開平01-14
7585号)）に基づいて算出し、該暗号化方法を内蔵記憶
手段に格納させておくようにすると良い。暗号か方法は
これらの方法に限定されるものでない。また認証コード
が一致したときに、アプリケーションプログラムの実行
アドレスを監視する手段を作動させ、プログラムが所定
の領域を越えた時に装置の作動を停止するように構成す
ると良い。
【０００８】認証コードの解読、キーコードの解読によ
る認定後のプログラムの改造を防止するためには、以下
に示すように外部記憶手段及び内部記憶手段に次のよう
にキーコードや認証コードを次のように格納し、これら
から認証コードを算出して比較するようにすればより複
雑になり簡単にはプログラムを改変することは難しい。 外部記憶手段に格納された認証コードが、複数のキー
コードK1，K2，K3，…Ki，…Knに基づきそれぞれ算出さ
れた複数のものC1，C2，C3，…Ci，…Cnからなり、内部
記憶手段に格納されたキーコードが前記複数のキーコー
ドK1，K2，K3，…Ki，…Knの内の任意の１つKiであり、
中央処理装置が比較する外部記憶手段の認証コードが、
前記キーコードKiに基づき算出された認証コードCiとす
る。 外部記憶手段に格納された認証コードが、複数の第１
次キーコードK1，K2，K3，…Ki，…，Knに基づきそれぞ
れ算出された複数の第１次認証コードC1，C2，C3，…
Ci，…，Cnと、該第１次認証コードC1，C2，C3，…Ci，
…，Cn及び第２次キーコードKbに基づき算出された第２
次認証コードC20からなり、内部記憶手段に格納された
キーコードが前記複数の第１次キーコードK1，K2，K3，
…Ki，…，Knの内の任意の１つKiと第２次キーコードKb
であり、中央処理装置が比較する外部記憶手段の認証コ
ードが第１次キーコードKiに基づき算出された任意の第
１次認証コードCiと、第２次認証コードC20とする。 外部記憶手段に格納された認証コードが、１つの中間
キーコードK0に基づき算出された中間認証コードC0及び
複数の第１次キーコードK1，K2，K3，…Ki，…，Knに基
づき暗号化された第１次認証コードC1，C2，C3，…Ci，
…，Cnと、該第１次認証コードC1，C2，C3，…Ci，…，
Cn及び第２次キーコードKbに基づき算出された第２次認
証コードC20からなり、内部記憶手段に格納されたキー
コードが中間キーコードK0と、前記複数の第１次キーコ
ードK1，K2，K3，…Ki，…，Knの内の任意の１つKiと、
第２次キーコードKbであり、中央処理装置が比較する外
部記憶手段の認証コードが第１次キーコードKiに基づき
算出された任意の第１次認証コードCiと、第２次認証コ
ードC20とする。
る認定後のプログラムの改造を防止するためには、以下
に示すように外部記憶手段及び内部記憶手段に次のよう
にキーコードや認証コードを次のように格納し、これら
から認証コードを算出して比較するようにすればより複
雑になり簡単にはプログラムを改変することは難しい。 外部記憶手段に格納された認証コードが、複数のキー
コードK1，K2，K3，…Ki，…Knに基づきそれぞれ算出さ
れた複数のものC1，C2，C3，…Ci，…Cnからなり、内部
記憶手段に格納されたキーコードが前記複数のキーコー
ドK1，K2，K3，…Ki，…Knの内の任意の１つKiであり、
中央処理装置が比較する外部記憶手段の認証コードが、
前記キーコードKiに基づき算出された認証コードCiとす
る。 外部記憶手段に格納された認証コードが、複数の第１
次キーコードK1，K2，K3，…Ki，…，Knに基づきそれぞ
れ算出された複数の第１次認証コードC1，C2，C3，…
Ci，…，Cnと、該第１次認証コードC1，C2，C3，…Ci，
…，Cn及び第２次キーコードKbに基づき算出された第２
次認証コードC20からなり、内部記憶手段に格納された
キーコードが前記複数の第１次キーコードK1，K2，K3，
…Ki，…，Knの内の任意の１つKiと第２次キーコードKb
であり、中央処理装置が比較する外部記憶手段の認証コ
ードが第１次キーコードKiに基づき算出された任意の第
１次認証コードCiと、第２次認証コードC20とする。 外部記憶手段に格納された認証コードが、１つの中間
キーコードK0に基づき算出された中間認証コードC0及び
複数の第１次キーコードK1，K2，K3，…Ki，…，Knに基
づき暗号化された第１次認証コードC1，C2，C3，…Ci，
…，Cnと、該第１次認証コードC1，C2，C3，…Ci，…，
Cn及び第２次キーコードKbに基づき算出された第２次認
証コードC20からなり、内部記憶手段に格納されたキー
コードが中間キーコードK0と、前記複数の第１次キーコ
ードK1，K2，K3，…Ki，…，Knの内の任意の１つKiと、
第２次キーコードKbであり、中央処理装置が比較する外
部記憶手段の認証コードが第１次キーコードKiに基づき
算出された任意の第１次認証コードCiと、第２次認証コ
ードC20とする。
【０００９】
【作用】以上述べた構成において、本発明にかかるマイ
クロプロセッサーでは外部記憶手段に記憶されたアプリ
ケーションプログラム（ＡＰと呼ぶ）及び認証コードを
読み込むことにより以下のように装置を制御する。外部
記憶手段に記憶されているデータのパターンとして次の
ようなものがある。 プログラムアドレスの領域が正規及び正規の認証コー
ド有り 外部記憶手段のデータ領域のフォーマット異常あり。 プログラムアドレスの領域が正規及び認証コードなし プログラムアドレスの領域が正規でない及び正規の認
証コード有り プログラムアドレスの領域が正規でない及び正規の認
証コードなし
クロプロセッサーでは外部記憶手段に記憶されたアプリ
ケーションプログラム（ＡＰと呼ぶ）及び認証コードを
読み込むことにより以下のように装置を制御する。外部
記憶手段に記憶されているデータのパターンとして次の
ようなものがある。 プログラムアドレスの領域が正規及び正規の認証コー
ド有り 外部記憶手段のデータ領域のフォーマット異常あり。 プログラムアドレスの領域が正規及び認証コードなし プログラムアドレスの領域が正規でない及び正規の認
証コード有り プログラムアドレスの領域が正規でない及び正規の認
証コードなし
【００１０】これらの外部記憶手段のプログラム管理デ
ータ及び認証コードの一部又は全部は、作業用記憶手段
に格納される。格納されているアプリケーションプログ
ラムのアドレス領域に異常がない場合は、認証コードが
外部記憶手段に格納されているかを確認し、もし認証コ
ードが記録されていない場合や、アドレスにフォーマッ
ト異常がある場合には正規の装置ではないとして停止処
理される。
ータ及び認証コードの一部又は全部は、作業用記憶手段
に格納される。格納されているアプリケーションプログ
ラムのアドレス領域に異常がない場合は、認証コードが
外部記憶手段に格納されているかを確認し、もし認証コ
ードが記録されていない場合や、アドレスにフォーマッ
ト異常がある場合には正規の装置ではないとして停止処
理される。
【００１１】次に認証コードＣを有する場合には、読み
込んだアプリケーションプログラムから正規の型式検査
と同一の方法（内蔵記憶手段に格納されている認証コー
ド算出アルゴリズム及び算出用のキーコードＫ）にて認
証コードｃを算出する。その後算出された認証コードｃ
と外部記憶手段から読み込んだ認証コードＣとを比較
し、読み込んだ認証コードが正規のものか否かを確認す
る。確認した結果、認証コードが正規のものと確認され
た場合には、実行アドレス監視手段を作動させた状態又
は作動させない状態でアプリケーションプログラムを実
行させ、また認証コードが不一致のときには実行時間監
視手段及び実行アドレス監視手段を作動させた状態で、
アプリケーションプログラムを実行させる。
込んだアプリケーションプログラムから正規の型式検査
と同一の方法（内蔵記憶手段に格納されている認証コー
ド算出アルゴリズム及び算出用のキーコードＫ）にて認
証コードｃを算出する。その後算出された認証コードｃ
と外部記憶手段から読み込んだ認証コードＣとを比較
し、読み込んだ認証コードが正規のものか否かを確認す
る。確認した結果、認証コードが正規のものと確認され
た場合には、実行アドレス監視手段を作動させた状態又
は作動させない状態でアプリケーションプログラムを実
行させ、また認証コードが不一致のときには実行時間監
視手段及び実行アドレス監視手段を作動させた状態で、
アプリケーションプログラムを実行させる。
【００１２】認証コード一致の状態でアプリケーション
プログラムを実行させた場合は、アドレス領域を越えて
実行しようとするとき、装置の作動が停止するようにト
ラップするか又はＣＰＵをリセットとし装置を再起動さ
せる。また、認証コード不一致の状態でアプリケーショ
ンプログラムを実行させた場合は、当該アプリケーショ
ンプログラムがアドレス領域を越えて制御しようとする
時又はアプリケーションプログラムの実行開始から所定
時間経過した後は装置の作動を停止するようにトラップ
する。以上のようにして外部記憶手段に格納された〜
などのケースについてプログラムの内容を確認し、装
置を作動させるのである。以下に本発明を図示された実
施例に従って詳細に説明する。
プログラムを実行させた場合は、アドレス領域を越えて
実行しようとするとき、装置の作動が停止するようにト
ラップするか又はＣＰＵをリセットとし装置を再起動さ
せる。また、認証コード不一致の状態でアプリケーショ
ンプログラムを実行させた場合は、当該アプリケーショ
ンプログラムがアドレス領域を越えて制御しようとする
時又はアプリケーションプログラムの実行開始から所定
時間経過した後は装置の作動を停止するようにトラップ
する。以上のようにして外部記憶手段に格納された〜
などのケースについてプログラムの内容を確認し、装
置を作動させるのである。以下に本発明を図示された実
施例に従って詳細に説明する。
【００１３】
【実施例】図１は本発明にかかるマイクロプロセッサー
の実施例の概略を表すブロック図であり、本発明にかか
るマイクロプロセッサーでは、システムバスを介して中
央処理装置１（ＣＰＵ）と接続されたアプリケーション
プログラムの実行アドレスを監視する手段としてのイリ
ーガルアドレストラップジェネレーター２（以下ＩＡＴ
Ｇと呼ぶ）、アプリケーションプログラムの実行時間を
監視する手段としてのブート用ウオッチドッグタイマー
３（以下ＢＷＤＴと呼ぶ）、システム制御作業用記憶手
段としての制御用ワークＲＡＭ４、アプリケーションプ
ログラム作業用記憶手段としてのアプリケーションプロ
グラム用ワークＲＡＭ５、アプリケーションプログラム
用ワークＲＡＭ５をアプリケーションプログラムに対応
させて制限するためのＲＡＭサイズ制限器６、ＣＰＵ１
への入力を切替るためのプログラムメモリーバンク切替
器７及び、ＩＡＴＧ２，ＢＷＤＴ３，制御用ワークＲＡ
Ｍ４及び前記プログラムメモリーバンク切替器７並びに
外部バスゲート８に実行モード（Md）を出すモードコン
トローラ９と、前記プログラムメモリーバンク切替器７
と接続された制御用プログラムが格納された内蔵ＲＯＭ
１０及び外部バスゲート８と、外部バスゲート８及びＣ
ＰＵ１と接続されたプログラムメモリ入出力装置１２と
からなり、前記アプリケーションプログラム用ワークＲ
ＡＭ５がＲＡＭサイズ制限器６と接続された素子Ａと、
素子Ａの外部バスゲート８と接続されたアプリケーショ
ンプログラムや該アプリケーションプログラムの認証コ
ード並びにアプリケーションプログラム用のデータ等が
格納された外部ＲＯＭ１４とからなる。
の実施例の概略を表すブロック図であり、本発明にかか
るマイクロプロセッサーでは、システムバスを介して中
央処理装置１（ＣＰＵ）と接続されたアプリケーション
プログラムの実行アドレスを監視する手段としてのイリ
ーガルアドレストラップジェネレーター２（以下ＩＡＴ
Ｇと呼ぶ）、アプリケーションプログラムの実行時間を
監視する手段としてのブート用ウオッチドッグタイマー
３（以下ＢＷＤＴと呼ぶ）、システム制御作業用記憶手
段としての制御用ワークＲＡＭ４、アプリケーションプ
ログラム作業用記憶手段としてのアプリケーションプロ
グラム用ワークＲＡＭ５、アプリケーションプログラム
用ワークＲＡＭ５をアプリケーションプログラムに対応
させて制限するためのＲＡＭサイズ制限器６、ＣＰＵ１
への入力を切替るためのプログラムメモリーバンク切替
器７及び、ＩＡＴＧ２，ＢＷＤＴ３，制御用ワークＲＡ
Ｍ４及び前記プログラムメモリーバンク切替器７並びに
外部バスゲート８に実行モード（Md）を出すモードコン
トローラ９と、前記プログラムメモリーバンク切替器７
と接続された制御用プログラムが格納された内蔵ＲＯＭ
１０及び外部バスゲート８と、外部バスゲート８及びＣ
ＰＵ１と接続されたプログラムメモリ入出力装置１２と
からなり、前記アプリケーションプログラム用ワークＲ
ＡＭ５がＲＡＭサイズ制限器６と接続された素子Ａと、
素子Ａの外部バスゲート８と接続されたアプリケーショ
ンプログラムや該アプリケーションプログラムの認証コ
ード並びにアプリケーションプログラム用のデータ等が
格納された外部ＲＯＭ１４とからなる。
【００１４】具体的な各手段とＣＰＵ１との接続関係及
びモードコントローラから発せられるモードとの関係は
図２に示す通りであり、アプリケーションプログラムの
実行時間監視用のブート用ウオッチドッグタイマー３
は、図４に示すようにモードコントローラ９からモード
信号が発信された場合に作動され、アプリケーションプ
ログラムの作動時間をカウンタ１６によりカウントを始
め、ＣＰＵ１から与えられた時間（所定時間：１〜２
分）とカウンタ１６の時間とを比較器１８により比較
し、所定時間経過した場合にはＣＰＵ１に対して停止信
号を発信する。
びモードコントローラから発せられるモードとの関係は
図２に示す通りであり、アプリケーションプログラムの
実行時間監視用のブート用ウオッチドッグタイマー３
は、図４に示すようにモードコントローラ９からモード
信号が発信された場合に作動され、アプリケーションプ
ログラムの作動時間をカウンタ１６によりカウントを始
め、ＣＰＵ１から与えられた時間（所定時間：１〜２
分）とカウンタ１６の時間とを比較器１８により比較
し、所定時間経過した場合にはＣＰＵ１に対して停止信
号を発信する。
【００１５】アプリケーションプログラムの実行アドレ
ス監視用のイリーガルアドレストラップジェネレータ２
は、図５に示すようにＣＰＵ１から与えられたアドレス
領域の上限の番地及び下限の番地をそれぞれアドレスレ
ジスタ２０、２１に記憶させておき、モードコントロー
ラ９からモード信号が発信された場合に作動し、ＣＰＵ
１のプログラムの走行アドレスを比較器２３，２４で常
時監視し、いずれかにおいてアドレスを越えた時にＣＰ
Ｕ１に対して停止命令を発信する。
ス監視用のイリーガルアドレストラップジェネレータ２
は、図５に示すようにＣＰＵ１から与えられたアドレス
領域の上限の番地及び下限の番地をそれぞれアドレスレ
ジスタ２０、２１に記憶させておき、モードコントロー
ラ９からモード信号が発信された場合に作動し、ＣＰＵ
１のプログラムの走行アドレスを比較器２３，２４で常
時監視し、いずれかにおいてアドレスを越えた時にＣＰ
Ｕ１に対して停止命令を発信する。
【００１６】内蔵ＲＯＭ１０には、型式の認証における
アプリケーションプログラムの認証コード（期待値）を
算出するためのアルゴリズム及び算出のためのキーコー
ドが格納されており、このキーコード及びアルゴリズム
は認証機関が実際に使用するものと同一のものを用い
る。また、外部ＲＯＭ１４から読み込まれるアプリケー
ションプログラムのアドレス領域に関するデータ及び認
証コードの有無により作動を停止させるためにＲＯＭ１
０には制御プログラムが格納されている。
アプリケーションプログラムの認証コード（期待値）を
算出するためのアルゴリズム及び算出のためのキーコー
ドが格納されており、このキーコード及びアルゴリズム
は認証機関が実際に使用するものと同一のものを用い
る。また、外部ＲＯＭ１４から読み込まれるアプリケー
ションプログラムのアドレス領域に関するデータ及び認
証コードの有無により作動を停止させるためにＲＯＭ１
０には制御プログラムが格納されている。
【００１７】プログラムメモリ入出力装置１２は、主に
外部ＲＯＭ１４に格納されたアプリケーションプログラ
ムメモリを外部Ｉ／Ｏとして読み取るものであり、本実
施例ではその他の格納されたデータとして認証コード、
ＲＡＭサイズデータ、資源管理データが含まれる。
外部ＲＯＭ１４に格納されたアプリケーションプログラ
ムメモリを外部Ｉ／Ｏとして読み取るものであり、本実
施例ではその他の格納されたデータとして認証コード、
ＲＡＭサイズデータ、資源管理データが含まれる。
【００１８】以上述べた構成において、本発明にかかる
マイクロプロセッサーではＣＰＵ１からの指示によりモ
ードコントローラ９がモードを出し制御用ワークＲＡＭ
４を使用可能状態とし、内蔵ＲＯＭ１０から型式認証コ
ード（期待値）を算出するためのアルゴリズム及び（単
数又は複数の）キーコード並びに認証コードの有無又は
アプリケーションプログラムアドレス領域の範囲内か否
かで装置を停止するためのプログラムがＣＰＵ１に読み
込まれる。
マイクロプロセッサーではＣＰＵ１からの指示によりモ
ードコントローラ９がモードを出し制御用ワークＲＡＭ
４を使用可能状態とし、内蔵ＲＯＭ１０から型式認証コ
ード（期待値）を算出するためのアルゴリズム及び（単
数又は複数の）キーコード並びに認証コードの有無又は
アプリケーションプログラムアドレス領域の範囲内か否
かで装置を停止するためのプログラムがＣＰＵ１に読み
込まれる。
【００１９】かかる後、ＣＰＵ１からの指示によりモー
ドコントローラ９が、プログラムメモリーバンク切替器
７に対するモードを切替え、外部バスゲート８及び入出
力装置１２を介して外部ＲＯＭ１４からＲＡＭサイズ等
の資源管理データ及び認証コードを読み込み、ＣＰＵ１
の指示によりモードコントローラ９がＲＡＭサイズ制限
器６を所定のサイズに切替える。そしてアプリケーショ
ンプログラムのユーザーワークデータは、アプリケーシ
ョンプログラムワーク用ＲＡＭ５、また認証コードはＣ
ＰＵ１のメモリーに格納される。ちなみにパチンコ用は
２５６バイトでパチスロ用は５１２バイトと規定されて
いる。
ドコントローラ９が、プログラムメモリーバンク切替器
７に対するモードを切替え、外部バスゲート８及び入出
力装置１２を介して外部ＲＯＭ１４からＲＡＭサイズ等
の資源管理データ及び認証コードを読み込み、ＣＰＵ１
の指示によりモードコントローラ９がＲＡＭサイズ制限
器６を所定のサイズに切替える。そしてアプリケーショ
ンプログラムのユーザーワークデータは、アプリケーシ
ョンプログラムワーク用ＲＡＭ５、また認証コードはＣ
ＰＵ１のメモリーに格納される。ちなみにパチンコ用は
２５６バイトでパチスロ用は５１２バイトと規定されて
いる。
【００２０】また一方でＣＰＵ１はＲＯＭ１４の全デー
タを読み込んで、アドレス走査を行い、プログラムのア
ドレス領域が所定のものよりも大きいか否か、資源管理
データ以外の認証コードデータの有無についてもチェッ
クしており、プログラムアドレス領域が規定外の時又は
認証コードが格納されていない場合には自動的に装置の
停止指令を出す。さらにＣＰＵ１は走査の結果からデー
タアドレス領域を確認し、そのセレクトデータをメモリ
ーする。
タを読み込んで、アドレス走査を行い、プログラムのア
ドレス領域が所定のものよりも大きいか否か、資源管理
データ以外の認証コードデータの有無についてもチェッ
クしており、プログラムアドレス領域が規定外の時又は
認証コードが格納されていない場合には自動的に装置の
停止指令を出す。さらにＣＰＵ１は走査の結果からデー
タアドレス領域を確認し、そのセレクトデータをメモリ
ーする。
【００２１】資源管理データ及び認証コードデータの有
無のチェックをクリアした場合には、モードが切り替わ
り、外部ＲＯＭ１４に格納されたアプリケーションプロ
グラムを含む全データと、内蔵ＲＯＭ１０に格納された
認証コード算出用のアルゴリズムと、内蔵ＲＯＭ１０に
格納されたキーコードが読み込まれ、アプリケーション
プログラムの認証コードが算出される。
無のチェックをクリアした場合には、モードが切り替わ
り、外部ＲＯＭ１４に格納されたアプリケーションプロ
グラムを含む全データと、内蔵ＲＯＭ１０に格納された
認証コード算出用のアルゴリズムと、内蔵ＲＯＭ１０に
格納されたキーコードが読み込まれ、アプリケーション
プログラムの認証コードが算出される。
【００２２】算出された認証コードと、外部ＲＯＭ１４
から読み込んだ認証コードとはＣＰＵ１により照合さ
れ、照合の結果一致する場合は装置のモードを外部バス
８、切替器７、外部ＲＯＭに切替えてアプリケーション
プログラム実行モードに移行させる。また照合の結果が
不一致の場合には、実行アドレスのＩＡＴＧ２のアドレ
スのレジスタ２０，２１に上限及び下限に関するデータ
を与えた後にこれを作動させると共にＢＷＤＴ３にプロ
グラムの実行時間に関するデータをカウンタ１６に与え
てこれを作動させ、さらにアプリケーションプログラム
を実行させる。
から読み込んだ認証コードとはＣＰＵ１により照合さ
れ、照合の結果一致する場合は装置のモードを外部バス
８、切替器７、外部ＲＯＭに切替えてアプリケーション
プログラム実行モードに移行させる。また照合の結果が
不一致の場合には、実行アドレスのＩＡＴＧ２のアドレ
スのレジスタ２０，２１に上限及び下限に関するデータ
を与えた後にこれを作動させると共にＢＷＤＴ３にプロ
グラムの実行時間に関するデータをカウンタ１６に与え
てこれを作動させ、さらにアプリケーションプログラム
を実行させる。
【００２３】このアプリケーションプログラムが認証コ
ード不適合のものであることから、ＩＡＴＧ２及びＢＷ
ＤＴ３は常時プログラムの実行状態を監視しており、ア
プリケーションプログラムが作業領域を越えてプログラ
ムを実行しようとする時及び設定された時間を越えてプ
ログラムを実行しようとする時に装置の停止指令がＣＰ
Ｕ１に対し発せられ、装置は停止される。尚、本実施例
では正規に認証されたアプリケーションプログラムでも
ごくたまにアドレス領域を越えて作動する不正プログラ
ムがある。かかるプログラムは、たとえ正規のものとは
いえ、不正プログラムであることからアプリケーション
プログラム移行に際して予め走査したアドレス領域をア
ドレスレジスタ２０，２１に記憶させた状態でＩＡＴＧ
２を作動させている。
ード不適合のものであることから、ＩＡＴＧ２及びＢＷ
ＤＴ３は常時プログラムの実行状態を監視しており、ア
プリケーションプログラムが作業領域を越えてプログラ
ムを実行しようとする時及び設定された時間を越えてプ
ログラムを実行しようとする時に装置の停止指令がＣＰ
Ｕ１に対し発せられ、装置は停止される。尚、本実施例
では正規に認証されたアプリケーションプログラムでも
ごくたまにアドレス領域を越えて作動する不正プログラ
ムがある。かかるプログラムは、たとえ正規のものとは
いえ、不正プログラムであることからアプリケーション
プログラム移行に際して予め走査したアドレス領域をア
ドレスレジスタ２０，２１に記憶させた状態でＩＡＴＧ
２を作動させている。
【００２４】外部ＲＯＭへの認証コードの入力及び外部
ＲＯＭに入力されたアプリケーションプログラム及び認
証コードに基づく本実施例にかかるマイクロプロセッサ
ーによる認証コードの整合性の判断は、図６に示された
ようなブッロク図のように行われる。すなわち、認証コ
ード（セキュリティーコード）発行機Ｂ、外部ＲＯＭ１
４とのあいだにおいて、発行機Ｂには、予め入力された
フィール８の暗号化プログラム及び暗号化するためのキ
ーコードＫが入力されており、外部ＲＯＭ１４が接続さ
れた時点において、アプリケーションプログラムを走査
しながらキーコードＫに基づき認証コードＣが算出さ
れ、その算出された認証コードＣが外部ＲＯＭ１４に書
き込まれ、検査済み外部ＲＯＭ１４ができあがる。
ＲＯＭに入力されたアプリケーションプログラム及び認
証コードに基づく本実施例にかかるマイクロプロセッサ
ーによる認証コードの整合性の判断は、図６に示された
ようなブッロク図のように行われる。すなわち、認証コ
ード（セキュリティーコード）発行機Ｂ、外部ＲＯＭ１
４とのあいだにおいて、発行機Ｂには、予め入力された
フィール８の暗号化プログラム及び暗号化するためのキ
ーコードＫが入力されており、外部ＲＯＭ１４が接続さ
れた時点において、アプリケーションプログラムを走査
しながらキーコードＫに基づき認証コードＣが算出さ
れ、その算出された認証コードＣが外部ＲＯＭ１４に書
き込まれ、検査済み外部ＲＯＭ１４ができあがる。
【００２５】完成した外部ＲＯＭ１４は、実際に遊技機
に装着して作動させる場合は、プロセッサー（素子）Ａ
に接続される。外部ＲＯＭ１４が接続された場合にプロ
セッサーＡは、その内部ＲＯＭ１０に記憶された発行機
Ｂと同じキーコードＫ及び暗号化プログラムに基づき、
アプリケーションプログラムを走査して認証コードｃを
算出する。そして、外部ＲＯＭ１４に記憶された認証コ
ードＣとプロセッサーＡで算出した認証コードｃとを比
較して一致した時にはアプリケーションプログラムプロ
グラムを実行させ、また一致しなかった時にはアプリケ
ーションプログラムプログラムを実行させないで停止さ
せる。尚、認証コードの発行システム及び認証コードの
算出・比較システムは図８にしめされたものに限定され
るのではなく、図９、図10、図11に示される方式で行う
とより解読が難しくなる。以下にそれぞれの発行システ
ム、比較システムについて説明する。
に装着して作動させる場合は、プロセッサー（素子）Ａ
に接続される。外部ＲＯＭ１４が接続された場合にプロ
セッサーＡは、その内部ＲＯＭ１０に記憶された発行機
Ｂと同じキーコードＫ及び暗号化プログラムに基づき、
アプリケーションプログラムを走査して認証コードｃを
算出する。そして、外部ＲＯＭ１４に記憶された認証コ
ードＣとプロセッサーＡで算出した認証コードｃとを比
較して一致した時にはアプリケーションプログラムプロ
グラムを実行させ、また一致しなかった時にはアプリケ
ーションプログラムプログラムを実行させないで停止さ
せる。尚、認証コードの発行システム及び認証コードの
算出・比較システムは図８にしめされたものに限定され
るのではなく、図９、図10、図11に示される方式で行う
とより解読が難しくなる。以下にそれぞれの発行システ
ム、比較システムについて説明する。
【００２６】図７に示すものは、第２実施例を示すもの
で、発行機Ｂには複数の第１次認証キーコードK1、K2、
K3、…Ki、Kn及び暗号化プログラムが入力されており、
外部ＲＯＭ１４を接続した場合にそれぞれのキーコード
に基づきアプリケーションプログラムを走査して認証コ
ードC1、C2、C3、…Ci、Cnを算出し、これらを外部ＲＯ
Ｍ１４に書き込むことにより、検査済み外部ＲＯＭが出
来上がる。この外部ＲＯＭ１４をプロセッサーＡに接続
した時に、プロセッサーには予め所定のキーコードKi及
び暗号化プログラムが入力されており、このキーコード
Kiに基づきアプリケーションプログラムを走査して認証
コードciを算出し、これがｉ番目に記憶された認証コー
ドCiと一致しているか否か比較され、前述同様に一致し
ている場合はアプリケーションプログラムを実行させ、
一致していない場合にはアプリケーションプログラムを
実行させずに停止させる。
で、発行機Ｂには複数の第１次認証キーコードK1、K2、
K3、…Ki、Kn及び暗号化プログラムが入力されており、
外部ＲＯＭ１４を接続した場合にそれぞれのキーコード
に基づきアプリケーションプログラムを走査して認証コ
ードC1、C2、C3、…Ci、Cnを算出し、これらを外部ＲＯ
Ｍ１４に書き込むことにより、検査済み外部ＲＯＭが出
来上がる。この外部ＲＯＭ１４をプロセッサーＡに接続
した時に、プロセッサーには予め所定のキーコードKi及
び暗号化プログラムが入力されており、このキーコード
Kiに基づきアプリケーションプログラムを走査して認証
コードciを算出し、これがｉ番目に記憶された認証コー
ドCiと一致しているか否か比較され、前述同様に一致し
ている場合はアプリケーションプログラムを実行させ、
一致していない場合にはアプリケーションプログラムを
実行させずに停止させる。
【００２７】図９に示すものは第３実施例を示すもの
で、発行機Ｂには複数の第１次認証キーコードK1、K2、
K3、…Ki、Kn、第２次認証キーコードKb及び暗号化プロ
グラムが入力されており、外部ＲＯＭ１４を接続した場
合にそれぞれのキーコードに基づきアプリケーションプ
ログラムを走査して認証コードC1、C2、C3、…Ci、Cnを
算出し、これらを外部ＲＯＭ１４に書き込み、さらに書
き込んだ認証コードC1、C2、C3、…Ci、Cnを走査しなが
ら、キーコードKbに基づき第２次認証コードC20を算出
し、第２次認証コードC20を外部ＲＯＭ１４に書き込む
ことにより検査済み外部ＲＯＭが出来上がる。このこの
外部ＲＯＭ１４をプロセッサーＡに接続した時に、プロ
セッサーには予め第１次認証キーコードの一つKi、第２
次認証キーコードKb及び暗号化プログラムが入力されて
おり、第１次認証キーコードKiに基づきアプリケーショ
ンプログラムを走査して第１次認証コードciを算出する
と共に第２次認証キーコードKbに基づき外部ＲＯＭ１４
に書き込まれた第１次認証コードC1、C2、C3、…Ci、Cn
を走査して第２次認証キーコードc20を算出する。そし
て書き込まれたｉ番目の第１次認証コードCiと算出した
第１次認証コードciおよび書き込まれた第２次認証コー
ドC20と算出した第２次認証コードc20とを比較していず
れもが一致した場合にアプリケーションプログラムを実
行させ、それ以外の時に実行させないで停止させる。
で、発行機Ｂには複数の第１次認証キーコードK1、K2、
K3、…Ki、Kn、第２次認証キーコードKb及び暗号化プロ
グラムが入力されており、外部ＲＯＭ１４を接続した場
合にそれぞれのキーコードに基づきアプリケーションプ
ログラムを走査して認証コードC1、C2、C3、…Ci、Cnを
算出し、これらを外部ＲＯＭ１４に書き込み、さらに書
き込んだ認証コードC1、C2、C3、…Ci、Cnを走査しなが
ら、キーコードKbに基づき第２次認証コードC20を算出
し、第２次認証コードC20を外部ＲＯＭ１４に書き込む
ことにより検査済み外部ＲＯＭが出来上がる。このこの
外部ＲＯＭ１４をプロセッサーＡに接続した時に、プロ
セッサーには予め第１次認証キーコードの一つKi、第２
次認証キーコードKb及び暗号化プログラムが入力されて
おり、第１次認証キーコードKiに基づきアプリケーショ
ンプログラムを走査して第１次認証コードciを算出する
と共に第２次認証キーコードKbに基づき外部ＲＯＭ１４
に書き込まれた第１次認証コードC1、C2、C3、…Ci、Cn
を走査して第２次認証キーコードc20を算出する。そし
て書き込まれたｉ番目の第１次認証コードCiと算出した
第１次認証コードciおよび書き込まれた第２次認証コー
ドC20と算出した第２次認証コードc20とを比較していず
れもが一致した場合にアプリケーションプログラムを実
行させ、それ以外の時に実行させないで停止させる。
【００２８】図９に示すものは第４実施例を示すもの
で、発行機Ｂには複数の第１次中間キーコードK0と、該
中間キーコードK0に基づき中間認証コードC0を算出する
プログラムと、算出された中間認証コードC0の暗号化を
行うための第１次キーコードK1、K2、K3、…Ki、Knと、
算出された第１次認証コードC1、C2、C3、…Ci、Cnを走
査して暗号化するための第２次認証キーコードKbとが入
力されており、外部ＲＯＭ１４を接続した場合にまずア
プリケーションプログラムを走査しながら中間認証コー
ドC0を算出し、算出された中間認証コードC0と第１次認
証キーコードK1、K2、K3、…Ki、Knに基づき暗号化して
第１次認証コードC1、C2、C3、…Ci、Cnを算出し、これ
らを外部ＲＯＭ１４に書き込むと共に外部ＲＯＭ１４に
書き込まれた第１次認証コードC1、C2、C3、…Ci、Cnを
走査しながら第２次認証キーコードKbに基づき認証コー
ドC20を算出して外部ＲＯＭ１７４に書き込むことによ
り検査済み外部ＲＯＭが出来上がる。このこの外部ＲＯ
Ｍ１４をプロセッサーＡに接続した時に、プロセッサー
Ａには予め第１次認証中間キーコードK0、第１次認証キ
ーコードKi及び第２次認証キーコードKb並びに暗号化プ
ログラムが入力されており、第１次中間認証キーコード
K0に基づきアプリケーションプログラムを走査して第１
次認証コードc0を算出し、さらに第１次認証キーコード
Kiに基づき暗号化して第１次認証コードciを算出する。
次に第２次認証キーコードKbに基づき外部ＲＯＭ１４に
書き込まれた第１次認証コードC1、C2、C3、…Ci、Cnを
走査することにより第２次認証コードc20を算出する。
そして第１次認証コードと第２次認証コードとが一致し
ている場合に限り、アプリケーションプログラムを実行
させ、それ以外の時にはプログラムを実行させることな
く停止させる。
で、発行機Ｂには複数の第１次中間キーコードK0と、該
中間キーコードK0に基づき中間認証コードC0を算出する
プログラムと、算出された中間認証コードC0の暗号化を
行うための第１次キーコードK1、K2、K3、…Ki、Knと、
算出された第１次認証コードC1、C2、C3、…Ci、Cnを走
査して暗号化するための第２次認証キーコードKbとが入
力されており、外部ＲＯＭ１４を接続した場合にまずア
プリケーションプログラムを走査しながら中間認証コー
ドC0を算出し、算出された中間認証コードC0と第１次認
証キーコードK1、K2、K3、…Ki、Knに基づき暗号化して
第１次認証コードC1、C2、C3、…Ci、Cnを算出し、これ
らを外部ＲＯＭ１４に書き込むと共に外部ＲＯＭ１４に
書き込まれた第１次認証コードC1、C2、C3、…Ci、Cnを
走査しながら第２次認証キーコードKbに基づき認証コー
ドC20を算出して外部ＲＯＭ１７４に書き込むことによ
り検査済み外部ＲＯＭが出来上がる。このこの外部ＲＯ
Ｍ１４をプロセッサーＡに接続した時に、プロセッサー
Ａには予め第１次認証中間キーコードK0、第１次認証キ
ーコードKi及び第２次認証キーコードKb並びに暗号化プ
ログラムが入力されており、第１次中間認証キーコード
K0に基づきアプリケーションプログラムを走査して第１
次認証コードc0を算出し、さらに第１次認証キーコード
Kiに基づき暗号化して第１次認証コードciを算出する。
次に第２次認証キーコードKbに基づき外部ＲＯＭ１４に
書き込まれた第１次認証コードC1、C2、C3、…Ci、Cnを
走査することにより第２次認証コードc20を算出する。
そして第１次認証コードと第２次認証コードとが一致し
ている場合に限り、アプリケーションプログラムを実行
させ、それ以外の時にはプログラムを実行させることな
く停止させる。
【００２９】図６〜図９に示したものの暗号化の意義に
ついて説明する。 図６（第１実施例）のものは、暗号化のキーコードが
一つであり、これに基づいて所定のアルゴリズムにて認
証コードを暗号化しているが、プロセッサーのキーコー
ドが解読された場合にはキーコードを変更することが必
要であり、その場合にはユーザーの全てのＲＯＭを変更
する必要性が生じる。 図７（第２実施例）のものは、暗号化のキーコードが
複数（ｎ）あり、プロセッサーに使用するキーコードを
任意の１つとしている。このため、一つキーコードが解
読されたとしても、全てのキーコードを解読したことに
はならず、これに一致するようにプログラムを改変する
ことは難しい。 図８（第３実施例）のものは、キーコードを複数用い
て暗号化し、第１次認証コードに基づき第２次認証コー
ドを算出するように構成しているために全てのキーコー
ドを解読すること、かつ解読したキーコードから認証番
号が一致するようにプログラムを改変することは非常に
難しくなる。しかし、発行機で認証コードを作成するた
めにｎ回暗号化することになり、暗号化に時間がかかり
過ぎる。 図９(第４実施例）に示すものは、暗証化に時間がか
かりすぎないように為されたもので、第１実施例の場合
とほぼ同様の時間で認証コードを算出することができ、
かつ第２、第３実施例のようにキーコードの解読やプロ
グラムの改変が難しいものとなる。次に認証コード作成
のアルゴリズム（１６ビット）について簡単に説明す
る。
ついて説明する。 図６（第１実施例）のものは、暗号化のキーコードが
一つであり、これに基づいて所定のアルゴリズムにて認
証コードを暗号化しているが、プロセッサーのキーコー
ドが解読された場合にはキーコードを変更することが必
要であり、その場合にはユーザーの全てのＲＯＭを変更
する必要性が生じる。 図７（第２実施例）のものは、暗号化のキーコードが
複数（ｎ）あり、プロセッサーに使用するキーコードを
任意の１つとしている。このため、一つキーコードが解
読されたとしても、全てのキーコードを解読したことに
はならず、これに一致するようにプログラムを改変する
ことは難しい。 図８（第３実施例）のものは、キーコードを複数用い
て暗号化し、第１次認証コードに基づき第２次認証コー
ドを算出するように構成しているために全てのキーコー
ドを解読すること、かつ解読したキーコードから認証番
号が一致するようにプログラムを改変することは非常に
難しくなる。しかし、発行機で認証コードを作成するた
めにｎ回暗号化することになり、暗号化に時間がかかり
過ぎる。 図９(第４実施例）に示すものは、暗証化に時間がか
かりすぎないように為されたもので、第１実施例の場合
とほぼ同様の時間で認証コードを算出することができ、
かつ第２、第３実施例のようにキーコードの解読やプロ
グラムの改変が難しいものとなる。次に認証コード作成
のアルゴリズム（１６ビット）について簡単に説明す
る。
【００３０】（認証コード作成アルゴリズム１）図10に
示すように外部ＲＯＭ１４に格納されたユーザーエリア
及び制御エリアの各アドレスの１６ビットのデータを左
右の８ビットづつのデータ8Ai，8Biに拡散し、図６に示
すようにアドレスの若い方から順に走査し直前の認証コ
ード8A"i-1及び8B"i-1（初期値：格納されたキーコー
ド）をそれぞれ与えた状態で８ビットの認証コード8
A'i，8B'iを算出する。さらに算出した一方の８ビット
のデータ（例8A'i）を他方で算出された８ビットデータ
（例8B'i）をキーコードとして与えて認証コード8A"i，
8B"iを算出する。ここで得られた認証コード8A"i，8B"i
を次に走査した８ビットのデータ8Ai+1，8Bi+1を前述の
ようにデータ拡散のためのキーコードとして用い順次拡
散し、最終的に算出された左右の８ビットデータ8A"n，
8B"nを融合して１６ビットのデータとして最終認証コー
ドとする。
示すように外部ＲＯＭ１４に格納されたユーザーエリア
及び制御エリアの各アドレスの１６ビットのデータを左
右の８ビットづつのデータ8Ai，8Biに拡散し、図６に示
すようにアドレスの若い方から順に走査し直前の認証コ
ード8A"i-1及び8B"i-1（初期値：格納されたキーコー
ド）をそれぞれ与えた状態で８ビットの認証コード8
A'i，8B'iを算出する。さらに算出した一方の８ビット
のデータ（例8A'i）を他方で算出された８ビットデータ
（例8B'i）をキーコードとして与えて認証コード8A"i，
8B"iを算出する。ここで得られた認証コード8A"i，8B"i
を次に走査した８ビットのデータ8Ai+1，8Bi+1を前述の
ようにデータ拡散のためのキーコードとして用い順次拡
散し、最終的に算出された左右の８ビットデータ8A"n，
8B"nを融合して１６ビットのデータとして最終認証コー
ドとする。
【００３１】（認証コードアルゴリズム２）図12に示す
ように外部ＲＯＭ１４に格納されたユーザーエリア及び
制御エリアの各アドレスの１６ビットのデータを左右の
８ビットづつのデータ8Ai，8Biに拡散し、アドレスの若
い方から順に走査しキーコードＫを与えた状態でフィー
ル８にかけ認証コード8'Ai，8'Biを算出し、これらに次
のアドレスの8Ai+1，8Bi+1のデータを排他的論理和（Ｅ
Ｘ−ＯＲと呼ぶ）回路を通して拡散し、再びキーコード
Ｋを与えた状態でフィール８にかけ認証コード8'Ai+1，
8'Bi+1を算出する操作を繰り返すことにより認証コード
8'An，8'Bn算出する。そして最後に8'An，8'Bnで得られ
た値にそれぞれ8'An又は8'Bnをキーコードとしてフィー
ル８にかけ、認証コード8"An，8"Bnを得る。
ように外部ＲＯＭ１４に格納されたユーザーエリア及び
制御エリアの各アドレスの１６ビットのデータを左右の
８ビットづつのデータ8Ai，8Biに拡散し、アドレスの若
い方から順に走査しキーコードＫを与えた状態でフィー
ル８にかけ認証コード8'Ai，8'Biを算出し、これらに次
のアドレスの8Ai+1，8Bi+1のデータを排他的論理和（Ｅ
Ｘ−ＯＲと呼ぶ）回路を通して拡散し、再びキーコード
Ｋを与えた状態でフィール８にかけ認証コード8'Ai+1，
8'Bi+1を算出する操作を繰り返すことにより認証コード
8'An，8'Bn算出する。そして最後に8'An，8'Bnで得られ
た値にそれぞれ8'An又は8'Bnをキーコードとしてフィー
ル８にかけ、認証コード8"An，8"Bnを得る。
【００３２】（認証コードアルゴリズム３（８ビッ
ト））８ビットの認証コードのアルゴリズムは図11に示
すように、初期値０とした状態で８ビットのデータ81を
入力し、ＥＸ−ＯＲ回路を通して8'1と拡散した後に所
定のキーコードを与えた状態で、認証コード8"1を算出
する。得られた認証コードを次々にデータ拡散のための
ＥＸ−ＯＲ回路に入力し、認証コードを算出して、最終
的に得られた認証コード8"nを認証コードとする。
ト））８ビットの認証コードのアルゴリズムは図11に示
すように、初期値０とした状態で８ビットのデータ81を
入力し、ＥＸ−ＯＲ回路を通して8'1と拡散した後に所
定のキーコードを与えた状態で、認証コード8"1を算出
する。得られた認証コードを次々にデータ拡散のための
ＥＸ−ＯＲ回路に入力し、認証コードを算出して、最終
的に得られた認証コード8"nを認証コードとする。
【００３３】（暗号化アルゴリズム）暗号化アルゴリズ
ムは図12に示すように、暗号化したいデータ例えば8
An，8Bnに所定のキーコードＫを与えた状態でフィール
８にかけ認証コード8'An，8'Bnを算出し、さらにこれら
データ8'An，8'Bnにキーコードとして8'An又は8'Bnをを
与えた状態でさらにフィール８にかけ認証コード8"An，
8"Bnを得る。
ムは図12に示すように、暗号化したいデータ例えば8
An，8Bnに所定のキーコードＫを与えた状態でフィール
８にかけ認証コード8'An，8'Bnを算出し、さらにこれら
データ8'An，8'Bnにキーコードとして8'An又は8'Bnをを
与えた状態でさらにフィール８にかけ認証コード8"An，
8"Bnを得る。
【００３４】以上のように型式認定で算出される認識コ
ードは、各アドレスのデータを順次暗号化しながら最終
データの暗号コードを認証コードとするようになってい
るので、各アドレスの殆どのデータが適合していたとし
ても、１ヵ所のデータに間違いがあれば算出される認証
コードが異なることになるため、プログラムの改変は極
めて難しいものとなる。
ードは、各アドレスのデータを順次暗号化しながら最終
データの暗号コードを認証コードとするようになってい
るので、各アドレスの殆どのデータが適合していたとし
ても、１ヵ所のデータに間違いがあれば算出される認証
コードが異なることになるため、プログラムの改変は極
めて難しいものとなる。
【００３５】
【効果】以上述べたように本発明にかかる遊技機用のマ
イクロプロセッサーは、型式認定を受けたアプリケーシ
ョンプログラムに対して初めてそのプログラム及びデー
タ全体のビットデータを所定のアルゴリズムの基に暗号
化しながら計算して、認証コードを付すようにし、また
これを読み込んで機械を制御するマイクロプロセッサー
にも事前に認証コードを算出させ、一致したときにのみ
正常な作動をするように構成したので、従来のマイクロ
プロセッサーでは起こりがちであったプログラムの改
変、データの改変等の充分に防ぐことができる。またパ
チンコ機械の製造メーカにとっても、一台の装置の型式
申請において認定を受けたアプリケーションプログラム
及び認証コードが格納された不揮発性記憶手段をコピー
するだけで済むために認定機種についてそれぞれ型式認
定を受ける必要がなくなる。
イクロプロセッサーは、型式認定を受けたアプリケーシ
ョンプログラムに対して初めてそのプログラム及びデー
タ全体のビットデータを所定のアルゴリズムの基に暗号
化しながら計算して、認証コードを付すようにし、また
これを読み込んで機械を制御するマイクロプロセッサー
にも事前に認証コードを算出させ、一致したときにのみ
正常な作動をするように構成したので、従来のマイクロ
プロセッサーでは起こりがちであったプログラムの改
変、データの改変等の充分に防ぐことができる。またパ
チンコ機械の製造メーカにとっても、一台の装置の型式
申請において認定を受けたアプリケーションプログラム
及び認証コードが格納された不揮発性記憶手段をコピー
するだけで済むために認定機種についてそれぞれ型式認
定を受ける必要がなくなる。
【００３６】さらにプログラムの改変が防止されるため
に遊技者は、常に健全な遊技機とプレイできることにな
り、遊技者の期待値を裏切ることがない。認証されたも
のでも、チェックからもれ、所定のプログラム領域を越
えて作動する不正プログラムも存在するが、本発明にか
かるマイクロプロセッサーでは、正規のものでもアドレ
ス領域を常時監視するように構成されているので、チェ
ック漏れによる不正をも排除することができる。
に遊技者は、常に健全な遊技機とプレイできることにな
り、遊技者の期待値を裏切ることがない。認証されたも
のでも、チェックからもれ、所定のプログラム領域を越
えて作動する不正プログラムも存在するが、本発明にか
かるマイクロプロセッサーでは、正規のものでもアドレ
ス領域を常時監視するように構成されているので、チェ
ック漏れによる不正をも排除することができる。
【図１】本発明にかかるマイクロプロセッサーの概略を
表すブロック図である。
表すブロック図である。
【図２】マイクロプロセッサーの作動関係を示すブロッ
ク図である。
ク図である。
【図３】マイクロプロセッサーの作動を示すフローチャ
ートである。
ートである。
【図４】ＡＰ実行時間監視器の構成例を示すブロック図
である。
である。
【図５】ＡＰ実行アドレス監視器の構成例を示すブロッ
ク図である。
ク図である。
【図６】 発行機による外部ＲＯＭの暗号化と、ＡＰの
適正を判断する場合のプロセッサー作動を示す概略図で
ある。
適正を判断する場合のプロセッサー作動を示す概略図で
ある。
【図７】 発行機による外部ＲＯＭの暗号化と、ＡＰの
適正を判断する場合のプロセッサー作動を示す第２実施
例の概略図である。
適正を判断する場合のプロセッサー作動を示す第２実施
例の概略図である。
【図８】 発行機による外部ＲＯＭの暗号化と、ＡＰの
適正を判断する場合のプロセッサー作動を示す第３実施
例の概略図である。
適正を判断する場合のプロセッサー作動を示す第３実施
例の概略図である。
【図９】 発行機による外部ＲＯＭの暗号化と、ＡＰの
適正を判断する場合のプロセッサー作動を示す第４実施
例の概略図である。
適正を判断する場合のプロセッサー作動を示す第４実施
例の概略図である。
【図10】16ビットデータの認証コード算出のアルゴリズ
ム１を示すブロック図である。
ム１を示すブロック図である。
【図11】８ビットデータの認証コード算出のアルゴリズ
ム２を示すブロック図である。
ム２を示すブロック図である。
【図12】16ビットデータの認証コード算出のアルゴリズ
ム３を示すブロック図である。
ム３を示すブロック図である。
【図13】16ビットデータの暗号化アルゴリズムを示すブ
ロック図である。
ロック図である。
１ ＣＰＵ ２ ＡＰ実行アドレス監視器 ３ ＡＰ実行時間監視器 ４ 制御用ワークＲＡＭ ５ ＡＰ用ワークＲＡＭ ６ ＲＡＭサイズ制限器 ７ プログラムメモリーバンク切替器 ８ 外部バスゲート ９ モードコントローラ 10 内蔵ＲＯＭ 12 プログラムメモリ入出力装置 14 外部ＲＯＭ
Claims (6)
- 【請求項１】 所定の領域に記憶されたアプリケーショ
ンプログラム及び該アプリケーションプログラムから所
定のアルゴリズムの基に暗号化された認証コード等が格
納された外部記憶手段と、 前記アプリケーションプログラムから認証コードを算出
するアルゴリズム及び認証コード算出用の単数又は複数
のキーコードが格納された内蔵記憶手段と、前記外部記
憶手段からユーザーデータ等が読み込まれ格納されるア
プリケーションプログラム作業用記憶手段と、 前記内蔵記憶手段に格納されたアルゴリズムの一部又は
全部が格納されるシステム制御用記憶手段と、 アプリケーションプログラムのアドレス領域を走査しこ
れが外部記憶手段のデータ格納規定に違反している時に
装置の作動の停止させ、外部記憶手段から入力されるア
プリケーションプログラムと、内部記憶手段に格納され
た認証コード算出プログラム及びキーコードから認証コ
ードを算出すると共に、該認証コードと予め外部記憶手
段から読み込んだ認証コードとを比較する中央処理装置
（ＣＰＵ）とからなり、 中央処理装置が比較した結果認証コードが一致しなかっ
た時にアプリケーションプログラムの実行アドレスを監
視する手段及びアプリケーションプログラムの実行時間
を監視する手段を作動させると共にアプリケーションプ
ログラムを実行させ、プログラムが領域を越えた時又は
プログラム実行時間が所定時間経過した時に装置の作動
を停止させ、認証コードが比較により一致した時にアプ
リケーションプログラムを実行させるように構成された
遊技機用マイクロプロセッサー。 - 【請求項２】 外部記憶手段に格納された認証コード
が、複数のキーコードK1，K2，K3，…Ki，…Knに基づき
それぞれ算出された複数のものC1，C2，C3，…Ci，…Cn
からなり、内部記憶手段に格納されたキーコードが前記
複数のキーコードK1，K2，K3，…Ki，…Knの内の任意の
１つKiであり、中央処理装置が比較する外部記憶手段の
認証コードが、前記キーコードKiに基づき算出された認
証コードCiであることを特徴とする請求項１記載の遊技
機用マイクロプロセッサー。 - 【請求項３】 外部記憶手段に格納された認証コード
が、複数の第１次キーコードK1，K2，K3，…Ki，…，Kn
に基づきそれぞれ算出された複数の第１次認証コード
C1，C2，C3，…Ci，…，Cnと、該第１次認証コードC1，
C2，C3，…Ci，…，Cn及び第２次キーコードKbに基づき
算出された第２次認証コードC20からなり、内部記憶手
段に格納されたキーコードが前記複数の第１次キーコー
ドK1，K2，K3，…Ki，…，Knの内の任意の１つKiと第２
次キーコードKbであり、中央処理装置が比較する外部記
憶手段の認証コードが第１次キーコードKiに基づき算出
された任意の第１次認証コードCiと、第２次認証コード
C20であることを特徴とする請求項１記載の遊技機用マ
イクロプロセッサー。 - 【請求項４】 外部記憶手段に格納された認証コード
が、１つの中間キーコードK0に基づき算出された中間認
証コードC0及び複数の第１次キーコードK1，K2，K3，…
Ki，…，Knに基づき暗号化された第１次認証コードC1，
C2，C3，…Ci，…，Cnと、該第１次認証コードC1，C2，
C3，…Ci，…，Cn及び第２次キーコードKbに基づき算出
された第２次認証コードC20からなり、内部記憶手段に
格納されたキーコードが中間キーコードK0と、前記複数
の第１次キーコードK1，K2，K3，…Ki，…，Knの内の任
意の１つKiと、第２次キーコードKbであり、中央処理装
置が比較する外部記憶手段の認証コードが第１次キーコ
ードKiに基づき算出された任意の第１次認証コードC
iと、第２次認証コードC20であることを特徴とする請求
項１記載の遊技機用マイクロプロセッサー。 - 【請求項５】 前記外部記憶手段が読み書き込み可能な
不揮発性の記憶手段であり、内部記憶手段が不揮発性の
読み出し専用記憶手段である請求項１記載の遊技機用マ
イクロプロセッサー。 - 【請求項６】 認証コードが一致したときに、アプリケ
ーションプログラムの実行アドレスを監視する手段を作
動させ、プログラムが所定の領域を越えた時に装置の作
動を停止又はＣＰＵをリセットするように構成されてい
る請求項１記載の遊技機用マイクロプロセッサー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4129481A JP2620020B2 (ja) | 1991-04-22 | 1992-04-22 | 遊技機用マイクロプロセッサー |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11812091 | 1991-04-22 | ||
| JP3-118120 | 1991-04-22 | ||
| JP4129481A JP2620020B2 (ja) | 1991-04-22 | 1992-04-22 | 遊技機用マイクロプロセッサー |
Related Child Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6033106A Division JP2975522B2 (ja) | 1991-04-22 | 1994-02-04 | 遊技機用マイクロプロセッサー |
| JP8331170A Division JP2918855B2 (ja) | 1991-04-22 | 1996-12-11 | 遊技機用マイクロプロセッサー |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05200153A true JPH05200153A (ja) | 1993-08-10 |
| JP2620020B2 JP2620020B2 (ja) | 1997-06-11 |
Family
ID=26456113
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4129481A Expired - Lifetime JP2620020B2 (ja) | 1991-04-22 | 1992-04-22 | 遊技機用マイクロプロセッサー |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2620020B2 (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11123271A (ja) * | 1997-10-23 | 1999-05-11 | Heiwa Corp | 遊技機不正改造検出装置 |
| JP2009251794A (ja) * | 2008-04-03 | 2009-10-29 | Renesas Technology Corp | 情報処理装置、命令コードの暗号化方法および暗号化命令コードの復号化方法 |
| JP2010088462A (ja) * | 2008-10-03 | 2010-04-22 | Daiichi Shokai Co Ltd | 遊技機 |
| JP2010088463A (ja) * | 2008-10-03 | 2010-04-22 | Daiichi Shokai Co Ltd | 遊技機 |
| US7853798B2 (en) | 2004-02-06 | 2010-12-14 | Nec Electronics Corporation | Program tamper detecting apparatus, method for program tamper detection, and program for program tamper detection |
| JP2011067249A (ja) * | 2009-09-24 | 2011-04-07 | Kyoraku Sangyo Kk | 電子機器、遊技機、主制御基板、周辺基板、認証方法及び認証プログラム |
| JP2015126759A (ja) * | 2013-12-20 | 2015-07-09 | ネット株式会社 | 遊技機 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04215782A (ja) * | 1990-12-14 | 1992-08-06 | Sankyo Kk | 遊技機 |
-
1992
- 1992-04-22 JP JP4129481A patent/JP2620020B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04215782A (ja) * | 1990-12-14 | 1992-08-06 | Sankyo Kk | 遊技機 |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11123271A (ja) * | 1997-10-23 | 1999-05-11 | Heiwa Corp | 遊技機不正改造検出装置 |
| US7853798B2 (en) | 2004-02-06 | 2010-12-14 | Nec Electronics Corporation | Program tamper detecting apparatus, method for program tamper detection, and program for program tamper detection |
| JP2009251794A (ja) * | 2008-04-03 | 2009-10-29 | Renesas Technology Corp | 情報処理装置、命令コードの暗号化方法および暗号化命令コードの復号化方法 |
| JP2010088462A (ja) * | 2008-10-03 | 2010-04-22 | Daiichi Shokai Co Ltd | 遊技機 |
| JP2010088463A (ja) * | 2008-10-03 | 2010-04-22 | Daiichi Shokai Co Ltd | 遊技機 |
| JP2011067249A (ja) * | 2009-09-24 | 2011-04-07 | Kyoraku Sangyo Kk | 電子機器、遊技機、主制御基板、周辺基板、認証方法及び認証プログラム |
| JP2015126759A (ja) * | 2013-12-20 | 2015-07-09 | ネット株式会社 | 遊技機 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2620020B2 (ja) | 1997-06-11 |
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