JPH0445976U - - Google Patents

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JPH0445976U
JPH0445976U JP8731390U JP8731390U JPH0445976U JP H0445976 U JPH0445976 U JP H0445976U JP 8731390 U JP8731390 U JP 8731390U JP 8731390 U JP8731390 U JP 8731390U JP H0445976 U JPH0445976 U JP H0445976U
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  • Manipulation Of Pulses (AREA)

Description

【図面の簡単な説明】
第1図は本考案の実施例の回路図、第2図は第
1図の回路動作を例示する信号タイミング図、第
3図は従来の最大パルス幅測定回路の回路図であ
る。 1……ダウンカウンタ、2……アツプカウンタ
、3……パルス前縁検出回路、4,5,13……
オア回路、10……レジスタ、11……コンパレ
ータ、12……パスル後縁検出回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. イネーブル期間中計測用のクロツクパルスをア
    ツプカウントするアツプカウンタと、被測定パル
    スの開始時点を検出するパルス前縁検出回路と、
    前記アツプカウンタの出力信号を前記パスル前縁
    検出回路の検出タイミングでロードされてイネー
    ブル期間中のボロー出力が出るまで前記クロツク
    をダウンカウントするダウンカウンタと、前記ダ
    ウンカウンタの前記ボロー出力および前記被測定
    パルスからそれぞれ前記アツプカウンタおよび前
    記ダウンカウンタの前記イネーブル期間を指示す
    る信号を発生する第1および第2の論理回路とを
    備えていることを特徴とする最大パルス幅測定回
    路。
JP8731390U 1990-08-21 1990-08-21 最大パルス幅測定回路 Expired - Fee Related JP2518022Y2 (ja)

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JPH0445976U true JPH0445976U (ja) 1992-04-20
JP2518022Y2 JP2518022Y2 (ja) 1996-11-20

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