JPS61197593U - - Google Patents

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JPS61197593U
JPS61197593U JP8297085U JP8297085U JPS61197593U JP S61197593 U JPS61197593 U JP S61197593U JP 8297085 U JP8297085 U JP 8297085U JP 8297085 U JP8297085 U JP 8297085U JP S61197593 U JPS61197593 U JP S61197593U
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JP
Japan
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output signal
circuit
detection
detection output
settling time
Prior art date
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Application number
JP8297085U
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Publication date
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Publication of JPS61197593U publication Critical patent/JPS61197593U/ja
Pending legal-status Critical Current

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  • Measurement Of Unknown Time Intervals (AREA)
  • Tests Of Electronic Circuits (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例の構成を示すブロツ
ク図、第2図は第1図に示す各部の信号波形を示
す信号波形図である。 符号の説明、1:DUT、2:第1コンパレー
タ、3:第2コンパレータ、4:ナンド・ゲート
、5:第1ダウン・カウンタ、6:基準クロツク
発生回路、7:第2ダウン・カウンタ、8:ナン
ド・ゲート。

Claims (1)

  1. 【実用新案登録請求の範囲】 セツトリング時間を測定すべき回路の出力が規
    格内にあるか否かを検出し、検出出力信号を出力
    する検出手段と、 該検出手段の検出出力信号に基づき制御される
    カウント手段であつて、上記回路の出力が規格外
    にあることを示す検出出力信号に基づきカウント
    初期値が設定され、上記回路の出力が規格内にあ
    ることを示す検出出力信号に基づき、所定のカウ
    ント動作を実行するカウント手段と、 上記回路のセツトリング時間より大である所定
    時間経過時の上記カウント手段内容に基づきセツ
    トリング時間を出力する手段とを設けて成ること
    を特徴とするセツトリング時間設定装置。
JP8297085U 1985-05-30 1985-05-30 Pending JPS61197593U (ja)

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JP8297085U JPS61197593U (ja) 1985-05-30 1985-05-30

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JP8297085U JPS61197593U (ja) 1985-05-30 1985-05-30

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JPS61197593U true JPS61197593U (ja) 1986-12-10

Family

ID=30631176

Family Applications (1)

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JP8297085U Pending JPS61197593U (ja) 1985-05-30 1985-05-30

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JP (1) JPS61197593U (ja)

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