JPH04352355A - Manufacture of thin-film transistor - Google Patents
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Landscapes
- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
- Thin Film Transistor (AREA)
Abstract
Description
【0001】0001
【産業上の利用分野】本発明は薄膜トランジスタの製造
方法に関し、特にレーザ光を照射して同一基板上にpチ
ャネルとnチャネルの薄膜トランジスタを形成する薄膜
トランジスタの製造方法に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method for manufacturing a thin film transistor, and more particularly to a method for manufacturing a thin film transistor in which p-channel and n-channel thin film transistors are formed on the same substrate by irradiating laser light.
【0002】0002
【従来の技術】従来から、非晶質半導体層にレーザ光を
照射して非晶質半導体層を溶融・固化させて単結晶化す
るレーザビーム結晶化法がある。このレーザビーム結晶
化法を応用して三次元ICなどを製造する方法も種々提
案されているが、三次元ICを製造する場合、基板は必
ずバルク状のシリコン基板に限られてしまい、大面積化
は到底望めないとともに、半導体層に不純物を拡散する
場合、イオン注入法や熱拡散法で行うことから、不純物
イオンを広い領域にわたって均一に拡散させることがで
きなかったり、高温加熱に耐えられる基板を用いなけれ
ばならないなど技術上不可避の問題がある。2. Description of the Related Art Conventionally, there has been a laser beam crystallization method in which an amorphous semiconductor layer is irradiated with laser light to melt and solidify the amorphous semiconductor layer to form a single crystal. Various methods have been proposed for manufacturing three-dimensional ICs by applying this laser beam crystallization method, but when manufacturing three-dimensional ICs, the substrate is always limited to a bulk silicon substrate, and the area is large. In addition, when diffusing impurities into the semiconductor layer, it is done by ion implantation or thermal diffusion, so it may not be possible to diffuse impurity ions uniformly over a wide area, or a substrate that can withstand high temperature heating may not be possible. There are unavoidable technical problems such as having to use .
【0003】そこで、このような問題を解決する方法と
して、例えば特開昭62−214668号公報では、図
3に示すように、基板11として大面積化が可能で安価
なガラス基板を用い、このガラス基板上にSiO2 膜
12などを形成し、このSiO2 膜12の所定部分に
トランジスタのチャネル領域を形成するための不純物と
なるホウ素12aとリン12bをイオン注入法などで部
分的に注入し、このSiO2 膜12上にシリコン薄膜
13、19を堆積させてシリコン薄膜13にレーザ光を
照射して加熱することによりSiO2 膜12中の不純
物をシリコン薄膜13、19に拡散させてそれぞれ異な
る不純物を含有するチャネル領域15、19を形成して
、ガラス基板11上に逆チャネル型の薄膜トランジスタ
18、23などを形成することも提案されている。なお
、図3において、14、20はソース・ドレイン領域、
16、21はゲート絶縁膜、17、22はゲート電極で
ある。Therefore, as a method to solve such problems, for example, Japanese Patent Application Laid-Open No. 62-214668 uses an inexpensive glass substrate that can be made into a large area as the substrate 11, as shown in FIG. A SiO2 film 12 or the like is formed on a glass substrate, and boron 12a and phosphorus 12b, which serve as impurities for forming a channel region of a transistor, are partially implanted into a predetermined portion of the SiO2 film 12 using an ion implantation method. By depositing silicon thin films 13 and 19 on the SiO2 film 12 and heating the silicon thin film 13 by irradiating it with laser light, impurities in the SiO2 film 12 are diffused into the silicon thin films 13 and 19, each containing different impurities. It has also been proposed to form channel regions 15 and 19 to form reverse channel type thin film transistors 18 and 23 on the glass substrate 11. In addition, in FIG. 3, 14 and 20 are source/drain regions,
16 and 21 are gate insulating films, and 17 and 22 are gate electrodes.
【0004】ところが、この従来の薄膜トランジスタの
製造方法では、SiO2 膜12に予めトランジスタの
チャネル領域を形成する不純物をイオン注入法などで注
入しておかなければならず、製造工程が煩雑で装置も大
掛かりなものを用意しなければならないという問題が依
然としてある。However, in this conventional method for manufacturing thin film transistors, impurities that form the channel region of the transistor must be implanted into the SiO2 film 12 in advance by ion implantation or the like, and the manufacturing process is complicated and the equipment is large. There is still the problem of having to prepare things.
【0005】また、n型半導体用不純物とp型半導体用
不純物とは同時にイオン注入できないことから、n型チ
ャネル領域とp型チャネル領域を形成する場合、それぞ
れ個別のマスクパターンを用いなければならないととも
に、異なる不純物を含有するチャネル上にそれぞれ異な
る不純物を含有するソース領域とドレイン領域を形成す
る際にも2種類のマスクパターンを使用しなければなら
ず、マスク工程が煩雑であるという問題があった。Furthermore, since impurities for n-type semiconductors and impurities for p-type semiconductors cannot be ion-implanted at the same time, separate mask patterns must be used when forming the n-type channel region and the p-type channel region. However, when forming source and drain regions containing different impurities on channels containing different impurities, two types of mask patterns had to be used, making the mask process complicated. .
【0006】本発明は、このような従来方法の問題点に
鑑みて案出されたものであり、イオン注入法などの煩雑
な工程や大掛かりな装置を用いずに、しかもマスク工程
を少なくして同一基板上にpチャネルとnチャネルの薄
膜トランジスタを形成する薄膜トランジスタの製造方法
を提供することを目的とするものである。The present invention has been devised in view of the problems of the conventional methods, and eliminates the use of complicated processes such as ion implantation and large-scale equipment, and reduces the number of mask processes. It is an object of the present invention to provide a method for manufacturing a thin film transistor in which p-channel and n-channel thin film transistors are formed on the same substrate.
【0007】[0007]
【課題を解決するための手段】本発明によれば、基板上
に一導電型不純物を含有する第1の半導体層を形成する
工程と、前記第1の半導体層に部分的にレーザ光を照射
して第1の半導体層内に部分的に結晶化した第1の結晶
化領域を形成する工程と、前記第1の半導体層上に上記
一導電型不純物よりも多量の逆導電型不純物を含有する
第2の半導体層を形成する工程と、前記第1および第2
の半導体層に部分的にレーザ光を照射して第1および第
2の半導体層を同時に加熱・溶融して固化させることに
より逆導電型不純物に富んだ第2の結晶化領域を形成す
る工程と、前記第1の結晶化領域と第2の結晶化領域と
を除いた第1および第2の半導体層を除去することによ
って第1の結晶化領域と第2の結晶化領域とで構成され
る島状部を形成する工程と、前記島状部を覆うように逆
導電型不純物を含有する第3の半導体層を形成し、第1
の結晶化領域と第3の半導体層とで半導体接合を形成す
る工程と、前記第3の半導体層上に前記第3の半導体層
内の逆導電型不純物よりも多量の一導電型不純物を含有
する第4の半導体層を形成し、第3の半導体層と第4の
半導体層とがオーミック接触となるように形成する工程
と、前記第2の結晶化領域上の第3および第4の半導体
層にレーザ光を照射して加熱することにより一導電型不
純物に富んだ第3の結晶化領域を形成し、第2の結晶化
領域と第3の結晶化領域とで半導体接合を形成する工程
とを含んで成る薄膜トランジスタの製造方法が提供され
、そのことにより上記目的が達成される。[Means for Solving the Problems] According to the present invention, there is provided a step of forming a first semiconductor layer containing an impurity of one conductivity type on a substrate, and partially irradiating the first semiconductor layer with a laser beam. forming a partially crystallized first crystallized region in a first semiconductor layer; and containing an opposite conductivity type impurity in a larger amount than the one conductivity type impurity on the first semiconductor layer. a step of forming a second semiconductor layer to form a second semiconductor layer;
forming a second crystallized region rich in opposite conductivity type impurities by partially irradiating the semiconductor layer with a laser beam to simultaneously heat, melt, and solidify the first and second semiconductor layers; , a first crystallized region and a second crystallized region are formed by removing the first and second semiconductor layers except for the first crystallized region and the second crystallized region. a step of forming an island-like portion, forming a third semiconductor layer containing an opposite conductivity type impurity so as to cover the island-like portion;
forming a semiconductor junction between a crystallized region of and a third semiconductor layer, and containing an impurity of one conductivity type in a larger amount than an impurity of opposite conductivity type in the third semiconductor layer on the third semiconductor layer. a step of forming a fourth semiconductor layer such that the third semiconductor layer and the fourth semiconductor layer are in ohmic contact; and a step of forming a fourth semiconductor layer on the second crystallized region. A step of forming a third crystallized region rich in impurities of one conductivity type by irradiating the layer with laser light and heating it, and forming a semiconductor junction between the second crystallized region and the third crystallized region. A method for manufacturing a thin film transistor is provided, which achieves the above object.
【0008】[0008]
【作用】上記のように、第1の半導体層に部分的にレー
ザ光を照射して結晶化することにより一導電型不純物を
含有するチャネル部を形成するとともに、第1の半導体
層と第2の半導体層に同時にレーザ光を照射して結晶化
することにより逆導電型不純物に富んだチャネル部をマ
スクを使用せずに形成する。また、一導電型不純物を含
有するチャネル部と逆導電型不純物に富んだチャネル部
上に、逆導電型不純物を含有する半導体層と一導電型不
純物を含有する半導体層とを順次積層して、上記逆導電
型不純物に富んだチャネル部上の第3および第4の半導
体層にレーザ光を照射して一導電型不純物に富んだ領域
を形成することによって半導体接合部を形成する。なお
、一導電型不純物を含有するチャネル部上には、他の導
電型不純物を含有する第3の半導体層が形成され、また
第3と第4の半導体層間はオーミック接触を有している
ためレーザ光を照射して第3の半導体層と第4の半導体
とを混合しなくてもそのままで半導体接合部が形成され
る。すなわち、プラズマCVD法で形成した非晶質シリ
コンもしくは微結晶シリコンは、半導体用不純物を10
15個cm−3以上含んでいれば、そのpn接合は整流
性を示さず、良好なオーミック特性を示す。したがって
、イオン注入法や熱拡散法などによらずに半導体接合部
を形成できるとともに、マスク工程も少なくなる。[Operation] As described above, by partially irradiating the first semiconductor layer with laser light and crystallizing it, a channel portion containing impurities of one conductivity type is formed, and the first semiconductor layer and the second semiconductor layer are crystallized. By simultaneously irradiating the semiconductor layers with laser light and crystallizing them, a channel portion rich in opposite conductivity type impurities is formed without using a mask. Further, a semiconductor layer containing impurities of opposite conductivity type and a semiconductor layer containing impurities of one conductivity type are sequentially stacked on a channel portion containing impurities of one conductivity type and a channel portion rich in impurities of opposite conductivity type, A semiconductor junction is formed by irradiating the third and fourth semiconductor layers on the channel portion rich in opposite conductivity type impurities with laser light to form a region rich in one conductivity type impurity. Note that a third semiconductor layer containing impurities of another conductivity type is formed on the channel portion containing impurities of one conductivity type, and there is ohmic contact between the third and fourth semiconductor layers. A semiconductor junction is formed as it is without irradiating the laser beam and mixing the third semiconductor layer and the fourth semiconductor. In other words, amorphous silicon or microcrystalline silicon formed by the plasma CVD method contains 10% of semiconductor impurities.
If it contains 15 cm-3 or more, the pn junction does not exhibit rectification properties and exhibits good ohmic characteristics. Therefore, a semiconductor junction can be formed without using ion implantation or thermal diffusion, and the number of mask steps can be reduced.
【0009】[0009]
【実施例】以下、本発明を添付図面に基づき詳細に説明
する。図1は、本発明に係る薄膜トランジスタの製造方
法を説明するための工程図であり、1はガラスなどから
成る基板である。DESCRIPTION OF THE PREFERRED EMBODIMENTS The present invention will be described in detail below with reference to the accompanying drawings. FIG. 1 is a process diagram for explaining a method for manufacturing a thin film transistor according to the present invention, and 1 is a substrate made of glass or the like.
【0010】前記基板1上に、第1の半導体層2を形成
する。この第1の半導体層2は、例えば非晶質シリコン
や多結晶シリコンなどで構成され、例えばプラズマCV
D法などで厚み500〜10000Å程度に形成される
。この第1の半導体層2は、1015〜1020個/c
m3 程度の一導電型半導体用不純物元素を含有してい
る(同図(a)参照)。なお、基板1上には、必要に応
じて酸化シリコン膜(不図示)などを形成して、この酸
化シリコン膜上に第1の半導体層2を形成するようにし
てもよい。このように基板1上に酸化シリコン膜を形成
しておくことにより、後述するレーザ光を照射した際に
、基板1内の不純物によって第1の半導体層2が汚染さ
れるのを防止することができる。A first semiconductor layer 2 is formed on the substrate 1. This first semiconductor layer 2 is made of, for example, amorphous silicon or polycrystalline silicon, and is made of, for example, plasma CVD.
It is formed to a thickness of approximately 500 to 10,000 Å using the D method or the like. This first semiconductor layer 2 has 1015 to 1020 pieces/c
It contains an impurity element for one-conductivity type semiconductor of about 3 m3 (see figure (a)). Note that a silicon oxide film (not shown) or the like may be formed on the substrate 1 if necessary, and the first semiconductor layer 2 may be formed on this silicon oxide film. By forming the silicon oxide film on the substrate 1 in this way, it is possible to prevent the first semiconductor layer 2 from being contaminated by impurities in the substrate 1 when irradiated with laser light, which will be described later. can.
【0011】前記第1の半導体層2に部分的にレーザ光
L1 を照射して結晶化するとにより第1の結晶化領域
2aを形成する。このレーザ光L1としては、5×10
6 W/cm3 程度の出力で、ビーム径が40μm程
度の連続発振アルゴンレーザなどが好適に用いられる(
同図(b)参照)。The first semiconductor layer 2 is partially irradiated with a laser beam L1 to crystallize it, thereby forming a first crystallized region 2a. This laser beam L1 is 5×10
A continuous wave argon laser with an output of about 6 W/cm3 and a beam diameter of about 40 μm is preferably used (
(See figure (b)).
【0012】次に、前記第1の半導体層2上に、逆導電
型不純物を含有する第2の半導体層3を形成する。この
第2の半導体層3は、例えば非晶質シリコンや多結晶シ
リコンなどで構成され、例えばプラズマCVD法などで
厚み500〜10000Å程度に形成される。この第2
の半導体層3には、第1の半導体層2の不純物含有量よ
りも多い1016〜1021個/cm3 程度含有させ
ておく(同図(c)参照)。Next, a second semiconductor layer 3 containing an opposite conductivity type impurity is formed on the first semiconductor layer 2. This second semiconductor layer 3 is made of, for example, amorphous silicon or polycrystalline silicon, and is formed to a thickness of approximately 500 to 10,000 Å by, for example, plasma CVD. This second
The semiconductor layer 3 contains about 1016 to 1021 impurities/cm 3 , which is higher than the impurity content of the first semiconductor layer 2 (see FIG. 3(c)).
【0013】次に、第1の半導体層2と第2の半導体層
3に部分的にレーザ光L2 を照射して加熱・溶融させ
て固化させて結晶化させることにより第2の結晶化領域
3aを形成する(同図(d)参照)。レーザ光L2 が
照射された部分は、逆導電型を呈するようになる。すな
わち、半導体層が加熱された際に、第1および第2の半
導体層内の不純物が渾然一体化し、不純物の含有量の多
い逆導電型を呈するようになるのである。Next, the first semiconductor layer 2 and the second semiconductor layer 3 are partially irradiated with a laser beam L2 to heat and melt, solidify and crystallize, thereby forming a second crystallized region 3a. (see figure (d)). The portion irradiated with the laser beam L2 exhibits an opposite conductivity type. That is, when the semiconductor layer is heated, the impurities in the first and second semiconductor layers are mixed together, and the semiconductor layers exhibit opposite conductivity types with a high content of impurities.
【0014】このように、第1の半導体層2を部分的に
単結晶化して一導電型不純物を含有する第1の結晶化領
域2aを形成するとともに、第1および第2の半導体層
を部分的に結晶化して逆導電型不純物に富んだ第2の結
晶化領域3aを形成することにより、同一基板1上に一
導電型を呈する半導体結晶化部2aと逆導電型を呈する
半導体結晶化部3aが多数形成されることになる。In this manner, the first semiconductor layer 2 is partially single-crystalized to form the first crystallized region 2a containing impurities of one conductivity type, and the first and second semiconductor layers are partially monocrystalized. By crystallizing the second crystallized region 3a rich in impurities of opposite conductivity type, the semiconductor crystallized region 2a exhibiting one conductivity type and the semiconductor crystallized region exhibiting the opposite conductivity type are formed on the same substrate 1. 3a will be formed in large numbers.
【0015】上記半導体層2、3のうちの結晶化させた
領域2a、3a以外の部分をフッ硝酸溶液などでエッチ
ング除去し、結晶化させた領域2a、3aで構成される
島状部を多数形成する。すなわち、非晶質半導体膜と結
晶化させた領域2a、3aとは、エッチングの選択比が
一桁以上あって、結晶化させた領域2a、3aはエッチ
ングされにくいため結晶化させた領域2a、3aだけが
残ることになる。この残った領域2a、3aが薄膜トラ
ンジスタのチャネル部となる。The portions of the semiconductor layers 2 and 3 other than the crystallized regions 2a and 3a are removed by etching with a fluoro-nitric acid solution to form a large number of island-like portions made up of the crystallized regions 2a and 3a. Form. That is, the etching selectivity ratio between the amorphous semiconductor film and the crystallized regions 2a and 3a is more than one digit, and the crystallized regions 2a and 3a are difficult to be etched, so the crystallized regions 2a and 3a are Only 3a remains. The remaining regions 2a and 3a become the channel portion of the thin film transistor.
【0016】次に、図2に示すように、上記半導体層の
島状部分2a、3a上に、第3の半導体膜4を形成する
。この第3の半導体膜4は、例えば非晶質シリコンや微
結晶シリコンなどで構成され、例えばプラズマCVD法
などで厚み500〜10000Å程度に形成される。
この第3の半導体膜4中には、1016〜1020個/
cm3 程度の逆導電型不純物を含有している。Next, as shown in FIG. 2, a third semiconductor film 4 is formed on the island-shaped portions 2a, 3a of the semiconductor layer. This third semiconductor film 4 is made of, for example, amorphous silicon or microcrystalline silicon, and is formed to have a thickness of approximately 500 to 10,000 Å by, for example, plasma CVD. This third semiconductor film 4 contains 1016 to 1020 pieces/
Contains about cm3 of opposite conductivity type impurities.
【0017】上記第3の半導体層4上に、第4の半導体
層5を形成する。この第4の半導体層5も、例えば非晶
質シリコンや微結晶シリコンなどで構成され、例えばプ
ラズマCVD法などで厚み500〜10000Å程度に
形成される。この第4の半導体層5は、第3の半導体層
4中に含有している不純物の含有量よりも多い1017
〜1021個/cm3 程度の一導電型不純物を含有し
ている(同図(a)参照)。A fourth semiconductor layer 5 is formed on the third semiconductor layer 4. This fourth semiconductor layer 5 is also made of, for example, amorphous silicon or microcrystalline silicon, and is formed to a thickness of about 500 to 10,000 Å by, for example, plasma CVD method. This fourth semiconductor layer 5 has a content of 1017 impurities that is higher than that contained in the third semiconductor layer 4.
It contains about 1021 impurities/cm3 of one conductivity type (see figure (a)).
【0018】次に、逆導電型を呈する島状部分3a上の
第3および第4の半導体層4、5にレーザ光L3 を照
射して加熱する。この場合、第3の半導体層4と第4の
半導体層5が加熱されて渾然一体化し、加熱された領域
は一導電型を呈するようになる。なぜなら、第4の半導
体層5中の不純物含有量が、第3の半導体層4中の不純
物含有量よりも多いからである(同図(b)参照)。Next, the third and fourth semiconductor layers 4 and 5 on the island portion 3a exhibiting opposite conductivity types are irradiated with laser light L3 and heated. In this case, the third semiconductor layer 4 and the fourth semiconductor layer 5 are heated and harmoniously integrated, and the heated region exhibits one conductivity type. This is because the impurity content in the fourth semiconductor layer 5 is greater than the impurity content in the third semiconductor layer 4 (see FIG. 4B).
【0019】上記島状部分2a、3aのほぼ中央部と周
辺部の第3および第4の半導体層4、5を例えばフッ硝
酸溶液などでエッチングする。エッチングして残った部
分が薄膜トランジスタのソース領域とドレイン領域とな
る。The third and fourth semiconductor layers 4 and 5 at the substantially central and peripheral portions of the island-shaped portions 2a and 3a are etched using, for example, a fluoro-nitric acid solution. The portions remaining after etching become the source and drain regions of the thin film transistor.
【0020】上記のように形成するとにより、一導電型
不純物を含有する第1の半導体層2だけを結晶化して形
成したチャネル部2aは逆導電型不純物を含有する第3
の半導体層4とで半導体接合部を形成することができる
。なお、一導電型不純物を含有する非晶質半導体層と逆
導電型不純物を含有する非晶質半導体層とは良好なオー
ミックコンタクトが得られるため、第3の半導体層4上
に第4の半導体層5があっても差し支えない。また、第
1および第2の半導体層を渾然一体化させて形成した逆
導電型不純物に富んだチャネル部3aは第3および第4
の半導体層4、5を渾然一体化させて形成した一導電型
不純物に富んだ半導体層5aとで半導体接合部を形成す
ることができる。By forming as described above, the channel portion 2a formed by crystallizing only the first semiconductor layer 2 containing impurities of one conductivity type becomes the third semiconductor layer containing impurities of the opposite conductivity type.
A semiconductor junction can be formed with the semiconductor layer 4 . Note that since good ohmic contact can be obtained between the amorphous semiconductor layer containing impurities of one conductivity type and the amorphous semiconductor layer containing impurities of opposite conductivity type, a fourth semiconductor layer is formed on the third semiconductor layer 4. There is no problem even if there is layer 5. Further, the channel portion 3a rich in opposite conductivity type impurities formed by harmoniously integrating the first and second semiconductor layers is the third and fourth semiconductor layer.
A semiconductor junction can be formed with a semiconductor layer 5a rich in one conductivity type impurity formed by harmoniously integrating the semiconductor layers 4 and 5.
【0021】このようにして形成した半導体接合部を有
する領域上に、ゲート絶縁膜と層間絶縁膜となる酸化シ
リコンまたは窒化シリコンなどから成る絶縁膜を形成し
、この絶縁膜のソース領域上とドレイン領域上の一部を
除去して、アルミニウムなどを蒸着して一部をエッチン
グすることにより、ゲート電極、ソース電極、およびド
レイン電極を形成して薄膜トランジスタが完成する。An insulating film made of silicon oxide or silicon nitride, which will serve as a gate insulating film and an interlayer insulating film, is formed on the region having the semiconductor junction thus formed, and the source region and drain region of this insulating film are By removing a portion of the region, depositing aluminum or the like, and etching the portion, a gate electrode, a source electrode, and a drain electrode are formed to complete a thin film transistor.
【0022】[0022]
【発明の効果】以上のように、本発明に係る薄膜トラン
ジスタの製造方法によれば、不純物の種類と含有量とが
それぞれ異なる二層の半導体層に部分的にレーザ光を照
射して半導体接合部を形成することから、イオン注入装
置のような大型の装置を用いずに、しかもマスク工程を
大幅に少なくして同一基板上にpチャネルとnチャネル
の薄膜トランジスタを形成するとができる。As described above, according to the method for manufacturing a thin film transistor according to the present invention, two semiconductor layers having different types and contents of impurities are partially irradiated with laser light to form a semiconductor junction. Because of this, p-channel and n-channel thin film transistors can be formed on the same substrate without using a large device such as an ion implantation device and with significantly fewer mask steps.
【図1】本発明に係る薄膜トランジスタの製造方法を説
明するための工程図であり、チャネル部の製造方法を説
明するための図である。FIG. 1 is a process diagram for explaining a method for manufacturing a thin film transistor according to the present invention, and is a diagram for explaining a method for manufacturing a channel portion.
【図2】ソース領域とドレイン領域の製造方法を説明す
るための図である。FIG. 2 is a diagram for explaining a method of manufacturing a source region and a drain region.
【図3】従来の薄膜トランジスタの製造方法を説明する
ための図である。FIG. 3 is a diagram for explaining a conventional thin film transistor manufacturing method.
1、基板 2、第1の半導体層 2a、第1の結晶化領域 3、第2の半導体層 3a、第2の結晶化領域 4、第3の半導体層 5、第4の半導体層 5a、第3の結晶化領域 1. Board 2. First semiconductor layer 2a, first crystallized region 3. Second semiconductor layer 3a, second crystallization region 4. Third semiconductor layer 5. Fourth semiconductor layer 5a, third crystallization region
Claims (1)
1の半導体層を形成する工程と、前記第1の半導体層に
部分的にレーザ光を照射して第1の半導体層内に部分的
に結晶化した第1の結晶化領域を形成する工程と、前記
第1の半導体層上に上記一導電型不純物よりも多量の逆
導電型不純物を含有する第2の半導体層を形成する工程
と、前記第1および第2の半導体層に部分的にレーザ光
を照射して第1および第2の半導体層を同時に加熱・溶
融して固化させることにより逆導電型不純物に富んだ第
2の結晶化領域を形成する工程と、前記第1の結晶化領
域と第2の結晶化領域とを除いた第1および第2の半導
体層を除去することによって第1の結晶化領域と第2の
結晶化領域とで構成される島状部を形成する工程と、前
記島状部を覆うように逆導電型不純物を含有する第3の
半導体層を形成し、第1の結晶化領域と第3の半導体層
とで半導体接合を形成する工程と、前記第3の半導体層
上に前記第3の半導体層内の逆導電型不純物よりも多量
の一導電型不純物を含有する第4の半導体層を形成し、
第3の半導体層と第4の半導体層とがオーミック接触と
なるように形成する工程と、前記第2の結晶化領域上の
第3および第4の半導体層にレーザ光を照射して加熱す
ることにより一導電型不純物に富んだ第3の結晶化領域
を形成し、第2の結晶化領域と第3の結晶化領域とで半
導体接合を形成する工程とを含んで成る薄膜トランジス
タの製造方法。1. A step of forming a first semiconductor layer containing impurities of one conductivity type on a substrate; a step of forming a first crystallized region that is crystallized according to the method; and a step of forming a second semiconductor layer containing an opposite conductivity type impurity in a larger amount than the one conductivity type impurity on the first semiconductor layer. A second semiconductor layer rich in opposite conductivity type impurities is formed by partially irradiating the first and second semiconductor layers with a laser beam to simultaneously heat and melt the first and second semiconductor layers and solidify them. The first crystallized region and the second crystallized region are formed by forming a crystallized region and removing the first and second semiconductor layers except for the first crystallized region and the second crystallized region. a step of forming an island-like part composed of a crystallized region, and forming a third semiconductor layer containing an opposite conductivity type impurity so as to cover the island-like part; forming a semiconductor junction with a semiconductor layer; and forming a fourth semiconductor layer on the third semiconductor layer containing one conductivity type impurity in a larger amount than the opposite conductivity type impurity in the third semiconductor layer. form,
a step of forming a third semiconductor layer and a fourth semiconductor layer so that they are in ohmic contact; and irradiating the third and fourth semiconductor layers on the second crystallized region with laser light to heat them. A method for manufacturing a thin film transistor, comprising the steps of forming a third crystallized region enriched with impurities of one conductivity type, and forming a semiconductor junction between the second crystallized region and the third crystallized region.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3126184A JPH04352355A (en) | 1991-05-29 | 1991-05-29 | Manufacture of thin-film transistor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3126184A JPH04352355A (en) | 1991-05-29 | 1991-05-29 | Manufacture of thin-film transistor |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04352355A true JPH04352355A (en) | 1992-12-07 |
Family
ID=14928772
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3126184A Pending JPH04352355A (en) | 1991-05-29 | 1991-05-29 | Manufacture of thin-film transistor |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04352355A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6232156B1 (en) | 1994-02-03 | 2001-05-15 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device |
-
1991
- 1991-05-29 JP JP3126184A patent/JPH04352355A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6232156B1 (en) | 1994-02-03 | 2001-05-15 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device |
US6417031B2 (en) | 1994-02-03 | 2002-07-09 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device |
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