JPH04249791A - 時間間隔測定装置 - Google Patents
時間間隔測定装置Info
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- JPH04249791A JPH04249791A JP41867090A JP41867090A JPH04249791A JP H04249791 A JPH04249791 A JP H04249791A JP 41867090 A JP41867090 A JP 41867090A JP 41867090 A JP41867090 A JP 41867090A JP H04249791 A JPH04249791 A JP H04249791A
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- Japan
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- 102100034357 Casein kinase I isoform alpha Human genes 0.000 abstract description 11
- 239000003990 capacitor Substances 0.000 abstract description 11
- 238000006243 chemical reaction Methods 0.000 abstract description 9
- 101000994700 Homo sapiens Casein kinase I isoform alpha Proteins 0.000 abstract description 6
- 238000009825 accumulation Methods 0.000 abstract description 2
- 230000001360 synchronised effect Effects 0.000 abstract 1
- 230000000630 rising effect Effects 0.000 description 12
- 238000010586 diagram Methods 0.000 description 6
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- Measurement Of Unknown Time Intervals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、信号のパルス間隔や遅
延時間などを高い精度で測定することができる時間間隔
測定装置に関する。
延時間などを高い精度で測定することができる時間間隔
測定装置に関する。
【０００２】
【従来の技術】信号のパルス間隔などを測定する方法と
しては、入力される被測定パルス間隔を基準パルスでカ
ウントする方法がある。この測定方式では、図３に示す
ようにクロック回路２０から基準クロックが供給される
ゲート回路２１に時間間隔を測定しようとするパルスＰ
が入力され、図４に示すようにカウンタ２２において入
力パルスＰ１，Ｐ２間の基準クロックＣＫの個数が計数
される。カウンタ出力は乗算回路２３に供給され、この
乗算回路２３で基準クロック間隔ｕとクロック間隔個数
Ｎ（計数したクロック個数から１を減算した値）が乗算
されることで、入力パルスＰ１，Ｐ２の時間間隔が計測
される。時間間隔は表示部２４に表示される。
しては、入力される被測定パルス間隔を基準パルスでカ
ウントする方法がある。この測定方式では、図３に示す
ようにクロック回路２０から基準クロックが供給される
ゲート回路２１に時間間隔を測定しようとするパルスＰ
が入力され、図４に示すようにカウンタ２２において入
力パルスＰ１，Ｐ２間の基準クロックＣＫの個数が計数
される。カウンタ出力は乗算回路２３に供給され、この
乗算回路２３で基準クロック間隔ｕとクロック間隔個数
Ｎ（計数したクロック個数から１を減算した値）が乗算
されることで、入力パルスＰ１，Ｐ２の時間間隔が計測
される。時間間隔は表示部２４に表示される。
【０００３】また基準クロックでは計測できないような
非常に短い時間間隔を測定する方法としては、抵抗とコ
ンデンサからなる時定数回路を用いる方法がある。この
測定方式では、図５に示すように入力パルスＰ′がゲー
ト回路２５に入力され、このゲート回路２５から出力さ
れるトリガによって時定数回路２６を構成するコンデン
サ２８に抵抗２７を介して電位が蓄積される。入力パル
スＰ１′，Ｐ２′間隔に対応する蓄積電位Ｖ′は、Ａ／
Ｄ変換回路２９においてディジタル信号に直され、計測
された入力パルスＰ１′，Ｐ２′の間の時間間隔Ｔが表
示部３０に表示される。
非常に短い時間間隔を測定する方法としては、抵抗とコ
ンデンサからなる時定数回路を用いる方法がある。この
測定方式では、図５に示すように入力パルスＰ′がゲー
ト回路２５に入力され、このゲート回路２５から出力さ
れるトリガによって時定数回路２６を構成するコンデン
サ２８に抵抗２７を介して電位が蓄積される。入力パル
スＰ１′，Ｐ２′間隔に対応する蓄積電位Ｖ′は、Ａ／
Ｄ変換回路２９においてディジタル信号に直され、計測
された入力パルスＰ１′，Ｐ２′の間の時間間隔Ｔが表
示部３０に表示される。
【０００４】
【発明が解決しようとする課題】しかし、図３に示す従
来の時間間隔測定装置では、入力パルス間の時間間隔Ｔ
を測定するにあたって、入力パルスの始端と基準パルス
ＣＫが入力されるまでの期間ｔ１と、最後の基準パルス
ＣＫと入力パルスの終端との期間ｔ２を計測することが
できず、ｔ１＋ｔ２相当する測定誤差が生じてしまう。
来の時間間隔測定装置では、入力パルス間の時間間隔Ｔ
を測定するにあたって、入力パルスの始端と基準パルス
ＣＫが入力されるまでの期間ｔ１と、最後の基準パルス
ＣＫと入力パルスの終端との期間ｔ２を計測することが
できず、ｔ１＋ｔ２相当する測定誤差が生じてしまう。
【０００５】また図５に示す時間間隔測定装置では、ピ
コ秒オーダーの非常に短い時間間隔Ｔを測定できるが、
図７に示すような長い入力パルスＰ１，Ｐ２間の間隔Ｔ
は、時定数回路２６のコンデンサ２８に精度よく蓄積電
位ｖを形成できないため測定が難しい。
コ秒オーダーの非常に短い時間間隔Ｔを測定できるが、
図７に示すような長い入力パルスＰ１，Ｐ２間の間隔Ｔ
は、時定数回路２６のコンデンサ２８に精度よく蓄積電
位ｖを形成できないため測定が難しい。
【０００６】本発明は、このような課題を解決するため
に提案されたものであり、長いパルス間隔などを測定誤
差を生じることなく高い精度で測定できる時間間隔測定
装置を提供することを目的とする。
に提案されたものであり、長いパルス間隔などを測定誤
差を生じることなく高い精度で測定できる時間間隔測定
装置を提供することを目的とする。
【０００７】
【課題を解決するための手段】この目的を達成するため
に本発明による時間間隔測定装置は、被測定時間間隔の
始端と終端間に入力されるクロックパルス列のパルス数
を計数して、このクロックパルス列の先頭パルスと最後
尾パルス間の時間を計測する第１の時間計測部と、被測
定時間間隔の上記始端とクロックパルス列の上記先頭パ
ルスとの間の時間を時定数回路を用いて計測する第２の
時間計測部と、クロックパルス列の上記最後尾パルスと
被測定時間間隔の上記終端との間の時間を時定数回路を
用いて計測する第３の時間計測部と、第１、第２および
第３の時間計測部での計測結果を加算して被測定時間間
間隔の始端と終端間の時間間隔を算出する演算部とを備
えることを特徴とする。
に本発明による時間間隔測定装置は、被測定時間間隔の
始端と終端間に入力されるクロックパルス列のパルス数
を計数して、このクロックパルス列の先頭パルスと最後
尾パルス間の時間を計測する第１の時間計測部と、被測
定時間間隔の上記始端とクロックパルス列の上記先頭パ
ルスとの間の時間を時定数回路を用いて計測する第２の
時間計測部と、クロックパルス列の上記最後尾パルスと
被測定時間間隔の上記終端との間の時間を時定数回路を
用いて計測する第３の時間計測部と、第１、第２および
第３の時間計測部での計測結果を加算して被測定時間間
間隔の始端と終端間の時間間隔を算出する演算部とを備
えることを特徴とする。
【０００８】
【作用】上述した構成によれば、カウンタなどからなる
第１の時間計測部では、被測定時間間隔の始端と終端間
のクロックパルス数を計数することで、先頭のクロック
パルスと最後尾のクロックパルス間の時間を計測できる
。第２および第３の時間計測部では、時定数用の抵抗と
コンデンサなどからなる時定数回路での蓄積電位の大き
さを計測することで、被測定時間間隔の始端と先頭のク
ロックパルスとの間の時間、および最後尾のクロックパ
ルスと被測定時間間隔の終端間の時間を計測できる。 演算部では、第１、第２および第３の時間計測部での計
測結果を加算することで、被測定時間間隔の始端と終端
間の時間間隔を求められる。
第１の時間計測部では、被測定時間間隔の始端と終端間
のクロックパルス数を計数することで、先頭のクロック
パルスと最後尾のクロックパルス間の時間を計測できる
。第２および第３の時間計測部では、時定数用の抵抗と
コンデンサなどからなる時定数回路での蓄積電位の大き
さを計測することで、被測定時間間隔の始端と先頭のク
ロックパルスとの間の時間、および最後尾のクロックパ
ルスと被測定時間間隔の終端間の時間を計測できる。 演算部では、第１、第２および第３の時間計測部での計
測結果を加算することで、被測定時間間隔の始端と終端
間の時間間隔を求められる。
【０００９】
【実施例】以下、本発明による時間間隔測定装置の具体
的な実施例を図面に基づき詳細に説明する。図１に、こ
の時間間隔測定装置の一実施例を示す。この図で、時間
間隔の測定対象となる被測定パルスＰが入力される入力
端子１は、時定数用の抵抗２とコンデンサ３を有する時
定数回路４に接続されるとともに、ゲート回路５に接続
される。また基準クロックＣＫを発振するクロック回路
６は、時定数回路４のクロック入力端子に接続されると
ともに、ゲート回路５のクロック入力端子に接続される
。時定数回路４の出力端子は、Ａ／Ｄ変換回路７を介し
て演算回路９に接続される。またゲート回路５の出力端
子はカウンタ８に接続され、このカウンタ８の出力端子
が演算回路９に接続される。演算回路９には、測定結果
を表示する表示部１０が接続される。ここで、クロック
回路６、ゲート回路５およびカウンタ６は第１の時間計
測部を構成し、クロック回路６、時定数回路４およびＡ
／Ｄ変換回路７は第２および第３の時間計測部を構成す
る。
的な実施例を図面に基づき詳細に説明する。図１に、こ
の時間間隔測定装置の一実施例を示す。この図で、時間
間隔の測定対象となる被測定パルスＰが入力される入力
端子１は、時定数用の抵抗２とコンデンサ３を有する時
定数回路４に接続されるとともに、ゲート回路５に接続
される。また基準クロックＣＫを発振するクロック回路
６は、時定数回路４のクロック入力端子に接続されると
ともに、ゲート回路５のクロック入力端子に接続される
。時定数回路４の出力端子は、Ａ／Ｄ変換回路７を介し
て演算回路９に接続される。またゲート回路５の出力端
子はカウンタ８に接続され、このカウンタ８の出力端子
が演算回路９に接続される。演算回路９には、測定結果
を表示する表示部１０が接続される。ここで、クロック
回路６、ゲート回路５およびカウンタ６は第１の時間計
測部を構成し、クロック回路６、時定数回路４およびＡ
／Ｄ変換回路７は第２および第３の時間計測部を構成す
る。
【００１０】つぎに、この構成の時間間隔測定装置の動
作を図２のタイミングチャートに基づいて説明する。入
力端子１に被測定パルスＰが入力されると、時定数回路
４は始端の被測定パルスＰ１の立上りがトリガとなって
抵抗２を介してコンデンサ３に電位が蓄積される。コン
デンサ３への電位の蓄積は、クロック回路６から先頭の
クロックパルスＣＫ１が入力されるまでの間継続され、
この先頭のクロックパルスＣＫ１の立上りＣＫ１ａに同
期してコンデンサ３に蓄積された電位ｖ１の大きさが、
Ａ／Ｄ変換回路７でディジタル値に変換される。Ａ／Ｄ
変換回路７から出力されるディジタル値は、被測定パル
スＰ１の立上りＰ１ａから先頭のクロックパルスＣＫ１
の立上りＣＫ１ａまでの時間ｔ１に相当する。時定数回
路４は先頭のクロックパルスＣＫ１の立ち下りＣＫ１ｂ
に同期してクリアされる。Ａ／Ｄ変換回路７の出力デー
タは演算回路９に供給されて一時ストアされる。またゲ
ート回路５は、始端の被測定パルスＰ１の立上りＰ１ａ
からつぎの被測定パルスＰ２の立上りＰ２ａまでの間（
被測定時間間隔の始端と終端間）だけゲートが開かれ、
このゲート回路５を通過したクロックパルスＣＫの個数
がカウンタ８で計数される。カウンタ８の計数値は、演
算回路９に供給される。演算回路９では、計数値から１
を減算した値をパルス間隔数Ｎとして、クロックパルス
の１周期（パルス間隔）ｕにこのパルス間隔個数Ｎを乗
算することにより、ゲート回路５を通過したクロックパ
ルス列の先頭のクロックパルスＣＫ１の立上りＣＫ１ａ
から最後尾のクロックパルスＣＫ２の立上りＣＫ２ａま
での時間ＴＡを算出する。続いて、時定数回路４ではつ
ぎの被測定パルスＰ２の立上りＰ２ａから、続いて入力
されるクロックパルスＣＫ３の立上りＣＫ３ａまでの間
、コンデンサ３に電位が蓄積され、この蓄積電位ｖ２の
大きさがＡ／Ｄ変換回路７でディジタル値に変換される
ことで、パルスＰ２，ＣＫ３間の時間ｔ０が計測される
。この計測データが取り込まれる演算回路９では、クロ
ックパルスＣＫの１周期ｕからパルスＰ２，ＣＫ３間の
時間ｔ０を減算することで、最後尾のクロックパルスＣ
Ｋ２の立上りＣＫ２ａから被測定パルスＰ２の立上りＰ
２ａまでの時間ｔ２を算出する。その後、演算回路９で
は、Ｔ＝ｔ１＋ＴＡ＋ｔ２の演算を行なうことにより、
被測定パルスＰ１，Ｐ２間の時間間隔Ｔを算出する。こ
の時間間隔Ｔは、表示部１０にディジタル表示される。
作を図２のタイミングチャートに基づいて説明する。入
力端子１に被測定パルスＰが入力されると、時定数回路
４は始端の被測定パルスＰ１の立上りがトリガとなって
抵抗２を介してコンデンサ３に電位が蓄積される。コン
デンサ３への電位の蓄積は、クロック回路６から先頭の
クロックパルスＣＫ１が入力されるまでの間継続され、
この先頭のクロックパルスＣＫ１の立上りＣＫ１ａに同
期してコンデンサ３に蓄積された電位ｖ１の大きさが、
Ａ／Ｄ変換回路７でディジタル値に変換される。Ａ／Ｄ
変換回路７から出力されるディジタル値は、被測定パル
スＰ１の立上りＰ１ａから先頭のクロックパルスＣＫ１
の立上りＣＫ１ａまでの時間ｔ１に相当する。時定数回
路４は先頭のクロックパルスＣＫ１の立ち下りＣＫ１ｂ
に同期してクリアされる。Ａ／Ｄ変換回路７の出力デー
タは演算回路９に供給されて一時ストアされる。またゲ
ート回路５は、始端の被測定パルスＰ１の立上りＰ１ａ
からつぎの被測定パルスＰ２の立上りＰ２ａまでの間（
被測定時間間隔の始端と終端間）だけゲートが開かれ、
このゲート回路５を通過したクロックパルスＣＫの個数
がカウンタ８で計数される。カウンタ８の計数値は、演
算回路９に供給される。演算回路９では、計数値から１
を減算した値をパルス間隔数Ｎとして、クロックパルス
の１周期（パルス間隔）ｕにこのパルス間隔個数Ｎを乗
算することにより、ゲート回路５を通過したクロックパ
ルス列の先頭のクロックパルスＣＫ１の立上りＣＫ１ａ
から最後尾のクロックパルスＣＫ２の立上りＣＫ２ａま
での時間ＴＡを算出する。続いて、時定数回路４ではつ
ぎの被測定パルスＰ２の立上りＰ２ａから、続いて入力
されるクロックパルスＣＫ３の立上りＣＫ３ａまでの間
、コンデンサ３に電位が蓄積され、この蓄積電位ｖ２の
大きさがＡ／Ｄ変換回路７でディジタル値に変換される
ことで、パルスＰ２，ＣＫ３間の時間ｔ０が計測される
。この計測データが取り込まれる演算回路９では、クロ
ックパルスＣＫの１周期ｕからパルスＰ２，ＣＫ３間の
時間ｔ０を減算することで、最後尾のクロックパルスＣ
Ｋ２の立上りＣＫ２ａから被測定パルスＰ２の立上りＰ
２ａまでの時間ｔ２を算出する。その後、演算回路９で
は、Ｔ＝ｔ１＋ＴＡ＋ｔ２の演算を行なうことにより、
被測定パルスＰ１，Ｐ２間の時間間隔Ｔを算出する。こ
の時間間隔Ｔは、表示部１０にディジタル表示される。
【００１１】
【発明の効果】以上説明したように本発明によれば、従
来のように基準クロックを単にカウンタで計数して時間
間隔を測定するものとは異なり、被測定時間間隔の始端
と終端近傍に測定誤差がまったく現われず、非常に正確
にパルス間隔や遅延時間などを測定することができる。
来のように基準クロックを単にカウンタで計数して時間
間隔を測定するものとは異なり、被測定時間間隔の始端
と終端近傍に測定誤差がまったく現われず、非常に正確
にパルス間隔や遅延時間などを測定することができる。
【図１】本発明による時間間隔測定装置の一実施例を示
すブロック図。
すブロック図。
【図２】図１の時間間隔測定装置の動作を説明するため
のタイミングチャート。
のタイミングチャート。
【図３】従来の時間間隔測定装置の例を示すブロック図
。
。
【図４】図３に示す従来例の装置における測定誤差を説
明するための図。
明するための図。
【図５】他の従来の時間間隔測定装置の例を示すブロッ
ク図。
ク図。
【図６】図５に示す従来例の装置の動作を説明するため
の図。
の図。
【図７】図５に示す従来例の装置の不具合点を説明する
ための図。
ための図。
２ 時定数用の抵抗
３ 時定数用のコンデンサ ４ 時定数回路
５ ゲート回路６ クロック回路
７ Ａ／Ｄ変換回路 ８ カウンタ
９ 演算回路１０ 表示部
３ 時定数用のコンデンサ ４ 時定数回路
５ ゲート回路６ クロック回路
７ Ａ／Ｄ変換回路 ８ カウンタ
９ 演算回路１０ 表示部
Claims (1)
- 被測定時間間隔の始端と終端間に入力されるクロックパ
ルス列のパルス数を計数して、このクロックパルス列の
先頭パルスと最後尾パルス間の時間を計測する第１の時
間計測部と、被測定時間間隔の上記始端とクロックパル
ス列の上記先頭パルスとの間の時間を時定数回路を用い
て計測する第２の時間計測部と、クロックパルス列の上
記最後尾パルスと被測定時間間隔の上記終端との間の時
間を時定数回路を用いて計測する第３の時間計測部と、
第１、第２および第３の時間計測部での計測結果を加算
して被測定時間間隔の始端と終端間の時間間隔を算出す
る演算部とを備えることを特徴とする時間間隔測定装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP41867090A JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP41867090A JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04249791A true JPH04249791A (ja) | 1992-09-04 |
Family
ID=18526464
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP41867090A Pending JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04249791A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH1010248A (ja) * | 1996-06-24 | 1998-01-16 | Yokogawa Electric Corp | 時間計測装置 |
| JP2020042005A (ja) * | 2018-09-05 | 2020-03-19 | 株式会社デンソー | 時間計測回路及び積分型ａ／ｄコンバータ |
-
1990
- 1990-12-31 JP JP41867090A patent/JPH04249791A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH1010248A (ja) * | 1996-06-24 | 1998-01-16 | Yokogawa Electric Corp | 時間計測装置 |
| JP2020042005A (ja) * | 2018-09-05 | 2020-03-19 | 株式会社デンソー | 時間計測回路及び積分型ａ／ｄコンバータ |
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