JPH04249791A - 時間間隔測定装置 - Google Patents
時間間隔測定装置Info
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- JPH04249791A JPH04249791A JP41867090A JP41867090A JPH04249791A JP H04249791 A JPH04249791 A JP H04249791A JP 41867090 A JP41867090 A JP 41867090A JP 41867090 A JP41867090 A JP 41867090A JP H04249791 A JPH04249791 A JP H04249791A
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- Japan
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- time
- circuit
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- measured
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- 102100034357 Casein kinase I isoform alpha Human genes 0.000 abstract description 11
- 239000003990 capacitor Substances 0.000 abstract description 11
- 238000006243 chemical reaction Methods 0.000 abstract description 9
- 101000994700 Homo sapiens Casein kinase I isoform alpha Proteins 0.000 abstract description 6
- 238000009825 accumulation Methods 0.000 abstract description 2
- 230000001360 synchronised effect Effects 0.000 abstract 1
- 230000000630 rising effect Effects 0.000 description 12
- 238000010586 diagram Methods 0.000 description 6
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- 238000000034 method Methods 0.000 description 3
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- 230000001960 triggered effect Effects 0.000 description 1
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- Measurement Of Unknown Time Intervals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は、信号のパルス間隔や遅
延時間などを高い精度で測定することができる時間間隔
測定装置に関する。
延時間などを高い精度で測定することができる時間間隔
測定装置に関する。
【0002】
【従来の技術】信号のパルス間隔などを測定する方法と
しては、入力される被測定パルス間隔を基準パルスでカ
ウントする方法がある。この測定方式では、図3に示す
ようにクロック回路20から基準クロックが供給される
ゲート回路21に時間間隔を測定しようとするパルスP
が入力され、図4に示すようにカウンタ22において入
力パルスP1,P2間の基準クロックCKの個数が計数
される。カウンタ出力は乗算回路23に供給され、この
乗算回路23で基準クロック間隔uとクロック間隔個数
N(計数したクロック個数から1を減算した値)が乗算
されることで、入力パルスP1,P2の時間間隔が計測
される。時間間隔は表示部24に表示される。
しては、入力される被測定パルス間隔を基準パルスでカ
ウントする方法がある。この測定方式では、図3に示す
ようにクロック回路20から基準クロックが供給される
ゲート回路21に時間間隔を測定しようとするパルスP
が入力され、図4に示すようにカウンタ22において入
力パルスP1,P2間の基準クロックCKの個数が計数
される。カウンタ出力は乗算回路23に供給され、この
乗算回路23で基準クロック間隔uとクロック間隔個数
N(計数したクロック個数から1を減算した値)が乗算
されることで、入力パルスP1,P2の時間間隔が計測
される。時間間隔は表示部24に表示される。
【0003】また基準クロックでは計測できないような
非常に短い時間間隔を測定する方法としては、抵抗とコ
ンデンサからなる時定数回路を用いる方法がある。この
測定方式では、図5に示すように入力パルスP′がゲー
ト回路25に入力され、このゲート回路25から出力さ
れるトリガによって時定数回路26を構成するコンデン
サ28に抵抗27を介して電位が蓄積される。入力パル
スP1′,P2′間隔に対応する蓄積電位V′は、A/
D変換回路29においてディジタル信号に直され、計測
された入力パルスP1′,P2′の間の時間間隔Tが表
示部30に表示される。
非常に短い時間間隔を測定する方法としては、抵抗とコ
ンデンサからなる時定数回路を用いる方法がある。この
測定方式では、図5に示すように入力パルスP′がゲー
ト回路25に入力され、このゲート回路25から出力さ
れるトリガによって時定数回路26を構成するコンデン
サ28に抵抗27を介して電位が蓄積される。入力パル
スP1′,P2′間隔に対応する蓄積電位V′は、A/
D変換回路29においてディジタル信号に直され、計測
された入力パルスP1′,P2′の間の時間間隔Tが表
示部30に表示される。
【0004】
【発明が解決しようとする課題】しかし、図3に示す従
来の時間間隔測定装置では、入力パルス間の時間間隔T
を測定するにあたって、入力パルスの始端と基準パルス
CKが入力されるまでの期間t1と、最後の基準パルス
CKと入力パルスの終端との期間t2を計測することが
できず、t1+t2相当する測定誤差が生じてしまう。
来の時間間隔測定装置では、入力パルス間の時間間隔T
を測定するにあたって、入力パルスの始端と基準パルス
CKが入力されるまでの期間t1と、最後の基準パルス
CKと入力パルスの終端との期間t2を計測することが
できず、t1+t2相当する測定誤差が生じてしまう。
【0005】また図5に示す時間間隔測定装置では、ピ
コ秒オーダーの非常に短い時間間隔Tを測定できるが、
図7に示すような長い入力パルスP1,P2間の間隔T
は、時定数回路26のコンデンサ28に精度よく蓄積電
位vを形成できないため測定が難しい。
コ秒オーダーの非常に短い時間間隔Tを測定できるが、
図7に示すような長い入力パルスP1,P2間の間隔T
は、時定数回路26のコンデンサ28に精度よく蓄積電
位vを形成できないため測定が難しい。
【0006】本発明は、このような課題を解決するため
に提案されたものであり、長いパルス間隔などを測定誤
差を生じることなく高い精度で測定できる時間間隔測定
装置を提供することを目的とする。
に提案されたものであり、長いパルス間隔などを測定誤
差を生じることなく高い精度で測定できる時間間隔測定
装置を提供することを目的とする。
【0007】
【課題を解決するための手段】この目的を達成するため
に本発明による時間間隔測定装置は、被測定時間間隔の
始端と終端間に入力されるクロックパルス列のパルス数
を計数して、このクロックパルス列の先頭パルスと最後
尾パルス間の時間を計測する第1の時間計測部と、被測
定時間間隔の上記始端とクロックパルス列の上記先頭パ
ルスとの間の時間を時定数回路を用いて計測する第2の
時間計測部と、クロックパルス列の上記最後尾パルスと
被測定時間間隔の上記終端との間の時間を時定数回路を
用いて計測する第3の時間計測部と、第1、第2および
第3の時間計測部での計測結果を加算して被測定時間間
間隔の始端と終端間の時間間隔を算出する演算部とを備
えることを特徴とする。
に本発明による時間間隔測定装置は、被測定時間間隔の
始端と終端間に入力されるクロックパルス列のパルス数
を計数して、このクロックパルス列の先頭パルスと最後
尾パルス間の時間を計測する第1の時間計測部と、被測
定時間間隔の上記始端とクロックパルス列の上記先頭パ
ルスとの間の時間を時定数回路を用いて計測する第2の
時間計測部と、クロックパルス列の上記最後尾パルスと
被測定時間間隔の上記終端との間の時間を時定数回路を
用いて計測する第3の時間計測部と、第1、第2および
第3の時間計測部での計測結果を加算して被測定時間間
間隔の始端と終端間の時間間隔を算出する演算部とを備
えることを特徴とする。
【0008】
【作用】上述した構成によれば、カウンタなどからなる
第1の時間計測部では、被測定時間間隔の始端と終端間
のクロックパルス数を計数することで、先頭のクロック
パルスと最後尾のクロックパルス間の時間を計測できる
。第2および第3の時間計測部では、時定数用の抵抗と
コンデンサなどからなる時定数回路での蓄積電位の大き
さを計測することで、被測定時間間隔の始端と先頭のク
ロックパルスとの間の時間、および最後尾のクロックパ
ルスと被測定時間間隔の終端間の時間を計測できる。 演算部では、第1、第2および第3の時間計測部での計
測結果を加算することで、被測定時間間隔の始端と終端
間の時間間隔を求められる。
第1の時間計測部では、被測定時間間隔の始端と終端間
のクロックパルス数を計数することで、先頭のクロック
パルスと最後尾のクロックパルス間の時間を計測できる
。第2および第3の時間計測部では、時定数用の抵抗と
コンデンサなどからなる時定数回路での蓄積電位の大き
さを計測することで、被測定時間間隔の始端と先頭のク
ロックパルスとの間の時間、および最後尾のクロックパ
ルスと被測定時間間隔の終端間の時間を計測できる。 演算部では、第1、第2および第3の時間計測部での計
測結果を加算することで、被測定時間間隔の始端と終端
間の時間間隔を求められる。
【0009】
【実施例】以下、本発明による時間間隔測定装置の具体
的な実施例を図面に基づき詳細に説明する。図1に、こ
の時間間隔測定装置の一実施例を示す。この図で、時間
間隔の測定対象となる被測定パルスPが入力される入力
端子1は、時定数用の抵抗2とコンデンサ3を有する時
定数回路4に接続されるとともに、ゲート回路5に接続
される。また基準クロックCKを発振するクロック回路
6は、時定数回路4のクロック入力端子に接続されると
ともに、ゲート回路5のクロック入力端子に接続される
。時定数回路4の出力端子は、A/D変換回路7を介し
て演算回路9に接続される。またゲート回路5の出力端
子はカウンタ8に接続され、このカウンタ8の出力端子
が演算回路9に接続される。演算回路9には、測定結果
を表示する表示部10が接続される。ここで、クロック
回路6、ゲート回路5およびカウンタ6は第1の時間計
測部を構成し、クロック回路6、時定数回路4およびA
/D変換回路7は第2および第3の時間計測部を構成す
る。
的な実施例を図面に基づき詳細に説明する。図1に、こ
の時間間隔測定装置の一実施例を示す。この図で、時間
間隔の測定対象となる被測定パルスPが入力される入力
端子1は、時定数用の抵抗2とコンデンサ3を有する時
定数回路4に接続されるとともに、ゲート回路5に接続
される。また基準クロックCKを発振するクロック回路
6は、時定数回路4のクロック入力端子に接続されると
ともに、ゲート回路5のクロック入力端子に接続される
。時定数回路4の出力端子は、A/D変換回路7を介し
て演算回路9に接続される。またゲート回路5の出力端
子はカウンタ8に接続され、このカウンタ8の出力端子
が演算回路9に接続される。演算回路9には、測定結果
を表示する表示部10が接続される。ここで、クロック
回路6、ゲート回路5およびカウンタ6は第1の時間計
測部を構成し、クロック回路6、時定数回路4およびA
/D変換回路7は第2および第3の時間計測部を構成す
る。
【0010】つぎに、この構成の時間間隔測定装置の動
作を図2のタイミングチャートに基づいて説明する。入
力端子1に被測定パルスPが入力されると、時定数回路
4は始端の被測定パルスP1の立上りがトリガとなって
抵抗2を介してコンデンサ3に電位が蓄積される。コン
デンサ3への電位の蓄積は、クロック回路6から先頭の
クロックパルスCK1が入力されるまでの間継続され、
この先頭のクロックパルスCK1の立上りCK1aに同
期してコンデンサ3に蓄積された電位v1の大きさが、
A/D変換回路7でディジタル値に変換される。A/D
変換回路7から出力されるディジタル値は、被測定パル
スP1の立上りP1aから先頭のクロックパルスCK1
の立上りCK1aまでの時間t1に相当する。時定数回
路4は先頭のクロックパルスCK1の立ち下りCK1b
に同期してクリアされる。A/D変換回路7の出力デー
タは演算回路9に供給されて一時ストアされる。またゲ
ート回路5は、始端の被測定パルスP1の立上りP1a
からつぎの被測定パルスP2の立上りP2aまでの間(
被測定時間間隔の始端と終端間)だけゲートが開かれ、
このゲート回路5を通過したクロックパルスCKの個数
がカウンタ8で計数される。カウンタ8の計数値は、演
算回路9に供給される。演算回路9では、計数値から1
を減算した値をパルス間隔数Nとして、クロックパルス
の1周期(パルス間隔)uにこのパルス間隔個数Nを乗
算することにより、ゲート回路5を通過したクロックパ
ルス列の先頭のクロックパルスCK1の立上りCK1a
から最後尾のクロックパルスCK2の立上りCK2aま
での時間TAを算出する。続いて、時定数回路4ではつ
ぎの被測定パルスP2の立上りP2aから、続いて入力
されるクロックパルスCK3の立上りCK3aまでの間
、コンデンサ3に電位が蓄積され、この蓄積電位v2の
大きさがA/D変換回路7でディジタル値に変換される
ことで、パルスP2,CK3間の時間t0が計測される
。この計測データが取り込まれる演算回路9では、クロ
ックパルスCKの1周期uからパルスP2,CK3間の
時間t0を減算することで、最後尾のクロックパルスC
K2の立上りCK2aから被測定パルスP2の立上りP
2aまでの時間t2を算出する。その後、演算回路9で
は、T=t1+TA+t2の演算を行なうことにより、
被測定パルスP1,P2間の時間間隔Tを算出する。こ
の時間間隔Tは、表示部10にディジタル表示される。
作を図2のタイミングチャートに基づいて説明する。入
力端子1に被測定パルスPが入力されると、時定数回路
4は始端の被測定パルスP1の立上りがトリガとなって
抵抗2を介してコンデンサ3に電位が蓄積される。コン
デンサ3への電位の蓄積は、クロック回路6から先頭の
クロックパルスCK1が入力されるまでの間継続され、
この先頭のクロックパルスCK1の立上りCK1aに同
期してコンデンサ3に蓄積された電位v1の大きさが、
A/D変換回路7でディジタル値に変換される。A/D
変換回路7から出力されるディジタル値は、被測定パル
スP1の立上りP1aから先頭のクロックパルスCK1
の立上りCK1aまでの時間t1に相当する。時定数回
路4は先頭のクロックパルスCK1の立ち下りCK1b
に同期してクリアされる。A/D変換回路7の出力デー
タは演算回路9に供給されて一時ストアされる。またゲ
ート回路5は、始端の被測定パルスP1の立上りP1a
からつぎの被測定パルスP2の立上りP2aまでの間(
被測定時間間隔の始端と終端間)だけゲートが開かれ、
このゲート回路5を通過したクロックパルスCKの個数
がカウンタ8で計数される。カウンタ8の計数値は、演
算回路9に供給される。演算回路9では、計数値から1
を減算した値をパルス間隔数Nとして、クロックパルス
の1周期(パルス間隔)uにこのパルス間隔個数Nを乗
算することにより、ゲート回路5を通過したクロックパ
ルス列の先頭のクロックパルスCK1の立上りCK1a
から最後尾のクロックパルスCK2の立上りCK2aま
での時間TAを算出する。続いて、時定数回路4ではつ
ぎの被測定パルスP2の立上りP2aから、続いて入力
されるクロックパルスCK3の立上りCK3aまでの間
、コンデンサ3に電位が蓄積され、この蓄積電位v2の
大きさがA/D変換回路7でディジタル値に変換される
ことで、パルスP2,CK3間の時間t0が計測される
。この計測データが取り込まれる演算回路9では、クロ
ックパルスCKの1周期uからパルスP2,CK3間の
時間t0を減算することで、最後尾のクロックパルスC
K2の立上りCK2aから被測定パルスP2の立上りP
2aまでの時間t2を算出する。その後、演算回路9で
は、T=t1+TA+t2の演算を行なうことにより、
被測定パルスP1,P2間の時間間隔Tを算出する。こ
の時間間隔Tは、表示部10にディジタル表示される。
【0011】
【発明の効果】以上説明したように本発明によれば、従
来のように基準クロックを単にカウンタで計数して時間
間隔を測定するものとは異なり、被測定時間間隔の始端
と終端近傍に測定誤差がまったく現われず、非常に正確
にパルス間隔や遅延時間などを測定することができる。
来のように基準クロックを単にカウンタで計数して時間
間隔を測定するものとは異なり、被測定時間間隔の始端
と終端近傍に測定誤差がまったく現われず、非常に正確
にパルス間隔や遅延時間などを測定することができる。
【図1】本発明による時間間隔測定装置の一実施例を示
すブロック図。
すブロック図。
【図2】図1の時間間隔測定装置の動作を説明するため
のタイミングチャート。
のタイミングチャート。
【図3】従来の時間間隔測定装置の例を示すブロック図
。
。
【図4】図3に示す従来例の装置における測定誤差を説
明するための図。
明するための図。
【図5】他の従来の時間間隔測定装置の例を示すブロッ
ク図。
ク図。
【図6】図5に示す従来例の装置の動作を説明するため
の図。
の図。
【図7】図5に示す従来例の装置の不具合点を説明する
ための図。
ための図。
2 時定数用の抵抗
3 時定数用のコンデンサ 4 時定数回路
5 ゲート回路6 クロック回路
7 A/D変換回路 8 カウンタ
9 演算回路10 表示部
3 時定数用のコンデンサ 4 時定数回路
5 ゲート回路6 クロック回路
7 A/D変換回路 8 カウンタ
9 演算回路10 表示部
Claims (1)
- 被測定時間間隔の始端と終端間に入力されるクロックパ
ルス列のパルス数を計数して、このクロックパルス列の
先頭パルスと最後尾パルス間の時間を計測する第1の時
間計測部と、被測定時間間隔の上記始端とクロックパル
ス列の上記先頭パルスとの間の時間を時定数回路を用い
て計測する第2の時間計測部と、クロックパルス列の上
記最後尾パルスと被測定時間間隔の上記終端との間の時
間を時定数回路を用いて計測する第3の時間計測部と、
第1、第2および第3の時間計測部での計測結果を加算
して被測定時間間隔の始端と終端間の時間間隔を算出す
る演算部とを備えることを特徴とする時間間隔測定装置
。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP41867090A JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP41867090A JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04249791A true JPH04249791A (ja) | 1992-09-04 |
Family
ID=18526464
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP41867090A Pending JPH04249791A (ja) | 1990-12-31 | 1990-12-31 | 時間間隔測定装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04249791A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1010248A (ja) * | 1996-06-24 | 1998-01-16 | Yokogawa Electric Corp | 時間計測装置 |
JP2020042005A (ja) * | 2018-09-05 | 2020-03-19 | 株式会社デンソー | 時間計測回路及び積分型a/dコンバータ |
-
1990
- 1990-12-31 JP JP41867090A patent/JPH04249791A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1010248A (ja) * | 1996-06-24 | 1998-01-16 | Yokogawa Electric Corp | 時間計測装置 |
JP2020042005A (ja) * | 2018-09-05 | 2020-03-19 | 株式会社デンソー | 時間計測回路及び積分型a/dコンバータ |
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