JPH0420509B2 - - Google Patents
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- JPH0420509B2 JPH0420509B2 JP854984A JP854984A JPH0420509B2 JP H0420509 B2 JPH0420509 B2 JP H0420509B2 JP 854984 A JP854984 A JP 854984A JP 854984 A JP854984 A JP 854984A JP H0420509 B2 JPH0420509 B2 JP H0420509B2
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- 230000006870 function Effects 0.000 claims description 4
- 230000002265 prevention Effects 0.000 claims description 3
- 238000001514 detection method Methods 0.000 claims 3
- 230000004044 response Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 8
- 238000000034 method Methods 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 2
- 238000004891 communication Methods 0.000 description 1
- 230000006378 damage Effects 0.000 description 1
- 239000000523 sample Substances 0.000 description 1
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Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は不正使用を防止する機能を備えた照合
用のICカードに関するものである。
用のICカードに関するものである。
〈従来技術〉
ICカードはカードに埋め込まれたICチツプ内
のメモリに所有者の照合情報を記憶しておき、読
取装置にカードを挿入してその情報を読み取り、
所持者が読取装置に入力した自己の情報を前記の
記憶された照合情報と照合して所持者の確認を行
うものである。
のメモリに所有者の照合情報を記憶しておき、読
取装置にカードを挿入してその情報を読み取り、
所持者が読取装置に入力した自己の情報を前記の
記憶された照合情報と照合して所持者の確認を行
うものである。
新しいICカードにおいては、カードに埋め込
まれたICチツプ内にCPU（中央処理装置）および
メモリを配設し、読取装置から所持者により入力
された情報とメモリに記憶された所有者の情報を
CPUにおいて照合し、正しい所持者と判断され
た場合に読取装置に接続された処理装置が次の操
作を行うものである。
まれたICチツプ内にCPU（中央処理装置）および
メモリを配設し、読取装置から所持者により入力
された情報とメモリに記憶された所有者の情報を
CPUにおいて照合し、正しい所持者と判断され
た場合に読取装置に接続された処理装置が次の操
作を行うものである。
CPUにおいて正しい所持者でないと判断され
た場合には処理装置は次の操作を行わず、読取装
置に対して所持者の情報を再入力するよう求め
る。
た場合には処理装置は次の操作を行わず、読取装
置に対して所持者の情報を再入力するよう求め
る。
ところが、従来のICカードは第１図に示す如
く、データをメモリ１に書込むためには書き込み
用電源２を必要としていた。３はCPU、４は入
出力端子、５はCPU３、メモリ１を駆動する主
電源である。
く、データをメモリ１に書込むためには書き込み
用電源２を必要としていた。３はCPU、４は入
出力端子、５はCPU３、メモリ１を駆動する主
電源である。
したがつて外部から書き込み用電源２を与えな
ければメモリ１に書き込みができないので、メモ
リ１のデータの破壊をCPUが命令しても、デー
タを破壊することはできなかつた。
ければメモリ１に書き込みができないので、メモ
リ１のデータの破壊をCPUが命令しても、デー
タを破壊することはできなかつた。
そこで不正使用をする者は書き込み用電源２を
与えない状態としておき、そのICカードのPIN
（パーソナル・アイデンテイフイケーシヨン・ナ
ンバー：個人照合番号）を探すために何回もカー
ドにアクセスを行い、PINが分かるまでこれを繰
り返すことができた。
与えない状態としておき、そのICカードのPIN
（パーソナル・アイデンテイフイケーシヨン・ナ
ンバー：個人照合番号）を探すために何回もカー
ドにアクセスを行い、PINが分かるまでこれを繰
り返すことができた。
このように従来のICカードは書き込み用電源
がCPUを駆動する主電源とは別に設けられてい
たから、悪用による誤操作に対するエラーを記録
する場合に、書き込み用電源がなければメモリに
記録することができないため、悪用を防止するこ
とが困難であり、パソコン等と組み合せたPINを
さぐるシステムに対しては無防備に近い状態であ
つた。
がCPUを駆動する主電源とは別に設けられてい
たから、悪用による誤操作に対するエラーを記録
する場合に、書き込み用電源がなければメモリに
記録することができないため、悪用を防止するこ
とが困難であり、パソコン等と組み合せたPINを
さぐるシステムに対しては無防備に近い状態であ
つた。
〈本発明の目的〉
本発明は、上記のような不正アクセスを確実い
検知し、メモリの破壊等の防御手段を備えたIC
カードを提供することを目的とする。
検知し、メモリの破壊等の防御手段を備えたIC
カードを提供することを目的とする。
〈本発明の構成〉
本発明は、所有者の照合情報を記憶する記憶手
段と、外部から所持者により与えられる情報を入
力する入力手段と、該入力手段から入力された情
報と記憶手段に記憶された照合情報とを照合する
照合手段と、該照合手段からの信号を出力する出
力手段と、前記記憶手段の記憶内容を消去する消
去手段として分圧回路による分圧手段または昇圧
回路による昇圧手段のいずれか一方の手段を用い
てメモリ書き込み用の電圧を生成し、記憶内容を
消去する消去手段と、前記記憶手段、入力手段、
照合手段、出力手段、消去手段を制御する制御手
段として、前記照合手段により所定の不正使用が
検出された場合に、前記消去手段を動作させる不
正使用防止機能を持たせた構成としたものであ
る。
段と、外部から所持者により与えられる情報を入
力する入力手段と、該入力手段から入力された情
報と記憶手段に記憶された照合情報とを照合する
照合手段と、該照合手段からの信号を出力する出
力手段と、前記記憶手段の記憶内容を消去する消
去手段として分圧回路による分圧手段または昇圧
回路による昇圧手段のいずれか一方の手段を用い
てメモリ書き込み用の電圧を生成し、記憶内容を
消去する消去手段と、前記記憶手段、入力手段、
照合手段、出力手段、消去手段を制御する制御手
段として、前記照合手段により所定の不正使用が
検出された場合に、前記消去手段を動作させる不
正使用防止機能を持たせた構成としたものであ
る。
〈実施例〉
本発明の実施例を第２図に示す。１１は記憶手
段、１２は入力手段、１３は照合手段、１４は出
力手段、１５は消去手段、１６は制御手段であ
る。
段、１２は入力手段、１３は照合手段、１４は出
力手段、１５は消去手段、１６は制御手段であ
る。
記憶手段１１にはあらかじめ所有者の照合情報
が記憶されている。
が記憶されている。
而してICカードを所持者が読取装置に挿入し、
所持者のPINを読取装置に入力すると、入力され
た情報は入力手段１２から制御手段１６を介して
照合手段１３に送られる。照合手段１３では入力
手段１２から入力された情報と記憶手段１１に記
憶されたPINとを照合する。
所持者のPINを読取装置に入力すると、入力され
た情報は入力手段１２から制御手段１６を介して
照合手段１３に送られる。照合手段１３では入力
手段１２から入力された情報と記憶手段１１に記
憶されたPINとを照合する。
照合により真の所持者であると判断された場合
には照合手段１３からその旨の信号が制御手段１
６を経て出力手段１４を通して出力される。
には照合手段１３からその旨の信号が制御手段１
６を経て出力手段１４を通して出力される。
照合により真の所持者でないと判断された場合
には照合手段１３と制御手段１６により消去手段
１５を動作させて、記憶手段１１の記憶内容を消
去し、不正使用を防止するものである。
には照合手段１３と制御手段１６により消去手段
１５を動作させて、記憶手段１１の記憶内容を消
去し、不正使用を防止するものである。
さらに不正使用があつたことを記憶手段に記録
する手段（図示せず）を付加したものであつても
よい。
する手段（図示せず）を付加したものであつても
よい。
而して記憶手段１１の記憶内容の消去の方法と
しては、消去手段１５が動作可能状態にあること
を制御手段１６により確認してから照合手段１３
の照合動作を開始させるようにしてもよいし、照
合手段１３により真の所持者でないと判断された
場合に制御手段１６により消去手段１５を動作可
能状態としてもよい。
しては、消去手段１５が動作可能状態にあること
を制御手段１６により確認してから照合手段１３
の照合動作を開始させるようにしてもよいし、照
合手段１３により真の所持者でないと判断された
場合に制御手段１６により消去手段１５を動作可
能状態としてもよい。
次に本発明のより具体的な実施例を図面により
説明する。第３図は本発明の一実施例のブロツク
図である。１はメモリ、２は書き込み用電源、３
はCPU、４は入出力端子、５はCPU３およびメ
モリ１を駆動する主電源である。６は分圧回路で
あり、書き込み用電源２の電圧を分圧してCPU
３に入力するものである。
説明する。第３図は本発明の一実施例のブロツク
図である。１はメモリ、２は書き込み用電源、３
はCPU、４は入出力端子、５はCPU３およびメ
モリ１を駆動する主電源である。６は分圧回路で
あり、書き込み用電源２の電圧を分圧してCPU
３に入力するものである。
この実施例によると、メモリ書き込み用電源２
が主電源５とは別に設けられている点は従来例
（第１図）と同様であるが、分圧回路６により書
き込み用電源２の電圧を分圧してCPU３に入力
し、CPU３において書き込み用電源２が書き込
み動作可能な電圧に設定されていることを確認し
た後、照合動作に入るようにメモリ１のROM
（図示せず）内のプログラムを設定しておく。
が主電源５とは別に設けられている点は従来例
（第１図）と同様であるが、分圧回路６により書
き込み用電源２の電圧を分圧してCPU３に入力
し、CPU３において書き込み用電源２が書き込
み動作可能な電圧に設定されていることを確認し
た後、照合動作に入るようにメモリ１のROM
（図示せず）内のプログラムを設定しておく。
而して照合の結果、真の所持者でないと判断さ
れた場合には所持者にPINの再入力を求める。
れた場合には所持者にPINの再入力を求める。
所定の回数の照合が真の所持者でないと判断さ
れ、不正使用であると判断された場合にはCPU
３からの命令によりメモリ１のデータが消去され
る。書き込み用電源２は書き込み動作可能な電圧
に設定されているから消去に必要な電源はあらか
じめ与えられている。メモリ１のデータの消去に
よりカードは使用不能となり、不正使用を防止で
きる。
れ、不正使用であると判断された場合にはCPU
３からの命令によりメモリ１のデータが消去され
る。書き込み用電源２は書き込み動作可能な電圧
に設定されているから消去に必要な電源はあらか
じめ与えられている。メモリ１のデータの消去に
よりカードは使用不能となり、不正使用を防止で
きる。
この実施例によれば、書き込み用電源２が供給
されていない場合にはPINの照合ができないの
で、書き込み用電源２を供給せずPINをさがすた
めPINの照合を何回も行うことができない。
されていない場合にはPINの照合ができないの
で、書き込み用電源２を供給せずPINをさがすた
めPINの照合を何回も行うことができない。
あるいは不正使用であると判断された場合に
CPU３からの命令によりメモリ１に不正使用を
記憶させておくようにしてもよい。
CPU３からの命令によりメモリ１に不正使用を
記憶させておくようにしてもよい。
この実施例の具体的な構成を第４図ｂに示す。
第４図ａは従来のICカードの構成の一例である。
第４図ａは従来のICカードの構成の一例である。
第４図ａに示す従来のICカードはCPU３とメ
モリ１を駆動する主電源が端子VCCおよびGNDに
より与えられ、メモリ１の書き込み用電源が端子
VPPおよび端子GNDにより、CPU３から独立し
てメモリ１に与えられている。
モリ１を駆動する主電源が端子VCCおよびGNDに
より与えられ、メモリ１の書き込み用電源が端子
VPPおよび端子GNDにより、CPU３から独立し
てメモリ１に与えられている。
第４図ｂに示す本発明の実施例によればメモリ
１の書き込み用電源の端子VPPと端子GNDの間に
抵抗RPHおよび抵抗RPLを介設して、書き込み用
電源の電圧VPPを抵抗RPHおよび抵抗RPLにより分
圧してCPU３のVPPチエツク端子VPPCHECKに
入力する。書き込み用電源の電圧VPPは例えば２
５Ｖであり、分圧用の抵抗は例えばRPH＝20kΩ、
RPL＝5kΩとすればよい。
１の書き込み用電源の端子VPPと端子GNDの間に
抵抗RPHおよび抵抗RPLを介設して、書き込み用
電源の電圧VPPを抵抗RPHおよび抵抗RPLにより分
圧してCPU３のVPPチエツク端子VPPCHECKに
入力する。書き込み用電源の電圧VPPは例えば２
５Ｖであり、分圧用の抵抗は例えばRPH＝20kΩ、
RPL＝5kΩとすればよい。
而してCPU３は分圧されて入力された書き込
み用電圧VPPが書き込み可能状態となつているこ
とを確認した後、PINの照合を行う。
み用電圧VPPが書き込み可能状態となつているこ
とを確認した後、PINの照合を行う。
SIOはシリアル入出力端子、CLKはクロツク信
号入力端子、RSはリセツト端子、MCTLはメモ
リコントロール端子、ABはアドレスバス端子、
DBはデータバス端子である。
号入力端子、RSはリセツト端子、MCTLはメモ
リコントロール端子、ABはアドレスバス端子、
DBはデータバス端子である。
第５図は本発明の他の実施例のブロツク図であ
る。７は昇圧回路であり、主電源５の電圧を昇圧
してメモリ書き込み用の電圧とする。而して
CPU３によりPINの照合を行い、不正使用であ
ると判断された場合にはCPU３からの昇圧回路
７を動作させる命令により、昇圧回路７において
主電源５の電圧を昇圧してメモリ書き込み用の電
圧を供給し、メモリ１のデータを消去し、カード
の不正使用を防止する。
る。７は昇圧回路であり、主電源５の電圧を昇圧
してメモリ書き込み用の電圧とする。而して
CPU３によりPINの照合を行い、不正使用であ
ると判断された場合にはCPU３からの昇圧回路
７を動作させる命令により、昇圧回路７において
主電源５の電圧を昇圧してメモリ書き込み用の電
圧を供給し、メモリ１のデータを消去し、カード
の不正使用を防止する。
この実施例によればPINをさがすためPINの照
合を所定の回数行うと昇圧回路７が動作してメモ
リ１のデータが消去されるから、やはりPINの照
合を何回も行うことはできない。
合を所定の回数行うと昇圧回路７が動作してメモ
リ１のデータが消去されるから、やはりPINの照
合を何回も行うことはできない。
あるいは不正使用であると判断された場合に
CPU３からの命令によりメモリ１に不正使用を
記憶させておくようにしてもよい。
CPU３からの命令によりメモリ１に不正使用を
記憶させておくようにしてもよい。
この実施例の具体的な構成を第４図ｃに示す。
主電源の端子VCCを昇圧回路７を通してメモリ１
の書き込み用端子VPPに接続し、またCPU３と昇
圧回路７は書き込み電源コントロール端子VPP
CTLにより接続されている。
主電源の端子VCCを昇圧回路７を通してメモリ１
の書き込み用端子VPPに接続し、またCPU３と昇
圧回路７は書き込み電源コントロール端子VPP
CTLにより接続されている。
而してCPU３においてPINの照合の結果、不
正使用であると判断された場合にはCPU３から
書き込み電源コントロール端子VPPCTLを通して
昇圧回路７を動作させる命令を発し、昇圧回路７
において主電源VCCを昇圧した書き込み用電圧を
メモリ１の書き込み用端子VPPに供給し、CPU３
からメモリコントロール端子MCTLを通してメ
モリ１に入力された命令によりメモリ１のデータ
が消去される。
正使用であると判断された場合にはCPU３から
書き込み電源コントロール端子VPPCTLを通して
昇圧回路７を動作させる命令を発し、昇圧回路７
において主電源VCCを昇圧した書き込み用電圧を
メモリ１の書き込み用端子VPPに供給し、CPU３
からメモリコントロール端子MCTLを通してメ
モリ１に入力された命令によりメモリ１のデータ
が消去される。
昇圧回路７はICにより実現できるが、昇圧回
路を内蔵した市販のメモリ（例えばi2817、
HN58064等）をICカード用モジユールに組み込
んでもよい。
路を内蔵した市販のメモリ（例えばi2817、
HN58064等）をICカード用モジユールに組み込
んでもよい。
第６図は、分圧回路を設ける実施例におけるプ
ログラムのフローチヤートである。
ログラムのフローチヤートである。
分圧された電圧を読み込み（ステツプ）、設
定された電圧値と一致するかどうかを判断し（ス
テツプ）、一致した場合には所持者にPINを入
力させ（ステツプ）、入力されたPINとメモリ
に記憶されているPINを比較し（ステツプ）、
正しい入力と判断された場合には処理装置がその
後の操作に入る（ステツプ）。PINが一致しな
いときは不一致が所定の回数以内であるかどうか
を判断し（ステツプ）、所定の回数以内であれ
ば再度所持者にPINを入力させ（ステツプ）、
所定の回数を越えた不一致の場合はメモリのデー
タを消去する（ステツプ）。ステツプにおい
て分圧され読み込まれた電圧が設定値と一致しな
ければ、何回でもステツプに戻り、PINの入力
（ステツプ）には進まない。
定された電圧値と一致するかどうかを判断し（ス
テツプ）、一致した場合には所持者にPINを入
力させ（ステツプ）、入力されたPINとメモリ
に記憶されているPINを比較し（ステツプ）、
正しい入力と判断された場合には処理装置がその
後の操作に入る（ステツプ）。PINが一致しな
いときは不一致が所定の回数以内であるかどうか
を判断し（ステツプ）、所定の回数以内であれ
ば再度所持者にPINを入力させ（ステツプ）、
所定の回数を越えた不一致の場合はメモリのデー
タを消去する（ステツプ）。ステツプにおい
て分圧され読み込まれた電圧が設定値と一致しな
ければ、何回でもステツプに戻り、PINの入力
（ステツプ）には進まない。
このようにして書き込み用電源が動作可能状態
にあることを確認した後にPINの照合を行うこと
とし、照合の結果不正使用と判断された場合には
データを消去することにより不正使用を防止す
る。
にあることを確認した後にPINの照合を行うこと
とし、照合の結果不正使用と判断された場合には
データを消去することにより不正使用を防止す
る。
第７図は、メモリのデータを消去することな
く、不正使用をメモリに記録させておく実施例の
プログラムのフローチヤートである。
く、不正使用をメモリに記録させておく実施例の
プログラムのフローチヤートである。
第６図のフローチヤートと異なる点を説明する
と、所定の回数を越えた不一致の場合にメモリに
不正使用があつたことを記録しておき（ステツプ
）、次回のそのカードの使用の際に、不正使用
の記録がメモリにあるか否かを判断し（ステツプ
）、不正使用の記録がない場合には分圧された
電圧を読み込む（ステツプ）。不正使用の記録
がある場合には以後のプログラムを実行せず、不
正使用カードに対する処理（例えばカードの回
収、通報等）を行い（ステツプ）、終了（ステ
ツプ）となる。
と、所定の回数を越えた不一致の場合にメモリに
不正使用があつたことを記録しておき（ステツプ
）、次回のそのカードの使用の際に、不正使用
の記録がメモリにあるか否かを判断し（ステツプ
）、不正使用の記録がない場合には分圧された
電圧を読み込む（ステツプ）。不正使用の記録
がある場合には以後のプログラムを実行せず、不
正使用カードに対する処理（例えばカードの回
収、通報等）を行い（ステツプ）、終了（ステ
ツプ）となる。
このようにして不正使用を防止する。
第８図には昇圧回路を設ける実施例におけるプ
ログラムのフローチヤートを示す。
ログラムのフローチヤートを示す。
所持者にPINを入力させ（ステツプ）、入力
されたPINとメモリに記憶されているPINを比較
し（ステツプ）、正しい入力と判断された場合
には処理装置がその後の操作に入る（ステツプ
）。PINが一致しないときは不一致が所定の回
数以内であるかどうかを判断し（ステツプ）、
所定の回数以内であれば再度所持者にPINを入力
させ（ステツプ）、所定の回数を越えた不一致
の場合は昇圧回路を動作させ（ステツプ）、メ
モリのデータを消去する（ステツプ）。
されたPINとメモリに記憶されているPINを比較
し（ステツプ）、正しい入力と判断された場合
には処理装置がその後の操作に入る（ステツプ
）。PINが一致しないときは不一致が所定の回
数以内であるかどうかを判断し（ステツプ）、
所定の回数以内であれば再度所持者にPINを入力
させ（ステツプ）、所定の回数を越えた不一致
の場合は昇圧回路を動作させ（ステツプ）、メ
モリのデータを消去する（ステツプ）。
このようにして照合の結果、不正使用と判断さ
れた場合にはデータを消去して不正使用を防止す
る。第８図の実施例においても、第７図に示した
ように不正使用のあつたことをメモリに記録して
おくようにしてもよい。
れた場合にはデータを消去して不正使用を防止す
る。第８図の実施例においても、第７図に示した
ように不正使用のあつたことをメモリに記録して
おくようにしてもよい。
なお以上はPINの不正アクセスを例に説明した
が、この他にICカードと端末機器間での通信を
暗号化しておくことにより、暗号化が不正であつ
た場合にも同様にデータが自己破壊されるように
してもよい。
が、この他にICカードと端末機器間での通信を
暗号化しておくことにより、暗号化が不正であつ
た場合にも同様にデータが自己破壊されるように
してもよい。
〈本発明の効果〉
本発明は分圧回路による分圧手段または昇圧回
路による昇圧手段のいずれか一方の手段を用いて
メモリ書き込み用の電圧を生成し、記憶内容を消
去する消去手段と、前記記憶手段、入力手段、照
合手段、出力手段、消去手段を制御する制御手段
として前記照合手段により所定の不正使用が検出
された場合に前記消去手段を動作させる不正使用
防止機能を持たせた構成としたことにより、読み
込まれた電圧が設定値と一致せず不正使用と判断
された場合に以後のプログラムを実行せず、しか
もデータを消去するばかりでなく不正使用カード
に対する処理をも容易に行うことができるなど信
頼性が極めて高く不正アクセスの不許可による機
密性の向上したICカードを得ることができ、製
造工程は従来のものを若干変更するだけで良く、
製造も容易であり、実用上大なる効果を奏する。
路による昇圧手段のいずれか一方の手段を用いて
メモリ書き込み用の電圧を生成し、記憶内容を消
去する消去手段と、前記記憶手段、入力手段、照
合手段、出力手段、消去手段を制御する制御手段
として前記照合手段により所定の不正使用が検出
された場合に前記消去手段を動作させる不正使用
防止機能を持たせた構成としたことにより、読み
込まれた電圧が設定値と一致せず不正使用と判断
された場合に以後のプログラムを実行せず、しか
もデータを消去するばかりでなく不正使用カード
に対する処理をも容易に行うことができるなど信
頼性が極めて高く不正アクセスの不許可による機
密性の向上したICカードを得ることができ、製
造工程は従来のものを若干変更するだけで良く、
製造も容易であり、実用上大なる効果を奏する。
第１図は従来のICカードのブロツク図、第２
図は本発明のICカードのブロツク図、第３図は
本発明の一実施例のブロツク図、第４図ａは従来
のICカードの回路図、第４図ｂは本発明の一実
施例の回路図、第４図ｃは本発明の他の実施例の
回路図、第５図は本発明の他の実施例のブロツク
図、第６図、第７図、第８図は本発明の実施例の
プログラムのフローチヤートである。 １……メモリ、２……書き込み用電源、３……
CPU、４……入出力端子、５……主電源、６…
…分圧回路、７……昇圧回路、１１……記憶手
段、１２……入力手段、１３……照合手段、１４
……出力手段、１５……消去手段、１６……制御
手段。
図は本発明のICカードのブロツク図、第３図は
本発明の一実施例のブロツク図、第４図ａは従来
のICカードの回路図、第４図ｂは本発明の一実
施例の回路図、第４図ｃは本発明の他の実施例の
回路図、第５図は本発明の他の実施例のブロツク
図、第６図、第７図、第８図は本発明の実施例の
プログラムのフローチヤートである。 １……メモリ、２……書き込み用電源、３……
CPU、４……入出力端子、５……主電源、６…
…分圧回路、７……昇圧回路、１１……記憶手
段、１２……入力手段、１３……照合手段、１４
……出力手段、１５……消去手段、１６……制御
手段。
Claims (1)
- 【特許請求の範囲】 １ 所有者の照合情報を記憶する記憶手段と、 外部から所持者により与えられる情報を入力す
る入力手段と、 該入力手段から入力された情報と記憶手段に記
憶された照合情報とを照合する照合手段と、 該照合手段からの信号を出力する出力手段と、 前記記憶手段の記憶内容を消去するため、分圧
回路による分圧手段または昇圧回路による昇圧手
段のいずれか一方の手段を用いてメモリ書き込み
用の電圧を生成し、記憶内容を消去する消去手段
と、 前記記憶手段、入力手段、照合手段、出力手
段、消去手段を制御する制御手段として前記照合
手段により所定の不正使用が検出された場合に前
記消去手段を動作させる不正使用防止機能を持た
せた構成としたICカード。 ２ 前記制御手段が、前記消去手段の動作可能状
態を検知する検知手段と、消去手段が動作可能状
態である旨の該検知手段からの検知信号により前
記照合手段の動作を開始させる手段とからなる特
許請求の範囲第１項記載のICカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59008549A JPS60153581A (ja) | 1984-01-23 | 1984-01-23 | 不正使用防止機能を有するｉｃカ−ド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59008549A JPS60153581A (ja) | 1984-01-23 | 1984-01-23 | 不正使用防止機能を有するｉｃカ−ド |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60153581A JPS60153581A (ja) | 1985-08-13 |
| JPH0420509B2 true JPH0420509B2 (ja) | 1992-04-03 |
Family
ID=11696212
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59008549A Granted JPS60153581A (ja) | 1984-01-23 | 1984-01-23 | 不正使用防止機能を有するｉｃカ−ド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60153581A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6244870A (ja) * | 1985-08-22 | 1987-02-26 | Casio Comput Co Ltd | Ｉｃカ−ド判別方式 |
| JPS63123184A (ja) * | 1986-11-12 | 1988-05-26 | Omron Tateisi Electronics Co | Ｉｃカ−ド |
| JP2746801B2 (ja) * | 1992-08-27 | 1998-05-06 | 三菱電機株式会社 | Ｉｃカード及びｉｃカードの暗証番号照合方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5638651A (en) * | 1979-07-02 | 1981-04-13 | Cii | Portable data carrier |
| JPS5729498A (en) * | 1980-07-11 | 1982-02-17 | Transac Dev Transact Automat | Individual portable card |
| JPS5975380A (ja) * | 1982-10-21 | 1984-04-28 | Dainippon Printing Co Ltd | Ｉｃカ−ド |
-
1984
- 1984-01-23 JP JP59008549A patent/JPS60153581A/ja active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5638651A (en) * | 1979-07-02 | 1981-04-13 | Cii | Portable data carrier |
| JPS5729498A (en) * | 1980-07-11 | 1982-02-17 | Transac Dev Transact Automat | Individual portable card |
| JPS5975380A (ja) * | 1982-10-21 | 1984-04-28 | Dainippon Printing Co Ltd | Ｉｃカ−ド |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60153581A (ja) | 1985-08-13 |
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Legal Events
| Date | Code | Title | Description |
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| EXPY | Cancellation because of completion of term |