JPH04199441A - Abnormal state recorder - Google Patents
Abnormal state recorderInfo
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- JPH04199441A JPH04199441A JP2335852A JP33585290A JPH04199441A JP H04199441 A JPH04199441 A JP H04199441A JP 2335852 A JP2335852 A JP 2335852A JP 33585290 A JP33585290 A JP 33585290A JP H04199441 A JPH04199441 A JP H04199441A
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Abstract
Description
この発明は、CPUを備えfこ情報処理装置における異
常に至るまでの経過を記録する異常状態記録装置に関す
る。The present invention relates to an abnormal state recording device that includes a CPU and records the progress up to an abnormality in an information processing device.
CPUを備えた情報処理装置における異常の原因を調べ
る場合、従来は、第4図に示すように、異常が発生して
から装置内のROMに格納されたソフトを使用して、装
置内のRA Mエリアの内容を表示(a)シたり、印字
(b)シたり、外部へ伝送(c)しにりしていた。When investigating the cause of an abnormality in an information processing device equipped with a CPU, conventionally, as shown in Figure 4, after an abnormality occurs, software stored in the ROM in the device is used to check the RA in the device. The contents of the M area were displayed (a), printed (b), and transmitted (c) to the outside.
しかしながら、上記従来の方法では、異常発生後のメモ
リイメージしかわからず、そのメモリイメージから異常
発生の過程を推察することは困難であるという問題があ
った。また、異常の原因を調べる場合はその装置の他の
機能を停止しなければならないとか、装置が全く動作し
なくなった場合には原因の調査ができないといった問題
や、RAMエリアの内容を全て調へなければならないた
めに原因の解明が容易でないといった問題があっそこで
、この発明の目的は、上記のような問題をtくずように
しfこ異常状態記録装置を提供することにある。However, the conventional method described above has a problem in that only the memory image after the occurrence of the abnormality is known, and it is difficult to infer the process of the abnormality occurrence from the memory image. In addition, when investigating the cause of an abnormality, other functions of the device must be stopped, or if the device stops working at all, the cause cannot be investigated. Therefore, it is an object of the present invention to eliminate the above-mentioned problems and provide an abnormal state recording device.
上記目的を達成するf二め、この発明は、CPUを備え
た情報処理装置における異常に至るまでの経過を記録す
る異常状態記録装置であって、上記情報処理装置内の他
の記録媒体とは独立しており、上記cpvtこ接続され
たデータバス、アドレスバスまたは制御信号バスを介し
て伝送される情報を記録するための情報記録媒体と、上
記情報が所定の条件を表す情報である場合に、その情報
を上記情報記録媒体に記録する記録手段と、上記情報処
理装置に異常状態が発生しf二時に上記情報記録媒体へ
の情報の記録を中止する記録中止手段とを備えたことを
特徴としている。Second, the present invention provides an abnormal state recording device for recording the progress up to an abnormality in an information processing device equipped with a CPU, which is different from other recording media in the information processing device. an information recording medium for recording information transmitted via the data bus, address bus or control signal bus which is independent and connected to the cpvt; and when the information is information representing a predetermined condition; , comprising a recording means for recording the information on the information recording medium, and a recording stop means for stopping recording of the information on the information recording medium when an abnormal state occurs in the information processing apparatus at f2. It is said that
上記構成において、CPUに接続され1こデータバス、
アドレスバスまたは制御信号バスを介して伝送さオーる
情報か所定の条件を表す情報である場合に、記録手段が
情報記録媒体にその情報を記録する。そして、情報処理
装置に異常状態か発生した時に、記録中止手段が、上記
情報記録媒体への情報の記録を中止する。
従って、異常状態が発生した後に上記情報記録媒体の記
録内容を調べることにより、異常に至るまでの経過かわ
かる。また、上記情報記録媒体は他の記録媒体と独立し
ているため、その内容を失うことなく情報処理装置の外
へ取り出すことができ、その情報処理装置のある場所以
外で異常の原因を調査でき、まf二、その情報処理装置
が全く動作しなくなっても異常の原因を調査できる。更
に、所定の条件を表す情報だけを記録するようにしてい
るので、原因の調査か容易である。In the above configuration, one data bus connected to the CPU,
When the information transmitted via the address bus or the control signal bus is information representing a predetermined condition, the recording means records the information on the information recording medium. Then, when an abnormal state occurs in the information processing apparatus, the recording stop means stops recording information on the information recording medium. Therefore, by checking the recorded contents of the information recording medium after an abnormal state has occurred, it can be determined how the abnormal state has progressed. Furthermore, since the information recording medium is independent from other recording media, it can be taken out of the information processing device without losing its contents, and the cause of the abnormality can be investigated outside the location where the information processing device is located. Second, even if the information processing device stops working at all, the cause of the abnormality can be investigated. Furthermore, since only information representing predetermined conditions is recorded, it is easy to investigate the cause.
以下、この発明を図示の実施例により詳細に説明する。
第1図はこの発明の異常状態記録装置の一実施例を備え
た情報処理装置の回路図である。
本実施例の異常状態記録装置は、ケート2と、記録媒体
3と、条件回路(1)4と、ゲート5と、条件回路(2
)6と、設定回路9から構−さとている。
上記ゲート2は、CPUIと情報処理装置内の各種メモ
リやデバイス7を接続するデータバス、アドレスバスお
よび制御信号バスのそれぞれに出力された情報のいずれ
を記録媒体3に記録するかを選択するためのゲートであ
る。
条件回路(1)4は上記各ハスが所定の書込条件、例え
ばメモリ・フェッチや特定のI10アドルスへのライト
などの状態にあるかどうかを検出し、その書込条件が成
立したときにゲート5を通して記録媒体3Iこ書き込み
パルスを与える。この書き込みパルスにより上記記録媒
体3にはゲート2て選択された各バスの内容が記録され
る。
一方、条件回路(2)6は、各バスの異常条件、例えば
ROMエリアへのライトとか、存在しないI10アドレ
ス空間のアクセスなどを検出し、その異常条件か成立し
たときにゲート5を閉して記録媒体3への書き込みを中
止する。この書き込みを中止する条件としては、上記各
バスの異常条件の代わりに、装置内の各種メモリやデバ
イス7あるいはソフトウェア8からの中止条件を用いて
しよい。
上記ゲート2における記録情報の選択、条件回路(1)
における書込条件の設定、条件回路(2)における異常
条件の設定は設定回路9で行う。この設定回路9は機械
的なスイッチでもよいし、CPU1の制御によって設定
される回路的なスイッチでしよい。
上記記録媒体3は第2図に示すように書き込み可能なメ
モリ31と、このメモリ31にアドレスを与えるカウン
タ32とから構成されている。そして、上記メモリ31
のデータ入力DATAI〜DATAnには各バスからの
信号が入力され、ゲートからの書き込み信号WRにより
、メモリ31への書き込みが行われる一方、カウンタ3
2がインクリメン)・される。
従って、上記記録媒体3には各バスの異常条件が成立す
るまで、書き込み条件が成立しf二ときの各バスの内容
が記録される。
そして、異常状態が発生すると、上記記録媒体3をこの
情報処理装置から取り出して、第3図に示すように別の
装置10でその内容を読み取り、異常状態に至った原因
を調査する。
このように、記録媒体3が装置内の各種メモリとは独立
しているので、装置から取り出すことができ、装置の他
の機能を停止することなく装置の設置場所以外で原因の
調査ができると共に、装置が全く動作しなくなっ1こ状
態でも原因の調査ができる。また、所定の書き込み条件
が成立したときに信号を記録するようにしているので、
意図する条件にあった信号だけ記録でき、原因の調査が
容易となる。Hereinafter, the present invention will be explained in detail with reference to illustrated embodiments. FIG. 1 is a circuit diagram of an information processing apparatus equipped with an embodiment of the abnormal state recording device of the present invention. The abnormal state recording device of this embodiment includes a gate 2, a recording medium 3, a condition circuit (1) 4, a gate 5, and a condition circuit (2).
) 6 and a setting circuit 9. The gate 2 selects which of the information output to each of the data bus, address bus, and control signal bus that connects the CPU and various memories and devices 7 in the information processing apparatus is to be recorded on the recording medium 3. It is the gate of The conditional circuit (1) 4 detects whether or not each lotus is under a predetermined write condition, such as a memory fetch or a write to a specific I10 address, and when the write condition is met, the gate is activated. A write pulse is applied to the recording medium 3I through 5. The contents of each bus selected by the gate 2 are recorded on the recording medium 3 by this write pulse. On the other hand, the condition circuit (2) 6 detects an abnormal condition of each bus, such as a write to a ROM area or an access to a non-existent I10 address space, and closes the gate 5 when the abnormal condition is satisfied. Writing to the recording medium 3 is stopped. As a condition for stopping this writing, a cancellation condition from various memories or devices 7 or software 8 in the apparatus may be used instead of the above-mentioned abnormal conditions of each bus. Selection of recording information in gate 2, condition circuit (1)
The setting circuit 9 sets the write conditions in , and the abnormal conditions in the condition circuit (2). This setting circuit 9 may be a mechanical switch or may be a circuit switch set under the control of the CPU 1. As shown in FIG. 2, the recording medium 3 is composed of a writable memory 31 and a counter 32 that provides an address to this memory 31. Then, the memory 31
Signals from each bus are input to the data inputs DATAI to DATAn of the counter 3, and writing to the memory 31 is performed by the write signal WR from the gate.
2 is incremented). Therefore, the contents of each bus when the writing condition is satisfied and f2 is recorded on the recording medium 3 until the abnormal condition of each bus is satisfied. When an abnormal condition occurs, the recording medium 3 is taken out from this information processing apparatus, and as shown in FIG. 3, the contents are read by another apparatus 10 to investigate the cause of the abnormal condition. In this way, since the recording medium 3 is independent of the various memories in the device, it can be taken out from the device, and the cause can be investigated at a location other than the location where the device is installed without stopping other functions of the device. Even if the device stops working at all, the cause can be investigated. Also, since a signal is recorded when a predetermined writing condition is met,
Only signals that meet the intended conditions can be recorded, making it easier to investigate the cause.
以上より明らかなように、この発明の異常状態記録装置
は、CPUに接続されたデータバス、アドレスバスまた
は制御信号バスを介して伝送される情報が所定の条件を
表す情報である場合に、記録手段が情報記録媒体にその
情報を記録し、情報処理装置に異常状態が発生しに時に
、記録中止手段が、上記情報記録媒体への情報の記録を
中止するようになっているので、異常発生後に上記情報
記録媒体の記録内容を調へることにより異常に至るまで
の経過がわかり、異常に至った原因を調△、ることかで
きる。また、上記情報記録媒体は他の記録媒体と独立し
ているため、その内容を失う二となく情報処理装置の外
へ取り出すことかでき、その情報処理装置のある場所以
外で異常の原因を調査でき、まfコ、その情報処理装置
が全く動作しなくなっても異常の原因を調査できる。ま
た、」二記情報記録媒体には所定の条件を表す情報たけ
を記録するようにしているので、意図する条件にあった
情報だけを記録でき、原因の調査が容易となる。As is clear from the above, the abnormal state recording device of the present invention records information when the information transmitted via the data bus, address bus, or control signal bus connected to the CPU is information representing a predetermined condition. The means records the information on the information recording medium, and when an abnormal state occurs in the information processing apparatus, the recording stop means stops recording the information on the information recording medium, so that the abnormality does not occur. By later examining the recorded contents of the information recording medium, the progress leading up to the abnormality can be ascertained, and the cause of the abnormality can be investigated. In addition, since the information recording medium is independent from other recording media, it can be taken out of the information processing device without losing its contents, and the cause of the abnormality can be investigated outside the location where the information processing device is located. In addition, even if the information processing device stops working at all, the cause of the abnormality can be investigated. Furthermore, since the information recording medium records only the information representing the predetermined conditions, only the information that meets the intended conditions can be recorded, making it easy to investigate the cause.
第1図はこの発明の一実施例を備えL情報処理装置の回
路図、第2図は上記実施例における記録媒体の構成図、
第3図は上記記録媒体の内容を別の装置で調べることを
示す図、第4図は従来例を説明する図である。
1・・・CPU、2 ・ゲート、3 g2録媒体、4
・条件回路(1)、5 ゲート、6−・条件回路(2
)、9・・設定回路。FIG. 1 is a circuit diagram of an L information processing device including an embodiment of the present invention, FIG. 2 is a configuration diagram of a recording medium in the above embodiment,
FIG. 3 is a diagram showing that the contents of the recording medium are checked by another device, and FIG. 4 is a diagram illustrating a conventional example. 1... CPU, 2 ・Gate, 3 g2 recording medium, 4
・Condition circuit (1), 5 gate, 6-・Condition circuit (2
), 9... Setting circuit.
Claims (1)
までの経過を記録する異常状態記録装置であって、 上記情報処理装置内の他の記録媒体とは独立しており、
上記CPUに接続されたデータバス、アドレスバスまた
は制御信号バスを介して伝送される情報を記録するため
の情報記録媒体と、 上記情報が所定の条件を表す情報である場合に、その情
報を上記情報記録媒体に記録する記録手段と、 上記情報処理装置に異常状態が発生した時に上記情報記
録媒体への情報の記録を中止する記録中止手段とを備え
たことを特徴とする異常状態記録装置。(1) An abnormal state recording device that records the progress up to an abnormality in an information processing device equipped with a CPU, which is independent from other recording media in the information processing device,
an information recording medium for recording information transmitted via a data bus, address bus or control signal bus connected to the CPU; An abnormal state recording apparatus comprising: a recording means for recording on an information recording medium; and a recording stop means for stopping recording of information on the information recording medium when an abnormal state occurs in the information processing apparatus.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2335852A JPH04199441A (en) | 1990-11-29 | 1990-11-29 | Abnormal state recorder |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2335852A JPH04199441A (en) | 1990-11-29 | 1990-11-29 | Abnormal state recorder |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04199441A true JPH04199441A (en) | 1992-07-20 |
Family
ID=18293111
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2335852A Pending JPH04199441A (en) | 1990-11-29 | 1990-11-29 | Abnormal state recorder |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04199441A (en) |
-
1990
- 1990-11-29 JP JP2335852A patent/JPH04199441A/en active Pending
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