JPH0378390A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPH0378390A JPH0378390A JP21521289A JP21521289A JPH0378390A JP H0378390 A JPH0378390 A JP H0378390A JP 21521289 A JP21521289 A JP 21521289A JP 21521289 A JP21521289 A JP 21521289A JP H0378390 A JPH0378390 A JP H0378390A
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- Video Image Reproduction Devices For Color Tv Systems (AREA)
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はＴ Ｆ Ｔ （Ｔｈｉｎ Ｆｉｔｓ Ｔｒａ
ｎｓｉｓｔｏｒ）アクティブマトリクス液晶デイスプレ
ィ等の液晶表示装置に関し、特にそのフリッカ低減方法
に関するものである。
ｎｓｉｓｔｏｒ）アクティブマトリクス液晶デイスプレ
ィ等の液晶表示装置に関し、特にそのフリッカ低減方法
に関するものである。
第１１図は従来例の液晶表示装置の等価回路図である０
図において、１はマトリクス状に配された液晶セル、２
は各液晶セル１と並列になされている記憶用コンデンサ
、３は各液晶セル１毎にその一方の電極（ドレイン電極
あるいは画素電極）に接続されて設けられている電界効
果トランジスタ（ＦＥＴあるいはＴＰＴ）であって、こ
れら３つの素子にて一画素を構成している。４はマトリ
クスの各列毎にＦＥＴ３の入力電極（ソース電極）に共
通に接続された複数のＸ電極、５はマトリクスの各行毎
にＦＥＴ３のゲート電極に共通接続された複数のＹ電極
である。また６はＹ電極５に順次走査パルスを印加する
走査回路、７は映像信号をサンプリングしホールドする
ことにより一水平走査線分の映像信号をＸ電極数の並列
の映像信号に変換し、Ｘ電極４に印加する直／並列変換
回路であり、９は直／並列変換回路７に交流化映像信号
を供給するため、映像信号を交流化する各Ｒ１Ｇ、Ｂの
交流化回路である。８は全ての液晶セル１の他方の電極
に共通接続された共通電極である。
図において、１はマトリクス状に配された液晶セル、２
は各液晶セル１と並列になされている記憶用コンデンサ
、３は各液晶セル１毎にその一方の電極（ドレイン電極
あるいは画素電極）に接続されて設けられている電界効
果トランジスタ（ＦＥＴあるいはＴＰＴ）であって、こ
れら３つの素子にて一画素を構成している。４はマトリ
クスの各列毎にＦＥＴ３の入力電極（ソース電極）に共
通に接続された複数のＸ電極、５はマトリクスの各行毎
にＦＥＴ３のゲート電極に共通接続された複数のＹ電極
である。また６はＹ電極５に順次走査パルスを印加する
走査回路、７は映像信号をサンプリングしホールドする
ことにより一水平走査線分の映像信号をＸ電極数の並列
の映像信号に変換し、Ｘ電極４に印加する直／並列変換
回路であり、９は直／並列変換回路７に交流化映像信号
を供給するため、映像信号を交流化する各Ｒ１Ｇ、Ｂの
交流化回路である。８は全ての液晶セル１の他方の電極
に共通接続された共通電極である。
第１３図は第１１図の各液晶セル上に配された従来のＲ
，Ｇ、Ｂの画素形状及び画素配列を示すものである。こ
の図で、実線枠がほぼ同じ時刻でサンプリング表示され
る単位（１絵素）を示しており、この１つの駆動単位（
１絵素）が従来例ではＲ，Ｃ，Ｂ各１画素よりなってい
る。
，Ｇ、Ｂの画素形状及び画素配列を示すものである。こ
の図で、実線枠がほぼ同じ時刻でサンプリング表示され
る単位（１絵素）を示しており、この１つの駆動単位（
１絵素）が従来例ではＲ，Ｃ，Ｂ各１画素よりなってい
る。
次にこの表示装置を駆動する方法について説明する。
今、Ｙ電極のｉ行目の電極をＹ！とすると、Ｙ電極５の
各電極、例えばＹ、〜Ｙ４の電極には第１２図のＹ１〜
Ｙ４のようなタイミングの波形信号が走査回路６により
印加されている。この走査パルスがＦＥＴ３のゲートに
加わると、その選択された行の総てのＦＥＴ３はオン状
態となり、Ｘ電極４から並列映像信号に応じた電荷がＦ
ＥＴ３を介して記憶用コンデンサ２に充電される。そし
て、ＦＥＴ３がオフ状態になっても、記憶用コンデンサ
２に蓄えられた電荷により液晶に映像信号に対応した電
圧が印加され続けるため、各液晶セルの透過光が映像信
号により制御され表示できることになる。また、第１３
図に示したような駆動単位、例えばＲ，Ｃ，Ｂを同時刻
でサンプリングし表示するというような方法は、直／並
列変換回路７へのサンプリングクロックの与え方等によ
りコントロールできる。
各電極、例えばＹ、〜Ｙ４の電極には第１２図のＹ１〜
Ｙ４のようなタイミングの波形信号が走査回路６により
印加されている。この走査パルスがＦＥＴ３のゲートに
加わると、その選択された行の総てのＦＥＴ３はオン状
態となり、Ｘ電極４から並列映像信号に応じた電荷がＦ
ＥＴ３を介して記憶用コンデンサ２に充電される。そし
て、ＦＥＴ３がオフ状態になっても、記憶用コンデンサ
２に蓄えられた電荷により液晶に映像信号に対応した電
圧が印加され続けるため、各液晶セルの透過光が映像信
号により制御され表示できることになる。また、第１３
図に示したような駆動単位、例えばＲ，Ｃ，Ｂを同時刻
でサンプリングし表示するというような方法は、直／並
列変換回路７へのサンプリングクロックの与え方等によ
りコントロールできる。
なお、液晶に同極性の電圧を印加し続けると寿命が短く
なるという問題があるため、液晶に印加する電圧の極性
が逆になっても、はぼ同じ透過光特性を有していること
を利用して共通電極８の電位に対して画素電極の電位が
ＮＴＳＣ信号のフィールド周期（パネルでの表示原理上
ではフレーム周期）で反転するような信号処理を交流化
回路９で行っており、この交流化された信号を映像信号
として直／並列変換回路に供給している。
なるという問題があるため、液晶に印加する電圧の極性
が逆になっても、はぼ同じ透過光特性を有していること
を利用して共通電極８の電位に対して画素電極の電位が
ＮＴＳＣ信号のフィールド周期（パネルでの表示原理上
ではフレーム周期）で反転するような信号処理を交流化
回路９で行っており、この交流化された信号を映像信号
として直／並列変換回路に供給している。
次に、画素配列については、現在、第１３図のような水
平方向にＸＩ＋垂直方向にｙＩなるサイズの１つの駆動
単位が、垂直方向２４０個程度。
平方向にＸＩ＋垂直方向にｙＩなるサイズの１つの駆動
単位が、垂直方向２４０個程度。
水平方向３２０個程度で構成されている状況にある。こ
こで、垂直方向が２４０本程変色なっている理由は、例
えば垂直方向を４８０本程変色し、ＮＴＳＣ信号を同様
にインタレース表示すると、１つの画素が書き換えられ
る周期がＮＴＳＣ信号の１フレーム（１／３０ｓｅｃ）
となり、この周期で交流化を行なうと液晶の寿命の問題
や、フリッカが大きくなる等の問題があるためである。
こで、垂直方向が２４０本程変色なっている理由は、例
えば垂直方向を４８０本程変色し、ＮＴＳＣ信号を同様
にインタレース表示すると、１つの画素が書き換えられ
る周期がＮＴＳＣ信号の１フレーム（１／３０ｓｅｃ）
となり、この周期で交流化を行なうと液晶の寿命の問題
や、フリッカが大きくなる等の問題があるためである。
従って垂直方向は２４０本程変色、第１フイールドと第
２フイールドを重ね書きし、パネル表示上は２４０本の
ノンインタレース表示をし、各画素の書き換え周期を１
フイールド（１／６０ｓｅｃ）とすることにより、これ
らの問題を避けている。
２フイールドを重ね書きし、パネル表示上は２４０本の
ノンインタレース表示をし、各画素の書き換え周期を１
フイールド（１／６０ｓｅｃ）とすることにより、これ
らの問題を避けている。
次に、従来のフリッカ対策に関しては、上述したように
、液晶の寿命の関係でフィールド周期で交流化を行って
いるが、現実には液晶に加わる極性が異なると、正確に
同じ透過率を示す訳ではない、この結果、フィールド周
期（６０Ｈｚ）で正極性の画面と負極性の画面が交互に
現れることとナリ、フレーム周期（３０Ｈｚ）の明暗の
フリッカが生じることになる。従来、この種の大画面フ
リッカの対策として、例えば第１４図に示すように正極
性あるいは負極性でドライブする画素を図中の斜線部と
無斜線部に分割して大画面フリッカを低減していた。す
なわち、何の対策も行わない場合、６０Ｈｚで画面全体
が明／暗と変化するが、上記のような対策を行なうと画
面の部分領域では同じ＜６０Ｈｚで、それぞれ明／暗を
繰り返しているが、明／暗の領域が画面内に分散されて
いるため、視覚的なＬＰ（ローパス）効果が働き、明／
暗の平均輝度として認知される訳である。しかしながら
、従来のような画素配列で上記のような対策を行なうと
、例えば第１４図の場合は明／暗の縞のピッチが２ｘ、
となり、このピッチを小さ（するにしても限界があるた
め、少し近づいてみるとＬＰ効果がなくなり、明／暗の
縞模様が時間と共に変化する、いわゆるラインフリッカ
の現象が現れるという問題があった。また、正極性ドラ
イブと負極性ドライブの各領域を第１５図のように分割
するにしても一見明／暗のピッチが２／３ＸＩ となり
、小さ（なるように思えるが、Ｒ，Ｇ。
、液晶の寿命の関係でフィールド周期で交流化を行って
いるが、現実には液晶に加わる極性が異なると、正確に
同じ透過率を示す訳ではない、この結果、フィールド周
期（６０Ｈｚ）で正極性の画面と負極性の画面が交互に
現れることとナリ、フレーム周期（３０Ｈｚ）の明暗の
フリッカが生じることになる。従来、この種の大画面フ
リッカの対策として、例えば第１４図に示すように正極
性あるいは負極性でドライブする画素を図中の斜線部と
無斜線部に分割して大画面フリッカを低減していた。す
なわち、何の対策も行わない場合、６０Ｈｚで画面全体
が明／暗と変化するが、上記のような対策を行なうと画
面の部分領域では同じ＜６０Ｈｚで、それぞれ明／暗を
繰り返しているが、明／暗の領域が画面内に分散されて
いるため、視覚的なＬＰ（ローパス）効果が働き、明／
暗の平均輝度として認知される訳である。しかしながら
、従来のような画素配列で上記のような対策を行なうと
、例えば第１４図の場合は明／暗の縞のピッチが２ｘ、
となり、このピッチを小さ（するにしても限界があるた
め、少し近づいてみるとＬＰ効果がなくなり、明／暗の
縞模様が時間と共に変化する、いわゆるラインフリッカ
の現象が現れるという問題があった。また、正極性ドラ
イブと負極性ドライブの各領域を第１５図のように分割
するにしても一見明／暗のピッチが２／３ＸＩ となり
、小さ（なるように思えるが、Ｒ，Ｇ。
Ｂの各色との組み合わせで、やはり２ｘ＋のピッチで大
きな縞模様が現れ、これがラインフリッカとして現れる
という問題があった。
きな縞模様が現れ、これがラインフリッカとして現れる
という問題があった。
従来の液晶表示装置は以上のように構成されていたので
、大画面フリッカは低減できるものの、ラインフリッカ
が増大するという問題があった。
、大画面フリッカは低減できるものの、ラインフリッカ
が増大するという問題があった。
この発明は上記のような問題点を解消するためになされ
たもので、大画面フリッカ及びラインフリッカを低減で
きる液晶表示装置を得ることを目的とする。
たもので、大画面フリッカ及びラインフリッカを低減で
きる液晶表示装置を得ることを目的とする。
この発明に係る液晶表示装置は、液晶パネルの１絵素の
構成をＲ，Ｇ、Ｇ、Ｂの各画素を四角状に配して構成し
、同一画面内での正極性ドライブと負極性ドライブの各
画素の分割を、Ｇ−ＲとＧ・Ｂに、あるいはＧ−ＧとＲ
−Ｂに分割するように制御するようにしたものである。
構成をＲ，Ｇ、Ｇ、Ｂの各画素を四角状に配して構成し
、同一画面内での正極性ドライブと負極性ドライブの各
画素の分割を、Ｇ−ＲとＧ・Ｂに、あるいはＧ−ＧとＲ
−Ｂに分割するように制御するようにしたものである。
この発明においては、１絵素をＲ，Ｇ、Ｇ、Ｂの４画素
を四角状に配して構成し、Ｇ−ＲとＧ・ＢあるいはＧ−
ＧとＲ−Ｂの各画素領域に分割し分散させて、その画素
領域の極性を制御することにより、垂直方向の空間的余
裕を有効に利用して明／暗の画素ピッチを小さくするこ
とができ、又、明／暗の輝度変動を色相の変動に変換で
き、視覚の空間９時間的な特性を考慮すると、そのフリ
ッカに対する知覚を大巾に低減できる。
を四角状に配して構成し、Ｇ−ＲとＧ・ＢあるいはＧ−
ＧとＲ−Ｂの各画素領域に分割し分散させて、その画素
領域の極性を制御することにより、垂直方向の空間的余
裕を有効に利用して明／暗の画素ピッチを小さくするこ
とができ、又、明／暗の輝度変動を色相の変動に変換で
き、視覚の空間９時間的な特性を考慮すると、そのフリ
ッカに対する知覚を大巾に低減できる。
以下、この発明の一実施例を図について説明する。
第１図、第４図及び第６図は、１絵素をＲ，Ｇ。
Ｇ、Ｂの４画素を四角状に配する構成とした本発明の一
実施例による画素配列を示す図である。第１図において
、実線枠は１絵素を構成しており、寸法的には従来例の
第１３図の水平、垂直の各１絵素の寸法Ｘｔ＋ ｙ＋
がそれぞれ第１図の実線枠の水平、垂直の寸法に対応し
ている。
実施例による画素配列を示す図である。第１図において
、実線枠は１絵素を構成しており、寸法的には従来例の
第１３図の水平、垂直の各１絵素の寸法Ｘｔ＋ ｙ＋
がそれぞれ第１図の実線枠の水平、垂直の寸法に対応し
ている。
上記の画素配列で、Ｇ−ＲとＧ−ＢあるいはＧ・ＧとＲ
−Ｂの各領域に分割して、交流化する際の極性を互いに
逆極性となるようにとする訳であるが、この方法には、
例えば第１図の画素配列パターンの場合には第２図及び
第３図の、第４図の画素配列パターンの場合には第５図
の、第６図の画素配列パターンの場合には第７図及び第
８図のような分割方法が考えられる０図中の斜線領域と
無斜線領域で、交流化の際の極性を互いに相対するよう
にし、各画素においても、時間的にフィールド周期で極
性を反転することを示している。いずれの図も斜線領域
と無斜線領域の分割はＧ−ＲとＧ−ＢあるいはＧ−Ｇと
Ｒ−Ｂの各画素に分割されている。また、回路的には第
１１図の従来例と同様であるが、図のＲ，Ｇ、Ｂ交流化
回路９での正極性及び負極性の制御の仕方が、上述の各
パターンに沿うように変えられることになる。
−Ｂの各領域に分割して、交流化する際の極性を互いに
逆極性となるようにとする訳であるが、この方法には、
例えば第１図の画素配列パターンの場合には第２図及び
第３図の、第４図の画素配列パターンの場合には第５図
の、第６図の画素配列パターンの場合には第７図及び第
８図のような分割方法が考えられる０図中の斜線領域と
無斜線領域で、交流化の際の極性を互いに相対するよう
にし、各画素においても、時間的にフィールド周期で極
性を反転することを示している。いずれの図も斜線領域
と無斜線領域の分割はＧ−ＲとＧ−ＢあるいはＧ−Ｇと
Ｒ−Ｂの各画素に分割されている。また、回路的には第
１１図の従来例と同様であるが、図のＲ，Ｇ、Ｂ交流化
回路９での正極性及び負極性の制御の仕方が、上述の各
パターンに沿うように変えられることになる。
次に本発明によるフリッカの低減効果について説明する
。
。
まず、１絵素として、Ｒ，Ｇ、Ｇ、Ｂの４画素を四角状
に配することにより、従来の構成の項でも述べたように
垂直方向の空間的な余裕を有効に利用することになり、
特に垂直方向の１画素のサイズはｙ、／２となり、従来
の半分となる。なお、このように１絵素を垂直方向にも
２分割するため、駆動の際には２行分（２画素ライン分
）同時に駆動することとなる。また、水平方向の画素サ
イズに関しては、ここでは−絵素の寸法を従来と同様に
する（水平解像度を同等にする）という意味で、１絵素
巾をｘｌとしているため１画素の水平巾はｘ、／２とな
り、従来のｘ、／３より若干大きくなる。しかし、実際
にパネルを製作する段階では、当然従来と同じ水平巾の
画素サイズでも製作できる訳であるから、この場合パネ
ルサイズを固定して考えると、従来より１．５倍の水平
解像度を実現できることになる。
に配することにより、従来の構成の項でも述べたように
垂直方向の空間的な余裕を有効に利用することになり、
特に垂直方向の１画素のサイズはｙ、／２となり、従来
の半分となる。なお、このように１絵素を垂直方向にも
２分割するため、駆動の際には２行分（２画素ライン分
）同時に駆動することとなる。また、水平方向の画素サ
イズに関しては、ここでは−絵素の寸法を従来と同様に
する（水平解像度を同等にする）という意味で、１絵素
巾をｘｌとしているため１画素の水平巾はｘ、／２とな
り、従来のｘ、／３より若干大きくなる。しかし、実際
にパネルを製作する段階では、当然従来と同じ水平巾の
画素サイズでも製作できる訳であるから、この場合パネ
ルサイズを固定して考えると、従来より１．５倍の水平
解像度を実現できることになる。
次にフリッカの見え方については、従来例では、近づく
と第１４図の例では、明／暗の縞模様が２Ｘ、のピッチ
で見え、この縞模様が時間と共に変動し、ラインフリッ
カとじて知覚された。しかし、本発明では第２．３，５
．７及び８図に示すように、いずれも縞模様のピッチが
Ｘ、あるいはｙＩで現れる。実際のパネルは水平及び垂
直解像度のバランスという面でｘｌ！＝ｉｙ１となって
いるため、この縞模様のピッチは従来の約半分になって
いる。
と第１４図の例では、明／暗の縞模様が２Ｘ、のピッチ
で見え、この縞模様が時間と共に変動し、ラインフリッ
カとじて知覚された。しかし、本発明では第２．３，５
．７及び８図に示すように、いずれも縞模様のピッチが
Ｘ、あるいはｙＩで現れる。実際のパネルは水平及び垂
直解像度のバランスという面でｘｌ！＝ｉｙ１となって
いるため、この縞模様のピッチは従来の約半分になって
いる。
第９図はＴＶハンドブックより抜粋した人間の空間−相
対感度に関する視覚特性である０図において、横軸がｃ
ｐ ｄ （ｃｙｃｌｅ／ｄｅｇｒｅｅ） 、縦軸が相
対感度である０図のように明暗に比べ、赤−緑や黄−青
のような色度的な相違は空間的に約１０倍の巾が必要な
ことから、上記のように従来のピッチの約半分となって
いることもあり、混色的には充分小さい値であると言え
る。
対感度に関する視覚特性である０図において、横軸がｃ
ｐ ｄ （ｃｙｃｌｅ／ｄｅｇｒｅｅ） 、縦軸が相
対感度である０図のように明暗に比べ、赤−緑や黄−青
のような色度的な相違は空間的に約１０倍の巾が必要な
ことから、上記のように従来のピッチの約半分となって
いることもあり、混色的には充分小さい値であると言え
る。
本発明では、交流化の際の画素分割をＧ−Ｒ（−黄）と
Ｇ−Ｂ（−シアン）あるいはＧ−Ｇ（−緑）とＲ−Ｂ（
＝マゼンタ）に分割していることから、例えば第７図の
場合、斜線部の輝度が高いとすると、Ｒ，Ｇ、Ｂ相互間
の混色面では上述のように充分であるから、ＧとＢ及び
ＧとＲは混色してシアン系と黄系の縞模様がピッチＸＩ
で現れることになる。この場合、第９図にも示したよう
に色相の変化は輝度変化に比べ、検知限が充分低いため
従来と同じピッチの縞でも、縞と、して空間的に知覚さ
れにくいことになる。
Ｇ−Ｂ（−シアン）あるいはＧ−Ｇ（−緑）とＲ−Ｂ（
＝マゼンタ）に分割していることから、例えば第７図の
場合、斜線部の輝度が高いとすると、Ｒ，Ｇ、Ｂ相互間
の混色面では上述のように充分であるから、ＧとＢ及び
ＧとＲは混色してシアン系と黄系の縞模様がピッチＸＩ
で現れることになる。この場合、第９図にも示したよう
に色相の変化は輝度変化に比べ、検知限が充分低いため
従来と同じピッチの縞でも、縞と、して空間的に知覚さ
れにくいことになる。
なお、第１５図の従来例の場合には、例えば図の斜線部
の輝度が高いとすると、上述の過程にそってマゼンタ系
と縁糸の色縞がピッチ２ｘ＋で並ぶことになる。しかし
、マゼンタ系と縁糸の縞はシアン系と黄系の縞に比べて
、第９図に示したように視感度が高いこと、及び水平方
向のピッチは従来の画素単位での水平中を等しいとすれ
ば、更に小さ（できること等から、やはり本発明の方が
ＬＰ効果が大きくとれることになる。
の輝度が高いとすると、上述の過程にそってマゼンタ系
と縁糸の色縞がピッチ２ｘ＋で並ぶことになる。しかし
、マゼンタ系と縁糸の縞はシアン系と黄系の縞に比べて
、第９図に示したように視感度が高いこと、及び水平方
向のピッチは従来の画素単位での水平中を等しいとすれ
ば、更に小さ（できること等から、やはり本発明の方が
ＬＰ効果が大きくとれることになる。
最後に、時間的な輝度変動に関しては、人間の時間的な
輝度変動に対する知覚に関しては約５０〜６０Ｈｚがフ
リッカを感じない下限である。しかし、液晶ＴＶでは約
３０Ｈｚの輝度変動となるためこの輝度変動が知覚され
ることになる。しかるに、本発明では変動周波数は従来
と同じ３０Ｈ２であるが、その変動成分がシアン系とマ
ゼンタ系の縞が交互に変化するという色相的な変動とな
り、視覚特性的には、輝度よりも色相の時間変化の方が
知覚されにくいものであるが（例えばテレビジョン全国
大会ｐＨ，１９７３（坂田・磯野）の文献によれば、最
高感度周波数が３Ｈｚ （輝度の場合は１０〜２０Ｈｚ
）という報告がある。）、結果的に、フリッカが軽減さ
れていることになる。
輝度変動に対する知覚に関しては約５０〜６０Ｈｚがフ
リッカを感じない下限である。しかし、液晶ＴＶでは約
３０Ｈｚの輝度変動となるためこの輝度変動が知覚され
ることになる。しかるに、本発明では変動周波数は従来
と同じ３０Ｈ２であるが、その変動成分がシアン系とマ
ゼンタ系の縞が交互に変化するという色相的な変動とな
り、視覚特性的には、輝度よりも色相の時間変化の方が
知覚されにくいものであるが（例えばテレビジョン全国
大会ｐＨ，１９７３（坂田・磯野）の文献によれば、最
高感度周波数が３Ｈｚ （輝度の場合は１０〜２０Ｈｚ
）という報告がある。）、結果的に、フリッカが軽減さ
れていることになる。
なお、上記実施例における第１．４．６図のような画素
配列の１絵素を構成する素子配列は第１０図に示したよ
うな配列としてもよく、上記実施例と同様の効果を奏す
ることは言うまでもない。
配列の１絵素を構成する素子配列は第１０図に示したよ
うな配列としてもよく、上記実施例と同様の効果を奏す
ることは言うまでもない。
以上のようにこの発明によれば、フルカラーを表現でき
る最小絵素を構成する赤、緑、青の各画素を赤、緑、緑
、青の４つの絵素を四角形状に配置して１絵素を構成し
、その各画素をフィールド周期で極性反転する際、同じ
フィールド内で、赤と緑の各画素領域と、青と緑の各画
素領域で、あるいは緑と緑の各画素領域と、赤と青の各
画素領域で、それらに印加する電圧の極性が正負逆の関
係となるように制御するようにしたことにより、フリッ
カの現れ方がシアン系と黄系のような色相の異なる縞模
様が交互に変化し、更にその空間的なピッチも小さいも
のとなり、視覚の空間的ＬＰ効果が強く働くのみでなく
、時間的ＬＰ効果も強く働くことになり、ラインフリッ
カや大画面フリッカを大きく低減できる効果がある。
る最小絵素を構成する赤、緑、青の各画素を赤、緑、緑
、青の４つの絵素を四角形状に配置して１絵素を構成し
、その各画素をフィールド周期で極性反転する際、同じ
フィールド内で、赤と緑の各画素領域と、青と緑の各画
素領域で、あるいは緑と緑の各画素領域と、赤と青の各
画素領域で、それらに印加する電圧の極性が正負逆の関
係となるように制御するようにしたことにより、フリッ
カの現れ方がシアン系と黄系のような色相の異なる縞模
様が交互に変化し、更にその空間的なピッチも小さいも
のとなり、視覚の空間的ＬＰ効果が強く働くのみでなく
、時間的ＬＰ効果も強く働くことになり、ラインフリッ
カや大画面フリッカを大きく低減できる効果がある。
第１図、第４図、第６図は本発明の液晶表示装置の画素
配列を示す図、第２図、第３図、第５図。 第７図、第８図は本発明による正極性と負極性ドライブ
する際の画素分割の例を示す図、第９図の空間−相対感
度に対する人間の視覚特性を示す図、第１０図は第１．
４．６図の各画素配列の一絵素（１駆動車位）の素子構
成の他の例を示す図、第１１図は液晶表示装置の等価回
路図、第１２図は第１１図の走査回路の動作を説明する
図、第１３図は従来の画素配列を示す図、第１４図、第
１５図は従来のフリッカ対策を説明する図である。 図において、１は液晶セル、２は記憶用コンデンサ、３
はＦＥＴ、４はＸ電極、５はＹ電極、６は走査回路、７
は直並列変換回路、８は共通電極、９はＲ，Ｇ、Ｂ交流
化回路。 なお図中同一符号は同−又は相当部分を示す。
配列を示す図、第２図、第３図、第５図。 第７図、第８図は本発明による正極性と負極性ドライブ
する際の画素分割の例を示す図、第９図の空間−相対感
度に対する人間の視覚特性を示す図、第１０図は第１．
４．６図の各画素配列の一絵素（１駆動車位）の素子構
成の他の例を示す図、第１１図は液晶表示装置の等価回
路図、第１２図は第１１図の走査回路の動作を説明する
図、第１３図は従来の画素配列を示す図、第１４図、第
１５図は従来のフリッカ対策を説明する図である。 図において、１は液晶セル、２は記憶用コンデンサ、３
はＦＥＴ、４はＸ電極、５はＹ電極、６は走査回路、７
は直並列変換回路、８は共通電極、９はＲ，Ｇ、Ｂ交流
化回路。 なお図中同一符号は同−又は相当部分を示す。
Claims (1)
- （１）ある配列順序に従って、マトリクス状に配置した
多数の画素より構成された一駆動単位である絵素からな
る液晶パネルと、 上記画素配列にて、フィールド周期で、液晶に印加する
電圧の極性を反転するように制御する交流化手段とを有
する液晶表示装置において、フルカラーを表現できる最
小絵素を構成する赤、緑、青の各画素を赤、緑、緑、青
の４つの絵素を四角形状に配置して１絵素を構成し、 上記交流化手段は、上記各画素をフィールド周期で極性
反転する際、同じフィールド内で、赤、緑の各画素領域
と青、緑の各画素領域とで、あるいは緑、緑の各画素領
域と赤、青の各画素領域とで、それらに印加する電圧の
極性が正負逆の関係となるように制御するものであるこ
とを特徴とする液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1215212A JP2983027B2 (ja) | 1989-08-21 | 1989-08-21 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1215212A JP2983027B2 (ja) | 1989-08-21 | 1989-08-21 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0378390A true JPH0378390A (ja) | 1991-04-03 |
| JP2983027B2 JP2983027B2 (ja) | 1999-11-29 |
Family
ID=16668555
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1215212A Expired - Fee Related JP2983027B2 (ja) | 1989-08-21 | 1989-08-21 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2983027B2 (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05216435A (ja) * | 1991-12-02 | 1993-08-27 | Nec Corp | 液晶表示装置の駆動方法 |
| US6552706B1 (en) | 1999-07-21 | 2003-04-22 | Nec Corporation | Active matrix type liquid crystal display apparatus |
| KR100660586B1 (ko) * | 2003-05-01 | 2006-12-21 | 세이코 엡슨 가부시키가이샤 | 유기 ｅｌ 장치 및 전자 기기 |
| US7196745B2 (en) | 2003-09-02 | 2007-03-27 | Sharp Kabushiki Kaisha | Active element substrate with simplified signal line arrangement having active elements and pixel electrodes and liquid crystal display device using the same |
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| WO2013099560A1 (ja) * | 2011-12-27 | 2013-07-04 | 三菱電機株式会社 | 表示装置 |
| EP1461801B1 (en) * | 2002-01-07 | 2015-09-16 | Samsung Display Co., Ltd. | Color flat panel display sub-pixel arrangements and layouts for sub-pixel rendering with split blue sub-pixels |
| US11594578B2 (en) | 2012-03-06 | 2023-02-28 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting display device |
| US11626068B2 (en) | 2012-03-06 | 2023-04-11 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
-
1989
- 1989-08-21 JP JP1215212A patent/JP2983027B2/ja not_active Expired - Fee Related
Cited By (19)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US7196745B2 (en) | 2003-09-02 | 2007-03-27 | Sharp Kabushiki Kaisha | Active element substrate with simplified signal line arrangement having active elements and pixel electrodes and liquid crystal display device using the same |
| US7440039B2 (en) | 2003-09-02 | 2008-10-21 | Sharp Kabushiki Kaisha | Active element substrate with simplified signal line arrangement having active elements and pixel electrodes and liquid crystal display device using the same |
| JPWO2013099560A1 (ja) * | 2011-12-27 | 2015-04-30 | 三菱電機株式会社 | 表示装置 |
| WO2013099560A1 (ja) * | 2011-12-27 | 2013-07-04 | 三菱電機株式会社 | 表示装置 |
| US11594578B2 (en) | 2012-03-06 | 2023-02-28 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting display device |
| US11626068B2 (en) | 2012-03-06 | 2023-04-11 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11626066B2 (en) | 2012-03-06 | 2023-04-11 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11626067B2 (en) | 2012-03-06 | 2023-04-11 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11626064B2 (en) | 2012-03-06 | 2023-04-11 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11651731B2 (en) | 2012-03-06 | 2023-05-16 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11676531B2 (en) | 2012-03-06 | 2023-06-13 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting diode display |
| US11980077B2 (en) | 2012-03-06 | 2024-05-07 | Samsung Display Co., Ltd. | Pixel arrangement structure for organic light emitting display device |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2983027B2 (ja) | 1999-11-29 |
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|---|---|---|---|
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