JPH0349564A - Ｄｃ―ａｃインバータ - Google Patents
Ｄｃ―ａｃインバータInfo
- Publication number
- JPH0349564A JPH0349564A JP1181969A JP18196989A JPH0349564A JP H0349564 A JPH0349564 A JP H0349564A JP 1181969 A JP1181969 A JP 1181969A JP 18196989 A JP18196989 A JP 18196989A JP H0349564 A JPH0349564 A JP H0349564A
- Authority
- JP
- Japan
- Prior art keywords
- pulse
- output
- circuit
- switching
- pulses
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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- 238000007493 shaping process Methods 0.000 claims abstract description 8
- 238000010586 diagram Methods 0.000 description 7
- 230000000630 rising effect Effects 0.000 description 5
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- 101150015217 FET4 gene Proteins 0.000 description 2
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- 101100484930 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) VPS41 gene Proteins 0.000 description 1
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Landscapes
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、複数のスイッチング素子を交互に動作させて
ＤＣ電源からＡＣ出力を得るＤＣ−ＡＣインバータに係
り、特に上記スイッチング素子に人力されるスイッチン
グパルスのバルスデューティに関する。
ＤＣ電源からＡＣ出力を得るＤＣ−ＡＣインバータに係
り、特に上記スイッチング素子に人力されるスイッチン
グパルスのバルスデューティに関する。
従来、発振回路からの発振パルスに基づいて生或される
スイッチングパルスにより、複数のスイッチング素子を
交互にオン、オフさせてＤＣ電源からＡＣ出力を得るよ
うになされたＤＣ−ＡＣインバータが提案されている（
特開昭６３−１３３８７６号公報）。
スイッチングパルスにより、複数のスイッチング素子を
交互にオン、オフさせてＤＣ電源からＡＣ出力を得るよ
うになされたＤＣ−ＡＣインバータが提案されている（
特開昭６３−１３３８７６号公報）。
第３図は上記従来のＤＣ−ＡＣインバータの回路図を示
すものである。この回路図の構或を簡単に説明すると、
このＤＣ−ＡＣインバータは、予め設定された周期パル
スを送出する発振回路１１、該発振回路１１の出力パル
スの立ち上がり及び立ち下がりの両時点で動作させ、そ
の動作信号からスイッチング素子のオン、オフを制御す
るスイッチングパルスを生或するタイミング回路１２、
このスイッチングパルス信号により駆動されるＦＥＴゲ
ートドライブ回路部１、２によりオン、オフを繰り返す
スイッチング素子としてのＦＥＴＩ〜４から或るスイッ
チング回路１３及びこのスイッチング出力を昇圧してＡ
Ｃ出力を送出するトランスｌ４からなっている。
すものである。この回路図の構或を簡単に説明すると、
このＤＣ−ＡＣインバータは、予め設定された周期パル
スを送出する発振回路１１、該発振回路１１の出力パル
スの立ち上がり及び立ち下がりの両時点で動作させ、そ
の動作信号からスイッチング素子のオン、オフを制御す
るスイッチングパルスを生或するタイミング回路１２、
このスイッチングパルス信号により駆動されるＦＥＴゲ
ートドライブ回路部１、２によりオン、オフを繰り返す
スイッチング素子としてのＦＥＴＩ〜４から或るスイッ
チング回路１３及びこのスイッチング出力を昇圧してＡ
Ｃ出力を送出するトランスｌ４からなっている。
上記ワンショットマルチ１は発振回路１１の出力パルス
の立ち上がりで動作し、一方、ワンショットマルチ２は
インバータＩｎｖｌにより極性反転されたパルスの立ち
上がり、すなわち発振回路１１の出力パルスの立ち下が
りで動作し、更にこれらの信号についてＡＮＤ回路１、
２でそれぞれアンドを取って、スイッチング信号を生或
している。そして、このスイッチング信号により、ＦＥ
Ｔ２とＦＥＴ３の組とＦＥＴＩとＦＥＴ４の組が交互に
オン、オフされ、これにより、トランス１４の１次側に
正逆の電流を流して２次側にＡＣ出力を得るようにして
いる。このようにして得られたトランス１４のＡＣ出力
の内、正極性側は発振回路１１の出力パルスのハイレベ
ル期間に対応するパルス幅を有し、一方、負極性側は発
振回路１１の出力パルスのローレベル期間に対応するパ
ルス輻を有している。
の立ち上がりで動作し、一方、ワンショットマルチ２は
インバータＩｎｖｌにより極性反転されたパルスの立ち
上がり、すなわち発振回路１１の出力パルスの立ち下が
りで動作し、更にこれらの信号についてＡＮＤ回路１、
２でそれぞれアンドを取って、スイッチング信号を生或
している。そして、このスイッチング信号により、ＦＥ
Ｔ２とＦＥＴ３の組とＦＥＴＩとＦＥＴ４の組が交互に
オン、オフされ、これにより、トランス１４の１次側に
正逆の電流を流して２次側にＡＣ出力を得るようにして
いる。このようにして得られたトランス１４のＡＣ出力
の内、正極性側は発振回路１１の出力パルスのハイレベ
ル期間に対応するパルス幅を有し、一方、負極性側は発
振回路１１の出力パルスのローレベル期間に対応するパ
ルス輻を有している。
ところが、発振回路から出力されるパルス列はパルスデ
ューティが１７２に設計するのが好ましいにも拘らず、
発振回路１４を構成する電子部品その他の特性に起因し
て、そのパルスデューティが必ずしも１／２になってい
るとは限らず、従って、係るパルスの立ち上がり時点と
立ち下がり時点をＭｉｆｉとしてスイッチングパルスを
生成すると、トランスの１次側に流れる正逆の電流の通
電時間に差を生じてトランスが一方に偏磁することとな
る。その結果、トランスの出力エネンルギーにロスを生
じるとともに、トランスが必要以上に発熱するという問
題があった。
ューティが１７２に設計するのが好ましいにも拘らず、
発振回路１４を構成する電子部品その他の特性に起因し
て、そのパルスデューティが必ずしも１／２になってい
るとは限らず、従って、係るパルスの立ち上がり時点と
立ち下がり時点をＭｉｆｉとしてスイッチングパルスを
生成すると、トランスの１次側に流れる正逆の電流の通
電時間に差を生じてトランスが一方に偏磁することとな
る。その結果、トランスの出力エネンルギーにロスを生
じるとともに、トランスが必要以上に発熱するという問
題があった。
本発明は上記に鑑みてなされたもので、パルスデューテ
ィが１７２のパルスに基づいてスイッチングパルスを生
成し、効率のよいＤＣ−ＡＣインバータを｛是｛共する
ことを目的とする。
ィが１７２のパルスに基づいてスイッチングパルスを生
成し、効率のよいＤＣ−ＡＣインバータを｛是｛共する
ことを目的とする。
本発明は、発振回路の出力信号に基づいて生成されるス
イッチング信号により複数のスイッチング素子がオン、
オフしてトランスの２次側にＡＣ出力を送出するＤＣ−
ＡＣインバータにおいて、上記発振回路の出力信号をバ
ルスデューティが１／２のパルスに整形した後スイッチ
ング信号を生成する手段に導くパルス整形手段を設けた
ことを特徴とするＤＣ−ＡＣインバータものである。
イッチング信号により複数のスイッチング素子がオン、
オフしてトランスの２次側にＡＣ出力を送出するＤＣ−
ＡＣインバータにおいて、上記発振回路の出力信号をバ
ルスデューティが１／２のパルスに整形した後スイッチ
ング信号を生成する手段に導くパルス整形手段を設けた
ことを特徴とするＤＣ−ＡＣインバータものである。
本発明によれば、発振回路の出力信号はパルスデューテ
ィが１／２のパルスに整形され、該整形されたパルスに
基づいてスイッチングパルスが生成される。そして、こ
のスイッチングパルスがスイッチング素子に人力されて
トランスを作動することにより、両極性波形の等しいＡ
Ｃ出力が得られる。
ィが１／２のパルスに整形され、該整形されたパルスに
基づいてスイッチングパルスが生成される。そして、こ
のスイッチングパルスがスイッチング素子に人力されて
トランスを作動することにより、両極性波形の等しいＡ
Ｃ出力が得られる。
第１図は本発明に係るＤＣ−ＡＣインバータの一例を示
す回路図、第２図は各部の波形図である図において、ｖ
Ｂは直流電源、あるいは商用電源を一旦整流、平滑した
直流電源である。
す回路図、第２図は各部の波形図である図において、ｖ
Ｂは直流電源、あるいは商用電源を一旦整流、平滑した
直流電源である。
１１は予め定められた周期パルス（第２図、バルスａ）
を送出する発振回路で、この周期パルスはｔ１期間のハ
イレベル部分とｔ２期間のローレベル部分とから成って
いる。この期間ｔ１とｔ２の値は、前述したように発振
回路１１を構成する電子部品その他の特性等に起因して
正確に一致させることは困難であり、多くの場合多少異
なっている。
を送出する発振回路で、この周期パルスはｔ１期間のハ
イレベル部分とｔ２期間のローレベル部分とから成って
いる。この期間ｔ１とｔ２の値は、前述したように発振
回路１１を構成する電子部品その他の特性等に起因して
正確に一致させることは困難であり、多くの場合多少異
なっている。
１２はフリップフロップＦＦ１、インバータＩｎｖｌ、
２個のワンショットマルチ１、２及び２個のＡＮＤ回路
からなるタイミング回路である。
２個のワンショットマルチ１、２及び２個のＡＮＤ回路
からなるタイミング回路である。
このタイミング回路１２は、後述するトランス１４を動
作させるスイッチング動作の基準信号を生成するもので
ある。すなわち、フリップフロップＦＦＩは上記バルス
ａの立ち上がり時点でノ＼イをに変化し、次周期のバル
スａの立ち上がり時点てローに変化するもので、該フリ
ップフロップＦＦ１の出力パルスはハイの期間とローの
期間が共に（ｔ１＋ｔ２）となる、パルスデューティ１
／２に整形されている（第２図、パルスｂ）。そして、
フリップフロップＦＦＩは発振回路１１の出力バルスａ
が入力される毎に、その出力を反転する。
作させるスイッチング動作の基準信号を生成するもので
ある。すなわち、フリップフロップＦＦＩは上記バルス
ａの立ち上がり時点でノ＼イをに変化し、次周期のバル
スａの立ち上がり時点てローに変化するもので、該フリ
ップフロップＦＦ１の出力パルスはハイの期間とローの
期間が共に（ｔ１＋ｔ２）となる、パルスデューティ１
／２に整形されている（第２図、パルスｂ）。そして、
フリップフロップＦＦＩは発振回路１１の出力バルスａ
が入力される毎に、その出力を反転する。
また、ワンショットマルチ１は上記フリップフロップＦ
ＦＩの出力バルスｂの立ち上がりで期間ｔｏのローパル
スを出力し（第２図、バルスｄ）、一方、ワンショット
マルチ２はフリップフロップＦＦＩの出力バルスｂをイ
ンバータＩｎｖｌで極性反転したパルス（第２図、パル
スＣ）の立ち上がりで期間ｔｏのローパルスを出力する
（第２図、パルスｅ）。
ＦＩの出力バルスｂの立ち上がりで期間ｔｏのローパル
スを出力し（第２図、バルスｄ）、一方、ワンショット
マルチ２はフリップフロップＦＦＩの出力バルスｂをイ
ンバータＩｎｖｌで極性反転したパルス（第２図、パル
スＣ）の立ち上がりで期間ｔｏのローパルスを出力する
（第２図、パルスｅ）。
次に、このようにして得られたバルスｂとパルスｄをＡ
ＮＤ回路１に導いてバルスｆを得、一方、バルスＣとパ
ルスｅをＡＮＤ回路２に導いてバルスｇを得る。従って
、上記バルスｆ１ｇのパルス幅は共に（ｔ１＋ｔ２−ｔ
Ｑ ）と等しくなる。
ＮＤ回路１に導いてバルスｆを得、一方、バルスＣとパ
ルスｅをＡＮＤ回路２に導いてバルスｇを得る。従って
、上記バルスｆ１ｇのパルス幅は共に（ｔ１＋ｔ２−ｔ
Ｑ ）と等しくなる。
１３は２個のＦＥＴゲートドライブ回路１、２及び４個
のスイッチング素子ＦＥＴＩ〜４からなるスイッチング
回路で、ＦＥＴゲートドライブ回路１には上記ＡＮＤ回
路１からのバルスｆが人力され、一方、ＦＥＴゲートド
ライブ回路２には上記Ａ Ｎ Ｄ回路２からのパルスｇ
が人力されている。
のスイッチング素子ＦＥＴＩ〜４からなるスイッチング
回路で、ＦＥＴゲートドライブ回路１には上記ＡＮＤ回
路１からのバルスｆが人力され、一方、ＦＥＴゲートド
ライブ回路２には上記Ａ Ｎ Ｄ回路２からのパルスｇ
が人力されている。
そして、このバルスｆＳｇによりＦＥＴＩ〜４がオン、
オフ制御される。すなわち、バルスｆによりＦＥＴ２と
ＦＥＴ３が、バルスｇにょりＦＥＴ１とＦＥＴ４が同時
にオン、あるいはオフを交互に繰り返し行うようになさ
れている。これにより、トランス１４の１次側に正逆波
形共に等しい（ｔ１ ＋ｔ２−ｔｏ ）期間の交流電流
が流れ、間欠的な矩形波のＡＣ出力が得られるので（第
２図、パルスｈ）、トランス１４内部のコイルに発生す
る正逆の磁束密度に偏りがなくなり、トランスに偏磁が
発生しなくなる。
オフ制御される。すなわち、バルスｆによりＦＥＴ２と
ＦＥＴ３が、バルスｇにょりＦＥＴ１とＦＥＴ４が同時
にオン、あるいはオフを交互に繰り返し行うようになさ
れている。これにより、トランス１４の１次側に正逆波
形共に等しい（ｔ１ ＋ｔ２−ｔｏ ）期間の交流電流
が流れ、間欠的な矩形波のＡＣ出力が得られるので（第
２図、パルスｈ）、トランス１４内部のコイルに発生す
る正逆の磁束密度に偏りがなくなり、トランスに偏磁が
発生しなくなる。
また、パルスデューティが正確に１／２となるような高
精度、かつ高価な発振回路を必要とすることがなくなる
。更に、発振波形も正確な矩形波に限らず、少なくとも
フリップフロップＦＦ］が作動可能な波形であれば一般
的な周期性波形であってもよい。
精度、かつ高価な発振回路を必要とすることがなくなる
。更に、発振波形も正確な矩形波に限らず、少なくとも
フリップフロップＦＦ］が作動可能な波形であれば一般
的な周期性波形であってもよい。
なお、本実施例ではパルスデューティを１／２に整形す
る手段としてフリップフロツブＦＦＩを用いて説明した
が、発振回路出力を、例えば計数手段を用いて期間が正
確に一致する出力パルスを得るようにしてもよい。
る手段としてフリップフロツブＦＦＩを用いて説明した
が、発振回路出力を、例えば計数手段を用いて期間が正
確に一致する出力パルスを得るようにしてもよい。
以上説明したように、本発明によれば、発振回路出力を
パルスデューティ１／２のパルスに整形した後、スイッ
チングパルスを生成するようにしたので、上記発振回路
出力のパルスデューティが１／２でない場合であっても
、あるいはパルスデューティを考慮しない発振回路を用
いた場合にも、トランスの変換効率を低下させることな
く、好適なＡＣ出力を得ることが出来る。
パルスデューティ１／２のパルスに整形した後、スイッ
チングパルスを生成するようにしたので、上記発振回路
出力のパルスデューティが１／２でない場合であっても
、あるいはパルスデューティを考慮しない発振回路を用
いた場合にも、トランスの変換効率を低下させることな
く、好適なＡＣ出力を得ることが出来る。
第１図は本発明に係るＤＣ−ＡＣインバータの一例を示
す回路図、第２図は各部の波形図、第３図は従来のＤＣ
−ＡＣインバータある。 １１・・・発振回路、１２・・・タイミング回路、１３
・・スイッチング回路、１４・・・トランス、ＦＦ１・
・・フリップフロップ（パルス整形手段）
す回路図、第２図は各部の波形図、第３図は従来のＤＣ
−ＡＣインバータある。 １１・・・発振回路、１２・・・タイミング回路、１３
・・スイッチング回路、１４・・・トランス、ＦＦ１・
・・フリップフロップ（パルス整形手段）
Claims (1)
- １、発振回路の出力信号に基づいて生成されるスイッチ
ング信号により複数のスイッチング素子がオン、オフし
てトランスの２次側にＡＣ出力を送出するＤＣ−ＡＣイ
ンバータにおいて、上記発振回路の出力信号をパルスデ
ューティが１／２のパルスに整形した後スイッチング信
号を生成する手段に導くパルス整形手段を設けたことを
特徴とするＤＣ−ＡＣインバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1181969A JPH0349564A (ja) | 1989-07-13 | 1989-07-13 | Ｄｃ―ａｃインバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1181969A JPH0349564A (ja) | 1989-07-13 | 1989-07-13 | Ｄｃ―ａｃインバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0349564A true JPH0349564A (ja) | 1991-03-04 |
Family
ID=16110031
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1181969A Pending JPH0349564A (ja) | 1989-07-13 | 1989-07-13 | Ｄｃ―ａｃインバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0349564A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9557079B2 (en) | 2010-07-14 | 2017-01-31 | Bright Energy Storage Technologies, Llp | System and method for storing thermal energy |
-
1989
- 1989-07-13 JP JP1181969A patent/JPH0349564A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9557079B2 (en) | 2010-07-14 | 2017-01-31 | Bright Energy Storage Technologies, Llp | System and method for storing thermal energy |
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