JPH03268300A - データ処理装置 - Google Patents
データ処理装置Info
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- JPH03268300A JPH03268300A JP2066687A JP6668790A JPH03268300A JP H03268300 A JPH03268300 A JP H03268300A JP 2066687 A JP2066687 A JP 2066687A JP 6668790 A JP6668790 A JP 6668790A JP H03268300 A JPH03268300 A JP H03268300A
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- 101100087530 Caenorhabditis elegans rom-1 gene Proteins 0.000 abstract 2
- 101100305983 Mus musculus Rom1 gene Proteins 0.000 abstract 2
- 238000000034 method Methods 0.000 description 5
- 230000014759 maintenance of location Effects 0.000 description 4
- 102100031584 Cell division cycle-associated 7-like protein Human genes 0.000 description 2
- 101000777638 Homo sapiens Cell division cycle-associated 7-like protein Proteins 0.000 description 2
- 238000013500 data storage Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
この発明はＥＥＰＲＯＭを使用したデータ処理装置に関
する。
する。
（従来の技術）
一般に、磁気ディスク等のファイル装置を持たない例え
ばワークステーション等のデータ処理装置においては、
そのデータ処理装置が動作するために必要なプログラム
、あるいはそのプログラムの動作態様等を切り替えるた
めの装置毎の固有情報は、上位装置からダウンロードさ
れて、そのデータ処理装置内に取り込まれる。
ばワークステーション等のデータ処理装置においては、
そのデータ処理装置が動作するために必要なプログラム
、あるいはそのプログラムの動作態様等を切り替えるた
めの装置毎の固有情報は、上位装置からダウンロードさ
れて、そのデータ処理装置内に取り込まれる。
近年、これら上位装置からロードされる情報量は非常に
多くなり、データ転送速度が向上されたとはいっても、
そのロードにはかなり多くの時間が必要である。このた
め、最近では、上位装置からロードした情報をデータ処
理装置内部で保持するために、（ａ）電池によるメモリ
のバックアップ、（ｂ）補助電源によるメモリのバック
アップ、（Ｃ）電気的にデータの書き替えが可能な不揮
発性半導体メモリ（ＥＥＰＲＯＭ）を使用する、といっ
た方式が採用されている。
多くなり、データ転送速度が向上されたとはいっても、
そのロードにはかなり多くの時間が必要である。このた
め、最近では、上位装置からロードした情報をデータ処
理装置内部で保持するために、（ａ）電池によるメモリ
のバックアップ、（ｂ）補助電源によるメモリのバック
アップ、（Ｃ）電気的にデータの書き替えが可能な不揮
発性半導体メモリ（ＥＥＰＲＯＭ）を使用する、といっ
た方式が採用されている。
これら方式のうち、ＥＥＰＲＯＭを使用する方式におい
ては、情報保持の信頼性が低いという欠点がある。なぜ
なら、ＥＥＰＲＯＭにはそのデバイス毎に書き込み許容
回数が規定されており、その書き込み許容回数を越える
とデータ書き込みを正常に実行できなくなる特性がある
ためである。
ては、情報保持の信頼性が低いという欠点がある。なぜ
なら、ＥＥＰＲＯＭにはそのデバイス毎に書き込み許容
回数が規定されており、その書き込み許容回数を越える
とデータ書き込みを正常に実行できなくなる特性がある
ためである。
（発明が解決しようとする課題）
従来では、ＥＥＰＲＯＭを使用して情報を保持する従来
のデータ処理装置では、ＥＥＰＲＯＭの書き込み許容回
数を越えるとデータ書き込みを正常に実行できなくなり
、これによって情報保持の信頼性が低い欠点があった。
のデータ処理装置では、ＥＥＰＲＯＭの書き込み許容回
数を越えるとデータ書き込みを正常に実行できなくなり
、これによって情報保持の信頼性が低い欠点があった。
この発明はこの様な点に鑑みてなされたもので、ＥＥＰ
ＲＯＭの書き込み許容回数をデータ処理装置自信で管理
できるようにし、充分に情報保持の信頼性が高いデータ
処理装置を提供することを目的とする。
ＲＯＭの書き込み許容回数をデータ処理装置自信で管理
できるようにし、充分に情報保持の信頼性が高いデータ
処理装置を提供することを目的とする。
［発明の構成］
（課題を解決するための手段）
この発明によるデータ処理装置は、予め定められた書き
込み許容回数が記憶される許容回数記憶領域および実行
された書き込み回数が記憶される実書き込み回数記憶領
域を有するＥＥＰＲＯＭと、このＥＥＰＲＯＭへのデー
タ書き込みおよびデータ読み出しを行うアクセス手段と
、前記ＥＥＰＲＯＭへのデータ書き込み時に前記実書き
込み回数記憶領域の内容を更新する更新手段と、前記書
き込み許容回数記憶領域の内容と前記実書き込み回数記
憶領域の内容を比較し、その差に基づいて前記ＥＥＰＲ
ＯＭへのデータ書き込みが実行可能か否かを検出する検
出手段とを具備することを第１の特徴とする。
込み許容回数が記憶される許容回数記憶領域および実行
された書き込み回数が記憶される実書き込み回数記憶領
域を有するＥＥＰＲＯＭと、このＥＥＰＲＯＭへのデー
タ書き込みおよびデータ読み出しを行うアクセス手段と
、前記ＥＥＰＲＯＭへのデータ書き込み時に前記実書き
込み回数記憶領域の内容を更新する更新手段と、前記書
き込み許容回数記憶領域の内容と前記実書き込み回数記
憶領域の内容を比較し、その差に基づいて前記ＥＥＰＲ
ＯＭへのデータ書き込みが実行可能か否かを検出する検
出手段とを具備することを第１の特徴とする。
また、この発明によるデータ処理装置は、書き込み可能
残余回数が記憶される残余回数記憶領域を有するＥＥＰ
ＲＯＭと、このＥＥＰＲＯＭへのデータ書き込みおよび
データ読み出しを行うアクセス手段と、前記ＥＥＰＲＯ
Ｍへのデータ書き込み時に前記残余回数記憶領域の内容
を更新する更新手段と、前記残余回数記憶領域の内容に
基づいて前記ＥＥＰＲＯＭへのデータ書き込みが実行可
能か否かを検出する検出手段とを具備することを第２の
特徴とする。
残余回数が記憶される残余回数記憶領域を有するＥＥＰ
ＲＯＭと、このＥＥＰＲＯＭへのデータ書き込みおよび
データ読み出しを行うアクセス手段と、前記ＥＥＰＲＯ
Ｍへのデータ書き込み時に前記残余回数記憶領域の内容
を更新する更新手段と、前記残余回数記憶領域の内容に
基づいて前記ＥＥＰＲＯＭへのデータ書き込みが実行可
能か否かを検出する検出手段とを具備することを第２の
特徴とする。
（作用）
このデータ処理装置においては、
ＥＥＰＲＯＭの記憶領域の内容によって書き込み許容回
数を管理しているので、常にそのＥＥＰＲＯＭの書き込
み許容回数を管理した状態でデータ書き込みを実行する
ことができ、充分に情報保持の信頼性が高いデータ処理
装置が提供できる。
数を管理しているので、常にそのＥＥＰＲＯＭの書き込
み許容回数を管理した状態でデータ書き込みを実行する
ことができ、充分に情報保持の信頼性が高いデータ処理
装置が提供できる。
（実施例）
以下、図面を参照して、この発明の実施例を説明する。
第１図にはこの発明の第１実施例に係わるデータ処理装
置が示されている。このデータ処理装置は、例えばワー
クステーションのように磁気ディスク等のファイル装置
を持たないデータ処理装置であり、ＥＥＰＲＯＭＩ 、
ＲＡＭ２ 、リード／ライト制御ユニット（ＲＷＣ）３
、ＣＰＵ４、比較ユニット（ＣＭＰ）５ 、および表
示装置（ＤＳＰ）Ｂを備えている。
置が示されている。このデータ処理装置は、例えばワー
クステーションのように磁気ディスク等のファイル装置
を持たないデータ処理装置であり、ＥＥＰＲＯＭＩ 、
ＲＡＭ２ 、リード／ライト制御ユニット（ＲＷＣ）３
、ＣＰＵ４、比較ユニット（ＣＭＰ）５ 、および表
示装置（ＤＳＰ）Ｂを備えている。
ＥＥＰＲＯＭＩは、例えば上位接続装置からこのデータ
処理装置にロードされるプログラムや他の各種データを
保持しておくためのものであり、このＥＥＰＲＯＭＩの
データ記憶領域の一部は、書き込み許容回数記憶領域１
ａと実書き込み回数記憶領域１ｂとして割り当てられて
いる。書き込み許容回数記憶領域１ａには、ＥＥＰＲＯ
ＭＩに予め定められている書き込み許容回数が記憶され
、また実書き込み回数記憶領域１ｂには、ＥＥＰＲＯＭ
Ｉへのデータ書き込みが実際に実行された回数が記憶さ
れている。
処理装置にロードされるプログラムや他の各種データを
保持しておくためのものであり、このＥＥＰＲＯＭＩの
データ記憶領域の一部は、書き込み許容回数記憶領域１
ａと実書き込み回数記憶領域１ｂとして割り当てられて
いる。書き込み許容回数記憶領域１ａには、ＥＥＰＲＯ
ＭＩに予め定められている書き込み許容回数が記憶され
、また実書き込み回数記憶領域１ｂには、ＥＥＰＲＯＭ
Ｉへのデータ書き込みが実際に実行された回数が記憶さ
れている。
ＲＡＭ２は、ＣＰＵ４が動作するために必要なプログラ
ムや他の各種データを格納するためのものである。リー
ド／ライト制御ユニット３は、ＣＰＵ４の制御の下で、
ＥＥＰＲＯ旧およびＲＡＭ２それぞれに対するデータ書
き込み／読み出しを実行する。ＣＰＵ４はこのデータ処
理全体の動作を制御するためのものであり、リード／ラ
イト制御ユニット３と共同して、ＥＥＰＲＯＭＩの書き
込み許容回数記憶領域１ａへの書き込み許容回数の書き
込み／読み出し処理を実行すると共に、実書き込み回数
記憶領域１ｂへの実書き込み回数の書き込み／読み出し
処理を実行する。
ムや他の各種データを格納するためのものである。リー
ド／ライト制御ユニット３は、ＣＰＵ４の制御の下で、
ＥＥＰＲＯ旧およびＲＡＭ２それぞれに対するデータ書
き込み／読み出しを実行する。ＣＰＵ４はこのデータ処
理全体の動作を制御するためのものであり、リード／ラ
イト制御ユニット３と共同して、ＥＥＰＲＯＭＩの書き
込み許容回数記憶領域１ａへの書き込み許容回数の書き
込み／読み出し処理を実行すると共に、実書き込み回数
記憶領域１ｂへの実書き込み回数の書き込み／読み出し
処理を実行する。
比較ユニット（ＣＭＰ）５は、ＣＰＵ４の制御の下でＥ
ＥＰＲＯＭＩの書き込み許容回数記憶領域１ａに記憶さ
れている内容と実書き込み回数記憶領域１ｂに記憶され
ている内容を比較し、その比較結果をＣＰＵ４に通知す
る。実書き込み回数が書き込み許容回数に到達した場合
には、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書き込み
動作が実行できないことを表示装置６に画面表示してオ
ペレータに通知する。
ＥＰＲＯＭＩの書き込み許容回数記憶領域１ａに記憶さ
れている内容と実書き込み回数記憶領域１ｂに記憶され
ている内容を比較し、その比較結果をＣＰＵ４に通知す
る。実書き込み回数が書き込み許容回数に到達した場合
には、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書き込み
動作が実行できないことを表示装置６に画面表示してオ
ペレータに通知する。
次に、第１図に示したデータ処理装置の動作を説明する
。ＥＥＰＲＯＭＩに最初にデータを書き込む時には、Ｃ
ＰＵ４はリード／ライトユニット３を通じて、予め定め
られた書き込み許容回数を書き込み許容回数記憶領域１
ａに書き込みと共に、実書き込み回数として「１」を実
書き込み回数記憶領域１．ｂに書き込む。
。ＥＥＰＲＯＭＩに最初にデータを書き込む時には、Ｃ
ＰＵ４はリード／ライトユニット３を通じて、予め定め
られた書き込み許容回数を書き込み許容回数記憶領域１
ａに書き込みと共に、実書き込み回数として「１」を実
書き込み回数記憶領域１．ｂに書き込む。
ＥＥＰＲＯＭＩへの２回目以降のデータ書き込みに際し
ては、ＣＰＵ４はリード／ライトユニット３を通じて書
き込み許容回数記憶領域１ａの内容と実書き込み回数記
憶領域１ｂの内容を読み出し、それを比較ユニット５に
比較させる。書き込み許容回数記憶領域１ａの内容と実
書き込み回数記憶領域１ｂの内容が一致しない場合には
、ＣＰＵ４はＥＥＰＲＯＭＩへのデータ書き込みを許可
すると共に、実書き込み回数記憶領域１ｂの内容を＋１
増分する。一方、書き込み許容回数記憶領域１ａの内容
と実書き込み回数記憶領域ｌｂの内容が一致した場合に
は、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書き込みを
禁止すると共に、ＥＥＰＲＯＭＩへのデータ書き込み動
作が実行できないことを表示装置６に画面表示してオペ
レータに書き込み回数が寿命に達したことを通知する。
ては、ＣＰＵ４はリード／ライトユニット３を通じて書
き込み許容回数記憶領域１ａの内容と実書き込み回数記
憶領域１ｂの内容を読み出し、それを比較ユニット５に
比較させる。書き込み許容回数記憶領域１ａの内容と実
書き込み回数記憶領域１ｂの内容が一致しない場合には
、ＣＰＵ４はＥＥＰＲＯＭＩへのデータ書き込みを許可
すると共に、実書き込み回数記憶領域１ｂの内容を＋１
増分する。一方、書き込み許容回数記憶領域１ａの内容
と実書き込み回数記憶領域ｌｂの内容が一致した場合に
は、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書き込みを
禁止すると共に、ＥＥＰＲＯＭＩへのデータ書き込み動
作が実行できないことを表示装置６に画面表示してオペ
レータに書き込み回数が寿命に達したことを通知する。
この様に、このデータ処理装置では、
ＥＥＰＲＯＭＩの書き込み許容回数記憶領域１ａおよび
実書き込み回数記憶領域１ｂの内容によって書き込み許
容回数を管理しているので、常にそのＥＥＰＲＯＭの書
き込み許容回数を管理した状態でＥＥＰＲＯＭを運用す
ることができる。
実書き込み回数記憶領域１ｂの内容によって書き込み許
容回数を管理しているので、常にそのＥＥＰＲＯＭの書
き込み許容回数を管理した状態でＥＥＰＲＯＭを運用す
ることができる。
なお、ここでは書き込み許容回数到達時点で書き込み動
作の不許可通知を発生する場合を説明したが、それ以前
の書き込み動作時に書き込み可能残余回数が少ないこと
を通知するような構成にしでも良い。また、書き込み動
作の不許可通知を表示装置６に表示する例を説明したが
、上位装置に対してログアウトを行っても良い。
作の不許可通知を発生する場合を説明したが、それ以前
の書き込み動作時に書き込み可能残余回数が少ないこと
を通知するような構成にしでも良い。また、書き込み動
作の不許可通知を表示装置６に表示する例を説明したが
、上位装置に対してログアウトを行っても良い。
次に、第２図を参照して、この発明の第２実施例に係わ
るデータ処理装置を説明する。
るデータ処理装置を説明する。
この第２実施例のデータ処理装置においては、書き込み
許容回数記憶領域１ａ、および実書き込み回数記憶領域
１ｂの代わりに、書き込み可能残余回数記憶領域ＩＣが
、ＥＥＰＲＯＭＩのデータ記憶領域の一部に割り当てら
れている。また、第１実施例の比較ユニット５の代わり
に、書き込み許容回数記憶領域１ａから読み出した書き
込み許容回数の値を一１減分するデクリメントユニット
７が設けられている。
許容回数記憶領域１ａ、および実書き込み回数記憶領域
１ｂの代わりに、書き込み可能残余回数記憶領域ＩＣが
、ＥＥＰＲＯＭＩのデータ記憶領域の一部に割り当てら
れている。また、第１実施例の比較ユニット５の代わり
に、書き込み許容回数記憶領域１ａから読み出した書き
込み許容回数の値を一１減分するデクリメントユニット
７が設けられている。
ＥＥＰＲＯＭＩに最初にデータを書き込む時には、その
データ書き込みと同時に、ＣＰＵ４はリード／ライトユ
ニット３を通じて、予め定められた書き込み許容回数を
書き込み可能残余回数として書き込み可能残余回数記憶
領域１ｃに書き込む。
データ書き込みと同時に、ＣＰＵ４はリード／ライトユ
ニット３を通じて、予め定められた書き込み許容回数を
書き込み可能残余回数として書き込み可能残余回数記憶
領域１ｃに書き込む。
ＥＥＰＲＯＭＩへの２回目以降のデータ書き込みに際し
ては、ＣＰＵ４はリード／ライトユニット３を通じて書
き込み可能残余回数記憶領域１ｃの内容を読み出し、そ
の値をデクリメントユニット７によって一１減分する。
ては、ＣＰＵ４はリード／ライトユニット３を通じて書
き込み可能残余回数記憶領域１ｃの内容を読み出し、そ
の値をデクリメントユニット７によって一１減分する。
この減分の結果が「０」でない場合には、ＣＰＵ４はＥ
ＥＰＲＯＭＩへのデータ書き込みを許可すると共に、デ
クリメント０ ユニット７によって減分された値を書き込み可能残余回
数記憶領域１ｃに書き込む。一方、減分の結果が「０」
の場合には、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書
き込みを禁止すると共に、ＥＥＰＲＯＭＩへのデータ書
き込み動作が実行できないことを表示装置６に画面表示
してオペレータに書き込み回数が寿命に達したことを通
知する。
ＥＰＲＯＭＩへのデータ書き込みを許可すると共に、デ
クリメント０ ユニット７によって減分された値を書き込み可能残余回
数記憶領域１ｃに書き込む。一方、減分の結果が「０」
の場合には、ＣＰＵ４は、ＥＥＰＲＯＭＩへのデータ書
き込みを禁止すると共に、ＥＥＰＲＯＭＩへのデータ書
き込み動作が実行できないことを表示装置６に画面表示
してオペレータに書き込み回数が寿命に達したことを通
知する。
なお、この第２実施例においても、書き込み可能残余回
数が「０」に到達した時点で書き込み動作の不許可通知
を発生する場合に限らず、それ以前の書き込み動作時に
書き込み可能残余回数が少ないことをオペレータに通知
するような構成にしても良い。また、上位装置へログア
ウトすることも可能である。
数が「０」に到達した時点で書き込み動作の不許可通知
を発生する場合に限らず、それ以前の書き込み動作時に
書き込み可能残余回数が少ないことをオペレータに通知
するような構成にしても良い。また、上位装置へログア
ウトすることも可能である。
［発明の効果］
以上のように、この発明によれば、
ＥＥＰＲＯＭ（７）書き込み許容回数をデータ処理装置
自信で管理できるようになり、充分に情報保持の信頼性
が高いデータ処理装置を提供される。
自信で管理できるようになり、充分に情報保持の信頼性
が高いデータ処理装置を提供される。
１
第１図はこの発明の第１実施例に係わるデータ処理装置
を示すブロック図、第２図はこの発明の第２実施例に係
わるデータ処理装置を示すブロック図である。 １ ・・・ＥＥＰＲＯＭ、２ ・・・ＲＡＭ、３ ・・
・リード／ライトユニット、４・・・ＣＰＵ、５・・・
比較ユニット、Ｂ・・・表示装置、７・・・デクリメン
トユニット、１ａ・・・書き込み許容回数記憶領域、ｌ
ｂ・・・実書き込み回数記憶領域、ＩＣ・・・書き込み
可能残余回数記憶領域。
を示すブロック図、第２図はこの発明の第２実施例に係
わるデータ処理装置を示すブロック図である。 １ ・・・ＥＥＰＲＯＭ、２ ・・・ＲＡＭ、３ ・・
・リード／ライトユニット、４・・・ＣＰＵ、５・・・
比較ユニット、Ｂ・・・表示装置、７・・・デクリメン
トユニット、１ａ・・・書き込み許容回数記憶領域、ｌ
ｂ・・・実書き込み回数記憶領域、ＩＣ・・・書き込み
可能残余回数記憶領域。
Claims (2)
- （１）予め定められた書き込み許容回数が記憶される許
容回数記憶領域および実行された書き込み回数が記憶さ
れる実書き込み回数記憶領域を有するＥＥＰＲＯＭと、
このＥＥＰＲＯＭへのデータ書き込みおよびデータ読み
出しを行うアクセス手段と、前記ＥＥＰＲＯＭへのデー
タ書き込み時に前記実書き込み回数記憶領域の内容を更
新する更新手段と、前記書き込み許容回数記憶領域の内
容と前記実書き込み回数記憶領域の内容を比較し、その
差に基づいて前記ＥＥＰＲＯＭへのデータ書き込みが実
行可能か否かを検出する検出手段とを具備することを特
徴とするデータ処理装置。 - （２）書き込み可能残余回数が記憶される残余回数記憶
領域を有するＥＥＰＲＯＭと、このＥＥＰＲＯＭへのデ
ータ書き込みおよびデータ読み出しを行うアクセス手段
と、前記ＥＥＰＲＯＭへのデータ書き込み時に前記残余
回数記憶領域の内容を更新する更新手段と、前記残余回
数記憶領域の内容に基づいて前記ＥＥＰＲＯＭへのデー
タ書き込みが実行可能か否かを検出する検出手段とを具
備することを特徴とするデータ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2066687A JPH03268300A (ja) | 1990-03-16 | 1990-03-16 | データ処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2066687A JPH03268300A (ja) | 1990-03-16 | 1990-03-16 | データ処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03268300A true JPH03268300A (ja) | 1991-11-28 |
Family
ID=13323096
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2066687A Pending JPH03268300A (ja) | 1990-03-16 | 1990-03-16 | データ処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03268300A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100446807B1 (ko) * | 2001-12-28 | 2004-09-04 | 주식회사 하이닉스반도체 | 프로세서와 메모리간의 제어 시스템 및 그 방법 |
| CN111370048A (zh) * | 2018-12-25 | 2020-07-03 | 北京兆易创新科技股份有限公司 | 一种非易失存储器编程状态处理方法以及装置 |
-
1990
- 1990-03-16 JP JP2066687A patent/JPH03268300A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100446807B1 (ko) * | 2001-12-28 | 2004-09-04 | 주식회사 하이닉스반도체 | 프로세서와 메모리간의 제어 시스템 및 그 방법 |
| CN111370048A (zh) * | 2018-12-25 | 2020-07-03 | 北京兆易创新科技股份有限公司 | 一种非易失存储器编程状态处理方法以及装置 |
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