JPH03258051A - Data transmitter - Google Patents
Data transmitterInfo
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- JPH03258051A JPH03258051A JP5697290A JP5697290A JPH03258051A JP H03258051 A JPH03258051 A JP H03258051A JP 5697290 A JP5697290 A JP 5697290A JP 5697290 A JP5697290 A JP 5697290A JP H03258051 A JPH03258051 A JP H03258051A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデータ伝送装置に関し、特に、複数台の端末装
置が１つのデータ伝送路に接続されるマルチポイント接
続可能なデータ伝送装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a data transmission device, and particularly to a data transmission device capable of multi-point connection in which a plurality of terminal devices are connected to one data transmission path.
従来のこの種のマルチポイント接続可能なデータ伝送装
置では、端末装置から送信される送信可能状態を示すデ
ータ端末レディ信号のオン／オフ状態に無関係に、端末
装置からの送信要求信号があればリンクを確立していた
。In conventional data transmission devices of this type that can be connected to multiple points, the link is established if there is a transmission request signal from the terminal device, regardless of the on/off state of the data terminal ready signal that indicates the transmission ready state transmitted from the terminal device. had been established.
上述した従来のデータ伝送装置では、端末装置の電源が
断となり、端末装置との接続ケーブルが外れた場合に、
データ端末レディ信号がなくとも外来ノイズや接続ケー
ブル内での漏話等により送信要求信号ラインにピーク性
のノイズが発生し、リンク確立が行われてしまうという
誤動作が発生し、他の正常な端末装置の通信を妨害する
という欠点がある。In the conventional data transmission device described above, when the power to the terminal device is cut off and the connection cable to the terminal device is disconnected,
Even if there is no data terminal ready signal, peak noise occurs on the transmission request signal line due to external noise or crosstalk within the connection cable, causing a malfunction in which a link is established, and other normal terminal devices It has the disadvantage of interfering with communications.
本発明の目的は上述した欠点を除去し、外来ノイズや接
続ケーブル内での漏話等の望ましからざる信号によるリ
ンク確立の誤動作を排除したデータ伝送装置を提供する
ことにある。SUMMARY OF THE INVENTION An object of the present invention is to eliminate the above-mentioned drawbacks and to provide a data transmission device that eliminates link establishment malfunctions caused by undesirable signals such as external noise and crosstalk within a connecting cable.
本発明のデータ伝送装置は、複数台のデータ伝送装置を
１本のデータ伝送路にマルチ接続し、前記複数台のデー
タ伝送装置のうちの１台に接続されたホストコンピュー
タからのポーリング信号に対し前記データ伝送装置に接
続された端末装置から送信要求信号を返信することによ
りリンクを確立するマルチポイント接続可能なデータ伝
送装置において、前記端末装置から前記データ伝送装置
に送信されるデータ端末レディ信号を受け前記データ端
末レディ信号が所定のパルス幅を有する場合のみ前記デ
ータ伝送装置における前記端末装置との接続状態を形威
し、前記データ端末レディ信号がオフの場合もしくは所
定のパルス幅に満たないときには前記データ伝送装置に
おける前記端末装置との接続状態を断とする手段を備え
て構成される。The data transmission device of the present invention connects a plurality of data transmission devices to one data transmission path, and responds to a polling signal from a host computer connected to one of the plurality of data transmission devices. In a data transmission device capable of multi-point connection, which establishes a link by returning a transmission request signal from a terminal device connected to the data transmission device, a data terminal ready signal transmitted from the terminal device to the data transmission device is provided. The connection state of the data transmission device with the terminal device is confirmed only when the received data terminal ready signal has a predetermined pulse width, and when the data terminal ready signal is off or less than the predetermined pulse width. The data transmission device is configured to include means for disconnecting the data transmission device from the terminal device.
また本発明のデータ伝送装置は、前記データ端末レディ
信号のパルス幅が所定のパルス幅を満たすか否かの判定
を論理ゲートの組合せ構成によって行なう構成を有する
。Furthermore, the data transmission device of the present invention has a configuration in which a combination of logic gates determines whether the pulse width of the data terminal ready signal satisfies a predetermined pulse width.
次に、図面を参照して本発明を説明する。 Next, the present invention will be explained with reference to the drawings.
第１図は本発明のデータ伝送装置の一実施例の構成国で
ある。第１図に示す実施例は、リンク確立して通信すべ
きデータ伝送装置ｌおよび端末装置２と、インタフェー
スケーブル３とを備え、またデータ伝送装置１は、セレ
クタ１１と、パルス幅検出回路１２と、インタフェース
回路１３とを備えて成り５パルス幅検出回路１２が本発
明に直接かかわる構成である。FIG. 1 shows the constituent countries of an embodiment of the data transmission device of the present invention. The embodiment shown in FIG. 1 includes a data transmission device 1 to establish a link and communicate, a terminal device 2, and an interface cable 3, and the data transmission device 1 includes a selector 11, a pulse width detection circuit 12, and a terminal device 2. , and an interface circuit 13.The pulse width detection circuit 12 is a configuration directly related to the present invention.
次に、第１図の実施例の動作について説明する。Next, the operation of the embodiment shown in FIG. 1 will be explained.
端末装置２からは、データ伝送装置１との連接動作可能
な状態を示すパルス状のデータ端末レディ信号２１と、
送信要求信号２２がインタフェースケーブル３を介して
伝送装置１に送出され、また受信クロック情報としての
受信信号エレメントタイミング信号２３．２４等がデー
タ伝送装置１からインタフェースケーブル３を介して端
末装置２に送出される。From the terminal device 2, a pulse-shaped data terminal ready signal 21 indicating a state in which connection with the data transmission device 1 is possible;
A transmission request signal 22 is sent to the transmission device 1 via the interface cable 3, and reception signal element timing signals 23, 24, etc. as reception clock information are sent from the data transmission device 1 to the terminal device 2 via the interface cable 3. be done.
端末装置２からのデータ端末レディ信号２１は、データ
伝送装置１に入力され、パルス幅検出回路２で所定幅以
上の正常なパルスで゛あるか否かを監視される。所定の
一定幅以上のパルスであるときはパルス幅検出回路１２
の出力がオンとなり、セレクト人力１２１がセレクタ１
１に入力される。A data terminal ready signal 21 from the terminal device 2 is input to the data transmission device 1, and is monitored by the pulse width detection circuit 2 to see if it is a normal pulse with a predetermined width or more. If the pulse has a predetermined width or more, the pulse width detection circuit 12
The output of is turned on, and the selector 121 becomes the selector 1.
1 is input.
セレクタ１１．はセレクト人力１２１がオンのときター
ミナルＡｌ−Ａｎの入力、オフのときはターミナルＢ１
〜Ｂｎの入力を選択し、ターミナルＡ１〜Ａｎの入力を
選択したときは、データ伝送装置ｌと端末装置２とが接
続状態に保持される。また、データ端末レディ信号２１
がオフとなると、セレクタ１１はターミナルＢｌ〜Ｂｎ
を選択する為、データ伝送装置１と端末装置２は切状態
となり、端末装置２の電源断時もしくはインタフェース
ケーブル３の断時等におけるノイズによる誤動作を防止
することができる。第２図に、パルス幅検出回路１２の
一例を示す。Selector 11. is input to terminal Al-An when select human power 121 is on, and input to terminal B1 when it is off.
When the inputs of terminals A1 to An are selected, the data transmission device 1 and the terminal device 2 are maintained in a connected state. In addition, the data terminal ready signal 21
is turned off, the selector 11 selects the terminals Bl to Bn.
In order to select , the data transmission device 1 and the terminal device 2 are turned off, and it is possible to prevent malfunctions due to noise when the terminal device 2 is powered off or the interface cable 3 is disconnected. FIG. 2 shows an example of the pulse width detection circuit 12.
パルス幅検出回路１２は、モノマルチ回路１゜１とＮＡ
ＮＤゲート１０４を備えて戒り、モノマルチ回路１０１
にはワンショットマルチバイブレータ動作の時定数を設
定するコンデンサ１０２と抵抗１０３が接続され、論理
値“０”レベルのモノマルチ出力をＱ端子に出力しＮＡ
ＮＤゲート１０４に供給する。いま、ターミナルａを介
して正しいパルス幅のデータ端末レディ信号２１を受け
るとモノマルチ回Ｎ１０１からは論理値“０″レベル出
力をＮＡＮＤゲート１０４の１人力として出力とし、ま
たＮＡＮＤゲート１０４の他入力には論理値“１パレベ
ルのデータ端末レディ信号２１のパルスが入力し、ＮＡ
ＮＤゲート１０４からは°°１°ルベルのセレクト信号
１２１が出力される。The pulse width detection circuit 12 is connected to the mono multi-circuit 1゜1 and the NA
A mono multi-circuit 101 equipped with an ND gate 104
A capacitor 102 and a resistor 103 that set the time constant of the one-shot multivibrator operation are connected to the terminal, and a mono multi-output with a logic value "0" level is output to the Q terminal and the NA
ND gate 104 is supplied. Now, when the data terminal ready signal 21 with the correct pulse width is received through the terminal a, the mono-multi circuit N101 outputs a logic value "0" level as one output of the NAND gate 104, and also outputs the other inputs of the NAND gate 104. The pulse of the data terminal ready signal 21 with the logical value "1 PA level" is input to the NA
The ND gate 104 outputs a select signal 121 of °°1° level.
パルス幅検出回路１２は、正しいパルス幅のデータ端末
レディ信号２１の入力に対してのみセレクト入力１２１
を発生してセレクタ１１をターミナルＡ１〜Ａｎ接続と
し それ以外の場合はセレクタ１１をターミナルＢ１〜
Ｂｎ接続としてインタフェース回路１３を従ってデータ
伝送装置１と端末装置２との接続を断とする。これによ
り、端末装置２において、その電源が断となったり、ま
たインタフェースケーブル３が外れたりした場合に、外
来ノイズ、インタフェースケーブル３内での漏話等によ
って送信要求信号２２にピーク性のノイズが重畳してリ
ンク確立が行なわれる誤動作を排除できる。The pulse width detection circuit 12 selects the select input 121 only for the input of the data terminal ready signal 21 with the correct pulse width.
is generated and connects the selector 11 to terminals A1 to An. Otherwise, connects the selector 11 to terminals B1 to An.
As a Bn connection, the interface circuit 13 is thus disconnected between the data transmission device 1 and the terminal device 2. As a result, when the terminal device 2 is powered off or the interface cable 3 is disconnected, peak noise is superimposed on the transmission request signal 22 due to external noise, crosstalk within the interface cable 3, etc. It is possible to eliminate malfunctions caused by link establishment.
以上説明したように本発明は、端末装置からのデータ端
末レディ信号がオフのときは、デ・−夕伝送装置と端末
装置との接続を断とするように構成することにより、端
末装置の電源断、接続ケーブルが外れた場合等に発生す
るインタフェースケーブルでの漏話、外来ノイズ等によ
るリンク確立の誤動作を防止することができる効果があ
る。As explained above, the present invention is configured such that when the data terminal ready signal from the terminal device is off, the connection between the data transmission device and the terminal device is disconnected, thereby reducing the power supply of the terminal device. This has the effect of preventing malfunctions in link establishment due to crosstalk in the interface cable, external noise, etc. that occur when the connection cable is disconnected or disconnected.
第１図は本発明のデータ伝送装置の一実施例を示すブロ
ック図、第２図は第１図の実施例の！＜ルス幅検出回路
のブロック図である。
１・・・データ伝送装置、２・・・端末装置、１１・・
・セレクタ、１２・・・パルス幅検出回路、１３・・・
インタフェース回路、２１・・・データ端末レディ信号
、２２・・・送信要求信号、２３・・・受信信号エレメ
ントタイミング、２４・・・送信信号エレメントタイミ
ング、１０１・・・モノマルチ回路、１０２・・・コン
デンサ、１０３・・・抵抗、１０４・・・ＮＡＮＤゲー
ト。FIG. 1 is a block diagram showing an embodiment of the data transmission device of the present invention, and FIG. 2 is a block diagram of the embodiment of FIG. 1. <It is a block diagram of a pulse width detection circuit. 1... Data transmission device, 2... Terminal device, 11...
・Selector, 12...Pulse width detection circuit, 13...
Interface circuit, 21... Data terminal ready signal, 22... Transmission request signal, 23... Reception signal element timing, 24... Transmission signal element timing, 101... Mono multi circuit, 102... Capacitor, 103...Resistor, 104...NAND gate.
Claims (1)
ルチ接続し、前記複数台のデータ伝送装置のうちの１台
に接続されたホストコンピュータからのポーリング信号
に対し前記データ伝送装置に接続された端末装置から送
信要求信号を返信することによりリンクを確立するマル
チポイント接続可能なデータ伝送装置において、前記端
末装置から前記データ伝送装置に送信されるデータ端末
レディ信号を受け前記データ端末レディ信号が所定のパ
ルス幅を有する場合のみ前記データ伝送装置における前
記端末装置との接続状態を形成し、前記データ端末レデ
ィ信号がオフの場合もしくは所定のパルス幅に満たない
ときには前記データ伝送装置における前記端末装置との
接続状態を断とする手段を備えて成ることを特徴とする
データ伝送装置。 ２、前記データ端末レディ信号のパルス幅が所定のパル
ス幅を満たすか否かの判定を論理ゲートの組合せ構成に
よって行なうことを特徴とする請求項１記載のデータ伝
送装置。[Claims] 1. A plurality of data transmission devices are multi-connected to one data transmission path, and in response to a polling signal from a host computer connected to one of the plurality of data transmission devices. In a data transmission device capable of multi-point connection, which establishes a link by returning a transmission request signal from a terminal device connected to the data transmission device, a data terminal ready signal transmitted from the terminal device to the data transmission device is provided. The data transmission device establishes a connection state with the terminal device only when the received data terminal ready signal has a predetermined pulse width, and when the data terminal ready signal is off or less than the predetermined pulse width, A data transmission device comprising means for disconnecting the data transmission device from the terminal device. 2. The data transmission device according to claim 1, wherein the determination as to whether or not the pulse width of the data terminal ready signal satisfies a predetermined pulse width is made by a combination of logic gates.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5697290A JPH03258051A (en) | 1990-03-07 | 1990-03-07 | Data transmitter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5697290A JPH03258051A (en) | 1990-03-07 | 1990-03-07 | Data transmitter |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03258051A true JPH03258051A (en) | 1991-11-18 |
Family
ID=13042438
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5697290A Pending JPH03258051A (en) | 1990-03-07 | 1990-03-07 | Data transmitter |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03258051A (en) |
-
1990
- 1990-03-07 JP JP5697290A patent/JPH03258051A/en active Pending
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