JPH0318953A - Unit type package packing system - Google Patents
Unit type package packing systemInfo
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- JPH0318953A JPH0318953A JP1153820A JP15382089A JPH0318953A JP H0318953 A JPH0318953 A JP H0318953A JP 1153820 A JP1153820 A JP 1153820A JP 15382089 A JP15382089 A JP 15382089A JP H0318953 A JPH0318953 A JP H0318953A
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Landscapes
- Mounting Of Printed Circuit Boards And The Like (AREA)
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はユニット型式のパッケージ実装システムに関し
、特にパッケージ実装用のスロットを複数配設したユニ
ットへのパッケージ実装組合せを予め設定した条件内で
変えることが可能なユニット型式のパッケージ実装シス
テムに関する。[Detailed Description of the Invention] [Field of Industrial Application] The present invention relates to a unit-type package mounting system, and in particular, to changing the combination of package mounting on a unit having a plurality of slots for package mounting within preset conditions. The present invention relates to a unit-type package mounting system that allows for
従来のこの種のユニット型式のパッケージ実装システム
では、実装組合せ条件に合わせてユニットのスロットに
パッケージが実装されているか否かを、各パッケージか
ら送出される識別(ID)信号をソフトウェアで認識さ
せることにより、判定する方法がとられている。In conventional unit-type package mounting systems of this type, software recognizes identification (ID) signals sent from each package to determine whether or not the package is mounted in the slot of the unit according to the mounting combination conditions. A method of determining this is adopted.
上述した従来のパッケージ実装システムにおけるソフト
ウェアによる認識の方法では、ソフトウェアのシステム
が動作状態でなければ実装状態の正誤判定をできないの
で、パッケージ実装時に迅速に誤実装の有無を確認でき
ないことが多いという欠点がある。更に、ソフトウェア
システムを搭載する必要が無い装置では、誤実装防止の
目的のみにソフトウェアを搭載すると、装置が大形化、
高価格化するという問題点がある。The above-mentioned software-based recognition method in the conventional package mounting system cannot determine whether the mounting state is correct or incorrect unless the software system is in an operating state, so a drawback is that it is often impossible to quickly confirm the presence or absence of incorrect mounting at the time of package mounting. There is. Furthermore, in devices that do not need to be equipped with a software system, installing software solely for the purpose of preventing incorrect implementation will result in the device becoming larger and larger.
There is a problem of high prices.
本発明のパッケージ実装システムは、ユニットに複数個
のパッケージを着脱可能なユニット型式のパッケージ実
装システムにおいて、前記パッケージは前記ユニットへ
の装着時に実装されたことを表示するブランク情報と自
身のパッケージ種別を表示するパッケージ種別情報とを
送信しまた前記ユニットから与えられるイネーブル信号
を受信する信号回路を有し、前記ユニットは実装された
前記パッケージが送信する前記ブランク情報及び前記パ
ッケージ種別情報を受信して該両情報の組合せが予め設
定した許容組合せであるか否かを判定し許容組合せであ
ればイネーブル信号を実装された前記パッケージに与え
また許容組合せでなければ誤実装を表示する警報信号を
発出する論理ゲート回路を有している。The package mounting system of the present invention is a unit-type package mounting system in which a plurality of packages can be attached to and detached from the unit, and the package has blank information indicating that it has been mounted when attached to the unit and its own package type. The unit has a signal circuit that transmits package type information to be displayed and receives an enable signal given from the unit, and the unit receives the blank information and the package type information transmitted by the mounted package and displays the package type information. Logic that determines whether or not the combination of both information is a preset permissible combination, and if it is a permissible combination, gives an enable signal to the mounted package, and if it is not a permissible combination, issues an alarm signal indicating incorrect mounting. It has a gate circuit.
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
第1図は、本発明の実施例を示すブロー)り図である。FIG. 1 is a flow diagram showing an embodiment of the present invention.
ユニッ)lは、パッケージ実装用のスロット毎に信号接
続用のポート11.12を有し、また情報処理部2、制
御部3、警報発出部4を有する。ユニット1のスロット
に着脱可能なパッケージ5は、ブランク(BLANK)
情報回路51、パッケージ(PKG)種別回路52、イ
ネーブル(EN)信号処理回路53を有している。The unit 1 has ports 11 and 12 for signal connection for each slot for package mounting, and also has an information processing section 2, a control section 3, and an alarm issuing section 4. Package 5 that can be attached to and detached from the slot of unit 1 is blank (BLANK).
It has an information circuit 51, a package (PKG) type circuit 52, and an enable (EN) signal processing circuit 53.
本実施例では、パッケージ5の種別は2種類(PKGA
及びPKGB)であり、その一方PKGAは2ボ一ト分
の容量をもち、他方PKGBは1ポ一ト分の容量をもつ
。また、このシスムチは同時に2ボ一ト分の容量を処理
できるものとする。In this embodiment, there are two types of packages 5 (PKGA
and PKGB), on the one hand, PKGA has a capacity of two ports, and on the other hand, PKGB has a capacity of one point. It is also assumed that this system can handle the capacity of two ports at the same time.
このパッケージ実装組合せ条件によれば、第1表に示す
5通りの実装組合せが許容されることになる。According to this package mounting combination condition, five mounting combinations shown in Table 1 are allowed.
第1表
ポート11あるいは12にパッケージ5が実装されると
、パッケージ5が送出するBLANK情報及びPKG種
別の各信号は、情報処理部2へ人力される。情報処理部
2及び制御部3は、論理ゲート回路で構成されており、
情報処理部2は実装されたパッケージ5からのBLΔN
K情報及びPKG種別の各信号を読取り、コード化して
実装情報として制御部3へ送る。BLΔNK情報はパッ
ケージ実装の有無を示し、PKG種別は実装されたパッ
ケージの種別を示しており、本実施例ではおのおの1ポ
ート当り1ビツトずつで済むので、情報処理部2でのコ
ード化を省略し4ビット並列のまま制御B3へ送っても
回路規模に大差を生じないが、ポート個数およびパンケ
ージ種類が増えると、情報処理部2でコード化した方が
回路規模の増大を防げる。制(Xl1部3は、情報処理
82から与えられる実装情報が第1表のごとく許容され
た5通りの実装組合せの各実装情報のいずれかと一致し
ているとき、イネーブル(EN)信号を実装されたパッ
ケージ5へ送り、いずれとも一致しないときには、実装
されたパッケージ5をイネーブルせず、警較発出部4を
起動させて誤実装を表示する警報を発出させる。When the package 5 is mounted on the first table port 11 or 12, the BLANK information and PKG type signals sent from the package 5 are manually input to the information processing section 2. The information processing section 2 and the control section 3 are composed of logic gate circuits,
The information processing unit 2 receives the BLΔN from the mounted package 5.
Each signal of K information and PKG type is read, coded, and sent to the control unit 3 as mounting information. The BLΔNK information indicates whether a package is mounted, and the PKG type indicates the type of package mounted. In this embodiment, each port requires only one bit, so encoding in the information processing unit 2 is omitted. Even if the data is sent to the control B3 in 4-bit parallel format, there will be no significant difference in the circuit scale, but if the number of ports and the types of pancakes increase, it is better to encode the data in the information processing unit 2 to prevent an increase in the circuit scale. When the mounting information given from the information processing 82 matches any of the mounting information of the five allowed mounting combinations as shown in Table 1, the If they do not match, the installed package 5 is not enabled and the alarm issuing section 4 is activated to issue an alarm indicating incorrect mounting.
例えば、初めにポート1にPKGAのパッケージを実装
し、次にポート2にPKGBのパンケージを実装すると
、第1表の実装組合せのいずれの条件にも一致しないの
で、ポート2のパッケージ(PKCB)は誤実装と判定
される。また、ポート1にPKCBのパッケージを実装
し、次にポート2にPKGAのパッケージを実装すると
、やはり第1表の条件に一致しないので、ポート2のパ
ッケージ(PKGA)は誤実装と判定される。For example, if you first install a PKGA package on port 1 and then a PKGB package on port 2, the package for port 2 (PKCB) will not match any of the implementation combinations in Table 1. It is determined to be incorrect implementation. Furthermore, if a PKCB package is mounted on port 1 and then a PKGA package is mounted on port 2, the conditions in Table 1 are not met, so the port 2 package (PKGA) is determined to be incorrectly mounted.
以上説明したように本発明によれば、実装されたパッケ
ージからの情報によりその実装組合せが許容されたもの
であるか否かを瞬時に判断でき、またシステム立ち上げ
の前もしくは途中でも誤実装防止を判定できる。さらに
、ソフトウェアを搭載していないシステムでも装置を大
形化、高価格せずに誤実装防止を実現できる。As explained above, according to the present invention, it is possible to instantly determine whether a mounting combination is permissible based on information from the mounted packages, and to prevent incorrect mounting before or during system startup. can be determined. Furthermore, even in systems that do not have software installed, it is possible to prevent incorrect mounting without increasing the size and price of the device.
第1図は本発明の実施例のブロック図である。
1・・・・・・ユニット、2・・・・・・情報処理部、
3・・・・・・制御部、4・・・・・警報発出部、5・
・・・・・パッケージ、11.12・・・・・・ポート
、51・・・・・・ブランク (BLANK)情報回路
、52・・・・・・パッケージ(PKG)種別回路、5
3・・・・・・イネーブル(EN)信号処理回路。FIG. 1 is a block diagram of an embodiment of the invention. 1...Unit, 2...Information processing section,
3...Control unit, 4...Alarm issuing unit, 5...
...Package, 11.12 ...Port, 51 ...Blank (BLANK) information circuit, 52 ...Package (PKG) type circuit, 5
3... Enable (EN) signal processing circuit.
Claims (1)
型式のパッケージ実装システムにおいて、前記パッケー
ジは前記ユニットへの装着時に実装されたことを表示す
るブランク情報と自身のパッケージ種別を表示するパッ
ケージ種別情報とを送信しまた前記ユニットから与えら
れるイネーブル信号を受信する信号回路を有し、前記ユ
ニットは実装された前記パッケージが送信する前記ブラ
ンク情報及び前記パッケージ種別情報を受信して該両情
報の組合せが予め設定した許容組合せであるか否かを判
定し許容組合せであればイネーブル信号を実装された前
記パッケージに与えまた許容組合せでなければ誤実装を
表示する警報信号を発出する論理ゲート回路を有してい
ることを特徴とするユニット型式のパッケージ実装シス
テム。In a unit-type package mounting system in which multiple packages can be attached to and detached from a unit, the package transmits blank information indicating that it has been mounted when attached to the unit and package type information indicating its own package type. The unit further includes a signal circuit for receiving an enable signal given from the unit, and the unit receives the blank information and the package type information transmitted by the mounted package, and the combination of the two pieces of information is set in advance. It has a logic gate circuit that determines whether or not the combination is an allowable combination, and if the combination is an allowable combination, gives an enable signal to the mounted package, and if the combination is not an allowable combination, issues an alarm signal indicating incorrect mounting. A unit-type package mounting system featuring:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1153820A JPH0318953A (en) | 1989-06-15 | 1989-06-15 | Unit type package packing system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP1153820A JPH0318953A (en) | 1989-06-15 | 1989-06-15 | Unit type package packing system |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0318953A true JPH0318953A (en) | 1991-01-28 |
Family
ID=15570808
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1153820A Pending JPH0318953A (en) | 1989-06-15 | 1989-06-15 | Unit type package packing system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0318953A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP2008210098A (en) * | 2007-02-26 | 2008-09-11 | Yaskawa Electric Corp | Servo amplifier and detection method of option device therefor |
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-
1989
- 1989-06-15 JP JP1153820A patent/JPH0318953A/en active Pending
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