JPH03124231U - - Google Patents

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JPH03124231U
JPH03124231U JP3380290U JP3380290U JPH03124231U JP H03124231 U JPH03124231 U JP H03124231U JP 3380290 U JP3380290 U JP 3380290U JP 3380290 U JP3380290 U JP 3380290U JP H03124231 U JPH03124231 U JP H03124231U
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  • Computer And Data Communications (AREA)
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Description

【図面の簡単な説明】
第１図と第２図は本考案に係るコンピユータ装
置の実施例を示すアダプタの回路図とその付設さ
れたコンピユータ装置のブロツク図、第３図と第
４図はパソコンとモデム及びパソコン同士の各接
続態様を示すケーブルの各概略図である。 ６ａ，６ｂ……アダプタ、９，１０……３ステ
ートバツフア群、１１，１２……ＥＸ−ＯＲ回路
、１３−１４……ＲＳフリツプフロツプ回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 シリアルデータ転送用送信及び受信各端子を有
    し、上記送受信各端子をケーブルを介し相手側の
    送受信各端子にクロスして接続するようにしたコ
    ンピユータ装置において、 第１の３ステートバツフア出力及び第２の３ス
    テートバツフア入力を上記送受信端子の各一方毎
    にそれぞれ接続して各対応する入力及び出力を一
    対のデータ転送用第１、第２出力端子に接続する
    と共に、第３の３ステートバツフアの入出力及び
    第４の３ステートバツフアの出入力を上記第１、
    第２の３ステートバツフアの各出力間と各入力間
    に挿入してなる３ステートバツフア群と、上記第
    １、第２出力端子間に２入力を並列接続したＥＸ
    −ＯＲ回路と、ＲＳ入力を上記第１、第２出力端
    子に並列接続してタイミング入力をＥＸ−ＯＲ回
    路出力に接続すると共に、上記第１、第２の３ス
    テートバツフアの各ゲート入力にＱ出力、第３、
    第４の３ステートバツフアの各ゲート入力に反転
    Ｑ出力をそれぞれ接続した立ち上がり微分のＲＳ
    フリツプフロツプ回路とを具備したアダプタを上
    記送受信各端子とケーブル間に付設したことを特
    徴とするコンピユータ装置。
JP3380290U 1990-03-29 1990-03-29 コンピュータ装置 Expired - Lifetime JP2525460Y2 (ja)

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JPH03124231U true JPH03124231U (ja) 1991-12-17
JP2525460Y2 JP2525460Y2 (ja) 1997-02-12

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004289844A (ja) * 2003-03-24 2004-10-14 Sensormatic Electronics Corp 極性訂正回路およびそれを組み入れたシステム
KR102055252B1 (ko) * 2019-06-13 2019-12-12 주식회사유비씨에스 커넥터 일체형 분배기 및 결합기 어셈블리

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KR102055252B1 (ko) * 2019-06-13 2019-12-12 주식회사유비씨에스 커넥터 일체형 분배기 및 결합기 어셈블리

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JP2525460Y2 (ja) 1997-02-12

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