JPH03113546A - Storage - Google Patents
StorageInfo
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- JPH03113546A JPH03113546A JP25293789A JP25293789A JPH03113546A JP H03113546 A JPH03113546 A JP H03113546A JP 25293789 A JP25293789 A JP 25293789A JP 25293789 A JP25293789 A JP 25293789A JP H03113546 A JPH03113546 A JP H03113546A
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- rom
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は記憶装置に関し、特に小型薄型で、マイクロプ
ロセッサなどを含まないプリント基板に実装されて成る
記憶装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a storage device, and particularly to a storage device that is small and thin and is mounted on a printed circuit board that does not include a microprocessor or the like.
従来、この種の記憶装置は、プリント基板にＲＯＭか又
はＲＡＭの一種のメモリ素子が実装されてプリント基板
の一端の接続端子にメモリのアドレス端子やデータ端子
に加え、書込み、読出しなどの制御信号端子が接続され
、ホスト装置とのデータの授受およびホスト装置に対し
記憶装置からの種別情報（ＲＯＭ又はＲＡＭ）などの読
出しができる構成になっていて、種別情報としては一種
類しか読出しができない構成になっていた。Conventionally, in this type of storage device, a type of memory element such as ROM or RAM is mounted on a printed circuit board, and a connection terminal at one end of the printed circuit board is connected to the address terminal and data terminal of the memory, as well as control signals such as writing and reading. The terminal is connected and the configuration is such that data can be exchanged with the host device and type information (ROM or RAM) etc. can be read from the storage device to the host device, but only one type of type information can be read. It had become.
上述した従来の記憶装置は、プリント基板の接続端子に
実装されているメモリ素子のアドレス線やデータ線に加
えて、書込み、読出しなどの制御信号線が接続され、ホ
スト装置とのデータの授受、ホスト装置に対し記憶装置
の種別情報などの読出しができる構成になっていて、種
別識別情報としでは一種類のものしかホスト装置に返せ
ない構成となっているので、続出専用のメモリ（ＲＯＭ
）と書込可能のメモリ（Ｒ，ＡＭ）の両方を有すること
ができないという欠点が１色る。In the conventional storage device described above, in addition to the address line and data line of the memory element mounted on the connection terminal of the printed circuit board, control signal lines such as writing and reading are connected, and data can be exchanged with the host device. The host device is configured to be able to read storage device type information, etc., and only one type of type identification information can be returned to the host device.
) and writable memory (R, AM).
本発明の記憶装置は、プリン１へ基板上に実装されたＲ
ＯＭと、バラブリバックアップされたＦｉ、 ＡＭと、
ボス１〜システムとの複数の接続端子の配列が接続端面
の中心て点対称となった接続端子部と、前記接続端子の
うち予め設定した特定の端子の入力端子のレベルにより
残りの前記接続端子の使用法を切換えて前記ホストシス
テムから前記Ｒ，（’） Ｍにアクセス可とするか又は
前記１１． Ａ Ｍにアクセス可とするか選択する切換
部とを有している。The storage device of the present invention has R mounted on a substrate to a printer 1.
OM, randomly backed up Fi, AM,
A connecting terminal part in which a plurality of connecting terminals with the boss 1 to the system are arranged point-symmetrically with respect to the center of the connecting end surface, and the remaining connecting terminals are arranged according to the level of the input terminal of a preset specific terminal among the connecting terminals. The usage of R and (') M can be changed from the host system, or the method described in 11. It has a switching section for selecting whether to allow access to AM.
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
第１図は本発明の一実施例を示すブロック図である。FIG. 1 is a block diagram showing one embodiment of the present invention.
第１図において、本実施例の記憶装置１はプリント基板
（図示省略）上に実装されたＲＯＭ１３と、バッテリ１
２でバックアップされた１１．ＡＭｌｌと、ホストシス
テム（図示省略）との複数の接続端子と配列が接続端子
面の中心で点対称となった接続端子部２２と、ＲＡＭ１
］、、ＲＯＭ１３にア１〜レスバス１４．データバス
］５．リードライト制御信号線１６て接続しさｔ、にＲ
ＡＭ１．１にはＲ，Ａ Ｍセレクト信号線２０で接続し
ＲＯＭ１３にはＲＯＭセレクト信号線２１で接続し且つ
接続端子部２２にはメモリ選択信号線１８と接続バス１
つとで接続する切換郡部１７とを有して構成していて、
ＲＡＭＩＩおよびＲ，０Ｍ１−３はプリント基板内一方
の面（表面）にＲＡＭＩＩが他方の面（裏面）にＲＯＭ
１３が実装されている。In FIG. 1, a storage device 1 of this embodiment includes a ROM 13 mounted on a printed circuit board (not shown) and a battery 1.
11. Backed up with 2. A connection terminal section 22 with a plurality of connection terminals between the AMll and the host system (not shown) arranged symmetrically with respect to the center of the connection terminal surface, and the RAM1.
],, ROM 13 contains A1~Res bus 14. data bus]5. Connect the read/write control signal line 16 to R.
AM1.1 is connected to the R, AM select signal line 20, ROM13 is connected to the ROM select signal line 21, and the connection terminal section 22 is connected to the memory selection signal line 18 and the connection bus 1.
and a switching section 17 connected to the
RAMII and R,0M1-3 have RAMII on one side (front side) of the printed circuit board and ROM on the other side (back side)
13 have been implemented.
次に、本実施例の動作について説明する。Next, the operation of this embodiment will be explained.
今、ＲＡＭＩＩを使用する場合には、ＲＡＭ １１実装
側を表面になるように接続端子部２２をホストシステム
側に接続する。このとき、メモリ選択信号線］８の電圧
レベルは予め設定した電圧レベルの“ハイ′°に設定さ
れ、切換部１７は接続端子部２２からの接続バス１つを
ＲＡＭＩＩに接続できろようにアドレスバス１４．デー
タバス１５゜リードライト制御信号線１６に振り分ける
共にＲＡＭセレクト信号線２０をアクティブする。When using RAMII, connect the connection terminal section 22 to the host system side with the RAM 11 mounted side facing up. At this time, the voltage level of the memory selection signal line]8 is set to a preset voltage level of "high", and the switching section 17 sets the address so that one connection bus from the connection terminal section 22 can be connected to the RAM II. The bus 14 and the data bus 15 are distributed to the read/write control signal line 16 and the RAM select signal line 20 is activated.
この結果、ホストシステムは記憶装置１を１７ΔＭとし
て使用することかできる。As a result, the host system can use the storage device 1 as 17ΔM.
次に、ＲＯＭ］３を使用する場合には、プリント基板を
裏返してＲＯＭ１．３の実装側を表面になるように接続
端子部２２をポス１−システム側に接続する。このとき
メモリ選択信号線］８の電圧レベルは予め設定した電圧
レベルの゛ロー“に設定され、切換部１７は接続端子部
２２からの接続バス１９をＲＯＭ］３に接続できるよう
にアＩ・レスバス１４．データバス１５．リードライト
制御信号線１６に振り分ける共に１１．０ Ｍセレクト
信号線２１をアクティブにする。Next, when using the ROM 3, turn the printed circuit board over and connect the connection terminal section 22 to the POS 1-system side so that the mounting side of the ROM 1.3 is on the front side. At this time, the voltage level of the memory selection signal line ]8 is set to a preset voltage level of ``low'', and the switching section 17 switches the memory select signal line]8 to connect the connection bus 19 from the connection terminal section 22 to the ROM]3. 11.0 M select signal line 21 is activated.
この結果、ホストシステムは記憶装置１をＲＯＭとして
使用することができる。As a result, the host system can use the storage device 1 as a ROM.
本実施例では２種類のメモリとしてＲＡＭ ＦＬＯＭ
を使用することで説明したが、＝っのメモリ形態はどの
ようをものてあ−）てもよい。In this embodiment, there are two types of memory: RAM FLOM.
Although the explanation has been made by using ``='', any memory format may be used.
以上説明したように本発明は、プリント基板の裏・表の
どちらの面を上にしてもアクセスが可能で、しかもプリ
ンＩ・基板面の向きにより、メモリ独別を変えることが
できるようにすることにより、例えば、一方を読出専用
のＲＯＭとしてプログラムを格納し、ホストにロードし
、ホストで作成したデータを他方の書込可能なＲＡＭに
セーブするという使い方ができ、また、ポストとのイン
タフェース士は、２種類のメモリを持つ記憶装置という
ような認識とする必要をなくすことができる効果がある
。また例えば、プリント基板の表、裏各面に、その面を
見えるようにしたときに使えるメモリ種別を示すラベル
等の表示をしておくことによって、ユーザが目でプリン
ト基板の面を見て接続するという自然な操作でメモリ種
別を選択できる効果がある。As explained above, the present invention allows access whether the back or front side of the printed circuit board is facing up, and also allows memory isolation to be changed depending on the orientation of the printed circuit board and the surface of the board. This allows, for example, to store a program on one side as a read-only ROM, load it onto the host, and save data created on the host on the other side's writable RAM. This has the effect of eliminating the need to recognize a storage device having two types of memory. For example, by displaying labels on the front and back sides of a printed circuit board that indicate the type of memory that can be used when that side is visible, the user can visually check the side of the printed circuit board and make connections. This has the effect of allowing you to select the memory type with a natural operation.
第１図は本発明の一実施例を示すブロック図である。
１・・・記憶装置、１１ ・ＲＡ Ｍ、１２・・・バラ
ブリ、１３・・・ＲＯＭ、１４・・・アドレスバス、１
５・・・データバス、１６・・ソー。ライ１へ制御信号
線、１７・・切換部、１８・・・メモリｉ′ｆ１択（＋
：ｊ ”ｊ線、１９・・接わ゛Ｃハス、２０・・・ＲＡ
Ｍセレクト仏号線、２１・・・ＲＯＭセレクト信号線、
２２・・・接続端子部。FIG. 1 is a block diagram showing one embodiment of the present invention. 1... Storage device, 11 ・RAM, 12... Discrete, 13... ROM, 14... Address bus, 1
5...Data bus, 16...So. Control signal line to line 1, 17...switching section, 18...memory i'f1 selection (+
:j ”J line, 19... C lotus, 20... RA
M select Buddha signal line, 21...ROM select signal line,
22... Connection terminal section.
Claims (1)
アップされたＲＡＭと、ホストシステムとの複数の接続
端子の配列が接続端面の中心で点対称となった接続端子
部と、前記接続端子のうち予め設定した特定の端子の入
力電圧のレベルにより残りの前記接続端子の使用法を切
換えて前記ホストシステムから前記ＲＯＭにアクセス可
とするか又は前記ＲＡＭにアクセス可とするか選択する
切換部とを有することを特徴とする記憶装置。A connecting terminal portion in which a plurality of connecting terminals between the ROM mounted on the printed circuit board, the battery-backed RAM, and the host system are arranged symmetrically about the center of the connecting end surface, and a preset portion of the connecting terminals. and a switching unit that switches the usage of the remaining connection terminals depending on the input voltage level of the specific terminal, and selects whether the host system can access the ROM or the RAM. A storage device characterized by:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25293789A JPH03113546A (en) | 1989-09-27 | 1989-09-27 | Storage |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25293789A JPH03113546A (en) | 1989-09-27 | 1989-09-27 | Storage |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03113546A true JPH03113546A (en) | 1991-05-14 |
Family
ID=17244236
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25293789A Pending JPH03113546A (en) | 1989-09-27 | 1989-09-27 | Storage |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03113546A (en) |
-
1989
- 1989-09-27 JP JP25293789A patent/JPH03113546A/en active Pending
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