JPH02223243A - 差動展開スペクトラムデータエンコーダとデータ相関器と展開スペクトラム信号符号化方法とデータ信号相関方法 - Google Patents

差動展開スペクトラムデータエンコーダとデータ相関器と展開スペクトラム信号符号化方法とデータ信号相関方法

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JPH02223243A
JPH02223243A JP1294764A JP29476489A JPH02223243A JP H02223243 A JPH02223243 A JP H02223243A JP 1294764 A JP1294764 A JP 1294764A JP 29476489 A JP29476489 A JP 29476489A JP H02223243 A JPH02223243 A JP H02223243A
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JP
Japan
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code sequence
spread spectrum
expanded
signal
input terminal
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JP1294764A
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Greg A Nease
グレッグ・エイ・ニース
Peter K Cripps
ピーター・ケイ・クリップス
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Agilis Corp
Original Assignee
Agilis Corp
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Publication date
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/69—Spread spectrum techniques
    • H04B1/707—Spread spectrum techniques using direct sequence modulation
    • H04B1/709—Correlator structure
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/69—Spread spectrum techniques
    • H04B1/707—Spread spectrum techniques using direct sequence modulation
    • H04B1/70718—Spread spectrum techniques using direct sequence modulation with asynchronous demodulation, i.e. not requiring code synchronisation

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
  • Radio Relay Systems (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
  • Complex Calculations (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［発明の目的］ 〈産業上の利用分野〉 本発明は展開スペクトラム通信システムに関する。特に
、本発明は展開スペクトラム通信システムに使用するデ
ータ相関器に関する。
〈従来の技術〉 展開スペクトラム通信システムは周知である。
展開スペクトラムデータ通信システムに於ては、個々の
データビットが拡散コードシーケンスと称されるコード
シーケンスで変調される。拡散コードシーケンスの個々
のビットはチップと呼ばれる。
展開スペクトラム通信システムに於て各データビットを
転送するためには、先ず個々の各データビットが排他的
ＯＲゲートに於て拡散コードシーケンスによって乗算さ
れる。
従って、例えば０のデータビットについては拡散コード
自体が伝送される。これに対して１のデータビットにつ
いては拡散コードの反転が伝送される。拡散コードがデ
ータより高いクロックレートを有するので、結果として
得られる信号は元のデータ信号より高い周波数内容即ち
より高い帯域幅を有する。特に展開スペクトラム信号の
クロッグレートは、選択したスペクトラム拡散率によっ
て入力データのクロックレートより高くなる。従って、
展開スペクトラム信号エネルギ内容は周波数スペクトラ
ム全般に亘ってより分散される。従って、展開スペクト
ラム通信システムはノイズ及び干渉の影響を受け難くな
ると共に、マルチパス歪み遅れに対してより大きな耐性
を有する。
受信側に於て、拡散コードシーケンスは元の伝送データ
を回復するために検出される。展開スペクトラムシステ
ムに於ける一般的な問題は、受信信号を元の拡散コード
シーケンスの知識に相関させることである。一般に拡散
コードの検出が第１゜論理レベルの受信に対応するのに
対して、反転された拡散コードの検出は反対の論理レベ
ルの検出に対応する。従来技術に於ては、受信拡散コー
ドを検出するために様々な型式のコード相関器が使用さ
れている。
或る従来技術の手法に於ては、信号がアナログ遅延線路
に印加され、かつ記憶された拡散コードでプログラムさ
れたプログラム可能アナログインバータ・加算器を用い
て並行に比較される。使用時に、アナログ遅延線路タッ
プ出力は使用される拡散コードシーケンスに従って反転
されたり反転されなかったりする。入って来る信号がイ
ンバータのプログラミングに合せて整列すると、全出力
が加算されて１チップ長い相関スパイクが発生する。こ
の過程は数学的に自動相関として知られている。
アナログ遅延線路、インバータ及び加算器は単一の表面
弾性波（ＳＡＷ）デバイス上で結合することができる。
後者の手法は、特に生産数量が少ない場合にコスト高に
なり得るので、異なる拡散コードシーケンスについてＳ
ＡＷを再プログラムすることは困難である。完全なデジ
タル相関器がティーアールダブリュΦインコーポレイテ
ッド（ＴＲＷ　Ｉｎｃ、）等の各社から市販されている
が、非常に高価でありかつ相当大きな電力を使用する。
受信信号を元の拡散コードシーケンスに相関させる別の
方法は、局部コードシーケンス発生器を到来信号に同期
させることである。後者の場合には、必要なハードウェ
アが相当少くなる。受信信号が相関器に印加される前に
デジタル化される場合には、単一の排他的ＯＲゲートを
用いて到来信号を局部同期コード発生器の出力と比較す
ることができる。この場合に、局部コード発生器を送信
器内のコード発生器に同期させることが問題になる。し
かしながら、パケットプロトコルの操作に必要なオーバ
ーヘッドに加えて、シーケンスの同期化を実行するため
には多くの一ビットが必要であり、かつ場合によっては
既存のプロトコルを実行することが非常に困難になる。
〈発明が解決しようとする課題〉 これら従来の諸問題に鑑みて、本発明の目的は、同期化
時間が非常に短く、かつ同期化受信器が低コストである
展開スペクトラム技術を提供することにある。
［発明の構成］ 〈課題を解決するための手段〉 本発明によれば、拡散コードシーケンスが入力データ信
号に従って差動符号化される。
特に、入力データ信号が１である場合に、拡散コードシ
ーケンスの現在チップが或る固定時間遅れ前の拡散コー
ドシーケンスの対応するチップに関して反転される。入
力データ信号が０である場合には、拡散コードシーケン
スの現在チップは或る固定時間遅れ前の拡散コードシー
ケンスの対応するチップに関して反転されない。別言す
れば、拡散コードシーケンスの極性は、入力データ信号
が１またはＯであるかによってそれぞれ或る固定時間前
の拡散コードシーケンスの極性に関して反転されたり反
転されなかったりする。
受信器側に於て、本発明によれば、拡散コードシーケン
スの各受信チップは、拡散コードシーケンスの先の受信
チップと比較される。拡散コードシーケンスが最初に送
信器に於て差動符号化されていたので、拡散コードシー
ケンスの受信チップと拡散コードシーケンスの先の受信
チップが同じである場合には、受信データが論理レベル
０になる。逆に、拡散コードシーケンスの受信チップが
拡散コードシーケンスの先の受信チップの反転であ・る
場合には、受信データが論理レベル１になる。
１入力データピットの持続時間が展開スペクトラム拡散
コードシーケンスの１サイクルの持続時間に等しい必要
はない。一般に、データビット毎のチップ数は展開スペ
クトラム拡散コードシーケンスに於けるチップ数より少
いか、同じであるか、または多い場合がある。しかしな
がら、全ての場合に、送信器の符号化過程及び受信器の
相関化過程の双方に於て、各チップが先の拡散コードシ
ーケンスの対応するチップと比較される。
〈作用〉 本発明を用いることによって、シーケンス発生器が受信
器側に必要でなくなり、かつデータ相関器全体が操作が
簡単でかつ低コストになる。更に、受信器の同期化が拡
散コードシーケンスの１サイクル後に行われる。
〈実施例〉 以下に添付の図面を参照して本発明を特定の実施例につ
いて詳細に説明する。
第１図には、データ通信システムが概略的に示されてい
る。同図に於て、端子１０に於けるデータ入力が本シス
テムを通じて送信され、端子２４に於てデータ出力とし
て使用されるようになっている。
端子１０に於けるデータ入力は展開スベクトラム変調器
１２に印加され、次にＲＦ送信器１４に入力される。Ｒ
Ｆ送信器１４の出力は送信アンテナ１６に印加される。
この信号は適当な媒体を介して送信され、かつ受信アン
テナ１８によって受信された後に、ＲＦ受信器２０に印
加される。ＲＦ受信器２０の出力は元のデータに復元す
るために展開スペクトラム復調器２２に印加される。
展開スペクトラム変調器１２は、拡散コードシーケンス
を供給するためにシーケンス発生器を有する。第２ａ図
に示されるように、前記シーケンス発生器は、時刻Ｔ１
に始まって時刻Ｔ２に終了する長さの繰返しシーケンス
発生器プを発生する。
最大長擬似ランダムコード発生器のような繰返しコード
シーケンスを発生する方法は当業者にとって周知であり
、本発明の構成部分ではない。また、第２ａ図に示され
るように、前記シーケンスはＭチップ毎に繰返されるの
で、シーケンスの１サイクル毎にＭチップが存在する限
り該シーケンスの開始位置と終了位置との間には差がな
い。従って、時刻Ｔ３がシーケンスの開始時間となり、
かつ時刻Ｔ４が終了時間となる。
しかしながら、データビット毎のチップ数が拡散コード
シーケンス毎のチップ数と等しい必要はない。第２ｂ図
に示されるように、データビット毎のチップ数は拡散コ
ードシーケンスのサイクル毎のチップ数より少い場合が
あり、または第２Ｃ図に示されるように、データビット
毎のチップ数が拡散コードシーケンスのサイクル毎のチ
ップ数より多い場合がある。
データビット毎のチップ数と無関係に、データビットの
遷移は個々のチップの遷移と一致すべきである。従って
、第２ｂ図に於て、時刻Ｔ１に於けるデータ遷移がシス
テムのチップクロックと一致し、かつ第２Ｃ図に於て時
刻Ｔ４に於けるデータ遷移がシステムのチップクロック
に一致する。
第３図は、デジタルデータを送受信するための展開スペ
クトラム無線モデムのブロック図である。
送信部分は展開スペクトラムエンコーダ２８と送信器チ
ップクロック３０とＰＳＫ変調器３４とＲＦ送信器１４
とを備える。受信部分は、ＲＦ受信器２０とＰＳＫ復調
器４０と受信器チップクロック４２と展開スペクトラム
相関器４６とフィルタ・閾値回路５０とを備える。送受
信スイッチ３６によってアンテナ３８を送信器と受信器
との間で共有することができる。
コンピュータまたはコンピュータターミナルであるデー
タデバイス２６からのデータ出力は、展開スペクトラム
エンコーダ２８に印加される。より高い周波数送信器チ
ップクロックによって帯域幅が増大された展開スペクト
ラムエンコーダ２８の出力は、送受信スイッチ３６を介
してアンテナ３８に転送するためにＰ　Ｓ　Ｋ変調器３
４及びＲＦ送信器１４に印加される。
受信モードでは、送受信スイッチ３６がアンテナ３８を
ＲＦ受信器２０に接続する。ＲＦ受信器２０の出力はＰ
　Ｓ　Ｋ復調器４０に印加される。受信器チップクロッ
ク４２はＰＳＫ復調器４０の受信展開スペクトラム信号
を基にしている。
受信器チップクロック４２のｐｓＫｉｊ［調器４０で受
信した信号を基にした再構成は、当業者にとって周知で
あり、かつ本発明の一部を構成するものではない。復元
された受信器チップクロック４２はＰＳＫ復調器４０の
出力と同様に展開スペクトラム相関器４６に印加される
。展開スペクトラム復調器４６内では、受信データを引
き出すために、送信器内で使用されていた拡散コードシ
ーケンスで受信信号を相関させる。相関器４６の出力は
、データ入力をデータデバイス２６に供給するフィルタ
・閾値回路５０に接続されている。
第４図には、従来の一般的な展開スペクトラムエンコー
ダ２８が示されている。エンコーダ２８は、一方の入力
がデータ入力端子１０に接続された排他的ＯＲゲート５
２を有する。排他的ＯＲゲート５２の他方の入力は、送
信器チップクロック３０によって駆動されるシーケンス
発生器５４の出力に接続されている。導体５１上の排他
的ＯＲゲート５２の出力はＰ　Ｓ　Ｋ変調器３４に供給
される出力である。データ入力端子１０に於けるデータ
入力が１または０によって、シーケンス発生器５４から
の反転または非反転拡散コードシーケンスが導体５１上
の変調器３４に供給されることになる。
第５図には、従来のデータ相関器が示されている。デー
タ相関器４６は、復調器４０からの入力６３と受信器チ
ップクロック４２によって駆動される同期シーケンス発
生器６２に接続された別個の入力６１とを有する４象限
アナログ乗算器６０からなる。相関器４６内のシーケン
ス発生器６２を第４図示のエンコーダ２８内のシーケン
ス発生器５４と同期させる方法は従来から周知である。
また、第５図示のデータ相関器４６はデジタル形式で実
行することができる。この場合には、導体６３上の信号
入力が最初にデジタル化される。
この場合、同期シーケンス発生器６２の出力は全くデジ
タルである。１ビツト量子化の場合には、４象限アナロ
グ乗算器６０が２個の入力排他的ＯＲゲートに置き換え
られる。別の実施例に於て、導体６３上の信号入力が複
数ビットの並行出力を有するデジタル−アナログ変換器
内でデジタル化される場合には、アナログ乗算器６０が
デジタル乗算器に置き換えられる。
導体６３上の受信コードシーケンスが導体６１上の同期
コードシーケンスと同じである場合には、導体５９上の
出力が０のデータゼットを表示する。
逆に、導体６３上の受信コードシーケンスが導体６１上
の同期コードシーケンスの反転である場合には、導体５
９上の出力が１のデータビットを表示する。第５図示の
受信相関器４６に於けるシーケンス発生器６２を第４図
示のエンコーダ２８に於けるシーケンス発生器３０に同
期させなければならない点に留意するべきである。この
ような同期化は実行に長時間を要し、かつ相当量のハー
ドウェアが付加されることになる。
第６図には、本発明によるデータエンコーダが示されて
いる。データエンコーダ２８は排他的ＯＲゲート７０の
一方の入力端子に接続されたデータ入力端子１０を有す
る。排他的ＯＲゲート７０の導体７３に於ける出力は遅
延手段７２の入力に接続されている。遅延手段７２は、
シフトレジスタまたは別の型式の遅延メモリを用いるこ
とによって実行される。遅延手段７２は、シーケンス発
生器５４によって導体７５上に供給される拡散コードシ
ーケンスの長さと実質的に等しい遅延信号を供給する。
導体７１への遅延手段７２の出力は排他的ＯＲゲート７
０の第２入力に入力される。
排他的ＯＲゲート７０の導体７３への出力は排他的ＯＲ
ゲート７４への一方の入力である。導体７５上の排他的
ＯＲゲート７４の他方の入力はシーケンス発生器５４の
出力である。その結果により得られる排他的ＯＲゲート
７４の出力は、変調器３４に印加される導体５１上の展
開スペクトラム信号である。
第７図は、第６図のエンコーダ２８からの展開スヘクト
ラム信号を受け取るためのアナログ相関器４６を示して
いる。アナログ相関器４６は、４象限乗算器８０と遅延
手段８２とを備える。同様に、例えば電荷結合素子（Ｃ
ＣＤ）または他の遅延メモリである遅延手段８２によっ
て拡散コードシーケンスの１サイクルの長さと実質的に
等しい信号遅れが供給される。復調器４０からのｆＲ号
は導体８３上の４象限乗算器８０の一方の入力に印加さ
れ、かつ遅延手段８２の入力に印加される。
４象限乗算器８０の他方の入力は導体８１上の遅延手段
８２の出力に接続されている。導体８４上の４象限乗算
器８０の出力は第３図示のフィルタ・閾値回路５０に接
続されたデータ出力である。
第７図示のデータ相関器をデジタル式にしたものが第８
図に示されている。閾値回路４４は導体９５上の復調器
４０から到来する信号をデジタル化、即ち１ビツト量子
化するために使用される。
アナログ乗算器の代わりに、第８図のデジタルデータ相
関器は排他的ＯＲゲート９０を備える。導体９３上の閾
値回路４４の出力は、排他的ＯＲゲート９０の一方の入
力及び遅延手段９２の入力に接続されている。同様に、
デジタル式の場合にはシフトレジスタであるような遅延
手段９２によって、拡散コードシーケンスの１サイクル
と実質的に等しい遅れが供給される。導体９１上の遅延
手段９２の出力は、排他的ＯＲゲート９０の他方の入力
に接続されている。導体９４上の排他的ＯＲゲート９０
の出力は、受信システムの他の部分へのデータ出力であ
る。
第７図示される４象限アナログ乗算器８０は、第８図示
の２個の入力排他的ＯＲゲート９０に類似している。こ
れは、符号付きの数を乗算するための規則が排他的ＯＲ
ゲートの機能に関する論理表に類似していることから確
められる。即ち、乗算器８０への信号入力が同じ極性を
有する、即ち共に正または共に負である場合、出力は正
である。
他方、信号入力が反対の極性を有する場合には、乗算器
８０の出力が負である。従って、排他的ＯＲゲートが論
理レベルの同一性を表示するのに対して、４象限乗算器
は信号極性の同一性を表示する。
エンコーダ及び相関器の操作に関する以下の説［１に関
して、第６図の導体５１から第８図の導体９５に通じる
透明なデータ通路があるように思われる。即ち、ＰＳＫ
変調器・ＰＳＫ復調器、ＲＦ送信器・ＲＦ受信器を含む
送信システムのその他の部分によって第６図の導体５１
から第８図の導体９５に展開スペクトラム信号が送信さ
れると考えられる。
操作時には、第６図のエンコーダ２８の目的は、拡散コ
ードシーケンスの各チッーブの極性を入力データの値に
従って或る固定時間遅れ前の拡散コードシーケンスの対
応するチップの極性に関して反転させたり反転させない
ことにある。特に、現在入力データ信号が論理１である
場合、拡散コードシーケンスの極性が或る固定時間遅れ
前の拡散コードシーケンスの極性に関して反転される。
現在入力信号が０である場合には、第６図のエンコーダ
は、或る固定時間遅れ前の拡散コードシーケンスの極性
に関して拡散コードシーケンスの現在チップの極性を反
転させない。
排他的ＯＲゲート７４は拡散コードシーケンス発生器５
４の出力に作用して、導体７３上の反転制御論理信号の
値に応じて拡散コードシーケンスの各チップを反転させ
たり反転させなかったりする。このように、導体７３上
の信号が論理１である場合に、導体７５上のシーケンス
発生器５４からの拡散コードシーケンスの現在チップが
導体５１上の排他的ＯＲゲート７４の出力に於て反転さ
れる。逆１こ、導体７３上の信号が論理０である場合に
は、導体７５上の出力に於けるシーケンス発生器５４か
らの拡散コードシーケンスからの現在チップは反転され
ない。
導体７３上の反転制御信号が遅延手段７２に記録される
ことによって、或る固定された時間遅れ前の先の反転制
御信号が排他的ＯＲゲート７ｏへの１入力として導体７
１上に現われる。入力端子１０に於けるデータが論理１
である場合には、排他的ＯＲゲート７０が先の反転制御
信号を反転させて現在の反転制御信号を形成し、これに
対してデータ入力が論理０である場合には、排他的ＯＲ
ゲート７０が先の反転制御信号を反転させずに現在の反
転制御信号を形成することがわかる。
より詳細に言えば、拡散コードシーケンスの先のサイク
ルの対応するチップである先のチップが反転されかつデ
ータ入力が論理１である場合には、現在チップは反転さ
れない。前記先のチップが反転されなかった場合に、デ
ータ入力が論理１であれば現在チップは反転される。前
記先のチップが反転された場合に、データ入力が論理０
であれば現在チップも反転される。前記先のチップが反
転されなかった場合に、データ入力が論理０であれば、
現在チップも同様に反転されない。
受信器側に於て、第８図の導体９５上の信号入力が効果
的にデジタル化、即ち閾値回路４４によって１ビツト量
子化またはビット・スライスされることによって、その
ような信号がデジタル形式で導体９３上に現われる。
遅延手段９２は展開スペクトラム信号の個々の受信チッ
プを記憶する。遅延手段９２の出力は先の拡散コードシ
ーケンスの対応するチップである。
ここで、排他的ＯＲゲート９０が現在受信した拡散コー
ドシーケンスの各受信チップを先に受信した拡散コード
シーケンスの対応するチップと比較する。拡散コードシ
ーケンスの現在受信チップが先の受信シーケンスの先の
受信チップと同じであるか、先の受信シーケンスの反対
でなるかどちらかであり、前者の場合に受信データは論
理０であり、かつ後者の場合に受信データは論理１であ
る。
いずれの場合にも、排他的ＯＲゲート９０の導体９４へ
の出力は、拡散コードシーケンスの各チップに関する個
々の比較からなる１データビツト全長の一連の比較であ
り、その比較の全数はデータビット毎のチップの全数と
等しい。第７図のアナログ相関器４６は、受信拡散コー
ドシーケンスの各チップの極性を先の受信拡散コードシ
ーケンスの対応するチップの極性と比較し、両極性が同
じである場合には第１のアナログ出力表示（正の信号）
を、かつ極性が反対である場合には第２のアナログ出力
表示（負の信号）を供給することによって、同様に動作
する。
データ相関器４６の出力に続いて、受信データビットが
１または０であるかを決定するために多数決論理が行な
われる。理想的な条件下では、排他的ＯＲゲート９０か
らの１データビツトインタバルに亘る全出力チップが同
じ極性を有することになる。ノイズが存在する場合には
、それらのいくつかにエラーが生じる。しかしながら、
導体９４上の出力チップを多数決することによって、通
信の信頼性が改善される。
データ相関器４６が全くシーケンス発生器を備えていな
い点に留意すべきである。従って、同期化させるシーケ
ンス発生器が全く無い。その代わりに、同期化は拡散コ
ードシーケンスの完全な１サイクル後に、即ち一旦遅延
レジスタ９２が充填された後に自動的に実行される。
上述したように、データビット毎のチップ数は拡散コー
ドシーケンス毎のチップ数と等しい必要がない。しかし
ながら、第６図示のエンコーダ２８内の遅延メモリ７２
、及び第７図及び第８図示の相関器４６内の遅延メモリ
８２．９２がそれぞれ拡散コードシーケンスのチップ数
と実質的に等しい遅れを供給する限り、差動符号化差動
相関によって展開スペクトラムシステムにデータ通路が
提供される。
［発明の効果］ 以上説明したように、本発明によれば展開スペクトラム
通信システムと共に使用される単一の経済的なデータ相
関器・データエンコーダが提供される。このシステムは
低コストであり、かつ受信展開スペクトラム信号に急速
に同期化させることができる。
【図面の簡単な説明】
第１図は、本発明による汎用展開スペクトラム通信シス
テムを示すブロック図である。 第２ａ図、第２ｂ図、第２ｃ図からなる第２図は、本発
明と共に使用される拡散コードシーケンスを示すタイム
チャー１・である。 第３図は、本発明による展開スペクトラム送信器及び展
開スペクトラム受信器を有する展開スペクトラムモデム
を示すブロック図である。 第４図は、従来の展開スペクトラムデータエンコーダを
示すブロック図である。 第５図は、従来の展開スペクトラムデータ相関器を示す
ブロック図である。 第６図は、本発明による展開スペクトラムデータエンコ
ーダを示すブロック図である。 第７図は、本発明による展開スペクトラムデータ相関器
の実施例を示すブロック図である。 第８図は、本発明による展開スペクトラムデータ相関器
の第２実施例を示すブロック図である。 １０・・・データ入力端子 １２・・・展開スペクトラム変調器 １４・・・ＲＦ送信器　　１６・・・送信アンテナ１８
・・・受信アンテナ　２０・・・ＲＦ受信器２２・・・
展開スペクトラム復調器 ２６・・・データデバイス ２８・・・展開スペクトラムエンコーダ３０・・・送信
器チップクロック ３４・・・ＰＳＫ変調器　３６・・・送受信スイッチ３
８・・・アンテナ　　　４０・・・ＰＳＫ１１１調器４
２・・・受信器チップクロック ４６・・・展開スペクトラム相関器 ５０・・・フィルタ・閾値回路 ５１・・・導体　　　　　５２・・・排他的ＯＲゲート
５４・・・シーケンス発生器 ９・・・導体 ０・・・４象限アナログ乗算器 １・・・導体 ２・・・同期シーケンス発生器 ３・・・導体　　　　　７０・・・排他的ＯＲゲート・
・導体　　　　　７２・・・遅延手段３・・・導体　　
　　　７４・・・排他的ＯＲアゲ−・・・導体　　　　
　８０・・・４象限乗算器１・・・導体　　　　　８２
・・・遅延手段３．８４・・・導体　　９０・・・排他
的ＯＲゲート・・導体　　　　　９２・・・遅延手段３
〜９５・・・導体 ト ト ト 特 許出願人 アジリス・コーポレイショ ン 代 理　　　人　　弁理士　大　島　陽 手続補正書（方 式） 事件の表示 平成１年特許願第２９４７６４号 発明の名称 差動展開スペクトラムデータエンコーダとデータ相関器
と居　　　所　〒　１０２　　東京都千代田区飯口］橋
１−８（発送臼　平成２年２月２７日） ６、補正により増加する請求項の数　　０７、補正の対
象　願書の特許出願人の欄、委任状とその訳文並びに図
面 ８、補正の内容　別紙の通り （図面については内容に変更ない

Claims (15)

    【特許請求の範囲】
  1. （１）入力データ信号を受け取るための入力端子と、 出力端子と、 展開スペクトラム拡散コードシーケンスを発生する手段
    と、 前記出力端子に展開スペクトラム信号を供給するために
    、前記展開スペクトラム拡散コードシーケンス発生手段
    及び前記入力端子に於ける前記入力データ信号に応答す
    る差動符号化手段とを備え、前記差動符号化手段が、現
    在の前記入力データ信号が第１の論理レベルである場合
    に、前記出力端子に於ける或る固定時間遅れ前の前記展
    開スペクトラム拡散コードシーケンスの極性に関して前
    記展開スペクトラム拡散コードシーケンスの極性を反転
    させるための手段を備え、かつ 前記差動符号化手段が、現在の前記入力データ信号が第
    ２の論理レベルである場合に、前記出力端子に於ける前
    記固定時間遅れ前の前記展開スペクトラム拡散コードシ
    ーケンスの極性に関して前記展開スペクトラム拡散コー
    ドシーケンスの極性を反転させない手段を備えることを
    特徴とする差動展開スペクトラムデータエンコーダ。
  2. （２）前記差動符号化手段が、 前記入力端子に接続された第１入力端子と第２入力端子
    と出力端子を有する第１排他的ＯＲ（論理和）ゲートと
    、 前記第１排他的ＯＲゲートの前記出力端子に接続された
    入力端子と、前記第１排他的ＯＲゲートの前記第２入力
    端子に接続された出力端子とを有する遅延手段と、 前記第１排他的ＯＲゲートの前記出力端子に於ける信号
    と前記展開スペクトラム拡散コードシーケンス発生手段
    の出力とを結合するための手段とを備えることを特徴と
    する特許請求の範囲第１項に記載の差動展開スペクトラ
    ムデータエンコーダ。
  3. （３）前記結合手段が、 第１及び第２入力端子と出力端子とを有する第２排他的
    ＯＲゲートと、 前記第２排他的ＯＲゲートの前記第１入力端子を前記第
    １排他的ＯＲゲートの前記出力端子に接続するための手
    段と、 前記第２排他的ＯＲゲートの前記第２入力端子を前記展
    開スペクトラム拡散コードシーケンス発生手段の出力に
    結合する手段と、 前記第２排他的ＯＲゲートの前記出力端子を前記出力端
    子に接続する手段とを備えることを特徴とする特許請求
    の範囲第２項に記載の差動展開スペクトラムデータエン
    コーダ。
  4. （４）データ入力信号を受け取るための入力端子と、 第１及び第２入力端子と、出力端子とを有する第１及び
    第２排他的ＯＲゲートとを備え、かつ前記第１排他的Ｏ
    Ｒゲートの前記第１入力端子が前記入力端子に接続され
    ており、 前記第１排他的ＯＲゲートの出力端子に接続された入力
    端子と、前記第１排他的ＯＲゲートの前記第２入力端子
    に接続された出力端子とを有する遅延手段と、 展開スペクトラム拡張シーケンスを発生するための手段
    と、 前記展開スペクトラム拡散コードシーケンス発生手段の
    出力を前記第２排他的ＯＲゲートの第２入力端子に接続
    する手段と、 前記第１排他的ＯＲゲートの前記出力端子を前記第２排
    他的ＯＲゲートの前記第１入力端子に接続する手段と、 前記第２排他的ＯＲゲートの前記出力端子に接続された
    出力端子とを備えることを特徴とする差動展開スペクト
    ラムデータエンコーダ。
  5. （５）入力データ信号に従って差動を符号化された拡散
    コードシーケンスを有する展開スペクトラム通信システ
    ムに於て、 前記展開スペクトラム信号を受け取るための入力端子と
    、 出力端子と、 前記入力端子に於ける現在受信展開スペクトラム拡散コ
    ードシーケンスの少くとも１チップと前受信展開スペク
    トラム拡散コードシーケンスの少くとも１チップとが実
    質的に等しいかどうかを決定するために前記入力端子に
    接続された差動符号化手段とを備え、 前記差動符号化手段が、前記現在受信展開スペクトラム
    拡散コードシーケンスの前記チップと前記前受信展開ス
    ペクトラム拡散コードシーケンスの前記チップとが実質
    的に等しい場合に前記出力端子に第１論理レベルの出力
    を供給し、かつ前記差動符号化手段が、前記現在受信展
    開スペクトラム拡散コードシーケンスの前記チップと前
    記前受信展開スペクトラム拡散コードシーケンスの前記
    チップとが実質的に等しくない場合に前記出力端子に第
    ２論理レベルの出力を供給することを特徴とするデータ
    相関器。
  6. （６）入力データ信号に従って差動符号化された拡散コ
    ードシーケンスを有する展開スペクトラム信号を含む展
    開スペクトラム通信システムに於て、前記展開スペクト
    ラム信号を受け取るための入力端子と、 前記展開スペクトラム信号を受け取るための前記入力端
    子に結合された第１入力端子と、第２入力端子と、出力
    端子とを有する排他的ＯＲゲートと、 前記展開スペクトラム信号を受け取るための前記入力端
    子に結合された入力端子と、前記排他的ＯＲゲートの前
    記第２入力端子に結合された出力端子とを有する遅延手
    段と、 前記排他的ＯＲゲートの前記出力端子に結合された出力
    端子とを備えることを特徴とするデータ相関器。
  7. （７）前記遅延手段によって供給される時間遅れが、前
    記展開スペクトラム拡散コードシーケンスの１サイクル
    の持続時間と実質的に等しいことを特徴とする特許請求
    の範囲第６項に記載のデータ相関器。
  8. （８）入力データ信号に従って差動符号化された拡散コ
    ードシーケンスを有する展開スペクトラム通信システム
    に於て、前記展開スペクトラム信号を受け取るための入
    力端子と、 出力端子と、 前記入力端子に於ける現在受信展開スペクトラム拡散コ
    ードシーケンスの少くとも１チップと前受信展開スペク
    トラム拡散コードシーケンスの少くも１チップとが同じ
    極性を有するかどうかを決定するための前記入力端子に
    結合された差動符号化手段とを備え、 前記差動符号化手段が、前記現在受信展開スペクトラム
    拡散コードシーケンスの前記チップと前記前受信展開ス
    ペクトラム拡散コードシーケンスの前記チップとが同じ
    極性を有する場合に前記出力端子に第１アナログ信号出
    力表示を供給し、かつ 前記差動符号化手段が、前記現在受信展開スペクトラム
    拡散コードシーケンスの前記チップと前記前受信展開ス
    ペクトラム拡散コードシーケンスの前記チップとが反対
    の極性を有する場合に前記出力端子に第２アナログ信号
    出力表示を供給することを特徴とするデータ相関器。
  9. （９）入力データ信号に従って差動符号化された拡散コ
    ードシーケンスを有する展開スペクトラム信号を含む展
    開スペクトラム通信システムに於て、前記展開スペクト
    ラム信号を受け取るための入力端子と、 前記入力端子に結合された第１入力端子と、第２入力端
    子と、出力端子とを有するアナログ乗算手段と、 前記展開スペクトラム信号を受け取るために前記入力端
    子に結合された入力端子と、前記アナログ乗算手段の前
    記第２入力端子に結合された出力端子とを有するアナロ
    グ遅延手段と、 前記アナログ乗算手段の前記出力端子に結合された出力
    端子とを備えることを特徴とするデータ相関器。
  10. （１０）前記アナログ遅延手段によって与えられる前記
    時間遅れが前記展開スペクトラム拡散コードシーケンス
    の１サイクルの持続時間と実質的に同じであることを特
    徴とする特許請求の範囲第９項に記載のデータ相関器。
  11. （１１）入力データ信号で展開スペクトラム信号を符号
    化するための方法であって、 展開スペクトラム拡散コードシーケンスを発生する過程
    と、 現在入力データ信号が第１論理レベルである場合に、或
    る固定時間遅れ前の前記展開スペクトラム拡散コードシ
    ーケンスの極性に関して前記展開スペクトラム拡散コー
    ドシーケンスの極性を反転する過程と、 前記現在入力データ信号が第２論理レベルである場合に
    、前記固定時間遅れ前の前記展開スペクトラム拡散コー
    ドシーケンスの極性に関して前記展開スペクトラム拡散
    コードシーケンスの極性を反転しない過程とからなるこ
    とを特徴とする展開スペクトラム信号符号化方法。
  12. （１２）前記拡散コードシーケンスの前記チップの反転
    を制御するための現在反転制御信号を発生するために、
    遅延メモリ内に前反転制御信号の少くとも部分を記憶す
    る過程と、現在入力データ信号と前記遅延メモリ内に記
    憶された前記前反転制御信号との排他的論理和を計算し
    て現在反転制御信号を形成する過程とからなる方法を更
    に含むことを特徴とする特許請求の範囲第１１項に記載
    の展開スペクトラム信号符号化方法。
  13. （１３）入力データ信号に従って差動符号化された拡散
    コードシーケンスを有する展開スペクトラム信号を含む
    展開スペクトラム通信システムに於て、前記展開スペク
    トラム信号に前記データ信号を相関するための方法であ
    って、 現在受信展開スペクトラム拡散コードシーケンスの少く
    とも１チップと前受信展開スペクトラム拡散コードシー
    ケンスの少くとも１チップとが実質的に等しいかどうか
    を決定する過程と、 前記現在受信展開スペクトラム拡散コードシーケンスの
    前記チップと前記前受信展開スペクトラム拡散コードシ
    ーケンスの前記チップとが実質的に等しい場合に第１出
    力信号表示を供給する過程と、 前記現在受信展開スペクトラム拡散コードシーケンスの
    前記チップと前記前受信展開スペクトラム拡散コードシ
    ーケンスの前記チップとが実質的に等しくない場合に第
    ２出力信号表示を供給する過程とからなることを特徴と
    するデータ信号相関方法。
  14. （１４）現在受信展開スペクトラム拡散コードシーケン
    スの少くとも１チップと前受信展開スペクトラム拡散コ
    ードシーケンスの少くとも１チップとが実質的に等しい
    かどうかを決定する前記過程が、 遅延メモリ内に前記前受信展開スペクトラム拡散コード
    シーケンスを記憶する過程と、 前記現在受信展開スペクトラム拡散コードシーケンスの
    少くとも１チップと記憶された前記展開スペクトラム拡
    散コードシーケンスの少くとも１チップとの排他的論理
    を計算する過程とを更に含むことを特徴とする特許請求
    の範囲第１３項に記載のデータ信号相関方法。
  15. （１５）現在受信展開スペクトラム拡散コードシーケン
    スの少くとも１チップと前受信展開スペクトラム拡散コ
    ードシーケンスの少くとも１チップとが実質的に等しい
    かどうかを決定する前記過程が、 前記前受信展開スペクトラム拡散コードシーケンスを遅
    延メモリに記憶する過程と、 前記現在受信展開スペクトラム拡散コードシーケンスの
    少くとも１チップと記憶された前記展開スペクトラム拡
    散コードシーケンスの少くとも１チップとの積を計算す
    る過程を更に含むことを特徴とする特許請求の範囲第１
    ３項に記載のデータ信号相関方法。
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