JPH02161839A - 伝送路障害モニタ回路 - Google Patents
伝送路障害モニタ回路Info
- Publication number
- JPH02161839A JPH02161839A JP31682088A JP31682088A JPH02161839A JP H02161839 A JPH02161839 A JP H02161839A JP 31682088 A JP31682088 A JP 31682088A JP 31682088 A JP31682088 A JP 31682088A JP H02161839 A JPH02161839 A JP H02161839A
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- JP
- Japan
- Prior art keywords
- transmission line
- data
- fault
- circuits
- transmission
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 54
- 238000012423 maintenance Methods 0.000 abstract description 2
- 238000001514 detection method Methods 0.000 abstract 1
- 238000005259 measurement Methods 0.000 abstract 1
- 238000012544 monitoring process Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 3
- 101100524639 Toxoplasma gondii ROM3 gene Proteins 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
ディジクルのデータ伝送装置に使用され、伝送路の障害
をモニタする伝送路障害モニタ回路に関し、 伝送路の障害の監視・検出を特別な測定器を用いること
なく行える伝送路障害モニタ回路を提供することを目的
とし、 伝送路に接続され、伝送路からの入力データに対して所
定の符号化を行うインタフェース部を有する伝送装置に
おいて、インタフェース部に、複数ビットからなる特定
のパターンのデータを記憶する記憶回路と、記憶回路か
ら読み出したデータと伝送路から入力したデータとを入
力して両者の比較を行い両者が不一致の時伝送路に障害
が発生したと判定する比較・判定回路とを設けて構成す
る。
をモニタする伝送路障害モニタ回路に関し、 伝送路の障害の監視・検出を特別な測定器を用いること
なく行える伝送路障害モニタ回路を提供することを目的
とし、 伝送路に接続され、伝送路からの入力データに対して所
定の符号化を行うインタフェース部を有する伝送装置に
おいて、インタフェース部に、複数ビットからなる特定
のパターンのデータを記憶する記憶回路と、記憶回路か
ら読み出したデータと伝送路から入力したデータとを入
力して両者の比較を行い両者が不一致の時伝送路に障害
が発生したと判定する比較・判定回路とを設けて構成す
る。
本発明は、ディジタルのデータ伝送装置に使用され、伝
送路の障害をモニタする伝送路障害モニタ回路に関する
ものである。
送路の障害をモニタする伝送路障害モニタ回路に関する
ものである。
この際、伝送路の障害の監視・検出を特別な測定器を用
いることなく行える伝送路障害モニタ回路が要望されて
いる。
いることなく行える伝送路障害モニタ回路が要望されて
いる。
〔従来の技術]
第4図は従来例の伝送路障害をモニタする系を示す図で
ある。
ある。
第4図において、例えば一方の加入者の端末装置1−1
から相手側の加入者の端末装置8−1にデータを伝送す
る時、伝送路を介してバイポーラのデータを伝送装置2
に入力し、伝送装置2内のバイポーラ/ユニポーラ変換
回路(以下B/Uと称する)3−1でユニポーラのデー
タに変換した後、出力を多重化部(以下MUXと称する
)4に加えて他の加入者からのデータとともに多重化を
行う。
から相手側の加入者の端末装置8−1にデータを伝送す
る時、伝送路を介してバイポーラのデータを伝送装置2
に入力し、伝送装置2内のバイポーラ/ユニポーラ変換
回路(以下B/Uと称する)3−1でユニポーラのデー
タに変換した後、出力を多重化部(以下MUXと称する
)4に加えて他の加入者からのデータとともに多重化を
行う。
そして伝送路に送出し、相手側の加入者の端末装置に接
続された伝送装置5内の多重化分離装置(以下DMUX
と称する)6において多重化したデータを分離し、ユニ
ポーラ/バイポーラ変換回路(以下U/Bと称する)7
−1においてユニポーラからバイポーラのデータに変換
して伝送路に送出し相手側の加入者の端末装置8−1に
転送していた。
続された伝送装置5内の多重化分離装置(以下DMUX
と称する)6において多重化したデータを分離し、ユニ
ポーラ/バイポーラ変換回路(以下U/Bと称する)7
−1においてユニポーラからバイポーラのデータに変換
して伝送路に送出し相手側の加入者の端末装置8−1に
転送していた。
今、伝送路11−1に障害が発生した場合、伝送路11
−1の障害の発生を確認するために伝送装置2の近くに
、伝送路11−1から分岐してアナライザ9−1を接続
する。そして端末装置1−1から特定のパターン、例え
ば“10010100”を伝送路11−1に送出しアナ
ライザ9−1で受信して、上記特定のパターンと一致す
るか否かを調べることにより伝送路11−1の障害の有
無を判定していた。
−1の障害の発生を確認するために伝送装置2の近くに
、伝送路11−1から分岐してアナライザ9−1を接続
する。そして端末装置1−1から特定のパターン、例え
ば“10010100”を伝送路11−1に送出しアナ
ライザ9−1で受信して、上記特定のパターンと一致す
るか否かを調べることにより伝送路11−1の障害の有
無を判定していた。
他の端末装置1−2〜1−n、又は8−1〜8−nに接
続された伝送路12−1〜12−nについても同様の方
法で行う。
続された伝送路12−1〜12−nについても同様の方
法で行う。
しかしながら上述のモニタ系においては、伝送路の障害
を監視・検出するのに特別の測定器を用いていたため、
保守にコス1−がかかるという問題点があった。
を監視・検出するのに特別の測定器を用いていたため、
保守にコス1−がかかるという問題点があった。
したがって本発明の目的は、伝送路の障害の監視・検出
を特別な測定器を用いることなく行える伝送路障害モ・
ニタ回路を提供することにある。
を特別な測定器を用いることなく行える伝送路障害モ・
ニタ回路を提供することにある。
上記問題点は第1図に示す回路の構成によって解決され
る。
る。
即ち第1図において、伝送路に接続され、伝送路からの
入力データに対して所定の符号化を行うインタフェース
部350−1〜350−nを有する伝送装置において、
320−1〜320−nは複数ビットからなる特定のパ
ターンのデータを記憶する記憶回路である。
入力データに対して所定の符号化を行うインタフェース
部350−1〜350−nを有する伝送装置において、
320−1〜320−nは複数ビットからなる特定のパ
ターンのデータを記憶する記憶回路である。
330−1〜300−nは記憶回路から読み出したデー
タと伝送路から入力したデータとを入力して両者の比較
を行い両者が不一致の時伝送路に障害が発生したと判定
する比較・判定回路である。
タと伝送路から入力したデータとを入力して両者の比較
を行い両者が不一致の時伝送路に障害が発生したと判定
する比較・判定回路である。
上記320−1〜320−n及び330−1〜330−
nをインタフェース部350−1〜350−nに設ける
。
nをインタフェース部350−1〜350−nに設ける
。
第1図において、比較・判定回路330−1〜300−
nにおいて記憶回路320−1〜320−nから読み出
したデータと伝送路から入力したデータとを入力して両
者の比較を行い、両者が不一致の時伝送路に障害が発生
したと判定する。
nにおいて記憶回路320−1〜320−nから読み出
したデータと伝送路から入力したデータとを入力して両
者の比較を行い、両者が不一致の時伝送路に障害が発生
したと判定する。
この結果、伝送路の障害の監視・検出のための回路を装
置内に組み込むことにより、保守性の向上を図ることが
できる 〔実施例〕 第2図は本発明の実施例の回路の構成を示すブロック図
である。
置内に組み込むことにより、保守性の向上を図ることが
できる 〔実施例〕 第2図は本発明の実施例の回路の構成を示すブロック図
である。
第3図は実施例で使用されるCOMPの構成を示すブロ
ック図である。
ック図である。
全図を通じて同一符号は同一対象物を示す。
第2図において、例えば加入者の端末装置1O−1(図
示しない)からのバイポーラのデータが伝送路を介して
伝送装置20内のB1030−1に入力され、ユニポー
ラのデータに変換される。そして出力が分岐され、一方
がMUX (図示しない)に入力され、他方がインタフ
ェース部35−1内のシリアル/パラレル変換回路(以
下S/Pと称する) 31−1に入力され、シリアルの
データが例えば読み出し専用メモリ(以下ROMと称す
る)32−1に記憶したデータを読み出すための1ビツ
トの制御信号及び8ビツトからなるパラレルのデータ(
特定のパターン)に変換される。そして出力がROM3
2−1及び比較器(以下COMPと称する) 33−1
の一方の入力端子に加えられる。
示しない)からのバイポーラのデータが伝送路を介して
伝送装置20内のB1030−1に入力され、ユニポー
ラのデータに変換される。そして出力が分岐され、一方
がMUX (図示しない)に入力され、他方がインタフ
ェース部35−1内のシリアル/パラレル変換回路(以
下S/Pと称する) 31−1に入力され、シリアルの
データが例えば読み出し専用メモリ(以下ROMと称す
る)32−1に記憶したデータを読み出すための1ビツ
トの制御信号及び8ビツトからなるパラレルのデータ(
特定のパターン)に変換される。そして出力がROM3
2−1及び比較器(以下COMPと称する) 33−1
の一方の入力端子に加えられる。
ROM 32−1には予め、例えば8ビツトからなる特
定のパターンのデータ(例えば°10010100’と
する)を記憶させておく。ROM32−1に記憶した上
記データを上述の1ビツトの制御信号により読み出して
、COMP33−1の他方の入力端子に加える。COM
P33−1は例えば第3図に示すような回路で構成され
、AND回路33−11〜33−18の一方の入力端子
aには伝送路からのデータを、又すにはROM32−1
の出力データを入力する。上述した2つの入力の8ビツ
トのデータがすべて一致した時のみAND回路33−1
9から“1”が出力される。この出力“1″がモニタ回
路34−1に入力され、この場合伝送路に障害がないと
判定する。
定のパターンのデータ(例えば°10010100’と
する)を記憶させておく。ROM32−1に記憶した上
記データを上述の1ビツトの制御信号により読み出して
、COMP33−1の他方の入力端子に加える。COM
P33−1は例えば第3図に示すような回路で構成され
、AND回路33−11〜33−18の一方の入力端子
aには伝送路からのデータを、又すにはROM32−1
の出力データを入力する。上述した2つの入力の8ビツ
トのデータがすべて一致した時のみAND回路33−1
9から“1”が出力される。この出力“1″がモニタ回
路34−1に入力され、この場合伝送路に障害がないと
判定する。
又、第3図に示すAND回路33−11〜33−18の
どれかの出力が“0”の時AND回路33−19の出力
は“0”となり、モニタ回路34−1ではこの場合伝送
路に障害が発生したと判定する。
どれかの出力が“0”の時AND回路33−19の出力
は“0”となり、モニタ回路34−1ではこの場合伝送
路に障害が発生したと判定する。
このようにして伝送路の障害のモニタを行う。
以上説明したように本発明によれば、伝送路の障害の監
視・検出のための回路を装置内に組み込むことにより、
保守性の向上を図ることができる。
視・検出のための回路を装置内に組み込むことにより、
保守性の向上を図ることができる。
第1図は本発明の原理図、
第2図は本発明の実施例の回路の構成を示すブロック図
、 第3図は実施例で使用されるCOMPの構成を示すブロ
ック図、 第4図は従来例の伝送路障害をモニタする系を示す回で
ある。 図において 320−1〜320−n 330−1〜330−n を示す。 は記憶回路、 は比較・判定回路
、 第3図は実施例で使用されるCOMPの構成を示すブロ
ック図、 第4図は従来例の伝送路障害をモニタする系を示す回で
ある。 図において 320−1〜320−n 330−1〜330−n を示す。 は記憶回路、 は比較・判定回路
Claims (1)
- 【特許請求の範囲】 伝送路に接続され、該伝送路からの入力データに対して
所定の符号化を行うインタフェース部(350−1〜3
50−n)を有する伝送装置において、該インタフェー
ス部に、複数ビットからなる特定のパターンのデータを
記憶する記憶回路(320−1〜320−n)と、 該記憶回路から読み出したデータと該伝送路から入力し
たデータとを入力して両者の比較を行い、両者が不一致
の時該伝送路に障害が発生したと判定する比較・判定回
路(330−1〜330−n)とを設けたことを特徴と
する伝送路障害モニタ回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31682088A JPH02161839A (ja) | 1988-12-14 | 1988-12-14 | 伝送路障害モニタ回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31682088A JPH02161839A (ja) | 1988-12-14 | 1988-12-14 | 伝送路障害モニタ回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02161839A true JPH02161839A (ja) | 1990-06-21 |
Family
ID=18081280
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP31682088A Pending JPH02161839A (ja) | 1988-12-14 | 1988-12-14 | 伝送路障害モニタ回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02161839A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06334634A (ja) * | 1993-05-21 | 1994-12-02 | Nec Corp | テストパターン受信装置 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57135539A (en) * | 1981-02-14 | 1982-08-21 | Ando Electric Co Ltd | Bit collation circuit |
-
1988
- 1988-12-14 JP JP31682088A patent/JPH02161839A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57135539A (en) * | 1981-02-14 | 1982-08-21 | Ando Electric Co Ltd | Bit collation circuit |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06334634A (ja) * | 1993-05-21 | 1994-12-02 | Nec Corp | テストパターン受信装置 |
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