JPH02103932U - - Google Patents
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- Publication number
- JPH02103932U JPH02103932U JP1192789U JP1192789U JPH02103932U JP H02103932 U JPH02103932 U JP H02103932U JP 1192789 U JP1192789 U JP 1192789U JP 1192789 U JP1192789 U JP 1192789U JP H02103932 U JPH02103932 U JP H02103932U
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- JP
- Japan
- Prior art keywords
- digital
- analog conversion
- circuit
- analog
- converts
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims 20
- 238000010586 diagram Methods 0.000 description 1
Description
第1図は本考案によるデイジタル/アナログ変
換装置の第1の実施例を示すブロツク図、第2図
は第1図の動作説明に供するタイミングチヤート
、第3図は本考案によるデイジタル/アナログ変
換装置の第2の実施例、第4図は本考案によるデ
イジタル/アナログ変換装置の第3の実施例、第
5図は本考案によるデイジタル/アナログ変換装
置の第4の実施例、第6図及び第7図は従来のデ
イジタル/アナログ変換装置である。
符号の説明、14,51,62,73…ROM
、17,63…論理演算回路、19,20,55
,56,65,66,70,71…DAC,21
,57,67,72…DAC部、22,53,6
8,74…減衰回路、23,53,64,75…
アナログ加算回路。
FIG. 1 is a block diagram showing a first embodiment of the digital/analog converter according to the present invention, FIG. 2 is a timing chart for explaining the operation of FIG. 1, and FIG. 3 is a digital/analog converter according to the present invention. 4 shows a third embodiment of the digital/analog converter according to the present invention, FIG. 5 shows a fourth embodiment of the digital/analog converter according to the present invention, and FIGS. FIG. 7 shows a conventional digital/analog converter. Explanation of codes, 14, 51, 62, 73...ROM
, 17, 63...Logic operation circuit, 19, 20, 55
,56,65,66,70,71...DAC,21
, 57, 67, 72...DAC section, 22, 53, 6
8, 74...attenuation circuit, 23, 53, 64, 75...
Analog addition circuit.
Claims (1)
を変換する第1のデイジタル/アナログ変換回路
と、 前記第1のデイジタル/アナログ変換回路の出
力誤差補正データ入力デイジタル信号の下位ビツ
トのデータに基づくデイジタルデータを変換する
第2のデイジタル/アナログ変換回路と、 前記第1及び第2のデイジタル/アナログ変換
回路の出力を加算するアナログ加算回路とからな
るデイジタル/アナログ変換装置であり、 前記第1及び第2のデイジタル/アナログ変換
回路が、共に同一回路構成及び同一ビツト数であ
り、且つ一体に形成されていることを特徴とする
デイジタル/アナログ変換装置。 (2) 入力デイジタル信号の上位ビツトのデータ
を変換する第1のデイジタル/アナログ変換回路
と、 前記入力デイジタル信号の下位ビツトのデータ
に基づくデイジタルデータを変換する第2のデイ
ジタル/アナログ変換回路と、 前記第1及び第2のデイジタル/アナログ変換
回路の出力を加算するアナログ加算回路とからな
るデイジタル/アナログ変換回装置であり、 前記第1及び第2のデイジタル/アナログ変換
回路が、共に同一回路構成及び同一ビツト数であ
り、且つ一体に形成されていることを特徴とする
デイジタル/アナログ変換装置。 (3) 入力デイジタル信号を変換する第1のデイ
ジタル/アナログ変換回路と、 前記第1のデイジタル/アナログ変換回路の出
力誤差補正データを変換する第2のデイジタル/
アナログ変換回路と、 前記第1及び第2のデイジタル/アナログ変換
回路の出力を加算するアナログ加算回路とからな
るデイジタル/アナログ変換装置であり、 前記第1及び第2のデイジタル/アナログ変換
回路が、共に同一回路構成及び同一ビツト数であ
り、且つ一体に形成されていることを特徴とする
デイジタル/アナログ変換装置。[Claims for Utility Model Registration] (1) A first digital/analog conversion circuit that converts data of the upper bits of an input digital signal; and output error correction data of the first digital/analog conversion circuit of the input digital signal. A digital/analog conversion device comprising a second digital/analog conversion circuit that converts digital data based on lower bit data, and an analog addition circuit that adds the outputs of the first and second digital/analog conversion circuits. A digital/analog conversion device, wherein the first and second digital/analog conversion circuits have the same circuit configuration and the same number of bits, and are integrally formed. (2) a first digital/analog conversion circuit that converts the data of the upper bits of the input digital signal; a second digital/analog conversion circuit that converts the digital data based on the data of the lower bits of the input digital signal; A digital/analog conversion circuit device comprising an analog addition circuit that adds the outputs of the first and second digital/analog conversion circuits, wherein the first and second digital/analog conversion circuits both have the same circuit configuration. and a digital/analog converter having the same number of bits and being integrally formed. (3) a first digital/analog conversion circuit that converts an input digital signal; and a second digital/analog conversion circuit that converts output error correction data of the first digital/analog conversion circuit.
A digital/analog conversion device comprising an analog conversion circuit and an analog addition circuit that adds the outputs of the first and second digital/analog conversion circuits, the first and second digital/analog conversion circuits comprising: A digital/analog conversion device characterized in that both have the same circuit configuration and the same number of bits, and are integrally formed.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1192789U JPH02103932U (en) | 1989-02-03 | 1989-02-03 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1192789U JPH02103932U (en) | 1989-02-03 | 1989-02-03 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02103932U true JPH02103932U (en) | 1990-08-17 |
Family
ID=31220912
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1192789U Pending JPH02103932U (en) | 1989-02-03 | 1989-02-03 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02103932U (en) |
-
1989
- 1989-02-03 JP JP1192789U patent/JPH02103932U/ja active Pending
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