JPH0154643B2 - - Google Patents
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- Publication number
- JPH0154643B2 JPH0154643B2 JP7392584A JP7392584A JPH0154643B2 JP H0154643 B2 JPH0154643 B2 JP H0154643B2 JP 7392584 A JP7392584 A JP 7392584A JP 7392584 A JP7392584 A JP 7392584A JP H0154643 B2 JPH0154643 B2 JP H0154643B2
- Authority
- JP
- Japan
- Prior art keywords
- dot
- control circuit
- recording surface
- dot pattern
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000000034 method Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 2
- 230000007774 longterm Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
Landscapes
- Recording Measured Values (AREA)
Description
【発明の詳細な説明】
本発明は、紙送り方向と直交して配置され、か
つ１行に配列された複数のドツトを有するドツト
記録ヘツドと、入力するアナログ波形信号を逐次
サンプリングしてそのレベルに相当するドツトパ
ターン信号に変換するドツトパターン信号作成回
路と、横方向がドツト記録ヘツドのドツト数にそ
して縦方向が所定の入力波形の振幅に対応した単
位記録面に相当するアドレスを少なくとも有する
バツフアメモリとを備え、このメモリへ前記ドツ
ト信号作成回路により作成されストアされた単位
記録面のドツトパターン信号を横方向へアドレス
走査し、これを縦アドレス方向へ順にくり返して
読出し、ドツト記録ヘツドへ１ドツトラインずつ
記録させるように成つたドツト記録ヘツド式、例
えばサーマルヘツド式アナログ波形記録装置に関
するものである。
つ１行に配列された複数のドツトを有するドツト
記録ヘツドと、入力するアナログ波形信号を逐次
サンプリングしてそのレベルに相当するドツトパ
ターン信号に変換するドツトパターン信号作成回
路と、横方向がドツト記録ヘツドのドツト数にそ
して縦方向が所定の入力波形の振幅に対応した単
位記録面に相当するアドレスを少なくとも有する
バツフアメモリとを備え、このメモリへ前記ドツ
ト信号作成回路により作成されストアされた単位
記録面のドツトパターン信号を横方向へアドレス
走査し、これを縦アドレス方向へ順にくり返して
読出し、ドツト記録ヘツドへ１ドツトラインずつ
記録させるように成つたドツト記録ヘツド式、例
えばサーマルヘツド式アナログ波形記録装置に関
するものである。
この種の記録装置においては、バツフアメモリ
にストアされた単位記録面のドツトパターン信号
を単純に横方向へのアドレス走査を縦アドレス方
向へくり返し読出して記録させたのでは、記録紙
における単位記録面に単に１波形が描記されるこ
とになる。したがつて、長時間記録の場合この記
録方式では記録紙の消費量が増えるために、複数
の単位記録面を縦方向に少しずつずらして重ね書
きする方式が考えられた。しかしながら、横方向
へ１ドツトラインずつ記録させていくドツト記録
ヘツドを使うかぎり、現在記録しているドツトラ
インより以前に記録したドツトラインへ電気的に
戻つて重ね書きをすることは不可能である。その
種の高密度記録を行うためには、１つの単位記録
面の記録が終る毎に、記録紙自体を一定距離だけ
戻して重ね書きすれば可能であるが、記録紙を機
械的に往復動させるために、故障の原因となり易
いばかりか騒音の発生も避けられず、実用化は困
難であつた。
にストアされた単位記録面のドツトパターン信号
を単純に横方向へのアドレス走査を縦アドレス方
向へくり返し読出して記録させたのでは、記録紙
における単位記録面に単に１波形が描記されるこ
とになる。したがつて、長時間記録の場合この記
録方式では記録紙の消費量が増えるために、複数
の単位記録面を縦方向に少しずつずらして重ね書
きする方式が考えられた。しかしながら、横方向
へ１ドツトラインずつ記録させていくドツト記録
ヘツドを使うかぎり、現在記録しているドツトラ
インより以前に記録したドツトラインへ電気的に
戻つて重ね書きをすることは不可能である。その
種の高密度記録を行うためには、１つの単位記録
面の記録が終る毎に、記録紙自体を一定距離だけ
戻して重ね書きすれば可能であるが、記録紙を機
械的に往復動させるために、故障の原因となり易
いばかりか騒音の発生も避けられず、実用化は困
難であつた。
さらに別の従来例としては、非常に大きな記憶
容量を有するメモリへ、記録紙１ページ分（たと
えば30分間分）のアナログ波形を記憶した後に、
出力形式を定め１ページ分をまとめて記録するの
がある。しかしながら、この方法では膨大な容量
のメモリがいるばかりか、１ページ分のアナログ
波形が入力し終るまで、記録紙上で波形をみるこ
とができない。長時間記録計といえども過去の波
形データのみならず最新の波形データも観察する
必要がしばしば発生する。ところが１ページ分を
まとめて出力するこのような装置では最新の波形
あるいは実時間に近い波形を見ることは不可能で
ある。
容量を有するメモリへ、記録紙１ページ分（たと
えば30分間分）のアナログ波形を記憶した後に、
出力形式を定め１ページ分をまとめて記録するの
がある。しかしながら、この方法では膨大な容量
のメモリがいるばかりか、１ページ分のアナログ
波形が入力し終るまで、記録紙上で波形をみるこ
とができない。長時間記録計といえども過去の波
形データのみならず最新の波形データも観察する
必要がしばしば発生する。ところが１ページ分を
まとめて出力するこのような装置では最新の波形
あるいは実時間に近い波形を見ることは不可能で
ある。
よつて、本発明は、メモリ容量を増加すること
なく実時間に近いアナログ波形を所望の高密度に
かつ機械的な騒音を伴うことなく記録可能にする
ドツト記録ヘツド式アナログ波形記録装置を提供
することを目的とする。
なく実時間に近いアナログ波形を所望の高密度に
かつ機械的な騒音を伴うことなく記録可能にする
ドツト記録ヘツド式アナログ波形記録装置を提供
することを目的とする。
次に本発明を第１図の実施例を基に説明する。
１０は、記録紙１１の紙送り方向と直交して配
置された１行に複数ドツトを有するドツト記録ヘ
ツド例えばサーマルヘツド１２により、紙送りさ
れる記録紙１１に逐次１ドツトラインずつアナロ
グ波形のドツト記録を行なう記録器本体である。
２０は例えば周知の如くマイクロコンピユータを
利用したドツトパターン作成回路である。この回
路は、入力するアナログ波形信号を逐次サンプリ
ングしてデイジタル化し、サーマルヘツド１２の
ドツト数及び所定振幅に対応した縦横比の単位記
録面のドツトパターン信号に変換し、読出し時間
を考慮した少なくとも単位記録面に相当するアド
レス（容量）を有するバツフアメモリ２１へスト
アさせる。３０はバツフアメモリ２１にストアさ
れたドツトパターン信号が書込まれ、かつその読
出された信号をサーマルヘツド１２へ供給するよ
うにバツフアメモリ２１と同様に単位記録面に相
当のアドレスを有する出力用メモリ即ちRAMで
ある。４０はこの出力用メモリ３０へバツフアメ
モリ２１の単位記録面分のドツトパターン信号の
書込みを行なう際に、その縦方向アドレスを単位
記録面の書込みごとに１／ｎずつずらして書込み
を行わせる書込み制御回路である。これは、例え
ばバツフアメモリ２１の読出し信号のうち縦方向
アドレス信号を書込みごとに１／ｎずつずらすア
ドレス変換回路４１と、この書込み時にライト信
号を発生するライト信号発生回路４２とから構成
されている。５０は、出力用メモリ３０にストア
されたドツトパターン信号の読出及び単位記録面
の縦方向に１／ｎ領域ずつのサーマルヘツド１２
への供給を行なうと共に、出力用メモリ３０から
これらの供給済みの信号を消去する出力信号制御
回路である。これは、例えば読出し用のアドレス
信号発生回路５１と、そのアドレス信号を縦アド
レス方向に１／ｎずつ順にずらして選択するセレ
クタ５２と、リード信号及び消去用の“０”信号
を書込むためのライト信号を順に発生するリード
ライト制御回路５３とから構成されている。
置された１行に複数ドツトを有するドツト記録ヘ
ツド例えばサーマルヘツド１２により、紙送りさ
れる記録紙１１に逐次１ドツトラインずつアナロ
グ波形のドツト記録を行なう記録器本体である。
２０は例えば周知の如くマイクロコンピユータを
利用したドツトパターン作成回路である。この回
路は、入力するアナログ波形信号を逐次サンプリ
ングしてデイジタル化し、サーマルヘツド１２の
ドツト数及び所定振幅に対応した縦横比の単位記
録面のドツトパターン信号に変換し、読出し時間
を考慮した少なくとも単位記録面に相当するアド
レス（容量）を有するバツフアメモリ２１へスト
アさせる。３０はバツフアメモリ２１にストアさ
れたドツトパターン信号が書込まれ、かつその読
出された信号をサーマルヘツド１２へ供給するよ
うにバツフアメモリ２１と同様に単位記録面に相
当のアドレスを有する出力用メモリ即ちRAMで
ある。４０はこの出力用メモリ３０へバツフアメ
モリ２１の単位記録面分のドツトパターン信号の
書込みを行なう際に、その縦方向アドレスを単位
記録面の書込みごとに１／ｎずつずらして書込み
を行わせる書込み制御回路である。これは、例え
ばバツフアメモリ２１の読出し信号のうち縦方向
アドレス信号を書込みごとに１／ｎずつずらすア
ドレス変換回路４１と、この書込み時にライト信
号を発生するライト信号発生回路４２とから構成
されている。５０は、出力用メモリ３０にストア
されたドツトパターン信号の読出及び単位記録面
の縦方向に１／ｎ領域ずつのサーマルヘツド１２
への供給を行なうと共に、出力用メモリ３０から
これらの供給済みの信号を消去する出力信号制御
回路である。これは、例えば読出し用のアドレス
信号発生回路５１と、そのアドレス信号を縦アド
レス方向に１／ｎずつ順にずらして選択するセレ
クタ５２と、リード信号及び消去用の“０”信号
を書込むためのライト信号を順に発生するリード
ライト制御回路５３とから構成されている。
６０は少なくとも単位記録面のドツトパターン
作成終了ごとに先ず書込み制御回路４０を作動さ
せ、次いで出力信号制御回路５０を作動させるタ
イミング信号を発生するタイミング制御回路であ
る。
作成終了ごとに先ず書込み制御回路４０を作動さ
せ、次いで出力信号制御回路５０を作動させるタ
イミング信号を発生するタイミング制御回路であ
る。
動作は次の通りである。
ドツトパターン作成回路２０に、第２図に示す
ように記録面の縦幅に丁度相当する振幅の正弦波
状のアナログ波形信号が入力すると仮定する。そ
してこの回路２０は、単位記録面分のドツトパタ
ーン信号の作成が終了すると、バツフアメモリ２
１をリードモードにして読出し信号を発生する。
さらにこの作成終了信号に応答してタイミング制
御回路６０は、書込み制御回路４０を作動させ、
バツフアメモリ２１のドツトパターン信号を出力
用メモリ３０に書込ませ、その入力波形に対応し
たアドレスのデータを“１”にする（第３図ａ）。
次に出力信号制御回路５０は出力用メモリ３０か
ら１／ｎ、例えば1/4分のドツトパターン信号を
読出し、サーマルヘツド１２に供給して１ドツト
ラインずつ順に記録させる（第４図ａ）。次いで
Ｏ信号の書込みによりこの1/4分は出力用メモリ
３０から消去される（第４図ｂ）。この間バツフ
アメモリ２１の余分の領域に連続的に次の単位記
録面のドツトパターンがストアされ始めている。
ように記録面の縦幅に丁度相当する振幅の正弦波
状のアナログ波形信号が入力すると仮定する。そ
してこの回路２０は、単位記録面分のドツトパタ
ーン信号の作成が終了すると、バツフアメモリ２
１をリードモードにして読出し信号を発生する。
さらにこの作成終了信号に応答してタイミング制
御回路６０は、書込み制御回路４０を作動させ、
バツフアメモリ２１のドツトパターン信号を出力
用メモリ３０に書込ませ、その入力波形に対応し
たアドレスのデータを“１”にする（第３図ａ）。
次に出力信号制御回路５０は出力用メモリ３０か
ら１／ｎ、例えば1/4分のドツトパターン信号を
読出し、サーマルヘツド１２に供給して１ドツト
ラインずつ順に記録させる（第４図ａ）。次いで
Ｏ信号の書込みによりこの1/4分は出力用メモリ
３０から消去される（第４図ｂ）。この間バツフ
アメモリ２１の余分の領域に連続的に次の単位記
録面のドツトパターンがストアされ始めている。
次の単位記録面分のドツトパターン作成が終了
すると、このドツトパターン信号はアドレス変換
回路４１が縦方向のアドレス信号を単位記録面の
１／４だけずらすことにより出力用メモリ３０にず
れて、しかも重畳して書込まれる（第３図ｂ）。
そしてセレクタ５２の選択により単位記録面の2/
４領域が読出されて記録され（第４図ｂ）、かつ消
去される（第４図ｃ）。３番目及び４番目の単位
記録面のドツトパターン信号の作成が終了するご
とに、出力用メモリ３０への1/4単位記録面ずつ
ずれた消去・重畳書込み及び3/4領域及び4/4領域
の記録が行われる（第３図ｃ、第４図ｃ及び第３
図ｄ、第４図ｄ）。4/4領域の記録が終了すると、
再び出力用メモリ３０へアドレス信号のずれない
書込みが行われ、1/4領域の記録が行われる（第
３図ｅ、第４図ｅ）。以下、第３図ｆ、第４図ｆ
と同様な動作をくり返す。結果として第５図に示
すように１個の出力用メモリの追加で記録紙１１
の単位記録面への重ね書き、即ち高密度記録が行
われる。
すると、このドツトパターン信号はアドレス変換
回路４１が縦方向のアドレス信号を単位記録面の
１／４だけずらすことにより出力用メモリ３０にず
れて、しかも重畳して書込まれる（第３図ｂ）。
そしてセレクタ５２の選択により単位記録面の2/
４領域が読出されて記録され（第４図ｂ）、かつ消
去される（第４図ｃ）。３番目及び４番目の単位
記録面のドツトパターン信号の作成が終了するご
とに、出力用メモリ３０への1/4単位記録面ずつ
ずれた消去・重畳書込み及び3/4領域及び4/4領域
の記録が行われる（第３図ｃ、第４図ｃ及び第３
図ｄ、第４図ｄ）。4/4領域の記録が終了すると、
再び出力用メモリ３０へアドレス信号のずれない
書込みが行われ、1/4領域の記録が行われる（第
３図ｅ、第４図ｅ）。以下、第３図ｆ、第４図ｆ
と同様な動作をくり返す。結果として第５図に示
すように１個の出力用メモリの追加で記録紙１１
の単位記録面への重ね書き、即ち高密度記録が行
われる。
以上、本発明により単位記録面に相当する容量
の出力用メモリを追加し、このメモリへバツフア
メモリにストアされた単位記録面分のドツトパタ
ーン信号を縦方向アドレスについて順に１／ｎず
つずらしてもとの信号と重畳して書込み、一方ド
ツト記録ヘツドには出力用メモリの信号を１ドツ
トラインずつずらして供給し、かつ出力用メモリ
から消去することにより、記録紙上の単位記録面
において連続する入力アナログ波形が実時間に近
い形で描記される。即ち本発明によれば単位記録
面分のメモリの単に１個の追加で所望の高密度記
録が騒音を伴うことなく可能になる。
の出力用メモリを追加し、このメモリへバツフア
メモリにストアされた単位記録面分のドツトパタ
ーン信号を縦方向アドレスについて順に１／ｎず
つずらしてもとの信号と重畳して書込み、一方ド
ツト記録ヘツドには出力用メモリの信号を１ドツ
トラインずつずらして供給し、かつ出力用メモリ
から消去することにより、記録紙上の単位記録面
において連続する入力アナログ波形が実時間に近
い形で描記される。即ち本発明によれば単位記録
面分のメモリの単に１個の追加で所望の高密度記
録が騒音を伴うことなく可能になる。
第１図は本発明によるアナログ波形記録装置の
第１の回路構成例、第２乃至５図はその各部の動
作説明図。 １０……アナログ波形記録装置、２０……ドツ
トパターン信号作成回路、２１……バツフアメモ
リ、３０……出力用メモリ、４０……書込み制御
回路、５０……出力信号制御回路、６０……タイ
ミング制御回路。
第１の回路構成例、第２乃至５図はその各部の動
作説明図。 １０……アナログ波形記録装置、２０……ドツ
トパターン信号作成回路、２１……バツフアメモ
リ、３０……出力用メモリ、４０……書込み制御
回路、５０……出力信号制御回路、６０……タイ
ミング制御回路。
Claims (1)
- １ 紙送り方向と直交して配置され、かつ１行に
配列された複数ドツトを有するドツト記録ヘツド
と、入力するアナログ波形信号を逐次サンプリン
グしてそのレベルに相当するドツトパターン信号
に変換するドツトパターン信号作成回路と、横方
向がドツト記録ヘツドのドツト数にそして縦方向
が所定の入力波形の振幅に対応した単位記録面に
相当するアドレスを少なくとも有するバツフアメ
モリとを備え、このメモリへ前記ドツトパターン
信号作成回路によりストアされた単位記録面のド
ツトパターン信号を横方向アドレス走査の縦アド
レス方向へのくり返しにより順に読出してドツト
記録ヘツドへ供給して１ドツトラインずつ記録す
るように成つたドツト記録ヘツド式アナログ波形
記録装置において、バツフアメモリから順に単位
記録面のドツトパターン信号を書込まれ、同様単
位記録面に相当するアドレス数を有する出力用メ
モリと、この書込みの際に順に単位記録面の縦ア
ドレスの１／ｎずつ縦アドレス方向にずらして書
込みを行わせる書込み制御回路と、前記出力用メ
モリからドツトパターン信号を読出して単位記録
面の縦アドレス方向に１ドツトラインずつ順にド
ツト記録ヘツドに供給し、かつこの供給された領
域のドツトパターン信号を前記出力用メモリから
消去させる出力信号制御回路と、単位記録面分の
ドツトパターン信号の作成ごとに前記書込み制御
回路を作動させ、次いで前記出力信号制御回路を
作動させるタイミング制御回路とを有することを
特徴とするドツト記録ヘツド式アナログ波形記録
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7392584A JPS60218031A (ja) | 1984-04-14 | 1984-04-14 | ドツト記録ヘツド式アナログ波形記録装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7392584A JPS60218031A (ja) | 1984-04-14 | 1984-04-14 | ドツト記録ヘツド式アナログ波形記録装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60218031A JPS60218031A (ja) | 1985-10-31 |
| JPH0154643B2 true JPH0154643B2 (ja) | 1989-11-20 |
Family
ID=13532203
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7392584A Granted JPS60218031A (ja) | 1984-04-14 | 1984-04-14 | ドツト記録ヘツド式アナログ波形記録装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60218031A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63148119A (ja) * | 1986-12-11 | 1988-06-21 | Nippon X-Ray Kk | 分析スペクトルの記録方式 |
-
1984
- 1984-04-14 JP JP7392584A patent/JPS60218031A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60218031A (ja) | 1985-10-31 |
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