JPH01290047A - 画像メモリ - Google Patents
画像メモリInfo
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- JPH01290047A JPH01290047A JP11986388A JP11986388A JPH01290047A JP H01290047 A JPH01290047 A JP H01290047A JP 11986388 A JP11986388 A JP 11986388A JP 11986388 A JP11986388 A JP 11986388A JP H01290047 A JPH01290047 A JP H01290047A
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- 238000010586 diagram Methods 0.000 description 8
- 238000000034 method Methods 0.000 description 7
- 238000006243 chemical reaction Methods 0.000 description 5
- 230000006870 function Effects 0.000 description 3
- 238000003672 processing method Methods 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 238000012905 input function Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
画像メモリの構成法に関し、
フレームアクセス、フィールドアクセス、２フイールド
の連続アクセス等を選択的に行うことができる画像メモ
リを構成することを目的とし、Ｘ方向にｍ画素、Ｙ方向
にｎ画素の内容を有する画像データに対して、Ｘ方向に
２ｍ画素、Ｙ方向に１０００画素の空間を持つ画像メモ
リを用意し、Ｙ方向のアドレスを発生するＹカウンタの
最下位ビット（ＡＯ９）をＸ方向のアドレスを発生する
Ｘカウンタの最上位ビットとしてフレームアクセスを行
う第１の手段と、上記Ｘカウンタの最上位ビットで奇数
フィールド／偶数フィールドアクセスを判定する第２の
手段とを設けて、上記第１の手段と第２の手段とを用い
てフレームアクセス、フィールドアクセスを選択的に行
うことができるように構成する。
の連続アクセス等を選択的に行うことができる画像メモ
リを構成することを目的とし、Ｘ方向にｍ画素、Ｙ方向
にｎ画素の内容を有する画像データに対して、Ｘ方向に
２ｍ画素、Ｙ方向に１０００画素の空間を持つ画像メモ
リを用意し、Ｙ方向のアドレスを発生するＹカウンタの
最下位ビット（ＡＯ９）をＸ方向のアドレスを発生する
Ｘカウンタの最上位ビットとしてフレームアクセスを行
う第１の手段と、上記Ｘカウンタの最上位ビットで奇数
フィールド／偶数フィールドアクセスを判定する第２の
手段とを設けて、上記第１の手段と第２の手段とを用い
てフレームアクセス、フィールドアクセスを選択的に行
うことができるように構成する。
本発明は、画像メモリの構成法に関する。
最近の画像処理の分野においては、１枚の画像データを
扱うものから、動画を扱うものが増加する傾向にある。
扱うものから、動画を扱うものが増加する傾向にある。
これは１秒当たりに何コマかの画像を生成し、連続的に
表示等を行うことで、画像の動きを人間の目に見せるも
のである。
表示等を行うことで、画像の動きを人間の目に見せるも
のである。
現在、ビデオレートという３０コマ／秒というものがあ
るが、フィルムで発展してきた分野、例えば、アニメー
ション等においては、２４コマ（フレーム）７秒という
世界（フレームアクセスの世界）で動画が実現されてい
る。又、テレビ等の規格に合わせる為には、飛び越し走
査（インクレース）で６０フイ一ルド／秒の画像処理（
フィールドアクセスの世界）が必要となる。
るが、フィルムで発展してきた分野、例えば、アニメー
ション等においては、２４コマ（フレーム）７秒という
世界（フレームアクセスの世界）で動画が実現されてい
る。又、テレビ等の規格に合わせる為には、飛び越し走
査（インクレース）で６０フイ一ルド／秒の画像処理（
フィールドアクセスの世界）が必要となる。
このような現状から、上記フレームアクセス。
フィールドアクセスを自由に選択制御できる画像メモリ
が必要とされる。
が必要とされる。
〔従来の技術と発明が解決しようとする課題〕第３図は
従来の画像処理方式を説明する図であり、（ａ）は画像
処理装置の構成例を示し、（ｂ）はフレーム→フィール
ド変換の例を示している。
従来の画像処理方式を説明する図であり、（ａ）は画像
処理装置の構成例を示し、（ｂ）はフレーム→フィール
ド変換の例を示している。
従来の画像処理装置では、画像メモリ １ばフレーム（
例えば、５１２ Ｘ５１２画素）単位で処理することを
目的として構成されている為、フィールド画像（例えば
、５１２ Ｘ２５６画素）を扱う為には、別に表示用メ
モリ２を持ち、処理ユニット３で変換処理を行い、表示
用メモリ２に書き込んで表示する必要があった。
例えば、５１２ Ｘ５１２画素）単位で処理することを
目的として構成されている為、フィールド画像（例えば
、５１２ Ｘ２５６画素）を扱う為には、別に表示用メ
モリ２を持ち、処理ユニット３で変換処理を行い、表示
用メモリ２に書き込んで表示する必要があった。
例えば、２４コマの画像（２４フレーム）を３０コマの
画像（６０フイールド）に変換する為には、（ｂ）図に
示した変換を必要とする。
画像（６０フイールド）に変換する為には、（ｂ）図に
示した変換を必要とする。
これは、左に示した八〜Ｄの４フレームの画像データを
、右のように、１０フイールドの画像データに変換し、
仮想的に５フレームの画像データに変換することにより
、２４コマの画像を３０コマの画像に変換するものであ
る。
、右のように、１０フイールドの画像データに変換し、
仮想的に５フレームの画像データに変換することにより
、２４コマの画像を３０コマの画像に変換するものであ
る。
このように、従来の画像メモリ １においては、フレー
ム単位で処理される構成になっている為、フィールドア
クセスをしたり、コマ数の変換を行う為には、別の表示
用メモリ２を持ち、処理ユニット３で処理する必要があ
り、回路量（表示用メモリ）が増大するという問題があ
った。
ム単位で処理される構成になっている為、フィールドア
クセスをしたり、コマ数の変換を行う為には、別の表示
用メモリ２を持ち、処理ユニット３で処理する必要があ
り、回路量（表示用メモリ）が増大するという問題があ
った。
本発明は上記従来の欠点に鑑み、画像処理装置において
、メモリ量を増加させることなく、フレームアクセス、
フィールドアクセスを選択的に行うことができる画像メ
モリを提供することを目的とするものである。
、メモリ量を増加させることなく、フレームアクセス、
フィールドアクセスを選択的に行うことができる画像メ
モリを提供することを目的とするものである。
第１図は本発明の画像メモリの原理を説明する図である
。
。
上記の問題点は下記の如くに構成された画像メモリによ
って解決される。
って解決される。
Ｘ方向にｍ画素、Ｘ方向にｎ画素の内容を有する画像デ
ータ■に対して、Ｘ方向に２ｍ画素、Ｙ方向に１／２ｎ
画素の空間を持つ画像メモリ １を用意し、 Ｘ方向のアドレスを発生するＹカウンタ１２の最下位ピ
ッ） （ＡＯ９）をＸ方向のアドレスを発生するＸカウ
ンタ１１の最上位ビットとして、フレームアクセスを行
う第１の手段と、 上記Ｘカウンタ１１の最上位ビットで奇数フィールド／
偶数フィールドアクセスを判定する第２の手段とを設け
て、 上記第１の手段と、第２の手段を用いて、フレームアク
セス、フィールドアクセスを選択的に行うように構成す
る。
ータ■に対して、Ｘ方向に２ｍ画素、Ｙ方向に１／２ｎ
画素の空間を持つ画像メモリ １を用意し、 Ｘ方向のアドレスを発生するＹカウンタ１２の最下位ピ
ッ） （ＡＯ９）をＸ方向のアドレスを発生するＸカウ
ンタ１１の最上位ビットとして、フレームアクセスを行
う第１の手段と、 上記Ｘカウンタ１１の最上位ビットで奇数フィールド／
偶数フィールドアクセスを判定する第２の手段とを設け
て、 上記第１の手段と、第２の手段を用いて、フレームアク
セス、フィールドアクセスを選択的に行うように構成す
る。
即ち、本発明によれば、■で示した、例えば、５１２
Ｘ５１２画素の画像を格納する画像メモリとして、Ｘ方
向を２倍、Ｘ方向を１７２倍、つまり、１０２４ Ｘ
２５６画素の画像メモリを構成する。
Ｘ５１２画素の画像を格納する画像メモリとして、Ｘ方
向を２倍、Ｘ方向を１７２倍、つまり、１０２４ Ｘ
２５６画素の画像メモリを構成する。
そして、本発明においては、■の画像データを、■のよ
うに格納し、画像処理をするようにすると、左半分は奇
数フィールド、右半分は偶数フィールドとなる。
うに格納し、画像処理をするようにすると、左半分は奇
数フィールド、右半分は偶数フィールドとなる。
従って、■のようにアクセスすると、フィールドアクセ
スができる。このフィールドアクセスを利用し、各フィ
ールドでのデータをブロックとして転送することで、容
易にフレーム画像を生成することができる。勿論、前述
の４フレーム−０５フレーム変換もアクセスするフィー
ルドのアドレス変換だけで実現することができる。
スができる。このフィールドアクセスを利用し、各フィ
ールドでのデータをブロックとして転送することで、容
易にフレーム画像を生成することができる。勿論、前述
の４フレーム−０５フレーム変換もアクセスするフィー
ルドのアドレス変換だけで実現することができる。
即ち、簡単なアドレス制御回路だけでフィールドアクセ
ス、フレームアクセス、２フイールドの連続アクセスが
できるようになり、フィールド処理によるフレーム画像
の生成が容易となる為、任意のコマ数の画像から任意の
コマ数の画像が容易に生成できる効果がある。
ス、フレームアクセス、２フイールドの連続アクセスが
できるようになり、フィールド処理によるフレーム画像
の生成が容易となる為、任意のコマ数の画像から任意の
コマ数の画像が容易に生成できる効果がある。
以下本発明の実施例を図面によって詳述する。
前述の第１図が本発明の画像メモリの原理を説明する図
であり、第２図は本発明の一実施例を示した図であり、
（ａ）は本発明の画像メモリを用いた画像処理装置の全
体構成の例を示し、（ｂ）は本発明の画像メモリにおけ
るアドレス制御回路の構成例を示した図であって、第２
図に示した画像メモリ １．及びＸカウンタ１２の最下
位ビット（ＡＯＯ）をＸカウンタ１１の最上位ビットと
する手段と、該Ｘカウンタ１１の最上位ビット（ＡＯＯ
）で奇数フィールド、偶数フィールドを判定する手段１
３が本発明を実施するのに必要な手段である。
であり、第２図は本発明の一実施例を示した図であり、
（ａ）は本発明の画像メモリを用いた画像処理装置の全
体構成の例を示し、（ｂ）は本発明の画像メモリにおけ
るアドレス制御回路の構成例を示した図であって、第２
図に示した画像メモリ １．及びＸカウンタ１２の最下
位ビット（ＡＯＯ）をＸカウンタ１１の最上位ビットと
する手段と、該Ｘカウンタ１１の最上位ビット（ＡＯＯ
）で奇数フィールド、偶数フィールドを判定する手段１
３が本発明を実施するのに必要な手段である。
以下、第１図を参照しながら、第２図によって本発明の
画像メモリの構成と、アドレス制御方式を説明する。
画像メモリの構成と、アドレス制御方式を説明する。
先ず、第２図（ａ）に示した画像処理装置において、マ
イクロプロセンサー（ＭＰＵ） ６からの指示に基づい
て、処理ユニット３が画像リードバス７を介して本発明
の画像メモリ １より画像データをもらい、処理結果を
画像ライトバス８を介して画像メモリ １に書き込まれ
る。この時、一般に、処理はフレーム単位となる。
イクロプロセンサー（ＭＰＵ） ６からの指示に基づい
て、処理ユニット３が画像リードバス７を介して本発明
の画像メモリ １より画像データをもらい、処理結果を
画像ライトバス８を介して画像メモリ １に書き込まれ
る。この時、一般に、処理はフレーム単位となる。
又、アダプタ４はビデオ機器（ＴＶカメラ、 ＶＴＲ等
）５と上記画像メモリ １との間の橋渡しをするもので
、一般に、その処理はテレビ等の規格によりフィールド
単位となる。
）５と上記画像メモリ １との間の橋渡しをするもので
、一般に、その処理はテレビ等の規格によりフィールド
単位となる。
従って、上記画像リードバス７、画像ライトバス８には
、フレームとしての処理の流れと、フィールドとしての
処理の流れがあることになる。
、フレームとしての処理の流れと、フィールドとしての
処理の流れがあることになる。
又、フレーム単位の処理を行う処理ユニット３は上記フ
ィールドとして流れる画像データの１フイールドを１フ
レームとして処理することで、結果的に画像メモリ １
上で、該フィールドを合成して別のフレーム画像を生成
することができる。
ィールドとして流れる画像データの１フイールドを１フ
レームとして処理することで、結果的に画像メモリ １
上で、該フィールドを合成して別のフレーム画像を生成
することができる。
このような画像処理を行う為の画像メモリ １内でのア
ドレス制御回路を示したものが、第２図（ｂ）である。
ドレス制御回路を示したものが、第２図（ｂ）である。
第１図に示した前述の５１２ Ｘ ５１２画素からなる
画像データ■を扱う為には、本図に示したように、八〇
〇〜Ａ１７の１８ビツトのアドレス線が必要となる。
画像データ■を扱う為には、本図に示したように、八〇
〇〜Ａ１７の１８ビツトのアドレス線が必要となる。
本図において、１１はＸ方向のアドレス（ＡＯＯ−ＡＯ
８）を示すＸカウンタ（ＣＮＴ）で、そのキャリ信号（
ＣＡＲＹ）はカウント値５１１を示す。
８）を示すＸカウンタ（ＣＮＴ）で、そのキャリ信号（
ＣＡＲＹ）はカウント値５１１を示す。
今、前述の処理ユニット３がフレーム処理を行うときに
は、２つのマルチプレクサ（ＭＰＸ） １４．１５に入
力された選択信号Ｃによって、各々のマルチプレクサ（
ＭＰＸ） １４．１５は上側の入力信号を出力するよう
に制御される。
は、２つのマルチプレクサ（ＭＰＸ） １４．１５に入
力された選択信号Ｃによって、各々のマルチプレクサ（
ＭＰＸ） １４．１５は上側の入力信号を出力するよう
に制御される。
この場合、上記Ｘカウンタ（ＣＮＴ） １１のキャリ信
号（ＣＡＲＹ）により、Ｊ−にフリップフロップ（ＦＦ
） １３が反転し、アドレス線ＡＯ９となるが、本発明
においては該アドレス線ＡＯ９をＸアドレスの最上位ビ
ットとして機能させる。
号（ＣＡＲＹ）により、Ｊ−にフリップフロップ（ＦＦ
） １３が反転し、アドレス線ＡＯ９となるが、本発明
においては該アドレス線ＡＯ９をＸアドレスの最上位ビ
ットとして機能させる。
そして、論理積回路１６とマルチプレクサ（ＭＰＸ）
１５ニより、Ｙ カラ７ ／ｙ （ＣＮＴ） １２ハ、
前もッテプリセットされた値からＹアドレスの上位ビッ
ト（Ａ１０〜八１７）を生成するように動作する。
１５ニより、Ｙ カラ７ ／ｙ （ＣＮＴ） １２ハ、
前もッテプリセットされた値からＹアドレスの上位ビッ
ト（Ａ１０〜八１７）を生成するように動作する。
そして、上記プリセット手段により、任意のフィールド
の先頭アドレスが設定された後、該Ｙ方向のアドレス（
Ａ１０〜八１７）が生成される。
の先頭アドレスが設定された後、該Ｙ方向のアドレス（
Ａ１０〜八１７）が生成される。
この結果、マルチプレクサ（ＭＰＸ） １５は、上記Ｘ
アドレスの最上位ビットとして機能するアドレス線Δ０
９が“１゛のときにしか、Ｙカウンタ（ＣＮＴ） １２
にキャリ（ＣＡＲＹ）信号を送出しないので、第１図の
■で示した形式でのフレームアクセスが行われることに
なる。
アドレスの最上位ビットとして機能するアドレス線Δ０
９が“１゛のときにしか、Ｙカウンタ（ＣＮＴ） １２
にキャリ（ＣＡＲＹ）信号を送出しないので、第１図の
■で示した形式でのフレームアクセスが行われることに
なる。
次に、本処理ユニット３で、前述のテレビ規格であるフ
ィールド処理を行う場合には、上記Ｊ−にフリップフロ
ップ（ＦＦ） １３のプリセット人力τ。
ィールド処理を行う場合には、上記Ｊ−にフリップフロ
ップ（ＦＦ） １３のプリセット人力τ。
リセット人力■によって、奇数フィールドアクセス、又
は偶数フィールドアクセスを選択することができる。つ
まり、リセット人力丁を“０゛にして、上記アドレス線
へ〇９を “０゛に固定化すると、第１図の■の左側の
画像データが選択でき、奇数フィールドのアクセスとな
り、プリセット入力−λ−を°Ｏ１にして、アドレス線
ＡＯ９をＩ′に固定化すると、第１図の■の右側の画像
データが選択でき、偶数フィールドのアクセスとなる。
は偶数フィールドアクセスを選択することができる。つ
まり、リセット人力丁を“０゛にして、上記アドレス線
へ〇９を “０゛に固定化すると、第１図の■の左側の
画像データが選択でき、奇数フィールドのアクセスとな
り、プリセット入力−λ−を°Ｏ１にして、アドレス線
ＡＯ９をＩ′に固定化すると、第１図の■の右側の画像
データが選択でき、偶数フィールドのアクセスとなる。
但し、この場合には、マルチプレクサ（ＭＰＸ） １４
゜１５に対する選択信号Ｃを、下側の入力を選択するよ
うにして、Ｘカウンタ（ＣＮＴ） １１のキャリ（ＣＡ
ＲＹ）により、Ｘアドレスの最上位ピント（八０９）を
無視して、Ｙカウンタ（ＣＮＴ） １２を動作させ、Ｙ
アドレス（Ａ１０〜＾１７）を生成するように機能させ
る。
゜１５に対する選択信号Ｃを、下側の入力を選択するよ
うにして、Ｘカウンタ（ＣＮＴ） １１のキャリ（ＣＡ
ＲＹ）により、Ｘアドレスの最上位ピント（八０９）を
無視して、Ｙカウンタ（ＣＮＴ） １２を動作させ、Ｙ
アドレス（Ａ１０〜＾１７）を生成するように機能させ
る。
又、上記Ｊ−にフリップフロップ（ＰＦ） １３のプリ
セント人力τ、リセット入力官を使用しないで、マルチ
プレクサ（ＭＰＸ） １４．１５に対する選択信号Ｃを
、下側の入力を選択するように指示することにより、第
１図の■の左側の奇数フィールドと、右側の偶ｌフィー
ルドとの２フイールドの連続アクセスが可能となる。
セント人力τ、リセット入力官を使用しないで、マルチ
プレクサ（ＭＰＸ） １４．１５に対する選択信号Ｃを
、下側の入力を選択するように指示することにより、第
１図の■の左側の奇数フィールドと、右側の偶ｌフィー
ルドとの２フイールドの連続アクセスが可能となる。
このように本発明の画像メモリ １でのアドレスを制御
することにより、フレーム処理、フィールド処理、更に
２フイールドの連続アクセス処理の為のアクセスを選択
的に行うことができるようになる。
することにより、フレーム処理、フィールド処理、更に
２フイールドの連続アクセス処理の為のアクセスを選択
的に行うことができるようになる。
例えば、第３図（ｂ）に示したフレーム変換処理を上記
任意のフィールドの先頭アドレスを指定したフィールド
アクセスにより簡単に実現することができる。
任意のフィールドの先頭アドレスを指定したフィールド
アクセスにより簡単に実現することができる。
上記の実施例においては、処理ユニット３でフレームデ
ータ、或いはフィールドデータを読み出して処理し、該
処理結果を画像メモリに書き込んで表示する等の例で説
明したが、例えば、マイクロプロセンサー（ＭＰＵ）
６からの指示により、本発明の画像メモリ １の上記ア
ドレス制御回路を直接制御することで、上記処理ユニッ
トを介することなく、画像リードバス７にフレーム画像
、或いはフィールド画像を読み出し、アダプタ４を介し
てビデオ機器５に出力２表示等もできることは明らかで
ある。
ータ、或いはフィールドデータを読み出して処理し、該
処理結果を画像メモリに書き込んで表示する等の例で説
明したが、例えば、マイクロプロセンサー（ＭＰＵ）
６からの指示により、本発明の画像メモリ １の上記ア
ドレス制御回路を直接制御することで、上記処理ユニッ
トを介することなく、画像リードバス７にフレーム画像
、或いはフィールド画像を読み出し、アダプタ４を介し
てビデオ機器５に出力２表示等もできることは明らかで
ある。
このように、本発明は、例えば、ｍ Ｘ ｎ画素からな
る画像データを格納する画像メモリとして、Ｘ方向が２
ｍ画素、Ｙ方向が１／２ｎ画素からなる画像メモリを用
意し、該画像メモリをアクセスする際には、任意の左半
分の奇数フィールド、或いは右半分の偶数フィールド単
位アクセス、或いは、奇数、偶数の２フイールド連続ア
クセス、更にはフレーム（但し、２ｍ×１／２ｎ画素）
単位のアクセスをして、フィールド単位の処理、或いは
、該フィールド単位のデータを合成してｍｘｎのフレー
ム画像を生成することができるようにした所に特徴があ
る。
る画像データを格納する画像メモリとして、Ｘ方向が２
ｍ画素、Ｙ方向が１／２ｎ画素からなる画像メモリを用
意し、該画像メモリをアクセスする際には、任意の左半
分の奇数フィールド、或いは右半分の偶数フィールド単
位アクセス、或いは、奇数、偶数の２フイールド連続ア
クセス、更にはフレーム（但し、２ｍ×１／２ｎ画素）
単位のアクセスをして、フィールド単位の処理、或いは
、該フィールド単位のデータを合成してｍｘｎのフレー
ム画像を生成することができるようにした所に特徴があ
る。
以上、詳細に説明したように、本発明の画像メモリは、
Ｘ方向にｍ画素、Ｘ方向にｎ画素の内容を有する画像デ
ータに対して、Ｘ方向に２ｍ画素。
Ｘ方向にｍ画素、Ｘ方向にｎ画素の内容を有する画像デ
ータに対して、Ｘ方向に２ｍ画素。
Ｘ方向に１／２ｎ画素の空間を持つ画像メモリを用意し
、Ｘ方向のアドレスを発生するＹカウンタの最下位ビッ
ト（ＡＯ９）をＸ方向のアドレスを発生するＸカウンタ
の最上位ビットとしてフレームアクセスを行う第１の手
段と、上記Ｘカウンタの最上位ピントで奇数フィールド
／偶数フィールドアクセスを判定する第２の手段とを設
けて、フレームアクセス、フィールドアクセスを選択的
に行うことができるように構成したものであるので、簡
単なアドレス制御回路だけでフィールドアクセス。
、Ｘ方向のアドレスを発生するＹカウンタの最下位ビッ
ト（ＡＯ９）をＸ方向のアドレスを発生するＸカウンタ
の最上位ビットとしてフレームアクセスを行う第１の手
段と、上記Ｘカウンタの最上位ピントで奇数フィールド
／偶数フィールドアクセスを判定する第２の手段とを設
けて、フレームアクセス、フィールドアクセスを選択的
に行うことができるように構成したものであるので、簡
単なアドレス制御回路だけでフィールドアクセス。
フレームアクセス、２フイールドの連続アクセスができ
るようになり、フィールド処理によるフレーム画像の生
成が容易となる為、任意のコマ数の画像から任意のコマ
数の画像が容易に生成できる効果がある。
るようになり、フィールド処理によるフレーム画像の生
成が容易となる為、任意のコマ数の画像から任意のコマ
数の画像が容易に生成できる効果がある。
＝１４−
第１図は本発明の画像メモリの原理を説明する図。
第２図は本発明の一実施例を説明する図。
第３図は従来の画像処理方式を説明する図。
である。
図面において、
１は画像メモリ、 ２は表示用メモリ１１１はＸ
カウンタ（ＣＮＴ）、 １２はＹカウンタ（ＣＮＴ）
。 １３はＪ−にフリッププロップ（ＦＦ）。 １４．１５はマルチプレクサ（ＭＰＸ） 。 ３は処理ユニット ４はアダプタ。 ５はビデオ機器。 ６はマイクロプロセンサー（ＭＰＵ）。 ７は画像リードバス、 ８は画像ライトバス。 ＾００〜Ａ１７は画像メモリのアドレス。 ＣＡＲＹはキャリ。 Ａ〜Ｄはフレーム。 ■は画像データ。 ■、■は格納、アクセス形式。 ４〈発υ月の連山イルメモリの、卵Ｊ 第 １ ■粂説朗する図 図 （シ） 従来のわ像勉理方九乏 ！３ 口 （ 「討υ月するの ６ぞの２）
カウンタ（ＣＮＴ）、 １２はＹカウンタ（ＣＮＴ）
。 １３はＪ−にフリッププロップ（ＦＦ）。 １４．１５はマルチプレクサ（ＭＰＸ） 。 ３は処理ユニット ４はアダプタ。 ５はビデオ機器。 ６はマイクロプロセンサー（ＭＰＵ）。 ７は画像リードバス、 ８は画像ライトバス。 ＾００〜Ａ１７は画像メモリのアドレス。 ＣＡＲＹはキャリ。 Ａ〜Ｄはフレーム。 ■は画像データ。 ■、■は格納、アクセス形式。 ４〈発υ月の連山イルメモリの、卵Ｊ 第 １ ■粂説朗する図 図 （シ） 従来のわ像勉理方九乏 ！３ 口 （ 「討υ月するの ６ぞの２）
Claims (1)
- 【特許請求の範囲】 Ｘ方向にｍ画素、Ｙ方向にｎ画素の内容を有する画像デ
ータに対して、Ｘ方向に２ｍ画素、Ｙ方向に１／２ｎ画
素の空間を持つ画像メモリ（１）を用意し、 Ｙ方向のアドレスを発生するＹカウンタ（１２）の最下
位ビット（ＡＯ９）をＸ方向のアドレスを発生するＸカ
ウンタ（１１）の最上位ビットとして、フレームアクセ
スを行う第１の手段と、 上記Ｘカウンタ（１１）の最上位ビットで奇数フィール
ド／偶数フィールドアクセスを判定する第２の手段とを
設けて、 上記第１の手段と、第２の手段を用いて、フレームアク
セス、フィールドアクセスを選択的に行うように構成し
たことを特徴とする画像メモリ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11986388A JPH01290047A (ja) | 1988-05-17 | 1988-05-17 | 画像メモリ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11986388A JPH01290047A (ja) | 1988-05-17 | 1988-05-17 | 画像メモリ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01290047A true JPH01290047A (ja) | 1989-11-21 |
Family
ID=14772137
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11986388A Pending JPH01290047A (ja) | 1988-05-17 | 1988-05-17 | 画像メモリ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01290047A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6125432A (en) * | 1994-10-21 | 2000-09-26 | Mitsubishi Denki Kabushiki Kaisha | Image process apparatus having a storage device with a plurality of banks storing pixel data, and capable of precharging one bank while writing to another bank |
-
1988
- 1988-05-17 JP JP11986388A patent/JPH01290047A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6125432A (en) * | 1994-10-21 | 2000-09-26 | Mitsubishi Denki Kabushiki Kaisha | Image process apparatus having a storage device with a plurality of banks storing pixel data, and capable of precharging one bank while writing to another bank |
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