JPH01256838A - Signal transmission system - Google Patents
Signal transmission systemInfo
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Abstract
Description
【発明の詳細な説明】
〔概 要〕
同期をとる為のフレーム信号とデータ信号とを多重化し
て通信を行う場合の信号伝送方式に関し、擬似同期を発
生することなくデータ伝送量も殆ど減少しない信号伝送
方式の提供を目的とし、ＣＭＩ符号化部にて、データ信
号の２ビット分を１データとしてＣＭｒ符号化則に従い
符号化した同期をとる為のフレーム信号と、情報として
のデータ信号とを多重化部にて多重化して伝送するよう
に構成する。[Detailed Description of the Invention] [Summary] Regarding a signal transmission method when performing communication by multiplexing frame signals and data signals for synchronization, pseudo synchronization does not occur and the amount of data transmission hardly decreases. For the purpose of providing a signal transmission system, a frame signal for synchronization, which is encoded according to the CMr encoding rule as 2 bits of a data signal as 1 data, and a data signal as information are encoded in a CMI encoding unit. The configuration is such that the multiplexing unit multiplexes and transmits the multiplexed data.
本発明は、非同期で通信を行う通信装置にて、同期をと
る為のフレーム信号とデータ信号とを多重化して通信を
行う場合の信号伝送方式の改良に関する。The present invention relates to an improvement in a signal transmission method when a communication device that performs asynchronous communication performs communication by multiplexing frame signals and data signals for synchronization.
ＣＭＩ （Ｃｏｄｅ−Ｍａｒｋ−１ｎｖｅｒｓｉｏｎ
）符号化則について説明すると、第６図に示す如く、通
常の場合は、入力符号がＯの時は、“０．１″とし、１
の時は、′″０，０”１゜１″を交番とするものである
。CMI (Code-Mark-1 version
) To explain the encoding rule, as shown in Figure 6, in the normal case, when the input code is O, it is set to "0.1", and 1
In the case of , the alternation is ``0,0''1゜1''.
ＣＲＶ （Ｃｏｄｅ−Ｒｕｌｅ−Ｖｉｏｌａｔｉｏｎ）
を掛ける時は、入力符号が０の時は、通常だと“０，１
”とするものを“１．０″とし、１の時は、通常だと、
前回の１の符号が“１．１”であれば次は“０．０′″
とするものを“１．１”を連続させて符号則を変化させ
ることにより信号を区別出来るようにするものである。CRV (Code-Rule-Violation)
When multiplying, if the input sign is 0, normally it is "0, 1
” is “1.0”, and when it is 1, normally,
If the previous sign of 1 is “1.1”, the next one is “0.0′”
By making "1.1" consecutive and changing the sign rule, signals can be distinguished.
第７図は従来例の信号のフレーム構成を示す図である。 FIG. 7 is a diagram showing a frame structure of a conventional signal.
従来同期をとる為のフレーム信号は、擬似同期を防ぐ為
に、第７図に示す如く、第１フレームでは例えば“１，
１．Ｏ，Ｏ”とすると、次の第２フレームではこれを反
転した“０，０，１．１”とするようにしていたが、こ
れでは、未だ擬似同期を発生することがある。Conventionally, in order to prevent false synchronization, the frame signal used for synchronization is, for example, "1," in the first frame, as shown in FIG.
1. 0, O", in the next second frame, this was reversed to "0, 0, 1.1", but with this, pseudo-synchronization may still occur.
そこで、擬似同期をなくする為に、フレーム信号、デー
タ信号共にＣＭＩ符号化する方式があるが、この場合は
２ビット分が１データとなるので、データ伝送量が１／
２となる。Therefore, in order to eliminate pseudo-synchronization, there is a method of CMI encoding both the frame signal and the data signal, but in this case, 2 bits become 1 data, so the data transmission amount is reduced by 1/2.
It becomes 2.
上記説明の如く、フレーム信号をフレーム毎に反転する
方式では擬似同期を発生することがある問題点があり、
ＣＭｒ符号化する方式では、データ伝送量が１／２とな
る問題点がある。As explained above, the method of inverting the frame signal for each frame has the problem that pseudo synchronization may occur.
The CMr encoding method has a problem in that the data transmission amount is halved.
本発明は、擬似同期を発生することなくデータ伝送量も
殆ど減少しない信号伝送方式の提供を目的としている。An object of the present invention is to provide a signal transmission method that does not cause pseudo-synchronization and hardly reduces the amount of data transmission.
〔課題を解決するための手段〕 第１図は本発明の原理ブロック図である。[Means to solve the problem] FIG. 1 is a block diagram of the principle of the present invention.
第１図に示す如く、同期をとる為のフレーム信号をＣＭ
Ｉ符号化部１にて、データ信号の２ビット分を１データ
としてＣＭＴ符号化則に従って符号化する。As shown in Figure 1, the frame signal for synchronization is
The I encoding unit 1 encodes two bits of the data signal as one data according to the CMT encoding rule.
そして、このＣＭＩ符号化したフレーム信号と、データ
信号とを多重化部２にて多重化して伝送するようにする
。Then, the CMI encoded frame signal and the data signal are multiplexed by the multiplexer 2 and transmitted.
本発明によれば、フレーム信号をＣＭＩ符号化部１にて
、ＣＭＩ符号化則に従って、ＣＭＩ符号化したフレーム
信号とデータ信号とを多重化部２にて多重化して伝送す
る。According to the present invention, a frame signal is sent to a CMI encoder 1, and a CMI encoded frame signal and a data signal are multiplexed and transmitted by a multiplexer 2 according to the CMI encoding rule.
即ち、フレーム信号はＣＭＩ符号化則に従っているので
、擬似同期を発生することなく、又データ信号の２ビッ
ト分を１データとするのはフレーム信号だけであるので
、データ伝送量も殆ど減少せずに信号を伝送することが
出来る。In other words, since the frame signal follows the CMI encoding rule, pseudo synchronization does not occur, and since only the frame signal converts 2 bits of the data signal into 1 data, the amount of data transmission hardly decreases. It is possible to transmit signals to.
以下本発明の実施例に付き図に従って説明する。 Embodiments of the present invention will be described below with reference to the accompanying drawings.
第２図は本発明の実施例の送信部のブロック図、第３図
は本発明の実施例の受信部のブロック図、第４図は第２
図の各部のタイムチャートで、（Ａ）〜（Ｅ）は第２図
のａ ”−ｅ点に対応している。FIG. 2 is a block diagram of a transmitter according to an embodiment of the present invention, FIG. 3 is a block diagram of a receiver according to an embodiment of the present invention, and FIG.
In the time charts for each part of the figure, (A) to (E) correspond to points a''-e in FIG.
第５図は第３図の各部のタイムチャートで、（Ａ）（Ｂ
）は第３図のａ、ｂ点に対応している。Figure 5 is a time chart of each part of Figure 3, (A) (B
) correspond to points a and b in FIG.
最初に、第２図、第４図を用いて送信側を説明する。First, the transmitting side will be explained using FIGS. 2 and 4.
通常は、スイッチｓｗｔ、ＳＷ２を実線側とし、フレー
ム信号発生部３より、フレーム信号を挿入する周期で、
且つフレーム信号を構成する各データは、通常のＮＲＺ
符号のデータの２ビット分を１データとする周期で、例
えば第４図（Ａ）に示す如き、“１，１．Ｏ，Ｏ” を
出力すると、ＣＭ！符号化部１にて、ＣＭＩ符号化する
と、（Ｂ）に示す如き”０．０，１，１，０，１，０゜
１”のフレーム信号となり、多重化部２に入力する。Normally, the switches swt and SW2 are set to the solid line side, and the frame signal is inserted from the frame signal generator 3 at a cycle.
In addition, each data constituting the frame signal is a normal NRZ
If you output "1, 1. O, O" as shown in FIG. 4(A), for example, at a cycle in which 2 bits of code data constitute 1 data, CM! When the signal is subjected to CMI encoding in the encoding unit 1, it becomes a frame signal of "0.0, 1, 1, 0, 1, 0°1" as shown in (B), which is input to the multiplexing unit 2.
一方ＣＣ）に示す如き、フレーム信号を挿入する部分を
除いた部分にＮＲＺ符号のデータを乗せたデータ信号が
多重化部２に送られており、多重化されて（Ｄ）に示す
フレーム構成の信号となり伝送される。On the other hand, as shown in CC), a data signal with NRZ code data carried in the part excluding the part where the frame signal is inserted is sent to the multiplexing unit 2, and is multiplexed into the frame structure shown in (D). It becomes a signal and is transmitted.
ここで、フレーム信号を利用して、制御信号を送信しよ
うとすると、同期保護回路として、例えば、５回フレー
ム同期が外れたら、同期外れとするようになっているも
のとすると、１０フレーム内に１回位ＣＲＶを掛けて送
信することが出来る。Here, when trying to transmit a control signal using a frame signal, if the synchronization protection circuit is designed to detect synchronization if the frame synchronization is lost five times, then within 10 frames. It is possible to multiply the CRV once and then send it.
この場合は、ＣＲＶを掛けるフレーム信号の時は、切り
替え信号により、スイッチＳＷ１．ＳＷ２を点線側に切
り替え、ＣＲＶを掛けて、多重化部２に入力し、データ
信号と多重化して伝送する。In this case, when the frame signal is subjected to CRV, the switch SW1. Switch SW2 to the dotted line side, apply CRV, input to the multiplexer 2, multiplex with the data signal, and transmit.
例えば、制御信号が”１，０，０．１″とすると、ＣＲ
Ｖを掛けたフレーム信号は、（Ｅ）に示す如く“１，１
，１，０，１，０，１，１”となる。For example, if the control signal is "1, 0, 0.1", CR
The frame signal multiplied by V is “1,1” as shown in (E).
, 1, 0, 1, 0, 1, 1''.
次に、第３図、第５図を用いて、受信側を説明する。Next, the receiving side will be explained using FIGS. 3 and 5.
通常の場合は、伝送路より、第４図（Ｄ）に示す如きフ
レーム構成の信号が入力し、分離部５及びＣＭＩ復号化
及びフレーム信号パターン照合回路６及びＣＲＶ検出部
９に入力する。In a normal case, a signal having a frame structure as shown in FIG.
ＣＭｒ復号化及びフレーム信号パターン照合回路６では
、ＣＭＩ復号化を行い、”１，１，０゜０”のフレーム
信号パターンとの照合を行い、整合する度に信号を同期
保護回路７に送り、例えば５回以上整合すれば、同期が
とれたとして、ハンチング回路８のハンチングを止め、
分離部５にて、データ信号を分離し、第５図（Ａ）に示
す如きＮＲＺ符号のデータ信号を出力する。The CMr decoding and frame signal pattern matching circuit 6 performs CMI decoding and matching with the frame signal pattern of "1, 1, 0° 0", and sends a signal to the synchronization protection circuit 7 every time there is a match. For example, if the matching occurs five times or more, it is assumed that synchronization has been achieved, and the hunting of the hunting circuit 8 is stopped.
A separation unit 5 separates the data signal and outputs an NRZ code data signal as shown in FIG. 5(A).
ＣＲＶ検出部９では、ＣＲＶを掛けていないので制御信
号は検出出来ず、０レベルの信号をアンド回路１０に送
り、出力を禁止する。CRV detection section 9 cannot detect a control signal because CRV is not applied, and sends a 0-level signal to AND circuit 10 to inhibit output.
例えば、“１，０，０．１”の制御信号を送る為に、例
えばフレーム信号の１０回に１回ＣＲＶを掛けた時は、
ＣＲＶを掛けたフレーム信号は第４図（Ｅ）に示す如き
信号となる。For example, in order to send a control signal of "1, 0, 0.1", if you multiply CRV once every 10 times of the frame signal,
The frame signal multiplied by CRV becomes a signal as shown in FIG. 4(E).
このＣＲＶを掛けたフレーム信号が入力すると、ＣＲＶ
検出部９では、この信号を検出してルベルの信号をアン
ド回路１０に送りと共に、復号化して第５図（Ｂ）に示
す如き“１．Ｏ，０，１”の制御信号のパターンを生成
し、アンド回路１０に送り、“１．０，０．１”の制御
信号を出力する。When a frame signal multiplied by this CRV is input, the CRV
The detection unit 9 detects this signal, sends the Lebel signal to the AND circuit 10, and decodes it to generate a control signal pattern of "1.O, 0, 1" as shown in FIG. 5(B). and sends it to the AND circuit 10, which outputs a control signal of "1.0, 0.1".
このＣＲＶを掛けたフレーム信号は、１０回のフレーム
信号に対して１回位であるので、同期保護回路７では、
同期が外れたとしないので、制御信号を送ることが出来
る。Since the frame signal multiplied by this CRV is about 1 out of 10 frame signals, the synchronization protection circuit 7
Since it does not assume that synchronization is lost, a control signal can be sent.
以上詳細に説明せる如く本発明によれば、擬似同期を発
生することなくデータ伝送量も殆ど減少せずにフレーム
構成の信号を伝送することが出来る効果がある。As explained in detail above, according to the present invention, it is possible to transmit a frame-structured signal without generating pseudo-synchronization and with almost no reduction in data transmission amount.
第１図は本発明の原理ブロック図、
第２図は本発明の実施例の送信部のブロック図、第３図
は本発明の実施例の受信部のブロック図、第４図は第２
図の各部のタイムチャート、第５図は第３図の各部のタ
イムチャート、第６図はＣＭＩ符号化則説明図、
第７図は従来例の信号のフレーム構成を示す図である。
図において、
１はＣＭＩ符号化部、
２は多重化部、
３はフレーム信号発生部、
４はＣＲＶ部、
５は分離部、
６はＣＭＩ復号化及びフレーム信号パターン照合回路、
７は同期保護回路、
８はハンチング回路、
９はＣＲＶ検出部、
１０はアンド回路を示す。
参発明の、原モ里フ゛ロツ２図
卑 １ （２）
４署６日月の実檄社４列の送信き予〇フ゛０ソフ区羊
２ 口FIG. 1 is a block diagram of the principle of the present invention, FIG. 2 is a block diagram of a transmitter according to an embodiment of the present invention, FIG. 3 is a block diagram of a receiver according to an embodiment of the present invention, and FIG. 4 is a block diagram of a receiver according to an embodiment of the present invention.
FIG. 5 is a time chart of each part in FIG. 3, FIG. 6 is an explanatory diagram of CMI encoding rules, and FIG. 7 is a diagram showing a frame structure of a conventional signal. In the figure, 1 is a CMI encoding section, 2 is a multiplexing section, 3 is a frame signal generation section, 4 is a CRV section, 5 is a separation section, 6 is a CMI decoding and frame signal pattern matching circuit, and 7 is a synchronization protection circuit. , 8 is a hunting circuit, 9 is a CRV detection section, and 10 is an AND circuit. Invented by Hara Mori, 2 drawings 1 (2) 4th station, 6th day, Jitsukisha, 4th row of transmission reservations
2 mouths
Claims (1)
符号化部（１）にて、データ信号の２ビット分を１デー
タとしてＣＭＩ符号化則に従い符号化したフレーム信号
と、データ信号とを多重化部（２）にて多重化して伝送
することを特徴とする信号伝送方式。CMI (Code・Mark・Inversion)
The frame signal encoded in accordance with the CMI encoding rule by the encoding unit (1) as 2 bits of the data signal as one data and the data signal are multiplexed and transmitted in the multiplexing unit (2). Characteristic signal transmission method.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63084906A JPH01256838A (en) | 1988-04-06 | 1988-04-06 | Signal transmission system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63084906A JPH01256838A (en) | 1988-04-06 | 1988-04-06 | Signal transmission system |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01256838A true JPH01256838A (en) | 1989-10-13 |
Family
ID=13843779
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63084906A Pending JPH01256838A (en) | 1988-04-06 | 1988-04-06 | Signal transmission system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01256838A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04252633A (en) * | 1991-01-29 | 1992-09-08 | Nec Corp | Digital signal transmission system |
-
1988
- 1988-04-06 JP JP63084906A patent/JPH01256838A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04252633A (en) * | 1991-01-29 | 1992-09-08 | Nec Corp | Digital signal transmission system |
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