JPH01194531A - Encode method for digital audio data - Google Patents

Encode method for digital audio data

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JPH01194531A
JPH01194531A JP1824488A JP1824488A JPH01194531A JP H01194531 A JPH01194531 A JP H01194531A JP 1824488 A JP1824488 A JP 1824488A JP 1824488 A JP1824488 A JP 1824488A JP H01194531 A JPH01194531 A JP H01194531A
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JP
Japan
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data
value
signal
circuit
supplied
Prior art date
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Pending
Application number
JP1824488A
Other languages
Japanese (ja)
Inventor
Hisayoshi Moriwaki
森脇 久芳
Hideki Fukazawa
秀木 深澤
Hiromi Takano
高野 ひろみ
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
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Publication date
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  • Compression, Expansion, Code Conversion, And Decoders (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Abstract

PURPOSE:To improve error correcting ability by transmitting a change part as well concerning the data of a high important degree when digital audio data are data-compressed and transmitted. CONSTITUTION:A transmitting system by an ADPCM to data-compress the digital audio data and to transmit the data is composed of an encoder 10, a signal transmitting system 30 and a decoder 40. Here, concerning the forecasting parameter of the high important degree, these parameters are recorded and the difference between the forecasting parameters to be correspondent between two blocks is obtained in every two blocks and this difference is recorded to the area of a remainded word. Thus, error correction is executed without fail to the forecasting parameter of the high important degree and the error correcting ability can be improved.

Description

【発明の詳細な説明】 以下の順序で説明する。[Detailed description of the invention] The explanation will be given in the following order.

A 産業上の利用分野 B 発明の概要 C従来の技術 D 発明が解決しようとする課題 E 課題を解決するための手段(第1図)F 作用 G 実施例 G1第1の実施例(第1図〜第4図) G2他の実施例 H発明の効果 A 産業上の利用分野 この発明はデジタルオーディオデータのエンコード方法
に関する。
A Industrial field of application B Overview of the invention C Prior art D Problem to be solved by the invention E Means for solving the problem (Fig. 1) F Effect G Embodiment G1 First embodiment (Fig. 1) ~FIG. 4) G2 Other Embodiments H Effects of the Invention A Industrial Application Field This invention relates to a method for encoding digital audio data.

B 発明の概要 この発明は、デジタルオーディオデータをデータ圧縮し
て伝送する場合において、重要度の高いデータについて
は、その変化分をも伝送することにより、より優れたデ
コードができるようにしたものである。
B. Summary of the Invention This invention enables better decoding by transmitting changes in highly important data when compressing and transmitting digital audio data. be.

C従来の技術 例えば、8ミリビデオにおいては、オプションの機能と
して、記録時、オーディオ信号をPCM信号にデジタル
化し、このPCM信号を、テープのオーバースキャン区
間に記録し、再生時、その逆の処理を行うことによりも
とのオーディオ信号を得ることが認められている。
C. Conventional technology For example, in 8 mm video, as an optional function, the audio signal is digitized into a PCM signal during recording, this PCM signal is recorded in the overscan section of the tape, and the reverse process is performed during playback. It is accepted that the original audio signal can be obtained by performing

この場合、PCM信号のサンプリング周波数及び量子化
ビット数を多くすれば、より優れた特性でオーディオ信
号を記録再生できるが、そのようにすると、記録再生す
べきビット数が多くなり、記録再生できなくなってしま
う。
In this case, if the sampling frequency and number of quantization bits of the PCM signal are increased, it is possible to record and play back the audio signal with better characteristics. It ends up.

そこで、記録時、PCM信号のビット数の圧縮を行い、
再生時、そのビット数の伸張を行うことにより、テープ
上のピント数が少なくても優れた記録再生特性が得られ
るようにすることが考えられている。
Therefore, when recording, the number of bits of the PCM signal is compressed.
It has been considered to expand the number of bits during reproduction so that excellent recording and reproduction characteristics can be obtained even if the number of focuses on the tape is small.

そして、そのようなビット圧縮・伸張の方法としてAD
PCMと呼ばれる方法がある。
AD is a method of bit compression/expansion.
There is a method called PCM.

第8図は、そのADPCMによる伝送システムの一例を
示し、この例においては、入力データの連続する64サ
ンプルごとに、その64サンプルを1ブロツクとし、こ
の1ブロツクごとに予測フィルタの予測係数を最適値に
制御する場合である。そして、このとき、人力データの
1サンプルごとにビット圧縮した主データを出力すると
ともに、1ブロツクごとにそのビット圧縮に関する補助
データを出力する。
FIG. 8 shows an example of a transmission system using ADPCM. In this example, each 64 consecutive samples of input data is treated as one block, and the prediction coefficients of the prediction filter are optimized for each block. This is the case when controlling the value. At this time, bit-compressed main data is output for each sample of the human data, and auxiliary data related to the bit compression is output for each block.

すなわち、同図において、(10)はエンコーダ、(3
0)は信号伝送系、(40)はデコーダを示し、例えば
、8ミリビデオにおけるPCM音沖糸に通用される場合
であれば、エンコーダ(10)は記録糸に設けられ、デ
コーダ(40)は再生糸に設けられるとともに、伝送系
(30)は、エラー訂正の処理回路9回転磁気ヘッドな
どを含むものである。
That is, in the same figure, (10) is the encoder, (3
0) is a signal transmission system, and (40) is a decoder. For example, if the PCM sound is used for 8mm video, the encoder (10) is installed in the recording string, and the decoder (40) is The transmission system (30) is provided on the recycled yarn and includes an error correction processing circuit, a nine-rotation magnetic head, and the like.

そして、エンコーダ(10)において、デジタルデータ
Xtが、1サンプルごとに並列に入力端子(11)から
遅延回路(12) 、  (13)を通じて減算回路(
14)に供給される。この場合、入力データXtは、ア
ナログのオーディオ信号がリニアにA/D変換されたP
CM信号であり、例えば、サンプリング周波数は48k
)lx 、 量子化ビット数は16ビツトである。また
、データXtは、第9図に示すように、−1≦xt<i
の固定小数点で表現されているとともに、2の補数で表
現されているものとする(他のデータについても同様)
Then, in the encoder (10), the digital data Xt is transmitted in parallel for each sample from the input terminal (11) through the delay circuits (12) and (13) to the subtraction circuit (
14). In this case, the input data Xt is a linear A/D converted analog audio signal.
It is a CM signal, for example, the sampling frequency is 48k.
)lx, the number of quantization bits is 16 bits. Moreover, as shown in FIG. 9, the data Xt is -1≦xt<i
It is assumed that the data is expressed as a fixed-point number and as a two's complement number (the same applies to other data).
.

さらに、遅延回路(12) 、  (13)は、主デー
タと、補助データとのタイミングを合わせるためのもの
であり、それぞれlブロック期間の遅延時間を有する(
このため、厳密には、端子(11)の入力値をXtとす
れば、遅延回路(13)の出力はX t−B aとなる
が、煩雑になるので、串にXtと記す)。
Furthermore, the delay circuits (12) and (13) are for synchronizing the timing of the main data and the auxiliary data, and each has a delay time of l block period (
Therefore, strictly speaking, if the input value of the terminal (11) is Xt, the output of the delay circuit (13) will be Xt-B a, but for the sake of complexity, it is written as Xt on the skewer).

また、予測フィルタ(19)からデータXtに対する予
測値Xtが取り出され、この値父りが減算回路(14)
に供給されて減算回路(14)からは、値Xtとヌtと
の差Dt Dt  干xt−xt が取り出される。この値Dtは、入力値Xtに対する予
測値×【の誤差(予測残差)である。したがって、値D
tは、理想的には、Dt =0であり、一般的にも小さ
な値なので、値Dtの語長が例えば16ビツトであると
しても、例えば第9図に示すように、Dt≧0のときに
は、そのMSH側のかなりのビットは、すべて“0”に
なり、Dt<0のときには、すべて“1”になるととも
に、残るLSB側の数ビットが、値Xtと×Lとの差に
対応して“0″またはl”となる。また、値Dtが大き
い値となったときには、下位ビットは無視できる。
Further, the predicted value Xt for the data Xt is taken out from the prediction filter (19), and the difference in this value is sent to the subtraction circuit (14).
The difference Dt between the value Xt and the value t is extracted from the subtraction circuit (14). This value Dt is the error (prediction residual) of the predicted value x [with respect to the input value Xt. Therefore, the value D
Ideally, t is Dt = 0, and it is generally a small value, so even if the word length of the value Dt is, for example, 16 bits, when Dt≧0, as shown in FIG. , all of the considerable bits on the MSH side become “0”, and when Dt<0, all become “1”, and the remaining few bits on the LSB side correspond to the difference between the value Xt and ×L. When the value Dt becomes a large value, the lower bits can be ignored.

そこで、この値Dtが、利得制御回路(15)に供給さ
れて0倍(G≧1)されることにより正規化された値D
t−Gとされ、この値G−IJtが再量子化回路(16
)に供給されて例えば4ビツトの値ff1t−Gに再量
子化される。
Therefore, this value Dt is supplied to the gain control circuit (15) and multiplied by 0 (G≧1), resulting in a normalized value D
t-G, and this value G-IJt is sent to the requantization circuit (16
) and requantized, for example, into a 4-bit value ff1t-G.

さらに、この値5t−Gが利得制御回路(17)に供給
されて 1/G倍され、したがって、値1)tと同じオ
ーダーで、正規化されていない値′6tとされ、この値
t5tが加算回路(1B)に供給されるとともに、フィ
ルタ(19)からの予測値5(tが加算回路(18)に
供給されて加算回路(18)からは、値etとヌtとの
和父【 父t−gt+et が取り出され、この値父tがフィルタ(19)に供給さ
れる。
Further, this value 5t-G is supplied to the gain control circuit (17) and multiplied by 1/G, thus giving a non-normalized value '6t of the same order as the value 1)t, and this value t5t is At the same time, the predicted value 5(t) from the filter (19) is supplied to the adder circuit (18), and from the adder circuit (18), the sum of the value et and the value t [ The value t-gt+et is taken out and this value t is fed to the filter (19).

この場合、値ヌtは、値Xtに対する予測値であり、値
btは、その予測時における誤差Dtのド位ビットを切
り捨てた、あるいはまるめた値であるから、これら値ヌ
tと15tとの和である値55tは、入力値Xtにほぼ
等しい、そして、この値父tが、フィルタ(19)に供
給されたのであるから、そのフィルタ出力である値父【
は、次のサンプル時点の入力値Xtφ1を予測した値と
することができる。
In this case, the value t is the predicted value for the value Xt, and the value bt is the value obtained by truncating or rounding the 0-order bits of the error Dt at the time of prediction, so the value t and 15t are different. The value 55t which is the sum is almost equal to the input value Xt, and since this value t was supplied to the filter (19), the value 55t which is the filter output
can be a value that predicts the input value Xtφ1 at the next sampling point.

そして、再量子化回路(16)からの値t5t−Gが、
伝送系(30)を通じてデコーダ(40)に供給される
Then, the value t5t-G from the requantization circuit (16) is
The signal is supplied to a decoder (40) through a transmission system (30).

このデコーダ(40)においては、値15t−Gが利得
制御回路(41)により 1/G倍されて値5tとされ
、この値atが加算回路(42)に供給され、その加算
出力が出力端子(44)に取り出されるとともに、フィ
ルタ(19)と同様に構成された予測フィルタ(43)
に供給され、そのフィルタ出力が加算回路(42)に供
給される。
In this decoder (40), the value 15t-G is multiplied by 1/G by the gain control circuit (41) to give the value 5t, and this value at is supplied to the addition circuit (42), whose addition output is output from the output terminal. A prediction filter (43) extracted from (44) and configured similarly to filter (19)
and its filter output is supplied to the adder circuit (42).

したがって、フィルタ(43)の出力が、値×tとなる
とともに、端子(44)には、入力データXtにほぼ等
しいデジタルデータ父tが取り出される。
Therefore, the output of the filter (43) becomes the value xt, and digital data t approximately equal to the input data Xt is taken out to the terminal (44).

さらに、フィルタ(19) 、  (43)における予
測係数を1ブロツクごとに最適値とするため、次のよう
な回路が設けられる。
Further, in order to set the prediction coefficients in the filters (19) and (43) to optimal values for each block, the following circuit is provided.

すなわち、予測フィルタ(19) 、  (43)は、
予測係数として例えば偏自己相関係数(PARCOR係
数)を使用する3次のフィルタとされるとともに、その
第1次〜第3次の係数a1〜a3は、任意の値に変更で
きるようにされる。
That is, the prediction filters (19) and (43) are
For example, it is a third-order filter that uses partial autocorrelation coefficients (PARCOR coefficients) as prediction coefficients, and its first to third order coefficients a1 to a3 can be changed to arbitrary values. .

また、端子(11)からの入力データXtが、時間窓回
路(21)に供給されて所定の重みづけが行われてから
自己相関回路(22)に供給されて相関係数が算出され
、この係数が予測係数回路(23)に供給されてデータ
Xtの1ブロツクごとに第3次までの予測係数として偏
自己相関係数に1〜に3が算出され、この係数に1〜に
3がフィルタ(19)に供給されるとともに、ラッチ(
51)を通じてフィルタ(43)に供給される。
Input data Xt from the terminal (11) is supplied to a time window circuit (21), subjected to predetermined weighting, and then supplied to an autocorrelation circuit (22) to calculate a correlation coefficient. The coefficients are supplied to a prediction coefficient circuit (23), and a partial autocorrelation coefficient of 1 to 3 is calculated as a prediction coefficient up to the third order for each block of data Xt, and a value of 1 to 3 is applied to this coefficient by a filter. (19) and the latch (
51) to the filter (43).

さらに、遅延回路(12)からのデータXtが予測誤差
フィルタ(24)に供給され、そのフィルタ出力がブロ
ック内最大値検出回路(25)に供給される。
Further, data Xt from the delay circuit (12) is supplied to a prediction error filter (24), and the filter output is supplied to an intra-block maximum value detection circuit (25).

この場合、フィルタ(24)は、予測フィルタ(19)
と同様に構成された3次の予測フィルタ(241)と、
減算回路(242)とを有するとともに、係数回路(2
3)からの予測係数に1〜に3がフィルタ(241)に
供給され、入力データXtに対する誤差Dtの予測値(
予測誤差)5tを、1サンプルごとに生成するものであ
る。また、検出回路(25)は、入力データXtの1ブ
ロツクごとに、そのブロック内における予測誤差σt 
(これは64個ある)のうち、絶対値が最大である予測
誤差の絶対値j5+axを検出するものである。
In this case, the filter (24) is the prediction filter (19)
a third-order prediction filter (241) configured in the same manner as
a subtraction circuit (242), and a coefficient circuit (242).
3) are supplied to the filter (241) as prediction coefficients from 1 to 3, and the predicted value (
5t (prediction error) is generated for each sample. Further, the detection circuit (25) detects the prediction error σt within the block for each block of input data Xt.
(There are 64 of these), the absolute value j5+ax of the prediction error with the largest absolute value is detected.

そして、この最大値t5vaaxが正規化利得算出回路
(26)に供給されて正規化時の利得GG ” b /
 t5max bは、Q<b<1の安全係数で、 例えば、b−0,9 に変換され、この正規化用の利得係数Gが利得制御回路
(15) 、  (17)に供給されるとともに、ラッ
チ(52)を通じて利得制御回路(41)に供給される
。この場合、値j5maxは、64個ある値ff1tの
最大値であるから、値Dt−Gは、−1≦Dt・G<1
に正規化される。
Then, this maximum value t5vaax is supplied to the normalized gain calculation circuit (26) and the normalized gain GG'' b /
t5max b is a safety factor of Q<b<1, and is converted to, for example, b-0,9, and this gain coefficient G for normalization is supplied to the gain control circuits (15) and (17), It is supplied to the gain control circuit (41) through the latch (52). In this case, the value j5max is the maximum value of the 64 values ff1t, so the value Dt-G is -1≦Dt・G<1
normalized to .

なお、ランチ(51) 、  (52)は、係数に1〜
に3、Gを、対応する値f5t−Gの1ブロツク期間に
わたって保持するためのものである。
Note that Lunch (51) and (52) have coefficients of 1 to
3, to hold G for one block period of the corresponding value f5t-G.

また、エンコーダ(10)から伝送系(3o)を通じて
デコーダ(40)に伝送されるデータ量について考える
と、主データである予測残差t5t−Gは、例えば4ビ
ツトで1サンプルごとに伝送され、補助データ(予測パ
ラメータ)である予測係数に1〜に3及び利得係数Gは
、例えば16ビツト、12ビツト、 12ビツト及び8
ビツトで1ブロツクごとに伝送されるので、1ブロツク
期間におけるデータ鷺は、 4ビット×64サンプル分+16ビツト+12ビット+
12ビット+8ビット−304ビツトとなる。そして、
データ圧縮を行わない場合における1ブロツク期間のデ
ータ量は、 16ビツト×64サンプル分−1024ビツトである。
Also, considering the amount of data transmitted from the encoder (10) to the decoder (40) via the transmission system (3o), the prediction residual t5t-G, which is the main data, is transmitted for each sample in 4 bits, for example. The prediction coefficients 1 to 3 and the gain coefficient G, which are auxiliary data (prediction parameters), are, for example, 16 bits, 12 bits, 12 bits, and 8 bits.
Bits are transmitted for each block, so the data in one block period is 4 bits x 64 samples + 16 bits + 12 bits +
It becomes 12 bits + 8 bits - 304 bits. and,
The amount of data for one block period when data compression is not performed is 16 bits x 64 samples - 1024 bits.

したがって、データ量は、 304ビツト/ 1024ビツト= 29.7%に圧縮
されて伝送されたことになる。
Therefore, the amount of data was compressed and transmitted to 304 bits/1024 bits = 29.7%.

こうして、このシステムによれば、デジタルオーディオ
データのデータ圧縮を行うことができるが、この場合、
特にこのシステムによれば、係数及び演算の倍長に制限
があっても、予測フィルタ(19) 、  (43)の
予測係数を入力データXtにしたがって最適値に制御し
ているので、デコードされたデータ父tの圧縮により生
じるエラーを最小にすることができる。
In this way, according to this system, data compression of digital audio data can be performed, but in this case,
In particular, according to this system, even if there is a limit on the double length of the coefficients and calculations, the prediction coefficients of the prediction filters (19) and (43) are controlled to optimal values according to the input data Xt, so that the decoded Errors caused by compression of the data father t can be minimized.

また、予測残差l)tを伝送する場合、この残差Dtを
再祉子化によりビット数を少なくするとともに、その河
量子化の前に正規化を行っているので、伝送されるデー
タ6t−Gは、ビット数が少なく、しかも、誤差の少な
いデータとなる。
In addition, when transmitting the prediction residual l)t, this residual Dt is reduced in number of bits by recombination, and normalization is performed before quantization, so that the transmitted data 6t -G is data with a small number of bits and little error.

第5図及び第6図は、上述のエンコーダ(10)及びデ
コーダ(40)を、8ミリビデオのオーディオ信号の記
録系及び再生糸に通用した場合の一例を示す。
FIGS. 5 and 6 show an example in which the encoder (10) and decoder (40) described above are used in an 8 mm video audio signal recording system and playback system.

すなわち、記録糸においては、例えばN 1’ S C
方式のカラービデオ信号が、端子(61)を通じて記録
ビデオ回路(62)に供給されて輝度信号がFM信号に
変換されるとともに、搬送色信号が、そのドM輝度信号
よりも低域側、すなわち、til!送周波数fcが、f
 c = 47.25fh  (’−743kHz、f
 hは水平周波数)の信号に周波数変換され、これらF
 M輝度信号と、低域変換された搬送色信号と、再生時
のトラッキングサーボ用のパイロット信号との加算信号
Svが取り出され、この信号Svが記録アンプ(63)
を通じてスイッチ回路(64)に供給される。
That is, in the recording thread, for example, N 1' S C
The color video signal of the system is supplied to the recording video circuit (62) through the terminal (61), and the luminance signal is converted into an FM signal, and the carrier color signal is on the lower frequency side than the FM luminance signal, that is, ,til! The transmission frequency fc is f
c = 47.25fh ('-743kHz, f
h is the horizontal frequency), and these F
A sum signal Sv of the M luminance signal, the carrier color signal subjected to low frequency conversion, and the pilot signal for tracking servo during playback is extracted, and this signal Sv is sent to the recording amplifier (63).
It is supplied to the switch circuit (64) through.

また、ステレオの左及び右チャンネルのオーディオ信号
り、Rが、端子(71L) 、  (71R)を通じて
A/Dコンバータ(72L ) 、  (72)1 )
に供給されて信号り、 Hのそれぞれについて例えばサ
ンプリング周波数48kHz、量子化ビット数16ビツ
トのデジタルデータLt、RtにA/D変換され、これ
らデータLL、RLが上述したエンコーダ(10)と同
様に構成されたエンコーダ(IOL)。
In addition, the stereo left and right channel audio signals R and R are connected to the A/D converter (72L), (72)1) through the terminals (71L) and (71R).
Each of the signals H is A/D converted into digital data Lt and Rt with a sampling frequency of 48 kHz and a quantization bit number of 16 bits, and these data LL and RL are processed in the same way as the encoder (10) described above. Configured encoder (IOL).

(IOR)に供給されて各チャンネルごとに、データf
it−G、kt〜ki、Gに対応するデータXLt。
(IOR) for each channel, the data f
it-G, kt~ki, data XLt corresponding to G;

L k i〜Lka、LC;及びXRt 、Rkt〜R
k3゜RGが取り出される。
L k i~Lka, LC; and XRt, Rkt~R
k3°RG is taken out.

そして、これらデータが記録エンコーダ(73)ニ供給
されて1フイ一ルド期間分ごとに、エラー訂正データの
付加、インターリーブ及び各フィールド期間の終わりの
ほぼ115フイ一ルド期間への時間軸圧縮などの記録エ
ンコード処理の行われたデジタル信号Saとされ、この
信号Saが、変調回路(74)に供給されて例えばパイ
フェイズマーク信号sbとされ、この信号sbが記録ア
ンプ(75)を通じてスイッチ回路(64)に供給され
る。
These data are then supplied to the recording encoder (73), which performs processes such as adding error correction data, interleaving, and time axis compression to approximately 115 field periods at the end of each field period. The recording encoded digital signal Sa is supplied to a modulation circuit (74) and is converted into, for example, a pie-phase mark signal sb.This signal sb is passed through a recording amplifier (75) to a switch circuit (64). ).

そして、スイッチ回路(64)が所定のタイミングで制
御されてfK ’+ SVが1フイ一ルド期間ごとに交
互に回転磁気ヘッド(IA) 、  (IB)に供給さ
れるとともに、信号sbが信qSvとは逆の関係でヘッ
ド(IA) 、  (1B)に供給される。
Then, the switch circuit (64) is controlled at a predetermined timing so that fK'+SV is alternately supplied to the rotating magnetic heads (IA) and (IB) every one field period, and the signal sb is supplied to the signal qSv. The signals are supplied to the heads (IA) and (1B) in a reverse relationship.

また、ヘッド(16) 、  (IB)は、互いに18
0゛の角間隔を有し、端子(61)のカラービデオ信号
に同期してフレーム周波数で回転させられるとともに、
その回転周面の216゛強の角範囲にわたって磁気テー
プ(2)が斜めに一定の速度で走行させられる。なお、
ヘッド(LA) 、  (IB)は、互いに異なるスリ
ット角、いわゆるアジマス角を有する。
Moreover, the heads (16) and (IB) are 18
has an angular spacing of 0゛, is rotated at a frame frequency in synchronization with the color video signal at the terminal (61), and
The magnetic tape (2) is run diagonally at a constant speed over an angular range of more than 216 degrees around its rotating circumferential surface. In addition,
The heads (LA) and (IB) have different slit angles, so-called azimuth angles.

したがって、テープ(2)には、第7図に示すように、
トランク(2’r)が隣接して順次形成されるとともに
、そのトランク(2T)の始めから36°の区間には1
フイ一ルド期間分の信号sbが記録され、残る 180
゛の区間には1フイ一ルド期間分の信号Svが記録され
ることになる。
Therefore, as shown in FIG.
Trunks (2'r) are successively formed adjacent to each other, and 1
The signal sb for the field period is recorded and remains 180
The signal Sv for one field period is recorded in the section .

なお、上述における記録系及び記録フォーマットなどは
、信号sbにおける信号Saの内容を除けば、現行の8
ミリビデオと同様である。
Note that the recording system and recording format described above are the same as the current 8
It is similar to millivideo.

一方、再生系においては、ヘッド(1^)により1つお
きのトラック(2丁)から信号Sv、Sbが順次再生さ
れ、ヘッド(IB)により残る1つおきのトラック(2
T)から信号S v + S bが順次再生され、これ
ら再往信号が再往アンプ(81A ) 。
On the other hand, in the reproduction system, the head (1^) sequentially reproduces the signals Sv and Sb from every other track (2), and the head (IB) sequentially reproduces the signals Sv and Sb from every other track (2) remaining.
Signals S v + S b are sequentially reproduced from T), and these reciprocating signals are sent to a reciprocating amplifier (81A).

(81B )を通じてスイッチ回路(82)に供給され
、スイッチ回路(82)からはヘッド(1^)、(IB
)の再生した信号Sv、Svが連続して取り出されると
ともに、ヘッド(1^)、(IB)の再生した信号sb
、sbが各フィールド期間の終わりのほぼ115フイ一
ルド期間ごとに取り出される。
(81B) to the switch circuit (82), and from the switch circuit (82) head (1^), (IB
) are successively taken out, and the signals sb reproduced by the head (1^) and (IB) are
, sb are taken approximately every 115 field periods at the end of each field period.

そして、スイッチ回路(82)からの信号Svが再生ビ
デオ回路(83)に供給されて記録時とは逆の処理が行
われてもとのカラービデオ信号が端子(84)に取り出
される。
Then, the signal Sv from the switch circuit (82) is supplied to the reproduction video circuit (83), where the reverse processing to that during recording is performed and the original color video signal is taken out to the terminal (84).

また、スイッチ回路(82)からの信号sbが、?M調
回路(91)に供給されて信号Saが復調され、この信
号Saが再生デコーダ(92)に供給されて時間軸伸張
、デインターリーブ及びエラー訂正などが行われること
により、各チャンネルごとにもとのデータXLt 〜L
G、XRt−RGがデコードされ、これらデータが、上
述のデコーダ(4o)と同様に構成されたデコーダ(4
0L) 、  (40R)に供給されてデータLt、R
tがデコードされ、これらデータがD/Aコンバータ(
93L) 、  (93R)に供給されて端子’ (9
4L ) 、  (94R) にもとのオーディオ信号
り、Rが取り出される。
Also, the signal sb from the switch circuit (82) is ? The signal Sa is demodulated by being supplied to the M modulation circuit (91), and this signal Sa is supplied to the reproduction decoder (92) to perform time axis expansion, deinterleaving, error correction, etc. Data with XLt ~L
G, XRt-RG are decoded, and these data are sent to a decoder (4
0L), (40R) and the data Lt, R
t is decoded and these data are sent to the D/A converter (
93L), (93R) and terminal' (9
4L) and (94R), the original audio signal R is extracted.

以上のようにしてオーディオ信号り、、Rが記録再生さ
れるが、この場合、1フイ一ルド期間におけるデータ量
を計算すると、予測残差XLt、XRtのデータ量は、
1チヤンネルあたり、 48000サンプル/フイ一ルド周波数−48000/
 59.94・・・・ =  800.8サンプル となるが、端数を切り捨るゎけにはいかないので、80
1サンプル=801X4ビツト となる。したがっ°て、信号り、Rの2チヤンネルでは
、 801X 4ビット×2チャンネル−801ワード(l
ワード−8ビツト) となる。
As described above, the audio signals R, , R are recorded and reproduced. In this case, when calculating the amount of data in one field period, the amount of data of the prediction residuals XLt and XRt is as follows.
48000 samples/field frequency -48000/ per channel
59.94... = 800.8 samples, but since it is not possible to round down the fraction, it is 80.
1 sample = 801×4 bits. Therefore, for 2 channels of signal R, 801x 4 bits x 2 channels - 801 words (l
word - 8 bits).

また、予測係数L k L〜Lkコ、Rkl〜Rk3及
び利得係数LG、RGのデータ量は、64サンプル(1
ブロツク)ごとに1組が得られるので、1チヤンネルあ
たりでは、 801サンプル/64サンプル#12.51組となるが
、やはり端数を切り捨てるわけにはいかないので、13
組となり、信号り、Hの2チヤンネルでは、26組とな
る。そして、これをワード数に換算すると、 (16+12+12+ 8ビツト)×26組=6ワード
×26組 −156ワード となる。
In addition, the amount of data for the prediction coefficients LkL to Lk, Rkl to Rk3 and gain coefficients LG and RG is 64 samples (1
Since one set is obtained for each block), there are 801 samples/64 samples #12.51 sets per channel, but since we cannot round down the fraction, we have 13
For two channels, signal R and H, there are 26 sets. When this is converted into the number of words, it becomes (16+12+12+8 bits) x 26 sets = 6 words x 26 sets - 156 words.

したがって、1フイ一ルド期間における全データ量は、 801ワード+ 156ワード=957ワードとなる。Therefore, the total amount of data in one field period is 801 words + 156 words = 957 words.

これに対して、現行の8ミリビデオにおけるデジタルオ
ーディオデータのデータ量を計算すると、サンプリング
周波数が2rh″”=  31.468kHz 、 星
子化ビット数が8ビツトなので、■フィールド期間にお
けるデータ量は、信号り、 Rの2チヤンネルで、 2 r h7フイールド周波数×2チャンネル=525
サンプル×2チャンネル −1050ワード となる。
On the other hand, when calculating the amount of digital audio data in the current 8mm video, the sampling frequency is 2rh'' = 31.468kHz and the number of star bits is 8 bits, so the amount of data in the field period is With 2 channels of R, 2 r h7 field frequency x 2 channels = 525
Sample x 2 channels - 1050 words.

したがって、上述のADPCMによるデータ甘は、現行
の8ミリビデオにおけるPCMオーディオデータ量より
も少ないので、エンコーダ(73)においては、上述の
ADPCMによる各データを、そのまま現行の8ミリビ
デオにおけるデジタルオーディオデータとみなして記録
のエンコード処理を行うことができる。また、これによ
り、エンコーダ(73)−テープ(2)→デコーダ(9
2)の信号系は、現行の8ミリビデオと変わることがな
く、すなわち、現行のテープフォーマットのままで、オ
ーディオ信号をより優れた音質で記録再生できる。
Therefore, since the amount of data due to the above-mentioned ADPCM is smaller than the amount of PCM audio data in the current 8 mm video, the encoder (73) converts each data due to the above-mentioned ADPCM into the digital audio data in the current 8 mm video. The recording can be encoded by assuming that Also, this allows the encoder (73) - tape (2) -> decoder (9)
The signal system 2) is unchanged from the current 8 mm video, that is, it is possible to record and reproduce audio signals with better sound quality while using the current tape format.

文献:「音声情報処理の基礎」オーム社発行特願昭61
−299285号の明細書及び図面D 発明が解決しよ
うとする課題 ところで、上述の8ミリビデオにおいて、復tJMされ
た信号Saにエラーを生じていても、デコーダ(92)
において、データXLt−LG、XRt〜RGのエラー
を完全に訂正できれば、何も問題は生じない。
Literature: "Fundamentals of Speech Information Processing", patent application published by Ohmsha, 1986
-299285 Specification and Drawing D Problems to be Solved by the Invention By the way, in the above-mentioned 8 mm video, even if an error occurs in the decoded signal Sa, the decoder (92)
In this case, if errors in data XLt-LG and XRt-RG can be completely corrected, no problem will occur.

しかし、実際には、エンコーダ(73)において記録用
のエンコード処理を行う場合、エラー訂正用としてPパ
リティ、Qパリティ及びCRCコードが、1フイ一ルド
期間につき1組の割り合いで付加されるだけであり、こ
れでは完全なエラー訂正をできないことがある。
However, in reality, when performing encoding processing for recording in the encoder (73), only one set of P parity, Q parity, and CRC code is added for each field period for error correction. Therefore, complete error correction may not be possible with this method.

そして、データXLt−LG、XRt−RGO)中でも
、係数L k L −L k 31 L G + Rk
 t〜Rk3゜RGにエラーを生じていると、これは1
ブロック期間のデータLt、Rtに係わるので、聴感上
の影響が大きい。
And among the data XLt-LG, XRt-RGO), the coefficient L k L - L k 31 L G + Rk
If an error occurs in t~Rk3°RG, this is 1
Since this relates to the data Lt and Rt of the block period, it has a large effect on the auditory sense.

したがって、係数Lk1〜LG、Rkt〜RGに対して
は、さらに強力なエラー訂正能力を付加しておくことが
必要となる。
Therefore, it is necessary to add even stronger error correction capability to the coefficients Lk1 to LG and Rkt to RG.

しかし、上述の数値例によれば、1フイ一ルド期間にお
ける、現行の8ミリビデオのデータ容量は、1050ワ
ードであるのに対し、上述のADPCMは957ワード
を使用するので、lフィールド期間につき、 1050ワード−957ワード=93ワードしか余りが
なく、この93ワ一ド以内で係数Lkt〜LG、Rki
〜RGに対するエラー訂正能力を向上させなければなら
ない。
However, according to the above numerical example, the data capacity of current 8 mm video in one field period is 1050 words, whereas the above ADPCM uses 957 words, so per field period , 1050 words - 957 words = only 93 words are left, and within these 93 words, the coefficients Lkt ~ LG, Rki
~The error correction ability for RG must be improved.

この発明は、そのような要求に答ようとするものである
This invention attempts to answer such a need.

E 課題を解決するための手段 このため、この発明においては、重要度の高い予測パラ
メータLkz〜LG、Rkt〜RGについては、これら
を上述のように記録するとともに、2つのブロックごと
に、それら2つのブロック間で対応する予測パラメータ
の差を求め、この差を余った93ワードのエリアに記録
するようにしたものである。
E Means for Solving the Problem Therefore, in the present invention, the highly important prediction parameters Lkz~LG and Rkt~RG are recorded as described above, and the two blocks are recorded for each two blocks. The difference in the corresponding prediction parameters between the two blocks is determined, and this difference is recorded in the remaining 93 word area.

F 作用 重要度の高い予測パラメータに対するエラー訂正が確実
に行われる。
F: Error correction for prediction parameters with high operational importance is reliably performed.

G 実施例 G1第1の実施例 上述の数値例の場合には、1フイ一ルド期間に、子連l
パラメータL k 1〜Lk3.RGが13ブロック分 予測パラメータRk1〜Rki 、RGが13ブロック
分 得られるので、以下の説明においては、これらの予測パ
ラメータを、データP L n + P Rn  (n
はブロック番号で、nc=l〜13)で総称する。つま
り、例えば、データPLzは、あるフィールド期間の左
チャンネルの第1番目のブロックにおけるパラメータL
ks〜Lk3.LGのいずれをも代表して示すものとす
る。
G Example G1 First Example In the case of the above numerical example, in one field period, the child series l
Parameters L k 1 to Lk3. Since the prediction parameters Rk1 to Rki for 13 blocks of RG and the prediction parameters Rk1 to Rki for 13 blocks of RG are obtained, in the following explanation, these prediction parameters are expressed as data P L n + P Rn (n
is a block number, collectively referred to as nc=1 to 13). That is, for example, the data PLz is the parameter L in the first block of the left channel in a certain field period.
ks~Lk3. LG is shown as a representative.

第1図は記録系の一例を示し、左チャンネルのエンコー
ダ(IOL)から予測残差XLtが、インターフェイス
回路(101)に供給されるとともに、エンコーダ(1
0L)からは第3図Bに示すように、その1ブロック期
間ごとに、データPLnが取り出され、このデータPL
nがインターフェイス回路(101)に供給される。
FIG. 1 shows an example of a recording system, in which the prediction residual XLt is supplied from the left channel encoder (IOL) to the interface circuit (101), and the encoder (101) is supplied to the left channel encoder (IOL).
As shown in FIG. 3B, data PLn is extracted from 0L) for each block period, and this data PLn
n is supplied to the interface circuit (101).

さらに、エンコーダ(IOL)からのデータPLnが減
算回路(102)に供給されるとともに、遅延回路(1
03)に供給されて同図Cにボすように1ブロック期間
遅延したデータPLn−xとされ、このデータPLn−
zが減算回路(102)に供給されて同図りに示すよう
に、差のデータ5LnSLn −PLn −PLn−t
   ” (i)ただし、SLnについては、n−1〜
itの奇数及びn−12のみ有効 が取り出され、このデータSLnがインターフェイス回
路(101)に供給される。
Furthermore, the data PLn from the encoder (IOL) is supplied to the subtraction circuit (102), and the delay circuit (102) is supplied to the subtraction circuit (102).
03) and is delayed by one block period as shown in C in the figure, and this data PLn-
z is supplied to the subtraction circuit (102), and as shown in the figure, the difference data 5LnSLn -PLn -PLn-t
” (i) However, for SLn, n-1~
Only odd numbers and n-12 of it are taken out as valid, and this data SLn is supplied to the interface circuit (101).

この場合、例えば、データPLnが第2番目のブロック
の係数Lk1で、データPLn−1が第1番目のブロッ
クの係数L k sであるとすれば、データSLnは、
この両係数の差分である。つまり、データSLnは、連
続する2つのブロックにおける対応する2つの予測パラ
メータの差分である。
In this case, for example, if data PLn is the coefficient Lk1 of the second block and data PLn-1 is the coefficient Lk s of the first block, the data SLn is
This is the difference between these two coefficients. That is, data SLn is the difference between two corresponding prediction parameters in two consecutive blocks.

また、右チャンネルのデータXRt、Rnについても同
様の処理が行われてデータXRt 、Rn 。
Further, similar processing is performed on the right channel data XRt, Rn, resulting in data XRt, Rn.

SRn  (=PRn −PRn−t )がインターフ
ェイス回路(101)に供給される。
SRn (=PRn-PRn-t) is supplied to the interface circuit (101).

そして、インターフェイス回路(101)においては、
残差XLt 、XRtが1サンプルにつきそれぞれ4ビ
ア)なので、サンプリング時点が対応する左チャンネル
の残差XLt及び右チャンネルの残、t−XRtが、そ
れぞれ上位4ビツト及び下位4ビツトを占める1ワード
のデータMiに合成される。
In the interface circuit (101),
Since the residuals XLt and XRt are each 4 vias per sample, the left channel residual XLt and the right channel residual t-XRt corresponding to the sampling time are one word that occupies the upper 4 bits and the lower 4 bits, respectively. It is combined into data Mi.

この場合、上述のように、1フイ一ルド期間には、残!
!XLt 、XRtが801サンプル×2チャンネル分
得られ、したがって、データMiはlフィールド期間に
801ワード(i−0〜800)得られることになる。
In this case, as mentioned above, in one field period, the remaining!
! XLt and XRt are obtained for 801 samples×2 channels, and therefore, 801 words (i-0 to 800) of data Mi are obtained during the I field period.

さらに、インターフェイス回路(101)においては、
データPLn 、PRn  (パラメータLk1〜LG
、Rkx〜RG)が8ビツト長×156ワードのデータ
Pj  (j=0〜155)に再構成されるとともに、
データSLn 、SRnが、(1B+ 12+ 12+
 8ビツト)×7組×2チャンネル=6ワード×14組 のデータSs(mmQ〜83)に再構成される。
Furthermore, in the interface circuit (101),
Data PLn, PRn (parameters Lk1 to LG
, Rkx~RG) is reconfigured into data Pj (j=0~155) of 8 bit length x 156 words, and
Data SLn and SRn are (1B+ 12+ 12+
8 bits) x 7 sets x 2 channels = 6 words x 14 sets of data Ss (mmQ~83).

そして、これらデータMi 、Pj + Ssが、エン
コーダ(73)に、現行の8ミリビデオにおけるPCM
オーディオデータに代わって供給され、記録エンコード
処理、すなわち、1フイ一ルド期間分ごとに、エラー訂
正データの付加、インターリーブ及び時間軸圧縮などが
行われて信号Saとして取り出される。そして、この信
号Saが信号sbに変換されてからヘッド(1^)、(
IB)によりテープ(2)に記録される。
These data Mi, Pj + Ss are sent to the encoder (73) as PCM in current 8mm video.
The signal Sa is supplied in place of the audio data, and subjected to recording encoding processing, that is, addition of error correction data, interleaving, time axis compression, etc., every one field period, and is extracted as a signal Sa. After this signal Sa is converted to signal sb, the head (1^), (
IB) is recorded on tape (2).

この場合、1フイ一ルド期間につき、 データMi:801ワード データPj:156ワード データSm:84ワード であるから、全部で1041ワードとなり、これは現行
の8ミリビデオのデータ1l1050ワードに収まるこ
とになり、したがって、現行のフォーマントで記録でき
る。
In this case, data Mi: 801 words, data Pj: 156 words, data Sm: 84 words per field period, resulting in a total of 1041 words, which fits within the current 8 mm video data 1l 1050 words. and therefore can be recorded in the current formant.

第2図は再生糸の一例を示し、デコーダ(92)から左
チャンネルのデータMi 、 Pj 、 Ss+がデコ
ードされて取り出され、これらデータがインターフェイ
ス回路<201)に供給されて第4図A。
FIG. 2 shows an example of recycled yarn, in which the left channel data Mi, Pj, Ss+ are decoded and taken out from the decoder (92), and these data are supplied to the interface circuit <201) to be processed as shown in FIG. 4A.

C,Fに示すようにもとのデータX L t + P 
L n +SLnにデコードされ、データXLtは、他
のデータPLn 、SLnとのタイミング調整のため遅
延回路(202)により第4図Bに示すように1ブロッ
ク期間遅延されてからデコーダ(40L)に供給される
As shown in C and F, the original data X L t + P
The data XLt is decoded into L n +SLn, and is delayed by one block period as shown in FIG. 4B by the delay circuit (202) for timing adjustment with other data PLn and SLn, and then supplied to the decoder (40L). be done.

また、インターフェイス回路(201)からのデータP
Lnが遅延回路(203) 、  (204)に順次供
給されて同図り、Eに示すように、順次1ブロック期間
遅延したデータPLn−t 、PLn−2が取り出され
、データPLn−1がスイソナ回路(205)を通じて
デコーダ(40L)に供給されるとともに、データPL
n”−PLn−zが演算回路(206)に供給される。
Also, data P from the interface circuit (201)
Ln is sequentially supplied to the delay circuits (203) and (204), and as shown in E in the figure, data PLn-t and PLn-2 delayed by one block period are sequentially taken out, and data PLn-1 is sent to the swissona circuit. (205) to the decoder (40L), and the data PL
n''-PLn-z is supplied to the arithmetic circuit (206).

さらに、インターフェイス回路(201)からのデータ
SLnが演算回路(206)に供給されるとともに、遅
延回路(207)に供給されて同図Gに示すように1ブ
ロック期間遅延したデータ5Ln−xとされ、このデー
タ5Ln−1が演算回路(206)に供給される。
Furthermore, the data SLn from the interface circuit (201) is supplied to the arithmetic circuit (206), and is also supplied to the delay circuit (207), where it is delayed by one block period as data 5Ln-x, as shown in FIG. , this data 5Ln-1 is supplied to the arithmetic circuit (206).

そして、演算回路(206)においては、(i)式に基
づいてデータPLnが求められる。すなわち、(i)式
から PLn−1=PLn −5Ln  −(ii)または、
(i)式から PLn =PLn−t +SLn 、’、PLn−1−PLn−z+5Ln−t   ”(
iii)となる。
Then, in the arithmetic circuit (206), data PLn is obtained based on equation (i). That is, from equation (i), PLn-1=PLn-5Ln-(ii) or,
From formula (i), PLn = PLn-t + SLn,', PLn-1-PLn-z+5Ln-t'' (
iii).

そこで、データPLn−1(同図D)におけるブロック
番号(n−1)が偶数のときには、同図C1F、!−1
に破線で示すように、(ii)式に基づいてデータPL
n 、SLnからデータPLn−1が算出され、ブロッ
ク番号(n−1)が奇数及び(n −1)=12のとき
には、同図E、G、Hに示すように、(iii )式に
基づいてデータP Ln−2+  S Ln−tからデ
ータPLn−sが算出され、これら算出されたデータP
Ln−1がスイッチ回路(205)に供給される。
Therefore, when the block number (n-1) in data PLn-1 (D in the same figure) is an even number, C1F in the same figure, ! -1
As shown by the broken line in , data PL is calculated based on equation (ii).
Data PLn-1 is calculated from n and SLn, and when the block number (n-1) is an odd number and (n-1) = 12, data PLn-1 is calculated based on formula (iii) as shown in E, G, and H of the same figure. The data PLn-s is calculated from the data PLn-2+S Ln-t, and these calculated data P
Ln-1 is supplied to the switch circuit (205).

さらに、デコーダ(92)には、エラー検出回路(21
1)が接続され、データPjにエラーを生じているとき
、これを示す検出信号Seが取り出され、この信号Se
がタイミング調整用の遅延回路(212)により1ブロ
ック期間遅延されてからスイッチ回路(205)に制御
信号として供給されてエラー時にはスイッチ回路(20
5)は図とは逆の状態に切り換えられる。
Furthermore, the decoder (92) includes an error detection circuit (21).
1) is connected and an error has occurred in the data Pj, a detection signal Se indicating this is extracted, and this signal Se
is delayed for one block period by the delay circuit (212) for timing adjustment, and then supplied to the switch circuit (205) as a control signal, and in the event of an error, the switch circuit (205)
5) is switched to a state opposite to that shown in the figure.

このような構成によれば、再生時、データXLtがエン
コーダ(40L )に供給されるとともに、データPj
にエラーを生じていない場合には、すなわち、1ブロッ
ク期間後に遅延回路(203’)から得られるデータP
Ln−1にエラーを生じていない場合には、スイッチ回
路(205)は図の状態にあり、遅延回路(203)か
らのデータPLn−1(同図D)がデコーダ(40L)
に供給されてデータLtがデコードされる。
According to such a configuration, during reproduction, data XLt is supplied to the encoder (40L), and data Pj
In other words, if no error occurs in the data P obtained from the delay circuit (203') after one block period,
When no error occurs in Ln-1, the switch circuit (205) is in the state shown in the figure, and data PLn-1 (D in the figure) from the delay circuit (203) is sent to the decoder (40L).
The data Lt is decoded.

しかし、データPjにデコーダ(92)では訂正できな
かったエラーを生じている場合には、すなわち、lブロ
ック期間後に遅延回路(203)から得られるデータP
Ln−1にエラーを生じている場合には、そのデータP
jが遅延回路(203)からデータPLn−zとして取
り出されている期間、信号Seによりスイッチ回路(2
05)は図とは逆に切り換えられているので、演算回路
(206)からのデータPLn−1がデコーダ(40L
 )に供給されてデータLtがデコードされる。
However, if the data Pj has an error that cannot be corrected by the decoder (92), then the data Pj obtained from the delay circuit (203) after l block period
If an error occurs in Ln-1, the data P
j is taken out from the delay circuit (203) as data PLn-z, the signal Se causes the switch circuit (2
05) is switched in the opposite direction as shown in the figure, data PLn-1 from the arithmetic circuit (206) is switched to the decoder (40L).
) and the data Lt is decoded.

また、右チャンネルについても同様の処理が丘われる。Similar processing is also performed for the right channel.

こうして、この発明によれば、データPjのエラーによ
りデータPLn−1にエラーを生じているときには、(
ii )式あるいは(iii )式に基づいて隣りのブ
ロックのデータを使用してデータPLn−sが取り出さ
れるので、データPLn−*に対するエラー訂正能力が
向上し、信号りを適切に再生でき、同様にして信号Rも
適切に再生できる。
Thus, according to the present invention, when an error occurs in data PLn-1 due to an error in data Pj, (
Since the data PLn-s is extracted using the data of the adjacent block based on the formula (ii) or (iii), the error correction ability for the data PLn-* is improved, the signal can be properly reproduced, and the same The signal R can also be properly reproduced.

しかも、この場合、2つのブロックごとに、その2つの
ブロック間における対応する予測パラメータL k 1
〜L G 、 Rk 1〜RGの差データSLn。
Moreover, in this case, for each two blocks, the corresponding prediction parameter L k 1 between the two blocks
~LG, Rk 1~RG difference data SLn.

SRnを得、この差データを本来のデータXLt。SRn is obtained, and this difference data is used as the original data XLt.

L k 1〜LG、XRt 、Rkt〜RGとともに記
録しているので、上述のように、余った93ワードの中
にその差データSLn 、SRnを収めることができ、
記録フォーマットなどを変更する必要がない。
Since they are recorded together with L k 1 to LG, XRt, and Rkt to RG, the difference data SLn and SRn can be stored in the remaining 93 words as described above.
There is no need to change the recording format, etc.

G2他の実施例 なお、上述においては、左及び右の各チャンネル内にお
いて2つのブロックから差データSLn。
G2 Other Embodiments In the above description, difference data SLn is obtained from two blocks in each of the left and right channels.

SRnを得たが、左チャンネルのブロックのデータPL
nと、右チャンネルのブロックのデータPRnとの差デ
ータを得、これを上述と同様に記録及び再生して使用す
ることもできる。
SRn is obtained, but the left channel block data PL
It is also possible to obtain difference data between PRn and data PRn of the right channel block, and record and reproduce this data in the same manner as described above.

H発明の効果 この発明によれば、データPjのエラーによりデータP
Ln−rにエラーを生じているときには、(ii)式あ
るいは(iii )式に基づいて隣りのブロックのデー
タを使用してデータPLn−1が取り出されるので、デ
ータPLn−sに対するエラー訂正能力が向上し、信号
りを適切に再生でき、同様にして信号Rも適切に再生で
きる。
H Effects of the Invention According to this invention, data Pj is changed due to an error in data Pj.
When an error occurs in Ln-r, data PLn-1 is extracted using the data of the adjacent block based on equation (ii) or (iii), so the error correction ability for data PLn-s is signal R can be appropriately reproduced, and in the same way, signal R can also be appropriately reproduced.

しかも、この場合、2つのブロックごとに、その2つの
ブロック間における対応する予測パラメータL k 1
〜L G 、 Rk s 〜RGの差データSLn 。
Moreover, in this case, for each two blocks, the corresponding prediction parameter L k 1 between the two blocks
~LG, Rks~RG difference data SLn.

SRnを得、この差データを本来のデータXLt 。Obtain SRn and use this difference data as original data XLt.

Lk1〜LG、XRt 、Rks 〜RGとともに記録
しているので、上述のように、余った93ワードの中に
その差データSLn 、SRnを収めることができ、記
録フォーマットなどを変更する必要がない。
Since they are recorded together with Lk1 to LG, XRt, and Rks to RG, the difference data SLn and SRn can be stored in the remaining 93 words as described above, and there is no need to change the recording format.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一例の系統図、第2図〜第9図はそ
の説明のための図である。 (10)はエンコーダ、(30)は信号伝送系、(40
)はデコーダである。
FIG. 1 is a system diagram of an example of the present invention, and FIGS. 2 to 9 are diagrams for explaining the same. (10) is an encoder, (30) is a signal transmission system, (40
) is a decoder.

Claims (1)

【特許請求の範囲】 A/D変換されたサンプルを、その所定数ごとに1つの
ブロックとし、 このブロックごとに、そのブロックに含まれる上記サン
プルから予測パラメータを求め、この予測パラメータに
基づいて、この予測パラメータを求めた上記ブロックの
上記サンプルごとに予測残差を求め、 この予測残差及び上記予測パラメータを、送出するとと
もに、 上記ブロックの2つごとに、その2つのブロック間にお
ける、対応する予測パラメータの差データを求め、 この差データを上記予測残差及び上記予測パラメータと
ともに送出するようにしたデジタルオーディオデータの
エンコード方法。
[Claims] A predetermined number of A/D converted samples are set as one block, a prediction parameter is obtained from the samples included in the block for each block, and based on this prediction parameter, A prediction residual is obtained for each sample of the block for which this prediction parameter was obtained, and this prediction residual and the above prediction parameter are sent out, and for each two of the blocks, the corresponding A method for encoding digital audio data, comprising: obtaining difference data between prediction parameters; and transmitting this difference data together with the prediction residual and the prediction parameter.
JP1824488A 1988-01-28 1988-01-28 Encode method for digital audio data Pending JPH01194531A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100330336B1 (en) * 1996-10-09 2002-04-01 도날드 디. 먼둘 Error correction with two block codes

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KR100330336B1 (en) * 1996-10-09 2002-04-01 도날드 디. 먼둘 Error correction with two block codes

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