JPH01177623A - Microcomputer system - Google Patents
Microcomputer systemInfo
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- JPH01177623A JPH01177623A JP63001868A JP186888A JPH01177623A JP H01177623 A JPH01177623 A JP H01177623A JP 63001868 A JP63001868 A JP 63001868A JP 186888 A JP186888 A JP 186888A JP H01177623 A JPH01177623 A JP H01177623A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はマイクロ・コンピュータと特にFPC(Fro
nt Panel Controller)とを有する
システムに関する。[Detailed Description of the Invention] [Field of Industrial Application] The present invention is applicable to microcomputers and especially FPCs (Front PCs).
nt Panel Controller).
従来、この種のシステムの発振回路は第3図に示すよう
に、マイクロ・コンピュータ100を動作させる発振回
路102と、FPC104を動作させる発振回路107
を有し、それぞれに発振子を用いることにより独立した
システム・クロックにより動作させていた。Conventionally, the oscillation circuit of this type of system includes an oscillation circuit 102 for operating a microcomputer 100 and an oscillation circuit 107 for operating an FPC 104, as shown in FIG.
Each had an oscillator and was operated by an independent system clock.
上述した従来の発振回路は、マイクロ・コンピュータお
よびFPCにそれぞれ、発振回路を発振子が必要となる
ため、価格が高くなるという欠点がある。The above-described conventional oscillation circuit has the disadvantage that it is expensive because the microcomputer and FPC each require an oscillator for the oscillation circuit.
本発明によるシステムマイクロ・コンピュータのシステ
ム・クロックをそのままもしくは分周して周辺ディジタ
ル回路を動作させることを特徴としている。The system clock of the system microcomputer according to the present invention is characterized by operating peripheral digital circuits either as is or by dividing the frequency.
以下、本発明について図面を用いて説明する。 Hereinafter, the present invention will be explained using the drawings.
第1図は本発明の第1の実施例のブロック・ダイアグラ
ムである。100はマイクロ・コンピュータ、102は
1のマイクロ・コンピュータのシステム・クロックを生
成する発振回路および発振子、103は2で生成された
クロックをN分周する分局器、104は表示器105お
よびキー人力部106を制御するFPC(Front
PanelContrpHer)である。FIG. 1 is a block diagram of a first embodiment of the invention. 100 is a microcomputer, 102 is an oscillation circuit and an oscillator that generates the system clock for the microcomputer 1, 103 is a divider that divides the clock generated by 2 by N, and 104 is a display 105 and a key input. FPC (Front
PanelContrpHer).
今、マイクロ・コンピュータ100が、発振子および発
振回路102によって生成されたシステム・クロックに
より動作しているとき、103の分周器を介してFPC
104にもクロックが供給される。FPC104が1チ
ツプ・マイクロ・コンピュータ等であれば、マイクロ・
コンピュータ1から供給されるクロックをシステム・ク
ロックとして動作することが可能となり、表示器105
およびキー人力部106を動作させる。また、分周器1
03の分周比を大きくすることにより、低速のFPCに
も対応できるようになる。Now, when the microcomputer 100 is operating with the system clock generated by the oscillator and oscillation circuit 102, the FPC
104 is also supplied with a clock. If FPC104 is a 1-chip microcomputer, etc., it is a microcomputer.
It becomes possible to operate the clock supplied from the computer 1 as the system clock, and the display 105
and operates the key human power section 106. Also, frequency divider 1
By increasing the frequency division ratio of 03, it becomes possible to support low-speed FPC.
第2図は本発明の第2の実施例のブロック・ダイアグラ
ムである。ここで103の分周器の分周比をプログラマ
ブルにすると、たとえばFPC104が蛍光表示管10
5の表示ドライバとして使用されている時などに、分周
比をかえることにより、FPC104のシステム・クロ
ックが変化し、蛍光表示管の輝度を可変させることが可
能となる。FIG. 2 is a block diagram of a second embodiment of the invention. If the frequency division ratio of the frequency divider 103 is made programmable, for example, the FPC 104 can be
By changing the frequency division ratio when the FPC 104 is used as a display driver for the FPC 104, the system clock of the FPC 104 changes, and the brightness of the fluorescent display tube can be varied.
第4図は本発明の第3の実施例のブロック・ダイアグラ
ムである。第1図と異なるところは、スイッチ107が
FPC104へのクロック供給ラインに直列に設けられ
ていることである。FIG. 4 is a block diagram of a third embodiment of the invention. The difference from FIG. 1 is that a switch 107 is provided in series with the clock supply line to the FPC 104.
今、スイッチ107がオンのとき、マイクロ・コンピュ
ータ100が、発振子および発振回路102によって生
成されたシステム・クロックにより動作しているとき、
FPC104にもクロックが供給される。FPCが1チ
ツプ・マイクロ・コンピュータ等であれば、マイクロ・
コンピュータ1から供給されるクロックをシステム・り
Oツクとして動作することが可能となり、表示器5およ
びキー人力部6を動作させる。分周器103の分周比を
大きくすることにより、低速のFPCにも対応できるよ
うになる。マイコン100がバック・アップ・モードと
なると、FPC104にクロックを供給し続けると、消
費電流が大きくなるため、プログラムにより、スイッチ
107をOFFすれば、FPCの消費電流は減少し、マ
イクロ・コンピュータ100のみのバック・アップ・モ
ードとすることが可能となる。Now, when the switch 107 is on and the microcomputer 100 is operating with the system clock generated by the oscillator and the oscillation circuit 102,
A clock is also supplied to the FPC 104. If the FPC is a 1-chip microcomputer, etc., it is a microcomputer.
The clock supplied from the computer 1 can be used as a system clock to operate the display 5 and the key power section 6. By increasing the frequency division ratio of the frequency divider 103, it becomes possible to support low-speed FPC. When the microcomputer 100 enters the backup mode, current consumption increases if the clock is continued to be supplied to the FPC 104. Therefore, if the switch 107 is turned off by the program, the current consumption of the FPC decreases, and only the microcomputer 100 backup mode.
第6図は本発明の第4の実施例のブロック・ダイアグラ
ムである。ここでスイッチ107の0N10FFがプロ
グラマブルであると、たとえばFPC’104が蛍光表
示管の表示ドライバとして使用されている時などに、こ
のスイッチ107をOFFすることによりFPC104
のシステム・クロックが0FFL、蛍光表示管の表示を
消灯させることが可能となる。また分周器103の分周
比もプログラマブルであれば、FPCに供給されるクロ
ックが可変できるため、表示の輝度を変えることも可能
となる。FIG. 6 is a block diagram of a fourth embodiment of the present invention. Here, if 0N10FF of the switch 107 is programmable, for example, when the FPC'104 is used as a display driver of a fluorescent display tube, by turning off this switch 107, the FPC'104
When the system clock reaches 0FFL, it becomes possible to turn off the display on the fluorescent display tube. Furthermore, if the frequency division ratio of the frequency divider 103 is also programmable, the clock supplied to the FPC can be varied, so that the brightness of the display can also be changed.
以上説明したように本発明は、FPCのシステム・り四
ツクを、マイクロ・コンピュータかう供給することによ
り、F P’ Cの発振回路と発振子が不要となり、価
格が安くなるといり効果がある。As explained above, the present invention is effective in that by supplying the FPC system components with a microcomputer, the oscillation circuit and oscillator of the FPC are unnecessary, and the cost is reduced.
また、マイクロ・コンピュータとFPCの同期がとれる
ため、データ通信等も簡潔になるという効果がある。Furthermore, since the microcomputer and FPC can be synchronized, data communication etc. can be simplified.
第1図は本発明の第1実施例のブロック・ダイアグラム
、第2図は本発明の第2の実施例のブロック・ダイアグ
ラム、第3図は従来のブロック・ダイアグラム、第4図
および第5図はそれぞれ本発明の第3および第4の実施
例を示すブロック図である。
100・・・・・・マイクロ・コンピュータ、102・
・・・・・発振子および発振回路、103・・・・・・
分周器、104・・・・・・FPC(フロント・パネル
・コントローラ)、105・・・・・・表示器、106
・・・・・・キー人力部、107・・・・・・スイッチ
。
代理人 弁理士 内 原 音
−1ニ
=134−FIG. 1 is a block diagram of a first embodiment of the present invention, FIG. 2 is a block diagram of a second embodiment of the present invention, FIG. 3 is a conventional block diagram, and FIGS. 4 and 5. are block diagrams showing third and fourth embodiments of the present invention, respectively. 100...Micro computer, 102.
...Resonator and oscillation circuit, 103...
Frequency divider, 104... FPC (front panel controller), 105... Display unit, 106
...Key Human Power Department, 107...Switch. Agent Patent Attorney Uchihara Oto-1 d = 134-
Claims (1)
より動作する周辺ディジタル回路とを備え、前記マイク
ロ・コンピュータの発振回路により得られたクロックを
前記周辺ディジタル回路に供給して前記周辺ディジタル
回路を動作させることを特徴とするマイクロ・コンピュ
ータシステム。 2、前記マイクロ・コンピュータの発振回路の出力をプ
ログラマブル分周器で分周して前記クロックを得ること
を特徴とする特許請求の範囲第1項記載のマイクロ・コ
ンピュータシステム。[Scope of Claims] A microcomputer including an oscillation circuit and a peripheral digital circuit operated by a clock, and a clock obtained by the oscillation circuit of the microcomputer is supplied to the peripheral digital circuit to control the peripheral digital circuit. A microcomputer system that operates circuits. 2. The microcomputer system according to claim 1, wherein the clock is obtained by dividing the output of the oscillation circuit of the microcomputer using a programmable frequency divider.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63001868A JPH01177623A (en) | 1988-01-08 | 1988-01-08 | Microcomputer system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63001868A JPH01177623A (en) | 1988-01-08 | 1988-01-08 | Microcomputer system |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01177623A true JPH01177623A (en) | 1989-07-13 |
Family
ID=11513526
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63001868A Pending JPH01177623A (en) | 1988-01-08 | 1988-01-08 | Microcomputer system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01177623A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US6782483B2 (en) | 1990-03-23 | 2004-08-24 | Matsushita Electric Industrial Co., Ltd. | Data processing apparatus |
-
1988
- 1988-01-08 JP JP63001868A patent/JPH01177623A/en active Pending
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