JPH01151350U - - Google Patents

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JPH01151350U
JPH01151350U JP4754488U JP4754488U JPH01151350U JP H01151350 U JPH01151350 U JP H01151350U JP 4754488 U JP4754488 U JP 4754488U JP 4754488 U JP4754488 U JP 4754488U JP H01151350 U JPH01151350 U JP H01151350U
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JP
Japan
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multiprocessor system
cpu
prioritized
addressed
degree
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JP4754488U
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Description

【図面の簡単な説明】
第1図は本考案のマルチプロセツサ・システム
を構成するCPUボードを表わす図、第2図は本
考案のマルチプロセツサ・システムを表わす図、
第3図は従来のマルチプロセツサ・システムを表
わす図である。 1,1A,1B,1C……CPUボード、11
……バツフア、b……システム・バス、d,dA
,dB,dC……デバイス、fA,fB,fC…
…FIFOメモリ、f′,f′A,f′B,f′
C……優先度付FIFOメモリ、M……メモリ・
ボード、m……グローバル・メモリ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 各々独立に動作して相互に割り込みを発生する
    CPUボードを少なくとも2個以上システム・バ
    スに接続してなるマルチプロセツサ・システムに
    おいて、各々のCPUボードに、自己宛てに発生
    した割り込み要求をその優先度に従つて並び替え
    る優先度付先入れ先出しメモリを設けたことを特
    徴とするマルチプロセツサ・システム。
JP4754488U 1988-04-08 1988-04-08 Pending JPH01151350U (ja)

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JP4754488U JPH01151350U (ja) 1988-04-08 1988-04-08

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4754488U JPH01151350U (ja) 1988-04-08 1988-04-08

Publications (1)

Publication Number Publication Date
JPH01151350U true JPH01151350U (ja) 1989-10-19

Family

ID=31273745

Family Applications (1)

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JP4754488U Pending JPH01151350U (ja) 1988-04-08 1988-04-08

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JP (1) JPH01151350U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08249295A (ja) * 1995-03-15 1996-09-27 Kofu Nippon Denki Kk メッセージ制御装置

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5671143A (en) * 1979-11-15 1981-06-13 Fujitsu Ltd Queue control system
JPS58149557A (ja) * 1981-12-02 1983-09-05 エヌ ベー フイリップス フルーイランペン ファブリケン マルチプロセサシステム
JPS61175822A (ja) * 1985-01-31 1986-08-07 Nec Corp 優先順位付キユ−

Patent Citations (3)

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Publication number Priority date Publication date Assignee Title
JPS5671143A (en) * 1979-11-15 1981-06-13 Fujitsu Ltd Queue control system
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