JPS6331429U - - Google Patents
Info
- Publication number
- JPS6331429U JPS6331429U JP12376286U JP12376286U JPS6331429U JP S6331429 U JPS6331429 U JP S6331429U JP 12376286 U JP12376286 U JP 12376286U JP 12376286 U JP12376286 U JP 12376286U JP S6331429 U JPS6331429 U JP S6331429U
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- reset
- reset signal
- cpu board
- boards
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Multi Processors (AREA)
Description
第１図は本考案の一実施例を示すマルチプロセ
ツサの構成図、第２図は第１図の各ＣＰＵボード
内に設けられるリセツト回路の構成例を示す図、
第３図は第１図のリセツト動作のタイムチヤート
、第４図は従来のマルチプロセツサの構成図であ
る。 １０，１１，１２：ＣＰＵボード、１３：バス
、１５，１６，１７：リセツトライン、２０：リ
セツト回路、２１：パワーオンリセツト回路。
ツサの構成図、第２図は第１図の各ＣＰＵボード
内に設けられるリセツト回路の構成例を示す図、
第３図は第１図のリセツト動作のタイムチヤート
、第４図は従来のマルチプロセツサの構成図であ
る。 １０，１１，１２：ＣＰＵボード、１３：バス
、１５，１６，１７：リセツトライン、２０：リ
セツト回路、２１：パワーオンリセツト回路。
Claims (1)
- プロセツサあるいはそれに準ずる機能を備えた
ＣＰＵボードを複数結合して構成されるシステム
において、全ＣＰＵボードの同時立ち上げを行う
ために、個々のＣＰＵボードに内部リセツト信号
と外部リセツト信号のうち長いリセツト時間を有
効とするリセツト回路を備えたことを特徴とする
ＣＰＵボード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12376286U JPS6331429U (ja) | 1986-08-12 | 1986-08-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12376286U JPS6331429U (ja) | 1986-08-12 | 1986-08-12 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6331429U true JPS6331429U (ja) | 1988-03-01 |
Family
ID=31015161
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12376286U Pending JPS6331429U (ja) | 1986-08-12 | 1986-08-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6331429U (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06350429A (ja) * | 1993-06-04 | 1994-12-22 | Mitsubishi Electric Corp | 半導体集積回路の信号入出力回路 |
| JP2004173307A (ja) * | 2004-01-28 | 2004-06-17 | Renesas Technology Corp | 半導体集積回路の信号入出力回路 |
-
1986
- 1986-08-12 JP JP12376286U patent/JPS6331429U/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06350429A (ja) * | 1993-06-04 | 1994-12-22 | Mitsubishi Electric Corp | 半導体集積回路の信号入出力回路 |
| JP2004173307A (ja) * | 2004-01-28 | 2004-06-17 | Renesas Technology Corp | 半導体集積回路の信号入出力回路 |