JPH01129176A - Device testing apparatus - Google Patents

Device testing apparatus

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Publication number
JPH01129176A
JPH01129176A JP62287899A JP28789987A JPH01129176A JP H01129176 A JPH01129176 A JP H01129176A JP 62287899 A JP62287899 A JP 62287899A JP 28789987 A JP28789987 A JP 28789987A JP H01129176 A JPH01129176 A JP H01129176A
Authority
JP
Japan
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voltage
devices
device testing
testing apparatus
current
Prior art date
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Pending
Application number
JP62287899A
Other languages
Japanese (ja)
Inventor
Hideji Shoji
庄司 秀治
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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Publication of JPH01129176A publication Critical patent/JPH01129176A/en
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Abstract

PURPOSE:To eliminate the necessity for providing a voltage judge means at every device and to obtain a small-scale device testing apparatus, by judging whether a plurality of devices have good quality by measuring the terminal voltages of a plurality of the devices in common. CONSTITUTION:A CPU 900b controls the registers 3 of device testing apparatuses 500b, 600b, 700b, 800b to control the whole of a system. The terminal voltage of a device 100A measured by the voltage measuring part 2 of the apparatus 500b to judge the quality of the device 100A and the code of the next device 100B is set to the register 3 of the apparatus 500b. The terminal voltage of a device 200A measured by the voltage measuring part 2 of the apparatus 600b is read to judge the quality of the device 200A and the code of the next device 200B is set to the register 3 of the apparatus 600b. By this method, it becomes unnecessary to provide voltage judge means at every devices 100A, 100B, 200A, 200B and a small-scale device testing apparatus is obtained.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、メモリテストシステム等に利用するデバイス
試験装置に関する。
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a device testing apparatus used in a memory testing system or the like.

従来の技術 第3図は、従来のデバイス試験装置10を示す。Conventional technology FIG. 3 shows a conventional device testing apparatus 10. As shown in FIG.

第3図において、IOA、IOB、IOc、IODはそ
れぞれ、不図示の1個のデバイスに電流を供給する電流
供給部、2OA、20B、20CX20Dはそれぞれ、
電流供給部10A、IOB、IOC,IODにより電流
を供給されたデバイスの端子電圧を測定する電圧測定部
である。
In FIG. 3, IOA, IOB, IOc, and IOD each supply current to one device (not shown), and 2OA, 20B, and 20CX20D respectively,
The current supply unit 10A is a voltage measurement unit that measures the terminal voltage of a device to which current is supplied by the IOB, IOC, and IOD.

電流供給部10Aと電圧測定部20AXIOBと20B
Current supply section 10A and voltage measurement section 20AXIOB and 20B
.

10C°と20C,IODと20Dはそれぞれ、電流供
給電圧測定部11.12.13.14を構成し、1個の
デバイスに電流を供給して端子電圧を測定する。したが
って、このデバイス試験装置10は、合計4個のデバイ
スを試験することができる。
10C° and 20C, and IOD and 20D constitute current supply voltage measurement units 11, 12, 13, and 14, respectively, which supply current to one device and measure the terminal voltage. Therefore, this device testing apparatus 10 can test a total of four devices.

(資)は、測定を開始する電流供給電圧測定部11.1
2.13.14を指定するレジスタである。
(capital) is the current supply voltage measuring section 11.1 that starts the measurement.
This is a register that specifies 2.13.14.

第4図は、上記デバイス試験装置lOと同一の構成のデ
バイス試験装置500 as 600as 700a1
800aを並列に設け、合計16個のデバイス100A
〜100D、 200A〜200D、  300A〜3
00D。
FIG. 4 shows a device testing device 500 as 600as 700a1 having the same configuration as the device testing device IO described above.
800A in parallel, total of 16 devices 100A
~100D, 200A~200D, 300A~3
00D.

400A〜400Dを試験するデバイス試験システムを
示し、900aは、デバイス試験装置500 a 。
A device testing system for testing 400A to 400D is shown, and 900a is a device testing apparatus 500a.

600 a %  700 a % 800 aのレジ
スタ加を制御することによりシステム全体を制御するC
PU (中央処理装置)である。
600 a % 700 a % 800 C that controls the entire system by controlling register addition of a
PU (Central Processing Unit).

次に、第5図を参照して上記システムの動作、特にCP
 U 900 aの動作を説明する。
Next, with reference to FIG. 5, we will explain the operation of the above system, especially the CP
The operation of U 900a will be explained.

ステップ51において、デバイス100 A〜100 
D。
In step 51, devices 100A to 100
D.

200A〜200D、  300A〜300D、  4
00A〜400Dを試験する条件設定モードに設定され
、ステップ52において条件(供給電流、出力電圧等)
が設定されると、ステップ53.54.55.56にお
いてそれぞれ、デバイス試験装置500 a 、 60
0 a 、700B、800aの各レジスタ加を起動す
る。
200A~200D, 300A~300D, 4
The condition setting mode is set to test 00A to 400D, and the conditions (supply current, output voltage, etc.) are set in step 52.
Once set, in steps 53, 54, 55, and 56, the device test apparatuses 500a, 60, respectively
Activate each register addition of 0a, 700B, and 800a.

各レジスタIは、第3図に示す電流供給部10A〜IO
Dを順次起動してデバイス100 A〜100 D 。
Each register I has current supply units 10A to IO shown in FIG.
Devices 100A to 100D are started up in sequence.

200A〜200D、 300A〜300D、 400
A〜400Dに設定電流を供給させる。
200A~200D, 300A~300D, 400
A to 400D are supplied with the set current.

次いでステップ57〜60ではそれぞれ、デバイス試験
装置500aの電圧測定部20A−20Dにより測定さ
れた端子電圧を読み取って設定電圧と比較し、デバイス
100A〜100Dの良否を判定する。
Next, in steps 57 to 60, the terminal voltages measured by the voltage measuring sections 20A to 20D of the device testing apparatus 500a are read and compared with the set voltages to determine whether the devices 100A to 100D are good or bad.

以下、同様に、デバイス試験装置6QOa、 700a
Hereinafter, similarly, device test equipment 6QOa, 700a
.

800aの電圧測定部2OA−20Dにより測定された
端子電圧を読み取って設定電圧と比較し、デバイス20
0 A〜200D、 300A〜300D、 400A
〜400Dの良否を判定する。
The terminal voltage measured by the voltage measurement unit 2OA-20D of the device 800a is read and compared with the set voltage.
0 A~200D, 300A~300D, 400A
- Determine the quality of 400D.

したがって、上記従来例では、複数のデバイス試験装置
10を並列に設けることにより多数のデバイスを試験す
ることができる。
Therefore, in the conventional example described above, a large number of devices can be tested by providing a plurality of device testing apparatuses 10 in parallel.

発明が解決しようとする問題点 しかしながら、上記従来のデバイス試験装置では、試験
を行うデバイス毎に電流供給電圧測定部11等を設けて
いるために、・・−ドウエアの構成が複雑になり、した
がって大型化し、また高価となるという問題点がある。
Problems to be Solved by the Invention However, in the conventional device testing apparatus described above, the current supply voltage measuring section 11 and the like are provided for each device to be tested. There are problems in that it is large and expensive.

本発明は上記問題点に鑑み、ノ・−ドウエアを小型化す
ることができ、したがって安価なデバイス試験装置を提
供することを目的とする。
SUMMARY OF THE INVENTION In view of the above problems, it is an object of the present invention to provide a device testing apparatus that can reduce the size of the computer hardware and is therefore inexpensive.

問題点を解決するための手段 本発明は上記問題点を解決するために、デバイスにそれ
ぞれ電流を供給する複数の電流供給手段と、電流を供給
された複数のデバイスの端子電圧を共通に測定する電圧
測定手段を設け、複数のデバイスにそれぞれ電流を供給
し、複数のデバイスの端子電圧を時分割で読み取ること
によりそれぞれのデバイスの良否を判定するようにした
ものである。
Means for Solving the Problems In order to solve the above problems, the present invention uses a plurality of current supply means for supplying current to each device, and commonly measures the terminal voltages of the plurality of devices supplied with current. A voltage measuring means is provided, current is supplied to each of the plurality of devices, and the terminal voltages of the plurality of devices are read in a time-division manner to determine the quality of each device.

作用 本発明は上記構成により、複数のデバイスの端子電圧を
共通に測定することにより複数のデバイスデバイスの良
否を判定することができるために、デバイス毎に電圧測
定手段を設ける必要がなくなシ、シたがって、小型かつ
安価なデバイス試験装置を実現することができる。
According to the present invention, with the above configuration, it is possible to judge the quality of a plurality of devices by commonly measuring the terminal voltages of the plurality of devices, thereby eliminating the need to provide a voltage measuring means for each device. Therefore, a small and inexpensive device testing apparatus can be realized.

実施例 以下、図面を参照して本発明の詳細な説明する。第1図
は、本発明に係るデバイス試験装置の一実施例を示す概
略ブロック図、第2図は、第1図のデバイス試験装置を
用いたデバイス試験システムの動作を説明するためのフ
ローチャートである。
EXAMPLES Hereinafter, the present invention will be described in detail with reference to the drawings. FIG. 1 is a schematic block diagram showing an embodiment of a device testing apparatus according to the present invention, and FIG. 2 is a flowchart for explaining the operation of a device testing system using the device testing apparatus of FIG. 1. .

第1図において、LA、IB、IC,LDはそれぞれ、
不図示の1個のデバイスに電流を供給する電流供給部、
2は、電流供給部IA、IBl 1C11Dにより電流
を供給された4個のデバイスの端子電圧を共通に測定す
る電圧測定部であり、これら電流供給部IA、IB、I
C,IDと電圧測定部2は、4個のデバイスに電流を供
給して端子電圧を共通に測定する電流供給電圧測定装置
を構成する。
In Figure 1, LA, IB, IC, and LD are each
a current supply unit that supplies current to one device (not shown);
2 is a voltage measurement unit that commonly measures the terminal voltage of four devices supplied with current by the current supply units IA, IBl 1C11D;
C, ID and the voltage measuring section 2 constitute a current supply voltage measuring device that supplies current to four devices and commonly measures the terminal voltage.

3は、4個のデバイスの測定を開始する電流供給部IA
、IB、IC1IDと電圧測定部2を指定するレジスタ
であり、これらの部材が4個のデバイスの良否を判定す
るデバイス試験装置lを構成する。
3 is a current supply unit IA that starts measurement of four devices.
, IB, IC1ID, and a register for specifying the voltage measuring section 2. These members constitute a device testing apparatus l that determines the quality of four devices.

第4図に示すように、上記デバイス試験装置1と同一の
構成のデバイス試験装置500b、600b。
As shown in FIG. 4, device testing apparatuses 500b and 600b have the same configuration as the device testing apparatus 1 described above.

700b、 800bを並列に設けることにより、合計
16個のデバイス100A〜100D、 200A〜2
00 D 。
By providing 700b and 800b in parallel, a total of 16 devices 100A to 100D and 200A to 2
00D.

300A〜300D、 400A〜400Dを試験する
デバイス試験システムを構成することができる。
A device test system can be configured to test 300A to 300D and 400A to 400D.

尚、900 bは、デバイス試験装置500 b 、 
600b。
In addition, 900b is a device testing apparatus 500b,
600b.

700.800bのレジスタ3を制御することによりシ
ステム全体を制御するCPU (中央処理装置)である
This is a CPU (central processing unit) that controls the entire system by controlling register 3 of 700.800b.

次に、第2図を参照して上記構成に係るデバイス試験シ
ステムの動作、特にCP U 900 bの動作を説明
する。
Next, the operation of the device testing system according to the above configuration, particularly the operation of the CPU 900b, will be explained with reference to FIG.

ステップ21において、デバイス100A〜100D。In step 21, devices 100A-100D.

200A〜200D、 300A〜300D、 400
A〜400Dを試験する条件設定モードに設定され、ス
テップnにおいて条件(供給電圧、出力電圧等)が設定
されると、ステップZ3X24.25.26においてそ
れぞれ、デバイス試験装置500b、  600b、 
 700b、5oobの各レジスタ3に対し、デバイス
100A、200A、300A、40OAのコードを設
定する。
200A~200D, 300A~300D, 400
When the condition setting mode for testing A to 400D is set and the conditions (supply voltage, output voltage, etc.) are set in step n, the device test apparatuses 500b, 600b, and
Codes of devices 100A, 200A, 300A, and 40OA are set for each register 3 of 700b and 5oob.

各レジスタ3は、第1図に示す当該電流供給部1を起動
してデバイ、x、 100A、 200A、 300A
Each register 3 starts the current supply unit 1 shown in FIG.
.

400Aに設定電流を供給させる。400A is supplied with the set current.

続くステップ刀では、デバイス試験装置500bの電圧
測定部2により測定されたデバイス100Aの端子電圧
を読み取ってその良否を判定し、次いでステップ郡にお
いて、デバイス試験装置500bのレジスタ3に対して
次のデバイス100Bのコードを設定する。
In the next step, the terminal voltage of the device 100A measured by the voltage measuring section 2 of the device testing apparatus 500b is read to determine its acceptability, and then, in the step group, the next device is sent to the register 3 of the device testing apparatus 500b. Set a 100B code.

同様に、ステップ四、加では、デバイス試験装置600
bの電圧測定部2により測定されたデバイス200Aの
端子電圧を読み取ってその良否を判定し、デバイス試験
装置600bのレジスタ3に対して次のデバイス200
Bのコードを設定する。
Similarly, in step 4, the device test equipment 600
The terminal voltage of the device 200A measured by the voltage measurement unit 2 of b is read to determine its acceptability, and the next device 200A is sent to the register 3 of the device testing device 600b.
Set the code for B.

また、ステップ31.32では、デバイス試験装置70
0bの電圧測定部2により測定されたデバイス300A
の端子電圧を読み取ってその良否を判定し、デバイス試
験装置700bのレジスタ3に対して次のデバイス30
0Bのコードを設定し、同様にステップア、讃では、デ
バイス試験装置800bの電圧測定部2により測定され
たデバイス400Aの端子電圧を読み取ってその良否を
判定し、デバイス試験装置800bのレジスタ3に対し
て次のデバイス400 Bのコードを設定する。
Further, in step 31.32, the device test equipment 70
Device 300A measured by voltage measurement unit 2 of 0b
reads the terminal voltage of the device 30 to determine whether it is good or bad.
0B code is set, and in the same way, in Step A and San, the terminal voltage of the device 400A measured by the voltage measuring section 2 of the device testing equipment 800b is read to determine its acceptability, and the code is stored in the register 3 of the device testing equipment 800b. The code of the next device 400B is set for the next device 400B.

以下、ステップあ以下において、電流が供給されたデバ
イスの電圧を共通に測定してその良否を判定することに
より、16個のデバイスを試験することができる。
Hereinafter, in step A and subsequent steps, 16 devices can be tested by commonly measuring the voltages of the devices to which current is supplied and determining their acceptability.

発明の詳細 な説明したように、本発明は、デバイスにそれぞれ電流
を供給する複数の電流供給手段と、電流を供給された複
数のデバイスの端子電圧を共通に測定する電圧測定手段
を設け、複数のデバイスにそれぞれ電流を供給し、複数
のデバイスの端子電圧を時分割で読み取ることによりそ
れぞれのデバイスの良否を判定するようにしたので、デ
バイス毎に電圧測定手段を設ける必要がなくなり、シた
がって、小型かつ安価なデバイス試験装置を実現するこ
とができる。
DETAILED DESCRIPTION OF THE INVENTION As described in detail, the present invention provides a plurality of current supply means for supplying current to each device, and a voltage measurement means for commonly measuring the terminal voltage of a plurality of devices supplied with current. Since current is supplied to each device and the terminal voltage of multiple devices is read in a time-sharing manner to determine the acceptability of each device, there is no need to provide voltage measurement means for each device. , it is possible to realize a small and inexpensive device testing apparatus.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は、本発明に係るデバイス試験装置の一実施例を
示す概略ブロック図、第2図は、第1図のデバイス試験
装置を用いたデバイス試験システムの動作を説明するた
めのフローチャ−ト、第3図は、従来例のデバイス試験
装置を示す概略ブロック図、第4図は、第1図、第3図
のデバイス試験装置により構成されるデバイス試験シス
テムの概略ブロック図、第5図は、第3図のデバイス試
験装置を用いたデバイス試験システムの動作を説明する
ためのフローチャートである。 ■、500b、 600b、 600b、 600b・
・・デバイス試験装置、LA、IB、IC,LD・・・
電流供給部、2・・・電圧測定部、3・・・レジスタ、
1oOA〜100D、 200A 〜200D、  3
00A 〜300D、 400A〜400 D・・・デ
バイス、900 b・・・CPU (中央処理装置)。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 第 2 図 第3図 第4図
FIG. 1 is a schematic block diagram showing an embodiment of a device testing apparatus according to the present invention, and FIG. 2 is a flowchart for explaining the operation of a device testing system using the device testing apparatus of FIG. 1. , FIG. 3 is a schematic block diagram showing a conventional device testing apparatus, FIG. 4 is a schematic block diagram of a device testing system composed of the device testing apparatuses shown in FIGS. 1 and 3, and FIG. , is a flowchart for explaining the operation of a device testing system using the device testing apparatus of FIG. 3. ■, 500b, 600b, 600b, 600b・
...Device test equipment, LA, IB, IC, LD...
Current supply section, 2... Voltage measurement section, 3... Register,
1oOA~100D, 200A~200D, 3
00A to 300D, 400A to 400D...device, 900b...CPU (central processing unit). Name of agent: Patent attorney Toshio Nakao and 1 other person No. 1
Figure 2 Figure 3 Figure 4

Claims (1)

【特許請求の範囲】[Claims] デバイスにそれぞれ電流を供給する複数の電流供給手段
と、前記電流を供給された複数のデバイスの端子電圧を
共通に測定する電圧測定手段と、複数のデバイスにそれ
ぞれ電流を供給するように前記電流供給手段を制御し、
前記電圧測定手段により測定された複数のデバイスの端
子電圧を時分割で読み取り、この電圧によりそれぞれの
デバイスの良否を判定する手段とを有するデバイス試験
装置。
a plurality of current supply means for supplying current to each device; a voltage measurement means for commonly measuring terminal voltages of the plurality of devices supplied with the current; and a plurality of current supply means for supplying current to each of the plurality of devices. control the means;
A device testing apparatus comprising: means for time-divisionally reading the terminal voltages of a plurality of devices measured by the voltage measuring means, and determining the quality of each device based on this voltage.
JP62287899A 1987-11-13 1987-11-13 Device testing apparatus Pending JPH01129176A (en)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57189075A (en) * 1981-05-18 1982-11-20 Hitachi Ltd Testing device for semiconductor integrated circuit

Patent Citations (1)

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Publication number Priority date Publication date Assignee Title
JPS57189075A (en) * 1981-05-18 1982-11-20 Hitachi Ltd Testing device for semiconductor integrated circuit

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