JPH01120677U - - Google Patents
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- Publication number
- JPH01120677U JPH01120677U JP1554588U JP1554588U JPH01120677U JP H01120677 U JPH01120677 U JP H01120677U JP 1554588 U JP1554588 U JP 1554588U JP 1554588 U JP1554588 U JP 1554588U JP H01120677 U JPH01120677 U JP H01120677U
- Authority
- JP
- Japan
- Prior art keywords
- external terminal
- integrated circuit
- circuit
- internal signals
- internal
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 238000010998 test method Methods 0.000 description 1
Landscapes
- Tests Of Electronic Circuits (AREA)
Description
第１図は、第１の実施例を適用したゲートアレ
イの回路ブロツク図、第２図は、内部信号観測回
路２０の回路構成図、第３図はａは、上記第１の
実施例の動作試験方法を説明するタイミングチヤ
ート、第３図ｂは、１１＝“０”，Ｉ１２＝“
１”の時のＸ０〜Ｘ１５の真理値を示す図表、第
４図は、第２の実施例を適用したゲートアレイの
回路ブロツク図、第５図は、ゲートアレイの回路
構成の一例を示す図である。 ２０……内部信号観測回路、２１，２２……シ
フトレジスタ、３０……選択回路（セレクタ）、
４０……選択ゲート。
イの回路ブロツク図、第２図は、内部信号観測回
路２０の回路構成図、第３図はａは、上記第１の
実施例の動作試験方法を説明するタイミングチヤ
ート、第３図ｂは、１１＝“０”，Ｉ１２＝“
１”の時のＸ０〜Ｘ１５の真理値を示す図表、第
４図は、第２の実施例を適用したゲートアレイの
回路ブロツク図、第５図は、ゲートアレイの回路
構成の一例を示す図である。 ２０……内部信号観測回路、２１，２２……シ
フトレジスタ、３０……選択回路（セレクタ）、
４０……選択ゲート。
Claims (1)
- 集積回路内部にあつて、該集積回路の内部信号
を第１の外部端子から加わる制御信号によりパラ
レル入力し、その取り込んだ内部信号を第２の外
部端子から加わるクロツクにより第３の外部端子
にシリアル出力するシフトレジスタを少なくとも
１個備えたことを特徴とする集積回路の内部信号
観測回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1554588U JPH01120677U (ja) | 1988-02-08 | 1988-02-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1554588U JPH01120677U (ja) | 1988-02-08 | 1988-02-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01120677U true JPH01120677U (ja) | 1989-08-16 |
Family
ID=31227686
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1554588U Pending JPH01120677U (ja) | 1988-02-08 | 1988-02-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01120677U (ja) |
-
1988
- 1988-02-08 JP JP1554588U patent/JPH01120677U/ja active Pending