JP7166090B2 - Sealing sheet and method for producing electronic element device - Google Patents

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Description

本発明は、封止用シートおよび電子素子装置の製造方法に関し、詳しくは、電子素子装置の製造方法およびそれに用いられる封止用シートに関する。 TECHNICAL FIELD The present invention relates to a sealing sheet and a method for manufacturing an electronic element device, and more particularly to a method for manufacturing an electronic element device and a sealing sheet used therein.

従来、基板の一方面に実装された電子デバイスを、電子デバイス封止用シートで封止して、電子デバイスパッケージを製造する方法が知られている(例えば、下記特許文献1参照。)。 Conventionally, there is known a method of manufacturing an electronic device package by sealing an electronic device mounted on one side of a substrate with an electronic device sealing sheet (see, for example, Patent Document 1 below).

この方法では、電子デバイス封止用シートは、電子デバイスの一方面および側面と、基板における電子デバイスの周囲の一方面とに接触するように、電子デバイスを埋設して、電子デバイスを封止する。 In this method, the sheet for encapsulating the electronic device embeds the electronic device so as to be in contact with one surface and side surface of the electronic device and one surface surrounding the electronic device on the substrate to seal the electronic device. .

特開2015-179829号公報JP 2015-179829 A

しかるに、電子デバイスが基板から剥離することを抑制して、信頼性に優れる電子デバイスパッケージを製造する要求がある。 However, there is a demand for manufacturing a highly reliable electronic device package by suppressing the separation of the electronic device from the substrate.

また、電子デバイスパッケージにおいて、電子デバイス封止用シートの硬化物である封止樹脂シートには、形状安定性が求められる。 Further, in the electronic device package, the sealing resin sheet, which is a cured product of the electronic device sealing sheet, is required to have shape stability.

さらに、封止樹脂シートを薄く形成して、製造される電子デバイスパッケージの薄型化が求められる。 Furthermore, it is required to form a thin encapsulating resin sheet to make the manufactured electronic device package thinner.

本発明は、電子素子の基板からの剥離を抑制することができながら、形状安定性に優れる封止層を形成することができる封止用シート、および、薄型化が図られた電子素子装置の製造方法を提供する。 The present invention provides a sealing sheet capable of forming a sealing layer having excellent shape stability while suppressing the separation of an electronic element from a substrate, and a thin electronic element device. A manufacturing method is provided.

本発明(1)は、基板の厚み方向一方面に対向するように実装される電子素子を、前記基板において前記電子素子と対向しない前記厚み方向一方面と接触するように、封止する封止層を形成するように使用される封止用シートであり、前記電子素子の前記厚み方向一方面に配置される前記封止層の厚みt1の、前記電子素子の厚みt2に対する比(t1/t2)が、0.7以上、2.3以下である、封止用シートを含む。 In the present invention (1), an electronic element mounted so as to face one surface in the thickness direction of a substrate is sealed so as to be in contact with one surface in the thickness direction of the substrate that does not face the electronic element. A sealing sheet used to form a layer, the ratio (t1/t2 ) is 0.7 or more and 2.3 or less.

[1]電子素子の厚み方向一方面に配置される封止層の厚みt1が過度に厚いために、上記した封止層の厚みt1の、電子素子の厚みt2に対する比(t1/t2)が、2.3を超える場合には、図5Aに示すように、上記した厚い封止層を備える電子素子装置の薄型化を図れない。 [1] Since the thickness t1 of the sealing layer disposed on one side in the thickness direction of the electronic element is excessively large, the ratio (t1/t2) of the thickness t1 of the sealing layer to the thickness t2 of the electronic element , exceeds 2.3, as shown in FIG. 5A, it is impossible to reduce the thickness of the electronic element device having the thick sealing layer.

また、[2]電子素子の厚みt2が過度に薄いために、上記した封止層の厚みt1の、電子素子の厚みt2に対する比(t1/t2)が、2.3を超える場合には、電子素子を埋設する薄い封止層の、電子素子の周側面に対する接触面積が過度に小さくなり、また、図5Bに示すように、断面視において、電子素子を取り囲む略コ字形状(U字形状)(図2参照)ではなく、厚み方向他方面が平坦状に近似する形状になる。そのため、封止層の電子素子に対する拘束力(アンカー効果のような効果)が小さくなり、その結果、電子素子の基板からの剥離を抑制することができない。 [2] When the thickness t2 of the electronic element is too thin and the ratio (t1/t2) of the thickness t1 of the sealing layer to the thickness t2 of the electronic element exceeds 2.3, The contact area of the thin sealing layer that embeds the electronic element with respect to the peripheral side surface of the electronic element becomes excessively small, and as shown in FIG. ) (see FIG. 2), the other surface in the thickness direction has a shape that approximates a flat shape. As a result, the binding force (anchoring effect) of the sealing layer to the electronic element is reduced, and as a result, the separation of the electronic element from the substrate cannot be suppressed.

しかし、本発明の封止用シートでは、封止層の厚みt1の、電子素子の厚みt2に対する比(t1/t2)が、2.3以下であるので、[1]電子素子装置の薄型化を図ることができる。併せて、[2]封止層が、電子素子の周側面に対する接触面積を十分に確保でき、また、図2に示すように、断面視において、電子素子を取り囲む略コ字形状(U字形状)になることができる。そのため、封止層の電子素子に対する拘束力(アンカー効果のような効果)が発現され、その結果、電子素子の基板からの剥離を抑制することができる。 However, in the sealing sheet of the present invention, the ratio (t1/t2) of the thickness t1 of the sealing layer to the thickness t2 of the electronic element is 2.3 or less. can be achieved. In addition, [2] the sealing layer can ensure a sufficient contact area with the peripheral side surface of the electronic element, and as shown in FIG. ). Therefore, the sealing layer exerts a restraining force (anchoring effect) on the electronic element, and as a result, it is possible to suppress the separation of the electronic element from the substrate.

一方、[3]電子素子の厚み方向一方面に配置される封止層の厚みt1が過度に薄いために、上記した封止層の厚みt1の、電子素子の厚みt2に対する比(t1/t2)が、0.7に満たない場合には、図4Aに示すように、電子素子の厚み方向一方面に配置される薄い封止層が損傷や欠損し易く、そのため、封止性が低下し、その結果、電子素子の基板からの剥離を抑制することができない。 On the other hand, [3] Since the thickness t1 of the sealing layer disposed on one side in the thickness direction of the electronic element is excessively thin, the ratio of the thickness t1 of the sealing layer to the thickness t2 of the electronic element (t1/t2 ) is less than 0.7, as shown in FIG. 4A, the thin sealing layer disposed on one side in the thickness direction of the electronic element is likely to be damaged or chipped, resulting in reduced sealing performance. As a result, it is not possible to prevent the electronic element from being detached from the substrate.

また、[4]電子素子の厚みt2が過度に厚いために、上記した封止層の厚みt1の、電子素子の厚みt2に対する比(t1/t2)が、0.7に満たない場合には、封止用シートが電子素子に対してプレスされるときに、図4Bに示すように、厚い封止用シートが、電子素子の外側に向かって流れ易くなる。そのため、封止用シートから形成される封止層の周端部が所望の形状とならない。その結果、封止層の形状安定性が低下する。 [4] When the thickness t2 of the electronic element is excessively thick and the ratio (t1/t2) of the thickness t1 of the sealing layer to the thickness t2 of the electronic element is less than 0.7 When the encapsulating sheet is pressed against the electronic element, the thick encapsulating sheet tends to flow toward the outside of the electronic element, as shown in FIG. 4B. Therefore, the peripheral edge portion of the sealing layer formed from the sealing sheet does not have a desired shape. As a result, the shape stability of the encapsulation layer is reduced.

しかし、本発明の封止用シートでは、電子素子の厚みt2に対する比(t1/t2)が、0.7以上であるので、[3]電子素子の厚み方向一方面に配置される封止層の損傷や欠損を抑制でき、そのため、封止性の低下を抑制でき、その結果、電子素子の基板からの剥離を抑制することができる。併せて、[4]封止用シートが電子素子に対してプレスされるときに、封止用シートが、電子素子の外側に向かって流れ易くなることが抑制され、そのため、封止用シートから形成される封止層の周端部を所望の形状とすることができる。その結果、封止層の形状安定性の低下を抑制することができる。 However, in the sealing sheet of the present invention, the ratio (t1/t2) to the thickness t2 of the electronic element is 0.7 or more. damage or chipping of the electronic element can be suppressed, and therefore deterioration of the sealing performance can be suppressed, and as a result, peeling of the electronic element from the substrate can be suppressed. In addition, [4] when the sealing sheet is pressed against the electronic element, it is suppressed that the sealing sheet tends to flow toward the outside of the electronic element. The peripheral end portion of the formed sealing layer can be formed into a desired shape. As a result, deterioration of the shape stability of the sealing layer can be suppressed.

従って、この封止用シートによれば、電子素子の基板からの剥離を抑制することができるとともに、形状安定性に優れる封止層を形成して、薄型化が図られた電子素子装置を製造することができる。 Therefore, according to this sealing sheet, it is possible to suppress the separation of the electronic element from the substrate, form a sealing layer excellent in shape stability, and manufacture a thin electronic element device. can do.

本発明(2)は、前記封止層の厚みt1と、前記電子素子の厚みt2との合計(t1+t2)が、0.25[mm]以上、0.50[mm]以下である、(1)に記載の封止用シートを含む。 In the present invention (2), the total (t1+t2) of the thickness t1 of the sealing layer and the thickness t2 of the electronic element is 0.25 [mm] or more and 0.50 [mm] or less, (1 ) includes the sealing sheet described in .

封止層の厚みt1が厚く、上記した合計(t1+t2)が0.25[mm]以上である場合には、厚い封止層によって電子素子を確実に封止できる。また、電子素子の厚みt2が厚く、上記した合計(t1+t2)が0.25[mm]以上である場合には、電子素子の周側面に対する封止層の接触面積を十分に確保できるので、かかる封止層によって、電子素子を確実に封止できる。 When the thickness t1 of the sealing layer is thick and the total (t1+t2) is 0.25 [mm] or more, the thick sealing layer can reliably seal the electronic element. Further, when the thickness t2 of the electronic element is thick and the total (t1+t2) is 0.25 [mm] or more, a sufficient contact area of the sealing layer with respect to the peripheral side surface of the electronic element can be secured. The electronic element can be reliably sealed by the sealing layer.

一方、封止層の厚みt1が薄く、上記した合計(t1+t2)が0.50[mm]以下である場合、または、電子素子の厚みt2が薄く、上記した合計(t1+t2)が0.50[mm]以下である場合には、薄型化が図られた電子素子装置を製造することができる。 On the other hand, when the thickness t1 of the sealing layer is thin and the total (t1 + t2) is 0.50 [mm] or less, or when the thickness t2 of the electronic element is thin and the total (t1 + t2) is 0.50 [mm] mm] or less, it is possible to manufacture a thin electronic device.

本発明(3)は、(1)または(2)に記載の封止用シートを使用して、電子素子を封止する、電子素子装置の製造方法を含む。 The present invention (3) includes a method for producing an electronic element device, in which an electronic element is sealed using the sealing sheet according to (1) or (2).

この電子素子装置の製造方法では、封止用シートを使用して、基板の厚み方向一方面に対向するように実装される電子素子を、基板において電子素子と対向しない厚み方向一方面と接触するように、封止する封止層を形成する。そのため、基板に実装される電子素子を封止層で確実に封止することができる。その結果、基板、電子素子および封止層を備え、信頼性に優れる電子素子装置を製造することができる。 In this method for manufacturing an electronic element device, the sealing sheet is used to bring the electronic element mounted so as to face one surface in the thickness direction of the substrate into contact with the one surface in the thickness direction of the substrate that does not face the electronic element. A sealing layer for sealing is formed as follows. Therefore, the electronic element mounted on the substrate can be reliably sealed with the sealing layer. As a result, it is possible to manufacture a highly reliable electronic element device comprising a substrate, an electronic element and a sealing layer.

本発明の封止用シートによれば、電子素子の基板からの剥離を抑制することができるとともに、形状安定性に優れる封止層を形成して、薄型化が図られた電子素子装置を製造することができる。 According to the sealing sheet of the present invention, it is possible to suppress the peeling of the electronic element from the substrate, and to form a sealing layer having excellent shape stability to manufacture a thin electronic element device. can do.

本発明の電子素子装置の製造方法によれば、信頼性に優れる電子素子装置を製造することができる。 According to the method for manufacturing an electronic element device of the present invention, an electronic element device having excellent reliability can be manufactured.

図1は、本発明の封止用シートの一実施形態である電子素子封止用シートの断面図を示す。FIG. 1 shows a cross-sectional view of an electronic element encapsulating sheet that is one embodiment of the encapsulating sheet of the present invention. 図2は、図1に示す電子素子封止用シートを用いて電子素子を封止して、電子素子の周囲の基板および封止層をダイシングし、電子素子装置を製造する工程を示す。FIG. 2 shows a process of sealing an electronic element using the sheet for electronic element sealing shown in FIG. 1, dicing the substrate and the sealing layer around the electronic element, and manufacturing an electronic element device. 図3Aおよび図3Bは、1つの電子素子を備える電子素子実装基板から電子素子装置を製造する工程を説明する図であり、図3Aが、1つの電子素子を備える電子素子実装基板を準備する工程、図3Bが、電子素子装置において、電子素子の周囲の基板および封止層をダイシングする工程を示す。3A and 3B are diagrams for explaining the process of manufacturing an electronic element device from an electronic element mounting board having one electronic element, and FIG. 3A is a process of preparing an electronic element mounting board having one electronic element. 3B show the step of dicing the substrate and sealing layer around the electronic element in the electronic element device. 図4Aおよび図4Bは、封止層の電子素子に対する厚みの比(t1/t2)が過小である比較例の断面図であり、図4Aが、封止層が過度に薄い比較例、図4Bが、電子素子が過度に厚い比較例を示す。4A and 4B are cross-sectional views of comparative examples in which the thickness ratio (t1/t2) of the sealing layer to the electronic element is too small, FIG. 4A being a comparative example in which the sealing layer is too thin, and FIG. shows a comparative example in which the electronic element is excessively thick. 図5Aおよび図5Bは、封止層の電子素子に対する厚みの比(t1/t2)が過大である比較例の断面図であり、図5Aが、封止層が過度に厚い比較例、図4Bが、電子素子が過度に薄い比較例を示す。5A and 5B are cross-sectional views of comparative examples in which the thickness ratio (t1/t2) of the sealing layer to the electronic element is excessive, FIG. 5A being a comparative example in which the sealing layer is excessively thick, and FIG. shows a comparative example in which the electronic element is excessively thin. 図6は、封止層の厚みt1と、電子素子の厚みt2との関係を示すグラフである。FIG. 6 is a graph showing the relationship between the thickness t1 of the sealing layer and the thickness t2 of the electronic element.

本発明の封止用シートの一実施形態である電子素子封止用シートを図1および図2を参照して説明する。 An electronic element encapsulating sheet, which is one embodiment of the encapsulating sheet of the present invention, will be described with reference to FIGS. 1 and 2. FIG.

図1および図2に示すように、この電子素子封止用シート1は、電子素子装置(電子素子パッケージ)3の製造に使用される。図2に示すように、電子素子装置3は、後で説明するが、基板2と、電子素子4および封止層5を備える。 As shown in FIGS. 1 and 2, this electronic element encapsulating sheet 1 is used for manufacturing an electronic element device (electronic element package) 3 . As shown in FIG. 2, the electronic element device 3 includes a substrate 2, an electronic element 4 and a sealing layer 5, which will be described later.

また、図1に示す電子素子封止用シート1は、電子素子4を封止した後の封止層5(図2参照)ではなく、つまり、電子素子4を封止する前であり、封止層5を形成するための前駆体シート(好ましくは、硬化性シート)である。 Further, the electronic element sealing sheet 1 shown in FIG. 1 is not the sealing layer 5 after sealing the electronic element 4 (see FIG. 2), that is, before sealing the electronic element 4, It is a precursor sheet (preferably a curable sheet) for forming the stopping layer 5 .

図1に示すように、電子素子封止用シート1は、厚み方向に直交する方向(面方向)に延びる略板形状(フィルム形状)を有する。電子素子封止用シート1は、厚み方向一方面である第1シート面6と、厚み方向他方面である第2シート面7とを有する。第1シート面6および第2シート面7は、互いに平行する平面(平坦面)である。 As shown in FIG. 1, the sheet 1 for electronic element encapsulation has a substantially plate shape (film shape) extending in a direction (plane direction) perpendicular to the thickness direction. The electronic element encapsulating sheet 1 has a first sheet surface 6 that is one surface in the thickness direction and a second sheet surface 7 that is the other surface in the thickness direction. The first sheet surface 6 and the second sheet surface 7 are planes (flat surfaces) parallel to each other.

第1シート面6は、電子素子封止用シート1が電子素子4(図2参照)を封止するときに、例えば、その平坦(平面)形状を維持して、第2シート面7との厚み方向における間隔を確保して、所定の厚みを与える。 When the electronic element encapsulating sheet 1 seals the electronic element 4 (see FIG. 2), the first sheet surface 6 maintains its flat (flat) shape, for example, and is in contact with the second sheet surface 7. A predetermined thickness is provided by securing an interval in the thickness direction.

第2シート面7は、後述するが、電子素子封止用シート1が電子素子4を封止するときに、電子素子4における少なくとも第1素子面8(後述)と、基板2において電子素子4と対向しない第1基板面11(後述)との両面に接触する接触面である。 Although the second sheet surface 7 will be described later, when the electronic element sealing sheet 1 seals the electronic element 4, at least the first element surface 8 (described later) in the electronic element 4 and the electronic element 4 in the substrate 2 It is a contact surface that contacts both surfaces of the first substrate surface 11 (described later) that does not face the .

電子素子封止用シート1の材料は、封止層5が後述する大きさを有するような材料であれば、特に限定されない。電子素子封止用シート1の材料としては、例えば、封止組成物が挙げられる。 The material of the electronic element encapsulating sheet 1 is not particularly limited as long as it is a material that allows the encapsulating layer 5 to have the size described below. Examples of the material of the sheet 1 for encapsulating electronic elements include encapsulating compositions.

封止組成物は、例えば、熱硬化性成分を含有する硬化性組成物である。 A sealing composition is, for example, a curable composition containing a thermosetting component.

熱硬化性成分は、電子素子4を封止するときの加熱により一旦軟化し、さらには、溶融して流動し、さらなる加熱によって、硬化する成分である。 The thermosetting component is a component that is once softened by heating when the electronic element 4 is sealed, melts and flows, and is cured by further heating.

また、熱硬化性成分は、電子素子封止用シート1においてBステージ(半硬化状態)であって、Cステージではない(つまり、完全硬化前の状態である)。なお、Bステージは、熱硬化性成分が、液状であるAステージと、完全硬化したCステージとの間の状態であって、硬化およびゲル化がわずかに進行し、圧縮弾性率がCステージの圧縮弾性率よりも小さい状態である。 Moreover, the thermosetting component is in the B stage (semi-cured state) in the sheet 1 for encapsulating an electronic element, and is not in the C stage (that is, the state before complete curing). In the B stage, the thermosetting component is in a state between the A stage in which it is liquid and the C stage in which it is completely cured. It is in a state smaller than the compression modulus.

熱硬化性成分は、例えば、主剤、硬化剤および硬化促進剤を含む。 Thermosetting components include, for example, a main agent, a curing agent and a curing accelerator.

主剤としては、例えば、エポキシ樹脂、フェノール樹脂、メラミン樹脂、ビニルエステル樹脂、シアノエステル樹脂、マレイミド樹脂、シリコーン樹脂などが挙げられる。主剤としては、耐熱性などの観点から、好ましくは、エポキシ樹脂が挙げられる。主剤がエポキシ樹脂であれば、熱硬化性成分は、後述する硬化剤(エポキシ系硬化剤)および硬化促進剤(エポキシ系硬化促進剤)とともに、エポキシ系熱硬化性成分を構成する。 Examples of base resins include epoxy resins, phenol resins, melamine resins, vinyl ester resins, cyano ester resins, maleimide resins, and silicone resins. From the viewpoint of heat resistance and the like, the main agent is preferably an epoxy resin. If the main agent is an epoxy resin, the thermosetting component constitutes an epoxy thermosetting component together with a curing agent (epoxy curing agent) and a curing accelerator (epoxy curing accelerator), which will be described later.

エポキシ樹脂としては、例えば、ビスフェノールA型エポキシ樹脂、ビスフェノールF型エポキシ樹脂、変性ビスフェノールA型エポキシ樹脂、変性ビスフェノールF型エポキシ樹脂、ビフェニル型エポキシ樹脂などの2官能エポキシ樹脂、例えば、フェノールノボラック型エポキシ樹脂、クレゾールノボラック型エポキシ樹脂、トリスヒドロキシフェニルメタン型エポキシ樹脂、テトラフェニロールエタン型エポキシ樹脂、ジシクロペンタジエン型エポキシ樹脂などの3官能以上の多官能エポキシ樹脂などが挙げられる。これらエポキシ樹脂は、単独で使用または2種以上を併用することができる。 Examples of epoxy resins include bifunctional epoxy resins such as bisphenol A type epoxy resin, bisphenol F type epoxy resin, modified bisphenol A type epoxy resin, modified bisphenol F type epoxy resin, biphenyl type epoxy resin, and phenol novolac type epoxy resin. trifunctional or higher polyfunctional epoxy resins such as resins, cresol novolak-type epoxy resins, trishydroxyphenylmethane-type epoxy resins, tetraphenylolethane-type epoxy resins, and dicyclopentadiene-type epoxy resins. These epoxy resins can be used alone or in combination of two or more.

好ましくは、2官能エポキシ樹脂の単独使用が挙げられ、具体的には、ビスフェノールF型エポキシ樹脂の単独使用が挙げられる。 Preferably, a bifunctional epoxy resin is used alone, and specifically, a bisphenol F type epoxy resin is used alone.

エポキシ樹脂のエポキシ当量は、例えば、10g/eq.以上、好ましくは、100g/eq.以上であり、また、例えば、300g/eq.以下、好ましくは、250g/eq.以下である。 The epoxy equivalent of the epoxy resin is, for example, 10 g/eq. above, preferably 100 g/eq. or more, and, for example, 300 g/eq. Below, preferably 250 g/eq. It is below.

主剤(好ましくは、エポキシ樹脂)の軟化点は、例えば、50℃以上、好ましくは、70℃以上であり、また、例えば、110℃以下、好ましくは、90℃以下である。 The softening point of the main agent (preferably epoxy resin) is, for example, 50° C. or higher, preferably 70° C. or higher, and is, for example, 110° C. or lower, preferably 90° C. or lower.

主剤(好ましくは、エポキシ樹脂)の割合は、封止組成物において、例えば、1質量%以上、好ましくは、2質量%以上であり、また、例えば、30質量%以下、好ましくは、10質量%以下である。また、主剤(好ましくは、エポキシ樹脂)の割合は、熱硬化性成分において、例えば、50質量%以上、好ましくは、60質量%以上であり、また、例えば、90質量%以下、好ましくは、10質量%以下である。 The proportion of the main agent (preferably epoxy resin) in the sealing composition is, for example, 1% by mass or more, preferably 2% by mass or more, and is, for example, 30% by mass or less, preferably 10% by mass. It is below. The proportion of the main agent (preferably epoxy resin) in the thermosetting component is, for example, 50% by mass or more, preferably 60% by mass or more, and is, for example, 90% by mass or less, preferably 10% by mass. % by mass or less.

硬化剤は、加熱によって、上記した主剤を硬化させる成分(好ましくは、エポキシ樹脂硬化剤)である。硬化剤としては、例えば、フェノールノボラック樹脂などのフェノール樹脂が挙げられる。 The curing agent is a component (preferably epoxy resin curing agent) that cures the main agent by heating. Examples of curing agents include phenolic resins such as phenolic novolac resins.

硬化剤の割合は、主剤がエポキシ樹脂であり、硬化剤がフェノール樹脂であれば、エポキシ樹脂中のエポキシ基1当量に対して、フェノール樹脂中の水酸基の合計が、例えば、0.7当量以上、好ましくは、0.9当量以上、例えば、1.5当量以下、好ましくは、1.2当量以下となるように、調整される。具体的には、硬化剤の配合部数は、主剤100質量部に対して、例えば、30質量部以上、好ましくは、50質量部以上であり、また、例えば、75質量部以下、好ましくは、60質量部以下である。 If the main agent is an epoxy resin and the curing agent is a phenolic resin, the ratio of the curing agent is such that the total amount of hydroxyl groups in the phenolic resin is, for example, 0.7 equivalents or more per equivalent of the epoxy groups in the epoxy resin. , preferably 0.9 equivalents or more, for example, 1.5 equivalents or less, preferably 1.2 equivalents or less. Specifically, the number of parts of the curing agent is, for example, 30 parts by mass or more, preferably 50 parts by mass or more, and for example, 75 parts by mass or less, preferably 60 parts by mass, with respect to 100 parts by mass of the main agent. Part by mass or less.

硬化促進剤は、加熱によって、主剤の硬化を促進する触媒(熱硬化触媒)(好ましくは、エポキシ樹脂硬化促進剤)であって、例えば、有機リン系化合物、例えば、2-フェニル-4,5-ジヒドロキシメチルイミダゾール(2PHZ-PW)などのイミダゾール化合物などが挙げられる。好ましくは、イミダゾール化合物が挙げられる。硬化促進剤の配合部数は、主剤100質量部に対して、例えば、0.05質量部以上であり、また、例えば、5質量部以下である。 The curing accelerator is a catalyst (thermosetting catalyst) (preferably an epoxy resin curing accelerator) that accelerates the curing of the main agent by heating, and is, for example, an organic phosphorus compound such as 2-phenyl-4,5 -Imidazole compounds such as dihydroxymethylimidazole (2PHZ-PW). Imidazole compounds are preferred. The amount of the curing accelerator compounded is, for example, 0.05 parts by mass or more and, for example, 5 parts by mass or less with respect to 100 parts by mass of the main agent.

なお、封止組成物は、上記した熱硬化性成分に加え、無機フィラー、熱可塑性成分、顔料、シランカップリング剤などの添加剤を含有することができる。 The encapsulating composition can contain additives such as inorganic fillers, thermoplastic components, pigments, and silane coupling agents in addition to the thermosetting components described above.

無機フィラーは、封止層5(後述)の強度を向上させて、封止層5に優れた靱性を付与する無機粒子である。無機フィラーの材料としては、例えば、石英ガラス、タルク、シリカ、アルミナ、窒化アルミニウム、窒化珪素、窒化ホウ素などの無機化合物が挙げられる。これらは、単独使用または2種以上併用することができる。好ましくは、シリカが挙げられる。 The inorganic filler is an inorganic particle that improves the strength of the sealing layer 5 (described later) and imparts excellent toughness to the sealing layer 5 . Examples of inorganic filler materials include inorganic compounds such as quartz glass, talc, silica, alumina, aluminum nitride, silicon nitride, and boron nitride. These can be used singly or in combination of two or more. Silica is preferred.

無機フィラーの形状は、特に限定されず、例えば、略球形状、略板形状、略針形状、不定形状などが挙げられる。好ましくは、略球形状が挙げられる。 The shape of the inorganic filler is not particularly limited, and examples thereof include a substantially spherical shape, a substantially plate shape, a substantially needle shape, and an irregular shape. A substantially spherical shape is preferred.

無機フィラーの最大長さの平均値(略球形状であれば、平均粒子径)Mは、例えば、50μm以下、好ましくは、20μm以下、より好ましくは、10μm以下であり、また、例えば、0.1μm以上、好ましくは、0.5μm以上である。なお、平均粒子径Mは、例えば、レーザー散乱法における粒度分布測定法によって求められた粒度分布に基づいて、D50値(累積50%メジアン径)として求められる。 The average maximum length of the inorganic filler (average particle diameter in the case of a substantially spherical shape) M is, for example, 50 μm or less, preferably 20 μm or less, more preferably 10 μm or less. It is 1 μm or more, preferably 0.5 μm or more. The average particle diameter M is obtained as a D50 value (cumulative 50% median diameter) based on a particle size distribution determined by a particle size distribution measurement method in laser scattering, for example.

また、無機フィラーは、第1フィラーと、第1フィラーの最大長さの平均値M1より小さい最大長さの平均値M2を有する第2フィラーとを含むことができる。 In addition, the inorganic filler may include a first filler and a second filler having an average maximum length M2 smaller than the average maximum length M1 of the first filler.

第1フィラーの最大長さの平均値(略球形状であれば、平均粒子径)M1は、例えば、1μm以上、好ましくは、3μm以上であり、また、例えば、50μm以下、好ましくは、30μm以下である。 The average maximum length of the first filler (average particle diameter in the case of a substantially spherical shape) M1 is, for example, 1 μm or more, preferably 3 μm or more, and is, for example, 50 μm or less, preferably 30 μm or less. is.

第2フィラーの最大長さの平均値(略球形状であれば、平均粒子径)M2は、例えば、1μm未満、好ましくは、0.8μm以下であり、また、例えば、0.01μm以上、好ましくは、0.1μm以上である。 The average maximum length of the second filler (average particle size in the case of a substantially spherical shape) M2 is, for example, less than 1 μm, preferably 0.8 μm or less, and, for example, 0.01 μm or more, preferably is 0.1 μm or more.

第1フィラーの最大長さの平均値の、第2フィラーの最大長さの平均値に対する比(M1/M2)は、例えば、2以上、好ましくは、5以上であり、また、例えば、50以下、好ましくは、20以下である。 The ratio (M1/M2) of the average maximum length of the first filler to the average maximum length of the second filler (M1/M2) is, for example, 2 or more, preferably 5 or more, and, for example, 50 or less. , preferably 20 or less.

第1フィラーおよび第2フィラーの材料は、ともに同一あるいは相異っていてもよい。 The materials of the first filler and the second filler may be the same or different.

さらに、無機フィラーは、その表面が、部分的あるいは全体的に、シランカップリング剤などで表面処理されていてもよい。 Furthermore, the surface of the inorganic filler may be partially or wholly treated with a silane coupling agent or the like.

無機フィラーが上記した第1フィラーと第2フィラーとを含む場合には、第1フィラーの割合は、封止組成物中、例えば、40質量%以上、好ましくは、50質量%超過であり、また、例えば、80質量%以下、好ましくは、70質量%以下、より好ましくは、60質量%以下である。第2フィラーの配合部数は、第1フィラー100質量部に対して、例えば、40質量部以上、好ましくは、50質量部以上であり、また、例えば、70質量部以下、好ましくは、60質量部以下である。 When the inorganic filler contains the first filler and the second filler described above, the proportion of the first filler in the sealing composition is, for example, 40% by mass or more, preferably more than 50% by mass, and , for example, 80% by mass or less, preferably 70% by mass or less, more preferably 60% by mass or less. The amount of the second filler compounded is, for example, 40 parts by mass or more, preferably 50 parts by mass or more, and for example, 70 parts by mass or less, preferably 60 parts by mass, with respect to 100 parts by mass of the first filler. It is below.

無機フィラーの割合は、封止組成物中、例えば、50質量%以上、好ましくは、65質量%以上、より好ましくは、70質量%以上、さらに好ましくは、75質量%以上であり、また、例えば、95質量%以下、好ましくは、90質量%以下である。 The proportion of the inorganic filler in the sealing composition is, for example, 50% by mass or more, preferably 65% by mass or more, more preferably 70% by mass or more, and still more preferably 75% by mass or more. , 95% by mass or less, preferably 90% by mass or less.

熱可塑性成分は、電子素子4を封止するときの電子素子封止用シート1における柔軟性を向上させる成分である。熱可塑性成分は、例えば、熱可塑性樹脂である。 The thermoplastic component is a component that improves the flexibility of the electronic element sealing sheet 1 when the electronic element 4 is sealed. A thermoplastic component is, for example, a thermoplastic resin.

熱可塑性樹脂としては、例えば、天然ゴム、ブチルゴム、イソプレンゴム、クロロプレンゴム、エチレン-酢酸ビニル共重合体、エチレン-アクリル酸共重合体、エチレン-アクリル酸エステル共重合体、ポリブタジエン樹脂、ポリカーボネート樹脂、熱可塑性ポリイミド樹脂、ポリアミド樹脂(6-ナイロンや6,6-ナイロンなど)、フェノキシ樹脂、アクリル樹脂、飽和ポリエステル樹脂(PETなど)、ポリアミドイミド樹脂、フッ素樹脂、スチレン-イソブチレン-スチレンブロック共重合体などが挙げられる。これら熱可塑性樹脂は、単独使用または2種以上併用することができる。 Examples of thermoplastic resins include natural rubber, butyl rubber, isoprene rubber, chloroprene rubber, ethylene-vinyl acetate copolymer, ethylene-acrylic acid copolymer, ethylene-acrylic acid ester copolymer, polybutadiene resin, polycarbonate resin, Thermoplastic polyimide resin, polyamide resin (6-nylon, 6,6-nylon, etc.), phenoxy resin, acrylic resin, saturated polyester resin (PET, etc.), polyamideimide resin, fluorine resin, styrene-isobutylene-styrene block copolymer etc. These thermoplastic resins can be used alone or in combination of two or more.

熱可塑性樹脂として、好ましくは、主剤(好ましくは、エポキシ樹脂)との分散性を向上させる観点から、アクリル樹脂が挙げられる。 The thermoplastic resin is preferably an acrylic resin from the viewpoint of improving dispersibility with the main agent (preferably epoxy resin).

アクリル樹脂としては、例えば、直鎖または分岐のアルキル基を有する(メタ)アクリル酸アルキルエステルと、その他のモノマー(共重合性モノマー)とを含むモノマー成分を重合してなる、カルボキシル基含有(メタ)アクリル酸エステルコポリマー(好ましくは、カルボキシル基含有アクリル酸エステルコポリマー)などが挙げられる。 As the acrylic resin, for example, a carboxyl group-containing (meta ) acrylic acid ester copolymers (preferably carboxyl group-containing acrylic acid ester copolymers), and the like.

アルキル基としては、例えば、メチル、エチル、プロピル、イソプロピル、n-ブチル、t-ブチル、イソブチル、ペンチル、ヘキシルなどの炭素数1~6のアルキル基などが挙げられる。 Examples of alkyl groups include alkyl groups having 1 to 6 carbon atoms such as methyl, ethyl, propyl, isopropyl, n-butyl, t-butyl, isobutyl, pentyl and hexyl.

その他のモノマーとしては、例えば、アクリル酸、メタクリル酸、カルボキシエチルアクリレート、カルボキシペンチルアクリレート、イタコン酸、マレイン酸、フマール酸、クロトン酸などのカルボキシル基含有モノマーなどが挙げられる。 Examples of other monomers include carboxyl group-containing monomers such as acrylic acid, methacrylic acid, carboxyethyl acrylate, carboxypentyl acrylate, itaconic acid, maleic acid, fumaric acid and crotonic acid.

熱可塑性成分の重量平均分子量は、例えば、10万以上、好ましくは、30万以上であり、また、例えば、100万以下、好ましくは、90万以下である。なお、重量平均分子量は、ゲル浸透クロマトフラフィー(GPC)により、標準ポリスチレン換算値に基づいて測定される。 The weight average molecular weight of the thermoplastic component is, for example, 100,000 or more, preferably 300,000 or more, and is, for example, 1,000,000 or less, preferably 900,000 or less. The weight average molecular weight is measured by gel permeation chromatography (GPC) based on standard polystyrene conversion values.

熱可塑性成分の割合(固形分割合)は、封止組成物の熱硬化を阻害しないように調整されており、具体的には、封止組成物に対して、例えば、1質量%以上、好ましくは、2質量%以上であり、また、例えば、10質量%以下、好ましくは、5質量%以下である。なお、熱可塑性成分は、適宜の溶媒で希釈されて調製されていてもよい。 The ratio of the thermoplastic component (solid content ratio) is adjusted so as not to hinder the thermosetting of the sealing composition. is 2% by mass or more, and is, for example, 10% by mass or less, preferably 5% by mass or less. In addition, the thermoplastic component may be prepared by being diluted with an appropriate solvent.

顔料としては、例えば、カーボンブラックなどの黒色顔料が挙げられる。顔料の平均粒子径は、例えば、0.001μm以上、例えば、1μm以下である。顔料の割合は、封止組成物に対して、例えば、0.1質量%以上、また、例えば、2質量%以下である。 Pigments include, for example, black pigments such as carbon black. The average particle size of the pigment is, for example, 0.001 μm or more and, for example, 1 μm or less. The proportion of the pigment is, for example, 0.1% by mass or more and, for example, 2% by mass or less, relative to the sealing composition.

シランカップリング剤としては、例えば、エポキシ基を含有するシランカップリング剤が挙げられる。エポキシ基を含有するシランカップリング剤としては、例えば、3-グリシドキシプロピルメチルジメトキシシラン、3-グリシドキシプロピルメチルジエトキシシランなどの3-グリシドキシジアルキルジアルコキシシラン、例えば、3-グリシドキシプロピルトリメトキシシラン、3-グリシドキシプロピルトリエトキシシランなどの3-グリシドキシアルキルトリアルコキシシランが挙げられる。好ましくは、3-グリシドキシアルキルトリアルコキシシランが挙げられる。シランカップリング剤の配合割合は、無機フィラー100質量部に対して、例えば、0.1質量部以上、好ましくは、1質量部以上であり、また、例えば、10質量部以下、好ましくは、5質量部以下である。 Silane coupling agents include, for example, silane coupling agents containing epoxy groups. Silane coupling agents containing an epoxy group include, for example, 3-glycidoxydialkyldialkoxysilanes such as 3-glycidoxypropylmethyldimethoxysilane and 3-glycidoxypropylmethyldiethoxysilane; 3-glycidoxyalkyltrialkoxysilanes such as glycidoxypropyltrimethoxysilane and 3-glycidoxypropyltriethoxysilane. Preferred is 3-glycidoxyalkyltrialkoxysilane. The mixing ratio of the silane coupling agent is, for example, 0.1 parts by mass or more, preferably 1 part by mass or more, and for example, 10 parts by mass or less, preferably 5 parts by mass, with respect to 100 parts by mass of the inorganic filler. Part by mass or less.

電子素子封止用シート1の厚みTは、例えば、0.25mm以上、好ましくは、0.27mm以上である。具体的には、電子素子封止用シート1の厚みTは、第1シート面6および第2シート面7間の距離(平均長さ)である。 The thickness T of the electronic element sealing sheet 1 is, for example, 0.25 mm or more, preferably 0.27 mm or more. Specifically, the thickness T of the electronic element encapsulating sheet 1 is the distance (average length) between the first sheet surface 6 and the second sheet surface 7 .

一方、電子素子封止用シート1の厚みTは、例えば、0.50mm未満、好ましくは、0.45mm以下、より好ましくは、0.40mm以下である。 On the other hand, the thickness T of the electronic element sealing sheet 1 is, for example, less than 0.50 mm, preferably 0.45 mm or less, more preferably 0.40 mm or less.

電子素子封止用シート1の直交方向(面方向)における形状は、特に限定されず、その大きさは、複数の電子素子4を埋設(封止)するとともに、複数の電子素子4から露出する基板2の第1基板面11(電子素子4の周囲の第1基板面11)に接触できるように、設定されている。具体的には、電子素子封止用シート1の面方向における長さ(電子素子封止用シート1が平面視矩形状であれば、最大長さとなる1辺の長さ)は、例えば、1mm以上であり、また、例えば、500mm以下である。 The shape of the electronic element encapsulating sheet 1 in the orthogonal direction (plane direction) is not particularly limited, and the size of the electronic element encapsulating sheet 1 is such that the plurality of electronic elements 4 are embedded (sealed) and exposed from the plurality of electronic elements 4. It is set so as to be in contact with the first substrate surface 11 of the substrate 2 (the first substrate surface 11 around the electronic element 4). Specifically, the length in the surface direction of the sheet 1 for encapsulating an electronic element (the length of one side that is the maximum length when the sheet 1 for encapsulating an electronic element is rectangular in plan view) is, for example, 1 mm. or more, and for example, 500 mm or less.

電子素子封止用シート1を製造するには、まず、封止組成物を調製する。具体的には、上記した成分を配合して、それらを混合して、封止組成物を調製する。好ましくは、上記した各成分(および必要により溶媒(ケトン、アルコールなど)を配合および混合して、ワニスを調製する。その後、ワニスを、図示しない剥離シートに塗布し、乾燥させて、電子素子封止用シート1を得る。なお、ワニスを調製せず、混練押出によって、封止組成物から電子素子封止用シート1を形成することもできる。 In order to manufacture the sheet 1 for electronic element encapsulation, first, a sealing composition is prepared. Specifically, the components described above are blended and mixed to prepare a sealing composition. Preferably, each component described above (and if necessary, a solvent (ketone, alcohol, etc.) are blended and mixed to prepare a varnish. After that, the varnish is applied to a release sheet (not shown) and dried to seal the electronic element. A sealing sheet 1 is obtained.The electronic element encapsulating sheet 1 can also be formed from the encapsulating composition by kneading and extruding without preparing the varnish.

これによって、電子素子封止用シート1は、封止組成物から1層として形成される。 By this, the sheet|seat 1 for electronic element sealing is formed as 1 layer from a sealing composition.

電子素子封止用シート1は、熱硬化性成分を含有する場合には、例えば、Bステージである。 The sheet 1 for electronic element sealing is B stage, for example, when it contains a thermosetting component.

(電子素子装置の製造方法)
次に、電子素子封止用シート1を用いて、電子素子装置3を製造する方法を説明する。
(Manufacturing method of electronic element device)
Next, a method for manufacturing the electronic element device 3 using the electronic element encapsulating sheet 1 will be described.

この製造方法は、電子素子封止用シート1および電子素子4を準備する準備工程(図1参照)、および、電子素子封止用シート1を使用して電子素子4を封止して、封止層5を形成する封止工程(図2参照)を備える。 This manufacturing method includes a preparatory step (see FIG. 1) of preparing the electronic element sealing sheet 1 and the electronic element 4, and sealing the electronic element 4 using the electronic element sealing sheet 1 to seal the electronic element 4. A sealing step (see FIG. 2) for forming the stopping layer 5 is provided.

(準備工程)
図1に示すように、準備工程では、上記した電子素子封止用シート1(好ましくは、Bステージの電子素子封止用シート1)を準備する。別途、図1の仮想線で示すように、準備工程では、基板2に実装された電子素子4を準備する。
(Preparation process)
As shown in FIG. 1, in the preparation step, the electronic element encapsulating sheet 1 (preferably B-stage electronic element encapsulating sheet 1) is prepared. Separately, as indicated by the phantom lines in FIG. 1, in the preparation step, the electronic element 4 mounted on the substrate 2 is prepared.

電子素子4は、基板2の第1基板面11(後述)において、互いに間隔を隔てて複数配置されている。複数の電子素子4のそれぞれは、面方向に延びる略平板形状を有する。具体的には、複数の電子素子4のそれぞれは、第1素子面8、第2素子面9、および、素子周側面10を連続して備える。 A plurality of electronic elements 4 are arranged at intervals on a first substrate surface 11 (described later) of the substrate 2 . Each of the plurality of electronic elements 4 has a substantially flat plate shape extending in the plane direction. Specifically, each of the plurality of electronic elements 4 has a first element surface 8, a second element surface 9, and an element peripheral side surface 10 in succession.

第1素子面8および第2素子面9は、厚み方向に互いに間隔を隔てられており、互いに平行する平面である。 The first element surface 8 and the second element surface 9 are planes that are spaced apart from each other in the thickness direction and parallel to each other.

素子周側面10は、第1素子面8および第2素子面9の周端縁を厚み方向に連結する。素子周側面10は、厚み方向に延びており、より具体的には、素子周側面10は、面方向に直交する。 The element peripheral side surface 10 connects the peripheral edges of the first element surface 8 and the second element surface 9 in the thickness direction. The element peripheral side surface 10 extends in the thickness direction, and more specifically, the element peripheral side surface 10 is perpendicular to the surface direction.

電子素子4としては、特に限定されず、種々の電子素子が挙げられ、例えば、中空型電子素子、半導体素子などが挙げられる。電子素子4は、基板2の第1基板面11に対向するように複数実装されている。具体的には、複数の電子素子4は、基板2に対してフリップチップ実装されている。この場合には、複数の電子素子4の第2素子面9に設けられる電極(図示せず)が、基板2の第1基板面11に設けられる端子(図示せず)と電気的に接続される。また、電子素子4の基板2に対して、図示しない接着層(ダイボンディングフィルムなど)を介してダイボンディングされていてもよい。 The electronic element 4 is not particularly limited, and includes various electronic elements such as hollow electronic elements and semiconductor elements. A plurality of electronic elements 4 are mounted so as to face the first substrate surface 11 of the substrate 2 . Specifically, the plurality of electronic elements 4 are flip-chip mounted on the substrate 2 . In this case, electrodes (not shown) provided on the second element surface 9 of the plurality of electronic elements 4 are electrically connected to terminals (not shown) provided on the first substrate surface 11 of the substrate 2. be. Alternatively, the electronic element 4 may be die-bonded to the substrate 2 via an adhesive layer (die-bonding film or the like) not shown.

電子素子4の材料としては、特に限定されず、例えば、シリコンなどの硬質材料が挙げられる。 The material of the electronic element 4 is not particularly limited, and examples thereof include hard materials such as silicon.

電子素子4の厚みt2は、例えば、0.05mm以上、好ましくは、0.10mm以上であり、また、例えば、0.5mm以下、好ましくは、0.4mm以下、より好ましくは、0.3mm以下である。電子素子4の厚みt2は、第1素子面8および第2素子面9間の距離である。 The thickness t2 of the electronic element 4 is, for example, 0.05 mm or more, preferably 0.10 mm or more, and is, for example, 0.5 mm or less, preferably 0.4 mm or less, more preferably 0.3 mm or less. is. A thickness t<b>2 of the electronic element 4 is the distance between the first element surface 8 and the second element surface 9 .

電子素子4の厚みt2が上記した上限以下であれば、電子素子装置3が厚みの制限を受けることを予め抑制することができる。 If the thickness t2 of the electronic element 4 is equal to or less than the above-described upper limit, it is possible to prevent the electronic element device 3 from being restricted in thickness.

一方、電子素子4の厚みt2が上記した下限以上であれば、電子素子4の素子周側面10が封止層5に接触する面積を十分に確保して、封止層5による封止層を向上させることができる。 On the other hand, if the thickness t2 of the electronic element 4 is equal to or greater than the above-described lower limit, the area where the element peripheral side surface 10 of the electronic element 4 contacts the sealing layer 5 is sufficiently ensured, and the sealing layer by the sealing layer 5 is formed. can be improved.

電子素子4の面方向長さ(電子素子4が平面視矩形状であれば、4辺における最大長さ)は、電子素子4が基板2の第1基板面11に固定される長さ(ひいては、面積)が確保されれば、特に限定されず、例えば、0.01mm以上、好ましくは、0.1mm以上であり、また、例えば、10mm以下、好ましくは、1mm以下である。 The surface direction length of the electronic element 4 (if the electronic element 4 has a rectangular shape in plan view, the maximum length of the four sides) is the length at which the electronic element 4 is fixed to the first substrate surface 11 of the substrate 2 (and thus , area) is not particularly limited, and is, for example, 0.01 mm or more, preferably 0.1 mm or more, and for example, 10 mm or less, preferably 1 mm or less.

また、隣り合う電子素子4間の間隔は、かかる間隔に電子素子封止用シート1が充填され、基板2の第1基板面11に接触できれば、特に限定されず、例えば、0.01mm以上、好ましくは、0.1mm以上であり、また、例えば、10mm以下、好ましくは、1mm以下である。 In addition, the interval between the adjacent electronic elements 4 is not particularly limited as long as the electronic element encapsulating sheet 1 is filled in such an interval and can be in contact with the first substrate surface 11 of the substrate 2. For example, 0.01 mm or more, It is preferably 0.1 mm or more and, for example, 10 mm or less, preferably 1 mm or less.

基板2は、電子素子4とともに、電子素子実装基板13に備えられる。つまり、電子素子実装基板13は、複数の電子素子4と、複数の電子素子4を実装する基板2とを備える。好ましくは、電子素子実装基板13は、複数の電子素子4と、基板2とのみからなる。 The substrate 2 is provided on the electronic device mounting substrate 13 together with the electronic device 4 . That is, the electronic element mounting board 13 includes a plurality of electronic elements 4 and a substrate 2 on which the plurality of electronic elements 4 are mounted. Preferably, the electronic device mounting board 13 consists of the plurality of electronic devices 4 and the substrate 2 only.

基板2は、面方向に延びる略平板形状を有する。基板2は、平面視において、複数の電子素子4を囲む大きさを有する。基板2は、厚み方向一方面である第1基板面11と、厚み方向他方面である第2基板面12を備える。 The substrate 2 has a substantially flat plate shape extending in the plane direction. The substrate 2 has a size surrounding the plurality of electronic elements 4 in plan view. The substrate 2 has a first substrate surface 11 that is one surface in the thickness direction and a second substrate surface 12 that is the other surface in the thickness direction.

第1基板面11は、厚み方向一方側に露出する。第1基板面11には、電子素子4とのフリップチップ実装に供される端子(図示せず)が設けられている。 The first substrate surface 11 is exposed on one side in the thickness direction. The first substrate surface 11 is provided with terminals (not shown) for flip-chip mounting with the electronic element 4 .

第2基板面12は、第1基板面11に平行する平面である。 The second substrate surface 12 is a plane parallel to the first substrate surface 11 .

基板2の材料としては、特に限定されず、例えば、樹脂、セラミック(アルミナなど)、金属などが挙げられる。好ましくは、低い線膨張率を確保する観点から、セラミックが挙げられる。 Materials for the substrate 2 are not particularly limited, and examples thereof include resins, ceramics (alumina, etc.), and metals. Ceramic is preferable from the viewpoint of ensuring a low coefficient of linear expansion.

基板2の厚みt3は、特に限定されず、例えば、10μm以上、例えば、1,000μm以下、好ましくは、500μm以下である。 The thickness t3 of the substrate 2 is not particularly limited, and is, for example, 10 μm or more, 1,000 μm or less, preferably 500 μm or less.

(封止工程)
封止工程では、図1の矢印および図2に示すように、次いで、電子素子封止用シート1を使用して電子素子4を封止する。
(sealing process)
In the sealing step, the electronic element 4 is then sealed using the electronic element sealing sheet 1 as shown by the arrow in FIG. 1 and FIG. 2 .

例えば、電子素子封止用シート1を、電子素子実装基板13に対して熱プレスする。熱プレスの温度、時間、圧力は、特に限定されない。この熱プレスによって、電子素子封止用シート1(とくに、第2シート面7)が、変形する。 For example, the electronic element encapsulating sheet 1 is hot-pressed onto the electronic element mounting board 13 . The temperature, time and pressure of hot pressing are not particularly limited. By this hot pressing, the electronic element encapsulating sheet 1 (in particular, the second sheet surface 7) is deformed.

すると、電子素子封止用シート1の第2シート面7が、電子素子4の第1素子面8および素子周側面10と、基板2において電子素子4の周囲の第1基板面11とに接触して、電子素子封止用シート1が、電子素子4を埋設する。 Then, the second sheet surface 7 of the electronic element sealing sheet 1 comes into contact with the first element surface 8 and the element peripheral side surface 10 of the electronic element 4 and the first substrate surface 11 around the electronic element 4 on the substrate 2. Then, the electronic element encapsulating sheet 1 embeds the electronic element 4 .

上記した熱プレスの後、電子素子封止用シート1の材料が熱硬化性成分を含有し、電子素子封止用シート1がBステージであれば、電子素子封止用シート1を加熱して、完全硬化(Cステージ化)させる。これにより、電子素子封止用シート1から封止層5を形成する。 After the hot pressing described above, if the material of the electronic element encapsulating sheet 1 contains a thermosetting component and the electronic element encapsulating sheet 1 is in the B stage, the electronic element encapsulating sheet 1 is heated. , completely hardened (to C stage). Thereby, the sealing layer 5 is formed from the electronic element sealing sheet 1 .

図2の太い仮想線で示すように、その後、電子素子装置3において、電子素子4の周囲の基板2および封止層5をダイシングする。例えば、基板2の第2基板面12に仮想線で示すダイシングテープ14を配置し、その後、ダイシングソー(図示せず)によって、隣り合う電子素子4間における基板2および封止層5を、面方向に沿って切断する。併せて、電子素子4の外側における基板2および封止層5を、面方向に沿って切断する(つまり、外形加工する)。 As indicated by thick virtual lines in FIG. 2, in the electronic device device 3, the substrate 2 and the sealing layer 5 around the electronic device 4 are then diced. For example, a dicing tape 14 shown in phantom lines is placed on the second substrate surface 12 of the substrate 2, and then the substrate 2 and the sealing layer 5 between the adjacent electronic elements 4 are cut by a dicing saw (not shown). Cut along the direction. At the same time, the substrate 2 and the sealing layer 5 on the outside of the electronic element 4 are cut along the surface direction (that is, the outer shape is processed).

これによって、基板2と、1つの電子素子4と、封止層5とを備える電子素子装置3を得る。電子素子装置3は、好ましくは、基板2と、電子素子4と、封止層5とのみからなる。 Thus, the electronic element device 3 including the substrate 2, one electronic element 4, and the sealing layer 5 is obtained. The electronic device device 3 preferably consists of only the substrate 2 , the electronic device 4 and the sealing layer 5 .

電子素子装置3において、電子素子4は、基板2および封止層5によって、外部との連通が遮断される。つまり、電子素子4が外部に対して遮蔽される。換言すれば、複数の電子素子4が、封止層5によって封止される。 In the electronic element device 3 , the electronic element 4 is blocked from communication with the outside by the substrate 2 and the sealing layer 5 . That is, the electronic element 4 is shielded from the outside. In other words, a plurality of electronic elements 4 are encapsulated by the encapsulation layer 5 .

図2(の仮想線)に示すように、封止層5は、第1封止面15と、第2封止面16と、封止周側面21とを備える。 As shown in FIG. 2 (phantom lines), the sealing layer 5 includes a first sealing surface 15 , a second sealing surface 16 , and a sealing peripheral side surface 21 .

第1封止面15は、電子素子封止用シート1の第1シート面6から形成される。第1封止面15は、面方向に沿う平面である。 The first sealing surface 15 is formed from the first sheet surface 6 of the electronic element sealing sheet 1 . The first sealing surface 15 is a plane along the surface direction.

第2封止面16は、電子素子封止用シート1の第2シート面7から形成されており、断面視において、厚み方向他方側に開く略U字(略ハット)形状を有する。具体的には、第2封止面16は、電子素子4に接触する素子接触面17と、基板2に接触する基板接触面18とを連続して備える。 The second sealing surface 16 is formed from the second sheet surface 7 of the electronic element encapsulating sheet 1, and has a substantially U-shaped (substantially hat) shape that opens to the other side in the thickness direction in a cross-sectional view. Specifically, the second sealing surface 16 includes an element contact surface 17 that contacts the electronic element 4 and a substrate contact surface 18 that contacts the substrate 2 in succession.

素子接触面17は、電子素子4の素子第1面8および素子周側面10の両面に接触(密着)している。つまり、素子接触面17は、電子素子4に対応する形状を有する。詳しくは、素子接触面17は、第1素子面8に接触する第3封止面19と、素子周側面10に接触する第4封止面20とを連続して備える。 The element contact surface 17 is in contact with (adheres to) both the element first surface 8 and the element peripheral side surface 10 of the electronic element 4 . That is, the element contact surface 17 has a shape corresponding to the electronic element 4 . Specifically, the element contact surface 17 continuously includes a third sealing surface 19 that contacts the first element surface 8 and a fourth sealing surface 20 that contacts the element peripheral side surface 10 .

第3封止面19は、平面視において、電子素子4の第1素子面8と同一形状を有する。 The third sealing surface 19 has the same shape as the first element surface 8 of the electronic element 4 in plan view.

第4封止面20は、第3封止面20の周端縁から厚み方向他方側に延びる内側面である。第4封止面20は、側面視において、電子素子4の素子周側面10と同一形状を有する。 The fourth sealing surface 20 is an inner surface extending from the peripheral edge of the third sealing surface 20 to the other side in the thickness direction. The fourth sealing surface 20 has the same shape as the element peripheral side surface 10 of the electronic element 4 in a side view.

基板接触面18は、第4封止面20の厚み方向他端縁に連続しており、第4封止面20の厚み方向他端縁から面方向外側に延びる形状を有する。基板接触面18は、基板2において電子素子4の周囲の第1基板面11に対して接触(密着)している。そのため、基板接触面18は、基板2において電子素子4の周囲の第1基板面11と同一の平面形状を有する。 The substrate contact surface 18 is continuous with the other edge in the thickness direction of the fourth sealing surface 20 and has a shape extending outward in the surface direction from the other edge in the thickness direction of the fourth sealing surface 20 . The substrate contact surface 18 is in contact (close contact) with the first substrate surface 11 surrounding the electronic element 4 on the substrate 2 . Therefore, the substrate contact surface 18 has the same planar shape as the first substrate surface 11 surrounding the electronic element 4 on the substrate 2 .

封止周側面21は、第1封止面15と第2封止面16(基板接触面18)の周端縁を連結する周面である。封止周側面21は、厚み方向に延びる形状を有する。なお、封止周側面21と、第1封止側面15とのなす角度は、例えば、60度以上、好ましくは、80度以上であり、また、例えば、120度以下、好ましくは、100度以下であり、最も好ましくは、90度(直角)である。 The sealing peripheral side surface 21 is a peripheral surface that connects peripheral edges of the first sealing surface 15 and the second sealing surface 16 (substrate contact surface 18). The sealing peripheral side surface 21 has a shape extending in the thickness direction. The angle formed by the sealing peripheral side surface 21 and the first sealing side surface 15 is, for example, 60 degrees or more, preferably 80 degrees or more, and is, for example, 120 degrees or less, preferably 100 degrees or less. and most preferably 90 degrees (perpendicular).

封止層5の厚みt1は、電子素子4の厚み方向一方面8に接触する部分の厚み、つまり、封止層5における最小厚みであり、例えば、0.15mm以上、好ましくは、0.17mm以上、より好ましくは、0.19mm以上、さらに好ましくは、0.20mm以上であり、また、例えば、0.50mm以下、好ましくは、0.40mm以下、より好ましくは、0.35mm以下である。上記した封止層5の厚みt1は、第1封止面15と、第3封止面19との間の厚み方向における距離である。 The thickness t1 of the sealing layer 5 is the thickness of the portion in contact with the one side 8 in the thickness direction of the electronic element 4, that is, the minimum thickness of the sealing layer 5, and is, for example, 0.15 mm or more, preferably 0.17 mm. Above, more preferably 0.19 mm or more, still more preferably 0.20 mm or more, and for example, 0.50 mm or less, preferably 0.40 mm or less, more preferably 0.35 mm or less. The thickness t1 of the sealing layer 5 described above is the distance in the thickness direction between the first sealing surface 15 and the third sealing surface 19 .

封止層5の厚みt1が上記した下限以上であれば、封止層5による電子素子4の確実な封止を図ることができる。具体的には、電子素子4の厚み方向一方面8に接触する封止層5の損傷や欠損(図4Aの仮想線の符号22参照)を抑制でき、そのため、封止層5による封止性を向上させることができる。 When the thickness t1 of the sealing layer 5 is equal to or greater than the above-described lower limit, the electronic element 4 can be reliably sealed by the sealing layer 5 . Specifically, it is possible to suppress damage or loss of the sealing layer 5 in contact with the one surface 8 in the thickness direction of the electronic element 4 (see the symbol 22 of the phantom line in FIG. 4A). can be improved.

封止層5の厚みt1が上記した上限以下であれば、電子素子装置3が過度に厚くなることを抑制して、電子素子装置3が厚みの制限を受けることを予め抑制(予防)することができる。また、封止層5の第1封止面15の周端部を所望の形状とすることができる。 If the thickness t1 of the sealing layer 5 is equal to or less than the above-described upper limit, the electronic element device 3 is prevented from becoming excessively thick, and the electronic element device 3 is previously suppressed (prevented) from being subject to thickness restrictions. can be done. Moreover, the peripheral end portion of the first sealing surface 15 of the sealing layer 5 can be formed into a desired shape.

封止層5の最大厚みは、上記した最小厚みt1と、電子素子4の厚みt2との合計(=t1+t2)であり、具体的には、第1封止面15と、基板接触面18との間の厚み方向における距離である。また、封止層5の最大厚みは、封止周側面21の厚み方向長さでもある。封止層5の最大厚み(t1+t2)は、例えば、0.25mm以上、好ましくは、0.30mm以上、より好ましくは、0.35mm以上であり、また、例えば、0.50mm以下、好ましくは、0.45mm以下である。 The maximum thickness of the sealing layer 5 is the sum of the minimum thickness t1 and the thickness t2 of the electronic element 4 (=t1+t2). is the distance in the thickness direction between The maximum thickness of the sealing layer 5 is also the length in the thickness direction of the sealing peripheral side surface 21 . The maximum thickness (t1+t2) of the sealing layer 5 is, for example, 0.25 mm or more, preferably 0.30 mm or more, more preferably 0.35 mm or more, and for example, 0.50 mm or less, preferably 0.45 mm or less.

封止層5の最大厚みが上記した下限以上であれば、電子素子3に対する封止性を向上させることができる。一方、封止層5の最大厚みが上記した上限以下であれば、薄型化が図られた電子素子装置3を製造することができる。 If the maximum thickness of the sealing layer 5 is equal to or more than the above-described lower limit, the sealing performance with respect to the electronic element 3 can be improved. On the other hand, if the maximum thickness of the sealing layer 5 is equal to or less than the above-described upper limit, it is possible to manufacture a thin electronic element device 3 .

また、封止層5の最大厚み(t1+t2)の、封止層5の最小厚みt1に対する比([t1+t2]/t1)は、例えば、1.4以上、好ましくは、1.7以上であり、また、例えば、2.2以下、好ましくは、2.0以下である。 Further, the ratio ([t1+t2]/t1) of the maximum thickness (t1+t2) of the sealing layer 5 to the minimum thickness t1 of the sealing layer 5 is, for example, 1.4 or more, preferably 1.7 or more, Also, for example, it is 2.2 or less, preferably 2.0 or less.

また、封止層5の最大厚み(t1+t2)の、電子素子用封止シート1の厚みTに対する比([t1+t2]/T)は、例えば、0.8以上、好ましくは1.0以上であり、また、例えば、1.6以下、好ましくは、1.4以下である。 Further, the ratio ([t1+t2]/T) of the maximum thickness (t1+t2) of the sealing layer 5 to the thickness T of the sealing sheet 1 for electronic elements is, for example, 0.8 or more, preferably 1.0 or more. , or, for example, 1.6 or less, preferably 1.4 or less.

そして、この電子素子装置3において、封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)は、0.7以上、2.3以下である。 In this electronic element device 3, the ratio (t1/t2) of the thickness t1 of the sealing layer 5 to the thickness t2 of the electronic element 4 is 0.7 or more and 2.3 or less.

上記した比(t1/t2)が上記した0.7に満たなければ、後で詳しく述べるが、電子素子4の基板2からの剥離を抑制することができず、封止層5の第1封止面15の周端縁を所望の形状とすることができない。 If the above ratio (t1/t2) is less than the above 0.7, the separation of the electronic element 4 from the substrate 2 cannot be suppressed, and the first sealing of the sealing layer 5 will be described in detail later. The peripheral edge of the stop surface 15 cannot be formed into a desired shape.

一方、上記した比(t1/t2)が上記した2.3を超過すれば、後で詳しく述べるが、電子素子装置3の薄型化を図ることができず、電子素子4の基板2からの剥離を抑制することができない。 On the other hand, if the ratio (t1/t2) exceeds 2.3, the thickness of the electronic element device 3 cannot be reduced, and the electronic element 4 is peeled off from the substrate 2, as will be described in detail later. cannot be suppressed.

また、上記した比は、好ましくは、0.80以上、より好ましくは、0.90以上、さらに好ましくは、1.00以上である。また、上記した比は、好ましくは、2.00以下、より好ましくは、1.80以下、さらに好ましくは、1.70以下、とりわけ好ましくは、1.50以下である。上記した比(t1/t2)が上記した下限を上回れば、電子素子4の基板2からの剥離を抑制することができ、併せて、封止層5の第1封止面15の周端縁を所望の形状とすることができる。一方、上記した比(t1/t2)が上記した上限を下回れば、電子素子装置3の薄型化を図ることができ、併せて、電子素子4の基板2からの剥離を抑制することができる。 Also, the above ratio is preferably 0.80 or more, more preferably 0.90 or more, and still more preferably 1.00 or more. Also, the above ratio is preferably 2.00 or less, more preferably 1.80 or less, even more preferably 1.70 or less, and most preferably 1.50 or less. If the above ratio (t1/t2) exceeds the above lower limit, it is possible to suppress the peeling of the electronic element 4 from the substrate 2, and at the same time, the peripheral edge of the first sealing surface 15 of the sealing layer 5 can be of any desired shape. On the other hand, if the ratio (t1/t2) is below the upper limit, the thickness of the electronic element device 3 can be reduced, and at the same time, the separation of the electronic element 4 from the substrate 2 can be suppressed.

封止層5の基板接触面18の面方向における長さLは、その最短距離として、例えば、0.01mm以上、好ましくは、0.02mm以上であり、また、例えば、1.0mm以下、好ましくは、0.5mm以下である。なお、基板接触面18における長さLは、電子素子4の第2素子面9の周端縁から、封止周側面21の厚み方向他端縁までの距離Lであり、また、第4封止面20の厚み方向他端縁から面方向外側に向かって進むときに、基板2の第1基板面11に対して基板接触面18が接触している接触長さLである。また、封止層5および電子素子4のそれぞれが平面視略矩形状であり、平面視において、封止層5の4つの封止周側面21のそれぞれが、電子素子4の4つの素子周側面10のそれぞれと平行する場合には、基板接触面18における長さLは、隣り合う封止周側面21および素子周側面10間における最短距離である。 The length L in the surface direction of the substrate contact surface 18 of the sealing layer 5 is, for example, 0.01 mm or more, preferably 0.02 mm or more, and preferably 1.0 mm or less, as the shortest distance. is 0.5 mm or less. The length L on the substrate contact surface 18 is the distance L from the peripheral edge of the second element surface 9 of the electronic element 4 to the other edge in the thickness direction of the sealing peripheral side surface 21. It is the contact length L that the substrate contact surface 18 is in contact with the first substrate surface 11 of the substrate 2 when proceeding from the other edge in the thickness direction of the stop surface 20 toward the outside in the surface direction. In addition, each of the sealing layer 5 and the electronic element 4 has a substantially rectangular shape in plan view, and in plan view, each of the four sealing peripheral side surfaces 21 of the sealing layer 5 corresponds to the four element peripheral side surfaces of the electronic element 4. 10 , the length L at the substrate contact surface 18 is the shortest distance between adjacent sealing peripheral side surfaces 21 and device peripheral side surfaces 10 .

封止層5の25℃の引張貯蔵弾性率E’は、例えば、5,000[N/mm]以上、好ましくは、9,000[N/mm]以上、より好ましくは、10,000[N/mm]以上、さらに好ましくは、13,000[N/mm]以上であり、また、例えば、20,000[N/mm]以下、好ましくは、15,000[N/mm]以下、より好ましくは、14,000[N/mm]以下である。なお、封止層5の25℃の引張貯蔵弾性率E’は、昇温速度:10℃/分、周波数:1Hzの動的粘弾性試験によって求められる。 The tensile storage modulus E′ of the sealing layer 5 at 25° C. is, for example, 5,000 [N/mm 2 ] or more, preferably 9,000 [N/mm 2 ] or more, more preferably 10,000. [N/mm 2 ] or more, more preferably 13,000 [N/mm 2 ] or more, and for example, 20,000 [N/mm 2 ] or less, preferably 15,000 [N/mm 2 ] or less, more preferably 14,000 [N/mm 2 ] or less. The tensile storage modulus E′ of the sealing layer 5 at 25° C. is determined by a dynamic viscoelasticity test with a heating rate of 10° C./min and a frequency of 1 Hz.

電子素子装置3の厚みT0は、電子素子装置3の使用の制限の観点から、例えば、0.80mm以下、より薄型の電子素子装置3を製造する観点から、好ましくは、0.70mm以下、より好ましくは、0.60mm以下であり、また、例えば、0.40mm以上である。電子素子装置3の厚みT0は、封止層5の厚みt1と、電子素子4の厚みt2と、基板2の厚みt3の合計(=t1+t2+t3)であり、また、基板2の第2基板面12と、封止層5の第1封止面15との厚み方向長さ(距離)である。 The thickness T0 of the electronic element device 3 is, for example, 0.80 mm or less from the viewpoint of limiting the use of the electronic element device 3, and preferably 0.70 mm or less or more from the viewpoint of manufacturing a thinner electronic device device 3. Preferably, it is 0.60 mm or less and, for example, 0.40 mm or more. The thickness T0 of the electronic element device 3 is the sum of the thickness t1 of the sealing layer 5, the thickness t2 of the electronic element 4, and the thickness t3 of the substrate 2 (=t1+t2+t3). and the thickness direction length (distance) between the sealing layer 5 and the first sealing surface 15 .

そして、[1]電子素子4の第1素子面8に配置される封止層5の厚みt1が過度に厚いために、上記した封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が、2.3を超える場合には、図5Aに示すように、上記した厚い封止層5を備える電子素子装置3の薄型化を図れない。 [1] Since the thickness t1 of the sealing layer 5 disposed on the first element surface 8 of the electronic element 4 is excessively thick, the thickness t1 of the sealing layer 5 described above with respect to the thickness t2 of the electronic element 4 If the ratio (t1/t2) exceeds 2.3, as shown in FIG. 5A, it is not possible to reduce the thickness of the electronic element device 3 having the thick sealing layer 5 described above.

また、[2]電子素子4の厚みt2が過度に薄いために、上記した封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が、2.3を超える場合には、電子素子4を埋設する薄い封止層5の、電子素子4の周側面に対する接触面積が過度に小さくなり、また、図5Bに示すように、断面視において、電子素子4を取り囲む略コ字形状(U字形状)(図2参照)ではなく、厚み方向他方面が平坦状に近似する形状になる。そのため、封止層5の電子素子4に対する拘束力(アンカー効果のような効果)が小さくなり、その結果、電子素子4の基板2からの剥離を抑制することができない。 [2] When the thickness t2 of the electronic element 4 is excessively thin and the ratio (t1/t2) of the thickness t1 of the sealing layer 5 to the thickness t2 of the electronic element 4 exceeds 2.3 5B, the contact area of the thin sealing layer 5 embedding the electronic element 4 with the peripheral side surface of the electronic element 4 becomes excessively small, and as shown in FIG. It does not have a U-shape (U-shape) (see FIG. 2), but has a shape in which the other side in the thickness direction approximates a flat shape. Therefore, the binding force (anchoring effect) of the sealing layer 5 to the electronic element 4 is reduced, and as a result, the peeling of the electronic element 4 from the substrate 2 cannot be suppressed.

しかし、この電子素子封止用シート1では、封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が、2.3以下であるので、[1]電子素子装置3の薄型化を図ることができる。併せて、[2]封止層5が、電子素子4の周側面に対する接触面積を十分に確保でき、また、図2に示すように、断面視において、電子素子4を取り囲む略コ字形状(U字形状)になることができる。そのため、封止層5の電子素子4に対する拘束力(アンカー効果のような効果)が発現され、その結果、電子素子4の基板2からの剥離を抑制することができる。 However, in this electronic element encapsulating sheet 1, the ratio (t1/t2) of the thickness t1 of the encapsulating layer 5 to the thickness t2 of the electronic element 4 is 2.3 or less. 3 can be made thinner. In addition, [2] the sealing layer 5 can ensure a sufficient contact area with the peripheral side surface of the electronic element 4, and as shown in FIG. U-shaped). Therefore, the sealing layer 5 exerts a restraining force (anchoring effect) on the electronic element 4 , and as a result, it is possible to suppress the separation of the electronic element 4 from the substrate 2 .

一方、[3]電子素子4の第1素子面8に配置される封止層5の厚みt1が過度に薄いために、上記した封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が、0.7に満たない場合には、図4Aに示すように、電子素子4の第1素子面8に配置される薄い封止層5が損傷や欠損し易く、そのため、封止性が低下し、その結果、電子素子4の基板2からの剥離を抑制することができない。 On the other hand, [3] Since the thickness t1 of the sealing layer 5 disposed on the first element surface 8 of the electronic element 4 is excessively thin, the thickness t1 of the sealing layer 5 described above with respect to the thickness t2 of the electronic element 4 When the ratio (t1/t2) is less than 0.7, as shown in FIG. 4A, the thin sealing layer 5 disposed on the first element surface 8 of the electronic element 4 is likely to be damaged or chipped. Therefore, the sealing property is deteriorated, and as a result, the separation of the electronic element 4 from the substrate 2 cannot be suppressed.

また、[4]電子素子4の厚みt2が過度に厚いために、上記した封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が、0.7に満たない場合には、電子素子封止用シート1が電子素子4に対してプレスされるときに、図4Bに示すように、厚い電子素子封止用シート1が、電子素子4の外側に向かって流れ易くなる。そのため、電子素子封止用シート1から形成される封止層5の周端部が所望の形状とならない。その結果、封止層5の形状安定性が低下する。 [4] Since the thickness t2 of the electronic element 4 is excessively large, the ratio (t1/t2) of the thickness t1 of the sealing layer 5 to the thickness t2 of the electronic element 4 is less than 0.7. In this case, when the electronic element encapsulating sheet 1 is pressed against the electronic element 4, the thick electronic element encapsulating sheet 1 flows toward the outside of the electronic element 4 as shown in FIG. 4B. becomes easier. Therefore, the peripheral edge portion of the sealing layer 5 formed from the electronic element sealing sheet 1 does not have a desired shape. As a result, the shape stability of the sealing layer 5 is lowered.

しかし、この電子素子封止用シート1では、電子素子4の厚みt2に対する比(t1/t2)が、0.7以上であるので、[3]電子素子4の第1素子面8に配置される封止層5の損傷や欠損を抑制でき、そのため、封止性の低下を抑制でき、その結果、電子素子4の基板2からの剥離を抑制することができる。併せて、[4]電子素子封止用シート1が電子素子4に対してプレスされるときに、電子素子封止用シート1が、電子素子4の外側に向かって流れ易くなることが抑制され、そのため、電子素子封止用シート1から形成される封止層5の周端部を所望の形状とすることができる。その結果、封止層5の形状安定性の低下を抑制することができる。 However, in this electronic element encapsulating sheet 1, the ratio (t1/t2) to the thickness t2 of the electronic element 4 is 0.7 or more. Damage or loss of the encapsulating layer 5 can be suppressed, and therefore deterioration of the sealing performance can be suppressed, and as a result, peeling of the electronic element 4 from the substrate 2 can be suppressed. In addition, [4] when the electronic element encapsulating sheet 1 is pressed against the electronic element 4, the electronic element encapsulating sheet 1 is prevented from easily flowing toward the outside of the electronic element 4. Therefore, the peripheral end portion of the sealing layer 5 formed from the electronic element sealing sheet 1 can be formed into a desired shape. As a result, deterioration in the shape stability of the sealing layer 5 can be suppressed.

従って、この電子素子封止用シート1によれば、電子素子4の基板2からの剥離を抑制することができるとともに、形状安定性に優れる封止層5を形成して、薄型化が図られた電子素子装置3を製造することができる。 Therefore, according to the electronic element encapsulating sheet 1, it is possible to suppress the separation of the electronic element 4 from the substrate 2, and to form the encapsulating layer 5 excellent in shape stability, thereby reducing the thickness. The electronic element device 3 can be manufactured.

また、封止層5の厚みt1が厚く、上記した合計(t1+t2)が0.25[mm]以上である場合には、厚い封止層5によって電子素子4を確実に封止できる。また、電子素子4の厚みt2が厚く、上記した合計(t1+t2)が0.25[mm]以上である場合には、電子素子4の素子周側面10に対する封止層5の接触面積を十分に確保できるので、かかる封止層5によって、電子素子4を確実に封止できる。 Further, when the thickness t1 of the sealing layer 5 is thick and the total (t1+t2) is 0.25 [mm] or more, the electronic element 4 can be reliably sealed with the thick sealing layer 5 . Further, when the thickness t2 of the electronic element 4 is thick and the above-mentioned total (t1+t2) is 0.25 [mm] or more, the contact area of the sealing layer 5 with the element peripheral side surface 10 of the electronic element 4 is sufficiently large. Since it can be secured, the electronic element 4 can be reliably sealed by the sealing layer 5 .

一方、封止層5の厚みt1が薄く、上記した合計(t1+t2)が0.50[mm]以下である場合、または、電子素子4の厚みt2が薄く、上記した合計(t1+t2)が0.50[mm]以下である場合には、薄型化が図られた電子素子装置3を製造することができる。 On the other hand, when the thickness t1 of the sealing layer 5 is thin and the total (t1+t2) is 0.50 [mm] or less, or when the thickness t2 of the electronic element 4 is thin and the total (t1+t2) is 0.50 [mm]. When it is 50 [mm] or less, it is possible to manufacture a thin electronic element device 3 .

この製造方法では、上記した電子素子封止用シート1を使用して、基板2に実装される電子素子を封止層5で確実に封止することができる。その結果、基板2、電子素子4および封止層5を備え、信頼性に優れる電子素子装置3を製造することができる。 In this manufacturing method, the electronic element mounted on the substrate 2 can be reliably sealed with the sealing layer 5 using the electronic element sealing sheet 1 described above. As a result, it is possible to manufacture the electronic element device 3 having the substrate 2, the electronic element 4 and the sealing layer 5 and having excellent reliability.

変形例
以下の各変形例において、上記した一実施形態と同様の部材および工程については、同一の参照符号を付し、その詳細な説明を省略する。また、各変形例は、特記する以外、一実施形態と同様の作用効果を奏することができる。さらに、一実施形態およびその変形例を適宜組み合わせることができる。
Modifications In each modification below, the same reference numerals are given to the same members and steps as in the above-described embodiment, and detailed description thereof will be omitted. Moreover, each modification can have the same effects as the one embodiment, unless otherwise specified. Furthermore, one embodiment and its modifications can be combined as appropriate.

一実施形態では、図1に示すように、電子素子実装基板13は、複数の電子素子4を備えるが、その数は、特に限定されず、例えば、図3Aに示すように、1つであってもよい。この場合においても、図3Bの太い仮想線で示すように、1つの電子素子4を備える電子素子装置3において、電子素子4の周囲の基板2および封止層5をダイシングして、電子素子装置3の平面視における大きさ(面方向長さ)を調整(外形加工)する。 In one embodiment, as shown in FIG. 1, the electronic element mounting board 13 includes a plurality of electronic elements 4, but the number is not particularly limited, and may be one, for example, as shown in FIG. 3A. may Even in this case, as shown by the thick virtual line in FIG. The size (surface direction length) of 3 in plan view is adjusted (outer shape processing).

以下に実施例および比較例を示し、本発明をさらに具体的に説明する。なお、本発明は、何ら実施例および比較例に限定されない。また、以下の記載において用いられる配合割合(含有割合)、物性値、パラメータなどの具体的数値は、上記の「発明を実施するための形態」において記載されている、それらに対応する配合割合(含有割合)、物性値、パラメータなど該当記載の上限(「以下」、「未満」として定義されている数値)または下限(「以上」、「超過」として定義されている数値)に代替することができる。 EXAMPLES Examples and comparative examples are shown below to describe the present invention more specifically. In addition, the present invention is not limited to Examples and Comparative Examples. In addition, specific numerical values such as the mixing ratio (content ratio), physical property values, and parameters used in the following description are the corresponding mixing ratios ( content ratio), physical properties, parameters, etc. can.

実施例および比較例で使用した各成分を以下に示す。 Components used in Examples and Comparative Examples are shown below.

エポキシ樹脂:新日鐵化学社製のYSLV-80XY(ビスフェノールF型エポキシ樹脂、高分子量エポキシ樹脂、エポキシ当量200g/eq.軟化点80℃)
硬化剤:群栄化学社製のLVR-8210DL(ノボラック型フェノール樹脂、エポキシ樹脂硬化剤、水酸基当量:104g/eq.、軟化点:60℃)
アクリル樹脂:根上工業社製のHME-2006M、カルボキシル基含有のアクリル酸エステルコポリマー(アクリル系ポリマー)、重量平均分子量:60万、ガラス転移温度(Tg):-35℃、固形分濃度20質量%のメチルエチルケトン溶液
硬化促進剤:四国化成工業社製の2PHZ-PW(2-フェニル-4,5-ジヒドロキシメチルイミダゾール)、エポキシ樹脂硬化促進剤
シランカップリング剤:信越化学社製のKBM-403(3-グリシドキシプロピルトリメトキシシラン)
カーボンブラック:三菱化学社製の#20
第1フィラー:FB-8SM(球状溶融シリカ粉末(無機フィラー)、平均粒子径7.0μm)
第2フィラー:アドマテックス社製のSC220G-SMJ(平均粒径0.5μm)を3-メタクリロキシプロピルトリメトキシシラン(信越化学社製の製品名:KBM-503)で表面処理した無機フィラー。無機フィラーの100質量部に対して1質量部のシランカップリング剤で表面処理したもの。
Epoxy resin: YSLV-80XY manufactured by Nippon Steel Chemical Co., Ltd. (bisphenol F type epoxy resin, high molecular weight epoxy resin, epoxy equivalent 200 g / eq. softening point 80 ° C.)
Curing agent: LVR-8210DL manufactured by Gun Ei Kagaku Co., Ltd. (novolac type phenolic resin, epoxy resin curing agent, hydroxyl equivalent: 104 g/eq., softening point: 60 ° C.)
Acrylic resin: HME-2006M manufactured by Negami Kogyo Co., Ltd., carboxyl group-containing acrylic acid ester copolymer (acrylic polymer), weight average molecular weight: 600,000, glass transition temperature (Tg): -35 ° C., solid content concentration 20% by mass Methyl ethyl ketone solution Curing accelerator: Shikoku Kasei Co., Ltd. 2PHZ-PW (2-phenyl-4,5-dihydroxymethylimidazole), epoxy resin curing accelerator Silane coupling agent: Shin-Etsu Chemical Co., Ltd. KBM-403 (3 -glycidoxypropyltrimethoxysilane)
Carbon black: #20 manufactured by Mitsubishi Chemical Corporation
First filler: FB-8SM (spherical fused silica powder (inorganic filler), average particle size 7.0 μm)
Second filler: an inorganic filler obtained by surface-treating SC220G-SMJ (average particle size 0.5 μm) manufactured by Admatechs with 3-methacryloxypropyltrimethoxysilane (product name: KBM-503 manufactured by Shin-Etsu Chemical Co., Ltd.). A surface treated with 1 part by mass of a silane coupling agent with respect to 100 parts by mass of the inorganic filler.

実施例1~実施例6および比較例1~比較例8
表1に記載の配合処方に従って、封止組成物を調製し、図1に示すように、この封止組成物から表1に記載の厚みTを有する電子素子封止用シート1を製造した。
Examples 1 to 6 and Comparative Examples 1 to 8
A sealing composition was prepared according to the formulation shown in Table 1, and an electronic element encapsulating sheet 1 having a thickness T shown in Table 1 was produced from this sealing composition as shown in FIG.

その後、図2に示すように、電子素子封止用シート1によって、複数の電子素子4を封止して、封止層5を形成した。 After that, as shown in FIG. 2 , a sealing layer 5 was formed by sealing a plurality of electronic elements 4 with the electronic element encapsulating sheet 1 .

具体的には、シリコンからなり、3mm角、表1に記載の厚みt2を有する電子素子4を複数準備し、これを、厚み20μmのダイボンディングフィルム(接着層)を介して、アルミナからなり、50mm角、厚みt3が0.22mmである基板2の第1基板面11にダイボンディングした。なお、隣り合う電子素子4間の間隔は、0.3mmであった。これにより、図1に示すように、複数の電子素子4と、基板2とを備える電子素子実装基板13を準備した。 Specifically, a plurality of electronic elements 4 made of silicon, 3 mm square, and having a thickness t2 shown in Table 1 are prepared, and this is made of alumina through a die bonding film (adhesive layer) having a thickness of 20 μm, It was die-bonded to the first substrate surface 11 of the substrate 2 having a size of 50 mm square and a thickness t3 of 0.22 mm. The interval between adjacent electronic elements 4 was 0.3 mm. Thus, as shown in FIG. 1, an electronic element mounting substrate 13 including a plurality of electronic elements 4 and the substrate 2 was prepared.

次いで、電子素子封止用シート1を電子素子実装基板13の厚み方向一方側に配置し、続いて、電子素子封止用シート1を電子素子実装基板1に対して、75℃、60秒、圧力100kPaの条件で真空プレスして、電子素子封止用シート1によって、複数の電子素子4を埋設した。その後、電子素子実装基板13および電子素子封止用シート1を150℃で1時間加熱して、電子素子封止用シート1をCステージ化した。これにより、図2に示すように、複数の電子素子4を封止する封止層5を形成した。 Next, the electronic element encapsulating sheet 1 is placed on one side in the thickness direction of the electronic element mounting board 13, and then the electronic element encapsulating sheet 1 is placed against the electronic element mounting board 1 at 75°C for 60 seconds. A plurality of electronic elements 4 were embedded with the electronic element encapsulating sheet 1 by vacuum pressing at a pressure of 100 kPa. After that, the electronic element mounting substrate 13 and the electronic element encapsulating sheet 1 were heated at 150° C. for 1 hour to bring the electronic element encapsulating sheet 1 into a C-stage. Thereby, as shown in FIG. 2, a sealing layer 5 for sealing a plurality of electronic elements 4 was formed.

その後、図2の太い仮想線で示すように、複数の電子素子4のそれぞれの周囲における封止層5および基板2をダイシングした。これにより、基板2、電子素子4、および封止層5を備える電子素子装置(電子素子パッケージ)3を製造した。基板接触面18における長さ(平均長さ)Lは、0.15mmであった。 After that, as indicated by thick virtual lines in FIG. 2, the sealing layer 5 and the substrate 2 around each of the plurality of electronic elements 4 were diced. Thus, an electronic element device (electronic element package) 3 including the substrate 2, the electronic element 4, and the sealing layer 5 was manufactured. The length (average length) L at the substrate contact surface 18 was 0.15 mm.

(評価)
下記の項目を評価した。それらの結果を表1に記載する。
(evaluation)
The following items were evaluated. The results are listed in Table 1.

(封止層の厚み)
封止層5の厚みt1をリニアゲージ(PEACOCK社製)により測定した。封止層5の厚みt1と、電子素子4の厚みt2との関係を図6に示す。なお、電子素子4の厚みt2の厚みは既知であって、表1に示す。また、図6では、本発明で定義される範囲をハッチング処理して示す。
(Thickness of sealing layer)
The thickness t1 of the sealing layer 5 was measured with a linear gauge (manufactured by PEACOCK). FIG. 6 shows the relationship between the thickness t1 of the sealing layer 5 and the thickness t2 of the electronic element 4. As shown in FIG. The thickness t2 of the electronic element 4 is known and shown in Table 1. In addition, in FIG. 6, the range defined by the present invention is hatched.

また、図6では、封止層5の厚みt1の、電子素子4の厚みt2に対する比(t1/t2)が0.7であるライン(実線)と、2.3であるライン(実線)とを示しており、これらの2つのラインに挟まれる領域は、上記した比(t1/t2)0.7以上、2.3以下の範囲を示す。 In FIG. 6, a line (solid line) where the ratio (t1/t2) of the thickness t1 of the sealing layer 5 to the thickness t2 of the electronic element 4 is 0.7 and a line (solid line) where the ratio is 2.3. , and the region sandwiched between these two lines indicates the range of the ratio (t1/t2) of 0.7 or more and 2.3 or less.

さらに、図6では、封止層5の厚みt1の、電子素子4の厚みt2との合計(t1+t2)が0.25[mm]であるライン(一点鎖線)と、0.50[mm]であるライン(一点鎖線)とを示しており、これらの2つの一点鎖線に挟まれる領域は、合計(t1+t2)が0.25[mm]以上、0.50[mm]以下の範囲を示す。 Furthermore, in FIG. 6, a line (chain line) where the total (t1+t2) of the thickness t1 of the sealing layer 5 and the thickness t2 of the electronic element 4 is 0.25 [mm] and A certain line (one-dot chain line) is shown, and the area sandwiched between these two one-dot chain lines indicates a range in which the total (t1+t2) is 0.25 [mm] or more and 0.50 [mm] or less.

(接合強度の評価)(剥離の観察)
電子素子装置3について、以下の温度サイクル試験を実施した。
(Evaluation of bonding strength) (Observation of peeling)
The electronic device device 3 was subjected to the following temperature cycle test.

温度:-40℃から85℃まで
Total transfer time :1分以下
Total Dwell Time :10分以上
Specified temp reached in:15分以下
サイクル : 1000 サイクル
そして、超音波映像装置[SAT](日立建機ファインテック製、「FineSAT II」)を用いて、基板2と電子素子4との界面、および、基板2と封止層5との界面を観察し、以下の基準で、評価した。
○:剥離が、基板2と電子素子4との界面に観察されず、剥離が、基板2と封止層5との界面にも観察されなかった。
△:剥離が、基板2と電子素子4との界面に観察された。一方、剥離が、基板2と封止層5との界面には観察されなかった。図4Aおよび図5参照。なお、図4Aおよび図5において、基板2と電子素子4との間に隙間を描画しているが、実際には、この比較例では、隙間はなく、単に、電子素子4の基板2に対する固定(接着)(ボンディング)が外れた(剥離した)例であり、上記した「剥離」を容易に理解するために示すために、隙間を描画した。
×:剥離が、基板2と電子素子4との界面に観察された。剥離が、基板2と封止層5との界面にも観察された。なお、図4Bにおいて、基板2と、電子素子4および封止層5との間に隙間を描画しているが、実際には、この比較例では、隙間はなく、単に、電子素子4および封止層5の、基板2に対する固定(接着)が外れた(剥離した)例であり、上記した「剥離」を容易に理解するために示すために、隙間を描画した。
Temperature: -40°C to 85°C
Total transfer time : 1 minute or less
Total Dwell Time: 10 minutes or more
Specified temp reached in: 15 minutes or less Cycle: 1000 cycles Then, using an ultrasonic imaging device [SAT] (manufactured by Hitachi Kenki Fine Tech, "FineSAT II"), the interface between the substrate 2 and the electronic element 4, and The interface between the substrate 2 and the sealing layer 5 was observed and evaluated according to the following criteria.
○: No peeling was observed at the interface between the substrate 2 and the electronic element 4 , nor was peeling observed at the interface between the substrate 2 and the sealing layer 5 .
Δ: Peeling was observed at the interface between the substrate 2 and the electronic element 4 . On the other hand, peeling was not observed at the interface between the substrate 2 and the sealing layer 5 . See FIGS. 4A and 5. FIG. 4A and 5 show a gap between the substrate 2 and the electronic element 4, in fact, in this comparative example, there is no gap, and the electronic element 4 is simply fixed to the substrate 2. This is an example in which (adhesion) (bonding) is detached (separated), and a gap is drawn to show the above-described "separation" for easy understanding.
x: Peeling was observed at the interface between the substrate 2 and the electronic element 4 . Delamination was also observed at the interface between substrate 2 and sealing layer 5 . In FIG. 4B, a gap is drawn between the substrate 2 and the electronic element 4 and the sealing layer 5, but actually, in this comparative example, there is no gap, and the electronic element 4 and the sealing layer 5 are simply This is an example in which the fixing (adhesion) of the stopping layer 5 to the substrate 2 has come off (peeled off), and the gap is drawn to show the above-described "peeling" for easy understanding.

電子素子装置の厚み
電子素子装置の厚みT0を測定し、以下の基準に従って、評価した。
○:電子素子装置の厚みT0が0.70mm以下であった。
×:電子素子装置の厚みT0が0.70mm超過であった。
Thickness of Electronic Element Device The thickness T0 of the electronic element device was measured and evaluated according to the following criteria.
○: The thickness T0 of the electronic element device was 0.70 mm or less.
x: The thickness T0 of the electronic element device was over 0.70 mm.

Figure 0007166090000001
Figure 0007166090000001

1 電子素子封止用シート
2 基板
3 電子素子装置
4 電子素子
5 封止層
11 第1基板面
t1 厚み(封止層)
t2 厚み(電子素子)
1 electronic element sealing sheet 2 substrate 3 electronic element device 4 electronic element 5 sealing layer 11 first substrate surface t1 thickness (sealing layer)
t2 thickness (electronic element)

Claims (3)

熱硬化性成分と熱可塑性成分とを含む封止組成物から形成され、
基板の厚み方向一方面に対向するように実装される電子素子を、前記基板において前記電子素子と対向しない前記厚み方向一方面と接触するように、封止する封止層を形成するように使用される封止用シートであり、
前記熱可塑性成分がアクリル樹脂を含み、
前記電子素子の前記厚み方向一方面に配置される前記封止層の厚みt1の、前記電子素子の厚みt2に対する比(t1/t2)が、0.7以上、2.3以下であることを特徴とする、封止用シート。
formed from a sealing composition comprising a thermosetting component and a thermoplastic component;
Used to form a sealing layer that seals an electronic element mounted on one surface in the thickness direction of a substrate so as to be in contact with the one surface in the thickness direction of the substrate that does not face the electronic element. is a sheet for sealing,
the thermoplastic component comprises an acrylic resin;
The ratio (t1/t2) of the thickness t1 of the sealing layer disposed on one side in the thickness direction of the electronic element to the thickness t2 of the electronic element is 0.7 or more and 2.3 or less. A sheet for sealing, characterized by:
前記封止層の厚みt1と、前記電子素子の厚みt2との合計(t1+t2)が、0.25[mm]以上、0.50[mm]以下であることを特徴とする、請求項1に記載の封止用シート。 The sum total (t1 + t2) of the thickness t1 of the sealing layer and the thickness t2 of the electronic element is 0.25 [mm] or more and 0.50 [mm] or less, Sealing sheet described. 請求項1または2に記載の封止用シートを使用して、電子素子を封止することを特徴とする、電子素子装置の製造方法。 A method for manufacturing an electronic element device, comprising sealing an electronic element using the sealing sheet according to claim 1 or 2.
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