JP6911961B2 - 撮像素子および撮像装置 - Google Patents
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Description
には、CCDカラーエリアセンサから出力される画像信号を複数の信号処理部でA/D変
換して、それらの変換結果の平均を算出することにより、A/D変換時に発生するランダ
ムノイズを低減する電子カメラが開示されている。
モードが用意されていることがある。たとえば、高感度撮影モードのときには、露光量が
少ないためノイズ成分を低減しないとSN比を向上させられない。
処理部に入力して、それらの信号処理部の出力の平均を算出してノイズ成分を低減する場
合に、低減前と同一の読み出し速度を実現するためには、信号処理部の個数を増加させる
必要がある。しかし、信号処理部の増加は固体撮像素子の大型化につながるおそれがある
。
図1は、本発明の第1の実施の形態による撮像装置の一構成例を示す概略ブロック図で
ある。電子カメラ1は、撮影レンズ2と、固体撮像装置3と、撮像制御部4と、レンズ制
御部5と、メモリ6と、マイクロプロセッサ7と、操作部8と、画像処理部9と、記録部
10とを備える撮像装置である。
ンズ2のフォーカシングレンズや絞りは、レンズ制御部5により駆動される。固体撮像装
置3は、イメージセンサ30を備える。撮影レンズ2の結像面には、イメージセンサ30
の撮像面が配置される。
る。固体撮像装置3は、撮像制御部4から出力される制御信号に従い、撮像信号を出力す
る。固体撮像装置3から出力された撮像信号は、メモリ6に一旦蓄積される。
する。マイクロプロセッサ7には、レリーズスイッチ、電源スイッチ、選択スイッチなど
の操作部8が接続される。画像処理部9は、メモリ6に蓄積された撮像信号に対してホワ
イトバランスの調整、圧縮処理など、各種画像処理を行う。記録部10には記録媒体10
aが着脱自在に装着され、画像処理部9により圧縮された画像データを記録媒体10aに
記録する。
を所定値(たとえば、ISO800)以上に高めて撮影を行う高感度撮影モードと、イメ
ージセンサ30から撮像信号を高速に読み出す高速読み出しモードとを有する。高感度撮
影モードでは、イメージセンサ30の露光量が少なく、露光量を増加させることも困難で
あるため、ノイズ成分を低減しないと撮像信号のSN比が向上しない。
えることができる。マイクロプロセッサ7は、電子カメラ1の撮影モードが切り替えられ
ると、レンズ制御部5、撮像制御部4、画像処理部9などを切り替えられた撮影モードに
適合した設定に変更する。
撮像装置3は、画素アレイ30aと、カラム回路31と、第1切替部32と、第2切替部
33と、平均化演算器34と、出力選択回路35とを備える。
されている。図2には、ベイヤ配列に従って配置された複数の画素20の一部が図示され
ている。
列の垂直信号線25には、当該画素列に含まれる画素20がすべて接続されている。撮像
制御部4の制御により読み出し対象となった画素20は、垂直信号線25に信号を出力す
る。
41aおよび41bを複数備える。開閉器41aは、n列目の画素列の垂直信号線25と
n列目の画素列のカラム回路31との間に設けられる。開閉器41bは、n列目の画素列
の垂直信号線25とn+1列目の画素列のカラム回路31との間に設けられる。ここで、
nは、1から画素アレイ30aに含まれる画素列の列数までの整数である。
れる信号は、第1切替部32を介してカラム回路31に読み込まれる。図2に例示したカ
ラム回路31は、A/D変換部(ADC)51とPGA(Programmable G
ain Amp)52とを備える。PGA52は、第1切替部32から入力された信号を
増幅する。A/D変換部51は、PGA52が増幅した信号をA/D変換する。カラム回
路31は、後述する相関二重サンプリングにより撮像信号を生成する。
力する。偶数列目の各画素列に設けられたカラム回路31は、撮像信号を出力信号線61
bへ出力する。出力信号線61aおよび61bは、第2切替部33に接続されている。
42c、および42dを備える。開閉器42aおよび開閉器42cは出力信号線61aに
接続され、開閉器42bおよび開閉器42dは出力信号線61bに接続されている。開閉
器42aおよび開閉器42bは、平均化演算器34に接続されている。開閉器42cおよ
び開閉器42dは、出力選択回路35に接続されている。
を要する撮影モードの際に用いられ、入力された二つの画像信号の平均を演算する。たと
えば、平均化演算器34は、二つの画像信号を加算して2で除す。平均化演算器34は、
その平均化した画像信号を新たな画像信号として出力選択回路35に出力する。
出力選択回路35は、入力された画像信号を固体撮像装置3の外部へ出力する。
部33とを制御する。
たとえば、電子カメラ1が高感度撮影モードである場合、一つの画素20が読み出し対
象となる。このとき、切替制御部4aは、読み出し対象の画素20が属する画素列の垂直
信号線25に接続している開閉器41aおよび41bのみが閉じるように、第1切替部3
2を制御する。また、切替制御部4aは、電子カメラ1が高感度撮影モードである場合、
開閉器42cおよび開閉器42dが開き、開閉器42aおよび開閉器42bを閉じるよう
に、第2切替部33を制御する。
の画素列に含まれる場合、読み出し対象の画素20から垂直信号線25に出力された信号
は、n列目とn+1列目のカラム回路31に読み出される。n列目とn+1列目のカラム
回路31は、その信号に基づいて撮像信号をそれぞれ生成する。n列目とn+1列目のカ
ラム回路31が生成した各撮像信号は、それぞれ平均化演算器34へ入力される。平均化
演算器34は、二つの撮像信号の平均を算出して、平均化した撮像信号を出力選択回路3
5へ出力する。
象となる。撮像制御部4は、開閉器41bが開いて開閉器41aが閉じるように、第1切
替部32を制御する。また、撮像制御部4は、電子カメラ1が高速読み出しモードである
場合、開閉器42aおよび開閉器42bを開き、開閉器42cおよび開閉器42dを閉じ
るように、第2切替部33を制御する。
に隣り合う二つの読み出し対象の画素20の各々から信号を読み出す。カラム回路31は
、読み出した信号に基づいて撮像信号をそれぞれ生成して、その撮像信号を出力選択回路
35へ出力する。
を行うと、撮像信号にノイズが発生する。固体撮像装置3は、電子カメラ1が高感度撮影
モードにある場合、同一の信号に基づいて2個のカラム回路31が生成した撮像信号の平
均を演算することにより、撮像信号に含まれるノイズを1/√2に低減する。撮像信号に
含まれるノイズが1/√2に低減されることにより、高感度撮影モードにおける撮像信号
のSN比が向上して、撮像画像の画質が向上する。
ときは、平均の演算に必要な撮像信号をn+1列目の画素列に従来から設けられているカ
ラム回路31を用いて生成する。電子カメラ1が高感度撮影モードであるときに、第1切
替部32を介してn列目の垂直信号線25をn+1列目のカラム回路31に接続すること
により、画素列ごとに複数個のカラム回路31を設ける場合よりも固体撮像装置3の大き
さを小さくすることができる。
まれる二つの画素20を読み出し対象とすることで、電子カメラ1が高感度撮影モードに
ある場合の半分の読み出し時間で画像を読み出すことができる。
は、画素20は、それぞれフォトダイオードPDと転送トランジスタTaと増幅トランジ
スタTbとリセットトランジスタTcと選択トランジスタTdとを備える。また、図3で
は、開閉器41a、41b、42a、42b、42c、42dは、それぞれNMOSトラ
ンジスタで構成されている。各トランジスタのゲートには、以下の制御信号が入力される
。なお、iは1から画素アレイ30aの垂直画素数までの整数であり、mは1から画素ア
レイ30aの水平画素数までの整数である。
i行m列の画素20の転送トランジスタTa:制御信号TX(i,m)
i行m列の画素20のリセットトランジスタTc:制御信号RST(i,m)
i行m列の画素20の選択トランジスタTd:制御信号SEL(i,m)
奇数列目の画素列の開閉器41a:制御信号LINE1
奇数列目の画素列の開閉器41b:制御信号LINE2
偶数列目の画素列の開閉器41a:制御信号LINE3
偶数列目の画素列の開閉器41b:制御信号LINE4
開閉器42a:制御信号OUT_SW4
開閉器42b:制御信号OUT_SW3
開閉器42c:制御信号OUT_SW1
開閉器42d:制御信号OUT_SW2
4により出力される。制御信号LINE1、LINE2、LINE3、LINE4、OU
T_SW1、OUT_SW2、OUT_SW3、およびOUT_SW4は、切替制御部4
aにより出力される。
不図示のフローティングディフュージョンに転送される。不図示のフローティングディフ
ュージョンFDは、転送トランジスタTaを介して転送された電荷を電圧に変換する。そ
の電圧は、増幅トランジスタTbのゲートに印加される。増幅トランジスタTbは、その
ゲート電圧に応じた電気信号を生成する。
ージョンFDや増幅トランジスタTbのゲートに転送された電荷を排出し、画素20をリ
セット状態にする。
を電気的に接続する。画素20が垂直信号線25に接続されると、増幅トランジスタTb
にて生成された信号が垂直信号線25に出力される。選択トランジスタTdがオン状態に
ある場合に、転送トランジスタTaがオン状態となると信号レベルの信号が垂直信号線2
5に出力され、画素20がリセット状態になるとリセットレベルの信号が垂直信号線25
に出力される。
AMPとが入力される。制御信号SAMPLEは、A/D変換部51に入力されたリセッ
トレベルまたは信号レベルの信号をサンプリングするか否かを表す。制御信号SAMPL
EがHiレベルのとき、A/D変換部51は、サンプリングを行う。A/D変換部51は
、制御信号RAMPにHiレベルからLoレベルへの傾斜信号が入力されているとき、サ
ンプリング結果に基づきA/D変換を行う。カラム回路31は、A/D変換後の信号レベ
ルの信号からA/D変換後のリセットレベルの信号を差し引いて撮像信号を生成する。
固体撮像装置3の動作について説明する。図4は、1行m列の画素20と1行m+1列の
画素20から信号が読み出されて、出力選択回路35から外部に撮像信号が出力されるま
での動作を表すタイミングチャートである。
制御信号TX(i,m):Loレベル
制御信号RST(i,m):Loレベル
制御信号SEL(i,m):Loレベル
制御信号LINE1:Loレベル
制御信号LINE2:Loレベル
制御信号LINE3:Hiレベル
制御信号LINE4:Hiレベル
制御信号OUT_SW4:Hiレベル
制御信号OUT_SW3:Hiレベル
制御信号OUT_SW2:Loレベル
制御信号OUT_SW1:Loレベル
LINE3および制御信号LINE4がLoレベルに切り替わり、制御信号LINE1お
よび制御信号LINE2がHiレベルに切り替わる。1行m列の画素20の選択トランジ
スタTdがオン状態となり、1行m列の画素20がm列目の垂直信号線25に接続される
。偶数列目の開閉器41aおよび開閉器41bが開き、奇数列目の画素列の開閉器41a
および開閉器41bが閉じる。
20がリセット状態になる。このとき、m列の垂直信号線25には、1行m列の画素20
からリセットレベルの信号R1darkが出力される。
SAMPLEがHiレベルに切り替わり、m列目とm+1列目のA/D変換部51がリセ
ットレベルの信号R1darkのサンプリングを開始する。
MPに傾斜信号が入力され、制御信号TX(1,m)がHiレベルに切り替わる。m列目
とm+1列目のA/D変換部51は、制御信号RAMPに傾斜信号が入力されている間、
時間T3から時間T4までの期間にサンプリングしたリセットレベルの信号R1dark
についてA/D変換する。また、1行m列の画素20の転送トランジスタTaがオン状態
となり、1行m列の画素20のフォトダイオードPDから1行m列の画素20のフローテ
ィングディフュージョンに電荷が転送される。以降、m列の垂直信号線25には、1行m
列の画素20から信号レベルの信号R1signalが出力される。
時間T5では、制御信号TX(1,m)がLoレベルに切り替わり、1行m列の画素2
0の転送トランジスタTaがオフ状態となり、電荷の転送が終了する。m列の垂直信号線
25には、引き続き1行m列の画素20から信号レベルの信号R1signalが出力さ
れる。
PLEがHiレベルに切り替わる。m列目とm+1列目のA/D変換部51は、信号レベ
ルの信号R1signalのサンプリングを開始する。
MPに傾斜信号が入力される。m列目とm+1列目のA/D変換部51は、制御信号RA
MPに傾斜信号が入力されている間、時間T6から時間T7までの期間にサンプリングし
た信号レベルの信号R1signalについてA/D変換する。
1)がHiレベルに、制御信号LINE1および制御信号LINE2がLoレベルに、制
御信号LINE3および制御信号LINE4がHiレベルにそれぞれ切り替わる。1行m
列の画素20の選択トランジスタTdがオフ状態となり、1行m+1列の画素20の選択
トランジスタTdがオン状態となる。すなわち、1行m+1列の画素20がm+1列目の
垂直信号線25に接続される。また、奇数列目の開閉器41aおよび開閉器41bが開き
、偶数列目の画素列の開閉器41aおよび開閉器41bが閉じる。
列の画素20がリセット状態になる。このとき、m+1列の垂直信号線25には、1行m
+1列の画素20からリセットレベルの信号Gr1darkが出力される。
御信号RAMPへの傾斜信号の入力が終わり、制御信号SAMPLEがHiレベルに切り
替わる。m+1列目とm+2列目のA/D変換部51は、リセットレベルの信号Gr1d
arkのサンプリングを開始する。また、m列目とm+1列目のカラム回路31は、時間
T4から時間T6の間にA/D変換したリセットレベルの信号R1darkを時間T7か
ら時間T10の間にA/D変換した信号レベルの信号R1signalから減じて、撮像
信号を生成する。m列目とm+1列目のカラム回路31は、各々が生成した撮像信号を平
均化演算器34へ出力する。平均化演算器34は、m列目とm+1列目のカラム回路31
がそれぞれ出力した撮像信号の平均を演算して、出力選択回路35へ出力する。出力選択
回路35は、1行m列の画素20に関する撮像信号R1aを固体撮像装置3の外部へ出力
する。
AMPに傾斜信号が入力され、制御信号TX(1,m+1)がHiレベルに切り替わる。
m+1列目とm+2列目のA/D変換部51は、制御信号RAMPに傾斜信号が入力され
ている間、時間T10から時間T11までの期間にサンプリングしたリセットレベルの信
号Gr1darkについてA/D変換する。また、1行m+1列の画素20の転送トラン
ジスタTaがオン状態となり、1行m+1列の画素20のフォトダイオードPDから1行
m+1列の画素20のフローティングディフュージョンに電荷が転送される。以降、m+
1列の垂直信号線25には、1行m+1列の画素20から信号レベルの信号Gr1sig
nalが出力される。
列の画素20の転送トランジスタTaがオフ状態となり、電荷の転送が終了する。m+1
列の垂直信号線25には、引き続き1行m+1列の画素20から信号レベルの信号Gr1
signalが出力されている。
MPLEがHiレベルに切り替わる。m+1列目とm+2列目のA/D変換部51は、信
号レベルの信号Gr1signalのサンプリングを開始する。
AMPに傾斜信号が入力される。m+1列目とm+2列目のA/D変換部51は、制御信
号RAMPに傾斜信号が入力されている間、時間T13から時間T14までの期間にサン
プリングした信号レベルの信号Gr1signalについてA/D変換する。
および制御信号LINE2がHiレベルに、制御信号LINE3およびLINE4がLo
レベルにそれぞれ切り替わる。1行m+1列の画素20の選択トランジスタTdがオフ状
態となる。奇数列目の開閉器41aおよび開閉器41aが閉じて、偶数列目の開閉器41
aおよび開閉器41bが開く。
列目のカラム回路31は、時間T11から時間T13の間にA/D変換した1行m+1列
の画素20のリセットレベルの信号Gr1darkを時間T14から時間T16の間にA
/D変換した1行m+1列の画素20の信号レベルの信号Gr1signalから減じて
、撮像信号を生成する。m+1列目とm+2列目のカラム回路31は、各々が生成した撮
像信号を平均化演算器34へ出力する。平均化演算器34は、m+1列目とm+2列目の
カラム回路31がそれぞれ出力した撮像信号の平均を演算して、出力選択回路35へ出力
する。出力選択回路35は、1行m+1列の画素20に関する撮像信号Gr1aを固体撮
像装置3の外部へ出力する。
の固体撮像装置3の動作について説明する。図5は、固体撮像装置3が1行m列の画素2
0と1行m+1列の画素20から信号を読み出して、出力選択回路35から外部に撮像信
号を出力するまでの動作を表すタイミングチャートである。
制御信号TX(i,m):Loレベル
制御信号RST(i,m):Loレベル
制御信号SEL(i,m):Loレベル
制御信号LINE1:Hiレベル
制御信号LINE2:Loレベル
制御信号LINE3:Hiレベル
制御信号LINE4:Loレベル
制御信号OUT_SW4:Loレベル
制御信号OUT_SW3:Loレベル
制御信号OUT_SW2:Loレベル
制御信号OUT_SW1:Loレベル
びLINE3は、常にHiレベルである。すなわち、電子カメラ1の撮影モードが高感度
撮影モードでない場合、開閉器41aは、常に閉じている(オン状態である)。一方、制
御信号LINE2およびLINE4は、常にLoレベルである。すなわち、電子カメラ1
の撮影モードが高感度撮影モードでない場合、開閉器41bは、常に開いている(オフ状
態である)。
に切り替わる。1行m列および1行m+1列の画素20の選択トランジスタTdがオン状
態となり、1行m列の画素20がm列目の垂直信号線25に接続され、1行m+1列の画
素20がm+1列目の垂直信号線25に接続される。
に切り替わり、1行m列および1行m+1列の画素20がそれぞれリセット状態になる。
このとき、m列の垂直信号線25には、1行m列の画素20からリセットレベルの信号R
1darkが出力される。m+1列の垂直信号線25には、1行m+1列の画素20から
リセットレベルの信号Gr1darkが出力される。
に切り替わると共に、制御信号SAMPLEがHiレベルに切り替わる。m列目のA/D
変換部51は、リセットレベルの信号R1darkのサンプリングを開始し、m+1列目
のA/D変換部51は、リセットレベルの信号Gr1darkのサンプリングを開始する
。
AMPに傾斜信号が入力され、制御信号TX(1,m)およびTX(1,m+1)がHi
レベルに切り替わる。m列目のA/D変換部51は、制御信号RAMPに傾斜信号が入力
されている間、時間T23から時間T24までの期間にサンプリングしたリセットレベル
の信号R1darkについてA/D変換する。m+1列目のA/D変換部51は、制御信
号RAMPに傾斜信号が入力されている間、時間T23から時間T24までの期間にサン
プリングしたリセットレベルの信号Gr1darkについてA/D変換する。また、1行
m列および1行m+1列の画素20の転送トランジスタTaがオン状態となり、1行m列
および1行m+1列の画素20のフォトダイオードPDから各画素20のフローティング
ディフュージョンに電荷が転送される。以降、m列の垂直信号線25には、1行m列の画
素20から信号レベルの信号R1signalが出力される。また、m+1列の垂直信号
線25には、1行m+1列の画素20から信号レベルの信号Gr1signalが出力さ
れる。
り替わり、1行m列および1行m+1列の画素20の転送トランジスタTaがオフ状態と
なり、電荷の転送が終了する。m列の垂直信号線25には、引き続き1行m列の画素20
から信号レベルの信号R1signalが出力される。m+1列の垂直信号線25には、
引き続き1行m+1列の画素20から信号レベルの信号Gr1signalが出力される
。
MPLEがHiレベルに切り替わる。m列目のA/D変換部51は、信号レベルの信号R
1signalのサンプリングを開始する。m+1列目のA/D変換部51は、信号レベ
ルの信号Gr1signalのサンプリングを開始する。
AMPに傾斜信号が入力される。m列目のA/D変換部51は、制御信号RAMPに傾斜
信号が入力されている間、時間T26から時間T27までの期間にサンプリングした信号
レベルの信号R1signalについてA/D変換する。m+1列目のA/D変換部51
は、制御信号RAMPに傾斜信号が入力されている間、時間T26から時間T27までの
期間にサンプリングした信号レベルの信号Gr1signalについてA/D変換する。
にそれぞれ切り替わると共に、制御信号SEL(2,m)およびSEL(2,m+1)が
Hiレベルにそれぞれ切り替わる。1行m列および1行m+1列の画素20の選択トラン
ジスタTdがオフ状態となり、2行m列および2行m+1列の画素20の選択トランジス
タTdがオン状態となる。すなわち、2行m列の画素20がm列目の垂直信号線25に接
続される。また、2行m+1列の画素20がm+1列の垂直信号線25に接続される。
に切り替わり、2行m列および2行m+1列の画素20がリセット状態になる。このとき
、m列目の垂直信号線25には、2行m列の画素20からリセットレベルの信号Gb1d
arkが出力され、m+1列の垂直信号線25には、2行m+1列の画素20からリセッ
トレベルの信号B1darkが出力される。
に切り替わると共に、制御信号RAMPへの傾斜信号の入力が終わり、制御信号SAMP
LEがHiレベルに切り替わり、制御信号OUT_SW1がHiレベルに切り替わる。m
列目のA/D変換部51は、リセットレベルの信号Gb1darkのサンプリングを開始
する。m+1列目のA/D変換部51は、リセットレベルの信号B1darkのサンプリ
ングを開始する。また、m列目のカラム回路31は、時間T24から時間T26の間にA
/D変換したリセットレベルの信号R1darkを時間T27から時間T30の間にA/
D変換した信号レベルの信号R1signalから減じて、撮像信号を生成する。同様に
、m+1列目のカラム回路31は、時間T24から時間T26の間にA/D変換したリセ
ットレベルの信号Gr1darkを時間T27から時間T30の間にA/D変換した信号
レベルの信号Gr1signalから減じて、撮像信号を生成する。制御信号OUT_S
W1がHiレベルに切り替わることにより、m列目のカラム回路31が生成した撮像信号
が出力選択回路35へ出力される。出力選択回路35は、1行m列の画素20に関する撮
像信号R1aを固体撮像装置3の外部へ出力する。
AMPに傾斜信号が入力され、制御信号TX(2,m)およびTX(2,m+1)がHi
レベルに切り替わる。m列目のA/D変換部51は、制御信号RAMPに傾斜信号が入力
されている間、時間T30から時間T31までの期間にサンプリングしたリセットレベル
の信号Gb1darkについてA/D変換する。m+1列目のA/D変換部51は、制御
信号RAMPに傾斜信号が入力されている間、時間T30から時間T31までの期間にサ
ンプリングしたリセットレベルの信号B1darkについてA/D変換する。
また、2行m列および2行m+1列の画素20の転送トランジスタTaがオン状態とな
り、2行m列の画素20のフォトダイオードPDから2行m列の画素20のフローティン
グディフュージョンに電荷が転送される。2行m+1列の画素20のフォトダイオードP
Dから2行m+1列の画素20のフローティングディフュージョンに電荷が転送される。
以降、m列目の垂直信号線25には、2行m列の画素20から信号レベルの信号Gb1s
ignalが出力され、m+1列目の垂直信号線25には、2行m+1列の画素20から
信号レベルの信号B1signalが出力される。
り替わり、2行m列および2行m+1列の画素20の転送トランジスタTaがオフ状態と
なり、電荷の転送が終了する。m列の垂直信号線25には、引き続き2行m列の画素20
から信号レベルの信号Gb1signalが出力されている。m+1列の垂直信号線25
には、引き続き2行m+1列の画素20から信号レベルの信号B1signalが出力さ
れている。
MPLEがHiレベルに切り替わり、制御信号OUT_SW1がLoレベルに切り替わり
、制御信号OUT_SW2がHiレベルに切り替わる。m列目のA/D変換部51は、信
号レベルの信号Gb1signalのサンプリングを開始する。m+1列目のA/D変換
部51は、信号レベルの信号B1signalのサンプリングを開始する。制御信号OU
T_SW1がLoレベルに切り替わり、制御信号OUT_SW2がHiレベルに切り替わ
ることにより、m+1列目のカラム回路31が生成した撮像信号が出力選択回路35へ出
力される。出力選択回路35は、1行m+1列の画素20に関する撮像信号Gr1aを固
体撮像装置3の外部へ順次出力する。
AMPに傾斜信号が入力される。m列目のA/D変換部51は、制御信号RAMPに傾斜
信号が入力されている間、時間T33から時間T34までの期間にサンプリングした信号
レベルの信号Gb1signalについてA/D変換する。m+1列目のA/D変換部5
1は、制御信号RAMPに傾斜信号が入力されている間、時間T33から時間T34まで
の期間にサンプリングした信号レベルの信号B1signalについてA/D変換する。
にそれぞれ切り替わる。2行m列および2行m+1列の画素20の選択トランジスタTd
がオフ状態となる。
T_SW2がLoレベルに切り替わり、制御信号OUT_SW1がHiレベルに切り替わ
る。m列目のカラム回路31は、時間T31から時間T33の間にA/D変換したリセッ
トレベルの信号Gb1darkを時間T34から時間T36の間にA/D変換した信号レ
ベルの信号Gb1signalから減じて、撮像信号を生成する。同様に、m+1列目の
カラム回路31は、時間T31から時間T33の間にA/D変換したリセットレベルの信
号B1darkを時間T34から時間T36の間にA/D変換した信号レベルの信号B1
signalから減じて、撮像信号を生成する。制御信号OUT_SW1がHiレベルに
切り替わることにより、m列目のカラム回路31が生成した撮像信号が出力選択回路35
へ出力される。出力選択回路35は、2行m列の画素20に関する撮像信号Gb1aを固
体撮像装置3の外部へ出力する。
図6は、本発明の第2の実施の形態による固体撮像装置3の等価回路図である。第2の
実施の形態による固体撮像装置3は、イメージセンサ30と、カラム回路31と、第2切
替部33と、平均化演算器34と、出力選択回路35と、第3切替部36とを備える。第
1の実施の形態と同一の構成には、同一の符号を付し、その構成に関する説明を省略する
。
直信号線25aおよび第2垂直信号線25bを備える。n列目の画素列に設けられた第1
垂直信号線25aには、n列目の画素列に含まれる画素20のうち奇数行目の画素20、
すなわち奇数行n列の画素20が接続される。一方、n列目の画素列に設けられた第2垂
直信号線25bには、偶数行n列の画素20が接続される。
各画素列の両端にカラム回路31が設けられている。すなわち、第2の実施の形態では、
画素列ごとに二つのカラム回路31が設けられている。一つ目のカラム回路31は画素列
の上端側に設けられ、二つ目のカラム回路31は画素列の下端側に設けられている。すな
わち、一つ目のカラム回路31は第1垂直信号線25aおよび第2垂直信号線25bの上
端側に設けられ、二つ目のカラム回路31は第1垂直信号線25aおよび第2垂直信号線
25bの下端側に設けられている。
43c、43d、および43eをそれぞれ複数備える。開閉器43a、43b、43c、
43d、および43eは、それぞれ以下の位置に設けられる。なお、以下の説明で用いる
変数qは画素アレイ30aの水平画素数以下の奇数である。
開閉器43aは、q列目の第1垂直信号線25aとq列目の下端側のカラム回路31と
の間、およびq+1列目の第1垂直信号線25aとq+1列目の上端側のカラム回路31
との間に設けられる。
開閉器43bは、q列目の第1垂直信号線25aとq+1列目の下端側のカラム回路3
1との間、およびq+1列目の第1垂直信号線25aとq列目の上端側のカラム回路31
との間に設けられる。
開閉器43cは、q列目の第2垂直信号線25bとq列目の下端側のカラム回路31と
の間、およびq+1列目の第2垂直信号線25bとq+1列目の上端側のカラム回路31
との間に設けられる。
開閉器43dは、q列目の第2垂直信号線25bとq+1列目の下端側のカラム回路3
1との間、およびq+1列目の第2垂直信号線25bとq列目の上端側のカラム回路31
との間に設けられる。
開閉器43eは、q列目の第2垂直信号線25bとq列目の上端側のカラム回路31と
の間、およびq+1列目の第2垂直信号線25bとq+1列目の下端側のカラム回路31
との間に設けられる。
3、平均化演算器34、および出力選択回路35をそれぞれ二つ備える。一つ目の第2切
替部33、平均化演算器34、および出力選択回路35は、画素列の上端側に設けられた
カラム回路31が出力する撮像装置のために用いられる。二つ目の第2切替部33、平均
化演算器34、および出力選択回路35は、画素列の下端側に設けられたカラム回路31
が出力する撮像装置のために用いられる。
は、画素20は、それぞれフォトダイオードPDと転送トランジスタTaと増幅トランジ
スタTbとリセットトランジスタTcと選択トランジスタTdとを備える。また、図7で
は、開閉器42a、42b、42c、42d、43a、43b、43c、43d、43e
は、それぞれNMOSトランジスタで構成されている。各トランジスタのゲートには、以
下の制御信号が入力される。pは、1から画素アレイ30aの垂直画素数以下の整数であ
る。
p行の画素20の転送トランジスタTa:制御信号TX(p)
p行の画素20のリセットトランジスタTc:制御信号RST(p)
p行の画素20の選択トランジスタTd:制御信号SEL(p)
開閉器42a:制御信号OUT_SW4
開閉器42b:制御信号OUT_SW3
開閉器42c:制御信号OUT_SW1
開閉器42d:制御信号OUT_SW2
開閉器43a:制御信号LINE1
開閉器43b:制御信号LINE3
開閉器43c:制御信号LINE2
開閉器43d:制御信号LINE4
開閉器43e:制御信号LINE5
される。制御信号LINE1、LINE2、LINE3、LINE4、LINE5、OU
T_SW1、OUT_SW2、OUT_SW3、およびOUT_SW4は、切替制御部4
aにより出力される。
上端側および下端側のカラム回路31のA/D変換部51には、それぞれ制御信号SA
MPLEと制御信号RAMPとが入力される。
固体撮像装置3の動作について説明する。図8は、1行q列、1行q+1列、2行q列、
2行q+1列の画素20から信号が読み出されて、出力選択回路35から外部に撮像信号
が出力するまでの動作を表すタイミングチャートである。
制御信号TX(p):Loレベル
制御信号RST(p):Loレベル
制御信号SEL(p):Loレベル
制御信号OUT_SW4:Hiレベル
制御信号OUT_SW3:Hiレベル
制御信号OUT_SW2:Loレベル
制御信号OUT_SW1:Loレベル
制御信号LINE1:Loレベル
制御信号LINE2:Hiレベル
制御信号LINE3:Loレベル
制御信号LINE4:Hiレベル
制御信号LINE5:Loレベル
INE2および制御信号LINE4がLoレベルに切り替わり、制御信号LINE1およ
び制御信号LINE3がHiレベルに切り替わる。1行q列および1行q+1列の画素2
0の選択トランジスタTdがオン状態となり、1行q列の画素20がq列目の第1垂直信
号線25aに接続され、1行q+1列の画素20がq+1列目の第1垂直信号線25aに
接続される。開閉器43cおよび開閉器43dが開き、開閉器43aおよび開閉器43b
が閉じる。
行q+1列の画素20の増幅トランジスタTbがリセット状態になる。以降、q列目の第
1垂直信号線25aには、1行q列の画素20からリセットレベルの信号R1darkが
出力される。q+1列目の第1垂直信号線25aには、1行q+1列の画素20からリセ
ットレベルの信号Gr1darkが出力される。
AMPLEがHiレベルに切り替わる。q列目とq+1列目の下端側のカラム回路31の
A/D変換部51がリセットレベルの信号R1darkのサンプリングを開始する。q列
目とq+1列目の上端側のカラム回路31のA/D変換部51がリセットレベルの信号G
r1darkのサンプリングを開始する。
AMPに傾斜信号が入力され、制御信号TX(1)がHiレベルに切り替わる。q列目の
下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号が入力され
ている間、時間T43から時間T44までの期間にサンプリングしたリセットレベルの信
号R1darkについてA/D変換する。q+1列目の上端側のカラム回路31のA/D
変換部51は、制御信号RAMPに傾斜信号が入力されている間、時間T43から時間T
44までの期間にサンプリングしたリセットレベルの信号Gr1darkについてA/D
変換する。1行q列および1行q+1列の画素20の転送トランジスタTaがオン状態と
なり、1行q列および1行q+1列の画素20のフォトダイオードPDから各画素20の
フローティングディフュージョンに電荷が転送される。以降、q列の第1垂直信号線25
aには、1行q列の画素20から信号レベルの信号R1signalが出力される。また
、q+1列の第1垂直信号線25aには、1行q+1列の画素20から信号レベルの信号
Gr1signalが出力される。
q+1列の画素20の転送トランジスタTaがオフ状態となり、電荷の転送が終了する。
q列の第1垂直信号線25aには、引き続き1行q列の画素20から信号レベルの信号R
1signalが出力される。q+1列の第1垂直信号線25aには、引き続き1行q+
1列の画素20から信号レベルの信号Gr1signalが出力される。
MPLEがHiレベルに切り替わる。q列目およびq+1列目の下端側のカラム回路31
のA/D変換部51が信号レベルの信号R1signalのサンプリングを開始する。q
列目およびq+1列目の上端側のカラム回路31のA/D変換部51が信号レベルの信号
Gr1signalのサンプリングを開始する。
AMPに傾斜信号が入力される。q列目およびq+1列目の下端側のカラム回路31のA
/D変換部51が制御信号RAMPに傾斜信号が入力されている間、時間T46から時間
T47までの期間にサンプリングした信号レベルの信号R1signalについてA/D
変換する。q列目およびq+1列目の上端側のカラム回路31のA/D変換部51が制御
信号RAMPに傾斜信号が入力されている間、時間T46から時間T47までの期間にサ
ンプリングした信号レベルの信号Gr1signalについてA/D変換する。
レベルに、制御信号LINE1および制御信号LINE3がLoレベルに、制御信号LI
NE2および制御信号LINE4がHiレベルにそれぞれ切り替わる。1行q列および1
行q+1列の画素20の選択トランジスタTdがオフ状態となり、2行q列および2行q
+1列の画素20の選択トランジスタTdがオン状態となる。1行q列の画素20がq列
目の第1垂直信号線25aから切断され、1行q+1列の画素20がq+1列目の第1垂
直信号線25aから切断される。2行q列の画素20がq列目の第2垂直信号線25bに
接続され、2行q+1列の画素20がq+1列目の第2垂直信号線25bに接続される。
開閉器43aおよび開閉器43bが開き、開閉器43cおよび開閉器43dが閉じる。
時間T49では、制御信号RST(2)がHiレベルに切り替わり、2行q列および2
行q+1列の画素20がリセット状態になる。
AMPへの傾斜信号の入力が終わり、制御信号SAMPLEがHiレベルに切り替わる。
q列目とq+1列目の下端側のカラム回路31のA/D変換部51がリセットレベルの信
号Gb1darkのサンプリングを開始する。q列目とq+1列目の上端側のカラム回路
31のA/D変換部51が信号レベルの信号B1darkのサンプリングを開始する。
また、q列目とq+1列目の下端側のカラム回路31は、時間T44から時間T46の
間にA/D変換したリセットレベルの信号R1darkを時間T47から時間T50の間
にA/D変換した信号レベルの信号R1signalから減じて、撮像信号を生成する。
q列目とq+1列目の上端側のカラム回路31は、時間T44から時間T46の間にA/
D変換したリセットレベルの信号Gr1darkを時間T47から時間T50の間にA/
D変換した信号レベルの信号Gr1signalから減じて、撮像信号を生成する。
q列目とq+1列目の下端側のカラム回路31は、各々が生成した撮像信号を下端側の
平均化演算器34へ出力する。下端側の平均化演算器34は、q列目およびq+1列目の
下端側のカラム回路31がそれぞれ出力した撮像信号の平均を演算して、出力選択回路3
5へ出力する。下端側の出力選択回路35は、1行q列の画素20に関する撮像信号R1
bを固体撮像装置3の外部へ出力する。
q列目とq+1列目の上端側のカラム回路31は、各々が生成した撮像信号を上端側の
平均化演算器34へ出力する。上端側の平均化演算器34は、q列目およびq+1列目の
上端側のカラム回路31がそれぞれ出力した撮像信号の平均を演算して、出力選択回路3
5へ出力する。上端側の出力選択回路35は、1行q+1列の画素20に関する撮像信号
Gr1bを固体撮像装置3の外部へ出力する。
AMPに傾斜信号が入力され、制御信号TX(2)がHiレベルに切り替わる。q列目の
下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号が入力され
ている間、時間T50から時間T51までの期間にサンプリングしたリセットレベルの信
号Gb1darkについてA/D変換する。q+1列目の上端側のカラム回路31のA/
D変換部51は、制御信号RAMPに傾斜信号が入力されている間、時間T50から時間
T51までの期間にサンプリングしたリセットレベルの信号B1darkについてA/D
変換する。
2行q列および2行q+1列の画素20の転送トランジスタTaがオン状態となり、2
行q列の画素20のフォトダイオードPDから2行q列の画素20のフローティングディ
フュージョンに電荷が転送される。2行q+1列の画素20のフォトダイオードPDから
2行q+1列の画素20のフローティングディフュージョンに電荷が転送される。以降、
q列目の第2垂直信号線25bには、2行q列の画素20から信号レベルの信号Gb1s
ignalが出力され、q+1列目の第2垂直信号線25bには、2行q+1列の画素2
0から信号レベルの信号B1signalが出力される。
q+1列の画素20の転送トランジスタTaがオフ状態となり、電荷の転送が終了する。
q列の第2垂直信号線25bには、引き続き2行q列の画素20から信号レベルの信号G
b1signalが出力されている。q+1列の第2垂直信号線25bには、引き続き2
行q+1列の画素20から信号レベルの信号B1signalが出力されている。
MPLEがHiレベルに切り替わる。q列目およびq+1列目の下端側のカラム回路31
のA/D変換部51が信号レベルの信号Gb1signalのサンプリングを開始する。
q列目およびq+1列目の上端側のカラム回路31のA/D変換部51が信号レベルの信
号B1signalのサンプリングを開始する。
AMPに傾斜信号が入力される。q列目およびq+1列目の下端側のカラム回路31のA
/D変換部51が制御信号RAMPに傾斜信号が入力されている間、時間T53から時間
T54までの期間にサンプリングした信号レベルの信号Gb1signalについてA/
D変換する。q列目およびq+1列目の上端側のカラム回路31のA/D変換部51が制
御信号RAMPに傾斜信号が入力されている間、時間T53から時間T54までの期間に
サンプリングした信号レベルの信号B1signalについてA/D変換する。
御信号LINE4がLoレベルに、制御信号LINE1および制御信号LINE3がHi
レベルにそれぞれ切り替わる。2行q列および2行q+1列の画素20の選択トランジス
タTdがオフ状態となる。2行q列の画素20がq列目の第2垂直信号線25bから切断
され、2行q+1列の画素20がq+1列目の第2垂直信号線25bから切断される。開
閉器43cおよび開閉器43dが開き、開閉器43aおよび開閉器43bが閉じる。
また、q列目とq+1列目の下端側のカラム回路31は、時間T51から時間T53の
間にA/D変換したリセットレベルの信号Gb1darkを時間T54から時間T56の
間にA/D変換した信号レベルの信号Gb1signalから減じて、撮像信号を生成す
る。
また、q列目とq+1列目の上端側のカラム回路31は、時間T51から時間T53の
間にA/D変換したリセットレベルの信号B1darkを時間T54から時間T56の間
にA/D変換した信号レベルの信号B1signalから減じて、撮像信号を生成する。
q列目とq+1列目の下端側のカラム回路31は、各々が生成した撮像信号を下端側の
平均化演算器34へ出力する。下端側の平均化演算器34は、q列目およびq+1列目の
下端側のカラム回路31がそれぞれ出力した撮像信号の平均を演算して、出力選択回路3
5へ出力する。下端側の出力選択回路35は、2行q列の画素20に関する撮像信号Gb
1bを固体撮像装置3の外部へ出力する。
q列目とq+1列目の上端側のカラム回路31は、各々が生成した撮像信号を上端側の
平均化演算器34へ出力する。上端側の平均化演算器34は、q列目およびq+1列目の
上端側のカラム回路31がそれぞれ出力した撮像信号の平均を演算して、出力選択回路3
5へ出力する。上端側の出力選択回路35は、2行q+1列の画素20に関する撮像信号
B1bを固体撮像装置3の外部へ出力する。
置3の動作について説明する。図9は、固体撮像装置3が1行q列、1行q+1列、2行
q列、2行q+1列の画素20から信号を読み出して、出力選択回路35から外部に撮像
信号を出力するまでの動作を表すタイミングチャートである。
制御信号TX(p):Loレベル
制御信号RST(p):Loレベル
制御信号SEL(p):Loレベル
制御信号OUT_SW4:Loレベル
制御信号OUT_SW3:Loレベル
制御信号OUT_SW2:Loレベル
制御信号OUT_SW1:Loレベル
制御信号LINE1:Hiレベル
制御信号LINE2:Loレベル
制御信号LINE3:Loレベル
制御信号LINE4:Loレベル
制御信号LINE5:Hiレベル
は、常にHiレベルである。すなわち、電子カメラ1が高速読み出しモードである場合、
開閉器43aおよび開閉器43eは、常に閉じている。一方、制御信号LINE2、LI
NE3、およびLINE4は、常にLoレベルである。
。1行q列、1行q+1列、2行q列、2行q+1列の画素20の選択トランジスタTd
がオン状態となる。1行q列の画素20がq列目の第1垂直信号線25aに接続され、1
行q+1列の画素20がq+1列目の第1垂直信号線25aに接続される。2行q列の画
素20がq列目の第2垂直信号線25bに接続され、2行q+1列の画素20がq+1列
目の第2垂直信号線25bに接続される。
、1行q列、1行q+1列、2行q列、2行q+1列の画素20がそれぞれリセット状態
になる。このとき、q列の第1垂直信号線25aには、1行q列の画素20からリセット
レベルの信号R1darkが出力される。q+1列の第1垂直信号線25aには、1行q
+1列の画素20からリセットレベルの信号Gr1darkが出力される。q列の第2垂
直信号線25bには、2行q列の画素20からリセットレベルの信号Gb1darkが出
力される。q+1列の第2垂直信号線25bには、2行q+1列の画素20からリセット
レベルの信号B1darkが出力される。
と共に、制御信号SAMPLEがHiレベルに切り替わる。q列目の下端側のカラム回路
31のA/D変換部51がリセットレベルの信号R1darkのサンプリングを開始する
。q+1列目の下端側のカラム回路31のA/D変換部51がリセットレベルの信号B1
darkのサンプリングを開始する。q列目の上端側のカラム回路31のA/D変換部5
1がリセットレベルの信号Gb1darkのサンプリングを開始する。q+1列目の上端
側のカラム回路31のA/D変換部51がリセットレベルの信号Gr1darkのサンプ
リングを開始する。
AMPに傾斜信号が入力され、制御信号TX(1)およびTX(2)がHiレベルに切り
替わる。q列目の下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾
斜信号が入力されている間、時間T63から時間T64までの期間にサンプリングしたリ
セットレベルの信号R1darkについてA/D変換する。q+1列目の下端側のカラム
回路31のA/D変換部51は、制御信号RAMPに傾斜信号が入力されている間、時間
T63から時間T64までの期間にサンプリングしたリセットレベルの信号B1dark
についてA/D変換する。q列目の上端側のカラム回路31のA/D変換部51は、制御
信号RAMPに傾斜信号が入力されている間、時間T63から時間T64までの期間にサ
ンプリングしたリセットレベルの信号Gb1darkについてA/D変換する。q+1列
目の上端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号が入力
されている間、時間T63から時間T64までの期間にサンプリングしたリセットレベル
の信号Gr1darkについてA/D変換する。
がオン状態となり、各画素20のフォトダイオードPDから各画素20のフローティング
ディフュージョンに電荷が転送される。以降、q列の第1垂直信号線25aには、1行q
列の画素20から信号レベルの信号R1signalが出力される。q+1列の第1垂直
信号線25aには、1行q+1列の画素20から信号レベルの信号Gr1signalが
出力される。q列の第2垂直信号線25bには、2行q列の画素20から信号レベルの信
号Gb1signalが出力される。q+1列の第2垂直信号線25aには、2行q+1
列の画素20から信号レベルの信号B1signalが出力される。
行q列、1行q+1列、2行q列、2行q+1列の画素20の転送トランジスタTaがオ
フ状態となり、電荷の転送が終了する。q列およびq+1列の第1垂直信号線25aおよ
び第2垂直信号線25bには、対応する信号レベルの信号が引き続き出力される。
MPLEがHiレベルに切り替わる。q列目の下端側のカラム回路31のA/D変換部5
1が信号レベルの信号R1signalのサンプリングを開始する。q+1列目の下端側
のカラム回路31のA/D変換部51が信号レベルの信号B1signalのサンプリン
グを開始する。q列目の上端側のカラム回路31のA/D変換部51が信号レベルの信号
Gb1signalのサンプリングを開始する。q+1列目の上端側のカラム回路31の
A/D変換部51が信号レベルの信号Gr1signalのサンプリングを開始する。
AMPに傾斜信号が入力される。q列目の下端側のカラム回路31のA/D変換部51は
、制御信号RAMPに傾斜信号が入力されている間、時間T66から時間T67までの期
間にサンプリングした信号レベルの信号R1signalについてA/D変換する。q+
1列目の下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号が
入力されている間、時間T66から時間T67までの期間にサンプリングした信号レベル
の信号B1signalについてA/D変換する。q列目の上端側のカラム回路31のA
/D変換部51は、制御信号RAMPに傾斜信号が入力されている間、時間T66から時
間T67までの期間にサンプリングした信号レベルの信号Gb1signalについてA
/D変換する。q+1列目の上端側のカラム回路31のA/D変換部51は、制御信号R
AMPに傾斜信号が入力されている間、時間T66から時間T67までの期間にサンプリ
ングした信号レベルの信号Gr1signalについてA/D変換する。
、制御信号SEL(3)およびSEL(4)がHiレベルに切り替わる。1行q列、1行
q+1列、2行q列、2行q+1列の画素20がオフ状態となり、3行q列、3行q+1
列、4行q列、4行q+1列の画素20がオン状態となる。1行q列の画素20がq列目
の第1垂直信号線25aから切断され、代わりに3行q列の画素20がq列目の第1垂直
信号線25aに接続される。1行q+1列の画素20がq+1列目の第1垂直信号線25
aから切断され、代わりに3行q+1列の画素20がq+1列目の第1垂直信号線25a
に接続される。2行q列の画素20がq列目の第2垂直信号線25bから切断され、代わ
りに4行q列の画素20がq列目の第2垂直信号線25bに接続される。2行q+1列の
画素20がq+1列目の第2垂直信号線25bから切断され、4行q+1列の画素20が
q+1列目の第2垂直信号線25bに接続される。
、3行q列、3行q+1列、4行q列、4行q+1列の画素20がリセット状態になる。
このとき、q列の第1垂直信号線25aには、3行q列の画素20からリセットレベルの
信号R2darkが出力される。q+1列の第1垂直信号線25aには、3行q+1列の
画素20からリセットレベルの信号Gr2darkが出力される。q列の第2垂直信号線
25bには、4行q列の画素20からリセットレベルの信号Gb2darkが出力される
。q+1列の第2垂直信号線25bには、4行q+1列の画素20からリセットレベルの
信号B2darkが出力される。
と共に、制御信号RAMPへの傾斜信号の入力が終わり、制御信号SAMPLEがHiレ
ベルに切り替わり、制御信号OUT_SW1がHiレベルに切り替わる。
q列目の下端側のカラム回路31のA/D変換部51がリセットレベルの信号R2da
rkのサンプリングを開始する。
q+1列目の下端側のカラム回路31のA/D変換部51がリセットレベルの信号B2
darkのサンプリングを開始する。
q列目の上端側のカラム回路31のA/D変換部51がリセットレベルの信号Gb2d
arkのサンプリングを開始する。
q+1列目の上端側のカラム回路31のA/D変換部51がリセットレベルの信号Gr
2darkのサンプリングを開始する。
が出力選択回路35へ出力される。下端側の出力選択回路35は、1行q列の画素20に
関する撮像信号R1bを出力する。
上端側の開閉器42cが閉じて、q列目の上端側のカラム回路31が生成した撮像信号
が出力選択回路35へ出力される。上端側の出力選択回路35は、2行q列の画素20に
関する撮像信号Gb1bを出力する。
AMPに傾斜信号が入力され、制御信号TX(3)およびTX(4)がHiレベルに切り
替わる。
q列目の下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号
が入力されている間、時間T70から時間T71までの期間にサンプリングしたリセット
レベルの信号R2darkについてA/D変換する。
q+1列目の下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜
信号が入力されている間、時間T70から時間T71までの期間にサンプリングしたリセ
ットレベルの信号B2darkについてA/D変換する。
q列目の上端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号
が入力されている間、時間T70から時間T71までの期間にサンプリングしたリセット
レベルの信号Gb2darkについてA/D変換する。
q+1列目の上端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜
信号が入力されている間、時間T70から時間T71までの期間にサンプリングしたリセ
ットレベルの信号Gr2darkについてA/D変換する。
タTaがオン状態となり、各画素20のフォトダイオードPDから各画素20のフローテ
ィングディフュージョンにそれぞれ電荷が転送される。以降、q列の第1垂直信号線25
aには、3行q列の画素20から信号レベルの信号R2signalが出力される。q+
1列の第1垂直信号線25aには、3行q+1列の画素20から信号レベルの信号Gr2
signalが出力される。q列の第2垂直信号線25bには、4行q列の画素20から
信号レベルの信号Gb2signalが出力される。q+1列の第2垂直信号線25aに
は、4行q+1列の画素20から信号レベルの信号B2signalが出力される。
行q列、3行q+1列、4行q列、および4行q+1列の画素20の転送トランジスタT
aがオフ状態となり、電荷の転送が終了する。q列およびq+1列の第1垂直信号線25
aおよび第2垂直信号線25bには、対応する信号レベルの信号が引き続き出力される。
MPLEがHiレベルに、制御信号OUT_SW1がLoレベルに、制御信号OUT_S
W2がHiレベルにそれぞれ切り替わる。
q列目の下端側のカラム回路31のA/D変換部51は、信号レベルの信号R2sig
nalのサンプリングを開始する。
q+1列目の下端側のカラム回路31のA/D変換部51は、信号レベルの信号B2s
ignalのサンプリングを開始する。
q列目の上端側のカラム回路31のA/D変換部51は、信号レベルの信号Gb2si
gnalのサンプリングを開始する。
q+1列目の上端側のカラム回路31のA/D変換部51は、信号レベルの信号Gr2
signalのサンプリングを開始する。
下端側の開閉器42dが閉じて、q+1列目の下端側のカラム回路31が生成した撮像
信号が出力選択回路35へ出力される。出力選択回路35は、4行q+1列の画素20に
関する撮像信号B1bを出力する。
上端側の開閉器42dが閉じて、q+1列目の上端側のカラム回路31が生成した撮像
信号が出力選択回路35へ出力される。出力選択回路35は、3行q+1列の画素20に
関する撮像信号Gr1bを出力する。
AMPに傾斜信号が入力される。q列目の下端側のカラム回路31のA/D変換部51は
、制御信号RAMPに傾斜信号が入力されている間、時間T73から時間T74までの期
間にサンプリングした信号レベルの信号R2signalについてA/D変換する。q+
1列目の下端側のカラム回路31のA/D変換部51は、制御信号RAMPに傾斜信号が
入力されている間、時間T73から時間T74までの期間にサンプリングした信号レベル
の信号B2signalについてA/D変換する。q列目の上端側のカラム回路31のA
/D変換部51は、制御信号RAMPに傾斜信号が入力されている間、時間T73から時
間T74までの期間にサンプリングした信号レベルの信号Gb2signalについてA
/D変換する。q+1列目の上端側のカラム回路31のA/D変換部51は、制御信号R
AMPに傾斜信号が入力されている間、時間T73から時間T74までの期間にサンプリ
ングした信号レベルの信号Gr2signalについてA/D変換する。
。3行q列、3行q+1列、4行q列、4行q+1列の画素20の選択トランジスタTd
がオフ状態となる。
3行q列の画素20がq列目の第1垂直信号線25aから切断され、3行q+1列の画
素20がq列目の第1垂直信号線25aから切断される。
4行q列の画素20がq列目の第2垂直信号線25bから切断され、4行q+1列の画
素20がq列目の第2垂直信号線25bから切断される。
T_SW2がLoレベルに切り替わり、制御信号OUT_SW1がHiレベルに切り替わ
る。
下端側の開閉器42cが閉じて、q列目の下端側のカラム回路31が生成した撮像信号
が出力選択回路35へ出力される。出力選択回路35は、3行q列の画素20に関する撮
像信号R2bを出力する。
上端側の開閉器42cが閉じて、q列目の上端側のカラム回路31が生成した撮像信号
が出力選択回路35へ出力される。出力選択回路35は、4行q列の画素20に関する撮
像信号Gb2bを出力する。
図10は、本発明の第3の実施の形態による固体撮像装置3の等価回路図である。第3
の実施の形態による固体撮像装置3は、イメージセンサ30と、カラム回路31と、平均
化演算器34と、出力選択回路35と、第4切替部37と、第5切替部38とを備える。
第1の実施の形態と同一の構成には、同一の符号を付し、その構成に関する説明を省略す
る。
0aの画素列ごとに第1垂直信号線25aおよび第2垂直信号線25bを備え、画素列の
両端にはカラム回路31が設けられている。
画素20の出力を上端側のカラム回路31と下端側のカラム回路31の両方に出力する。
上端側のカラム回路31と下端側のカラム回路31は、読み出し対象の画素20に関する
撮像信号をそれぞれ生成する。上端側のカラム回路31と下端側のカラム回路31が生成
した撮像信号は、平均化演算器34に出力されて、平均化される。
側に開閉器44cおよび44dを有する。
切替制御部4aは、p列目の画素列に設けられた開閉器44a、44b、44c、およ
び44dの各々を制御する制御信号LINE1(p)、LINE2(p)、LINE3(
p)、およびLINE4(p)を出力する。
れている。上端側の平均化演算器34は、奇数列目の画素列の両端に設けられたカラム回
路31が生成した撮像信号の平均を演算することに用いられる。下端側の平均化演算器3
4は、偶数列目の画素列の両端に設けられたカラム回路31が生成した撮像信号の平均を
演算することに用いられる。
備える。
開閉器45aは、上端側の出力信号線61aと上端側の平均化演算器34との間、下端
側の出力信号線61aと上端側の平均化演算器34との間にそれぞれ設けられている。
開閉器45bは、上端側の出力信号線61bと下端側の平均化演算器34との間、下端
側の出力信号線61bと下端側の平均化演算器34との間にそれぞれ設けられている。
開閉器45cは、上端側の出力信号線61aと上端側の出力選択回路35との間、下端
側の出力信号線61aと下端側の出力選択回路35との間にそれぞれ設けられている。
開閉器45dは、上端側の出力信号線61bと上端側の出力選択回路35との間、下端
側の出力信号線61bと下端側の出力選択回路35との間にそれぞれ設けられている。
0が読み出し対象となったとき、切替制御部4aは、図10に示すように第4切替部37
および第5切替部38を制御する。
図10に示す例では、切替制御部4aは、読み出し対象の画素20を含む画素列、すな
わちq列目およびq+1列目の画素列に設けられた開閉器44aおよび44cを閉じる。
また、切替制御部4aは、q列目およびq+1列目の画素列に設けられた開閉器44bお
よび44dを開く。なお、図10に図示していないが、切替制御部4aは、読み出し対象
の画素20を含まない画素列に設けられた開閉器44aおよび44cについても開いてい
る。
電子カメラ1が高感度撮影モードであるとき、切替制御部4aは、2個の開閉器45a
および2個の開閉器45bを閉じて、2個の開閉器45cおよび2個の開閉器45dを開
く。
象の画素20の信号がq列目の画素列の両端のカラム回路31に入力される。q列目の画
素列の両端に設けられたカラム回路31の各々で生成された撮像信号は、開閉器45aを
介して上端側の平均化演算器34に入力されて、それらの撮像信号の平均が演算される。
上端側の平均化演算器34の演算結果は、上端側の出力選択回路35に入力されて、外部
へ出力される。
31に入力される。q+1列目の画素列の両端に設けられたカラム回路31の各々で生成
された撮像信号は、開閉器45bを介して下端側の平均化演算器34に入力されて、それ
らの撮像信号の平均が演算される。下端側の平均化演算器34の演算結果は、下端側の出
力選択回路35に入力されて、外部へ出力される。
列、およびp+1行q+1列の画素20が読み出し対象となる。なお、ここでpは奇数で
あるものとする。
44dを閉じる。また、切替制御部4aは、他の画素列に設けられた開閉器44aおよび
44dと、すべての画素列に設けられた開閉器44bおよび44cとを開く。
cおよび2個の開閉器45dを閉じて、2個の開閉器45aおよび2個の開閉器45bを
開く。
p行q列の画素20からq列目の第1垂直信号線25aに出力される信号は、開閉器4
4aを介して、q列目の画素列の上端側のカラム回路31に読み出される。q列目の画素
列の上端側のカラム回路31が生成した撮像信号は、開閉器45cを介して上端側の出力
選択回路35から外部へ出力される。
p行q+1列の画素20からq+1列目の第1垂直信号線25aに出力される信号は、
開閉器44aを介して、q+1列目の画素列の上端側のカラム回路31に読み出される。
q+1列目の画素列の上端側のカラム回路31が生成した撮像信号は、開閉器45dを介
して上端側の出力選択回路35から外部へ出力される。
p+1行q列の画素20からq列目の第2垂直信号線25bに出力される信号は、開閉
器44dを介して、q列目の画素列の下端側のカラム回路31に読み出される。q列目の
画素列の下端側のカラム回路31が生成した撮像信号は、開閉器45cを介して下端側の
出力選択回路35から外部へ出力される。
p+1行q+1列の画素20からq+1列目の第2垂直信号線25bに出力される信号
は、開閉器44dを介して、q+1列目の画素列の下端側のカラム回路31に読み出され
る。q+1列目の画素列の下端側のカラム回路31が生成した撮像信号は、開閉器45d
を介して下端側の出力選択回路35から外部へ出力される。
第1、第2、および第3の実施の形態による固体撮像装置3は、高速読み出しモードと
高感度撮影モードとを有する電子カメラ1に用いられる。固体撮像装置3は、入射光量に
応じた信号レベルの信号を出力する複数の画素20が二次元状に配置された画素アレイ3
0aを有する。また、固体撮像装置3は、1または複数の垂直信号線25、25a、25
bとカラム回路31と平均化演算器34とを有する。垂直信号線25等の垂直信号線は、
複数の画素列の各々に設けられ、当該画素列に含まれる読み出し対象の画素20から信号
が出力される。カラム回路31は、複数の画素列の各々に設けられ、信号レベルの信号に
基づいて相関二重サンプリングの演算を行い、撮像信号を生成する。固体撮像装置3は、
第1切替部32、第3切替部36、または第4切替部37を備える。第1切替部32、第
3切替部36、または第4切替部37は、切替制御部4aの制御に基づいて、垂直信号線
25等の垂直信号線とカラム回路31との間を接続する。電子カメラ1が高速読み出しモ
ードであるとき、第1切替部32、第3切替部36、または第4切替部37は、読み出し
対象の画素20を含む画素列に設けられた垂直信号線と当該画素列に設けられたカラム回
路31との間を接続する。電子カメラ1が高感度撮影モードにあるとき、第1切替部32
、第3切替部36、または第4切替部37は、読み出し対象の画素20を含む画素列に設
けられた垂直信号線と複数のカラム回路31との間を接続する。平均化演算器34は、電
子カメラ1が高感度撮影モードであるとき、読み出し対象の画素20により出力された信
号レベルの信号に基づいて複数のカラム回路31が生成した撮像信号の平均を演算する。
固体撮像装置3は、高感度撮影モードのように、露光量を多くすることができない動作
モードにおいて、平均化演算器34を用いてノイズ成分を取り除いてSN比を向上させる
ことができる。
(変形例1)上記の各実施の形態では、図3および図7に示したように、イメージセンサ
30の画素20は、転送トランジスタTa、増幅トランジスタTb、リセットトランジス
タTc、および選択トランジスタTdをそれぞれ有していた。しかし、複数の画素の間で
一または複数のトランジスタを共用することにしてもよい。増幅トランジスタTb、リセ
ットトランジスタTc、および選択トランジスタTdを二つの画素で共有する場合の等価
回路図を図11に示す。
制御部4aは、垂直信号線25等の垂直信号線を二つのカラム回路31に接続することに
したが、垂直信号線を接続するカラム回路31の数量は2個に限定しない。たとえば、垂
直信号線と4個のカラム回路31との間を接続することにしてもよい。この場合、垂直信
号線と同時に接続されるカラム回路31の数と同数の出力信号線を設け、第2切替部33
または第5切替部38を介してそれらの出力信号線を平均化演算器34にそれぞれ接続す
ることが好ましい。垂直信号線と同時に接続するカラム回路31の個数、すなわち読み出
し対象の画素20の信号の入力先のカラム回路31の個数をc個に増やすと画像信号のノ
イズ成分は1/√cに低減される。
信号線を二つのカラム回路31に接続して、それらが出力する撮像信号の平均を演算する
ことにした。しかし、電子カメラ1が露光量を増加させることができないなどの理由を要
する高感度撮影モード以外の撮影モードである場合や、画像信号のノイズを低減させて撮
影したい場合にも、垂直信号線を複数のカラム回路31に接続することにしてもよい。
とを備えることにしたが、この構成だけに限定しない。たとえば、カラム回路31は、P
GA52を備えていなくてもよく、別の構成要素を備えることにしてもよい。
30aに配列される画素20の個数を2×4個としたが、あくまで例示であって、この個
数に限定されない。
い限り本発明はこれらの内容に限定されない。また、以上で説明した実施の形態や変形例
は発明の特徴が損なわれない限り組み合わせて実行してもよい。
3 固体撮像装置
4 撮像制御部
4a 切替制御部
7 マイクロプロセッサ
20 画素
25 垂直信号線
25a 第1垂直信号線
25b 第2垂直信号線
30 イメージセンサ
30a 画素アレイ
31 カラム回路
32 第1切替部
33 第2切替部
34 平均化演算器
35 出力選択回路
36 第3切替部
37 第4切替部
38 第5切替部
Claims (6)
- 第1方向に設けられ、光を光電変換して電荷を生成する第1光電変換部と第2光電変換部と、
前記第1方向と交差する第2方向に配線され、前記第1光電変換部で生成された電荷に基づく信号が出力される第1信号線と、
前記第2方向に配線され、前記第2光電変換部で生成された電荷に基づく信号が出力される第2信号線と、
前記第1信号線に出力された信号と前記第2信号線に出力された信号との少なくとも1方を処理する第1処理部と第2処理部と、
前記第1信号線と前記第2処理部との接続/非接続とを切替可能な第1切替部と、
前記第2信号線と前記第2処理部との接続/非接続とを切替可能な第2切替部と、
を備える撮像素子。 - 請求項1に記載の撮像素子において、
前記第1信号線と前記第1処理部との接続/非接続とを切替可能な第3切替部と、
前記第2信号線と前記第1処理部との接続/非接続とを切替可能な第4切替部と、を備える撮像素子。 - 請求項2に記載の撮像素子において、
前記第1信号線に出力された信号を前記第1処理部と前記第2処理部とで処理する第1制御と、前記第1信号線に出力された信号を前記第1処理部で処理し、前記第2信号線に出力された信号を前記第2処理部で処理する第2制御とを行う制御部を備える撮像素子。 - 請求項3に記載の撮像素子において、
前記制御部は、前記第1制御において、前記第1信号線と前記第2処理部とを前記第1切替部により接続させ、前記第2信号線と前記第2処理部とを前記第2切替部により非接続とし、前記第2制御において、前記第1信号線と前記第2処理部とを前記第1切替部により非接続とし、前記第2信号線と前記第2処理部とを前記第2切替部により接続させる撮像素子。 - 請求項3または4に記載の撮像素子において、
前記制御部は、前記第1制御において、前記第1信号線と前記第1処理部とを前記第3切替部により接続させ、前記第2信号線と前記第1処理部とを前記第4切替部により非接続とし、前記第2制御において、前記第1信号線と前記第1処理部とを前記第3切替部により接続させ、前記第2信号線と前記第1処理部とを前記第4切替部により非接続とする撮像素子。 - 請求項1から5のいずれか一項に記載の撮像素子と、
前記撮像素子から出力された信号に基づいて画像データを生成する生成部と、を備える撮像装置。
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