JP6665885B2 - Electro-optical device, method of manufacturing the same, and electronic equipment - Google Patents

Electro-optical device, method of manufacturing the same, and electronic equipment Download PDF

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Description

本発明は、電気光学装置及びその製造方法、電子機器に関する。   The present invention relates to an electro-optical device, a method for manufacturing the same, and an electronic apparatus.

電気光学装置の一例として、有機エレクトロルミネッセンス(EL:Electro Luminescence)素子を用いた画素が素子基板の表示領域にマトリックス状に配置された有機EL装置が提案されている(例えば、特許文献1を参照。)。   As an example of an electro-optical device, an organic EL device has been proposed in which pixels using an organic electroluminescence (EL) element are arranged in a matrix in a display region of an element substrate (for example, see Patent Document 1). .).

具体的に、特許文献1には、反射層、第1の電極(画素電極)、発光層及び第2の電極(対向電極)が順に積層された有機EL素子を有するトップエミッション構造の有機EL装置が開示されている。   Specifically, Patent Document 1 discloses an organic EL device having a top emission structure including an organic EL element in which a reflective layer, a first electrode (pixel electrode), a light emitting layer, and a second electrode (a counter electrode) are sequentially stacked. Is disclosed.

特開2010−198754号公報Japanese Patent Application Laid-Open No. 2010-198754

ところで、特許文献1に記載の有機EL装置では、表示領域の外側の周辺領域に、データ線駆動回路や走査線駆動回路などを実装するための実装端子、外部接続用端子等を含む複数の端子が配列されている。これらの端子は、上述した反射層と同一プロセスで成膜されるアルミニウム(Al)などの反射導電材料と、第1の電極と同一プロセスで成膜される酸化インジウムスズ(ITO:Indium Tin Oxide)などの透明導電材料とを積層した構造を有している。   By the way, in the organic EL device described in Patent Literature 1, a plurality of terminals including a mounting terminal for mounting a data line driving circuit, a scanning line driving circuit, and the like, an external connection terminal, and the like are provided in a peripheral region outside a display region. Are arranged. These terminals are made of a reflective conductive material such as aluminum (Al) formed in the same process as the above-described reflective layer, and indium tin oxide (ITO) formed in the same process as the first electrode. And a transparent conductive material such as a transparent conductive material.

しかしながら、上述した反射導電材料と透明導電材料とを直接積層した場合には、端子におけるコンタクト抵抗が非常に高くなる。また、反射導電材料と透明導電材料との間で電蝕が生じることもある。この対策として、端子を別プロセスにより作製することも考えられるが、工程数の増加によって製造コストが嵩むことになる。   However, when the reflective conductive material and the transparent conductive material described above are directly laminated, the contact resistance at the terminal becomes extremely high. Further, electrolytic corrosion may occur between the reflective conductive material and the transparent conductive material. As a countermeasure, it is conceivable to manufacture the terminals by another process, but the manufacturing cost increases due to an increase in the number of steps.

一方、引用文献1には、チタン(又は窒化チタン)とアルミニウムとチタン(又は窒化チタン)とを積層した配線層の上にITOを積層した端子が開示されている。しかしながら、この配線層と同じ材料を反射層に用いた場合には、反射層の反射率が低下するおそれがある。   On the other hand, Patent Literature 1 discloses a terminal in which ITO is stacked on a wiring layer in which titanium (or titanium nitride), aluminum, and titanium (or titanium nitride) are stacked. However, when the same material as the wiring layer is used for the reflective layer, the reflectivity of the reflective layer may be reduced.

本発明の一つの態様は、このような従来の事情に鑑みて提案されたものであり、反射電極の反射率が低下することを防ぎつつ、端子の抵抗値を下げることを可能とした電気光学装置及びその製造方法、並びにそのような電気光学装置を備えた電子機器を提供することを目的の一つとしている。   One aspect of the present invention has been proposed in view of such a conventional situation, and has made it possible to reduce the terminal resistance while preventing the reflectance of the reflective electrode from decreasing. It is an object to provide an apparatus, a method for manufacturing the same, and an electronic apparatus including such an electro-optical device.

本発明の一つの態様に係る電気光学装置は、複数の発光素子がマトリックス状に配列された表示領域と、前記表示領域の外側に端子が配置された周辺領域と、含む素子基板を備え、前記発光素子は、反射電極と、前記反射電極を覆う絶縁層と、光路調整層と、第1の電極と、画素分離層と、発光層と、第2の電極と、が積層され、前記第1の電極がコンタクト電極と電気的に接続された構造を有し、前記端子は、前記反射電極と同じ第1の導電膜により形成される第1の端子層と、前記コンタクト電極と同じ第2の導電膜により形成される第2の端子層と、前記第1の電極と同じ第3の導電膜により形成される第3の端子層と、が積層された構造を有し、前記画素分離層は、前記第1の電極の一部を露出させる開口部を有し、平面視で前記コンタクト電極は、前記開口部と重なっておらず、平面視で隣り合う2つの前記開口部の間の領域において、前記光路調整層の端部と前記コンタクト電極の一部とが互いに重なり、平面視で前記開口部と重ならない領域に、前記絶縁層を貫通するコンタクトホールが設けられ、前記コンタクト電極は、前記コンタクトホールを介して前記反射電極に電気的に接続され、前記コンタクト電極の一部の面上に、前記光路調整層が設けられ、前記コンタクト電極の他の一部の面上に、前記光路調整層が設けられていない部位が設けられ、前記第1の電極は、前記部位においてコンタクト電極と電気的に接続されているElectro-optical device according to one embodiment of the present invention includes a display region in which a plurality of light emitting elements are arranged in a matrix, and a peripheral area where the terminal on the outside of the display region is disposed, the device substrate including, The light emitting element includes a reflective electrode , an insulating layer covering the reflective electrode, an optical path adjustment layer, a first electrode, a pixel separation layer, a light emitting layer, and a second electrode, which are stacked. One electrode is electrically connected to a contact electrode; the terminal is a first terminal layer formed of the same first conductive film as the reflective electrode; and a second terminal layer is the same as the contact electrode. And a third terminal layer formed of the same third conductive film as that of the first electrode. Has an opening for exposing a portion of the first electrode, and Ntakuto electrode is not overlapped with the opening, in the area between the two said adjacent openings in plan view, Ri part and heavy Do each other of the contact electrode and the end portion of the optical path adjusting layer, A contact hole penetrating the insulating layer is provided in a region that does not overlap with the opening in plan view, and the contact electrode is electrically connected to the reflection electrode via the contact hole, and one of the contact electrodes The optical path adjustment layer is provided on the surface of the part, and a part where the optical path adjustment layer is not provided is provided on another part of the surface of the contact electrode, and the first electrode is provided on the part Are electrically connected to the contact electrodes .

この構成によれば、端子において、反射電極と同じ第1の導電膜により形成される第1の端子層と、第1の電極と同じ第3の導電膜により形成される第3の端子層との間に、コンタクト電極と同じ第2の導電膜により形成される第2の端子層を設けることで、反射電極の反射率が低下することを防ぎつつ、端子の抵抗値を下げることが可能である。   According to this configuration, in the terminal, the first terminal layer formed of the same first conductive film as the reflective electrode and the third terminal layer formed of the same third conductive film as the first electrode are used. By providing a second terminal layer formed of the same second conductive film as the contact electrode between them, the resistance value of the terminal can be reduced while preventing the reflectance of the reflective electrode from decreasing. is there.

また、上記電気光学装置において、第3の導電膜は、透明導電材料を含み、第2の導電膜は、第3の導電膜よりも導電性の高い導電材料を含み、第1の導電膜は、反射導電材料を含む構成であってもよい。   In the electro-optical device, the third conductive film includes a transparent conductive material, the second conductive film includes a conductive material having higher conductivity than the third conductive film, and the first conductive film includes And a reflective conductive material.

この構成によれば、端子において、反射導電材料を含む第1の導電膜と、透明導電材料を含む第3の導電膜との間に、第3の導電膜よりも導電性の高い導電材料を含む第2の導電膜を設けることで、反射導電材料と透明導電材料とが直接積層される場合よりも、端子の抵抗値を下げることが可能である。また、反射電極は、反射導電材料を含む第1の導電膜により形成されるため、この反射電極の反射率が低下することを防ぐことができる。   According to this structure, a conductive material having higher conductivity than the third conductive film is provided between the first conductive film including the reflective conductive material and the third conductive film including the transparent conductive material in the terminal. With the provision of the second conductive film including the reflective conductive material and the transparent conductive material, the resistance of the terminal can be reduced as compared with the case where the reflective conductive material and the transparent conductive material are directly stacked. Further, since the reflective electrode is formed of the first conductive film containing a reflective conductive material, it is possible to prevent the reflectance of the reflective electrode from being reduced.

また、上記電気光学装置において、第3の導電膜は、酸化インジウムスズを含み、第2の導電膜は、窒化チタンを含み、第1の導電膜は、アルミニウム及び銅を含む構成であってもよい。   In the above electro-optical device, the third conductive film contains indium tin oxide, the second conductive film contains titanium nitride, and the first conductive film contains aluminum and copper. Good.

この構成によれば、端子において、アルミニウム及び銅を含む第1の導電膜と、酸化インジウムスズを含む第3の導電膜との間に、窒化チタンを含む第2の導電膜を設けることで、端子の抵抗値を下げることが可能である。また、反射電極は、アルミニウム及び銅を含む第1の導電膜により形成されるため、この反射電極の反射率が低下することを防ぐことができる。   According to this structure, in the terminal, the second conductive film containing titanium nitride is provided between the first conductive film containing aluminum and copper and the third conductive film containing indium tin oxide, It is possible to reduce the resistance value of the terminal. Further, since the reflective electrode is formed of the first conductive film containing aluminum and copper, it is possible to prevent the reflectance of the reflective electrode from decreasing.

また、上記電気光学装置において、第1の電極は、コンタクト電極を介して反射電極と電気的に接続され、反射電極は、画素毎に分割して配置されると共に、発光素子を駆動するトランジスターと電気的に接続されている構成であってもよい。   In the electro-optical device, the first electrode is electrically connected to the reflective electrode through the contact electrode, and the reflective electrode is divided for each pixel, and includes a transistor for driving a light-emitting element. An electrically connected configuration may be used.

この構成によれば、反射電極を介してトランジスターと第1の電極とが電気的に接続されるため、反射電極と第1の電極とが同電位となる。これにより、トランジスターから反射電極を介して第1の電極に印加される電位を制御しながら、信頼性の高い発光素子の発光動作を行うことが可能である。また、この構成によれば、歩留まりの更なる向上を図ることが可能である。   According to this configuration, the transistor and the first electrode are electrically connected via the reflective electrode, so that the reflective electrode and the first electrode have the same potential. Accordingly, a highly reliable light-emitting operation of the light-emitting element can be performed while controlling a potential applied from the transistor to the first electrode through the reflective electrode. According to this configuration, it is possible to further improve the yield.

また、上記電気光学装置において、反射電極は、電源線の一部により構成され、反射電極に形成された開口の内側に、発光素子を駆動するトランジスターと電気的に接続される中継電極が配置され、第1の電極は、コンタクト電極を介して中継電極と電気的に接続されている構成であってもよい。   In the electro-optical device, the reflective electrode is formed by a part of a power supply line, and a relay electrode electrically connected to a transistor for driving a light emitting element is arranged inside an opening formed in the reflective electrode. The first electrode may be configured to be electrically connected to the relay electrode via the contact electrode.

この構成によれば、開口から入射する光をコンタクト電極で遮光することによって、表示品質を向上させることが可能である。   According to this configuration, it is possible to improve display quality by blocking the light incident from the opening with the contact electrode.

また、本発明の一つの態様に係る電子機器は、上記何れかの電気光学装置を備えることを特徴とする。   According to another aspect of the invention, an electronic apparatus includes any one of the above-described electro-optical devices.

この構成によれば、反射電極の反射率が低下することを防ぎつつ、端子の抵抗値を下げることを可能とした電気光学装置を備えた電子機器を提供することが可能である。   According to this configuration, it is possible to provide an electronic apparatus including an electro-optical device capable of lowering the resistance value of the terminal while preventing the reflectance of the reflective electrode from lowering.

また、本発明の一つの態様に係る電気光学装置の製造方法は、複数の発光素子がマトリックス状に配列された表示領域と、前記表示領域の外側に端子が配置された周辺領域と、含み、前記発光素子は、反射電極と、前記反射電極を覆う絶縁層と、光路調整層と、第1の電極と、画素分離層と、発光層と、第2の電極と、が積層され、前記第1の電極がコンタクト電極と電気的に接続された構造を有し、前記端子は、第1の端子層と、第2の端子層と、第3の端子層と、が積層された構造を有し、前記画素分離層は、前記第1の電極の一部を露出させる開口部を有し、平面視で前記コンタクト電極は、前記開口部と重なっておらず、平面視で隣り合う2つの前記開口部の間の領域において、前記光路調整層の端部と前記コンタクト電極の一部とが互いに重なり、平面視で前記開口部と重ならない領域に、前記絶縁層を貫通するコンタクトホールが設けられ、前記コンタクト電極は、前記コンタクトホールを介して前記反射電極に電気的に接続され、前記コンタクト電極の一部の面上に、前記光路調整層が設けられ、前記コンタクト電極の他の一部の面上に、前記光路調整層が設けられていない部位が設けられ、前記第1の電極は、前記部位においてコンタクト電極と電気的に接続されている電気光学装置の製造方法であって、第1の導電膜を形成し、前記第1の導電膜をパターニングすることによって、前記表示領域に前記反射電極を形成し、前記周辺領域に前記第1の端子層を形成する工程と、第2の導電膜を形成し、前記第2の導電膜をパターニングすることによって、前記表示領域に前記コンタクト電極を形成し、前記周辺領域において前記第1の端子層の上に前記第2の端子層を積層する工程と、第3の導電膜を形成し、前記第3の導電膜をパターニングすることによって、前記表示領域に前記第1の電極を形成し、前記周辺領域において前記第2の端子層の上に前記第3の端子層を積層する工程と、を含む。
Further, a method of manufacturing an electro-optical device according to one aspect of the present invention includes a display region in which a plurality of light emitting elements are arranged in a matrix, and a peripheral area where the terminal on the outside of the display area is arranged, the The light emitting element, a reflective electrode , an insulating layer covering the reflective electrode, an optical path adjustment layer, a first electrode, a pixel separation layer, a light emitting layer, and a second electrode are stacked, The terminal has a structure in which a first electrode is electrically connected to a contact electrode, and the terminal has a structure in which a first terminal layer, a second terminal layer, and a third terminal layer are stacked. The pixel separation layer has an opening that exposes a part of the first electrode, and the contact electrode does not overlap with the opening in plan view, and two adjacent electrodes in plan view. In a region between the openings, an end of the optical path adjustment layer and a part of the contact electrode Ri but heavy Do one another, in a region which does not overlap with the opening in a plan view, the insulating layer contact hole penetrating is provided, said contact electrode is electrically connected to the reflective electrode through the contact hole An optical path adjusting layer provided on a part of the surface of the contact electrode, and a part where the optical path adjusting layer is not provided on another part of the surface of the contact electrode; The method of manufacturing an electro-optical device , wherein the electrode is electrically connected to a contact electrode at the portion, wherein the first conductive film is formed, and the first conductive film is patterned to form the display. Forming the reflective electrode in a region, forming the first terminal layer in the peripheral region, forming a second conductive film, and patterning the second conductive film, Forming the contact electrode in a region, laminating the second terminal layer on the first terminal layer in the peripheral region, forming a third conductive film, and forming the third conductive film Forming the first electrode in the display region by patterning, and laminating the third terminal layer on the second terminal layer in the peripheral region.

この方法によれば、第1の端子層に反射電極と同じ第1の導電膜と、第2の端子層にコンタクト電極と同じ第2の導電膜と、第3の端子層に第1の電極と同じ第3の導電膜とを用いて、発光素子を作製するプロセス中で、第1の端子層と、第2の端子層と、第3の端子層とが積層された端子を作製することが可能である。また、反射電極の反射率が低下することを防ぎつつ、端子の抵抗値を下げることが可能である。   According to this method, the first terminal layer has the same first conductive film as the reflective electrode, the second terminal layer has the same second conductive film as the contact electrode, and the third terminal layer has the first electrode. Forming a terminal in which a first terminal layer, a second terminal layer, and a third terminal layer are stacked in a process of manufacturing a light-emitting element by using the same third conductive film as that of the first embodiment. Is possible. In addition, it is possible to reduce the resistance value of the terminal while preventing the reflectance of the reflective electrode from decreasing.

また、上記電気光学装置の製造方法において、第3の導電膜は、透明導電材料を含み、第2の導電膜は、第3の導電膜よりも導電性の高い導電材料を含み、第1の導電膜は、反射導電材料を含む方法であってもよい。   In the method for manufacturing an electro-optical device, the third conductive film includes a transparent conductive material, the second conductive film includes a conductive material having higher conductivity than the third conductive film, The conductive film may be a method including a reflective conductive material.

この方法によれば、作製される端子において、反射導電材料を含む第1の導電膜と、透明導電材料を含む第3の導電膜との間に、第3の導電膜よりも導電性の高い導電材料を含む第2の導電膜を形成することで、反射導電材料と透明導電材料とが直接積層される場合よりも、端子の抵抗値を下げることが可能である。また、反射電極は、反射導電材料を含む第1の導電膜により形成されるため、この反射電極の反射率が低下することを防ぐことができる。   According to this method, in a terminal to be manufactured, a higher conductivity than the third conductive film is provided between the first conductive film including the reflective conductive material and the third conductive film including the transparent conductive material. By forming the second conductive film including a conductive material, the resistance value of the terminal can be lower than in the case where the reflective conductive material and the transparent conductive material are directly stacked. Further, since the reflective electrode is formed of the first conductive film containing a reflective conductive material, it is possible to prevent the reflectance of the reflective electrode from being reduced.

また、上記電気光学装置の製造方法において、第3の導電膜は、酸化インジウムスズを含み、第2の導電膜は、窒化チタンを含み、第1の導電膜は、アルミニウムと銅とを含む方法であってもよい。   In the method for manufacturing an electro-optical device, the third conductive film includes indium tin oxide, the second conductive film includes titanium nitride, and the first conductive film includes aluminum and copper. It may be.

この方法によれば、作製される端子において、アルミニウム及び銅を含む第1の導電膜と、酸化インジウムスズを含む第3の導電膜との間に、窒化チタンを含む第2の導電膜を形成することで、端子の抵抗値を下げることが可能である。また、反射電極は、アルミニウム及び銅を含む第1の導電膜により形成されるため、この反射電極の反射率が低下することを防ぐことができる。   According to this method, a second conductive film containing titanium nitride is formed between the first conductive film containing aluminum and copper and the third conductive film containing indium tin oxide in a terminal to be manufactured. By doing so, it is possible to reduce the resistance value of the terminal. Further, since the reflective electrode is formed of the first conductive film containing aluminum and copper, it is possible to prevent the reflectance of the reflective electrode from decreasing.

本発明の一実施形態に係る有機EL装置の構成を示す平面図である。FIG. 1 is a plan view illustrating a configuration of an organic EL device according to an embodiment of the present invention. 図1に示す有機EL装置が備える素子基板の構成を示す回路図である。FIG. 2 is a circuit diagram illustrating a configuration of an element substrate included in the organic EL device illustrated in FIG. 1. 図1に示す有機EL装置が備える画素回路の構成を示す回路図である。FIG. 2 is a circuit diagram illustrating a configuration of a pixel circuit included in the organic EL device illustrated in FIG. 1. 図1に示す有機EL装置が備える画素の構成を示す平面図である。FIG. 2 is a plan view illustrating a configuration of a pixel included in the organic EL device illustrated in FIG. 1. (a)図4中に示す線分A─A’による断面図、(b)(a)中に示す一部の画素を拡大した断面図である。FIG. 5A is a cross-sectional view taken along line A′A ′ shown in FIG. 4, and FIG. 5B is an enlarged cross-sectional view of some pixels shown in FIG. (a)図4中に示す線分B─B’による断面図、(b)図4中に示す線分C─C’による断面図、(c)図4中に示す線分D─D’による断面図である。4A is a sectional view taken along line B─B ′ shown in FIG. 4, FIG. 4B is a sectional view taken along line C─C ′ shown in FIG. 4, and FIG. 4C is a sectional view taken along line D─D ′ shown in FIG. FIG. 図1に示す有機EL装置の表示領域と周辺領域との間における断面図である。FIG. 2 is a cross-sectional view between a display area and a peripheral area of the organic EL device shown in FIG. 1. (a)端子の構成を示す平面図、(b)(a)中に示す線分E−E’による断面図である。(A) is a plan view showing a configuration of a terminal, and (b) is a sectional view taken along line E-E 'shown in (a). 図1に示す有機EL装置の製造工程を説明するための断面図である。FIG. 2 is a cross-sectional view for explaining a manufacturing process of the organic EL device shown in FIG. 1. 本発明の一実施形態に係る有機EL装置が備える画素の別の構成例を示す平面図である。FIG. 6 is a plan view illustrating another configuration example of a pixel included in the organic EL device according to an embodiment of the present invention. 図10中に示す線分E─E’による断面図である。FIG. 11 is a sectional view taken along line E′E ′ shown in FIG. 10. 有機EL装置を備えた電子機器の一例を示す概略図である。It is a schematic diagram showing an example of electronic equipment provided with an organic EL device.

(有機EL装置)
先ず、本発明の一実施形態として図1に示す有機EL装置100について説明する。
有機EL装置100は、本発明における「電気光学装置」の一例として示す自発光型の表示装置である。なお、図1は、有機EL装置100の構成を模式的に示す平面図である。
(Organic EL device)
First, an organic EL device 100 shown in FIG. 1 will be described as one embodiment of the present invention.
The organic EL device 100 is a self-luminous display device shown as an example of the “electro-optical device” in the present invention. FIG. 1 is a plan view schematically showing the configuration of the organic EL device 100.

有機EL装置100は、図1に示すように、素子基板10と、保護基板70とを有している。素子基板10と保護基板70とは、互いに対向した状態で、図示を省略する接着剤によって接合されている。なお、接着剤には、例えばエポキシ樹脂やアクリル樹脂などを使用することができる。   The organic EL device 100 has an element substrate 10 and a protection substrate 70 as shown in FIG. The element substrate 10 and the protection substrate 70 are joined to each other by an adhesive (not shown) in a state of facing each other. Note that, for example, an epoxy resin or an acrylic resin can be used as the adhesive.

素子基板10は、発光素子として、青色(B)光を発する有機EL素子30Bが配置された画素20Bと、緑色(G)の光を発する有機EL素子30Gが配置された画素20Gと、赤色(R)の光を発する有機EL素子30Rが配置された画素20Rとがマトリックス状に配列された表示領域Eを有している。   The element substrate 10 includes, as light emitting elements, a pixel 20B on which an organic EL element 30B emitting blue (B) light is arranged, a pixel 20G on which an organic EL element 30G emitting green (G) light is arranged, and a red ( The pixel 20R in which the organic EL element 30R that emits light R) is disposed has a display region E in which the pixels 20R are arranged in a matrix.

有機EL装置100では、画素20Bと画素20Gと画素20Rとが表示単位となってフルカラーの表示が提供される。なお、以降の説明では、画素20B、画素20G及び画素20Rをまとめて画素20として扱う場合があり、有機EL素子30B、有機EL素子30G及び有機EL素子30Rをまとめて有機EL素子30として扱う場合がある。   In the organic EL device 100, the pixel 20B, the pixel 20G, and the pixel 20R serve as a display unit to provide a full-color display. In the following description, the pixel 20B, the pixel 20G, and the pixel 20R may be collectively treated as the pixel 20, and the organic EL element 30B, the organic EL element 30G, and the organic EL element 30R may be collectively treated as the organic EL element 30. There is.

表示領域Eには、カラーフィルター層50が設けられている。カラーフィルター層50のうち、画素20Bの有機EL素子30Bの上には、青色のカラーフィルター層50Bが配置され、画素20Gの有機EL素子30Gの上には、緑色のカラーフィルター層50Gが配置され、画素20Rの有機EL素子30Rの上には、赤色のカラーフィルター層50Rが配置されている。   In the display area E, a color filter layer 50 is provided. In the color filter layer 50, a blue color filter layer 50B is disposed on the organic EL element 30B of the pixel 20B, and a green color filter layer 50G is disposed on the organic EL element 30G of the pixel 20G. The red color filter layer 50R is disposed on the organic EL element 30R of the pixel 20R.

本実施形態では、同色の発光が得られる画素20がY方向(第1の方向)に配列し、異なる色の発光が得られる画素20がY方向に対して交差(直交)するX方向(第2の方向)に配列している。したがって、画素20の配置は、所謂ストライプ方式となっている。
この画素の配列に応じて、有機EL素子30B、有機EL素子30G及び有機EL素子30Rはそれぞれストライプ状に配置されており、青色のカラーフィルター層50B、緑色のカラーフィルター層50G、赤色のカラーフィルター層50Rもまたストライプ状に配置されている。なお、画素20の配置は、ストライプ方式に限定されず、モザイク方式、デルタ方式であってもよい。
In the present embodiment, the pixels 20 that emit light of the same color are arranged in the Y direction (first direction), and the pixels 20 that emit light of different colors intersect (perpendicularly) with the Y direction. 2 direction). Therefore, the arrangement of the pixels 20 is of a so-called stripe type.
The organic EL element 30B, the organic EL element 30G, and the organic EL element 30R are respectively arranged in a stripe shape according to the pixel arrangement, and the blue color filter layer 50B, the green color filter layer 50G, the red color filter The layer 50R is also arranged in a stripe shape. Note that the arrangement of the pixels 20 is not limited to the stripe method, and may be a mosaic method or a delta method.

有機EL装置100は、トップエミッション構造を有している。したがって、有機EL素子30で発せられた光は、素子基板10のカラーフィルター層50を透過して保護基板70の側から表示光として射出される。   The organic EL device 100 has a top emission structure. Therefore, light emitted from the organic EL element 30 passes through the color filter layer 50 of the element substrate 10 and is emitted as display light from the protective substrate 70 side.

有機EL装置100がトップエミッション構造であることから、素子基板10の基材には、透明な石英基板やガラス基板などに加えて、不透明なセラミック基板や半導体基板などを用いることができる。本実施形態では、素子基板10の基材として、シリコン基板(半導体基板)を使用している。   Since the organic EL device 100 has a top emission structure, an opaque ceramic substrate, a semiconductor substrate, or the like can be used as the base of the element substrate 10 in addition to a transparent quartz substrate, a glass substrate, or the like. In the present embodiment, a silicon substrate (semiconductor substrate) is used as a base material of the element substrate 10.

表示領域Eの外側には、外部接続用端子103が配列された周辺領域Fが設けられている。周辺領域Fには、素子基板10の長辺側の一辺に沿って、複数の外部接続用端子103が配列されている。また、複数の外部接続用端子103と表示領域Eとの間には、データ線駆動回路101が設けられている。また、素子基板10の短辺側の二辺と表示領域Eとの間には、走査線駆動回路102が設けられている。なお、以降の説明では、素子基板10の長辺に沿った方向をX方向とし、素子基板10の短辺に沿った方向をY方向とし、保護基板70から素子基板10に向かう方向をZ(+)方向とする。   Outside the display area E, a peripheral area F in which the external connection terminals 103 are arranged is provided. In the peripheral area F, a plurality of external connection terminals 103 are arranged along one long side of the element substrate 10. A data line driving circuit 101 is provided between the plurality of external connection terminals 103 and the display area E. Further, a scanning line driving circuit 102 is provided between the two short sides of the element substrate 10 and the display area E. In the following description, the direction along the long side of the element substrate 10 is defined as the X direction, the direction along the short side of the element substrate 10 is defined as the Y direction, and the direction from the protection substrate 70 toward the element substrate 10 is defined as Z ( +) Direction.

保護基板70は、素子基板10よりも小さく、外部接続用端子103が露出されるように素子基板10と対向して配置されている。保護基板70は、透光性の基板であり、石英基板やガラス基板などを使用することができる。保護基板70は、表示領域Eに配置された有機EL素子30が傷つかないように保護する役割を有し、表示領域Eよりも広く設けられている。   The protection substrate 70 is smaller than the element substrate 10 and is arranged to face the element substrate 10 so that the external connection terminals 103 are exposed. The protection substrate 70 is a light-transmitting substrate, and a quartz substrate, a glass substrate, or the like can be used. The protection substrate 70 has a role of protecting the organic EL elements 30 arranged in the display area E from being damaged, and is provided wider than the display area E.

図2は、素子基板10の構成を示す回路図である。素子基板10には、図2に示すように、m行の走査線12がX方向に延在して設けられ、n列のデータ線14がY方向に延在して設けられている。また、素子基板10には、データ線14に沿って列毎に電源線19がY方向に延在して設けられている。   FIG. 2 is a circuit diagram showing a configuration of the element substrate 10. As shown in FIG. 2, on the element substrate 10, m rows of scanning lines 12 are provided extending in the X direction, and n columns of data lines 14 are provided extending in the Y direction. The element substrate 10 is provided with a power supply line 19 extending in the Y direction for each column along the data line 14.

素子基板10には、m行の走査線12とn列のデータ線14との交差部に対応して、画素回路110が設けられている。画素回路110は、画素20の一部をなす。表示領域Eには、m行×n列の画素回路110が、マトリックス状に配列されている。   Pixel circuits 110 are provided on the element substrate 10 corresponding to intersections of the m rows of scanning lines 12 and the n columns of data lines 14. The pixel circuit 110 forms a part of the pixel 20. In the display region E, m rows × n columns of pixel circuits 110 are arranged in a matrix.

電源線19には、初期化用のリセット電位Vorstが供給(給電)されている。さらに、図示を省略するが、制御信号Gcmp,Gel,Gorstを供給する3つの制御線が、走査線12に並行して設けられている。   A reset potential Vorst for initialization is supplied (supplied) to the power supply line 19. Although not shown, three control lines for supplying control signals Gcmp, Gel, and Gorst are provided in parallel with the scanning lines 12.

走査線12は、走査線駆動回路102に電気的に接続されている。データ線14は、データ線駆動回路101に電気的に接続されている。走査線駆動回路102には、走査線駆動回路102を制御するための制御信号Ctr1が供給されている。データ線駆動回路101には、データ線駆動回路101を制御するための制御信号Ctr2が供給されている。   The scanning line 12 is electrically connected to the scanning line driving circuit 102. The data line 14 is electrically connected to the data line driving circuit 101. The scanning line driving circuit 102 is supplied with a control signal Ctr1 for controlling the scanning line driving circuit 102. The data line driving circuit 101 is supplied with a control signal Ctr2 for controlling the data line driving circuit 101.

走査線駆動回路102は、フレームの期間にわたって走査線12を1行毎に走査するための走査信号Gwr(1)、Gwr(2)、Gwr(3)、…、Gwr(m− 1)、Gwr(m)を、制御信号Ctr1に従って生成する。さらに、走査線駆動回路102は、走査信号Gwrの他に、制御信号Gcmp,Gel,Gorstを制御線に供給する。なお、フレームの期間とは、有機EL装置100で1カット(コマ)分の画像が表示される期間であり、例えば同期信号に含まれる垂直同期信号の周波数が120Hzであれば、1フレームの期間は約8.3ミリ秒となる。   The scanning line driving circuit 102 scans the scanning lines 12 row by row over the period of the frame, and the scanning signals Gwr (1), Gwr (2), Gwr (3),..., Gwr (m−1), Gwr (M) is generated according to the control signal Ctr1. Further, the scanning line driving circuit 102 supplies control signals Gcmp, Gel, and Gorst to the control line in addition to the scanning signal Gwr. Note that the frame period is a period during which an image for one cut (frame) is displayed on the organic EL device 100. For example, if the frequency of the vertical synchronization signal included in the synchronization signal is 120 Hz, one frame period Is about 8.3 milliseconds.

データ線駆動回路101は、走査線駆動回路102によって選択された行に位置する画素回路110に対し、当該画素回路110の諧調データに応じた電位のデータ信号Vd(1)、Vd(2)、…、Vd(n)を、1、2、…、n列目のデータ線14に供給する。   The data line driving circuit 101 supplies data signals Vd (1), Vd (2) of potentials corresponding to the gradation data of the pixel circuit 110 to the pixel circuits 110 located in the row selected by the scanning line driving circuit 102. , Vd (n) are supplied to the data lines 14 of the first, second, ..., nth columns.

図3は、画素回路110の構成を示す回路図である。画素回路110は、図3に示すように、PチャネルMOS型のトランジスター121,122,123,124,125と、有機EL素子30と、容量21とを有している。画素回路110には、上述した走査信号Gwrや制御信号Gcmp,Gel,Gorstなどが供給される。   FIG. 3 is a circuit diagram showing a configuration of the pixel circuit 110. As shown in FIG. 3, the pixel circuit 110 includes P-channel MOS transistors 121, 122, 123, 124, and 125, an organic EL element 30, and a capacitor 21. The above-described scanning signal Gwr, control signals Gcmp, Gel, Gorst, and the like are supplied to the pixel circuit 110.

有機EL素子30は、互いに対向する画素電極(第1の電極)31と対向電極(第2の電極)33とで発光機能層(発光層)32を挟持した構造を有している。   The organic EL element 30 has a structure in which a light emitting functional layer (light emitting layer) 32 is sandwiched between a pixel electrode (first electrode) 31 and a counter electrode (second electrode) 33 facing each other.

画素電極31は、発光機能層32に正孔を供給するアノードであり、光透過性有する導電材料により形成されている。本実施形態では、画素電極31として、例えば膜厚200nmのITO(Indium Tin Oxide)膜を形成している。画素電極31は、トランジスター124のドレイン及びトランジスター125のソース又はドレインの一方に電気的に接続されている。   The pixel electrode 31 is an anode that supplies holes to the light emitting function layer 32, and is formed of a light-transmissive conductive material. In the present embodiment, for example, an ITO (Indium Tin Oxide) film having a thickness of 200 nm is formed as the pixel electrode 31. The pixel electrode 31 is electrically connected to one of a drain of the transistor 124 and a source or a drain of the transistor 125.

対向電極33は、発光機能層32に電子を供給するカソードであり、例えばマグネシウム(Mg)と銀(Ag)との合金などの光透過性と光反射性とを有する導電材料により形成されている。対向電極33は、複数の画素20に跨って設けられた共通電極であり、電源線8に電気的に接続されている。電源線8には、画素回路110において電源の低位側となる電位Vctが供給されている。   The counter electrode 33 is a cathode that supplies electrons to the light emitting function layer 32, and is formed of a conductive material having light transmissivity and light reflectivity, such as an alloy of magnesium (Mg) and silver (Ag). . The counter electrode 33 is a common electrode provided across the plurality of pixels 20 and is electrically connected to the power supply line 8. The power supply line 8 is supplied with a potential Vct which is a lower side of the power supply in the pixel circuit 110.

発光機能層32は、画素電極31の側から順に積層された正孔注入層、正孔輸送層、有機発光層、及び電子輸送層などを有している。有機EL素子30では、画素電極31から供給される正孔と、対向電極33から供給される電子とが、発光機能層32の中で結合することによって、発光機能層32が発光する。   The light emitting functional layer 32 has a hole injection layer, a hole transport layer, an organic light emitting layer, an electron transport layer, and the like, which are sequentially stacked from the pixel electrode 31 side. In the organic EL element 30, the holes supplied from the pixel electrodes 31 and the electrons supplied from the counter electrode 33 are combined in the light emitting function layer 32, so that the light emitting function layer 32 emits light.

また、素子基板10には、各電源線19に交差して電源線6がX方向に延在して設けられている。なお、電源線6はY方向に延在して設けられてもよいし、X方向及びY方向の両方に延在するように設けられてもよい。トランジスター121は、ソースが電源線6に電気的に接続され、ドレインがトランジスター123のソース又はドレインの他方と、トランジスター124のソースとにそれぞれ電気的に接続されている。また、電源線6には、画素回路110において電源の高位側となる電位Velが供給されている。また、電源線6には、容量21の一端が電気的に接続されている。トランジスター121は、トランジスター121のゲート及びソース間の電圧に応じた電流を流す駆動トランジスターとして機能する。   The power supply line 6 is provided on the element substrate 10 so as to extend in the X direction so as to cross each power supply line 19. The power supply line 6 may be provided to extend in the Y direction, or may be provided to extend in both the X direction and the Y direction. The transistor 121 has a source electrically connected to the power supply line 6 and a drain electrically connected to the other of the source and the drain of the transistor 123 and the source of the transistor 124. The power supply line 6 is supplied with a potential Vel that is a higher side of the power supply in the pixel circuit 110. One end of a capacitor 21 is electrically connected to the power supply line 6. The transistor 121 functions as a driving transistor that passes current according to a voltage between the gate and the source of the transistor 121.

トランジスター122は、ゲートが走査線12に電気的に接続され、ソース又はドレインの一方がデータ線14に電気的に接続されている。また、トランジスター122は、ソース又はドレインの他方が、トランジスター121のゲートと、容量21の他端と、トランジスター123のソース又はドレインの一方とに、それぞれ電気的に接続されている。
トランジスター122は、トランジスター121のゲートとデータ線14との間に電気的に接続され、トランジスター121のゲートとデータ線14との間の電気的な接続を制御する書込トランジスターとして機能する。
The transistor 122 has a gate electrically connected to the scan line 12 and one of a source and a drain electrically connected to the data line 14. The other of the source and the drain of the transistor 122 is electrically connected to the gate of the transistor 121, the other end of the capacitor 21, and one of the source and the drain of the transistor 123, respectively.
The transistor 122 is electrically connected between the gate of the transistor 121 and the data line 14, and functions as a writing transistor that controls an electrical connection between the gate of the transistor 121 and the data line 14.

トランジスター123は、ゲートが制御線に電気的に接続され、制御信号Gcmpが供給される。トランジスター123は、トランジスター121のゲート及びドレインの間の電気的な接続を制御する、閾値補償トランジスターとして機能する。   The transistor 123 has a gate electrically connected to the control line, and is supplied with a control signal Gcmp. The transistor 123 functions as a threshold compensation transistor that controls an electrical connection between the gate and the drain of the transistor 121.

トランジスター124は、ゲートが制御線に電気的に接続され、制御信号Gelが供給される。トランジスター124は、ドレインがトランジスター125のソース又はドレインの一方と有機EL素子30の画素電極31とにそれぞれ電気的に接続されている。トランジスター124は、トランジスター121のドレインと、有機EL素子30の画素電極31との間の電気的な接続を制御する、発光制御トランジスターとして機能する。   The transistor 124 has a gate electrically connected to the control line, and is supplied with a control signal Gel. The drain of the transistor 124 is electrically connected to one of the source and the drain of the transistor 125 and the pixel electrode 31 of the organic EL element 30. The transistor 124 functions as a light emission control transistor that controls an electrical connection between the drain of the transistor 121 and the pixel electrode 31 of the organic EL element 30.

トランジスター125は、ゲートが制御線に電気的に接続され、制御信号Gorstが供給される。また、トランジスター125のソース又はドレインの他方は、電源線19に電気的に接続され、リセット電位Vorstが供給されている。トランジスター125は、電源線19と、有機EL素子30の画素電極31との間の電気的な接続を制御する初期化トランジスターとして機能する。   The transistor 125 has a gate electrically connected to the control line, and is supplied with a control signal Gorst. The other of the source and the drain of the transistor 125 is electrically connected to the power supply line 19 and supplied with a reset potential Vorst. The transistor 125 functions as an initialization transistor that controls an electrical connection between the power supply line 19 and the pixel electrode 31 of the organic EL element 30.

図4は、画素20(画素20B,20G,20R)の構成を示す平面図である。図5(a)は、図4中に示す線分A─A’による画素20B,20G,20RのX方向に沿った断面図である。図5(b)は、図5(a)中に示す一部の画素20Rを拡大した断面図である。図6(a)は、図4中に示す線分B─B’による画素20BのY方向に沿った断面図である。図6(b)は、図4中に示す線分C─C’による画素20GのY方向に沿った断面図である。図6(c)は、図4中に示す線分D─D’による画素20RのY方向に沿った断面図である。   FIG. 4 is a plan view illustrating a configuration of the pixel 20 (pixels 20B, 20G, and 20R). FIG. 5A is a cross-sectional view of the pixels 20B, 20G, and 20R taken along the line A′A ′ shown in FIG. 4 along the X direction. FIG. 5B is an enlarged cross-sectional view of some of the pixels 20R shown in FIG. FIG. 6A is a cross-sectional view along the Y direction of the pixel 20 </ b> B along the line segment B′B ′ shown in FIG. 4. FIG. 6B is a cross-sectional view of the pixel 20 </ b> G along the Y direction by the line segment C′C ′ shown in FIG. 4. FIG. 6C is a cross-sectional view of the pixel 20 </ b> R along the Y direction along the line segment D′ D ′ shown in FIG. 4.

各画素20B,20G,20Rは、図4及び図5(a),(b)に示すように、それぞれ平面視で矩形状を為して、短手方向がX方向(長手方向がY方向)と平行となるように配置されている。また、各有機EL素子30B,30G,30Rの間には、画素分離層29が設けられている。   Each of the pixels 20B, 20G, and 20R has a rectangular shape in plan view as shown in FIGS. 4 and 5A and 5B, and has a short direction in the X direction (a long direction in the Y direction). And are arranged in parallel. A pixel separation layer 29 is provided between the organic EL elements 30B, 30G, and 30R.

画素分離層29は、絶縁材料からなり、隣り合う有機EL素子30B,30G,30Rの間を電気的に絶縁している。本実施形態では、画素分離層29として、例えば膜厚25nmの酸化シリコン(SiO2)膜を形成している。画素分離層29は、各画素20B,20G,20Rの画素電極31の周縁部を覆うように設けられている。すなわち、画素分離層29には、各画素20B,20G,20Rの画素電極31の一部を露出させる開口29CTが設けられている。開口29CTは、平面視で矩形状を為して、各画素20の発光領域を規定している。   The pixel separation layer 29 is made of an insulating material, and electrically insulates the adjacent organic EL elements 30B, 30G, and 30R. In the present embodiment, for example, a silicon oxide (SiO 2) film having a thickness of 25 nm is formed as the pixel separation layer 29. The pixel separation layer 29 is provided so as to cover the periphery of the pixel electrode 31 of each of the pixels 20B, 20G, and 20R. That is, the pixel separation layer 29 is provided with the opening 29CT that exposes a part of the pixel electrode 31 of each of the pixels 20B, 20G, and 20R. The opening 29CT has a rectangular shape in plan view, and defines a light emitting area of each pixel 20.

各画素20B,20G,20Rに配置された有機EL素子30B,30G,30Rは、図5(a),(b)及び図6(a)〜(c)に示すように、層間絶縁層(絶縁層)34の上に、反射電極35と、増反射層36と、保護層37と、光路調整層38と、画素電極31と、発光機能層32と、対向電極33とが積層された共振構造(キャビティ構造)を有している。なお、図4、図5(a),(b)及び図6(a)〜(c)では、上述した発光機能層32及び対向電極33の図示を省略している。   The organic EL elements 30B, 30G, and 30R arranged in each of the pixels 20B, 20G, and 20R have an interlayer insulating layer (insulating) as shown in FIGS. 5A and 5B and FIGS. 6A to 6C. A resonant structure in which a reflective electrode 35, a reflective layer 36, a protective layer 37, an optical path adjusting layer 38, a pixel electrode 31, a light emitting function layer 32, and a counter electrode 33 are stacked on a layer 34. (Cavity structure). In FIGS. 4, 5A, 5B, and 6A to 6C, the illustration of the light emitting functional layer 32 and the counter electrode 33 is omitted.

共振構造では、発光機能層32が発した光を反射電極35と対向電極33との間で繰り返し反射しながら、光路調整層38によって調整された反射電極35と対向電極33との間の光学的な距離に応じて、特定波長(共振波長)の光を増強させて射出することが可能となっている。   In the resonance structure, while the light emitted from the light emitting function layer 32 is repeatedly reflected between the reflection electrode 35 and the counter electrode 33, the optical path between the reflection electrode 35 and the counter electrode 33 adjusted by the optical path adjustment layer 38 is increased. It is possible to enhance and emit light of a specific wavelength (resonance wavelength) in accordance with the appropriate distance.

層間絶縁層34には、例えば酸化シリコン(SiO2)などの絶縁材料が用いられている。なお、図5(a)においては、層間絶縁層34の下にはトランジスター124のみを示しているが、層間絶縁層34の下には、トランジスター124の他、走査線12、データ線14、電源線19、制御線、電源線6、画素回路110を構成するトランジスター121,122,123,124,125、容量21などが配置されている。層間絶縁層34の表面には、これらのトランジスターや配線などに応じて凹凸が形成される可能性があるが、反射電極35が形成される表面は平坦化されることが好ましい。   An insulating material such as silicon oxide (SiO2) is used for the interlayer insulating layer 34, for example. Although only the transistor 124 is shown below the interlayer insulating layer 34 in FIG. 5A, the scanning line 12, the data line 14, the power supply The line 19, the control line, the power supply line 6, the transistors 121, 122, 123, 124, 125 constituting the pixel circuit 110, the capacitor 21 and the like are arranged. Irregularities may be formed on the surface of the interlayer insulating layer 34 according to these transistors and wirings, but it is preferable that the surface on which the reflective electrode 35 is formed be planarized.

反射電極35は、画素20毎に分割して配置されている。すなわち、反射電極35は、画素20B,20G,20Rのそれぞれに設けられている。また、隣り合う反射電極35の各間には、間隙35CTが形成されている。したがって、隣り合う反射電極35の各間には間隙35CTが設けられており、画素20毎に電気的に分離され、異なる電位が印加可能に構成されている。   The reflection electrode 35 is divided and arranged for each pixel 20. That is, the reflection electrode 35 is provided in each of the pixels 20B, 20G, and 20R. In addition, a gap 35CT is formed between the adjacent reflective electrodes 35. Therefore, a gap 35CT is provided between the adjacent reflective electrodes 35, and is electrically separated for each pixel 20 so that different potentials can be applied.

反射電極35は、光反射性を有する導電材料からなり、平面視で矩形状に形成されている。反射電極35は、画素電極31よりも大きく、各画素20の反射領域を規定している。本実施形態では、反射電極35として、例えば第1層35aとなる膜厚30nmのチタン(Ti)膜の上に、第2層35bとなる膜厚100nmのアルミニウム(Al)と銅(Cu)との合金(AlCu)膜を形成している。   The reflective electrode 35 is made of a conductive material having light reflectivity, and is formed in a rectangular shape in plan view. The reflection electrode 35 is larger than the pixel electrode 31 and defines a reflection area of each pixel 20. In the present embodiment, as the reflective electrode 35, for example, a 100 nm-thick aluminum (Al) and copper (Cu) having a thickness of 100 nm to be the second layer 35b are formed on a titanium (Ti) film having a thickness of 30 nm to be the first layer 35a. (AlCu) film is formed.

反射電極35は、層間絶縁層34を貫通して配置された第1のコンタクト電極28(図3及び図5(a)を参照。)を介して、上述したトランジスター124のドレインと電気的に接続されている。また、反射電極35は、第1のコンタクト電極28を介してトランジスター125のソース又はドレインの一方(図示せず)と電気的に接続されている。第1のコンタクト電極28には、例えばタングステン(W)やチタン(Ti)、窒化チタン(TiN)などの導電材料を用いることができる。本実施形態では、反射電極35の第1層35aは第1のコンタクト電極28と接続されている。   The reflective electrode 35 is electrically connected to the drain of the transistor 124 via the first contact electrode 28 (see FIGS. 3 and 5A) disposed through the interlayer insulating layer 34. Have been. The reflection electrode 35 is electrically connected to one of the source and the drain (not shown) of the transistor 125 via the first contact electrode 28. For the first contact electrode 28, for example, a conductive material such as tungsten (W), titanium (Ti), or titanium nitride (TiN) can be used. In the present embodiment, the first layer 35a of the reflection electrode 35 is connected to the first contact electrode 28.

増反射層36は、反射電極35による反射特性を高めるためのものであり、例えば光透過性を有する絶縁材料からなる。増反射層36は、反射電極35の面上を覆うように配置されている。本実施形態では、増反射層36として、例えば膜厚40nmの酸化シリコン(SiO2)膜を形成している。   The reflection-enhancing layer 36 is for enhancing the reflection characteristics of the reflection electrode 35, and is made of, for example, an insulating material having light transmittance. The reflection enhancing layer 36 is disposed so as to cover the surface of the reflection electrode 35. In the present embodiment, a silicon oxide (SiO 2) film having a thickness of, for example, 40 nm is formed as the reflection enhancing layer 36.

保護層37は、間隙35CTが形成された反射電極35の面上を覆うように設けられている。保護層37は、第1の絶縁膜39と、埋め込み絶縁膜40とを有している。第1の絶縁膜39は、増反射層36、反射電極35及び層間絶縁層34の面上に設けられており、間隙35CTに沿って形成されている。したがって、第1の絶縁膜39は、間隙35CTに対応した凹部39aを有している。埋め込み絶縁膜40は、凹部39aを埋めるように形成されている。保護層37は、凹部37aに埋め込まれた埋め込み絶縁膜によって、光路調整層38と接する側の面上が平坦化されている。本実施形態では、第1の絶縁膜39として、例えば膜厚80nmの窒化シリコン(SiN)膜を形成し、埋め込み絶縁膜40として、酸化シリコン(SiO2)膜を形成している。   The protective layer 37 is provided so as to cover the surface of the reflective electrode 35 where the gap 35CT is formed. The protective layer 37 has a first insulating film 39 and a buried insulating film 40. The first insulating film 39 is provided on the surfaces of the reflection-enhancing layer 36, the reflection electrode 35, and the interlayer insulating layer 34, and is formed along the gap 35CT. Therefore, the first insulating film 39 has a concave portion 39a corresponding to the gap 35CT. The buried insulating film 40 is formed so as to fill the recess 39a. The surface of the protective layer 37 that is in contact with the optical path adjustment layer 38 is planarized by the buried insulating film buried in the concave portion 37a. In the present embodiment, for example, a silicon nitride (SiN) film having a thickness of 80 nm is formed as the first insulating film 39, and a silicon oxide (SiO 2) film is formed as the buried insulating film 40.

光路調整層38は、保護層37の面上に配置された絶縁膜38a,38bを有している。光路調整層38は、画素20B,20G,20R毎に、反射電極35と対向電極33との間の光学的な距離に応じた光路調整を行う。   The optical path adjusting layer 38 has insulating films 38a and 38b disposed on the surface of the protective layer 37. The optical path adjustment layer 38 adjusts the optical path according to the optical distance between the reflective electrode 35 and the counter electrode 33 for each of the pixels 20B, 20G, and 20R.

具体的に、光路調整層38の膜厚は、画素20B、画素20G、画素20Rの順で大きくなっている。すなわち、画素20Bでは、図6(a)に示すように、例えば共振波長(輝度が最大となるピーク波長)が470nmとなるように、絶縁膜38a,38bが省略されている。画素20Gでは、図6(b)に示すように、例えば共振波長が540nmとなるように、絶縁膜38aが設けられている。画素20Rでは、図6(c)に示すように、例えば共振波長が610nmとなるように、絶縁膜38a,38bが設けられている。
本実施形態では、絶縁膜38aとして、例えば膜厚40nmの酸化シリコン(SiO2)を形成し、絶縁膜38bとして、例えば膜厚50nmの酸化シリコン(SiO2)を形成している。また、増反射層36及び保護層37も、反射電極35と対向電極33との間の光学的な距離に応じた光路調整を行い、例えば、画素20Bでは、増反射層36及び保護層37の膜厚は、例えば共振波長(輝度が最大となるピーク波長)が470nmとなるように設定されている。
Specifically, the thickness of the optical path adjustment layer 38 increases in the order of the pixel 20B, the pixel 20G, and the pixel 20R. That is, in the pixel 20B, as shown in FIG. 6A, the insulating films 38a and 38b are omitted so that, for example, the resonance wavelength (the peak wavelength at which the luminance becomes maximum) is 470 nm. In the pixel 20G, as shown in FIG. 6B, an insulating film 38a is provided so that, for example, the resonance wavelength becomes 540 nm. In the pixel 20R, as shown in FIG. 6C, for example, the insulating films 38a and 38b are provided so that the resonance wavelength becomes 610 nm.
In the present embodiment, for example, silicon oxide (SiO2) having a thickness of 40 nm is formed as the insulating film 38a, and silicon oxide (SiO2) having a thickness of, for example, 50 nm is formed as the insulating film 38b. Further, the reflective layer 36 and the protective layer 37 also adjust the optical path according to the optical distance between the reflective electrode 35 and the counter electrode 33. For example, in the pixel 20B, the reflective layer 36 and the protective layer 37 The film thickness is set so that, for example, the resonance wavelength (peak wavelength at which the luminance becomes maximum) is 470 nm.

これにより、画素20Bからは470nmをピーク波長とする青色(B)の光が発せられ、画素20Gからは540nmをピーク波長とする緑色(G)の光が発せられ、画素20Rからは610nmをピーク波長とする赤色(R)の光が発せられる。有機EL装置100では、このような共振構造を有する有機EL素子30によって、各画素20から発せられる表示光の色純度を高めている。   Accordingly, blue (B) light having a peak wavelength of 470 nm is emitted from the pixel 20B, green (G) light having a peak wavelength of 540 nm is emitted from the pixel 20G, and 610 nm is emitted from the pixel 20R. Red (R) light having a wavelength is emitted. In the organic EL device 100, the color purity of the display light emitted from each pixel 20 is increased by the organic EL element 30 having such a resonance structure.

光路調整層38は、各有機EL素子30B,30G,30Rの間に設けられている。具体的には、光路調整層38は、埋め込み絶縁膜40と同種の材料で構成されており、光路調整層38は埋め込み絶縁膜40を覆うように設けられている。このような構成によれば、保護層37の画素電極31側の表面の平坦性を損なうことなく、共振波長に応じて光路調整層38を加工可能である。本実施形態では、光路調整層38及び埋め込み絶縁膜40は、酸化シリコン(SiO2)により構成されている。   The optical path adjustment layer 38 is provided between the organic EL elements 30B, 30G, and 30R. Specifically, the optical path adjustment layer 38 is made of the same material as the buried insulating film 40, and the optical path adjustment layer 38 is provided so as to cover the buried insulating film 40. According to such a configuration, the optical path adjustment layer 38 can be processed according to the resonance wavelength without deteriorating the flatness of the surface of the protective layer 37 on the pixel electrode 31 side. In the present embodiment, the optical path adjustment layer 38 and the buried insulating film 40 are made of silicon oxide (SiO2).

光路調整層38の上には、図5(a),(b)及び図6(a)〜(c)に示すように、画素電極31が配置されている。画素電極31は、第2のコンタクト電極41を介して反射電極35と電気的に接続されている。具体的には、保護層37及び増反射層36を貫通するように、コンタクトホール41CTが設けられている。コンタクトホール41CTは、開口29CTとは平面視で重ならない領域、すなわち画素分離層29が形成された領域の下方に位置している。   As shown in FIGS. 5A and 5B and FIGS. 6A to 6C, the pixel electrode 31 is disposed on the optical path adjustment layer 38. The pixel electrode 31 is electrically connected to the reflection electrode 35 via the second contact electrode 41. Specifically, a contact hole 41CT is provided so as to penetrate the protective layer 37 and the reflection-enhancing layer 36. The contact hole 41CT is located below a region that does not overlap with the opening 29CT in plan view, that is, a region where the pixel isolation layer 29 is formed.

第2のコンタクト電極41は、第1のコンタクト部41aと、第2のコンタクト部41bとを有している。第1のコンタクト部41aは、コンタクトホール41CT内に配置されており、反射電極35の第2層35bと接続されている。第2のコンタクト部41bは、保護層37の面上に配置されており、画素電極31と接続されている。本実施形態では、第2のコンタクト電極41として、例えば窒化チタン(TiN)膜を形成し、第2のコンタクト部41bの厚みが50nmとなるように形成している。   The second contact electrode 41 has a first contact part 41a and a second contact part 41b. The first contact portion 41a is arranged in the contact hole 41CT and is connected to the second layer 35b of the reflection electrode 35. The second contact portion 41b is disposed on the surface of the protective layer 37 and is connected to the pixel electrode 31. In the present embodiment, for example, a titanium nitride (TiN) film is formed as the second contact electrode 41, and the second contact portion 41b is formed to have a thickness of 50 nm.

図5(a),(b)及び図6(a)〜(c)の示すように、光路調整層38の一部は、第2のコンタクト電極41と重なるように形成されている。このような構成によれば、保護層37の画素電極31側の表面の平坦性を損なうことなく、各有機EL素子30B,30G,30Rの間の領域の近傍に第2のコンタクト電極41を配置することができる。これにより、発光に寄与しない領域を縮小でき、各画素20の開口率を高めることが可能である。   As shown in FIGS. 5A and 5B and FIGS. 6A to 6C, a part of the optical path adjustment layer 38 is formed so as to overlap the second contact electrode 41. According to such a configuration, the second contact electrode 41 is arranged near the region between the organic EL elements 30B, 30G, and 30R without impairing the flatness of the surface of the protective layer 37 on the pixel electrode 31 side. can do. Thus, the area that does not contribute to light emission can be reduced, and the aperture ratio of each pixel 20 can be increased.

図6(a)に示すように、画素20Bにおいて、光路調整層38を構成する絶縁膜38a,38bは、第2のコンタクト電極41の一部又は埋め込み絶縁膜40と重なる領域に設けられている。光路調整層38を構成する絶縁膜38a,38bは、第2のコンタクト電極41の一部の面上には設けられておらず、当該部位において画素電極31を構成する導電材料は第2のコンタクト電極41に積層され、画素電極31を構成する導電材料は第2のコンタクト電極41に接している。   As shown in FIG. 6A, in the pixel 20B, the insulating films 38a and 38b constituting the optical path adjusting layer 38 are provided in a part of the second contact electrode 41 or in a region overlapping with the buried insulating film 40. . The insulating films 38a and 38b forming the optical path adjusting layer 38 are not provided on a part of the surface of the second contact electrode 41, and the conductive material forming the pixel electrode 31 is not provided on the second contact electrode 41 at that portion. The conductive material that is stacked on the electrode 41 and forms the pixel electrode 31 is in contact with the second contact electrode 41.

図6(b)に示すように、画素20Gにおいて、光路調整層38を構成する絶縁膜38aは、第2のコンタクト電極41の一部又は埋め込み絶縁膜40と重なる領域に設けられている。そして、絶縁膜38bにはコンタクトホールが設けられ、画素電極31を構成する導電材料がこのコンタクトホール内に配置され、画素電極31は第2のコンタクト電極41と接続される。画素20Gにおいて、光路調整層38を構成する絶縁膜38bは、当該コンタクトホールを除き、ほぼ全面に設けられている。より具体的には、光路調整層38を構成する絶縁膜38aは、第2のコンタクト電極41の一部、反射電極35、又は埋め込み絶縁膜40と重なる領域に設けられている。   As shown in FIG. 6B, in the pixel 20G, the insulating film 38a constituting the optical path adjustment layer 38 is provided in a part of the second contact electrode 41 or in a region overlapping with the buried insulating film 40. Then, a contact hole is provided in the insulating film 38b, a conductive material forming the pixel electrode 31 is disposed in the contact hole, and the pixel electrode 31 is connected to the second contact electrode 41. In the pixel 20G, the insulating film 38b constituting the optical path adjustment layer 38 is provided on almost the entire surface except for the contact hole. More specifically, the insulating film 38a constituting the optical path adjusting layer 38 is provided in a region overlapping a part of the second contact electrode 41, the reflective electrode 35, or the buried insulating film 40.

図6(c)に示すように、画素20Rにおいて、光路調整層38を構成する絶縁膜38a,38bは、第2のコンタクト電極41の一部、反射電極35、又は埋め込み絶縁膜40と重なる領域に設けられている。そして、絶縁膜38a,38bにはコンタクトホールが設けられ、画素電極31を構成する導電材料がこのコンタクトホール内に配置され、画素電極31は第2のコンタクト電極41と接続される。   As shown in FIG. 6C, in the pixel 20 </ b> R, the insulating films 38 a and 38 b forming the optical path adjustment layer 38 are regions that overlap a part of the second contact electrode 41, the reflective electrode 35, or the buried insulating film 40. It is provided in. Then, contact holes are provided in the insulating films 38a and 38b, a conductive material forming the pixel electrode 31 is disposed in the contact hole, and the pixel electrode 31 is connected to the second contact electrode 41.

なお、図示を省略するが、画素電極31の上には、上述した発光機能層32及び対向電極33が配置され、その上に更に、素子基板10の面上を覆うと共に、有機EL素子30の面上を平坦化する封止層(パッシベーション膜)が配置されることによって、有機EL素子30への水分や酸素等の侵入を抑制している。上述したカラーフィルター層50は、この封止層の面上に配置されている。   Although not shown, the above-described light emitting functional layer 32 and the counter electrode 33 are disposed on the pixel electrode 31, and further cover the surface of the element substrate 10 and the organic EL element 30. By disposing a sealing layer (passivation film) for flattening the surface, penetration of moisture, oxygen, and the like into the organic EL element 30 is suppressed. The above-described color filter layer 50 is disposed on the surface of the sealing layer.

ここで、図7は、有機EL装置100の表示領域Eと周辺領域Fとの間における断面図である。また、図8(a)は、外部接続用端子103の構成を平面図であり、図8(b)は、図8(a)中に示す線分E−E’による断面図である。   Here, FIG. 7 is a cross-sectional view between the display region E and the peripheral region F of the organic EL device 100. FIG. 8A is a plan view showing the configuration of the external connection terminal 103, and FIG. 8B is a cross-sectional view taken along line E-E 'shown in FIG. 8A.

本実施形態の有機EL装置100では、図7及び図8(a),(b)に示すように、表示領域Eの外側に設けられた周辺領域Fにおいて、外部接続用端子103は、反射電極35と同じ第1の導電膜35LYにより形成される第1の端子層350と、コンタクト電極41と同じ第2の導電膜41LYにより形成される第2の端子層410と、画素電極31と同じ第3の導電膜31LYにより形成される第3の端子層310とが順に積層された構造を有している。   In the organic EL device 100 of the present embodiment, as shown in FIGS. 7 and 8A and 8B, in the peripheral region F provided outside the display region E, the external connection terminal 103 is a reflective electrode. 35, a second terminal layer 410 formed of the same second conductive film 41LY as the contact electrode 41, and a first terminal layer 410 formed of the same second conductive film 41LY as the contact electrode 41. And a third terminal layer 310 formed of three conductive films 31LY.

第1の端子層350は、層間絶縁層34の面上に平面視で矩形状に形成されている。増反射層36は、第1の端子層350の端部を覆うように配置されている。保護層37の第1の絶縁膜39は、第1の端子層350及び増反射層36が配置された層間絶縁層34の面上を第1の絶縁膜39が覆うように形成されている。保護層37の埋め込み絶縁膜40は、第1の絶縁膜39に形成された凹部39bに埋め込まれている。このような構造により、保護層37の第2の端子層410側の上面が平坦化されている。   The first terminal layer 350 is formed in a rectangular shape in plan view on the surface of the interlayer insulating layer 34. The enhanced reflection layer 36 is disposed so as to cover an end of the first terminal layer 350. The first insulating film 39 of the protective layer 37 is formed such that the first insulating film 39 covers the surface of the interlayer insulating layer 34 on which the first terminal layer 350 and the reflection enhancing layer 36 are disposed. The buried insulating film 40 of the protective layer 37 is buried in a concave portion 39b formed in the first insulating film 39. With such a structure, the upper surface of the protective layer 37 on the second terminal layer 410 side is planarized.

第1の端子層350の上には、増反射層36及び保護層37(第1の絶縁膜39)を貫通する第1のコンタクトホール410CTが形成されている。第2の端子層410は、第1のコンタクトホール410CTに埋め込まれた状態で保護層37の面上に配置されている。これにより、第2の端子層410は、第1のコンタクトホール410CTから露出した第1の端子層350(第1の導電膜35LY)の面上に積層されている。   On the first terminal layer 350, a first contact hole 410CT that penetrates the reflective layer 36 and the protective layer 37 (first insulating film 39) is formed. The second terminal layer 410 is disposed on the surface of the protective layer 37 while being embedded in the first contact hole 410CT. Thus, the second terminal layer 410 is stacked on the surface of the first terminal layer 350 (first conductive film 35LY) exposed from the first contact hole 410CT.

光路調整層38は、第2の端子層410が配置された保護層37の面上を絶縁膜38a,38bが覆うように配置されている。第2の端子層410の上には、光路調整層38を貫通する第2のコンタクトホール310CTが形成されている。第3の端子層310Tは、第2のコンタクトホール310CTに埋め込まれた状態で光路調整層38の面上に配置されている。これにより、第3の端子層310は、第2のコンタクトホール310CTから露出した第2の端子層410(第2の導電膜41LY)の面上に積層されている。   The optical path adjusting layer 38 is disposed so that the insulating films 38a and 38b cover the surface of the protective layer 37 on which the second terminal layer 410 is disposed. On the second terminal layer 410, a second contact hole 310CT penetrating the optical path adjustment layer 38 is formed. The third terminal layer 310T is disposed on the surface of the optical path adjustment layer 38 in a state of being embedded in the second contact hole 310CT. Thereby, the third terminal layer 310 is stacked on the surface of the second terminal layer 410 (the second conductive film 41LY) exposed from the second contact hole 310CT.

画素分離層29は、第2の端子層410が配置された光路調整38の面上を覆うように配置されている。画素分離層29には、外部接続用端子103(第3の端子層31)を露出させる端子開口部290CTが設けられている。   The pixel separation layer 29 is disposed so as to cover the surface of the optical path adjustment 38 on which the second terminal layer 410 is disposed. The pixel separation layer 29 is provided with a terminal opening 290CT that exposes the external connection terminal 103 (third terminal layer 31).

本実施形態において、第1の導電膜35LYは、AlCu膜からなり、第2の導電膜41LYは、TiN膜からなり、第3の導電膜31LYは、ITO膜からなる。すなわち、第2の導電膜41LYは、第3の導電膜31LYよりも電導性の高い導電材料からなる。   In the present embodiment, the first conductive film 35LY is made of an AlCu film, the second conductive film 41LY is made of a TiN film, and the third conductive film 31LY is made of an ITO film. That is, the second conductive film 41LY is made of a conductive material having higher conductivity than the third conductive film 31LY.

この場合、外部接続用端子103において、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)との間に、第2の端子層410(第2の導電膜41LY)を設けることで、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)とが直接積層される場合よりも、外部接続用端子103の抵抗値を下げることが可能である。また、反射電極35は、第1の導電膜35LYにより形成されるため、この反射電極35の反射率が低下することを防ぐことができる。   In this case, in the external connection terminal 103, the second terminal layer 410 is disposed between the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY). By providing the (second conductive film 41LY), the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY) are directly stacked. Also, the resistance value of the external connection terminal 103 can be reduced. In addition, since the reflective electrode 35 is formed of the first conductive film 35LY, it is possible to prevent the reflectance of the reflective electrode 35 from decreasing.

また、本実施形態の有機EL装置100を製造する際は、第1の端子層350に反射電極35と同じ第1の導電膜35LYと、第2の端子層410にコンタクト電極41と同じ第2の導電膜41LYと、第3の端子層310に画素電極31と同じ第3の導電膜31LYとを用いて、有機EL素子30を作製するプロセス中で、第1の端子層350と、第2の端子層410と、第3の端子層310とが順に積層された外部接続用端子103を作製することが可能である。   When manufacturing the organic EL device 100 of this embodiment, the first terminal layer 350 has the same first conductive film 35LY as the reflective electrode 35, and the second terminal layer 410 has the same second conductive film 35LY as the contact electrode 41. During the process of manufacturing the organic EL element 30 using the third conductive film 31LY and the same third conductive film 31LY as the pixel electrode 31 for the third terminal layer 310, the first terminal layer 350 It is possible to manufacture the external connection terminal 103 in which the terminal layer 410 and the third terminal layer 310 are sequentially stacked.

(有機EL装置の製造方法)
具体的に、本実施形態の有機EL装置100の製造方法について、図9(a)〜(f)を参照して説明する。なお、図9(a)〜(f)は、上記有機EL装置100の製造工程として、有機EL素子30(本実施形態では30Rを例示する。)と外部接続用端子103とを作製する工程を説明するための断面図である。また、図9(a)〜(f)中の右側には、表示領域Eにおける1つの画素20(本実施形態では20Rを例示する。)を示し、図9(a)〜(f)中の左側には、周辺領域Fにおける1つの外部接続用端子103を示している。
(Method of Manufacturing Organic EL Device)
Specifically, a method for manufacturing the organic EL device 100 according to the present embodiment will be described with reference to FIGS. 9A to 9F show a process of manufacturing the organic EL device 30 (30R is exemplified in this embodiment) and the external connection terminal 103 as a manufacturing process of the organic EL device 100. It is sectional drawing for demonstrating. 9A to 9F, one pixel 20 (20R is exemplified in the present embodiment) in the display area E is shown on the right side in FIGS. 9A to 9F. On the left side, one external connection terminal 103 in the peripheral area F is shown.

本実施形態では、有機EL素子30を作製するプロセス中で、第1の端子層350と、第2の端子層410と、第3の端子層310とが順に積層された外部接続用端子103を作製することが可能である。   In the present embodiment, during the process of manufacturing the organic EL element 30, the external connection terminal 103 in which the first terminal layer 350, the second terminal layer 410, and the third terminal layer 310 are sequentially stacked is formed. It can be made.

具体的に、本実施形態の製造方法では、先ず、図9(a)に示すように、層間絶縁層34の面上に、Ti/AlCu膜(第1の導電膜35LY)と、SiO2膜(増反射層36)とを順に積層した後に、その上に、フォトリソグラフィ技術を用いて反射電極35と第1の端子層350とに対応した形状のマスク層(図示せず)を形成する。そして、層間絶縁層34の表面が露出するまでTi/AlCu膜及びSiO2膜をエッチングした後、マスク層を除去する。これにより、Ti/AlCu膜及びSiO2膜を反射電極35及び第1の端子層350に対応した形状にパターニングすることができる。   Specifically, in the manufacturing method of the present embodiment, first, as shown in FIG. 9A, a Ti / AlCu film (first conductive film 35LY) and a SiO2 film ( After sequentially laminating the enhanced reflection layer 36), a mask layer (not shown) having a shape corresponding to the reflection electrode 35 and the first terminal layer 350 is formed thereon by using a photolithography technique. Then, after the Ti / AlCu film and the SiO2 film are etched until the surface of the interlayer insulating layer 34 is exposed, the mask layer is removed. Thus, the Ti / AlCu film and the SiO 2 film can be patterned into a shape corresponding to the reflective electrode 35 and the first terminal layer 350.

次に、図9(b)に示すように、この上に、SiN膜(第1の絶縁膜39)を形成すると共に、第1の絶縁膜39に形成された凹部39a,39bにSiO2膜(埋め込み絶縁膜40)を埋め込み形成する。これにより、上面が平坦化された保護層37が形成される。   Next, as shown in FIG. 9B, a SiN film (first insulating film 39) is formed thereon, and a SiO2 film (first insulating film 39) is formed in the concave portions 39a and 39b formed in the first insulating film 39. The buried insulating film 40) is buried. As a result, a protective layer 37 whose upper surface is flattened is formed.

次に、図9(c)に示すように、増反射層36及び保護層37を貫通するように、反射電極35の上にコンタクトホール41CTと、第1の端子層350の上に第1のコンタクトホール410CTとを形成する。その後、これらのコンタクトホール41CT,410CTに埋め込まれた状態で、保護層37の面上を覆うTiN膜(第2の導電膜41YL)を形成する。その後、その上に、フォトリソグラフィ技術を用いて第2のコンタクト電極41と第2の端子層410とに対応した形状のマスク層(図示せず)を形成する。そして、保護層37の表面が露出するまでTiN膜をエッチングした後、マスク層を除去する。
これにより、TiN膜を第2のコンタクト電極41及び第2の端子層410に対応した形状にパターニングすることができる。
Next, as shown in FIG. 9C, a contact hole 41CT is formed on the reflective electrode 35 and a first hole is formed on the first terminal layer 350 so as to penetrate the reflective layer 36 and the protective layer 37. A contact hole 410CT is formed. Thereafter, a TiN film (second conductive film 41YL) that covers the surface of the protective layer 37 is formed while being buried in the contact holes 41CT and 410CT. Thereafter, a mask layer (not shown) having a shape corresponding to the second contact electrode 41 and the second terminal layer 410 is formed thereon by using a photolithography technique. Then, after etching the TiN film until the surface of the protective layer 37 is exposed, the mask layer is removed.
Thereby, the TiN film can be patterned into a shape corresponding to the second contact electrode 41 and the second terminal layer 410.

次に、図9(d)に示すように、この上に、絶縁膜38a,38bを順に積層することによって光路調整層38を形成する。その後、光路調整層38を貫通するように、第2のコンタクト電極41の上にコンタクトホール31CTと、第2の端子層410の上に第2のコンタクトホール310CTを形成する。   Next, as shown in FIG. 9D, an optical path adjusting layer 38 is formed by sequentially laminating insulating films 38a and 38b thereon. Thereafter, a contact hole 31CT is formed on the second contact electrode 41 and a second contact hole 310CT is formed on the second terminal layer 410 so as to penetrate the optical path adjustment layer 38.

次に、図9(e)に示すように、これらのコンタクトホール31CT,310CTに埋め込まれた状態で、光路調整層38の面上を覆うITO膜(第3の導電膜31LY)を形成する。その後、その上に、フォトリソグラフィ技術を用いて画素電極31と第3の端子層310とに対応した形状のマスク層(図示せず)を形成する。そして、光路調整層38の表面が露出するまでITO膜をエッチングした後、マスク層を除去する。これにより、ITO膜を画素電極31及び第3の端子層310に対応した形状にパターニングすることができる。その後、SiO2膜(画素分離層29)を形成した後、画素電極31の上に開口29CTと、第3の端子層310の上に端子開口部290CTとを形成する。   Next, as shown in FIG. 9E, an ITO film (third conductive film 31LY) that covers the surface of the optical path adjustment layer 38 is formed in a state of being buried in the contact holes 31CT and 310CT. Thereafter, a mask layer (not shown) having a shape corresponding to the pixel electrode 31 and the third terminal layer 310 is formed thereon by using a photolithography technique. Then, after etching the ITO film until the surface of the optical path adjusting layer 38 is exposed, the mask layer is removed. Thus, the ITO film can be patterned into a shape corresponding to the pixel electrode 31 and the third terminal layer 310. Then, after forming a SiO2 film (pixel separation layer 29), an opening 29CT is formed on the pixel electrode 31 and a terminal opening 290CT is formed on the third terminal layer 310.

以上のように、本実施形態の製造方法では、第1の端子層350に反射電極35と同じ第1の導電膜35LYと、第2の端子層410に第2のコンタクト電極41と同じ第2の導電膜41LYと、第3の端子層310に画素電極31と同じ第3の導電膜31LYとを用いて、有機EL素子30を作製するプロセス中で、第1の端子層350と、第2の端子層410と、第3の端子層310とが順に積層された外部接続用端子103を作製することが可能である。   As described above, in the manufacturing method of this embodiment, the first terminal layer 350 has the first conductive film 35LY same as the reflective electrode 35, and the second terminal layer 410 has the second conductive film 35LY same as the second contact electrode 41. During the process of manufacturing the organic EL element 30 using the third conductive film 31LY and the same third conductive film 31LY as the pixel electrode 31 for the third terminal layer 310, the first terminal layer 350 It is possible to manufacture the external connection terminal 103 in which the terminal layer 410 and the third terminal layer 310 are sequentially stacked.

また、本実施形態の製造方法では、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)との間に、第2の端子層410(第2の導電膜41LY)を形成することで、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)とを直接積層する場合よりも、外部接続用端子103の抵抗値を下げることが可能である。また、反射電極35は、第1の導電膜35LYにより形成されるため、この反射電極35の反射率が低下することを防ぐことができる。   Further, in the manufacturing method of the present embodiment, the second terminal layer 410 is provided between the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY). By forming the (second conductive film 41LY), the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY) are not directly stacked. Also, the resistance value of the external connection terminal 103 can be reduced. In addition, since the reflective electrode 35 is formed of the first conductive film 35LY, it is possible to prevent the reflectance of the reflective electrode 35 from decreasing.

また、本実施形態の有機EL装置100では、上述した第1のコンタクト電極28を介してトランジスター124と反射電極35とが電気的に接続され、第2のコンタクト電極41を介して反射電極35と画素電極31とが電気的に接続された構成となっている。すなわち、画素電極31は、反射電極35を介してトランジスター124と電気的に接続されている。   Further, in the organic EL device 100 of the present embodiment, the transistor 124 and the reflection electrode 35 are electrically connected via the above-described first contact electrode 28, and are connected to the reflection electrode 35 via the second contact electrode 41. The pixel electrode 31 is electrically connected. That is, the pixel electrode 31 is electrically connected to the transistor 124 via the reflective electrode 35.

これにより、本実施形態の有機EL装置100では、電源線の一部が反射電極を構成する場合や、電源線と反射電極とを電気的に接続する場合とは異なり、反射電極35と画素電極31とを電気的に接続することによって、反射電極35と画素電極31とが同電位となっている。これにより、反射電極35と画素電極31との間の絶縁膜(増反射層36や保護層37、光路調整層38など。)に欠陥等が生じて電源線と画素電極との間で短絡(ショート)するといったことを回避できるため、歩留まりの更なる向上を図ることが可能である。   Thus, in the organic EL device 100 according to the present embodiment, unlike the case where a part of the power supply line forms the reflective electrode or the case where the power supply line and the reflective electrode are electrically connected, the reflective electrode 35 and the pixel electrode By electrically connecting the pixel electrode 31 and the pixel electrode 31, the reflective electrode 35 and the pixel electrode 31 have the same potential. As a result, a defect or the like occurs in the insulating film (the reflective layer 36, the protective layer 37, the optical path adjusting layer 38, etc.) between the reflective electrode 35 and the pixel electrode 31, and a short circuit occurs between the power supply line and the pixel electrode ( Since short-circuiting can be avoided, it is possible to further improve the yield.

また、本実施形態の有機EL装置100では、このような構成によって、トランジスター124から反射電極35を介して画素電極31に印加される電位を制御しながら、信頼性の高い有機EL素子30の発光動作を行うことが可能である。   Further, in the organic EL device 100 of the present embodiment, with such a configuration, the light emission of the highly reliable organic EL element 30 is controlled while controlling the potential applied from the transistor 124 to the pixel electrode 31 via the reflective electrode 35. Actions can be taken.

また、本実施形態の有機EL装置100では、上述したコンタクト電極41が、コンタクトホール41CTに埋め込まれた状態で反射電極35と接続される第1のコンタクト部41aと、光路調整層38の面上を覆った状態で画素電極31と接続される第2のコンタクト部41bとを有している。この場合、第2のコンタクト電極41を介して反射電極35と画素電極31とを確実に接続することが可能である。   Further, in the organic EL device 100 of the present embodiment, the above-described contact electrode 41 is connected to the reflective electrode 35 in a state where the contact electrode 41 is embedded in the contact hole 41CT, and on the surface of the optical path adjusting layer 38. And a second contact portion 41b connected to the pixel electrode 31 in a state where the pixel electrode 31 is covered. In this case, it is possible to reliably connect the reflection electrode 35 and the pixel electrode 31 via the second contact electrode 41.

さらに、本実施形態の有機EL装置100では、上述した光路調整層38の少なくとも一部の端部が第2のコンタクト部41bの面上に位置することによって、光路調整層38を所定の形状にパターニングする際に、第2のコンタクト部41bを光路調整層38のエッチングストッパーとして機能させると共に、各画素20の開口率を高めることが可能である。また、外部接続用端子103において、第2の端子層410は、光路調整層38のエッチングストッパーとして機能させることができる。   Furthermore, in the organic EL device 100 of the present embodiment, at least a part of the end of the above-described optical path adjustment layer 38 is located on the surface of the second contact portion 41b, so that the optical path adjustment layer 38 has a predetermined shape. At the time of patterning, the second contact portion 41b can function as an etching stopper for the optical path adjustment layer 38, and the aperture ratio of each pixel 20 can be increased. In the external connection terminal 103, the second terminal layer 410 can function as an etching stopper for the optical path adjustment layer 38.

また、本実施形態の有機EL装置100では、上述した保護層37の光路調整層38と接する側の面上が平坦化されているため、画素20毎に光路調整層38の厚みを調整することによって、反射電極35と画素電極31との間の光路調整を正確に行うことが可能である。これにより、上述した共振構造による色再現性の良い有機EL素子30の発光動作を行うことが可能である。また、外部接続用端子103において、第1の端子層350等による段差を保護層37により平坦化されている。したがって、複数の外部接続用端子103が設けられた領域を平坦にすることができ、外部の回路との接続を確実に行うことができる。   Further, in the organic EL device 100 of the present embodiment, since the surface of the protective layer 37 on the side in contact with the optical path adjustment layer 38 is flattened, the thickness of the optical path adjustment layer 38 is adjusted for each pixel 20. Thereby, the optical path between the reflective electrode 35 and the pixel electrode 31 can be accurately adjusted. Thereby, it is possible to perform the light emitting operation of the organic EL element 30 having good color reproducibility by the above-described resonance structure. Further, in the external connection terminal 103, a step caused by the first terminal layer 350 and the like is flattened by the protective layer 37. Therefore, a region where the plurality of external connection terminals 103 are provided can be made flat, and connection with an external circuit can be reliably performed.

また、本実施形態の有機EL装置100では、上述した保護層37の面上に配置される光路調整層38も平坦化されるため、この光路調整層38の面上に配置される画素電極31の端部を凹部39aが形成された位置よりも外側に位置させることができる。これにより、画素20の開口率、すなわち上述した画素20の発光領域を規定する開口29CTの開口面積(発光面積)を大きくすることが可能である。   In the organic EL device 100 according to the present embodiment, the optical path adjustment layer 38 disposed on the surface of the protective layer 37 is also flattened, so that the pixel electrode 31 disposed on the surface of the optical path adjustment layer 38 is formed. Can be located outside the position where the concave portion 39a is formed. Accordingly, it is possible to increase the aperture ratio of the pixel 20, that is, the opening area (light emitting area) of the opening 29CT that defines the light emitting region of the pixel 20 described above.

また、本実施形態の有機EL装置100では、上述した第1の絶縁膜39の面上に光路調整層38(絶縁膜38a,38b)の少なくとも一部の端部が位置するように配置されている。このうち、光路調整層38(絶縁膜38a,38b)及び埋め込み絶縁膜40には、酸化シリコン(SiO2)が用いられ、第1の絶縁膜39には、酸化シリコン(SiO2)よりもエッチングレートが低い窒化シリコン(SiN)が用いられている。   Further, in the organic EL device 100 of the present embodiment, at least a part of the end of the optical path adjustment layer 38 (insulating films 38a and 38b) is arranged on the surface of the first insulating film 39 described above. I have. Of these, silicon oxide (SiO 2) is used for the optical path adjusting layers 38 (insulating films 38 a and 38 b) and the buried insulating film 40, and the first insulating film 39 has an etching rate higher than that of silicon oxide (SiO 2). Low silicon nitride (SiN) is used.

この場合、例えばフッ素系ガスを用いたドライエッチングによって、窒化シリコンに対して酸化シリコンを選択的にエッチングすることができる。したがって、光路調整層38を所定の形状にパターニングする際に、埋め込み絶縁膜40を保護しながら、第1の絶縁膜39を光路調整層38のエッチングストッパーとして機能させることが可能である。   In this case, silicon oxide can be selectively etched with respect to silicon nitride by, for example, dry etching using a fluorine-based gas. Therefore, when the optical path adjusting layer 38 is patterned into a predetermined shape, the first insulating film 39 can function as an etching stopper for the optical path adjusting layer 38 while protecting the buried insulating film 40.

(変形例)
次に、上記有機EL装置100の変形例として、図10及び図11に示す有機EL装置200について説明する。なお、図10は、画素20(画素20B,20G,20R)の構成を示す平面図である。図11は、図10中に示す線分E─E’による画素20Gの断面図である。また、以下の説明では、上記有機EL装置100と同等の部位については、説明を省略すると共に、図面において同じ符号を付すものとする。
(Modification)
Next, as a modified example of the organic EL device 100, an organic EL device 200 shown in FIGS. 10 and 11 will be described. FIG. 10 is a plan view showing the configuration of the pixel 20 (pixels 20B, 20G, and 20R). FIG. 11 is a cross-sectional view of the pixel 20G taken along a line E─E ′ shown in FIG. In the following description, portions that are the same as those of the organic EL device 100 will not be described, and will be denoted by the same reference numerals in the drawings.

有機EL装置200は、図10及び図11に示すように、上記画素20毎に分割して配置された反射電極35の代わりに、電源線6の一部により構成された反射電極60を備えている。すなわち、この反射電極60は、各画素20B,20G,20Rに共通して配置されている。   As shown in FIGS. 10 and 11, the organic EL device 200 includes a reflective electrode 60 constituted by a part of the power supply line 6 instead of the reflective electrode 35 divided for each pixel 20. I have. That is, the reflective electrode 60 is arranged in common for each of the pixels 20B, 20G, and 20R.

また、図3に示したように、電源線6には、トランジスター121のソース及び容量21の一端が接続されている。したがって、反射電極60は、発光機能層32側からの光を反射すると共に、電源の高位側となる電位Velを画素回路110に供給する役割を果たす。第1のコンタクト電極28と同様、層間絶縁層(絶縁層)34には、コンタクト電極を備える。   Further, as shown in FIG. 3, the source of the transistor 121 and one end of the capacitor 21 are connected to the power supply line 6. Therefore, the reflective electrode 60 plays a role of reflecting the light from the light emitting function layer 32 side and supplying the potential Vel on the higher side of the power supply to the pixel circuit 110. Similarly to the first contact electrode 28, the interlayer insulating layer (insulating layer) 34 includes a contact electrode.

また、有機EL装置200は、上記第1のコンタクト電極28と電気的に接続される中継電極61を備えている。各画素20には、平面視で矩形状の開口60CTが形成されている。コンタクトホール60CTは、反射電極60を貫通する孔部であり、中継電極61は、この開口60CTの内側に配置されている。   In addition, the organic EL device 200 includes a relay electrode 61 that is electrically connected to the first contact electrode 28. Each pixel 20 is formed with a rectangular opening 60CT in plan view. The contact hole 60CT is a hole penetrating the reflective electrode 60, and the relay electrode 61 is disposed inside the opening 60CT.

本実施形態では、反射電極60及び中継電極61として、例えば膜厚30nmのチタン(Ti)膜の上に、膜厚100nmのアルミニウム(Al)と銅(Cu)との合金(AlCu)膜を形成している。   In the present embodiment, an alloy (AlCu) film of aluminum (Al) and copper (Cu) with a thickness of 100 nm is formed as a reflective electrode 60 and a relay electrode 61 on a titanium (Ti) film with a thickness of 30 nm, for example. are doing.

また、有機EL装置200は、上記増反射層36が省略されると共に、上記保護層37及び光路調整層38の代わりに、光学調整層62を備えている。光学調整層62は、開口60CTが形成された反射電極60の面上を覆うと共に、開口60CTの内側に形成された凹部63aを有する第1の絶縁膜63と、凹部63aに埋め込まれた埋め込み絶縁膜64と、第1の絶縁膜63の面上に配置された第2の絶縁膜66とを有している。   In addition, the organic EL device 200 has an optical adjustment layer 62 instead of the protective layer 37 and the optical path adjustment layer 38 while omitting the enhanced reflection layer 36. The optical adjustment layer 62 covers the surface of the reflective electrode 60 in which the opening 60CT is formed, and has a first insulating film 63 having a recess 63a formed inside the opening 60CT, and a buried insulating film embedded in the recess 63a. It has a film 64 and a second insulating film 66 disposed on the surface of the first insulating film 63.

また、有機EL装置200は、上記第2のコンタクト電極41の代わりに、画素電極31と電気的に接続される第2のコンタクト電極67を備えている。第2のコンタクト電極67は、中継電極61と接続される第1のコンタクト部67aと、画素電極31と接続される第2のコンタクト部67bとを有している。コンタクトホール67CTは、第1の絶縁膜63を貫通する孔部であり、第1のコンタクト部67aは、コンタクトホール67CTに埋め込まれるように形成されている。第2のコンタクト部67bは、第2の絶縁膜66の面上に配置されている。   In addition, the organic EL device 200 includes a second contact electrode 67 electrically connected to the pixel electrode 31 instead of the second contact electrode 41. The second contact electrode 67 has a first contact part 67a connected to the relay electrode 61, and a second contact part 67b connected to the pixel electrode 31. The contact hole 67CT is a hole penetrating the first insulating film 63, and the first contact portion 67a is formed so as to be embedded in the contact hole 67CT. The second contact part 67b is arranged on the surface of the second insulating film 66.

光学調整層62のうち、第1の絶縁膜63及び埋め込み絶縁膜64は、保護層として機能している。また、第2の絶縁膜66は、光路調整層として機能している。   In the optical adjustment layer 62, the first insulating film 63 and the buried insulating film 64 function as protective layers. Further, the second insulating film 66 functions as an optical path adjusting layer.

第2の絶縁膜66は、第1の絶縁膜63及び第2のコンタクト部67bの面上を覆うように配置されている。画素電極31は、この第2の絶縁膜66に形成されたコンタクトホール31CTを介してコンタクト電極67(第2のコンタクト部67b)と接続されている。   The second insulating film 66 is disposed so as to cover the surfaces of the first insulating film 63 and the second contact portion 67b. The pixel electrode 31 is connected to a contact electrode 67 (second contact portion 67b) via a contact hole 31CT formed in the second insulating film 66.

なお、本実施形態では、第1の絶縁膜63として、窒化シリコン(SiN)膜を形成し、埋め込み絶縁膜64、第2の絶縁膜66として、酸化シリコン(SiO2)膜を形成している。   In the present embodiment, a silicon nitride (SiN) film is formed as the first insulating film 63, and a silicon oxide (SiO2) film is formed as the buried insulating film 64 and the second insulating film 66.

また、光学調整層62の膜厚は、画素20B、画素20G、画素20Rの順で大きくなっている。すなわち、画素20Bでは、例えば共振波長(輝度が最大となるピーク波長)が470nmとなるように、第1の絶縁膜63が設けられている。画素20Gでは、例えば共振波長が540nmとなるように、第1の絶縁膜63及び第2の絶縁膜66が設けられている。画素20Rでは、例えば共振波長が610nmとなるように、第1の絶縁膜63、第2の絶縁膜66及び第3の絶縁膜(図示せず)が設けられている。   The thickness of the optical adjustment layer 62 increases in the order of the pixel 20B, the pixel 20G, and the pixel 20R. That is, in the pixel 20B, the first insulating film 63 is provided so that, for example, the resonance wavelength (the peak wavelength at which the luminance becomes maximum) is 470 nm. In the pixel 20G, the first insulating film 63 and the second insulating film 66 are provided so that, for example, the resonance wavelength becomes 540 nm. In the pixel 20R, for example, a first insulating film 63, a second insulating film 66, and a third insulating film (not shown) are provided so that the resonance wavelength becomes 610 nm.

なお、本実施形態において、増反射層36を省略したが、第1の絶縁膜63と反射電極60との間に増反射層36を備えた構成であってもよい。   In the present embodiment, the reflection enhancing layer 36 is omitted, but a configuration in which the reflection enhancing layer 36 is provided between the first insulating film 63 and the reflection electrode 60 may be adopted.

以上のような構成を有する有機EL装置200では、中継電極61及びコンタクト電極67を介してトランジスター124と画素電極31とが電気的に接続されている。また、コンタクト電極67は、中継電極61及び開口60CTを覆うように設けられている。そして、コンタクト電極67は、反射電極60の少なくとも一部と平面視重なるように設けられている。そして、コンタクト電極67は遮光性を有している。この構成によれば、開口60CTから入射する光をコンタクト電極67で遮光することによって、表示品質を向上させることが可能である。なお、本実施形態では、コンタクト電極67として、例えば厚みが500nmの窒化チタン(TiN)膜を形成している。   In the organic EL device 200 having the above configuration, the transistor 124 and the pixel electrode 31 are electrically connected via the relay electrode 61 and the contact electrode 67. The contact electrode 67 is provided so as to cover the relay electrode 61 and the opening 60CT. The contact electrode 67 is provided so as to overlap at least a part of the reflective electrode 60 in a plan view. The contact electrode 67 has a light shielding property. According to this configuration, it is possible to improve display quality by blocking the light incident from the opening 60CT with the contact electrode 67. In this embodiment, as the contact electrode 67, for example, a titanium nitride (TiN) film having a thickness of 500 nm is formed.

本実施形態の有機EL装置200では、上述した有機EL装置100と同様に、第1の端子層350に反射電極35と同じ第1の導電膜35LYと、第2の端子層410にコンタクト電極67と同じ第2の導電膜41LYと、第3の端子層310に画素電極31と同じ第3の導電膜31LYとを用いて、有機EL素子30を作製するプロセス中で、第1の端子層350と、第2の端子層410と、第3の端子層310とが順に積層された外部接続用端子103を作製することが可能である。   In the organic EL device 200 of the present embodiment, as in the organic EL device 100 described above, the first terminal layer 350 has the same first conductive film 35LY as the reflective electrode 35, and the second terminal layer 410 has the contact electrode 67. In the process of manufacturing the organic EL element 30 using the same second conductive film 41LY as the above and the third conductive film 31LY as the pixel electrode 31 for the third terminal layer 310, the first terminal layer 350 , A second terminal layer 410 and a third terminal layer 310 can be manufactured in that order.

したがって、本実施形態の有機EL装置200では、上述した有機EL装置100と同様に、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)との間に、第2の端子層410(第2の導電膜41LY)を形成することで、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)とを直接積層する場合よりも、外部接続用端子103の抵抗値を下げることが可能である。また、反射電極35は、第1の導電膜35LYにより形成されるため、この反射電極35の反射率が低下することを防ぐことができる。   Therefore, in the organic EL device 200 of the present embodiment, similarly to the above-described organic EL device 100, the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY) are used. ), The second terminal layer 410 (the second conductive film 41LY) is formed, so that the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 35LY) are formed. The resistance value of the external connection terminal 103 can be reduced as compared with the case where the conductive film 31LY is directly laminated. In addition, since the reflective electrode 35 is formed of the first conductive film 35LY, it is possible to prevent the reflectance of the reflective electrode 35 from decreasing.

なお、本実施形態の有機EL装置200の製造方法については、その説明を省略するものの、上述した有機EL装置100の製造方法と同様の方法を用いることによって、同様の効果を得ることが可能である。   Although the description of the method of manufacturing the organic EL device 200 of the present embodiment is omitted, the same effect can be obtained by using the same method as the method of manufacturing the organic EL device 100 described above. is there.

すなわち、第1の端子層350に反射電極35と同じ第1の導電膜35LYと、第2の端子層410に第2のコンタクト電極67と同じ第2の導電膜41LYと、第3の端子層310に画素電極31と同じ第3の導電膜31LYとを用いて、有機EL素子30を作製するプロセス中で、第1の端子層350と、第2の端子層410と、第3の端子層310とが順に積層された外部接続用端子103を作製することが可能である。   That is, the first terminal layer 350 has the first conductive film 35LY same as the reflective electrode 35, the second terminal layer 410 has the second conductive film 41LY same as the second contact electrode 67, and the third terminal layer. In the process of manufacturing the organic EL element 30 by using the same third conductive film 31LY as the pixel electrode 31 as the pixel electrode 31, the first terminal layer 350, the second terminal layer 410, and the third terminal layer It is possible to manufacture the external connection terminal 103 in which the external connection terminals 310 and 310 are sequentially stacked.

また、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)との間に、第2の端子層410(第2の導電膜41LY)を形成することで、第1の端子層350(第1の導電膜35LY)と第3の端子層310(第3の導電膜31LY)とを直接積層する場合よりも、外部接続用端子103の抵抗値を下げることが可能である。また、反射電極35は、第1の導電膜35LYにより形成されるため、この反射電極35の反射率が低下することを防ぐことができる。   The second terminal layer 410 (the second conductive film 41LY) is provided between the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY). Is formed, the first terminal layer 350 (the first conductive film 35LY) and the third terminal layer 310 (the third conductive film 31LY) are more directly stacked than the external connection terminals 103. It is possible to lower the resistance value. In addition, since the reflective electrode 35 is formed of the first conductive film 35LY, it is possible to prevent the reflectance of the reflective electrode 35 from decreasing.

(電子機器)
次に、上記有機EL装置100,200を備えた電子機器の一例として、図12に示すヘッドマウントディスプレイ1000について説明する。なお、図12は、マウントディスプレイ1000の構成を示す概略図である。
(Electronics)
Next, a head-mounted display 1000 shown in FIG. 12 will be described as an example of an electronic apparatus including the organic EL devices 100 and 200. FIG. 12 is a schematic diagram showing the configuration of the mount display 1000.

ヘッドマウントディスプレイ1000は、図12に示すように、左右の目に対応して設けられた2つの表示部1001を有している。観察者Mはヘッドマウントディスプレイ1000を眼鏡のように頭部に装着することにより、表示部1001に表示された文字や画像などを見ることができる。例えば、左右の表示部1001に視差を考慮した画像を表示すれば、立体的な映像を見て楽しむこともできる。   As shown in FIG. 12, the head mounted display 1000 has two display units 1001 provided corresponding to the left and right eyes. The observer M can see characters, images, and the like displayed on the display unit 1001 by wearing the head mounted display 1000 on the head like eyeglasses. For example, if an image in which parallax is considered is displayed on the left and right display units 1001, it is possible to enjoy viewing a stereoscopic video.

表示部1001には、上記有機EL装置100,200が用いられている。上記有機EL装置100,200では、上述した反射電極35の反射率が低下することを防ぎつつ、外部接続用端子103の抵抗値を下げることが可能である。したがって、表示部1001に上記有機EL装置100,200を搭載することで、点欠陥の発生が抑制され且つ高品位の表示のヘッドマウントディスプレイ1000を提供することが可能である。   The display unit 1001 uses the organic EL devices 100 and 200 described above. In the organic EL devices 100 and 200, the resistance value of the external connection terminal 103 can be reduced while preventing the reflectance of the reflective electrode 35 from decreasing as described above. Therefore, by mounting the organic EL devices 100 and 200 on the display unit 1001, it is possible to provide the head mounted display 1000 that suppresses the occurrence of point defects and has high-quality display.

なお、本発明は、上記実施形態のものに必ずしも限定されるものではなく、本発明の趣旨を逸脱しない範囲において種々の変更を加えることが可能である。
具体的に、本発明を適用した電気光学装置としては、上述した発光素子として有機EL素子を備えた有機EL装置に限定されず、例えば無機EL素子やLEDなどの自発光型の発光素子備えた電気光学装置に対して本発明を幅広く適用することが可能である。
Note that the present invention is not necessarily limited to the above-described embodiment, and various changes can be made without departing from the spirit of the present invention.
Specifically, the electro-optical device to which the present invention is applied is not limited to an organic EL device including an organic EL element as the light emitting element described above, and includes a self-luminous light emitting element such as an inorganic EL element or an LED. The present invention can be widely applied to electro-optical devices.

また、本発明を適用した電子機器としては、上述したヘッドマウントディスプレイ1000に限らず、例えば、ヘッドアップディスプレイや、デジタルカメラの電子ビューファインダー、携帯型情報端末、ナビゲーターなどの表示部に、本発明を適用した電気光学装置を用いた電子機器を挙げることができる。   Further, the electronic apparatus to which the present invention is applied is not limited to the head-mounted display 1000 described above. For example, a head-up display, an electronic viewfinder of a digital camera, a portable information terminal, and a display unit of a navigator may be used. An electronic device using an electro-optical device to which is applied.

6…電源線 10…素子基板 20(20B,20G,20R)…画素 28…第1の
コンタクト電極 30(30B,30G,30R)…有機EL素子(発光素子) 31…
画素電極(第1の電極) 31LY…第3の導電膜 310…第3の端子層 310CT
…第2のコンタクトホール 32…発光機能層(発光層) 33…対向電極(第2の電極
) 34…層間絶縁層(絶縁層) 35…反射電極 35CT…開口 35LY…第1の
導電膜 350…第1の端子層 36…増反射層 37…保護層 38…光路調整層 3
9…第1の絶縁膜 39a,39b…凹部 40…埋め込み絶縁膜 41…第2のコンタ
クト電極 41a…第1のコンタクト部 41b…第2のコンタクト部 41CT…コン
タクトホール 41LY…第2の導電膜 410…第2の端子層 410CT…第1のコ
ンタクトホール 60…反射電極 60CT…開口 61…中継電極 62…光学調整層
(保護層、光路調整層) 63…第1の絶縁膜 63a…凹部 64…埋め込み絶縁膜
66…第2の絶縁膜 67…第2のコンタクト電極 67a…第1のコンタクト部 67
b…第2のコンタクト部 67CT…コンタクトホール 67EL…導電膜 68…マス
ク層 E…表示領域 F…周辺領域 100,200…有機EL装置(電気光学装置)
103…外部接続用端子(端子) 110…画素回路 124…トランジスター 100
0…ヘッドマウントディスプレイ(電子機器)
6 Power line 10 Element substrate 20 (20B, 20G, 20R) Pixel 28 First contact electrode 30 (30B, 30G, 30R) Organic EL element (light emitting element) 31
Pixel electrode (first electrode) 31LY: third conductive film 310: third terminal layer 310CT
... second contact hole 32 ... light emitting function layer (light emitting layer) 33 ... counter electrode (second electrode) 34 ... interlayer insulating layer (insulating layer) 35 ... reflecting electrode 35CT ... opening 35LY ... first conductive film 350 ... First terminal layer 36: Increasing reflection layer 37: Protective layer 38: Optical path adjusting layer 3
9 first insulating films 39a and 39b concave portions 40 embedded insulating films 41 second contact electrodes 41a first contact portions 41b second contact portions 41CT contact holes 41LY second conductive films 410 ... Second terminal layer 410CT First contact hole 60 Reflective electrode 60CT Opening 61 Relay electrode 62 Optical adjustment layer (protective layer, optical path adjustment layer) 63 First insulating film 63a Concavity 64 Embedded Insulating film
66 second insulating film 67 second contact electrode 67a first contact portion 67
b ... second contact part 67CT ... contact hole 67EL ... conductive film 68 ... mask layer E ... display area F ... peripheral area 100,200 ... organic EL device (electro-optical device)
103: external connection terminal (terminal) 110: pixel circuit 124: transistor 100
0: Head mounted display (electronic equipment)

Claims (9)

複数の発光素子がマトリックス状に配列された表示領域と、前記表示領域の外側に端子が配置された周辺領域と、含む素子基板を備え、
前記発光素子は、反射電極と、前記反射電極を覆う絶縁層と、光路調整層と、第1の電極と、画素分離層と、発光層と、第2の電極と、が積層され、前記第1の電極がコンタクト電極と電気的に接続された構造を有し、
前記端子は、前記反射電極と同じ第1の導電膜により形成される第1の端子層と、前記コンタクト電極と同じ第2の導電膜により形成される第2の端子層と、前記第1の電極と同じ第3の導電膜により形成される第3の端子層と、が積層された構造を有し、
前記画素分離層は、前記第1の電極の一部を露出させる開口部を有し、
平面視で前記コンタクト電極は、前記開口部と重なっておらず、
平面視で隣り合う2つの前記開口部の間の領域において、前記光路調整層の端部と前記コンタクト電極の一部とが互いに重なり、
平面視で前記開口部と重ならない領域に、前記絶縁層を貫通するコンタクトホールが設けられ、前記コンタクト電極は、前記コンタクトホールを介して前記反射電極に電気的に接続され、
前記コンタクト電極の一部の面上に、前記光路調整層が設けられ、前記コンタクト電極の他の一部の面上に、前記光路調整層が設けられていない部位が設けられ、
前記第1の電極は、前記部位においてコンタクト電極と電気的に接続されていることを特徴とする電気光学装置。
Comprising a display region in which a plurality of light emitting elements are arranged in a matrix, and a peripheral area where the terminal on the outside of the display region is disposed, the device substrate including,
The light emitting element includes a reflective electrode , an insulating layer covering the reflective electrode, an optical path adjustment layer, a first electrode, a pixel separation layer, a light emitting layer, and a second electrode, which are stacked. A structure in which one electrode is electrically connected to a contact electrode;
The terminal includes a first terminal layer formed of the same first conductive film as the reflective electrode, a second terminal layer formed of the same second conductive film as the contact electrode, and the first terminal layer. A third terminal layer formed of the same third conductive film as the electrode;
The pixel separation layer has an opening exposing a part of the first electrode,
In a plan view, the contact electrode does not overlap with the opening,
In the area between the two said adjacent openings in plan view, Ri part and heavy Do each other of the contact electrode and the end portion of the optical path adjusting layer,
In a region that does not overlap with the opening in plan view, a contact hole that penetrates the insulating layer is provided, and the contact electrode is electrically connected to the reflective electrode through the contact hole,
On a part of the surface of the contact electrode, the optical path adjusting layer is provided, and on another part of the surface of the contact electrode, a part where the optical path adjusting layer is not provided is provided,
The electro-optical device according to claim 1, wherein the first electrode is electrically connected to a contact electrode at the portion .
前記第3の導電膜は、透明導電材料を含み、
前記第2の導電膜は、前記第3の導電膜よりも導電性の高い導電材料を含み、
前記第1の導電膜は、導電材料を含むことを特徴とする請求項1に記載の電気光学装置。
The third conductive film includes a transparent conductive material,
The second conductive film includes a conductive material having higher conductivity than the third conductive film,
The electro-optical device according to claim 1, wherein the first conductive film contains a conductive material.
前記第3の導電膜は、酸化インジウムスズを含み、
前記第2の導電膜は、窒化チタンを含み、
前記第1の導電膜は、アルミニウム及び銅を含むことを特徴とする請求項2に記載の電気光学装置。
The third conductive film includes indium tin oxide,
The second conductive film includes titanium nitride,
The electro-optical device according to claim 2, wherein the first conductive film includes aluminum and copper.
前記第1の電極は、前記コンタクト電極を介して前記反射電極と電気的に接続され、 前記反射電極は、前記画素毎に分割して配置されると共に、前記発光素子を駆動するトランジスターと電気的に接続されていることを特徴とする請求項1〜3の何れか一項に記載の電気光学装置。   The first electrode is electrically connected to the reflection electrode via the contact electrode, and the reflection electrode is divided for each pixel and electrically connected to a transistor that drives the light emitting element. The electro-optical device according to claim 1, wherein the electro-optical device is connected to the electro-optical device. 前記反射電極は、電源線の一部により構成され、
前記反射電極に形成された開口の内側に、前記発光素子を駆動するトランジスターと電気的に接続される中継電極が配置され、
前記第1の電極は、前記コンタクト電極を介して前記中継電極と電気的に接続されていることを特徴とする請求項1〜3の何れか一項に記載の電気光学装置。
The reflective electrode is constituted by a part of a power supply line,
Inside the opening formed in the reflective electrode, a relay electrode electrically connected to a transistor for driving the light emitting element is arranged,
The electro-optical device according to claim 1, wherein the first electrode is electrically connected to the relay electrode via the contact electrode.
請求項1〜5の何れか一項に記載の電気光学装置を備えることを特徴とする電子機器。   An electronic apparatus comprising the electro-optical device according to claim 1. 複数の発光素子がマトリックス状に配列された表示領域と、前記表示領域の外側に端子が配置された周辺領域と、含み、前記発光素子は、反射電極と、前記反射電極を覆う絶縁層と、光路調整層と、第1の電極と、画素分離層と、発光層と、第2の電極と、が積層され、前記第1の電極がコンタクト電極と電気的に接続された構造を有し、前記端子は、第1の端子層と、第2の端子層と、第3の端子層と、が積層された構造を有し、前記画素分離層は、前記第1の電極の一部を露出させる開口部を有し、平面視で前記コンタクト電極は、前記開口部と重なっておらず、平面視で隣り合う2つの前記開口部の間の領域において、前記光路調整層の端部と前記コンタクト電極の一部とが互いに重なり、平面視で前記開口部と重ならない領域に、前記絶縁層を貫通するコンタクトホールが設けられ、前記コンタクト電極は、前記コンタクトホールを介して前記反射電極に電気的に接続され、前記コンタクト電極の一部の面上に、前記光路調整層が設けられ、前記コンタクト電極の他の一部の面上に、前記光路調整層が設けられていない部位が設けられ、前記第1の電極は、前記部位においてコンタクト電極と電気的に接続されている電気光学装置の製造方法であって、
第1の導電膜を形成し、前記第1の導電膜をパターニングすることによって、前記表示領域に前記反射電極を形成し、前記周辺領域に前記第1の端子層を形成する工程と、
第2の導電膜を形成し、前記第2の導電膜をパターニングすることによって、前記表示領域に前記コンタクト電極を形成し、前記周辺領域において前記第1の端子層の上に前記第2の端子層を積層する工程と、
第3の導電膜を形成し、前記第3の導電膜をパターニングすることによって、前記表示領域に前記第1の電極を形成し、前記周辺領域において前記第2の端子層の上に前記第3の端子層を積層する工程と、を含むことを特徴とする電気光学装置の製造方法。
A display area in which a plurality of light emitting elements are arranged in a matrix, wherein the peripheral region where the terminal is located outside of the display region, the light emitting element includes a reflective electrode, an insulating layer covering the reflective electrode A light path adjusting layer, a first electrode, a pixel separation layer, a light emitting layer, and a second electrode are laminated, and the first electrode is electrically connected to a contact electrode. , The terminal has a structure in which a first terminal layer, a second terminal layer, and a third terminal layer are stacked, and the pixel separation layer forms a part of the first electrode. The contact electrode has an opening to be exposed, and in a plan view, the contact electrode does not overlap with the opening, and in a region between two adjacent openings in a plan view, the end of the optical path adjustment layer and the end portion. some of the contact electrode and Ri heavy do each other, in a region which does not overlap with the opening in a plan view, A contact hole penetrating the insulating layer is provided, the contact electrode is electrically connected to the reflection electrode through the contact hole, and the optical path adjustment layer is provided on a part of the surface of the contact electrode. A portion where the optical path adjustment layer is not provided is provided on another part of the surface of the contact electrode, and the first electrode is electrically connected to the contact electrode at the portion. A method for manufacturing an optical device, comprising:
Forming a first conductive film, patterning the first conductive film, forming the reflective electrode in the display region, and forming the first terminal layer in the peripheral region;
Forming a second conductive film; patterning the second conductive film to form the contact electrode in the display region; and forming the second terminal on the first terminal layer in the peripheral region. Stacking layers,
Forming a third conductive film, patterning the third conductive film to form the first electrode in the display region, and forming the third electrode on the second terminal layer in the peripheral region; Laminating the terminal layers described above.
前記第3の導電膜は、透明導電材料を含み、
前記第2の導電膜は、前記第3の導電膜よりも導電性の高い導電材料を含み、
前記第1の導電膜は、反射導電材料を含むことを特徴とする請求項7に記載の電気光学装置の製造方法。
The third conductive film includes a transparent conductive material,
The second conductive film includes a conductive material having higher conductivity than the third conductive film,
The method according to claim 7, wherein the first conductive film includes a reflective conductive material.
前記第3の導電膜は、酸化インジウムスズを含み、
前記第2の導電膜は、窒化チタンを含み、
前記第1の導電膜は、アルミニウム及び銅を含むことを特徴とする請求項8に記載の電気光学装置の製造方法。
The third conductive film includes indium tin oxide,
The second conductive film includes titanium nitride,
9. The method according to claim 8, wherein the first conductive film contains aluminum and copper.
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