JP6640005B2 - Wafer processing method - Google Patents
Wafer processing method Download PDFInfo
- Publication number
- JP6640005B2 JP6640005B2 JP2016079413A JP2016079413A JP6640005B2 JP 6640005 B2 JP6640005 B2 JP 6640005B2 JP 2016079413 A JP2016079413 A JP 2016079413A JP 2016079413 A JP2016079413 A JP 2016079413A JP 6640005 B2 JP6640005 B2 JP 6640005B2
- Authority
- JP
- Japan
- Prior art keywords
- modified layer
- wafer
- forming step
- laser beam
- modified
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000003672 processing method Methods 0.000 title claims description 4
- 230000001678 irradiating effect Effects 0.000 claims description 14
- 238000000034 method Methods 0.000 claims description 14
- 230000001681 protective effect Effects 0.000 claims description 14
- 238000012986 modification Methods 0.000 claims description 7
- 238000005336 cracking Methods 0.000 claims 1
- 235000012431 wafers Nutrition 0.000 description 118
- 230000006698 induction Effects 0.000 description 8
- 230000004048 modification Effects 0.000 description 6
- 238000002407 reforming Methods 0.000 description 5
- 239000000463 material Substances 0.000 description 4
- 230000015572 biosynthetic process Effects 0.000 description 3
- 239000002131 composite material Substances 0.000 description 3
- 239000013078 crystal Substances 0.000 description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- 244000309466 calf Species 0.000 description 2
- 230000003028 elevating effect Effects 0.000 description 2
- 230000001939 inductive effect Effects 0.000 description 2
- 230000002093 peripheral effect Effects 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/268—Bombardment with radiation with high-energy radiation using electromagnetic radiation, e.g. laser radiation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/683—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L21/6835—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L21/6836—Wafer tapes, e.g. grinding or dicing support tapes
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
Description
本発明は、ウエーハを個々のチップに分割するウエーハの分割方法に関する。 The present invention relates to a wafer dividing method for dividing a wafer into individual chips.
ウエーハの内部に改質層を形成し、その後研削すると同時にデバイスチップ化する加工において、研削時に個片化されたデバイスが動いてデバイス同士が接触してデバイスのコーナーに欠けが発生するという問題があった。かかる問題は、デバイスが個片化されたときに動いてしまうことに起因している。そのため、改質層から表面に至るクラックの成長具合を調整して個片化のタイミングを調整するために、改質層を形成するためのレーザー光線を破線状にウエーハの内部に照射するという加工方法がある(例えば、下記の特許文献1を参照)。
In the process of forming a modified layer inside the wafer and then grinding it into a device chip at the same time, the devices singulated during grinding move and the devices come into contact with each other, causing chipping at the corners of the device. there were. Such a problem is caused by the fact that the device moves when it is singulated. Therefore, in order to adjust the degree of crack growth from the modified layer to the surface and adjust the timing of singulation, a processing method of irradiating the inside of the wafer with a laser beam for forming the modified layer in a broken line shape. (For example, see
しかし、近年においては、電気的特性向上のために、結晶方位が分割予定ラインに対して45°の角度を有するシリコンウエーハなどが多く使用されており、シリコンウエーハの内部にレーザー光線を照射して改質層を破線状に形成すると、デバイスのコーナー付近でカーフが蛇行してしまう。これは、破線状に改質層を形成したため、改質層から表面に至るクラックが分割予定ラインに沿って順調に成長できなかったためであると考えられる。 However, in recent years, silicon wafers having a crystal orientation at an angle of 45 ° with respect to a line to be divided have been often used to improve electrical characteristics. If the material layer is formed as a broken line, the kerf will meander near the corner of the device. This is considered to be because the cracks from the modified layer to the surface could not grow smoothly along the planned dividing line because the modified layer was formed in a broken line shape.
本発明は、上記の事情にかんがみてなされたもので、改質層を形成した後に研削して個々のデバイスに分割する加工において、デバイスのコーナーに欠けが発生したり、コーナー付近のカーフが蛇行したりするのを防ぐことを目的とする。 The present invention has been made in view of the above circumstances, and in processing in which a modified layer is formed and then ground and divided into individual devices, chipping occurs in device corners, or a kerf near the corners meanders. The purpose is to prevent you from doing so.
本発明は、表面に所定の方向に延びる複数の第1の分割予定ラインと該複数の第1の分割予定ラインと交差して形成された複数の第2の分割予定ラインとによって区画された複数の領域にデバイスが形成されたウエーハを、該第1の分割予定ラインおよび該第2の分割予定ラインに沿って分割するウエーハの加工方法であって、ウエーハの表面側に保護部材を貼着する保護部材貼着工程と、該保護部材貼着工程の後、該保護部材側を保持し、ウエーハに対して透過性を有する波長のレーザー光線をウエーハの裏面側から集光点をウエーハの内部に位置付けて該第1の分割予定ラインに沿って照射し、ウエーハの内部に該第1の分割予定ラインに沿って第1の改質層を形成する第1の改質層形成工程と、ウエーハに対して透過性を有する波長のレーザー光線をウエーハの裏面側から集光点をウエーハの内部に位置付けて該第2の分割予定ラインに沿って照射し、ウエーハの内部に該第2の分割予定ラインに沿って第2の改質層を形成する第2の改質層形成工程と、該第1の改質層形成工程および該第2の改質層形成工程を実施した後、該保護部材側を保持してウエーハの裏面から研削手段により研削し仕上げ厚さへと薄化するとともに研削動作により該改質層を起点としてウエーハの表面に至るクラックを該分割予定ラインに沿って成長させ、ウエーハを個々のデバイスに分割する分割工程と、を備え、該第1の改質層形成工程においてもしくは該第2の改質層形成工程において又は該第1の改質層形成工程および該第2の改質層形成工程の両工程において、該改質層は、1つの分割予定ラインにつき、該改質層からウエーハの表面に至るクラックの成長を誘導する少なくとも1つ以上の誘導改質層と、該改質層からウエーハの表面に至るクラックの成長を調整するための少なくとも1つ以上の調整改質層と、で複合的に形成され、該調整改質層は、所定の間隔を設けて各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てた非改質層領域を有し、該誘導改質層は、該改質層領域よりも短い所定の間隔を設けて、各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てて該非改質層領域よりも小さい非改質層領域を有し、ウエーハの裏面から表面にかけて、該調整改質層及び該誘導改質層の非改質層領域を、段階的に小さくする。 According to the present invention, a plurality of first divided lines extending in a predetermined direction on a surface and a plurality of second divided lines formed to intersect the plurality of first divided lines are defined. Is a method of processing a wafer having a device formed in the region (1) along the first planned dividing line and the second planned dividing line, wherein a protective member is attached to the front surface side of the wafer. After the protective member attaching step and the protective member attaching step, the protective member side is held, and a laser beam having a wavelength that is transmissive to the wafer is positioned from the back side of the wafer to a focusing point inside the wafer. A first modified layer forming step of irradiating along the first scheduled dividing line to form a first modified layer inside the wafer along the first scheduled dividing line; Of a wavelength that is transparent A laser beam is irradiated from the back side of the wafer at a condensing point positioned inside the wafer along the second scheduled line, and a second reforming is performed inside the wafer along the second scheduled line. After performing the second modified layer forming step of forming a layer, the first modified layer forming step, and the second modified layer forming step, the protection member side is held and the wafer is held from the back surface. Grinding by a grinding means to reduce the thickness to a finished thickness, and a grinding operation to grow cracks reaching the surface of the wafer from the modified layer as starting points along the planned dividing line, thereby dividing the wafer into individual devices. And in the first modified layer forming step or in the second modified layer forming step, or both the first modified layer forming step and the second modified layer forming step In the modified layer, one divided At least one induction-modified layer for inducing the growth of cracks from the modified layer to the surface of the wafer, and at least one for adjusting the growth of cracks from the modified layer to the surface of the wafer. And one or more adjustment / modification layers, are formed in a composite manner , and the adjustment / reformation layer is provided at a predetermined interval to stop irradiation of the laser beam at least once to one side of each device, The wafer has a non-modified layer region at a predetermined interval inside the wafer, and the induction-modified layer has a predetermined interval shorter than the modified layer region, and is at least one side of each device. By stopping the irradiation of the laser beam once, the wafer has a non-modified layer region smaller than the non-modified layer region at a predetermined interval inside the wafer, and the adjusted and modified layer is formed from the back surface to the front surface of the wafer. And a non-modified layer of the induction-modified layer The area is gradually reduced.
本発明にかかるウエーハの加工方法は、ウエーハの表面側に保護部材を貼着する保護部材貼着工程と、ウエーハの内部に第1の分割予定ラインに沿って第1の改質層を形成する第1の改質層形成工程と、ウエーハの内部に第2の分割予定ラインに沿って第2の改質層を形成する第2の改質層形成工程と、研削動作により改質層を起点としてウエーハの表面に至るクラックを分割予定ラインに沿って成長させ、ウエーハを個々のデバイスに分割する分割工程とを備え、第1の改質層形成工程においてもしくは第2の改質層形成工程において又は第1の改質層形成工程および第2の改質層形成工程の両工程において、ウエーハの内部に形成される改質層は、1つの分割予定ラインにつき、改質層からウエーハの表面に至るクラックの成長を誘導する少なくとも1つ以上の誘導改質層と、改質層からウエーハの表面に至るクラックの成長を調整するための少なくとも1つ以上の調整改質層と、で複合的に形成されるため、誘導改質層により改質層から発生したクラックがウエーハの表面側へ誘導されるとともに、調整改質層により表面に至るクラックの成長具合が調整されるため、ウエーハを個々のデバイスに分割する際にデバイスチップのコーナーに欠けが生じたりコーナー付近のカーフに蛇行が生じたりするのを防ぐことができる。 In the method for processing a wafer according to the present invention, a protective member attaching step of attaching a protective member to the front surface side of the wafer, and a first modified layer is formed inside the wafer along a first dividing line. A first modified layer forming step, a second modified layer forming step of forming a second modified layer inside the wafer along a second scheduled division line, and starting the modified layer by a grinding operation. Dividing the wafer into individual devices by growing cracks reaching the surface of the wafer along the planned dividing line, and in the first modified layer forming step or in the second modified layer forming step Alternatively, in both the first modified layer forming step and the second modified layer forming step, the modified layer formed inside the wafer is transferred from the modified layer to the surface of the wafer for each division line. Induces crack growth Since at least one induction-modified layer and at least one adjustment-modified layer for adjusting the growth of cracks from the modified layer to the surface of the wafer are formed in a complex manner, the induction modification is performed. The cracks generated from the modified layer by the modified layer are guided to the surface side of the wafer, and the growth state of the cracks reaching the surface is adjusted by the modified layer, so that when the wafer is divided into individual devices, Chips can be prevented from being chipped at corners and meandering from a kerf near the corners.
上記調整改質層は、所定の間隔を設けて各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てた非改質層領域を有するため、ウエーハの分割時に非改質層領域からクラックが生じず、隣り合うデバイスが接触しないようにデバイスの個片化されるタイミングが調整されるため、デバイスのコーナーに欠けが発生したり、コーナー付近のカーフが蛇行したりするのを効果的に防止することができる。 The adjustment-modified layer has a non-modified layer region at a predetermined interval inside the wafer by stopping irradiation of the laser beam at least once to one side of each device at a predetermined interval. Therefore, when the wafer is divided, cracks do not occur from the non-modified layer region, and the timing of device singulation is adjusted so that adjacent devices do not come into contact with each other. The meandering of a nearby calf can be effectively prevented.
上記誘導改質層は、上記非改質層領域よりも短い所定の間隔を設けて、各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てて該非改質層領域よりも小さい非改質層領域を有するため、かかる小さい非改質層領域からクラックが誘導されず、ウエーハの分割時にデバイスの動きを制限して、デバイスのコーナーに欠けが発生したり、コーナー付近のカーフが蛇行したりするのをより効果的に防止することができる。 The induction-modified layer is provided with a predetermined interval shorter than the non-modified layer region, and the laser beam irradiation is stopped at least once on one side of each device, so that a predetermined interval is formed inside the wafer. Has a non-modified layer region smaller than the non-modified layer region, cracks are not induced from such a small non-modified layer region, restricting the movement of the device at the time of dividing the wafer, to the corners of the device. The occurrence of chipping and the meandering of the calf near the corner can be more effectively prevented.
図1に示すウエーハWは、円形板状の基板を有する被加工物の一例である。ウエーハWの表面Waには、所定の方向として例えば第1方向に延びる複数の第1の分割予定ラインS1と複数の第1の分割予定ラインS1と交差する第2方向に延びる複数の第2の分割予定ラインS2とによって区画された複数の領域にデバイスDが形成されている。一方、ウエーハWの表面Waと反対側にある面は、研削が施される裏面Wbとなっている。ウエーハWは、例えば、結晶方位が第1の分割予定ラインS1および第2の分割予定ラインS2の延在方向に対して45°の角度を有して形成されたシリコンウエーハであり、その外周には結晶方位に対して45°の方向に向くノッチNが形成されている。以下では、ウエーハWを、個々のデバイスDに分割するウエーハの加工方法について説明する。 The wafer W shown in FIG. 1 is an example of a workpiece having a circular plate-shaped substrate. On the surface Wa of the wafer W, for example, a plurality of first division lines S1 extending in a first direction as a predetermined direction and a plurality of second extensions extending in a second direction intersecting the plurality of first division lines S1. The devices D are formed in a plurality of regions partitioned by the scheduled division line S2. On the other hand, the surface of the wafer W opposite to the front surface Wa is the back surface Wb to be ground. The wafer W is, for example, a silicon wafer whose crystal orientation is formed at an angle of 45 ° with respect to the extending direction of the first planned division line S1 and the second planned division line S2, and Has a notch N oriented at 45 ° to the crystal orientation. Hereinafter, a method of processing a wafer that divides the wafer W into individual devices D will be described.
(1)保護部材貼着工程
図1に示すように、ウエーハWの表面Wa側に保護部材1を貼着する。保護部材1は、少なくともウエーハWと略同径に形成されている。ウエーハWの表面Waの全面が保護部材1によって覆われると、各デバイスDが保護される。保護部材1の材質は、特に限定されず、少なくとも粘着性を有していればよい。
(1) Protective Member Adhering Step As shown in FIG. 1, the
(2)テープ貼着工程
図2に示すように、拡張可能なテープTを環状のフレームFの下部に貼り付けるとともにテープTをウエーハWに貼着されている保護部材1の全面に貼着する。これにより、ウエーハWは、裏面Wb側が上向きに露出した状態でフレームFと一体となって形成される。
(2) Tape Adhering Step As shown in FIG. 2, an expandable tape T is attached to a lower portion of the annular frame F, and the tape T is attached to the entire surface of the
(3)改質層形成工程
改質層形成工程は、第1の改質層形成工程と第2の改質層形成工程とに分けられて実施される。本実施形態では、第1の改質層形成工程を実施した後に第2の改質層形成工程を実施する場合について説明する。なお、第2の改質層形成工程を実施した後に第1の改質層形成工程を実施してもよい。
(3) Modified layer forming step The modified layer forming step is performed by being divided into a first modified layer forming step and a second modified layer forming step. In the present embodiment, a case where the second modified layer forming step is performed after the first modified layer forming step is performed will be described. The first modified layer forming step may be performed after the second modified layer forming step is performed.
(3−1)第1の改質層形成工程
保護部材貼着工程及びテープ貼着工程を実施した後、保護部材1側を回転可能な保持テーブル10で保持し、保持テーブル10の上方側に配置されたレーザー光線照射手段20を用いてウエーハWの内部に第1の分割予定ラインS1に沿って改質層M(第1の改質層m1)を形成する。保持テーブル10の上面は、吸引源からの吸引作用を受けてウエーハWを吸引保持する保持面11となっている。保持テーブル10には、図示していないが、保持テーブル10とレーザー光線照射手段20とを鉛直方向(Z軸方向)と直交する水平方向(X軸方向およびY軸方向)に相対移動させる移動手段が接続されている。
(3-1) First Modified Layer Forming Step After performing the protective member attaching step and the tape attaching step, the
レーザー光線照射手段20は、ウエーハWに対して透過性を有する波長のレーザー光線LBを発振する発振器21と、レーザー光線LBを集光するための集光器22と、レーザー光線の出力を調整するための出力調整器とを少なくとも備えている。レーザー光線照射手段20は、Z軸方向に移動可能となっており、集光器22をZ軸方向に移動させてレーザー光線LBの集光位置を調整することができる。
The laser beam irradiation means 20 includes an
第1の改質層m1をウエーハWの内部に形成するときは、テープTを下向きにして、保持テーブル10の保持面11にウエーハWを載置し、ウエーハWの裏面Wbを上向きにさせ、吸引源の吸引力によって保持テーブル10の保持面11で保護部材1側を吸引保持する。レーザー光線照射手段20は、集光器22をウエーハWに接近するZ軸方向に下降させ、レーザー光線LBの集光点Pを所望の位置に調整する。続いて、例えば移動手段によって保持テーブル10をX軸方向に移動させることにより、レーザー光線照射手段20と保持テーブル10とを相対的にウエーハWの裏面Wbに対して平行な方向(X軸方向)に移動させつつ、発振器21からウエーハWに対して透過性を有する波長のレーザー光線LBをウエーハWの裏面Wb側から第1の分割予定ラインS1に沿って破線状に照射して、ウエーハWの内部に第1の改質層m1を形成する。すべての第1の分割予定ラインS1に沿ってレーザー光線LBを照射して第1の改質層m1を形成したら、第1の改質層形成工程が完了する。
When forming the first modified layer m1 inside the wafer W, the wafer T is placed on the
(3−2)第2の改質層形成工程
次いで、レーザー光線照射手段20を用いてウエーハWの内部に第2の分割予定ラインS2に沿って改質層M(第2の改質層m2)を形成する。具体的には、保持テーブル10が回転し、図1に示したウエーハWを90°回転させることにより、第2方向に向いている第2の分割予定ラインS2を例えばX軸方向に向かせる。レーザー光線照射手段20は、集光器22をウエーハWに接近するZ軸方向に下降させ、レーザー光線LBの集光点Pを所望の位置に調整する。続いて、例えば保持テーブル10をX軸方向に移動させることにより、レーザー光線照射手段20と保持テーブル10とを相対的にウエーハWの裏面W
bに対して平行な方向(X軸方向)に移動させつつ、レーザー光線照射手段20がウエーハWに対して透過性を有する波長のレーザー光線LBをウエーハWの裏面Wb側から第2の分割予定ラインS2に沿って破線状に照射して、ウエーハWの内部に第2の改質層m2を形成する。全ての第2の分割予定ラインS2に沿ってレーザー光線LBを照射して第2の改質層m2を形成したら、第2の改質層形成工程が完了する。
(3-2) Second Modified Layer Forming Step Next, the modified layer M (second modified layer m2) is placed inside the wafer W along the second scheduled division line S2 using the laser beam irradiation means 20. To form Specifically, by rotating the holding table 10 and rotating the wafer W shown in FIG. 1 by 90 °, the second scheduled division line S2 oriented in the second direction is oriented, for example, in the X-axis direction. The laser beam irradiation means 20 lowers the
The laser beam irradiating means 20 transmits a laser beam LB having a wavelength that is transmissive to the wafer W from the back surface Wb side of the wafer W to the second dividing line S2 while moving the laser beam LB in a direction (X-axis direction) parallel to b. Is irradiated in a broken line along the line to form a second modified layer m2 inside the wafer W. When the second modified layer m2 is formed by irradiating the laser beam LB along all the second scheduled division lines S2, the second modified layer forming step is completed.
改質層M(第1の改質層m1および第2の改質層m2)は、レーザー光線LBの照射によってウエーハWの内部の強度や物理的な特性が変化した領域である。改質層Mは、図2の部分拡大図に示すように、集光点Pの上方側に形成され、改質層Mの上端と下端との間の幅tは、例えば20〜30μm程度となっている。 The modified layer M (the first modified layer m1 and the second modified layer m2) is a region in which the intensity and physical characteristics inside the wafer W have changed by the irradiation of the laser beam LB. As shown in the partially enlarged view of FIG. 2, the modified layer M is formed above the light converging point P, and the width t between the upper end and the lower end of the modified layer M is, for example, about 20 to 30 μm. Has become.
ここで、第1の改質層形成工程においてもしくは第2の改質層形成工程において又は第1の改質層形成工程および第2の改質層形成工程の両工程を実施する際、ウエーハWの内部に形成される改質層M(第1の改質層m1および第2の改質層m2)は、図3に示すように、1つの分割予定ラインにつき、改質層MからウエーハWの表面Waに至るクラックの成長を誘導する少なくとも1つ以上の誘導改質層Miと、改質層MからウエーハWの表面Waに至るクラックの成長を調整するための少なくとも1つ以上の調整改質層Maと、で複合的に形成される。図示の例における改質層Mは、ウエーハWの表面Wa側に最も近い位置に形成された1層の誘導改質層Miと、誘導改質層Miの上に形成された2層の調整改質層Maとにより構成される。 Here, when the first modified layer forming step, the second modified layer forming step, or both the first modified layer forming step and the second modified layer forming step are performed, the wafer W As shown in FIG. 3, the modified layer M (the first modified layer m1 and the second modified layer m2) formed inside the wafer W is divided from the modified layer M to the wafer W for each division line. At least one induction-modified layer Mi for inducing the growth of a crack reaching the surface Wa of the wafer W, and at least one or more adjustment modification for adjusting the growth of the crack from the modified layer M to the surface Wa of the wafer W. And the composite layer Ma. In the illustrated example, the modified layer M is composed of one induction-modified layer Mi formed at a position closest to the surface Wa of the wafer W, and two layers formed on the induction-modified layer Mi. And the material layer Ma.
ウエーハWの内部に誘導改質層Miを形成する際、レーザー光線照射手段20は、集光器22の位置をずらして、より表面Wa側にレーザー光線LBの集光点Pを位置付けた状態でレーザー光線LBを照射することにより誘導改質層Miを形成するとよい。誘導改質層Miの数や厚みは特に限定されるものではない。したがって、ウエーハWの厚み等に応じて誘導改質層Miの数や厚みを設定するとよい。図3の例では、誘導改質層Miは、ウエーハWの表面Wa側に最も近い位置に形成されているが、この位置に限られない。もっとも、本実施形態に示すように、改質層Mは、後の分割工程により研削され除去される高さ位置6に形成するとよい。
When forming the induction-modified layer Mi inside the wafer W, the laser beam irradiating means 20 shifts the position of the
また、ウエーハWの内部に調整改質層Maを形成する際、レーザー光線照射手段20は、集光器22の位置をさらに上方側にずらして、表面Wa側から裏面Wb側へと均等な間隔をあけてレーザー光線LBを段階的に照射することにより、2層の調整改質層Maを形成する。このとき、レーザー光線照射手段20は、所定の間隔H1を設けて図1に示した各デバイスDの1辺に対して少なくとも1回レーザー光線LBの照射を停止するように制御される。具体的には、レーザー光線照射手段20は、第1の分割予定ラインS1もしくは第2の分割予定ラインS2または第1の分割予定ラインS1および第2の分割予定ラインS2の双方において所定の間隔H1を設けた部分にレーザー光線LBを照射せず、所定の間隔H1以外の領域にレーザー光線LBを照射する。こうして形成された調整改質層Maは、ウエーハWの内部に所定の間隔H1を隔てた非改質層領域2を有しており、レーザー光線LBが照射された部分の強度が低下している。非改質層領域2は、ウエーハWの内部の強度が低下しておらず、後の分割時にクラックが生じない領域である。調整改質層Maの数や厚みについても特に限定されない。
In addition, when forming the adjustment modified layer Ma inside the wafer W, the laser beam irradiation means 20 shifts the position of the
(4)分割工程
第1の改質層形成工程および第2の改質層形成工程を実施した後、図4に示すように、保護部材1側を回転可能なチャックテーブル40で保持して、ウエーハWの裏面Wbから研削手段30により研削し仕上げ厚さ100へと薄化するとともに研削動作により改質層Mを起点としてウエーハWの表面Waに至るクラックを分割予定ラインに沿って成長させ、ウエーハWを個々のデバイスDに分割する。チャックテーブル40は、例えばポーラス
部材により形成される保持部41を備え、その上面がウエーハWを吸引保持する保持面42となっている。保持面42には、図示しない吸引源が接続されている。研削手段30は、鉛直方向の軸心を有するスピンドル31と、スピンドル31の下部に装着された研削ホイール32と、研削ホイール32の下部にリング状に固着された研削砥石33とを備え、研削ホイール32を回転させながら、全体が昇降可能となっている。
(4) Dividing Step After performing the first modified layer forming step and the second modified layer forming step, as shown in FIG. 4, the
図4に示すように、テープT側をチャックテーブル40で保持してウエーハWの裏面Wbを上向きにさせ、チャックテーブル40を回転させる。研削手段30は、研削ホイール32を例えば矢印A方向に回転させつつ、所定の研削送り速度で下降させ、研削砥石33でウエーハWの裏面Wbを押圧しながら所定の仕上げ厚さ100に至るまで研削してウエーハWを薄化する。かかる研削動作により改質層Mを起点としてウエーハWの表面Waに至るクラックを第1の分割予定ラインS1及び第2の分割予定ラインS2に沿って成長させる。すなわち、改質層Mが形成された位置からクラックが発生すると、図3に示した誘導改質層Miによって、表面Wa側に向けてクラックが誘導される。また、調整改質層Maの非改質層領域2からクラックが生じず、改質層Mから表面Waに至るクラックの成長具合が調整されて、デバイスDが個片化されるタイミングが調整される。そのため、薄化にともなってウエーハWが個々のデバイスDに分割されるときに、隣接するデバイスDが接触して破損することが防止される。
As shown in FIG. 4, the tape T side is held by the chuck table 40, the back surface Wb of the wafer W is turned upward, and the chuck table 40 is rotated. The grinding means 30 lowers the
(5)エキスパンド工程
分割工程を実施した後、図5に示すように、テープ拡張手段50によって、分割された個々のデバイスDの間隔を拡げる。テープ拡張手段50は、図5(a)に示すように、ウエーハWを支持する支持テーブル51と、支持テーブル51の外周側に配設されフレームFが載置されるフレーム載置台52と、フレーム載置台52に載置されたフレームFをクランプするクランプ部53と、フレーム載置台52の下部に連結されフレーム載置台52を上下方向に昇降させる昇降手段54とを備える。昇降手段54は、シリンダ54aと、シリンダ54aにより昇降駆動されるピストン54bとにより構成され、ピストン54bが上下に移動することにより、フレーム載置台52を昇降させることができる。
(5) Expanding Step After the dividing step is performed, as shown in FIG. 5, the space between the divided individual devices D is expanded by the tape expanding means 50. As shown in FIG. 5A, the tape expanding means 50 includes a support table 51 for supporting the wafer W, a frame mounting table 52 disposed on the outer peripheral side of the support table 51 and mounting the frame F, The apparatus includes a
ウエーハWを拡張する際には、支持テーブル51に保護部材1側を載置するとともに、フレーム載置台52にフレームFを載置する。その後、クランプ部53がフレームFの上部を押さえて動かないように固定する。次いで、図5(b)に示すように、ピストン54bが下方に移動しフレーム載置台52を下降させ、支持テーブル51に対して相対的にフレーム載置台52を下降させる。これにより、テープT及び保護部材1が放射状に拡張され、ウエーハWに対して放射方向の外力が付与され、各デバイスDの間隔が拡がり各デバイスDの間に隙間5が形成される。そして、各デバイスDは、搬送手段等によってピックアップされ、所望の搬送先に搬送される。
When expanding the wafer W, the
このように、本発明にかかるウエーハの加工方法では、第1の改質層形成工程においてもしくは該第2の改質層形成工程において又は該第1の改質層形成工程および該第2の改質層形成工程の両工程において、ウエーハWの内部に形成される改質層Mは、1つの分割予定ラインにつき、改質層MからウエーハWの表面Waに至るクラックの成長を誘導する少なくとも1つ以上の誘導改質層Miと、改質層MからウエーハWの表面Waに至るクラックの成長を調整するための少なくとも1つ以上の調整改質層Maと、で複合的に形成されるため、誘導改質層Miにより改質層Mから発生したクラックがウエーハWの表面Wa側へ誘導されるとともに、調整改質層Maにより表面Waに至るクラックの成長具合が調整されるため、ウエーハWを個々のデバイスDに分割する際にデバイスチップのコーナーに欠けが生じたりコーナー付近のカーフに蛇行が生じたりするのを防ぐことができる。また、調整改質層Maが、所定の間隔H1を隔てた非改質層領域2を有しているため、分割工程を実施するときに、非改質層領域2によって、隣り合うデバイスDが接触しないようにデバイスDの個片化されるタイミングが調整されるため、デバイスDのコーナーに欠けが発生したりコーナー付近のカーフが蛇行したりするのを効果的に防止することができる。
As described above, in the wafer processing method according to the present invention, in the first modified layer forming step, in the second modified layer forming step, or in the first modified layer forming step and the second modified layer forming step. In both steps of the quality layer forming step, the modified layer M formed inside the wafer W has at least one crack that induces the growth of cracks from the modified layer M to the surface Wa of the wafer W per one dividing line. Since at least one induced modified layer Mi and at least one or more adjusted modified layers Ma for adjusting the growth of cracks from the modified layer M to the surface Wa of the wafer W are formed in a composite manner. In addition, the crack generated from the modified layer M by the induction modified layer Mi is guided to the surface Wa side of the wafer W, and the growth degree of the crack reaching the surface Wa is adjusted by the adjusted modified layer Ma. The It is possible to prevent meandering kerf near the corner or caused lack of the device chip corner of that or generated upon the division into devices D. In addition, since the adjusted and modified layer Ma has the
図6に示す改質層M1(第1の改質層m1および第2の改質層m2)は、改質層形成工程の第1の変形例によってウエーハW1の内部に形成されたものである。改質層M1は、上記同様に、第1の改質層形成工程および第2の改質層形成工程を行うことで、ウエーハW1の表面Wa側に最も近い位置に形成された1層の誘導改質層Mi2と、誘導改質層Mi2の上に形成された2層の調整改質層Maとにより構成される。 The modified layer M1 (first modified layer m1 and second modified layer m2) shown in FIG. 6 is formed inside the wafer W1 by the first modified example of the modified layer forming step. . In the same manner as described above, the modified layer M1 performs the first modified layer forming step and the second modified layer forming step, thereby deriving the one layer formed at the position closest to the front surface Wa side of the wafer W1. It is composed of a modified layer Mi2 and two adjusted modified layers Ma formed on the induction modified layer Mi2.
ウエーハW1の内部に誘導改質層Mi2を形成する際、レーザー光線照射手段20は、集光器22の位置をずらして、より表面Wa側にレーザー光線LBの集光点Pを位置付けた状態で、調整改質層Maの非改質層領域2よりも短い所定の間隔H2を設けて、各デバイスDの1辺に対して少なくとも1回レーザー光線LBの照射を停止するように制御される。具体的には、レーザー光線照射手段20は、図1に示した第1の分割予定ラインS1もしくは第2の分割予定ラインS2または第1の分割予定ラインS1および第2の分割予定ラインS2の双方において所定の間隔H2を設けた部分にレーザー光線LBを照射せず、所定の間隔H2以外の領域にレーザー光線LBを照射する。こうして形成された誘導改質層Mi2は、ウエーハW1の内部に所定の間隔H2を隔てて非改質層領域2よりも小さい非改質層領域3を有し、レーザー光線LBが照射された部分の強度が低下している。非改質層領域3は、非改質層領域2と同様、分割時にクラックが生じない領域である。
When forming the induction-modified layer Mi2 inside the wafer W1, the laser beam irradiating means 20 adjusts the position of the
改質層形成工程の第1の変形例を実施した後、上記同様の分割工程に進み、研削動作により改質層M1を起点としてウエーハW1の表面Waに至るクラックを第1の分割予定ラインS1及び第2の分割予定ラインS2に沿って成長させる。すなわち、改質層M1が形成された位置からクラックが発生すると、誘導改質層Mi2によって、表面Wa側に向けてクラックが誘導される。また、調整改質層Maの非改質層領域2および誘導改質層Mi2の非改質層領域3からクラックが生じず、隣り合うデバイスDが接触しないようにデバイスDの個片化されるタイミングが調整されて、ウエーハW1を個々のデバイスDに分割することができる。このように、改質層M1では、誘導改質層Mi2が、調整改質層Maの非改質層領域2よりも小さい非改質層領域3を有するため、ウエーハW1の分割時に、小さい非改質層領域3からもクラックがウエーハW1の表面Waに誘導されないため、個片化されるデバイスDの動きを制限することができ、デバイスDのコーナーに欠けが発生したり、コーナー付近のカーフが蛇行したりするのをより効果的に防止することができる。
After the first modified example of the modified layer forming step is performed, the process proceeds to the same dividing step as described above, and a crack reaching the surface Wa of the wafer W1 from the modified layer M1 as a starting point by a grinding operation is formed into a first dividing line S1. And growing along the second scheduled division line S2. That is, when a crack occurs from the position where the modified layer M1 is formed, the crack is induced toward the surface Wa by the induced modified layer Mi2. Further, cracks do not occur from the
図7に示す改質層M2(第1の改質層m1および第2の改質層m2)は、改質層形成工程の第2の変形例によってウエーハW2の内部に形成されたものである。改質層M2は、上記同様に、第1の改質層形成工程および第2の改質層形成工程を行うことで、ウエーハW2の表面Wa側に最も近い位置に形成された1層の誘導改質層Mi2と、誘導改質層Mi2の上に形成され所定の間隔が異なる2層の調整改質層Ma,Ma2とにより構成される。誘導改質層Mi2,調整改質層Maの構成は、上記の第1の変形例と同様である。 The modified layer M2 (first modified layer m1 and second modified layer m2) shown in FIG. 7 is formed inside the wafer W2 by the second modified example of the modified layer forming step. . In the same manner as described above, the modified layer M2 performs the first modified layer forming step and the second modified layer forming step, thereby deriving the one layer formed at the position closest to the front surface Wa side of the wafer W2. It is composed of a modified layer Mi2 and two adjusted modified layers Ma, Ma2 formed on the induction modified layer Mi2 and having different predetermined intervals. The configuration of the induction reforming layer Mi2 and the adjustment reforming layer Ma is the same as that of the first modification.
ウエーハW2の内部に調整改質層Ma2を形成する際、レーザー光線照射手段20は、非改質層領域3よりも長く、かつ非改質層領域2よりも短い所定の間隔H3を設けて、各デバイスDの1辺に対して少なくとも1回レーザー光線LBの照射を停止するように制御される。具体的には、レーザー光線照射手段20は、図1に示した第1の分割予定ラインS1もしくは第2の分割予定ラインS2または第1の分割予定ラインS1および第2の分割予定ラインS2の双方において所定の間隔H3を設けた部分にレーザー光線LBを照射せず、所定の間隔H2以外の領域にレーザー光線LBを照射する。調整改質層Ma2は、ウエーハW2の内部に所定の間隔H3を隔てて非改質層領域3よりも大きく、かつ非改質層領域2よりも小さい非改質層領域4を有し、レーザー光線LBが照射された部分の強度が低下している。
When forming the modified modified layer Ma2 inside the wafer W2, the laser beam irradiation means 20 provides a predetermined interval H3 longer than the
改質層形成工程の第2の変形例を実施した後、上記同様の分割工程に進み、研削動作により改質層M2を起点としてウエーハW2の表面Waに至るクラックを第1の分割予定ラインS1及び第2の分割予定ラインS2に沿って成長させる。すなわち、改質層M2が形成された位置からクラックが発生すると、誘導改質層Mi2によって、表面Wa側に向けてクラックが誘導される。また、非改質層領域2,3および4からクラックが生じず、デバイスDの個片化されるタイミングが調整されるため、ウエーハW2を個々のデバイスDに分割できる。このように、改質層M2は、ウエーハW2の裏面Wbから表面Waにかけてレーザー光線LBを照射しない領域を段階的に非改質層領域2,4及び3の順に小さく構成したため、個片化されるデバイスDの動きを制限することができ、デバイスDのコーナーに欠けが発生したり、欠けた部分が蛇行したりするのを防止することができる。
After the second modified example of the modified layer forming step is performed, the process proceeds to the same dividing step as described above, and a crack reaching the surface Wa of the wafer W2 from the modified layer M2 as a starting point by a grinding operation is converted into a first dividing line S1. And growing along the second scheduled division line S2. That is, when a crack occurs from the position where the modified layer M2 is formed, the crack is induced toward the surface Wa by the induced modified layer Mi2. Further, since cracks do not occur from the
本実施形態に示す改質層形成工程で用いるレーザー照射条件としては、例えば光源、波長、出力、保持テーブル10の送り速度及びレーザー光線LBを照射しない所定の間隔H1〜H3の幅などが挙げられる。分割予定ライン毎に設定される所定の間隔H1〜H3は、一定の間隔でなくてもよい。ウエーハWの中央部分が外周部分に比べて動きにくく未分割領域が発生しやすいため、例えば中央部分の領域においては所定の間隔H1〜H3の幅を狭く設定するとよい。分割工程で用いる研削条件としては、例えば研削砥石33の種類、研削送り速度、チャックテーブル40の回転速度等が挙げられる。なお、レーザー照射条件及び研削条件は、ウエーハWの厚みや材質等に応じて適宜調整して組み合わせるとよい。
The laser irradiation conditions used in the modified layer forming step shown in the present embodiment include, for example, a light source, a wavelength, an output, a feed speed of the holding table 10, and a width of predetermined intervals H1 to H3 at which the laser beam LB is not irradiated. The predetermined intervals H1 to H3 set for each of the dividing lines do not have to be constant. Since the central portion of the wafer W is harder to move than the outer peripheral portion and undivided regions are more likely to occur, for example, the width of the predetermined intervals H1 to H3 may be set narrower in the central portion. The grinding conditions used in the dividing step include, for example, the type of the
1:保護部材 2,3,4:非改質層領域 5:隙間 6:高さ位置
10:保持テーブル 11:保持面 20:レーザー光線照射手段 21:発振器
22:集光器
30:研削手段 31:スピンドル 32:研削ホイール 33:研削砥石
40:チャックテーブル 41:保持部 42:保持面
50:テープ拡張手段 51:支持テーブル 52:フレーム載置台 53:クランプ部
54:昇降手段 54a:シリンダ 54b:ピストン
W,W1,W2:ウエーハ Wa:表面 Wb:裏面 D:デバイス
S1:第1の分割予定ライン S2:第2の分割予定ライン
M,M1,M2:改質層 m1:第1の改質層 m2:第2の改質層
Mi,Mi2:誘導改質層 Ma,Ma2:調整改質層 H1,H2,H3:所定の間隔
1:
Claims (1)
ウエーハの表面側に保護部材を貼着する保護部材貼着工程と、
該保護部材貼着工程の後、該保護部材側を保持し、ウエーハに対して透過性を有する波長のレーザー光線をウエーハの裏面側から集光点をウエーハの内部に位置付けて該第1の分割予定ラインに沿って照射し、ウエーハの内部に該第1の分割予定ラインに沿って第1の改質層を形成する第1の改質層形成工程と、
ウエーハに対して透過性を有する波長のレーザー光線をウエーハの裏面側から集光点をウエーハの内部に位置付けて該第2の分割予定ラインに沿って照射し、ウエーハの内部に該第2の分割予定ラインに沿って第2の改質層を形成する第2の改質層形成工程と、
該第1の改質層形成工程および該第2の改質層形成工程を実施した後、該保護部材側を保持してウエーハの裏面から研削手段により研削し仕上げ厚さへと薄化するとともに研削動作により該改質層を起点としてウエーハの表面に至るクラックを該分割予定ラインに沿って成長させ、ウエーハを個々のデバイスに分割する分割工程と、を備え、
該第1の改質層形成工程においてもしくは該第2の改質層形成工程において又は該第1の改質層形成工程および該第2の改質層形成工程の両工程において、
該改質層は、1つの分割予定ラインにつき、該改質層からウエーハの表面に至るクラックの成長を誘導する少なくとも1つ以上の誘導改質層と、該改質層からウエーハの表面に至るクラックの成長を調整するための少なくとも1つ以上の調整改質層と、で複合的に形成され、
該調整改質層は、所定の間隔を設けて各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てた非改質層領域を有し、
該誘導改質層は、該改質層領域よりも短い所定の間隔を設けて、各デバイスの1辺に対して少なくとも1回レーザー光線の照射を停止することで、ウエーハの内部に所定の間隔を隔てて該非改質層領域よりも小さい非改質層領域を有し、
ウエーハの裏面から表面にかけて、該調整改質層及び該誘導改質層の非改質層領域を、段階的に小さくする
ウエーハの加工方法。 A device is formed in a plurality of regions defined by a plurality of first division lines extending in a predetermined direction on the surface and a plurality of second division lines formed to intersect the plurality of first division lines. A wafer processing method for dividing the wafer on which is formed along the first planned dividing line and the second planned dividing line,
A protective member attaching step of attaching a protective member to the surface side of the wafer,
After the protection member adhering step, the first division is to be performed by holding the protection member side, and positioning a laser beam having a wavelength that is transparent to the wafer from the back surface side of the wafer to a focusing point inside the wafer. A first modified layer forming step of irradiating along a line and forming a first modified layer inside the wafer along the first scheduled dividing line;
A laser beam having a wavelength that is transmissive to the wafer is irradiated from the back side of the wafer along the second dividing line with the condensing point positioned inside the wafer and the second dividing line inside the wafer. A second modified layer forming step of forming a second modified layer along the line;
After performing the first modified layer forming step and the second modified layer forming step, while holding the protective member side, the wafer is ground from the back surface of the wafer by grinding means to reduce the thickness to a finished thickness. A cracking step of growing a crack reaching the surface of the wafer starting from the modified layer by the grinding operation along the planned dividing line, and dividing the wafer into individual devices;
In the first modified layer forming step, in the second modified layer forming step, or in both the first modified layer forming step and the second modified layer forming step,
The modified layer has at least one or more induced modified layers that induce the growth of cracks from the modified layer to the surface of the wafer per one scheduled division line, and extends from the modified layer to the surface of the wafer. And at least one or more adjustment-modification layers for adjusting the growth of cracks ;
The adjusted and modified layer has a non-modified layer region at a predetermined interval inside the wafer by stopping irradiation of the laser beam at least once to one side of each device at a predetermined interval. And
The induction-modified layer is provided with a predetermined interval shorter than the modified layer region, and stops irradiation of the laser beam at least once to one side of each device, so that a predetermined interval is formed inside the wafer. Having a non-modified layer region smaller than the non-modified layer region,
A method for processing a wafer, wherein the non-modified layer region of the adjustment-modified layer and the induction-modified layer is gradually reduced from the back surface to the front surface of the wafer.
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016079413A JP6640005B2 (en) | 2016-04-12 | 2016-04-12 | Wafer processing method |
TW106106385A TWI732824B (en) | 2016-04-12 | 2017-02-24 | Wafer processing method |
KR1020170042995A KR102250209B1 (en) | 2016-04-12 | 2017-04-03 | Wafer processing method |
CN201710228155.4A CN107293516B (en) | 2016-04-12 | 2017-04-10 | Method for processing wafer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016079413A JP6640005B2 (en) | 2016-04-12 | 2016-04-12 | Wafer processing method |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017191825A JP2017191825A (en) | 2017-10-19 |
JP6640005B2 true JP6640005B2 (en) | 2020-02-05 |
Family
ID=60085358
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016079413A Active JP6640005B2 (en) | 2016-04-12 | 2016-04-12 | Wafer processing method |
Country Status (4)
Country | Link |
---|---|
JP (1) | JP6640005B2 (en) |
KR (1) | KR102250209B1 (en) |
CN (1) | CN107293516B (en) |
TW (1) | TWI732824B (en) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7105058B2 (en) * | 2017-12-05 | 2022-07-22 | 株式会社ディスコ | Wafer processing method |
KR20200130816A (en) * | 2018-03-14 | 2020-11-20 | 도쿄엘렉트론가부시키가이샤 | Substrate processing system, substrate processing method and computer storage medium |
US10388526B1 (en) * | 2018-04-20 | 2019-08-20 | Semiconductor Components Industries, Llc | Semiconductor wafer thinning systems and related methods |
JP6934563B2 (en) | 2018-04-27 | 2021-09-15 | 東京エレクトロン株式会社 | Board processing system and board processing method |
JP7109537B2 (en) | 2018-04-27 | 2022-07-29 | 東京エレクトロン株式会社 | Substrate processing system and substrate processing method |
JP7088768B2 (en) * | 2018-07-24 | 2022-06-21 | 株式会社ディスコ | Wafer division method |
JP7118804B2 (en) * | 2018-08-17 | 2022-08-16 | キオクシア株式会社 | Semiconductor device manufacturing method |
JP7233816B2 (en) | 2019-02-19 | 2023-03-07 | 株式会社ディスコ | Wafer processing method |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007165850A (en) | 2005-11-16 | 2007-06-28 | Denso Corp | Wafer, and dividing method thereof |
JP2010003817A (en) * | 2008-06-19 | 2010-01-07 | Tokyo Seimitsu Co Ltd | Laser dicing method, and laser dicing device |
JP5379604B2 (en) * | 2009-08-21 | 2013-12-25 | 浜松ホトニクス株式会社 | Laser processing method and chip |
JP5394172B2 (en) | 2009-09-03 | 2014-01-22 | 株式会社ディスコ | Processing method |
JP5625522B2 (en) | 2010-06-16 | 2014-11-19 | 豊田合成株式会社 | Laser processing method |
JP2013126682A (en) | 2011-11-18 | 2013-06-27 | Hamamatsu Photonics Kk | Laser beam machining method |
JP6013806B2 (en) * | 2012-07-03 | 2016-10-25 | 株式会社ディスコ | Wafer processing method |
JP6053381B2 (en) | 2012-08-06 | 2016-12-27 | 株式会社ディスコ | Wafer dividing method |
JP6101468B2 (en) * | 2012-10-09 | 2017-03-22 | 株式会社ディスコ | Wafer processing method |
JP6189066B2 (en) * | 2013-03-27 | 2017-08-30 | 株式会社ディスコ | Wafer processing method |
JP6301726B2 (en) | 2014-05-07 | 2018-03-28 | 株式会社ディスコ | Optical device processing method |
-
2016
- 2016-04-12 JP JP2016079413A patent/JP6640005B2/en active Active
-
2017
- 2017-02-24 TW TW106106385A patent/TWI732824B/en active
- 2017-04-03 KR KR1020170042995A patent/KR102250209B1/en active IP Right Grant
- 2017-04-10 CN CN201710228155.4A patent/CN107293516B/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2017191825A (en) | 2017-10-19 |
KR20170116954A (en) | 2017-10-20 |
CN107293516B (en) | 2022-02-11 |
KR102250209B1 (en) | 2021-05-07 |
CN107293516A (en) | 2017-10-24 |
TW201737329A (en) | 2017-10-16 |
TWI732824B (en) | 2021-07-11 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6640005B2 (en) | Wafer processing method | |
TWI438834B (en) | Method of dividing an adhesive film bonded to a wafer | |
JP6101468B2 (en) | Wafer processing method | |
KR102196934B1 (en) | Wafer processing method | |
US9627242B2 (en) | Wafer processing method | |
JP6523882B2 (en) | Wafer processing method | |
JP2014033163A (en) | Wafer splitting method | |
US20120064696A1 (en) | Wafer machining method | |
JP6844992B2 (en) | Wafer processing method | |
TWI692017B (en) | Processing method of single crystal substrate | |
TWI757277B (en) | Wafer processing method | |
TW201715595A (en) | Wafer processing method | |
TW201911397A (en) | Method of processing a substrate | |
TWI798471B (en) | Wafer Processing Method | |
JP6152013B2 (en) | Wafer processing method | |
JP6634300B2 (en) | Wafer processing method | |
TW201944474A (en) | Wafer processing method capable of appropriately dividing a wafer to form a plurality of flash memory chips | |
JP7016264B2 (en) | How to divide the wafer | |
TWI831925B (en) | Wafer processing methods | |
TW201935549A (en) | Wafer processing method which does not change the control system of the laser processing device to smoothly divide a wafer configured with bumps | |
JP2020129642A (en) | Expanding sheet expansion method | |
JP2015167197A (en) | Processing method | |
JP6137999B2 (en) | Wafer processing method | |
JP2019150925A (en) | Method for grinding work-piece | |
JP7344695B2 (en) | Chip manufacturing method |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190220 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20190917 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20190924 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20191121 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20191203 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20191225 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6640005 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |