JP6604427B1 - 情報処理システム - Google Patents

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Abstract

【課題】情報処理システム全体の保守性を向上する。【解決手段】情報処理システムは、第１プラットフォームと第２プラットフォームと中継装置とを備える。第１プラットフォームは、所定条件を満たした場合に第１プラットフォームを再起動させ、かつ、再起動に先立ち再起動を中継装置に通知する第１プラットフォーム側起動制御部を備える。中継装置は、プラットフォーム間の通信を制御する通信制御マイコンと、第１プラットフォームの再起動が通知された場合に、第２プラットフォームに起動要求を出力し、通信制御マイコンのシャットダウン処理の実行後に通信制御マイコンを起動させる電源制御マイコンとを備える。第２プラットフォームは、シャットダウン要求が入力された場合に、第２プラットフォームのシャットダウン処理を実行し、中継装置から起動要求が入力された場合、第２プラットフォームを起動させる第２プラットフォーム側起動制御部を備える。【選択図】図８

Description

本発明の実施形態は、情報処理システムに関する。
ホストＰＣ（Personal Computer）と、プロセッサと、ホストＰＣおよびプロセッサが接続可能なＰＣＩｅ等の拡張バスを有する中継装置と、を有する情報処理システムにおいて、中継装置が、拡張バスを介したホストＰＣとプロセッサ間での通信を制御することにより、複数のプロセッサを用いて並列計算を行う技術が開発されている。
特開２００８−０４１０２７号公報 特表２０１２−５０４８３５号公報
ところで、情報処理システムが有するホストＰＣ、プロセッサ、および中継装置の各ブロックは、独立して動作し、当該各ブロックに対する電源制御も独立している。そのため、ホストＰＣが再起動を実行した場合に、プロセッサを再起動させることができず、ホストＰＣだけの再起動となってしまい、情報処理システムの保守性が低下する場合がある。
本発明の第１態様にかかる情報処理システムは、第１プラットフォームと、第２プラットフォームと、第１プラットフォームおよび第２プラットフォームが接続可能な拡張バスを有する中継装置と、を備える情報処理システムである。第１プラットフォームは、所定条件を満たした場合に、第１プラットフォームを再起動させ、かつ第１プラットフォームの再起動に先立って、第１プラットフォームの再起動が実行されることを中継装置に通知する第１プラットフォーム側起動制御部、を備える。中継装置は、拡張バスを介した第１プラットフォームとプロセッサ間での通信を制御する通信制御マイコンと、第１プラットフォームの再起動が実行されることが通知された場合に、第２プラットフォームに対して、当該第２プラットフォームの電源をオンの状態とする起動要求を出力し、かつ通信制御マイコンのシャットダウン処理の実行後、通信制御マイコンを起動させる電源制御マイコンと、を備える。第２プラットフォームは、当該第２プラットフォームのシャットダウンを要求するシャットダウン要求が入力された場合に、第２プラットフォームの電源をオフの状態とするシャットダウン処理を実行し、中継装置から起動要求が入力された場合、第２プラットフォームを起動させる起動処理を実行する第２プラットフォーム側電源制御部を備える。
本発明の上記第１態様によれば、第１プラットフォームの再起動が実行された際に、第２プラットフォームおよび通信制御マイコンも再起動させることが可能となるので、情報処理システム全体の保守性を向上させることができる。
図１は、本実施形態にかかる情報処理システムの全体構成の一例を示す図である。 図２は、本実施形態にかかる情報処理システムのハードウェア構成の一例を示す図である。 図３は、本実施形態にかかる情報処理システムのプラットフォームのソフトウェア構成の一例を示す図である。 図４は、本実施形態にかかる情報処理システムにおけるプラットフォーム間における通信処理の一例を説明するための図である。 図５は、本実施形態にかかる情報処理システムにおける任意のプラットフォームからの他のプラットフォームの見え方を例示する図である。 図６は、本実施形態にかかる情報処理システムにおける任意のプラットフォームからの他のプラットフォームの見え方を例示する図である。 図７は、本実施形態にかかる情報処理システムにおける中継装置を介したプロセッサ間のデータ転送方法の一例を説明するための図である。 図８は、本実施形態にかかる情報処理システム１の機能構成の一例を示すブロック図である。 図９は、本実施形態にかかる情報処理システムにおける再起動処理の流れの一例を示すシーケンス図である。 図１０は、本実施形態にかかる情報処理システムにおける再起動処理の流れの一例を示すシーケンス図である。
以下、添付の図面を用いて、本実施形態にかかる情報処理システムについて説明する。
図１は、本実施形態にかかる情報処理システムの全体構成の一例を示す図である。図１に示すように、本実施形態にかかる情報処理システム１は、複数のプラットフォーム２−１〜２−８、および中継装置３を有する。複数のプラットフォーム２−１〜２−８は、それぞれ中継装置３に接続されている。
以下の説明では、複数のプラットフォーム２−１〜２−８を区別する必要がなく、任意のプラットフォームを示す場合には、プラットフォーム２と記載する。また、ここでは、情報処理システム１が、８つのプラットフォーム２−１〜２−８を有する例について説明するが、複数のプラットフォーム２を有するものであれば、これに限定するものではない。
プラットフォーム２−１〜２−８は、情報処理システム１の制御部およびＧＵＩ（Graphical User Interface）として機能するホストＰＣ（Personal Computer）や、ＡＩ（Artificial Intelligence）推論処理や画像処理等を実行する演算部である。
具体的には、プラットフォーム２−１〜２−８は、プロセッサ２１−１〜２１−８を備える。以下の説明では、プロセッサ２１−１〜２１−８を区別する必要がなく、任意のプロセッサを示す場合には、プロセッサ２１と記載する。プロセッサ２１−１〜２１−８は、それぞれ違うメーカ（ベンダ）から提供されたものであっても良いし、同じメーカから提供されたものであっても良い。
例えば、プロセッサ２１−１はＡ社から提供され、プロセッサ２１−２はＢ社から提供され、プロセッサ２１−３はＣ社から提供され、プロセッサ２１−４はＤ社から提供され、プロセッサ２１−５はＥ社から提供され、プロセッサ２１−６はＦ社から提供され、プロセッサ２１−７はＧ社から提供され、プロセッサ２１−８はＨ社から提供されるものとする。
また、中継装置３に搭載される各ＥＰ（End Point）に対しては、それぞれ異なるプラットフォーム２を接続しても良いし、各ＥＰに対して１つのプラットフォーム２を接続し、プラットフォーム２側が複数のＲＣ（Rood Complex）を用いて中継装置３と通信しても良い。
次に、図２を用いて、本実施形態にかかる情報処理システム１のハードウェア構成の一例について説明する。図２は、本実施形態にかかる情報処理システムのハードウェア構成の一例を示す図である。以下の説明では、プラットフォーム２−１がホストＰＣとして機能し、プラットフォーム２−２〜２−８が、ＡＩ推論処理や画像処理等を実行する演算部として機能する例について説明する。
まず、ホストＰＣとして機能するプラットフォーム２−１のハードウェア構成について説明する。
プラットフォーム２−１は、図２に示すように、プロセッサ２１−１、表示部２０１、ＵＳＢ（Universal Serial Bus）ポート２０２、通信Ｉ／Ｆ２０３、記憶部２０４、およびメモリ２０５を有する。表示部２０１は、ＬＣＤ（Liquid Crystal Display）等であり、各種情報を表示する。ＵＳＢポート２０２は、プラットフォーム２−１と周辺機器とを接続するためのコネクタである。通信Ｉ／Ｆ２０３は、イーサネット（登録商標）等の通信規格に従って、ＬＡＮ（Local Area Network）等のネットワークと通信可能とする。
記憶部２０４は、ＨＤＤ（Hard Disk Drive）やＳＳＤ（Solid State Drive）、ＳＣＭ（Storage Class Memory）等の記憶装置であり、各種のデータを記憶する。メモリ２０５は、ＲＯＭ（Read Only Memory）やＲＡＭ（Random Access Memory）等である。ＲＯＭは、各種のソフトウェアプログラムや当該ソフトウェアプログラム用のデータを記憶する。ＲＯＭに記憶されるソフトウェアプログラムは、プロセッサ２１−１により読み込まれて実行される。ＲＡＭは、ＲＯＭに記憶されるソフトウェアプログラムを実行する際の作業領域として機能する。
プロセッサ２１−１は、ＣＰＵ（Central Processing Unit）、ＭＰＵ（Micro Processing Unit）、ＤＳＰ（Digital Signal Processor）、ＡＳＩＣ（Application Specific Integrated Circuit）、ＰＬＤ（Programmable Logic Device）、ＦＰＧＡ（Field Programmable Gate Array）等のプロセッサであり、プラットフォーム２−１全体を制御する。プロセッサ２１−１は、マルチコアプロセッサであっても良いし、２以上のプロセッサの組合せであっても良い。
次に、ＡＩ推論処理や画像処理等を実行する演算部として機能するプラットフォーム２−２〜２−８のハードウェア構成について説明する。
プラットフォーム２−２は、図２に示すように、プロセッサ２１−２、ＵＳＢポート２１１、および表示部２１２を有する。表示部２１２は、ＬＣＤ等であり、各種情報を表示する。ＵＳＢポート２１１は、プラットフォーム２−２と周辺機器とを接続するためのコネクタである。
プロセッサ２１−２は、ＣＰＵ、ＭＰＵ、ＤＳＰ、ＡＳＩＣ、ＰＬＤ、ＦＰＧＡ等のプロセッサであり、プラットフォーム２−２全体を制御する。プロセッサ２１−２は、マルチコアプロセッサであっても良いし、２以上のプロセッサの組合せであっても良い。例えば、プロセッサ２１−２は、ＣＰＵ及びＧＰＵの組み合わせであっても良い。
ここでは、プラットフォーム２−２のハードウェア構成について説明したが、ＡＩ推論処理や画像処理等を実行する演算部として機能する他のプラットフォーム２−３〜２−８も同様のハードウェア構成を有する。
次に、中継装置３のハードウェア構成について説明する。
中継装置３は、例えば、図２に示すように、複数のＥＰを１チップ内に有する中継装置である。中継装置３は、図２に示すように、通信制御マイコン３０１、電源制御マイコン３０２、メモリ３０３、および複数のスロット３０５−１〜３０５−８を備える。そして、図２に示すように、通信制御マイコン３０１、メモリ３０３、および複数のスロット３０５−１〜３０５−８は、内部バス３０４を介して互いに通信可能に接続されている。
また、電源制御マイコン３０２は、図２に示すように、信号線Ｌ１〜Ｌ８を介して、スロット３０５−１〜３０５−８に接続されるプラットフォーム２−１〜２−８と接続される。ここで、信号線Ｌ１〜Ｌ８は、プラットフォーム２−１〜２−８から電源制御マイコン３０２に入力される信号を伝送する信号線である。
また、通信制御マイコン３０１および電源制御マイコン３０２は、それぞれ異なる電源ユニット（不図示）から電源供給を受けて、動作する。本実施形態では、通信制御マイコン３０１は、プラットフォーム２と同じ電源ユニット（不図示）から電源供給を受けて動作する。一方、電源制御マイコン３０２は、プラットフォーム２とは異なる電源ユニット（不図示）から電源供給を受けて動作する。
スロット３０５−１〜３０５−８は、それぞれＰＣＩｅの規格を満たすように構成されたデバイスが接続される拡張スロット（拡張バス）の一例である。本実施形態では、スロット３０５−１〜３０５−８には、プラットフォーム２−１〜２−８が接続される。以下の説明では、スロット３０５−１〜３０５−８を区別する必要がなく、任意のスロットを示す場合には、スロット３０５と記載する。
また、１つのスロット３０５に対して、１つのプラットフォーム２が接続されていても良いが、１つのスロット３０５に対して、複数のプラットフォーム２が接続されていても良い。さらに、１つのプラットフォーム２に対して複数のスロット３０５を割り当てることにより、当該プラットフォーム２は、広い通信帯域を用いた通信が可能となる。
メモリ３０３は、例えば、ＲＯＭおよびＲＡＭを含むメモリである。メモリ３０３のＲＯＭには、スロット３０５に接続される複数のプラットフォーム２間での通信制御に関わるソフトウェアプログラム等の各種のソフトウェアプログラムや、これらのソフトウェアプログラム用のデータを記憶する。ＲＯＭに記憶されるソフトウェアプログラムは、通信制御マイコン３０１により読み込まれて実行される。メモリ３０３のＲＡＭは、メモリ３０３のＲＯＭに記憶されるソフトウェアプログラムを実行する際の作業領域として機能する。
また、プラットフォーム２には、各スロット３０５に対応させてメモリ２２等にメモリ領域が設けられ、当該メモリ領域には、スロット３０５の数だけ分割された複数の記憶領域が設定され、各記憶領域はいずれかのスロット３０５に対応付けられている。中継装置３は、スロット３０５毎に設けられる記憶領域のアドレスに基づいてプラットフォーム２間のデータ転送を行う。
通信制御マイコン３０１は、ＣＰＵ、ＭＰＵ、ＤＳＰ、ＡＳＩＣ、ＰＬＤ、ＦＰＧＡ等のプロセッサを含み、当該プロセッサが、スロット３０５を介したプラットフォーム２間での通信を制御する。通信制御マイコン３０１は、複数のプロセッサの組合せを含んでいても良い。そして、通信制御マイコン３０１は、メモリ３０３に記憶されるソフトウェアプログラムを実行することによって、スロット３０５に接続されるプラットフォーム２間での通信を実現する。
電源制御マイコン３０２は、ＣＰＵ、ＭＰＵ、ＤＳＰ、ＡＳＩＣ、ＰＬＤ、ＦＰＧＡ等のプロセッサを含み、当該プロセッサが、スロット３０５に接続されるプラットフォーム２に対する電源の供給を制御する。電源制御マイコン３０２のプロセッサは、複数のプロセッサの組合せを含んでいても良い。そして、電源制御マイコン３０２のプロセッサは、当該電源制御マイコン３０２が有するメモリに記憶されるソフトウェアプログラムを実行することによって、電源ユニット（不図示）から、スロット３０５に接続されるプラットフォーム２への電源の供給を実行する。
本実施形態では、中継装置３は、プラットフォーム２間での通信を高速化するために、ＰＣＩｅを用いて、図２に示すように、各プラットフォーム２に備えられるプロセッサ２１をＲＣとして動作させ、デバイスとして動作するＥＰ間でのデータの転送を実現する。
具体的には、情報処理システム１では、各プラットフォーム２のプロセッサ２１を、ＰＣＩｅのＲＣとして動作させる。また、各プラットフォーム２のプロセッサ２１に対して、中継装置３（すなわち、各プラットフォーム２が接続されるスロット３０５）をＥＰとして動作させる。
ここで、中継装置３をプラットフォーム２のプロセッサ２１に対してＥＰとして接続する手法としては、既知の様々な手法を用いて実現できる。例えば、中継装置３は、プラットフォーム２との接続時に、ＥＰとして機能することを示す信号を通知することによって、ＥＰとしてプラットフォーム２と接続される。
中継装置３は、ＥＰｔоＥＰ（End Point to End Point）でデータをトンネリングさせて、複数のＲＣにデータを転送する。プラットフォーム２のプロセッサ２１間の通信は、ＰＣＩｅのトランザクションが発生したときに論理的に接続され、１つのプロセッサ２１にデータの転送が集中しないときは、それぞれのプロセッサ２１間で並行してデータの転送が可能である。
次に、図３を用いて、本実施形態にかかる情報処理システム１のプラットフォーム２のソフトウェア構成の一例について説明する。図３は、本実施形態にかかる情報処理システムのプラットフォームのソフトウェア構成の一例を示す図である。
プラットフォーム２−１は、例えば、Windows（登録商標）をＯＳ（Operating System）として、このＯＳ上において各種ソフトウェアプログラムを実行する。プラットフォーム２−２，２−３は、例えば、Linux（登録商標）をＯＳとし、このＯＳ上において各種ソフトウェアプログラムを実行する。
プラットフォーム２には、ブリッジドライバ２０が設けられ、当該ブリッジドライバ２０を介して中継装置３および他のプラットフォーム２との間で通信を行う。各プラットフォーム２は、プロセッサ２１およびメモリを有する。そして、プロセッサ２１が、メモリに記憶されるＯＳや各種プログラム、ドライバ等を実行することにより、プラットフォーム２が有する各種の機能を実現する。
次に、図４を用いて、中継装置３に接続されるプラットフォーム２間における通信処理の一例について説明する。図４は、本実施形態にかかる情報処理システムにおけるプラットフォーム間における通信処理の一例を説明するための図である。ここでは、プラットフォーム２−１のプロセッサ２１−１と、プラットフォーム２−２のプロセッサ２１−２間での通信処理の一例について説明する。
送信元のプラットフォーム２−１は、ＲＣであるプロセッサ２１−１において生成されるデータが、ソフトウェア、トランザクション層、データリンク層、および物理層（ＰＨＹ）を順次転送され、物理層において中継装置３の物理層に転送される。
中継装置３は、送信元のプラットフォーム２−１から転送されてきたデータを、物理層、データリンク層、トランザクション層、およびソフトウェアを順次転送され、その後、送信先のプラットフォーム２−２のＲＣに対応するＥＰにトンネリングにより転送される。すなわち、中継装置３においては、ＥＰ間でデータをトンネリングさせることで、１つのＲＣ（プロセッサ２１−１）から他のＲＣ（プロセッサ２１−２）にデータが転送される。
送信先のプラットフォーム２−２は、中継装置３から転送されてきたデータが、物理層（ＰＨＹ）、データリンク層、トランザクション層、およびソフトウェアに順次転送され、その後、送信先のプラットフォーム２−２のプロセッサ２１−２に転送される。本実施形態の情報処理システム１では、プラットフォーム２間の通信は、ＰＣＩｅのトランザクションが発生した時に論理的に実現される。
中継装置３が有する複数のスロット３０５のうち１つに接続されたプラットフォーム２に対して、複数のプラットフォーム２からのデータの転送が集中しない場合には、異なる任意の複数組のプラットフォーム２間において並行してデータの転送を実行することも可能である。例えば、プラットフォーム２−１のプロセッサ２１−１に対して、プラットフォーム２−２のプロセッサ２１−２およびプラットフォーム２−３のプロセッサ２１−３が通信する場合には、中継装置３は、プラットフォーム２−２のプロセッサ２１−２およびプラットフォーム２−３のプロセッサ２１−３による通信をシリアルに処理する。
一方、異なるプラットフォーム２のプロセッサ２１同士が通信し、特定のプラットフォーム２のプロセッサ２１に通信が集中しない場合には、中継装置３は、プラットフォーム２間の通信を並行して処理することも可能である。
次に、図５および図６を用いて、プラットフォーム２のプロセッサ２１から他のプラットフォーム２のプロセッサ２１の見え方について説明する。図５および図６は、本実施形態にかかる情報処理システムにおける任意のプラットフォームからの他のプラットフォームの見え方を例示する図である。
各プラットフォーム２のプロセッサ２１間で通信が行なわれている状態において、各プロセッサ２１が実行するＯＳ（例えば、Windows（登録商標）のデバイスマネージャ）からは、中継装置３しか見えないため、接続先の他のプラットフォーム２のプロセッサ２１を直接管理する必要がない。すなわち、中継装置３のデバイスドライバが、中継装置３の先に接続されたプラットフォーム２のプロセッサ２１を管理する。
そのため、送信元、送信先それぞれのプラットフォーム２のプロセッサ２１を動作させるためのデバイスドライバを準備する必要がなく、中継装置３のデバイスドライバで中継装置３に対して通信処理を行なうだけで、プラットフォーム２間の通信を実現することができる。
次に、図７を用いて、情報処理システム１における中継装置３を介したプラットフォーム２間のデータ転送方法を説明する。図７は、本実施形態にかかる情報処理システムにおける中継装置を介したプロセッサ間のデータ転送方法の一例を説明するための図である。
この図７に示す例においては、スロット＃０に接続されたプラットフォーム２−１からスロット＃４に接続されたプラットフォーム２−５にデータを転送する場合について説明する。
送信元のプラットフォーム２−１は、ソフトウェア等によって送信されるデータ（以下、送信データという）を、プラットフォーム２−１に備えられるストレージ２３等からプラットフォーム２−１のメモリ領域３５に格納する（ステップＳ７０１）。メモリ領域３５は、転送されるデータが一時的に格納される通信バッファの一部であっても良い。メモリ領域３５は、プラットフォーム２のそれぞれに、メモリ２２等と同じ大きさで設けられた領域である。メモリ領域３５は、スロット３０５の数に応じて分割されている。メモリ領域３５の分割された記憶領域は、いずれかのスロット３０５に対応付けられている。例えば、メモリ領域３５内のＳｌｏｔ♯０で示す記憶領域は、Ｓｌｏｔ♯０に接続されたプラットフォーム２−１に対応付けられ、メモリ領域３５内にＳｌｏｔ♯４で示す記憶領域は、Ｓｌｏｔ♯４に接続されたプラットフォーム２−５に対応付けられている。プラットフォーム２−１は、メモリ領域３５のうち、送信先のスロット３０５に割り当てられた領域（ここでは、Ｓｌｏｔ♯４）に送信データを格納する。
ブリッジドライバ２０は、プラットフォーム２のメモリ領域３５の記憶領域に基づいて、送信先のスロット３０５を示すスロット情報と、送信先のメモリ領域３５における分割領域内におけるアドレスを示すアドレス情報とを取得または生成する（ステップＳ７０２）。
送信元のＥＰにおいて、ブリッジドライバ２０は、スロット情報と、アドレス情報と、送信データとを含む転送データを中継装置３に渡す（ステップＳ７０３）。これにより、中継装置３は、スロット情報に基づいてＥＰｔｏＥＰにより送信元のスロット３０５と送信先のスロット３０５とを接続することにより、転送データを送信先のプラットフォーム２−４に転送する（ステップＳ７０４）。送信先のブリッジドライバ２０は、スロット情報およびアドレス情報に基づいて、送信先のプラットフォーム２のメモリ領域３５のＳｌｏｔ♯４に対応する記憶領域内のアドレス情報が示すアドレスの領域に送信データ（または転送データ）を格納する（ステップＳ７０５）。
送信先のプラットフォーム２−５において、例えば、プログラムが、メモリ領域３５に格納された送信データを読み出して、メモリ（ローカルメモリ）２２やストレージ２３に移動させる（ステップＳ７０６、ステップＳ７０７）。
以上のようにして、送信元のプラットフォーム２−１から送信先のプラットフォーム２−５にデータ（転送データ）が転送される。
ところで、上述の構成においては、プラットフォーム２−１（ホストＰＣ）、プラットフォーム２−２〜２−８（演算部）、および中継装置３の各ブロックは、独立して動作し、各ブロックに対する電源制御も独立している。そのため、ホストＰＣが再起動を実行したとしても、演算部および中継装置３を再起動させることができずに、ホストＰＣだけの再起動となってしまい、情報処理システム１全体の保守性が低下する可能性がある。
そこで、本実施形態では、情報処理システム１に以下のような機能を持たせることによって、ホストＰＣの再起動が実行された際に、演算部および中継装置３も再起動させることを可能として、情報処理システム１全体の保守性を向上させることを実現する。
図８は、本実施形態にかかる情報処理システム１の機能構成の一例を示すブロック図である。図８に示すプラットフォーム２−１（ホストＰＣ）の機能は、プロセッサ２１−１がメモリ２０５に記憶されるソフトウェアプログラムを読み出して実行した結果として実現される。また、図８に示す中継装置３の機能は、電源制御マイコン３０２が有するプロセッサが、当該電源制御マイコン３０２が有するメモリに記憶されるソフトウェアプログラムを読み出して実行した結果として実現される。また、図８に示すプラットフォーム２−２〜２−８（演算部）の機能は、プロセッサ２１−２〜２１−８が、当該プラットフォーム２−２〜２−８が有するメモリに記憶されるソフトウェアプログラムを読み出して実行した結果として実現される。
まず、プラットフォーム２−１の機能構成について説明する。
図８に示すように、本実施形態にかかるプラットフォーム２−１は、機能的構成として、ホストＰＣ側起動制御部８０１を有する。ホストＰＣ側起動制御部８０１は、所定条件を満たした場合に、プラットフォーム２−１を再起動させる。
ここで、所定条件は、予め設定された条件である。本実施形態では、所定条件は、プラットフォーム２−１が備える操作部（不図示）を介して、再起動を指示する操作情報が入力された場合である。また、所定条件は、中継装置３（電源制御マイコン３０２）から再起動が要求された場合であっても良い。
本実施形態では、ホストＰＣ側起動制御部８０１は、再起動を指示する操作情報が入力された場合、プラットフォーム２−１の再起動に先立って、スロット３０５−１〜３０５−８を介してプラットフォーム２−２〜２−８に対して、当該プラットフォーム２−２〜２−８のシャットダウンを要求するシャットダウン要求を送信する。これにより、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
また、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１の再起動に先立って、ＧＰＩＯ等の専用の端子に接続される信号線Ｌ１を介して、プラットフォーム２−１の再起動が実行されることを電源制御マイコン３０２に通知する。言い換えると、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１の再起動に伴って当該プラットフォーム２−１がシャットダウンされる前に、プラットフォーム２−１の再起動が実行されることを電源制御マイコン３０２に通知する。
次に、中継装置３の機能構成について説明する。
また、図８に示すように、本実施形態にかかる中継装置３の電源制御マイコン３０２は、機能的構成として、電源供給制御部８０２を有する。電源供給制御部８０２は、プラットフォーム２−１から、当該プラットフォーム２−１の再起動が実行されることが通知された場合に、プラットフォーム２−２〜２−８に対して、当該プラットフォーム２−２〜２−８の起動を要求する起動要求を出力する。
本実施形態では、電源供給制御部８０２は、ＧＰＩＯ等の専用の端子に接続される信号線Ｌ１を介して、プラットフォーム２−１の再起動が実行されることが通知された場合に、ＧＰＩＯ等の専用の端子に接続される信号線Ｌ２〜Ｌ８を介して、プラットフォーム２−２〜２−８に対して起動要求を出力する。
また、電源供給制御部８０２は、プラットフォーム２−１の再起動が実行されることが通知された場合、ＧＰＩＯ等の専用の端子に接続される信号線（不図示）を介して、通信制御マイコン３０１のシャットダウン処理を実行させる。その後、電源供給制御部８０２は、信号線（不図示）を介して、通信制御マイコン３０１を起動させる。これにより、プラットフォーム２−１の再起動が実行された際に、通信制御マイコン３０１も再起動させることが可能となるので、情報処理システム１全体の保守性を向上させることができる。
また、スロット３０５−１〜３０５−８を介してプラットフォーム２−１とプラットフォーム２−２〜２−８との間で通信ができない場合、または情報処理システム１が有するハードウェアの異常等によって、プラットフォーム２−１からプラットフォーム２−２〜２−８に対してシャットダウン要求を出力できない場合に、電源供給制御部８０２が、起動要求の出力に先立って、プラットフォーム２−２〜２−８に対してシャットダウン要求を出力する。これにより、プラットフォーム２−１とプラットフォーム２−２〜２−８間において通信ができない場合であっても、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
さらに、通信制御マイコン３０１が備えるウォッチドックタイマによって当該通信制御マイコン３０１の異常が検出されて、通信制御マイコン３０１のシャットダウン処理が実行された場合、電源供給制御部８０２は、信号線Ｌ１を介して、プラットフォーム２−１に対して再起動を要求しかつプラットフォーム２−２〜２−８に対してシャットダウン要求を通知する。これにより、通信制御マイコン３０１の異常によって、プラットフォーム２−１とプラットフォーム２−２〜２−８間において通信ができない場合であっても、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
次に、プラットフォーム２−２の機能構成について説明する。以下の説明では、プラットフォーム２−２の機能構成について説明するが、プラットフォーム２−３〜２−８も同様の機能構成を有する。
さらに、図８に示すように、本実施形態にかかるプラットフォーム２−２は、機能的構成として、プロセッサ側起動制御部８０３を有する。プロセッサ側起動制御部８０３は、スロット３０５−１，３０５−２を介してプラットフォーム２−１からシャットダウン要求が入力された場合に、プロセッサ２１−２のシャットダウン処理を実行する。
本実施形態では、プロセッサ側起動制御部８０３は、スロット３０５−１，３０５−２を介してプラットフォーム２−１から入力されるシャットダウン要求に従って、シャットダウン処理を実行しているが、これに限定するものではない。例えば、プロセッサ側起動制御部８０３は、信号線Ｌ２を介して、中継装置３の電源制御マイコン３０２からシャットダウン要求が入力された場合も、同様に、シャットダウン処理を実行する。
また、プロセッサ側起動制御部８０３は、信号線Ｌ２を介して、中継装置３から起動要求が入力された場合、シャットダウン処理の実行後、プラットフォーム２−２を起動させる起動処理を実行する。これにより、プラットフォーム２−１の再起動が実行された際に、プラットフォーム２−２も再起動させることが可能となるので、情報処理システム１全体の保守性を向上させることができる。
次に、図９および図１０を用いて、本実施形態にかかる情報処理システム１における再起動処理の流れの一例について説明する。図９および図１０は、本実施形態にかかる情報処理システムにおける再起動処理の流れの一例を示すシーケンス図である。
プラットフォーム２−１（ホストＰＣ）のホストＰＣ側起動制御部８０１は、当該プラットフォーム２−１が備える操作部を介して、再起動を指示する操作情報が入力されるのを待つ。プラットフォーム２−１の再起動を指示する操作情報が入力されると（ステップＳ９０１）、ホストＰＣ側起動制御部８０１は、プラットフォーム２−２〜２−８において実行されるＡＩ推論処理や画像処理等を中断させる（ステップＳ９０２）。そして、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１とプラットフォーム２−１〜２−８間でのデータの転送が完了するのを待つ。
次いで、プラットフォーム２−１とプラットフォーム２−２〜２−８間でのデータの転送が完了すると、ホストＰＣ側起動制御部８０１は、スロット３０５−１〜３０５−８を介してプラットフォーム２−２〜２−８に対して、シャットダウン要求を送信する（ステップＳ９０３）。さらに、ホストＰＣ側起動制御部８０１は、信号線Ｌ１を介して、プラットフォーム２−１の再起動が実行されることを示すシステム再起動通知を電源制御マイコン３０２に通知する（ステップＳ９０４）。
プラットフォーム２−１のホストＰＣ側起動制御部８０１は、電源制御マイコン３０２に対してシステム再起動通知を出力した後、プラットフォーム２−１のシャットダウン処理を実行する（ステップＳ９０５）。さらに、ホストＰＣ側起動制御部８０１は、Main系電源、SUS系電源、STD系電源をオフする（ステップＳ９０６〜ステップＳ９１８）。その後、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１を、電力を消費しない状態である電源断状態に遷移させるとともに、信号線Ｌ１を介して、プラットフォーム２−１が電源断状態に遷移したことを、電源制御マイコン３０２に通知する（ステップＳ９０９）。
次いで、プラットフォーム２−２〜２−８のプロセッサ側起動制御部８０３は、プラットフォーム２−１からシャットダウン要求が入力されると、プラットフォーム２−２〜２−８のシャットダウン処理を実行する（ステップＳ９１０）。さらに、プロセッサ側起動制御部８０３は、プラットフォーム２−２〜２−８のシャットダウン処理の実行後、プラットフォーム２−２〜２−８を、電力を消費しない状態である電源断状態に遷移させる（ステップＳ９１１）。
中継装置３の電源供給制御部８０２は、プラットフォーム２−１からシステム再起動通知が入力されると、外部の電源ユニット（不図示）からプラットフォーム２−１〜２−８へ電源供給されているか否かを検出する（ステップＳ９１２）。そして、プラットフォーム２−１の再起動に伴うシャットダウン処理によって、外部の電源ユニット（不図示）からプラットフォーム２−１〜２−８に電源供給されていないと判断した場合、電源供給制御部８０２は、プラットフォーム２−１〜２−８のシャットダウン処理が完了したと判断して、外部の電源ユニット（不図示）が有するＬＥＤ（Light Emitting Diode）を点滅等させる（ステップＳ９１３）。これにより、プラットフォーム２−１に対する電源供給が遮断されたことをオペレータに通知する。
中継装置３の電源供給制御部８０２は、プラットフォーム２−１の再起動に伴ってプラットフォーム２−１〜２−８のシャットダウン処理が実行されると、通信制御マイコン３０１にシャットダウン処理を実行させ、かつ外部の電源ユニット（不図示）から通信制御マイコン３０１への電源供給を遮断する（ステップＳ９１４）。さらに、電源供給制御部８０２は、プラットフォーム２−１〜２−８および通信制御マイコン３０１に電源供給を行う外部の電源ユニット（不図示）の電源をオフする（ステップＳ９１５）。
また、中継装置３の電源供給制御部８０２は、情報処理システム１全体のシャットダウン処理が完了してからの経過時間をカウントする（ステップＳ９１６）。そして、カウントした経過時間が予め設定された時間（例えば、１０ｓ）に達した場合、電源供給制御部８０２は、外部の電源ユニット（不図示）の電源をオンする（ステップＳ９１７）。さらに、電源供給制御部８０２は、中継装置３が有するファンの動作に異常が無いか否かを検出する（ステップＳ９１８）。
また、中継装置３の電源供給制御部８０２は、外部の電源ユニットの電源がオンされて、当該外部の電源ユニットからの電力供給が再開されると、通信制御マイコン３０１に対して起動要求を出力して、通信制御マイコン３０１を起動させる（ステップＳ９１９）。
その後、通信制御マイコン３０１から起動が完了したことを通知する起動完了通知が入力されると（ステップＳ９２０）、電源供給制御部８０２は、スロット３０５−１に接続されるプラットフォーム２−１のモデル、およびスロット３０５−１に対するプラットフォーム２−１の接続状態を検出する（ステップＳ９２１、ステップＳ９２２）。ここで、プラットフォーム２−１の接続状態としては、プラットフォーム２−１がスロット３０５−１に接続されているか否か、プラットフォーム２−１に電源供給が行われているか否か、およびプラットフォーム２−１のＯＳが正常に起動しているか否か等である。
さらに、電源供給制御部８０２は、プラットフォーム２−１の接続状態に異常が検出されなかった場合、信号線Ｌ１を介して、プラットフォーム２−１に対して、電源ボタンイベントを通知する（ステップＳ９２３）。
プラットフォーム２−１のホストＰＣ側起動制御部８０１は、電源制御マイコン３０２から電源ボタンイベントが通知されると、Main系電源をオンする（ステップＳ９２４）。Main系電源がオンされると、中継装置３の電源供給制御部８０２は、スロット３０５−２〜３０５−８に対するプラットフォーム２−２〜２−８の接続状態を検出する（ステップＳ９２５）。ここで、プラットフォーム２−２〜２−８の接続状態としては、プラットフォーム２−２〜２−８がスロット３０５−２〜３０５−８に接続されているか否か、プラットフォーム２−２〜２−８に電源供給が行われているか否か、およびプラットフォーム２−２〜２−８のＯＳが正常に起動しているか否か等である。
プラットフォーム２−２〜２−８の接続状態に異常が検出されなかった場合、電源供給制御部８０２は、信号線Ｌ２〜Ｌ８を介して、プラットフォーム２−２〜２−８に対して起動要求を出力する（ステップＳ９２６）。
また、ホストＰＣ側起動制御部８０１は、プラットフォーム２−２〜２−８の起動に先立って、プラットフォーム２−１の起動処理を開始する。次いで、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１のＢＩＯＳが起動したか否かを判断するＰＯＳＴ処理を実行する（ステップＳ９２７）。
ＢＩＯＳが起動していると判断した場合、ホストＰＣ側起動制御部８０１は、プラットフォーム２−１のＯＳの起動、ブリッジドライバ２０を含む各種のドライバのロードを実行する（ステップＳ９２８、ステップＳ９２９）。また、ホストＰＣ側起動制御部８０１は、通信制御マイコン３０１に対して、プラットフォーム２−１とプラットフォーム２−２〜２−８間でのデータの転送を許可するデータ転送許可通知を出力する（ステップＳ９３０）。
最後に、ホストＰＣ側起動制御部８０１は、信号線Ｌ１を介して、電源制御マイコン３０２に対して、プラットフォーム２−１の起動処理の完了を通知する起動完了通知を出力する（ステップＳ９３１）。
電源制御マイコン３０２から起動要求が入力されると（ステップＳ９２６）、プラットフォーム２−２〜２−８のプロセッサ側起動制御部８０３は、プラットフォーム２−２〜２−８のＯＳの起動、ブリッジドライバ２０を含む各種のドライバのロードを実行する（ステップＳ９３２、ステップＳ９３３）。その後、プロセッサ側起動制御部８０３は、信号線Ｌ２を介して、電源制御マイコン３０２に対して、プラットフォーム２−２の起動処理の完了を通知する起動完了通知を出力する（ステップＳ９３４）。
中継装置３の電源供給制御部８０２は、プラットフォーム２−１〜２−８から起動完了通知が入力されると、外部の電源ユニット（不図示）が有するＬＥＤを点灯等させる（ステップＳ９３５）。これにより、情報処理システム１全体の再起動が完了したことをオペレータに通知する。
このように、本実施形態にかかる情報処理システム１によれば、プラットフォーム２−１の再起動が実行された際に、プラットフォーム２−２〜２−８および通信制御マイコン３０１も再起動させることが可能となるので、情報処理システム１全体の保守性を向上させることができる。
また、本実施形態にかかる情報処理システム１によれば、所定条件は、プラットフォーム２−１が備える操作部から、再起動を指示する操作情報が入力された場合であり、ホストＰＣ側起動制御部は、操作情報が入力された場合、プラットフォーム２−１の再起動に先立って、プラットフォーム２−２〜２−８に対して、スロット３０５を介して、シャットダウン要求を通知する。これにより、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
また、本実施形態にかかる情報処理システム１によれば、電源制御マイコン３０２は、スロット３０５を介してプラットフォーム２−１とプラットフォーム２−２〜２−８間での通信ができない場合に、起動要求の出力に先立って、プラットフォーム２−２〜２−９に対して、シャットダウン要求を通知する。これにより、プラットフォーム２−１とプラットフォーム２−２〜２−８間において通信ができない場合であっても、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
また、本実施形態にかかる情報処理システム１によれば、所定条件は、電源制御マイコン３０２から再起動が要求された場合であり、通信制御マイコン３０１は、ウォッチドックタイマを備え、電源制御マイコン３０２は、ウォッチドックタイマによって通信制御マイコン３０１の異常が検出されて当該通信制御マイコン３０１のシャットダウン処理が実行された場合、プラットフォーム２−１に対して再起動を要求しかつプラットフォーム２−２〜２−８に対してシャットダウン要求を通知する。これにより、通信制御マイコン３０１の異常によって、プラットフォーム２−１とプラットフォーム２−２〜２−８間において通信ができない場合であっても、プラットフォーム２−１の再起動に伴って、プラットフォーム２−２〜２−８をシャットダウンさせることができる。
上述の実施形態では、各部のＩ／ＯインターフェースとしてＰＣＩｅを例に挙げて説明したが、Ｉ／ＯインターフェースはＰＣＩｅに限定されない。例えば、各部のＩ／Ｏインターフェースは、データ転送バスによって、デバイス（周辺制御コントローラ）とプロセッサとの間でデータ転送を行える技術であればよい。データ転送バスは、１個の筐体等に設けられたローカルな環境（例えば、１つのシステムまたは１つの装置）で高速にデータを転送できる汎用のバスであってよい。Ｉ／Ｏインターフェースは、パラレルインターフェース及びシリアルインターフェースのいずれであってもよい。
Ｉ／Ｏインターフェースは、ポイント・ツー・ポイント接続ができ、データをパケットベースでシリアル転送可能な構成でよい。尚、Ｉ／Ｏインターフェースは、シリアル転送の場合、複数のレーンを有してよい。Ｉ／Ｏインターフェースのレイヤー構造は、パケットの生成及び復号を行うトランザクション層と、エラー検出等を行うデータリンク層と、シリアルとパラレルとを変換する物理層とを有してよい。また、Ｉ／Ｏインターフェースは、階層の最上位であり１または複数のポートを有するルート・コンプレックス、Ｉ／Ｏデバイスであるエンド・ポイント、ポートを増やすためのスイッチ、及び、プロトコルを変換するブリッジ等を含んでよい。Ｉ／Ｏインターフェースは、送信するデータとクロック信号とをマルチプレクサによって多重化して送信してもよい。この場合、受信側は、デマルチプレクサでデータとクロック信号を分離してよい。
１ 情報処理システム
２ プラットフォーム
３ 中継装置
２１ プロセッサ
３０１ 通信制御マイコン
３０２ 電源制御マイコン
３０５ スロット
８０１ ホストＰＣ側起動制御部
８０２ 電源供給制御部
８０３ プロセッサ側起動制御部

Claims (4)

  1. 第１プラットフォームと、第２プラットフォームと、前記第１プラットフォームおよび前記第２プラットフォームが接続可能な拡張バスを有する中継装置と、を備える情報処理システムであって、
    前記第１プラットフォームは、
    所定条件を満たした場合に、前記第１プラットフォームを再起動させ、かつ前記第１プラットフォームの再起動に先立って、前記第１プラットフォームの再起動が実行されることを前記中継装置に通知する第１プラットフォーム側起動制御部、を備え、
    前記中継装置は、
    前記拡張バスを介した前記第１プラットフォームと前記第２プラットフォーム間での通信を制御する通信制御マイコンと、
    前記第１プラットフォームの再起動が実行されることが通知された場合に、前記第２プラットフォームに対して、当該第２プラットフォームの電源をオンの状態とする起動要求を出力し、かつ前記通信制御マイコンのシャットダウン処理の実行後、前記通信制御マイコンを起動させる電源制御マイコンと、を備え、
    前記第２プラットフォームは、
    当該第２プラットフォームのシャットダウンを要求するシャットダウン要求が入力された場合に、前記第２プラットフォームの電源をオフの状態とするシャットダウン処理を実行し、前記中継装置から前記起動要求が入力された場合、前記第２プラットフォームを起動させる起動処理を実行する第２プラットフォーム側電源制御部、
    を備える情報処理システム。
  2. 前記所定条件は、前記第１プラットフォームが備える操作部から、再起動を指示する操作情報が入力された場合であり、
    前記第１プラットフォーム側起動制御部は、前記操作情報が入力された場合、前記第１プラットフォームの再起動に先立って、前記第２プラットフォームに対して、前記拡張バスを介して、前記シャットダウン要求を通知する請求項１に記載の情報処理システム。
  3. 前記電源制御マイコンは、前記拡張バスを介して前記第１プラットフォームと前記第２プラットフォーム間での通信ができない場合に、前記起動要求の出力に先立って、前記第２プラットフォームに対して、前記シャットダウン要求を通知する、請求項１または２に記載の情報処理システム。
  4. 前記所定条件は、前記電源制御マイコンから再起動が要求された場合であり、
    前記通信制御マイコンは、ウォッチドックタイマを備え、
    前記電源制御マイコンは、前記ウォッチドックタイマによって前記通信制御マイコンの異常が検出されて当該通信制御マイコンのシャットダウン処理が実行された場合、前記第１プラットフォームに対して再起動を要求しかつ前記第２プラットフォームに対して前記シャットダウン要求を通知する請求項１から３のいずれか一に記載の情報処理システム。
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* Cited by examiner, † Cited by third party
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Cited By (2)

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JP2021174263A (ja) * 2020-04-25 2021-11-01 富士通クライアントコンピューティング株式会社 情報処理装置、およびプログラム
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