JP6567754B2 - イーサネット(登録商標)フレーム検知回路 - Google Patents
イーサネット(登録商標)フレーム検知回路 Download PDFInfo
- Publication number
- JP6567754B2 JP6567754B2 JP2018197731A JP2018197731A JP6567754B2 JP 6567754 B2 JP6567754 B2 JP 6567754B2 JP 2018197731 A JP2018197731 A JP 2018197731A JP 2018197731 A JP2018197731 A JP 2018197731A JP 6567754 B2 JP6567754 B2 JP 6567754B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- mask
- pattern
- detected
- ethernet frame
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 238000001514 detection method Methods 0.000 title claims description 82
- 230000015654 memory Effects 0.000 claims description 23
- 238000000034 method Methods 0.000 description 13
- 238000010586 diagram Methods 0.000 description 8
- 230000006870 function Effects 0.000 description 8
- 238000004590 computer program Methods 0.000 description 5
- 230000005540 biological transmission Effects 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 4
- 238000012986 modification Methods 0.000 description 3
- 230000004048 modification Effects 0.000 description 3
- 230000008569 process Effects 0.000 description 3
- 238000004891 communication Methods 0.000 description 2
- 101100172132 Mus musculus Eif3a gene Proteins 0.000 description 1
- 238000013500 data storage Methods 0.000 description 1
- 238000013501 data transformation Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L43/00—Arrangements for monitoring or testing data switching networks
- H04L43/50—Testing arrangements
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/407—Bus networks with decentralised control
- H04L12/413—Bus networks with decentralised control with random access, e.g. carrier-sense multiple-access with collision detection [CSMA-CD]
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L41/00—Arrangements for maintenance, administration or management of data switching networks, e.g. of packet switching networks
- H04L41/08—Configuration management of networks or network elements
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L41/00—Arrangements for maintenance, administration or management of data switching networks, e.g. of packet switching networks
- H04L41/08—Configuration management of networks or network elements
- H04L41/0803—Configuration setting
- H04L41/0823—Configuration setting characterised by the purposes of a change of settings, e.g. optimising configuration for enhancing reliability
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L41/00—Arrangements for maintenance, administration or management of data switching networks, e.g. of packet switching networks
- H04L41/08—Configuration management of networks or network elements
- H04L41/0803—Configuration setting
- H04L41/0823—Configuration setting characterised by the purposes of a change of settings, e.g. optimising configuration for enhancing reliability
- H04L41/0826—Configuration setting characterised by the purposes of a change of settings, e.g. optimising configuration for enhancing reliability for reduction of network costs
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L43/00—Arrangements for monitoring or testing data switching networks
- H04L43/08—Monitoring or testing based on specific metrics, e.g. QoS, energy consumption or environmental parameters
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L43/00—Arrangements for monitoring or testing data switching networks
- H04L43/10—Active monitoring, e.g. heartbeat, ping or trace-route
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L69/00—Network arrangements, protocols or services independent of the application payload and not provided for in the other groups of this subclass
- H04L69/22—Parsing or analysis of headers
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L2101/00—Indexing scheme associated with group H04L61/00
- H04L2101/60—Types of network addresses
- H04L2101/618—Details of network addresses
- H04L2101/622—Layer-2 addresses, e.g. medium access control [MAC] addresses
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Health & Medical Sciences (AREA)
- Cardiology (AREA)
- General Health & Medical Sciences (AREA)
- Computer Security & Cryptography (AREA)
- Environmental & Geological Engineering (AREA)
- Small-Scale Networks (AREA)
- Communication Control (AREA)
Description
めのマスクレジスタ及び検知しようとするフレームを示すパターンレジスタを格納し、前
記格納されたマスクレジスタ及び前記パターンレジスタに基づいて、前記算出されたバイ
トカウント値に対応する前記マスクデータ及び前記比較データを計算するマスク及びパタ
ーン格納メモリを含むことができる。
ory)、ROM(Read Only Memory)、フラッシュメモリ(Flas
h Memory)の一つ以上で構成されることができる。
レジスタを格納するマスクレジスタ列と、前記マスクレジスタ及び前記算出されたバイト
カウント値に基づいて、前記マスクデータを計算する第1のマックスと、検知しようとす
るフレームを示すパターンレジスタを格納するパターンレジスタ列と、前記パターンレジ
スタ及び前記算出されたバイトカウント値に基づいて、前記比較データを計算する第2の
マックスと、を含むことができる。
て前記検知しなくてもよいビットを無視する第1の比較器と、前記計算された比較データ
に基づいて、前記受信されたデータを、前記検知しようとする目的データと比較する第2
の比較器と、を含むことができる。
々な構成によりイーサネットフレームを検知することができるため、イーサネットフレー
ム検知装置に要求される特性を満たすことができる。
単純化することができる。
で用いられる構成要素における接尾辞「モジュール」及び「部」は、明細書を容易に作成
するためにのみ付与または混用されるものであって、そのものが、互いに区別される意味
または役割を有するわけではない。
ができる。
するためのインタフェース(interface)であることができる。
ことができる。
0b、…300nで構成されることができる。
フレームを検知することができる。これにより、イーサネット検知装置400は、n個の
イーサネットフレーム検知回路を含む複数のイーサネットフレーム検知回路300a、3
00b、…300nを用いて、n個のフレームを同時に検知することができる。
明する。
るためのブロック構成図である。
0と、マスク及びパターン格納部320と、比較器330と、検知信号発生器340と、
を含む。
番目のバイトであるかをカウントすることができる。これにより、受信バイトカウンタ3
10は、受信中のデータのバイトカウント値を算出することができる。そして、受信バイ
トカウンタ310は、算出されたカウント値をマスク及びパターン格納部320と検知信
号発生器340に伝達することができる。
に基づいて、算出されたカウント値に対応するマスクデータ及び比較データを計算するこ
とができる。
すレジスタを意味することができる。そのため、マスクレジスタは、検知しなくてもよい
ビットを無視するために用いられるレジスタを意味することができる。マスクデータとは
、算出されたカウント値に対応するマスクレジスタを意味することができる。
すレジスタを意味することができる。そのため、パターンレジスタは、検知しようとする
フレームのパターンを示すためのレジスタを意味することができる。比較データは、算出
されたカウント値に対応するパターンレジスタを意味することができる。
することができる。例えば、比較器330は、計算されたマスクデータに基づいて、受信されたデータにおいて検知が不要なビットを無視することができる。そして、比較器330は、計算された比較データに基づいて、受信されたデータにおいて検知しようとするフレームのパターンを検知することができる。ここで、検知しようとするフレームのパターンを含むデータを、目的データと言える。そして、比較器330はその比較結果を検知信号発生器340に伝達する。
ネットフレーム検知回路300のブロック構成図である。
320は、マスクレジスタ列321と、第1のマックス(Mux)322と、パターンレ
ジスタ列323と、第2のマックス324と、を含むことができる。
出されたカウント値に基づいて、マスクデータを計算することができる。
ジスタ列321に格納されたマスクレジスタからマスクデータを選択することができる。
することができる。例えば、第1のマックス322は、計算されたマスクデータを第1の
比較器331に伝達することができる。
び算出されたカウント値に基づいて、比較データを計算することができる。
レジスタ列323に格納されたパターンレジスタから比較データを選択することができる
。
とができる。例えば、第2のマックス324は、計算された比較データを第2の比較器3
32に伝達することができる。
サネットフレーム検知回路300のブロック構成図である。
320は、マスク及びパターン格納メモリ327を含むことができる。
することができる。そして、マスク及びパターン格納メモリ327は、格納されたマスク
レジスタ及びパターンレジスタに基づいて、算出されたカウント値に対応するマスクデー
タ及び比較データを計算することができる。そして、マスク及びパターン格納メモリ32
7は、計算されたマスクデータ及び比較データを比較器330に伝達することができる。
例えば、マスク及びパターン格納メモリ327は、計算されたマスクデータを第1の比較
器331に伝達し、計算された比較データを第2の比較器332に伝達することができる
。
できる。例えば、マスク及びパターン格納メモリ327は、RAM(Random Access Memory)、ROM(Read Only Memory)、フラッシュメモリ(Flash Memory)の一つ以上で構成されることができる。
信号として検知信号を出力することができる。
を用いて、複数のフレームを同時に検知することができる。
00を含む場合、N ´ Lバイトのサイズを有するイーサネットフレームを同時に検知す
ることができる。
サが読み取ることができるコードとして具現することができる。プロセッサが読み取るこ
とができる媒体の例としては、ROM、RAM、CD‐ROM、磁気テープ、フロッピデ
ィスク、光データ格納装置などが挙げられ、キャリアウェーブ(例えば、インターネット
を介した送信)の形態で具現されることも含む。
ば、様々な構成によりイーサネットフレームを検知することができるため、イーサネット
フレーム検知装置に要求される特性を満たすことができる。
単純化することができる。
なく、実施形態の様々な変形が行われるように、各実施形態の全部または一部が選択的に
組み合わせられて構成されてもよい。
定の実施形態に限定されず、請求範囲にて請求する本発明の要旨を逸脱することなく当該
発明が属する技術分野において通常の知識を有する者によって様々な変形実施が可能であ
るだけでなく、かかる変形実施は本発明の技術的思想や展望から個別的に理解されてはな
らない。
300a 第1のイーサネットフレーム検知回路
300b 第2のイーサネットフレーム検知回路
300n 第nのイーサネットフレーム検知回路
310 受信バイトカウンタ
320 マスク及びパターン格納部
327 マスク及びパターン格納メモリ
330 比較器
321 マスクレジスタ列
322 第1のマックス
323 パターンレジスタ列
324 第2のマックス
330 比較器
331 第1の比較器
332 第2の比較器
340 検知信号発生器
Claims (5)
- イーサネットフレームを検知するイーサネットフレーム検知回路であって、
受信されたデータのバイトカウント値を算出する受信バイトカウンタと、
第1のマルチプレクサにより、検知しなくてもよいビットを無視するためのマスクレジスタデータ及び前記算出されたバイトカウント値に基づいて、マスクデータを計算し、かつ、第2のマルチプレクサにより、検知しようとするフレームを示すパターンレジスタデータ及び前記算出されたバイトカウント値に基づいて、フレームのパターンを含む比較データを計算するマスク及びパターン格納部と、
前記マスクデータ及び比較データに基づいて、前記受信されたデータが、検知しようとする目的データと一致するか否かを判断する比較器と、
前記判断結果に対応する検知信号を出力する検知信号発生器と、を含む、イーサネットフレーム検知回路。 - 前記マスク及びパターン格納部は、
検知しなくてもよいビットを無視するためのマスクレジスタデータ及び検知しようとするフレームを示すパターンレジスタデータを格納し、前記格納されたマスクレジスタデータ及び前記パターンレジスタデータに基づいて、前記算出されたバイトカウント値に対応する前記マスクデータ及び前記比較データを生成及び格納するマスク及びパターン格納メモリを含む、請求項1に記載のイーサネットフレーム検知回路。 - 前記マスク及びパターン格納メモリは、RAM、ROM、フラッシュメモリのうち少なくとも一つ以上で構成される、請求項2に記載のイーサネットフレーム検知回路。
- 前記マスク及びパターン格納部は、
検知しなくてもよいビットを無視するためのマスクレジスタデータを格納するマスクレジスタデータ列と、
前記マスクレジスタデータ及び前記算出されたバイトカウント値に基づいて、前記マスクデータを計算する第1のマルチプレクサと、
検知しようとするフレームを示すパターンレジスタデータを格納するパターンレジスタデータ列と、
前記パターンレジスタデータ及び前記算出されたバイトカウント値に基づいて、前記比較データを計算する第2のマルチプレクサと、を含む、請求項1に記載のイーサネットフレーム検知回路。 - 前記比較器は、
前記マスクデータに基づいて、前記受信されたデータにおいて前記検知しなくてもよいビットを無視する第1の比較器と、
前記比較データに基づいて、前記受信されたデータを、前記検知しようとする目的データと比較する第2の比較器と、を含む、請求項1に記載のイーサネットフレーム検知回路。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR10-2015-0108399 | 2015-07-30 | ||
KR1020150108399A KR101649828B1 (ko) | 2015-07-30 | 2015-07-30 | 이더넷 프레임 감지 장치 그의 동작 방법 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016148193A Division JP2017034673A (ja) | 2015-07-30 | 2016-07-28 | イーサネット(登録商標)フレーム検知回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2019030025A JP2019030025A (ja) | 2019-02-21 |
JP6567754B2 true JP6567754B2 (ja) | 2019-08-28 |
Family
ID=56617984
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016148193A Pending JP2017034673A (ja) | 2015-07-30 | 2016-07-28 | イーサネット(登録商標)フレーム検知回路 |
JP2018197731A Expired - Fee Related JP6567754B2 (ja) | 2015-07-30 | 2018-10-19 | イーサネット(登録商標)フレーム検知回路 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016148193A Pending JP2017034673A (ja) | 2015-07-30 | 2016-07-28 | イーサネット(登録商標)フレーム検知回路 |
Country Status (6)
Country | Link |
---|---|
US (1) | US10063390B2 (ja) |
EP (1) | EP3125470B1 (ja) |
JP (2) | JP2017034673A (ja) |
KR (1) | KR101649828B1 (ja) |
CN (1) | CN106411564B (ja) |
ES (1) | ES2735739T3 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112332951B (zh) * | 2020-11-20 | 2022-06-24 | 昆高新芯微电子(江苏)有限公司 | 一种以太网帧抢占方法、装置、设备及存储介质 |
CN112737995B (zh) * | 2020-12-16 | 2022-11-22 | 北京东土科技股份有限公司 | 以太网帧的处理方法、装置、设备及存储介质 |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5935245A (en) * | 1996-12-13 | 1999-08-10 | 3Com Corporation | Method and apparatus for providing secure network communications |
US6938040B2 (en) * | 1998-04-28 | 2005-08-30 | International Business Machines Corporation | Pattern matching in communications network where first memory stores set of patterns, and second memory stores mask data identifying patterns in the first memory |
TW498206B (en) * | 1998-07-28 | 2002-08-11 | Silicon Integrated Sys Corp | Method and device for matching data stream with a fixed pattern |
JP2001189752A (ja) * | 1999-12-28 | 2001-07-10 | Sony Corp | パケット選択装置とその方法および受信装置 |
US7230956B1 (en) * | 2003-01-10 | 2007-06-12 | Altera Corporation | Techniques for frame detection and word alignment |
US20040190506A1 (en) * | 2003-03-24 | 2004-09-30 | International Business Machines Corp. | Method and apparatus for performing complex pattern matching in a data stream within a computer network |
JP4341413B2 (ja) * | 2003-07-11 | 2009-10-07 | 株式会社日立製作所 | 統計収集装置を備えたパケット転送装置および統計収集方法 |
KR20050019952A (ko) | 2003-08-18 | 2005-03-04 | 엘지전자 주식회사 | 디에쓰 쓰리를 사용하는 통신 시스템에서의 프레임 검출장치 및 방법 |
US7373454B1 (en) * | 2003-10-28 | 2008-05-13 | Altera Corporation | Pattern detect and byte align circuit using CAM |
US7921263B2 (en) * | 2006-12-22 | 2011-04-05 | Broadcom Corporation | System and method for performing masked store operations in a processor |
JP2010161676A (ja) * | 2009-01-09 | 2010-07-22 | Panasonic Corp | 無線通信機能を有するマイクロコンピュータおよびその応用システム |
KR101276261B1 (ko) | 2011-09-21 | 2013-06-20 | 주식회사 마스터소프트 | 원격 접속 보안 시스템 |
KR101414959B1 (ko) | 2012-02-29 | 2014-07-09 | 주식회사 팬택 | 네트워크 공격을 감지하는 이동 통신 단말기 및 그 감지 방법 |
US8997231B2 (en) | 2012-04-18 | 2015-03-31 | Zimperium, Inc. | Preventive intrusion device and method for mobile devices |
KR101563059B1 (ko) | 2012-11-19 | 2015-10-23 | 삼성에스디에스 주식회사 | 안티 멀웨어 시스템 및 안티 멀웨어 시스템에서의 데이터 처리 방법 |
KR20140077489A (ko) | 2012-12-14 | 2014-06-24 | 삼성전자주식회사 | 사용자 단말 장치, 네트워크 장치 및 그 제어 방법 |
-
2015
- 2015-07-30 KR KR1020150108399A patent/KR101649828B1/ko active IP Right Grant
-
2016
- 2016-06-28 ES ES16176638T patent/ES2735739T3/es active Active
- 2016-06-28 EP EP16176638.1A patent/EP3125470B1/en active Active
- 2016-07-25 CN CN201610592947.5A patent/CN106411564B/zh active Active
- 2016-07-28 JP JP2016148193A patent/JP2017034673A/ja active Pending
- 2016-07-29 US US15/224,360 patent/US10063390B2/en active Active
-
2018
- 2018-10-19 JP JP2018197731A patent/JP6567754B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
ES2735739T3 (es) | 2019-12-20 |
JP2017034673A (ja) | 2017-02-09 |
CN106411564B (zh) | 2019-09-06 |
US10063390B2 (en) | 2018-08-28 |
EP3125470A1 (en) | 2017-02-01 |
US20170033945A1 (en) | 2017-02-02 |
CN106411564A (zh) | 2017-02-15 |
EP3125470B1 (en) | 2019-05-15 |
KR101649828B1 (ko) | 2016-08-19 |
JP2019030025A (ja) | 2019-02-21 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US20170068628A1 (en) | Reducing ethernet latency in a multi-server chassis | |
CN108111432A (zh) | 报文转发方法及装置 | |
US10749738B2 (en) | Method and apparatus for diagnosing network | |
US10701041B2 (en) | Calculation device, calculation method, communication apparatus, and storage medium | |
JP6567754B2 (ja) | イーサネット(登録商標)フレーム検知回路 | |
JP2012199724A (ja) | データ送信装置、データ受信装置、データ送受信装置及びデータ送受信装置の制御方法 | |
JP2016518750A5 (ja) | ||
US10318453B2 (en) | Systems and methods for transmitting interrupts between nodes | |
JP2015012580A5 (ja) | 受信装置、制御方法及びプログラム | |
US20160149800A1 (en) | Routing Loop Determining Method and Device | |
US20180375801A1 (en) | Apparatus and method for distribution of congestion information in a switch | |
US20210377152A1 (en) | Systems and methods for determining secure network elements using flexible algorithm technology | |
WO2015024499A1 (zh) | 一种序列传输、接收装置及方法 | |
US20170142677A1 (en) | Sequence detection method and apparatus, and computer storage medium | |
US10243590B1 (en) | Detection of errors in a ternary content addressable memory | |
US10684961B1 (en) | External memory protection for content addressable memory | |
JP2006237710A (ja) | データ処理装置 | |
KR20160086133A (ko) | 온 칩 네트워크에서 데이터를 송수신하는 방법 및 시스템 | |
US10484304B2 (en) | Determining actions to be immediately performed on a network packet with an application specific integrated circuit | |
KR101383397B1 (ko) | 방화벽 엔진 및 이를 이용한 패킷 매칭 방법 | |
KR102124778B1 (ko) | Fpga를 이용한 파워 스택 모니터링 시스템 및 이를 포함하는 파워 스택 | |
US10462046B2 (en) | Routing of data in network | |
US8775894B1 (en) | Lane specific CRC | |
KR101596163B1 (ko) | 비대칭 다중 모듈 구조를 이용하는 반도체 장치 및 처리 방법 | |
US20160191388A1 (en) | Pattern Matching Values of a Packet Which May Result in False-Positive Matches |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20181019 |
|
RD03 | Notification of appointment of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7423 Effective date: 20181211 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20190115 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20190625 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20190702 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20190731 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6567754 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |