JP6518180B2 - Gaming machine - Google Patents
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Description
グループに分割された演出装置を制御する複数のグループ単位制御手段と、複数のグル
ープ単位制御手段を制御するグループ統括制御手段とを備える遊技機に関し、特に、グル
ープ単位制御手段の初期化方法に関する。
The present invention relates to a gaming machine including a plurality of group unit control means for controlling a rendering device divided into groups, and a group general control means for controlling a plurality of group unit control means, and more particularly to a method of initializing group unit control means.
サブ中継基板と電飾基板との間の配線を簡素化することができる遊技機として、トップ
電飾領域の中央部に配置されたトップＬＥＤ中央基板をサブ中継基板とシリアル接続し、
トップ電飾領域の右側部に配置されたトップＬＥＤ右基板及びトップ電飾領域の左側部に
配置されたトップＬＥＤ左基板をトップＬＥＤ中央基板から分離して配線により接続した
構成の遊技機が知られている。これにより、サブ中継基板からトップ電飾領域への配線数
を減らして配線を簡素化することができる（例えば、特許文献１参照）。
As a gaming machine capable of simplifying the wiring between the sub relay board and the electric decoration board, the top LED central board disposed in the center of the top electric decoration area is serially connected to the sub relay board,
A gaming machine is known in which the top LED right substrate disposed on the right side of the top illumination area and the top LED left substrate disposed on the left side of the top illumination area are separated from the top LED central substrate and connected by wiring It is done. As a result, the number of wires from the sub relay board to the top illumination area can be reduced to simplify the wires (see, for example, Patent Document 1).
また、信号線の数を削減することができると共に不正行為の発見を容易に行うことがで
きる遊技機として、主基板と副基板との間での信号送信をＩ2Ｃバス方式により行い、主
基板及び副基板にそれぞれ双方向バスバッファを設けたものがある。この双方向バスバッ
ファは、Ｉ2Ｃバスを構成する二つの双方向シリアルライン（ＳＤＡ、ＳＣＬ）をそれぞ
れ二つの片方向シリアルラインに分岐させるためのものであり、主基板に設けられた双方
向バスバッファと副基板に設けられた双方向バスバッファとの間を、それらによって分岐
された片方向シリアルラインの信号伝送方向が互いに一致するようにして、四つのシリア
ル線で接続した構成としている（例えば、特許文献２参照）。
In addition, as a gaming machine that can reduce the number of signal lines and easily detect fraudulent activity, it performs signal transmission between the main substrate and the sub substrate by the I 2 C bus system, and Some substrates and sub substrates are provided with bidirectional bus buffers, respectively. This bi-directional bus buffer is for branching the two bi-directional serial lines (SDA, SCL) constituting the I 2 C bus into two unidirectional serial lines, respectively. Between the bus buffer and the bidirectional bus buffer provided on the sub board, the signal transmission directions of the unidirectional serial lines branched by them are made to coincide with each other, and they are connected by four serial lines (see FIG. See, for example, Patent Document 2).
本発明は、グループ統括制御手段とグループ単位制御手段とを接続する接続線の数を削
減しつつ、正しく動作することができる遊技機を提供することを目的とする。
An object of the present invention is to provide a gaming machine which can operate properly while reducing the number of connection lines connecting the group general control means and the group unit control means.
本発明は、遊技の演出を行う複数の演出装置を備える遊技機において、前記複数の演出装置を複数グループに分割し、該分割されたグループに属する演出装置を制御するためのグループ単位制御手段をグループ毎に設けるとともに、前記グループ単位制御手段の各々を統括的に制御するグループ統括制御手段を設け、前記グループ単位制御手段と前記グループ統括制御手段との間を、前記グループ統括制御手段から前記グループ単位制御手段にタイミング信号を伝達するタイミング信号線と、データ信号を伝達するデータ線と、前記グループ単位制御手段に電源電圧を供給する電源線と、を含むハーネスによりコネクタを介して接続し、前記グループ統括制御手段が前記グループ単位制御手段に伝達するデータには、前記グループ単位制御手段に設けられた記憶領域のうちの所定のアドレスを示すアドレス情報と、複数の制御データと、前記記憶領域の範囲内においてアドレスを更新する際の上限アドレスと戻りアドレスを特定可能なアドレス更新情報と、が含まれ、前記グループ統括制御手段は、当該グループ統括制御手段に電源供給が開始されると、当該グループ統括制御手段自身を電源供給による電圧上昇に基づいて初期化可能であり、前記グループ単位制御手段は、前記ハーネスの再接続により当該グループ単位制御手段に電源供給が開始されると、当該グループ単位制御手段自身を電源供給による電圧上昇に基づいて初期化可能であり、前記アドレス情報が示すアドレスを記憶先の開始アドレスとして、伝達された制御データを記憶し、制御データを記憶する毎に記憶先のアドレスを順次更新し、前記上限アドレスが示す記憶領域に制御データを記憶した場合は、前記戻りアドレスに戻るように記憶先のアドレスを更新する。 The present invention relates to a gaming machine including a plurality of effect devices for effecting a game, wherein the plurality of effect devices are divided into a plurality of groups, and group unit control means for controlling the effect devices belonging to the divided groups. A group general control means is provided for each group and comprehensively controls each of the group unit control means, and the group general control means is provided with the group general control means between the group unit control means and the group general control means. a timing signal line for transmitting a timing signal to the unit control means, and a data line for transmitting data signals, and a power supply line for supplying a power supply voltage to the group-unit control unit, via the connector by a harness including connecting said The data transmitted to the group unit control means by the group general control means includes the group unit control means. Address information indicating a predetermined address in the storage area provided in the storage area, a plurality of control data, and address update information capable of specifying an upper limit address and a return address when updating the address within the range of the storage area , include the group supervisory controlling means, when the power supply to the group supervisory controlling means is started, it is possible initialized based the group supervisory controlling means itself to the voltage rise due to the power supply, said group unit control means, when the power supply to the group-unit control unit is started by the re-connection of the harness, Ri initializability der based the group-unit control unit itself to the voltage rise due to the power supply, the address information The transmitted control data is stored with the indicated address as the start address of the storage destination, and the storage destination is stored each time the control data is stored. Sequentially updating the address, when storing the control data in the storage area in which the upper address indicates updates the address of the storage destination back to the return address.
本発明によると、グループ統括制御手段とグループ単位制御手段間の配線を少なくすることができる。また、適切なデータ送信を行うことができ、誤作動を防止することができる。 According to the present invention, the wiring between the group general control means and the group unit control means can be reduced. In addition, appropriate data transmission can be performed, and malfunction can be prevented.
（第１実施形態）
以下、本発明の第１実施形態について、図１〜図３２を参照して説明する。
First Embodiment
Hereinafter, a first embodiment of the present invention will be described with reference to FIGS.
図１は、本発明の第１実施形態の遊技機１の説明図である。
FIG. 1 is an explanatory view of a
遊技機１の前面枠（遊技枠）３は本体枠（外枠）２にヒンジ４を介して、遊技機１の前
面に開閉回動可能に組み付けられる。前面枠３の表側には、遊技盤１０（図２参照）が収
装される。また、前面枠３には、遊技盤１０の前面を覆うカバーガラス（透明部材）を備
えたガラス枠１８が取り付けられている。
The front frame (game frame) 3 of the
ガラス枠１８のカバーガラスの周囲には、装飾光が発光される装飾部材９が備えられて
いる。この装飾部材９の内部にはランプやＬＥＤ等からなる装飾装置６２０（図３参照）
が備えられている。この装飾装置６２０を所定の発光態様によって発光することによって
、装飾部材９が所定の発光態様によって発光する。
A
Is equipped. When the
ガラス枠１８の左右には、音響（例えば、効果音）を発するスピーカ３０が備えられて
いる。また、ガラス枠１８の上方には照明ユニット１１が備えられている。照明ユニット
１１の内部には、前述した装飾装置６２０が備えられている。
At the left and right of the
照明ユニット１１の右側には、遊技機１において異常が発生したことを報知するための
異常報知ＬＥＤ２９が備えられている。
An
前面枠３の下部の開閉パネル２０には図示しない打球発射装置に遊技球を供給する上皿
２１が、固定パネル２２には灰皿１５、下皿２３及び打球発射装置の操作部２４等が備え
られる。下皿２３には、下皿２３に貯まった遊技球を排出するための下皿球抜き機構１６
が備えられる。前面枠３下部右側には、ガラス枠１８を施錠するための鍵２５が備えられ
ている。
An
Is provided. A key 25 for locking the
また、遊技者が操作部２４を回動操作することによって、打球発射装置は、上皿２１か
ら供給される遊技球を発射する。
In addition, when the player rotates the
また、上皿２１の上縁部には、遊技者からの操作入力を受け付けるための演出ボタン１
７が備えられている。
In addition, at the upper edge of the
7 are provided.
遊技者が演出ボタン１７を操作することによって、遊技盤１０に設けられた表示装置５
３（図２参照）における特図変動表示ゲームの演出内容を選択して、表示装置５３におけ
る特図変動表示ゲームに、遊技者の操作を介入させた演出を行うことができる。
The
The effect contents of the special view variation display game in 3 (refer to FIG. 2) can be selected, and the special view variation display game in the
なお、特図変動表示ゲームは、発射された遊技球が遊技盤１０に備わる第１始動入賞口
４５（図２参照）又は普通変動入賞装置３６（図２参照）の第２始動入賞口に入賞した場
合に開始される。特図変動表示ゲームでは、表示装置５３において複数の識別情報が変動
表示する。そして、変動表示していた識別情報が停止し、停止した識別情報の結果態様が
特定の結果態様である場合に、遊技機１の状態が遊技者に有利な状態（特典が付与される
状態）である特別遊技状態に遷移する。
In the special view variation display game, the first starting winning opening 45 (see FIG. 2) or the second starting winning opening of the normal variation winning device 36 (see FIG. 2) provided on the
上皿２１の右上部には、遊技者が遊技球を借りる場合に操作する球貸ボタン２６、及び
、図示しないカードユニットからプリペイドカードを排出させるために操作される排出ボ
タン２７が設けられている。これらのボタン２６、２７の間には、プリペイドカードの残
高を表示する残高表示部２８が設けられる。
In the upper right portion of the
図２は、本発明の第１実施形態の遊技盤１０の正面図である。
FIG. 2 is a front view of the
図１に示す遊技機１は、内部の遊技領域１０ａ内に遊技球を発射して（弾球して）遊技
を行うもので、ガラス枠１８のカバーガラスの奥側には、遊技領域１０ａを構成する遊技
盤１０が設置されている。
The
遊技盤１０は、各種部材の取付ベースとなる平板状の遊技盤本体１０ｂ（木製又は合成
樹脂製）を備え、該遊技盤本体１０ｂの前面にガイドレール３２で囲まれた遊技領域１０
ａを有している。また、遊技盤本体１０ｂの前面であってガイドレール３２の外側には、
前面構成部材３３、３３、…が取り付けられている。そして、このガイドレール３２で囲
まれた遊技領域１０ａ内に発射装置から遊技球（打球；遊技媒体）を発射して遊技を行う
ようになっている。
The
have a. In addition, on the front of the game board
The
遊技領域１０ａの略中央には、特図変動表示ゲームの表示領域となる窓部５２を形成す
るセンターケース５１が取り付けられている。このセンターケース５１に形成された窓部
５２の後方には、複数の識別情報を変動表示する特図変動表示ゲームの演出を実行可能な
演出表示装置としての表示装置５３が配されるようになっている。この表示装置５３は、
例えば、液晶ディスプレイを備え、表示内容が変化可能な表示部５３ａがセンターケース
５１の窓部５２を介して遊技盤１０の前面側から視認可能となるように配されている。な
お、表示装置５３は、液晶ディスプレイを備えるものに限らず、ＥＬ、ＣＲＴ等のディス
プレイを備えるものであってもよい。
At the approximate center of the
For example, a liquid crystal display is provided, and a
センターケース５１の窓部５２の上端付近には、遊技状態に基づいて動作可能な可動役
物６０が取り付けられる。
In the vicinity of the upper end of the
また、遊技盤１０には、普図始動ゲート３４と、普図変動表示ゲームの未処理回数を表
示する普図記憶表示器４７、普図変動表示ゲームを表示する普図表示器３５が設けられて
いる。また、遊技領域１０ａ内には、第１の始動入賞領域をなす第１始動入賞口４５と、
第２の始動入賞領域をなす第２始動入賞口を有する普通変動入賞装置３６と、が設けられ
ている。そして、遊技球が第１始動入賞口４５に入賞した場合は、補助遊技として第１特
図変動表示ゲームが実行され、遊技球が普通変動入賞装置３６に入賞した場合は、補助遊
技として第２特図変動表示ゲームが実行されるようになっている。
Further, the
A normal
また、遊技盤１０には、第１特図変動表示ゲームを表示する第１特図表示器３８と、第
２特図変動表示ゲームを表示する第２特図表示器３９と、が設けられている。また、第１
特図変動表示ゲームの未処理回数（第１特図始動記憶）を表示する第１特図記憶表示器４
８と、第２特図変動表示ゲームの未処理回数（第２特図始動記憶）を表示する第２特図記
憶表示器４９が設けられている。なお、普図記憶表示器４７、普図表示器３５、第１特図
表示器３８、第２特図表示器３９、第１特図記憶表示器４８、第２特図記憶表示器４９は
、遊技状態を表す遊技状態表示ＬＥＤ（図示略）と併せて、セグメントＬＥＤとして一体
に設けられている。
In addition, the
First special
A second special
さらに遊技領域１０ａには、上端側が手前側に倒れる方向に回動して開放可能になって
いるアタッカ形式の開閉扉４２ａを有し、第１特図変動表示ゲーム、第２特図変動表示ゲ
ームの結果如何によって大入賞口を閉じた状態（遊技者にとって不利な状態）から開放状
態（遊技者にとって有利な状態）に変換する特別変動入賞装置４２、入賞口などに入賞し
なかった遊技球を回収するアウト穴４３が設けられている。この他、遊技領域１０ａには
、一般入賞口４４、４４、…、打球方向変換部材としての風車４６、多数の障害釘（図示
略）などが配設されている。
Furthermore, in the
普図始動ゲート３４内には、該普図始動ゲート３４を通過した遊技球を検出するための
ゲートＳＷ３４ａ（図３参照）が設けられている。そして、遊技領域１０ａ内に打ち込ま
れた遊技球が普図始動ゲート３４内を通過すると、普図変動表示ゲームが行われる。
In the drawing
また、普図変動表示ゲームを開始できない状態中に、普図始動ゲート３４を遊技球が通
過すると、普図始動記憶数が上限数未満であるならば、普図始動記憶数が１加算されて、
当該普図変動表示ゲームが当りとなるか否かを示す乱数が普図始動記憶として一つ記憶さ
れる。
In addition, when the game ball passes the common drawing start
A random number indicating whether or not the common drawing variation display game is hit is stored as one common drawing start memory.
普図変動表示ゲームが開始できない状態とは、例えば、普図変動表示ゲームが既に行わ
れ、その普図変動表示ゲームが終了していない状態や、普図変動表示ゲームが当って普通
変動入賞装置３６が開状態に変換されている状態のことをいう。
The state in which the common drawing fluctuation display game can not be started means, for example, a state in which the common drawing fluctuation display game has already been played and the common drawing fluctuation display game has not ended, or the common drawing fluctuation display game hits 36 refers to a state in which it is converted to the open state.
なお、普図変動表示ゲームの始動記憶数は、ＬＥＤを備える普図記憶表示器４７にて表
示される。
In addition, the starting memory number of the common drawing variation display game is displayed on the common
普図変動表示ゲームは、遊技盤１０に設けられた普図表示器３５で実行されるようにな
っている。なお、表示装置５３の表示領域の一部で普図変動表示ゲームを表示するように
してもよく、この場合は識別図柄として、例えば、数字、記号、キャラクタ図柄などを用
い、この識別図柄を所定時間変動表示させた後、停止表示させることにより行うようにす
る。
The common drawing variation display game is to be executed by the
この普図変動表示ゲームの停止表示が特別の結果態様となれば、普図変動表示ゲームが
当りとなって、普通変動入賞装置３６の開閉部材３６ａ、３６ａが所定時間（例えば、０
.５秒間）開放される。これにより、普通変動入賞装置３６に遊技球が入賞しやすくなり
、第２特図変動表示ゲームの始動が容易となる。
If the stop display of the common drawing fluctuation display game is a special result mode, the common drawing fluctuation display game becomes a hit, and the opening /
Open for .5 seconds) Thereby, the game ball easily wins the normal
普通変動入賞装置３６は左右一対の開閉部材３６ａ、３６ａを具備し、第１始動入賞口
４５の下部に配設される。この開閉部材３６ａ、３６ａは、常時は遊技球の直径程度の間
隔をおいて閉じた状態（遊技者にとって不利な状態）を保持しているが、普図変動表示ゲ
ームの結果が所定の停止表示態様となった場合（普図変動表示ゲームが当りとなった場合
）には、駆動装置としてのソレノイド（普電ＳＯＬ３６ｂ、図３参照）によって、逆「ハ
」の字状に開いて普通変動入賞装置３６に遊技球が流入し易い状態（遊技者にとって有利
な状態）に変化させられるようになっている。
The normal
また、本実施形態の遊技機１は、特図変動表示ゲームの結果態様に基づき、遊技状態と
して、表示装置５３における特図変動表示ゲームの変動表示時間を短縮する時短動作状態
（第２動作状態）を発生可能となっている。この時短動作状態（第２動作状態）は、普通
変動入賞装置３６の動作状態が、通常動作状態（第１動作状態）に比べて開放状態となり
やすい状態である。
In addition, the
この時短動作状態においては、上述の普図変動表示ゲームの実行時間が、通常動作状態
における長い実行時間よりも短くなるように制御され（例えば、１０秒が１秒）、これに
より、単位時間当りの普通変動入賞装置３６の開放回数が実質的に多くなるように制御さ
れる。また、時短動作状態においては、普図変動表示ゲームが当り結果となって普通変動
入賞装置３６が開放される場合に、開放時間が通常動作状態の短い開放時間より長くされ
るように制御される（例えば、０．３秒が１．８秒）。また、時短動作状態においては、
普図変動表示ゲームの１回の当り結果に対して、普通変動入賞装置３６が１回ではなく、
複数回（例えば、２回）開放される。さらに、時短動作状態においては普図変動表示ゲー
ムの当り結果となる確率が通常動作状態より高くなるように制御される。すなわち、通常
動作状態よりも普通変動入賞装置３６の開放回数が増加され、普通変動入賞装置３６に遊
技球が入賞しやすくなり、第２特図変動表示ゲームの始動が容易となる。
At this time, in the short operation state, the execution time of the above-mentioned common view variation display game is controlled to be shorter than the long execution time in the normal operation state (for example, 10 seconds is one second), whereby The number of opening of the normal
The normal
It is opened multiple times (for example, twice). Furthermore, in the short-time operation state, the probability of being a hit result of the common view variation display game is controlled to be higher than that in the normal operation state. That is, the number of times the normal
第１始動入賞口４５の内部には第１始動口ＳＷ４５ａ（図３参照）が備えられ、この第
１始動口ＳＷ４５ａによって遊技球を検出することに基づき、補助遊技としての第１特図
変動表示ゲームを開始する始動権利が発生するようになっている。また、普通変動入賞装
置３６の内部には第２始動口ＳＷ３６ｄ（図３参照）が備えられ、この第２始動口ＳＷ３
６ｄによって遊技球を検出することに基づき、補助遊技としての第２特図変動表示ゲーム
を開始する始動権利が発生するようになっている。
A first
Based on the detection of the game ball by 6d, a start right to start a second special view variation display game as an auxiliary game is generated.
この第１特図変動表示ゲームを開始する始動権利は、所定の上限数（例えば４）の範囲
内で第１始動記憶（特図１始動記憶）として記憶される。そして、この第１始動記憶数は
、第１特図記憶表示器４８に表示される。また、第２特図変動表示ゲームを開始する始動
権利は、所定の上限数（例えば４）の範囲内で第２始動記憶（特図２始動記憶）として記
憶される。そして、この第２始動記憶数は、第２特図記憶表示器４９にて表示される。
The right to start the first special view variable display game is stored as a first start storage (
そして、第１特図変動表示ゲームが開始可能な状態（第１始動記憶数及び第２始動記憶
数が０の状態）で、第１始動入賞口４５に遊技球が入賞すると、始動権利の発生に伴って
抽出された乱数が第１始動記憶として記憶されて、第１始動記憶数が１加算されるととと
もに、直ちに第１始動記憶に基づいて、第１特図変動表示ゲームが開始され、この際に第
１始動記憶数が１減算される。
Then, when the gaming ball is won in the first
また、第２特図変動表示ゲームは第１特図変動表示ゲームよりも優先して実行されるた
め、第１始動記憶数が０でなくても、第２始動記憶数が０であれば、第２始動入賞口をな
す普通変動入賞装置３６に遊技球が入賞すると、始動権利の発生に伴って抽出された乱数
が第２始動記憶として記憶されて、第２始動記憶数が１加算されるととともに、実行中の
第１特図変動表示ゲームが終了後直ちに第２始動記憶に基づいて、第２特図変動表示ゲー
ムが開始され、この際に第２始動記憶数が１減算される。
Further, since the second special view variation display game is executed prior to the first special view variation display game, even if the first start storage number is not zero, if the second start storage number is zero, When the game ball wins in the normal
一方、第１特図変動表示ゲーム又は第２特図変動表示ゲームが直ちに開始できない状態
、例えば、既に第１特図変動表示ゲーム又は第２特図変動表示ゲームが行われ、その特図
変動表示ゲームが終了していない状態や、特別遊技状態となっている場合に、第１始動入
賞口４５に遊技球が入賞すると、第１始動記憶数が上限数未満（例えば、４個未満）なら
ば、第１始動記憶数が１加算されて、第１始動入賞口４５に遊技球が入賞したタイミング
で抽出された乱数が第１始動記憶として一つ記憶される。
On the other hand, the first special view variation display game or the second special view variation display game can not be started immediately, for example, the first special view variation display game or the second special view variation display game is already played, and the special view variation display game is performed. If the game ball does not end the game or is in the special game state, and the game ball is won in the first
同様に、この場合に第２始動入賞口をなす普通変動入賞装置３６に遊技球が入賞すると
、第２始動記憶数が上限数未満（例えば、４個未満）ならば、第２始動記憶数が１加算さ
れて、第２始動入賞口に遊技球が入賞したタイミングで抽出された乱数が第２始動記憶と
して一つ記憶される。
Similarly, in this case, if the game ball wins in the normal
そして、第１特図変動表示ゲーム又は第２特図変動表示ゲームが開始可能な状態となる
と、第１始動記憶又は第２始動記憶に基づき第１特図変動表示ゲーム又は第２特図変動表
示ゲームが開始される。このとき、第１特図変動表示ゲームと第２特図変動表示ゲームは
同時に実行されることはなく、第２特図変動表示ゲームが第１特図変動表示ゲームよりも
優先して実行されるようになっている。
Then, when the first special view variation display game or the second special view variation display game can be started, the first special view variation display game or the second special view variation display is based on the first start storage or the second start storage. The game is started. At this time, the first special view change display game and the second special view change display game are not simultaneously executed, and the second special view change display game is executed with priority over the first special view change display game. It is supposed to be.
すなわち、第１始動記憶と第２始動記憶がある場合には、第２特図変動表示ゲームが実
行される。
That is, when there is the first start storage and the second start storage, the second special view variation display game is executed.
補助遊技としての第１特図変動表示ゲーム、第２特図変動表示ゲームは、遊技盤１０に
設けられた第１特図表示器３８、第２特図表示器３９で実行されるようになっており、複
数の識別情報を変動表示したのち、所定の結果態様を停止表示することで行われる。また
、表示装置５３にて各特図変動表示ゲームに対応して複数種類の識別情報（例えば、数字
、記号、キャラクタ図柄など）を変動表示させる特図変動表示ゲームが実行される。そし
て、この特図変動表示ゲームの結果として、第１特図表示器３８又は第２特図表示器３９
の表示態様が特別結果態様となった場合には、大当たりとなって特別遊技状態（いわゆる
、大当たり状態）となる。また、これに対応して表示装置５３の表示態様も特別結果態様
（例えば、「７，７，７」等のゾロ目数字の何れか）となる。なお、遊技機に第１特図表
示器３８、第２特図表示器３９を備えずに、表示装置５３のみで特図変動表示ゲームを実
行するようにしてもよい。
The first special view variation display game and the second special view variation display game as auxiliary games are to be executed by the first
When the display mode of is a special result mode, it becomes a jackpot and becomes a special gaming state (a so-called jackpot state). In addition, in response to this, the display mode of the
また、本実施形態の遊技機１は、特図変動表示ゲームの結果態様に基づき、遊技状態と
して確変状態（第２確率状態）を発生可能となっている。この確変状態（第２確率状態）
は、特図変動表示ゲームでの当り結果となる確率が、通常確率状態（第１確率状態）に比
べて高い状態である。なお、第１特図変動表示ゲームと第２特図変動表示ゲームのどちら
の特図変動表示ゲームの結果態様に基づき確変状態となっても、第１特図変動表示ゲーム
及び第２特図変動表示ゲームの両方が確変状態となる。また、確変状態と上述した時短動
作状態はそれぞれ独立して発生可能であり、両方を同時に発生することも可能であるし、
一方のみを発生させることも可能である。
In addition, the
Is a state in which the probability of being a hit result in the special figure variation display game is higher than that in the normal probability state (first probability state). Note that the first special view fluctuation display game and the second special view fluctuation even if it becomes a definite change state based on the result form of the special view fluctuation display game of the first special view fluctuation display game and the second special view fluctuation display game Both display games are in a state of probability variation. Also, the probability variation state and the above-mentioned short time operation state can be generated independently of each other, and both can be generated simultaneously,
It is also possible to generate only one.
図３は、本発明の第１実施形態の遊技機１の構成を示すブロック図である。
FIG. 3 is a block diagram showing the configuration of the
遊技機１は、遊技を統括的に制御する遊技制御装置５００、各種演出を行うために表示
装置５３及びスピーカ３０等を制御する演出制御装置５５０、遊技球を払い出すために図
示しない払出モータを制御する払出制御装置５８０を備える。
The
まず、遊技制御装置５００について説明する。図４では、演出制御装置５５０について
説明する。
First, the
遊技制御装置５００は、遊技用マイコン５０１、入力Ｉ／Ｆ（Ｉｎｔｅｒｆａｃｅ）５
０５、出力Ｉ／Ｆ（Ｉｎｔｅｒｆａｃｅ）５０６、及び外部通信端子５０７を備える。
The
05, an output I / F (Interface) 506, and an
遊技用マイコン５０１は、ＣＰＵ５０２、ＲＯＭ（Ｒｅａｄ Ｏｎｌｙ Ｍｅｍｏｒｙ）
５０３及びＲＡＭ（Ｒａｎｄｏｍ Ａｃｃｅｓｓ Ｍｅｍｏｒｙ）５０４を備える。
The
503 and a random access memory (RAM) 504.
ＣＰＵ５０２は、遊技を統括的に制御する主制御装置であって、遊技制御を司る。ＲＯ
Ｍ５０３は、遊技制御のための不変の情報（プログラム、データ等）を記憶している。Ｒ
ＡＭ５０４は、遊技制御時にワークエリアとして利用される。
The CPU 502 is a main control device that controls the game in an integrated manner, and controls the game control. RO
外部通信端子５０７は、遊技制御装置５００の設定情報等を検査する検査装置等の外部
機器に遊技制御装置５００を接続する。
The
ＣＰＵ５０２は、入力Ｉ／Ｆ５０５を介して各種入力装置（第１始動口ＳＷ４５ａ、第
２始動口ＳＷ３６ｄ、一般入賞口ＳＷ４４ａ、ゲートＳＷ３４ａ、カウントＳＷ４２ｄ、
ガラス枠開放ＳＷ１８ａ、前面枠開放ＳＷ３ａ、球切れＳＷ５４、振動センサ５５、及び
磁気センサ５６）からの検出信号を受けて、大当り抽選等、種々の処理を行う。
The CPU 502 can input various input devices (a first
In response to detection signals from the glass
第１始動口ＳＷ４５ａは、第１始動入賞口４５に遊技球が入賞したことを検出するスイ
ッチである。第２始動口ＳＷ３６ｄは、普通変動入賞装置３６の第２始動入賞口に遊技球
が入賞したことを検出するスイッチである。
The first
一般入賞口ＳＷａ４４ａ〜４４ｎは、一般入賞口４４に遊技球が入賞したことを検出す
るスイッチである。ゲートＳＷ３４ａは、普図始動ゲート３４を遊技球が通過したことを
検出するスイッチである。
The general winning
カウントＳＷ４２ｄは、特別変動入賞装置４２の大入賞口に遊技球が入賞したことを検
出するスイッチである。
The
ガラス枠開放ＳＷ１８ａは、ガラス枠１８が開放されたことを検出するスイッチである
。前面枠開放ＳＷ３ａは、前面枠３が開放されたことを検出するスイッチである。
The glass
球切れＳＷ５４は、遊技機１の内部に貯留され、払い出しに用いられる遊技球の数が所
定数以下になったことを検出するスイッチである。
The out-of-
振動センサ５５は、遊技機１に与えられた振動を検出するセンサであり、遊技機１に振
動を与えて、不当に遊技球を獲得する不正を検出する。磁気センサ５６は、第１始動入賞
口４５、普通変動入賞装置３６の第２始動入賞口、一般入賞口４４、特別変動入賞装置４
２の大入賞口、及び普図始動ゲート３４付近に設けられ、磁力を検出するセンサである。
磁気センサ９３は、各入賞口付近に磁石を近づけて、遊技領域１０ａに発射された遊技球
を各入賞口に導く不正を検出する。
The
A sensor for detecting the magnetic force is provided near the winning
The magnetic sensor 93 brings a magnet close to each winning opening, and detects an injustice leading the gaming balls fired to the
また、ＣＰＵ５０２は、出力Ｉ／Ｆ５０６を介して、第１特図表示器３８、第１特図記
憶表示器４８、第２特図表示器３９、第２特図記憶表示器４９、普図表示器３５、普電Ｓ
ＯＬ３６ｂ、大入賞口ＳＯＬ４２ｂ、払出制御装置５８０、及び演出制御装置５５０に指
令信号を送信して、遊技を統括的に制御する。
In addition, the CPU 502, through the output I /
A command signal is transmitted to the
第１特図表示器３８には、第１始動入賞口４５に遊技球が入賞した場合に補助遊技とし
て実行される第１特図変動表示ゲームが表示される。第１特図記憶表示器４８には、所定
の上限数の範囲内で記憶される第１特図変動表示ゲームを開始する始動権利である第１始
動記憶数が表示される。
On the first
第２特図表示器３９には、普通変動入賞装置３６の大入賞口に遊技球が入賞した場合に
補助遊技として実行される第２特図変動表示ゲームが表示される。第２特図記憶表示器４
９には、所定の上限数の範囲内で記憶される第２特図変動表示ゲームを開始する始動権利
である第２始動記憶数が表示される。
On the second
A second start memory number, which is a start right to start a second special view variation display game stored within a predetermined upper limit number, is displayed on the 9.
普図表示器３５には、遊技球が普図始動ゲート３４を通過した場合に行われる普図変動
表示ゲームが表示される。
The
普電ＳＯＬ３６ｂは、普図表示器３５で実行される普図変動表示ゲームの停止表示が特
別の結果態様となった場合に、開閉部材３６ａ、３６ａを開放し、普通変動入賞装置３６
の第２始動入賞口を遊技球が入賞しやすい状態にする。
When the stop display of the common drawing fluctuation display game executed by the
The game ball makes it easy to win the second start winning opening of the game.
大入賞口ＳＯＬ４２ｂは、第１特図変動表示ゲーム又は第２特図変動表示ゲームの結果
が特別の結果態様となり、特別遊技状態となった場合に、特別変動入賞装置４２の開閉扉
４２ａを開放して、大入賞口を遊技球が入賞しやすい状態に変換する。
In the special winning opening SOL42b, when the result of the first special view variation display game or the second special view variation display game becomes a special result mode, and the special game state is obtained, the open /
また、遊技制御装置５００は、遊技機データを、外部情報端子５０８を介して、図示し
ない情報収集端末装置を介して、図示しない遊技場管理装置に出力する。遊技場管理装置
は、遊技場に設置された遊技機１の遊技データを収集管理する計算機である。
Further, the
また、払出制御装置５８０は、遊技球が一般入賞口４４又は大入賞口に入賞した場合に
、入賞した入賞口に対応する数の遊技球の払い出し、又は球貸ボタン２６が操作された場
合に、所定数の遊技球の払い出しを行う払出指令を遊技制御装置５００から受信した場合
に、受信した払出指令に基づいて、図示しない払出モータを制御する。なお、払出指令に
は、払い出す遊技球の数が含まれる。
Further, the
遊技制御装置５００は、変動開始コマンド、客待ちデモコマンド、ファンファーレコマ
ンド、確率情報コマンド、及びエラー指定コマンド等を、遊技の状況を示す遊技データと
して、出力Ｉ／Ｆ５０６を介して、演出制御装置５５０へ送信する。
The
図４は、本発明の第１の実施形態の演出制御装置５５０の構成を示すブロック図である
。
FIG. 4 is a block diagram showing the configuration of the
演出制御装置５５０は、遊技制御装置５００から入力される遊技データ（表示制御指令
）に基づいて、演出内容を決定して、表示装置５３、及びスピーカ３０を制御するととも
に、装飾制御装置６１０を介して装飾装置６２０、役物駆動ＳＯＬ５６０（ソレノイド）
、及び役物駆動ＭＯＴ（モータ）５６１を制御する。詳細は後述するが、これら装飾装置
６２０、役物駆動ＳＯＬ５６０、及び役物駆動ＭＯＴ５６１（総称して演出装置という）
によって、遊技の演出が行われる。また、演出制御装置５５０は、演出ボタン１７から当
該演出ボタン１７が操作されたことを示す信号が入力される。
The
, And controls the accessory drive MOT (motor) 561. Although the details will be described later, the
An effect of the game is performed. Further, the
演出制御装置５５０は、ＣＰＵ５５１、制御ＲＯＭ５５２、ＲＡＭ５５３、画像ＲＯＭ
５５４、音ＲＯＭ５５５、ＶＤＰ５５６、音ＬＳＩ５５７、入出力Ｉ／Ｆ５５８、電源投
入検出回路５５９、マスタＩＣ５７０、及びＮＯＲゲート回路５９０を備える。
The
A
ＣＰＵ５５１は、遊技制御装置５００に接続され、遊技制御装置５００から指令信号が
割込信号（ＩＮＴ）として入力され、入力された指令信号に基づいて、各種演出を制御す
る主制御装置である。また、ＣＰＵ５５１には、マスタＩＣ５７０の後述するコントロー
ラから割込信号が入力されるとともに、ＶＤＰ５５６から割込信号が入力される。
The
なお、ＣＰＵ５５１に割込信号が入力されると、ＣＰＵ５５１は、現在実行中の処理を
中断して、入力された割込信号に対応する処理を実行する。
When an interrupt signal is input to the
制御ＲＯＭ５５２には、演出制御のための不変の情報（プログラム、データ等）が格納
されている。ＲＡＭ５５３は、演出制御時にワークエリアとして利用される。
The
画像ＲＯＭ５５４には、表示装置５３に表示される画像データが格納され、画像ＲＯＭ
５５４はＶＤＰ５５６に接続されている。音ＲＯＭ５５５には、スピーカ３０から出力さ
れる音データが格納され、音ＲＯＭ５５５は音ＬＳＩ５５７に接続されている。
The image ROM 554 stores image data to be displayed on the
554 is connected to the
ＶＤＰ５５６は、表示装置５３への画像出力を制御するプロセッサである。音ＬＳＩ５
５７は、スピーカ３０からの音声出力を制御する回路である。
The
Reference numeral 57 denotes a circuit for controlling an audio output from the
なお、ＶＤＰ５５６は、表示装置５３に表示される画像を更新する周期（３３ｍｓ周期
）と同期する同期信号を発生させる同期信号発生手段を備える。同期信号発生手段は、同
期信号を発生させるごとに、発生させた同期信号をＣＰＵ５５１に割込信号として入力す
る。
The
入出力Ｉ／Ｆ５５８は、演出ボタン１７、モータ位置検出センサ５１０、及びＮＯＲゲ
ート回路５９０に接続されるインタフェースであり、演出ボタン１７からの操作信号、及
びモータ位置検出センサ５１０からのモータ位置検出信号をＣＰＵ５５１へ伝達するとと
もに、ＣＰＵ５５１からのリセット信号をＮＯＲゲート回路５９０へ伝達する。
The input / output I /
なお、演出ボタン１７は、上皿２１の上縁部に設けられ、表示装置５３で実行される第
１特図変動表示ゲーム又は第２特図変動表示ゲームにおける演出で、遊技者によって操作
される。
The
また、モータ位置検出センサ５１０は、役物駆動ＭＯＴ５６１の回転軸が初期位置まで
回転したことを検出した場合に、モータ位置検出信号を出力するセンサである。
The motor
なお、ＮＯＲゲート回路５９０は、マスタＩＣ５７０のコントローラに備わるＲＥＳＥ
Ｔ端子、及び初期化を必要とする他の回路に接続される。初期化を必要とする他の回路と
は、例えば、ＶＤＰ５５６や音ＬＳＩ５５７などである。これらは、演出制御装置５５０
に電源が投入されて起動したときに、ＣＰＵ５５１により初期化されるものである。
NOR
It is connected to the T terminal and other circuits that require initialization. The other circuits requiring initialization are, for example, the
When the power is turned on to start up, the
ＣＰＵ５５１、ＶＤＰ５５６、ＲＡＭ５５３、制御ＲＯＭ５５２、音ＬＳＩ５５７、及
び入出力Ｉ／Ｆ５５８はバス５６３を介してそれぞれ接続されている。
The
電源投入検出回路５５９は、演出制御装置５５０に電源が投入された場合に、マスタＩ
Ｃ５７０の図示しないレジスタをデフォルト状態（すべて０）に初期化するリセット信号
を発生させ、発生させたリセット信号をＮＯＲゲート回路５９０へ出力する。
The power on
A reset signal for initializing a register (not shown) of
また、ＣＰＵ５５１は、所定の条件が成立した場合に、リセット信号をバス５６３を介
して入出力Ｉ／Ｆ５５８に出力し、入出力Ｉ／Ｆ５５８は入力されたリセット信号をＮＯ
Ｒゲート回路５９０へ出力する。
Further, when a predetermined condition is satisfied, the
なお、電源投入検出回路５５９からＮＯＲゲート回路５９０へ入力されるリセット信号
、及びＣＰＵ５５１から入出力Ｉ／Ｆ５５８を介してＮＯＲゲート回路５９０へ入力され
るリセット信号は、いずれの場合にもロウレベルの状態である場合にリセットを指令する
信号として機能する。そのため、電源投入検出回路５５９及びＣＰＵ５５１の少なくとも
一方からＮＯＲゲート回路５９０にリセット信号が出力されていれば、ＮＯＲゲート回路
５９０を介してリセット信号がマスタＩＣ５７０に入力される。
The reset signal input from the power on
上述したように、ＮＯＲゲート回路５９０は、マスタＩＣ５７０及び初期化を必要とす
る他の回路に接続されるため、ＮＯＲゲート回路５９０にリセットが入力されると、マス
タＩＣ５７０及び当該ＮＯＲゲート回路５９０に接続される初期化を必要とする他の回路
が初期化される。
As described above, since the NOR
なお、初期化を必要とする他の回路がない場合には、ＮＯＲゲート回路５９０は、マス
タＩＣ５７０にのみ接続される。
If there is no other circuit requiring initialization, NOR
次に、マスタＩＣ５７０について説明する。
Next,
マスタＩＣ５７０は、制御対象となる演出装置の装飾制御装置６１０のアドレスを指定
して、指定したアドレスの装飾制御装置６１０に演出装置の制御内容を出力する。
The
マスタＩＣ５７０は、接続線Ｖｃｃ、接続線Ｖａｃｔ、接続線ＳＤＡ、接続線ＳＣＬ、
及び接続線ＧＮＤ（図５参照）の５本の接続線を介して、中継基板（装飾制御装置）６０
０に接続される。
And the relay substrate (decorative control device) 60 via five connection lines of the connection line GND (see FIG. 5).
Connected to 0.
接続線Ｖｃｃは、中継基板６００及び装飾制御装置６１０に、ロジック用の電源を供給
するための接続線である。接続線Ｖａｃｔは、演出装置を駆動させるための電源（例えば
、ＬＥＤを発光させるための電源）を供給するための接続線である。接続線ＳＤＡは、演
出制御装置５５０と装飾制御装置６１０との間でデータを通信するための接続線であり、
本実施形態におけるデータ線として機能する。接続線ＳＣＬは、接続線ＳＤＡでのデータ
通信に用いられるクロック信号を入出力するための接続線であり、本実施形態におけるタ
イミング信号線として機能する。図５に示す接続線ＧＮＤは、接続線Ｖｃｃ及び接続線Ｖ
ａｃｔで供給される電源のグランドである。
The connection line Vcc is a connection line for supplying a power supply for logic to the
It functions as a data line in the present embodiment. The connection line SCL is a connection line for inputting and outputting a clock signal used for data communication in the connection line SDA, and functions as a timing signal line in the present embodiment. Connection line GND shown in FIG. 5 is formed of connection line Vcc and connection line V.
It is the ground of the power supplied by act.
中継基板６００と装飾制御装置６１０との間は、マスタＩＣ５７０と中継基板６００と
の間と同じく、接続線Ｖｃｃ、接続線Ｖａｃｔ、接続線ＳＤＡ、接続線ＳＣＬ、及び接続
線ＧＮＤを介して接続される。
Similar to the connection between the
マスタＩＣ５７０と装飾制御装置６１０とは、接続線ＳＤＡ及び接続ＳＣＬによって２
ライン双方向通信を行う。
Perform line bi-directional communication.
マスタＩＣ５７０は、中継基板６００及び装飾制御装置６１０にデータを送信する場合
には、まず、接続線ＳＣＬの信号レベルをＨＩＧＨに維持したまま、接続線ＳＤＡの信号
レベルをＨＩＧＨからＬＯＷに変化させることにより、装飾制御装置６１０へのデータ出
力を開始するためのスタート条件を成立させる（装飾制御装置６１０に対してスタートコ
ンディションを発行する）。
When transmitting data to relay
この後、マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＬＯＷに変更し、接続線Ｓ
ＣＬの信号レベルがＬＯＷである間に接続線ＳＤＡの信号レベルを送信データの最初のビ
ットのレベルに設定し、所定時間後に接続線ＳＣＬの信号レベルをＬＯＷからＨＩＧＨに
変化させる。接続線ＳＣＬの信号レベルがＨＩＧＨに変化すると、装飾制御装置６１０は
接続線ＳＤＡの信号レベルを取り込んで、送信データの最初のビットとして認識する。次
いで、マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＨＩＧＨからＬＯＷに戻す。
After this,
While the signal level of CL is LOW, the signal level of the connection line SDA is set to the level of the first bit of the transmission data, and after a predetermined time, the signal level of the connection line SCL changes from LOW to HIGH. When the signal level of the connection line SCL changes to HIGH, the
この手順を１回実行すると、マスタＩＣ５７０から装飾制御装置６１０へ１ビットのデ
ータが送信され、最終的にはこの手順が８回繰り返されることで、送信データの単位ビッ
トである８ビット全てがマスタＩＣ５７０から装飾制御装置６１０へ送信される（１バイ
ト分のデータが送信される）。
When this procedure is executed once, one bit of data is transmitted from the
そして、マスタＩＣ５７０は、最後の８ビット目のデータを送信し終えて、接続線ＳＣ
Ｌの信号レベルをＨＩＧＨからＬＯＷに戻した際に、接続線ＳＤＡを解放して装飾制御装
置６１０からの返答信号を受信することを待機する受信待機状態にする。
Then,
When the signal level of L is returned from HIGH to LOW, the connection line SDA is released to be in a reception standby state to wait to receive a response signal from the
受信待機状態になると、装飾制御装置６１０は、接続線ＳＤＡを介して１ビットの返答
信号（後述するＡＣＫ又はＮＡＣＫ）をマスタＩＣ５７０に返す。次いで、マスタＩＣ５
７０は、接続線ＳＣＬの信号レベルをＬＯＷからＨＩＧＨに変化させて返答信号のレベル
を取り込み、所定時間後に接続線ＳＣＬの信号レベルをＨＩＧＨからＬＯＷに変化させる
と、装飾制御装置６１０は接続線ＳＤＡを解放する。
When in the reception standby state, the
70 changes the signal level of the connection line SCL from LOW to HIGH to capture the level of the response signal, and changes the signal level of the connection line SCL from HIGH to LOW after a predetermined time, the
マスタＩＣ５７０は、このような１バイト分のデータ送信と１ビット分の返答信号の受
信とを交互に繰り返し、装飾制御装置６１０へ出力すべきデータがすべて出力されるまで
継続する。マスタＩＣ５７０は、出力すべきデータの出力が終了した場合には、接続線Ｓ
ＣＬの信号レベルをＨＩＧＨに維持したまま、接続線ＳＤＡの信号レベルをＬＯＷからＨ
ＩＧＨに変更させることにより、装飾制御装置６１０へのデータ出力を終了するためのス
トップ条件を成立させる（装飾制御装置６１０に対してストップコンディションを発行す
る）。
The signal level of the connection line SDA is changed from LOW to H while keeping the signal level of CL HIGH.
By changing to IGH, a stop condition for ending data output to the
入力用ＢＵＦ５７１は、装飾制御装置６１０から接続線ＳＤＡを介して入力されたデー
タが一時的に記憶される記憶装置である。
The
具体的には、マスタＩＣ５７０が入力モードに設定された場合において、装飾制御装置
６１０からマスタＩＣ５７０に送信されたデータが、フィルタ５７５Ａによりノイズが除
去されて入力用ＢＵＦ５７１に一時的に記憶される。
Specifically, when the
出力用ＢＵＦ５７２は、装飾制御装置６１０に接続線ＳＤＡを介して出力するデータが
一時的に記憶される。
The
リセットＲＥＧ５７３は、本実施形態の初期化指示データ記憶領域として機能するもの
で、バス５６３に接続され、ＣＰＵ５５１からの指令を受けてリセット信号をコントロー
ラに出力する。コントローラは、マスタＩＣ５７０を統括的に制御し、各種処理を実行す
る。
The
送信モードＲＥＧ５７４は、Ｉ2ＣＩ／Ｏエクスパンダ６１５へデータを送信するモー
ドを、バイトモード又はバッファモードにするかを選択するためのレジスタである。
The
バイトモードは、マスタＩＣ５７０が、Ｉ2ＣＩ／Ｏエクスパンダ６１５へデータを１
バイト送信する毎に、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＡＣＫ又はＮＡＣＫを受信し
、ＡＣＫ及びＮＡＣＫの何れを受信した場合でも、マスタＩＣ５７０からＣＰＵ５５１に
割込信号を出力するモードである。
In byte mode, the
In this mode, an ACK or NACK is received from the I 2 CI /
バッファモードは、マスタＩＣ５７０が、出力用ＢＵＦ５７２に格納された複数バイト
のデータを、Ｉ2ＣＩ／Ｏエクスパンダ６１５へ１バイト毎送信し、その送信の都度、Ｉ2
ＣＩ／Ｏエクスパンダ６１５からＡＣＫ又はＮＡＣＫを受信するととともに、ＮＡＣＫを
受信した場合には、その時点で、割込信号をＣＰＵ５５１に出力するモードである。
In the buffer mode, the
In addition to receiving an ACK or NACK from the CI /
但し、バッファモードでは、ＡＣＫを受信した場合には、出力用ＢＵＦ５７２に格納さ
れたすべてのデータが送信完了となった場合にのみ、割込信号をＣＰＵ５５１に出力し、
マスタＩＣ５７０は、出力用ＢＵＦ５７２に未送信のデータが残っている状態でＩ2ＣＩ
／Ｏエクスパンダ６１５からＡＣＫを受信したときには、割込信号をＣＰＵ５５１に出力
せずに、出力用ＢＵＦ５７２から次の送信すべきデータを取り出して、Ｉ2ＣＩ／Ｏエク
スパンダ６１５へ出力する制御が繰り返される。
However, in the buffer mode, when ACK is received, an interrupt signal is output to the
When an ACK is received from the /
なお、バイトモードは、マスタＩＣ５７０が、後述する初期化指示データ及び可動制御
データをＩ2ＣＩ／Ｏエクスパンダ６１５へ出力する場合に用いられる。バッファモード
は、マスタＩＣ５７０が、後述する発光制御データをＩ2ＣＩ／Ｏエクスパンダ６１５へ
出力する場合に用いられる。
The byte mode is used when the
ステータスＲＥＧ５７９は、マスタＩＣ５７０がＩ2ＣＩ／Ｏエクスパンダ６１５から
受信した返答信号が、ＡＣＫであったのかＮＡＣＫであったのかを識別するレジスタであ
る。マスタＩＣ５７０は、ＣＰＵ５５１に割込信号を出力する際に、Ｉ2ＣＩ／Ｏエクス
パンダ６１５から受信した返答信号に対応して、ステータスＲＥＧ５７９の値を設定する
。
The
フィルタ５７５Ａは、接続線ＳＤＡから入力されたデータのノイズを除去する。ドライ
バ５７６Ａは、接続線ＳＤＡからデータを出力する場合に、トランジスタ５７８Ａが動作
可能な電圧をトランジスタ５７８Ａに印加する。
The
図９に示すように接続線ＳＤＡには、プルアップ抵抗Ｒによって所定の電圧が印加され
て、接続線ＳＤＡはフィルタ５７５Ａ及びトランジスタ５７８Ａに接続されている。
As shown in FIG. 9, a predetermined voltage is applied to the connection line SDA by the pull-up resistor R, and the connection line SDA is connected to the
トランジスタ５７８Ａは、電力消費を抑えるために電界効果トランジスタ（ＦＥＴ）が
用いられており、トランジスタ５７８Ａのゲートはドライバ５７６Ａに接続され、ドレイ
ンはプルアップ抵抗Ｒにより所定の電圧が印加された接続線ＳＤＡに接続され、ソースは
接地されている。
トランジスタ５７８Ａのゲートに印加される電圧がトランジスタ５７８Ａを動作させる
所定値よりも小さければ、ドレインとソースとの間に電流が流れないので、接続線ＳＤＡ
に印加された電圧は降下せず、その結果、接続線ＳＤＡはＨＩＧＨレベルとなる。一方、
トランジスタ５７８Ａのゲートに印加される電圧がトランジスタ５７８Ａを動作させる所
定値以上であれば、所定値の電圧が印加されたドレインから接地されているソースへ電流
が流れることによって、接続線ＳＤＡの電圧が低下し、その結果、接続線ＳＤＡはＬＯＷ
レベルとなる。
If the voltage applied to the gate of
The applied voltage does not drop, and as a result, the connection line SDA goes high. on the other hand,
If the voltage applied to the gate of the
It becomes a level.
なお、トランジスタ５７８Ａは、１０ミリアンペア程度の電流をドレインからソースへ
流しても破損しない仕様のものを用いている。このため、接続線ＳＤＡには、通常のＩ2
Ｃバス使用で用いられる電流値よりもはるかに大きい１０ミリアンペア程度の電流を流す
ことが可能であり、演出制御装置５５０と装飾制御装置６１０との間のデータ送信が、ノ
イズによる障害に耐えうる構成となっている。
Note that the
A current of about 10 milliamperes which is much larger than the current value used in the C bus use can be supplied, and data transmission between the
ドライバ５７６Ａは、データを接続線ＳＤＡから出力する場合に、トランジスタ５７８
Ａにドレインとソースとの間に電流を流すためにトランジスタ５７８Ａのゲートにトラン
ジスタ５７８Ａが動作可能な値の電圧を印加する。そして、ドライバ５７６Ａは、接続線
ＳＤＡの電圧を、ＨＩＧＨレベル又はＬＯＷレベルに設定することによって、データを接
続線ＳＤＡから出力する。
When
In order to cause current to flow between the drain and the source in A, a voltage of an operable value is applied to the gate of the
また、フィルタ５７５Ｂは、接続線ＳＣＬから入力されたデータのノイズを除去する。
ドライバ５７６Ｂは、接続線ＳＣＬからデータを出力する場合に、トランジスタ５７８Ｂ
が動作可能な電圧をトランジスタ５７８Ｂに印加する。
In addition, the
When
Apply an operable voltage to the
図９に示すように接続線ＳＣＬは、プルアップ抵抗Ｒによって所定の電圧が印加されて
、接続線ＳＤＡはフィルタ５７５Ｂ及びトランジスタ５７８Ｂに接続されている。
As shown in FIG. 9, a predetermined voltage is applied to the connection line SCL by the pull-up resistor R, and the connection line SDA is connected to the
トランジスタ５７８Ｂは、電力消費を抑えるために電界効果トランジスタ（ＦＥＴ）が
用いられており、トランジスタ５７８Ｂのゲートはドライバ５７６Ｂに接続され、ドレイ
ンはプルアップ抵抗Ｒにより所定の電圧が印加された接続線ＳＣＬに接続され、ソースは
接地されている。
The
トランジスタ５７８Ｂのゲートに印加される電圧がトランジスタ５７８Ｂを動作させる
所定値よりも小さければ、ドレインとソースとの間に電流が流れないので、接続線ＳＣＬ
に印加された電圧は降下せず、その結果、接続線ＳＣＬはＨＩＧＨレベルとなる。一方、
トランジスタ５７８Ｂのゲートに印加される電圧がトランジスタ５７８Ｂを動作させる所
定値以上であれば、所定値の電圧が印加されたドレインから接地されているソースへ電流
が流れることによって、接続線ＳＣＬの電圧が低下し、その結果、接続線ＳＣＬはＬＯＷ
レベルとなる。
If the voltage applied to the gate of
The applied voltage does not drop, as a result, the connection line SCL goes high. on the other hand,
If the voltage applied to the gate of the
It becomes a level.
なお、トランジスタ５７８Ｂは、１０ミリアンペア程度の電流をドレインからソースへ
流しても破損しない仕様のものを用いている。そのため、接続線ＳＣＬには、通常のＩ2
Ｃバス使用で用いられる電流値よりもはるかに大きい１０ミリアンペア程度の電流を流す
ことが可能であり、演出制御装置５５０と装飾制御装置６１０との間のデータ送信が、ノ
イズによる障害に耐えうる構成となっている。
Note that the
A current of about 10 milliamperes which is much larger than the current value used in the C bus use can be supplied, and data transmission between the
ドライバ５７６Ｂは、クロック信号を接続線ＳＣＬから出力する場合に、トランジスタ
５７８Ｂにドレインとソースとの間に電流を流すためにトランジスタ５７８Ｂのゲートに
トランジスタ５７８Ｂが動作可能な値の電圧を印加する。そして、ドライバ５７６Ｂは、
接続線ＳＣＬの電圧を、ＨＩＧＨレベルとＬＯＷレベルとに繰り返し変化させることによ
って、クロック信号を接続線ＳＣＬから出力する。
When the
A clock signal is output from the connection line SCL by repeatedly changing the voltage of the connection line SCL between the high level and the low level.
電源投入リセット回路５７７は、マスタＩＣ５７０に電源が投入されて、電源投入リセ
ット回路５７７内の電圧が所定値に達した場合に、入力用ＢＵＦ５７１及び出力用ＢＵＦ
５７２などの記憶領域をデフォルト状態にするためのリセット信号をコントローラに出力
する。
When the
A reset signal for setting a storage area such as 572 to a default state is output to the controller.
次に、中継基板６００及び装飾制御装置６１０について説明する。
Next, the
なお、中継基板６００は、装飾制御装置６１０のうちマスタＩＣ５７０に直接接続され
る、つまり最も上流側に位置するものである。
The
装飾装置６２０は、装飾制御装置６１０に設けたＩ2ＣＩ／Ｏエクスパンダ６１５（図
６で後述）によって制御され、電流を流すことによって光が点滅して演出を行う発光装置
であり、例えばＬＥＤなどで構成される。役物駆動ソレノイド（ＳＯＬ）５６０は、電流
が流れると往復動作する装置であり、遊技盤１０に配置される図示しない装飾のための役
物を可動させて演出を行う。役物駆動モータ（ＭＯＴ）５６１は、電流が流れると回転動
作する装置であり、可動役物６０を可動させて演出を行う。役物駆動ソレノイド（ＳＯＬ
）５６０及び役物駆動モータ（ＭＯＴ）５６１も、装飾制御装置６１０に設けたＩ2ＣＩ
／Ｏエクスパンダ６１５によって制御される。
The
) 560 and the character drive motor (MOT) 561 are also provided in the
/
なお、役物駆動ＳＯＬ５６０が可動役物６０を可動させてもよいし、役物駆動ＭＯＴ５
６１が図示しない役物を可動させてもよい。
In addition, the
61 may move an unillustrated accessory.
演出制御装置５５０と中継基板６００との接続方法、及び中継基板６００と中継基板６
００以外の装飾制御装置６１０との接続方法は、図５で詳細を説明する。装飾制御装置６
１０は、図６〜図１０で詳細を説明する。
A method of connecting the
The connection method with the
10 will be described in detail with reference to FIGS.
図５は、本発明の第１の実施形態の装飾制御装置６１０Ａ〜６１０Ｆの接続の説明図で
ある。なお、説明の都合上、装飾制御装置６１０として、１個の中継基板６００と、６個
の装飾制御装置６１０Ａ〜６１０Ｆを図示しているが、実際には、遊技機の仕様に対応し
て必要な数の装飾制御装置６１０が接続されている。
FIG. 5 is an explanatory diagram of connection of the
演出制御装置５５０は、接続線Ｖｃｃ、接続線Ｖａｃｔ、接続線ＳＤＡ、接続線ＳＣＬ
、及び接続線ＧＮＤ（以下、この５本の接続線を一つのハーネスという）を介して演出制
御装置５５０と接続される。
The
And the connection line GND (hereinafter, these five connection lines are referred to as one harness) and are connected to the
中継基板６００には、二つの装飾制御装置６１０Ａ及び６１０Ｄがそれぞれハーネスに
よって並列に接続される。
Two
装飾制御装置６１０Ａにはハーネスを介して装飾制御装置６１０Ｂが接続され、装飾制
御装置６１０Ｂにはハーネスを介して装飾制御装置６１０Ｃが接続される。
A
一方、装飾制御装置６１０Ｄにはハーネスを介して装飾制御装置６１０Ｅが接続され、
装飾制御装置６１０Ｅにはハーネスを介して装飾制御装置６１０Ｆが接続される。
On the other hand, the
A
各装飾制御装置６１０は、ハーネスを自身に接続するための取付口となるコネクタを備
える。このコネクタは各装飾制御装置６１０で共通であるので、接続線を接続順の誤配線
を防止できる。
Each
ここで、装飾制御装置６１０に設けたＩ2ＣＩ／Ｏエクスパンダ６１５（図６で後述）
が装飾装置６２０を制御する方法について説明する。
Here, the I 2 CI / O expander 615 (described later in FIG. 6) provided in the
The method of controlling the
演出制御装置５５０は、遊技制御装置５００から入力された遊技データに基づいて、演
出装置の出力態様を決定する。そして、演出制御装置５５０は、決定された出力態様とな
るように、制御対象となる装飾制御装置６１０の個別アドレス（Ｉ2ＣＩ／Ｏエクスパン
ダ６１５の個別アドレス）を含む演出制御データ（演出制御情報）を中継基板６００に出
力する。このとき、演出制御データは、中継基板６００を介して演出制御装置５５０に接
続されるすべての装飾制御装置６１０に対して接続線ＳＤＡから出力される。このため、
マスタＩＣ５７０は、マスタＩＣ５７０に接続されるすべての装飾制御装置６１０を制御
可能である。
Based on the game data input from
The
なお、本実施形態では演出装置としてＬＥＤ等の発光装置を例示しているので、ＬＥＤ
の発光態様が演出装置の出力態様に相当する。この場合、演出制御データによって、ＬＥ
Ｄの点灯／点滅／消灯が指示され、同時に、ＬＥＤの点滅周期や点灯輝度も指示される。
In the present embodiment, a light emitting device such as an LED is illustrated as a rendering device, so the LED
The light emission aspect of corresponds to the output aspect of the effect device. In this case, the effect control data causes LE to
The lighting / blinking / lighting out of D is instructed, and at the same time, the blinking cycle of the LED and the lighting luminance are also instructed.
各装飾制御装置６１０には、一意な個別アドレスが予め設定されているので、演出制御
データが入力されると、入力された演出制御データに含まれるアドレスと設定されている
個別アドレスとが一致するか否かを判定する。そして、入力された演出制御データに含ま
れるアドレスと設定されている個別アドレスとが一致すると判定された場合には、装飾制
御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５は、演出制御データを取り込んで、対応
する装飾装置６２０の出力態様を制御するとともに、８ビット目のデータが入力された直
後に返答信号をマスタＩＣ５７０に出力する。
Since unique individual addresses are set in advance in each
なお、各装飾制御装置６１０には、個別アドレス以外にも、装飾制御装置６１０のＩ2
ＣＩ／Ｏエクスパンダ６１５を初期化するためのリセット用アドレスが設定されている。
このリセットアドレスは、すべてのＩ2ＣＩ／Ｏエクスパンダ６１５に対して共通に設け
られたアドレスであり、個別アドレスとして使用することは不可能となっている。また、
このリセットアドレスの値を変更することもできないようになっている（詳細は後述する
）。
In addition, in each
A reset address for initializing the CI /
This reset address is an address commonly provided to all the I 2 CI /
The value of this reset address can not be changed (the details will be described later).
演出制御装置５５０は、装飾制御装置６１０（正確には、装飾制御装置６１０のＩ2Ｃ
Ｉ／Ｏエクスパンダ６１５）を初期化する場合に、このリセット用の共通アドレスを含ん
だ初期化指示データを、中継基板６００に出力する。このとき、初期化指示データ演出制
御データは、中継基板６００を介して、演出制御装置５５０に接続されるすべての装飾制
御装置６１０に対して接続線ＳＤＡから出力される。
The
When the I / O expander 615) is initialized, initialization instruction data including the common address for this reset is output to the
各装飾制御装置６１０には、リセット用の共通アドレスが予め設定されているので、入
力されたデータに含まれるアドレスと、予め設定されているリセット用の共通アドレスと
が一致するか否かを判定する。入力されたデータに含まれるアドレスと、予め設定されて
いるリセット用の共通アドレスとが一致すると判定された場合には、装飾制御装置６１０
のＩ2ＣＩ／Ｏエクスパンダ６１５は、返答信号をマスタＩＣ５７０に出力するとともに
、入力されたデータを初期化指示データとして取り込み、Ｉ2ＣＩ／Ｏエクスパンダ６１
５自身を初期化する。
Since a reset common address is preset in each
The I 2 CI /
5 Initialize itself.
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５が初期化されると、当該初期化されたＩ2ＣＩ／
Ｏエクスパンダ６１５によって制御される演出装置はオフ状態となる。
Incidentally, the I 2 CI /
The rendering device controlled by the
このように、装飾制御装置６１０は、演出制御装置５５０からの指令に基づく制御を行
うので、演出制御装置５５０と装飾制御装置６１０との関係は、演出制御装置５５０のマ
スタＩＣ５７０がマスタであり、装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５
がスレーブである。
Thus, since the
Is the slave.
図５では、装飾制御装置６１０の制御対象が装飾装置６２０である場合について説明し
たが、装飾制御装置６１０の制御対象が役物駆動ＳＯＬ５６０や役物駆動ＭＯＴ５６１で
あってもよい。この場合、演出装置がモータやソレノイドなどの駆動源となることから、
これらの駆動源の動作態様が、演出装置の出力態様に相当することになる。この場合、演
出制御データによって、駆動源の作動／停止が指示され、同時に動作速度も指示される。
Although FIG. 5 describes the case where the control target of the
The operation mode of these drive sources corresponds to the output mode of the rendering device. In this case, the effect control data instructs the operation / stop of the drive source and at the same time the operation speed.
図６は、本発明の第１の実施形態の装飾制御装置６１０のブロック図である。
FIG. 6 is a block diagram of the
図６では、装飾制御装置６１０の内部に装飾装置６２０であるＬＥＤを備える装飾制御
装置６１０（図６の下側の装飾制御装置６１０）と、外部の装飾装置６２０に接続される
装飾制御装置６１０（図６の中央の装飾制御装置６１０）と、について説明する。
In FIG. 6, the decoration control device 610 (the
まず、装飾制御装置６１０の内部にＬＥＤを備える装飾制御装置６１０について説明す
る。
First, the
図６の下側の装飾制御装置６１０は、Ｉ2ＣＩ／Ｏエクスパンダ６１５及びＬＥＤ（装
飾装置２０）を備える。接続線ＳＤＡ及び接続線ＳＣＬは、装飾制御装置６１０内で二つ
に分岐し、一方は、そのまま次の装飾制御装置６１０に出力される。他方は、Ｉ2ＣＩ／
Ｏエクスパンダ６１５に接続される。
The
また、Ｉ2ＣＩ／Ｏエクスパンダ６１５の出力側には、制御対象となる装飾装置６２０
が接続される。Ｉ2ＣＩ／Ｏエクスパンダ６１５の出力側は、図７で説明するポート０〜
１５によって構成される。さらに、装飾制御装置６１０のすべてのポートが、図８Ａで後
述する電流制限抵抗Ｒ０〜Ｒ１５を介して、内部のＬＥＤに接続されている。なお、この
電流制限抵抗Ｒ０〜Ｒ１５も、装飾制御装置６１０に備えられている。
In addition, on the output side of the I 2 CI /
Is connected. The output side of the I 2 CI /
It is comprised by 15. Furthermore, all ports of the
前述したように、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、演出制御装置５５０から入力さ
れた演出制御データに含まれるアドレスと、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５に設定
されている個別アドレスとが一致する場合にのみ、演出制御データに含まれる装飾データ
に基づいて、Ｉ2ＣＩ／Ｏエクスパンダ６１５に接続されている装飾装置６２０を制御す
る。
As described above, the I 2 CI /
なお、図中の電源Ｖｌｅｄは、図５で前述した接続線Ｖａｃｔにより供給される電源（
ＬＥＤを発光させるための電源）に相当するものである。
Note that the power supply Vled in the figure is a power supply supplied by the connection line Vact described above with reference to FIG.
It corresponds to the power supply for making LED light-emit).
次に、外部の装飾装置６２０に接続される装飾制御装置６１０について説明する。
Next, the
図６の中央の装飾制御装置６１０は、Ｉ2ＣＩ／Ｏエクスパンダ６１５及びＬＥＤ（装
飾装置２０）を備え、装飾制御装置６１０の外部に接続される装飾装置基板６２５に備わ
るＬＥＤに電流を流すための接続線、装飾装置基板６２５のＬＥＤに電源電圧Ｖｌｅｄを
供給する接続線、及び、グランドに接地する接続線を介して、装飾制御装置６１０と装飾
装置基板６２５とが接続される。
The
装飾装置基板６２５は、Ｉ2ＣＩ／Ｏエクスパンダ６１５を備えておらず、ＬＥＤのみ
を備えた基板である。この場合、装飾装置基板６２５に備えたＬＥＤに接続される電流制
限抵抗（図８Ａ）を、装飾装置基板６２５に設けることになるが、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５が備えられた装飾制御装置６１０に設けてもよい。
The
なお、装飾装置基板６２５に設けたＬＥＤの数に対応して、装飾制御装置６１０から装
飾装置基板６２５へ渡されることになる、これらのＬＥＤに電流を流すための接続線の数
が決定される。例えば、装飾装置基板６２５に二つのＬＥＤを備えた場合には、Ｉ2ＣＩ
／Ｏエクスパンダ６１５のポートと対応するＬＥＤとを接続するための２本の制御線と、
Ｖｌｅｄを供給する電源線が１本とが、少なくとも必要となる。
It should be noted that the number of connection lines for causing current to flow to the
Two control lines for connecting the port of the /
At least one power supply line for supplying Vled is required.
そして、中央の装飾制御装置６１０に設けられたＩ2ＣＩ／Ｏエクスパンダ６１５も、
演出制御装置５５０から入力された演出制御データに含まれるアドレスと、当該Ｉ2ＣＩ
／Ｏエクスパンダ６１５に設定されている個別アドレスとが一致する場合にのみ、演出制
御データに含まれる装飾データに基づいて、Ｉ2ＣＩ／Ｏエクスパンダ６１５に接続され
ている装飾装置６２０を制御する。この場合、中央の装飾制御装置６１０に設けられた装
飾装置６２０と、装飾装置基板６２５に設けられた装飾装置６２０の両方が、Ｉ2ＣＩ／
Ｏエクスパンダ６１５によって制御される。
And, the I 2 CI /
An address included in the effect control data input from the
Controls the
It is controlled by
このように、装飾装置基板６２５を設けて、装飾制御装置６１０から一部の装飾装置（
ＬＥＤ）を分離させることで、離れた箇所に配置されたＬＥＤであっても、共通のＩ2Ｃ
Ｉ／Ｏエクスパンダ６１５により制御することができる。
Thus, the
Even if the LEDs are placed at a distant place by separating the LEDs), the common I 2 C
It can be controlled by the I /
なお、装飾制御装置６１０は、装飾装置６２０の代わりに、役物駆動ＳＯＬ５６０や役
物駆動ＭＯＴ５６１を接続し、これらを制御してもよいが、詳細は、図８Ｂで後述する。
Note that the
図７は、本発明の第１の実施形態のＩ2ＣＩ／Ｏエクスパンダ６１５のブロック図であ
る。
FIG. 7 is a block diagram of the I 2 CI /
Ｉ2ＣＩ／Ｏエクスパンダ６１５は、接続線ＳＤＡに接続されるトランジスタ６３０、
接続線ＳＤＡに接続されるフィルタ６３１、接続線ＳＤＡに接続されるドライバ６３２、
接続線ＳＣＬに接続されるフィルタ６３３、バスコントローラ６３４、出力設定レジスタ
６３５、出力コントローラ６３６、Ｉ2ＣＩ／Ｏエクスパンダ６１５の出力側の各ポート
０〜１５に接続されるドライバ６３７、各ポート０〜１５に接続されるトランジスタ６３
８Ａ〜６３８Ｐ、及びリセット信号発生回路６３９を備える。
The I 2 CI /
A
8A to 638P and a reset
フィルタ６３１は、接続線ＳＤＡに接続され、接続線ＳＤＡから入力されたデータのノ
イズを除去し、ノイズが除去されたデータをバスコントローラ６３４に出力する。ドライ
バ６３２は、返答信号を接続線ＳＤＡから出力する場合に、トランジスタ６３０が動作可
能な電圧をトランジスタ６３０に印加する。
The
ドライバ６３２は、接続線ＳＤＡからデータ（返答信号）を出力する場合に、トランジ
スタ６３０が動作可能な電圧をトランジスタ６３０に印加する。
When the
トランジスタ６３０は、電力消費を抑えるために電界効果トランジスタ（ＦＥＴ）が用
いられており、トランジスタ６３０のゲートはドライバ６３２に接続され、ドレインはプ
ルアップ抵抗Ｒ（図４参照）により所定の電圧が印加された接続線ＳＤＡに接続され、ソ
ースは接地されている。
The
トランジスタ６３０のゲートに印加される電圧がトランジスタ６３０を動作させる所定
値よりも小さければ、ドレインとソースとの間に電流が流れない。一方、トランジスタ６
３０のゲートに印加される電圧がトランジスタ６３０を動作させる所定値以上であれば、
所定値の電圧が印加されたドレインから接地されているソースへ電流が流れることによっ
て、接続線ＳＤＡの電圧が低下する。なお、トランジスタ６３０は、１０ミリアンペア程
度の電流をドレインからソースへ流しても破損しない仕様のものを用いている。
If the voltage applied to the gate of the
If the voltage applied to the gate of 30 is equal to or greater than the predetermined value for operating the
When a current flows from the drain to which the voltage of a predetermined value is applied to the source grounded, the voltage of the connection line SDA decreases. Note that the
ドライバ６３２は、データ（返答信号）を接続線ＳＤＡから出力する場合に、トランジ
スタ６３０にドレインとソースとの間に電流を流すためにトランジスタ６３０のゲートに
トランジスタ６３０が動作可能な値の電圧を印加する。そして、ドライバ６３２は、接続
線ＳＤＡの電圧をＨＩＧＨからＬＯＷへ繰り返し変化させることによって、データを接続
線ＳＤＡから出力する。
The
フィルタ６３３は、接続線ＳＣＬに接続され、接続線ＳＣＬから入力されたデータのノ
イズを除去し、ノイズが除去されたデータをバスコントローラ６３４に出力する。
The
また、Ｉ2ＣＩ／Ｏエクスパンダ６１５には、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５に備
わるアドレス設定用端子Ａ０〜Ａ３によって固有のアドレスが設定されており、バスコン
トローラ６３４に入力されている。さらに、Ｉ2ＣＩ／Ｏエクスパンダ６１５をリセット
するためのアドレスも、予め設定されている。
In addition, the I 2 CI /
バスコントローラ６３４は、接続線ＳＤＡから入力されたデータのアドレスがＩ2ＣＩ
／Ｏエクスパンダ６１５に設定された固有のアドレスと一致するか否かを判定し、一致し
ている場合に当該データを演出制御データとして取り込む。
The
It is determined whether or not the address matches the unique address set in the /
また、バスコントローラ６３４は、接続線ＳＤＡから入力されたデータのアドレスがＩ
2ＣＩ／Ｏエクスパンダ６１５に予め設定されたリセット用のアドレスと一致するか否か
を判定し、入力されたデータのアドレスとＩ2ＣＩ／Ｏエクスパンダ６１５に予め設定さ
れたリセット用のアドレスとが一致している場合に当該データを初期化指示データとして
取り込み、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５を初期化する。
Also, the
2 It is determined whether or not the address matches with the address for resetting preset in the CI /
また、バスコントローラ６３４は、ＳＣＬ接続線の信号レベルのＬＯＷからＨＩＧＨへ
の変化回数が８回に達し８ビット目のデータを取り込んだ後、ＳＣＬ接続線の信号レベル
がＨＩＧＨからＬＯＷへ変化すると、返答信号を接続線ＳＤＡからマスタＩＣ５７０に出
力する。さらに、ＳＣＬ接続線の信号レベルがＬＯＷからＨＩＧＨへ変化することが確認
され、再度ＳＣＬ接続線の信号レベルがＨＩＧＨからＬＯＷへ変化すると、接続線ＳＤＡ
を開放する。つまり、ＳＣＬ接続線の信号レベルのＬＯＷからＨＩＧＨへの変化回数が９
回になるタイミングで返答信号を出力する。
In addition, when the signal level of the SCL connection line changes from HIGH to LOW after the
Open In other words, the number of times the signal level of the SCL connection line changes from LOW to HIGH is 9
Outputs a response signal at the same timing.
出力設定レジスタ６３５には、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５の動作モードやポ
ート０〜１５の出力状態が設定される。バスコントローラ６３４が接続線ＳＤＡから初期
化指示データを取り込んで、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５が初期化された場合に
は、出力設定レジスタ６３５は、すべてのポート０〜１５に電流が流れないように初期状
態に設定される。
In the
出力コントローラ６３６は、出力設定レジスタ６３５に設定されたデータに基づいて、
ポートドライバ６３７を介して、各ポート０〜１５に接続された演出装置に電流を流すこ
とによって、演出装置の出力状態を実際に制御する。この出力状態は、バスコントローラ
６３４が接続線ＳＤＡから演出制御データを取り込むと、取り込んだ演出制御データに指
定されている内容に更新される。
By supplying current to the rendering devices connected to the
ドライバ６３７は、ポートに電流を流す場合に、電流を流すポートに接続されるトラン
ジスタ６３８Ａ〜６３８Ｐが動作可能な電圧を当該トランジスタに印加する。
The
トランジスタ６３８Ａ〜６３８Ｐのゲートはドライバ６３７に接続され、ドレインは図
８Ａ及び図８Ｂに示すように演出装置を動作させるための電圧が印加された接続線に接続
するポート端子に接続され、ソースは接地されている。
The gates of the
トランジスタ６３８Ａ〜６３８Ｐのゲートに印加される電圧がトランジスタ６３８Ａ〜
６３８Ｐを動作させる所定値よりも小さければ、ドレインとソースとの間に電流が流れな
い。一方、６３８Ａ〜６３８Ｐのゲートに印加される電圧がトランジスタ６３８を動作さ
せる所定値以上であれば、図８Ａに示す電源Ｖｌｅｄ、又は図８Ｂに示す電源Ｖｍｏｔや
電源Ｖｓｏｌからゲートに印加されている所定の電圧が、トランジスタ６３８のドレイン
を介して接地されているソースへ電流が流れることによって、ポート端子に接続された演
出装置の出力状態を制御できる。
The voltage applied to the gates of the
If it is smaller than the predetermined value for operating 638P, no current flows between the drain and the source. On the other hand, if the voltage applied to the gates of 638A to 638P is equal to or higher than the predetermined value for operating the transistor 638, the predetermined voltage applied to the gate from the power supply Vled shown in FIG. 8A or the power supply Vmot shown in FIG. When the voltage of the current flows through the drain of the transistor 638 to the grounded source, the output state of the rendering device connected to the port terminal can be controlled.
また、装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５は、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５のポート端子に接続された全ての演出装置を同時期に制御することが可能であ
るので、Ｉ2ＣＩ／Ｏエクスパンダ６１５のポート端子に接続された一つの演出装置を一
つのグループとして制御することができる。
In addition, since the I 2 CI /
そして、各装飾制御装置６１０に備わるＩ2ＣＩ／Ｏエクスパンダ６１５同士は、互い
に異なる個別アドレスが割り当てられているので、演出装置が複数のグループに分割され
た形態となっている。即ち、各装飾制御装置６１０に備わるＩ2ＣＩ／Ｏエクスパンダ６
１５は、演出装置をグループ単位で制御可能なグループ単位制御手段として構成されてい
るものである。
And since I 2 CI /
従って、装飾制御装置６１０を統括する演出制御装置５５０は、グループ単位制御手段
を統括して制御するグループ統括制御手段として機能している。
Therefore, the
リセット信号発生回路６３９には、Ｉ2ＣＩ／Ｏエクスパンダ６１５に電源を供給する
接続線Ｖｃｃと接続されるＶｃｃ端子、及び外部からのリセット信号を受け付けるＲＥＳ
ＥＴ端子が接続されている。
The reset
ET terminal is connected.
リセット信号発生回路６３９は、Ｉ2ＣＩ／Ｏエクスパンダ６１５に電源が投入され、
電圧が所定値まで立ち上がった場合、リセット信号を発生させ、発生させたリセット信号
をバスコントローラ６３４、出力設定レジスタ６３５、及び出力コントローラ６３６に入
力する。
The reset
When the voltage rises to a predetermined value, a reset signal is generated, and the generated reset signal is input to the
なお、外部からＬＯＷレベルのリセット信号が入力された場合には、リセット信号発生
回路６３９はリセット信号を出力するので、演出制御装置５５０のＣＰＵ５５１から、Ｎ
ＯＲゲート回路５９０を経由して、ＲＥＳＥＴ端子からリセット信号を入力するようにし
てもよい。ＲＥＳＥＴ端子を使用しない場合は、図８Ａ及び図８Ｂに示すようにＲＥＳＥ
Ｔ端子はＨＩＧＨにプルアップされていてもよい。
Since the reset
A reset signal may be input from the RESET terminal via the
The T terminal may be pulled up to HIGH.
図８Ａは、本発明の第１の実施形態の装飾装置６２０を制御する装飾制御装置６１０の
Ｉ2ＣＩ／Ｏエクスパンダ６１５周辺の回路図である。
FIG. 8A is a circuit diagram around the I 2 CI /
Ｉ2ＣＩ／Ｏエクスパンダ６１５は、入力端子としてＮＣ端子、ＲＥＳＥＴ端子、ＳＣ
Ｌ端子、ＳＤＡ端子、Ｖｃｃ端子、Ａ０〜Ａ３端子、及びＧＮＤ端子を備え、出力端子と
して、ＰＯＲＴ０〜ＰＯＲＴ１５を備える。
I 2 CI /
An L terminal, an SDA terminal, a Vcc terminal, an A0 to A3 terminal, and a GND terminal are provided, and PORT0 to PORT15 are provided as output terminals.
ＲＥＳＥＴ端子には、プルアップ抵抗Ｒを介してＩ2ＣＩ／Ｏエクスパンダ６１５に供
給される電源が接続されている。このため、リセット端子に印加される電圧は常にＨＩＧ
Ｈに維持されている。
The power supply supplied to the I 2 CI /
H is maintained.
ＳＣＬ端子は接続線ＳＣＬに接続され、ＳＤＡ端子は接続線ＳＤＡに接続される。 The SCL terminal is connected to the connection line SCL, and the SDA terminal is connected to the connection line SDA.
Ｖｃｃ端子には、Ｉ2ＣＩ／Ｏエクスパンダ６１５に供給される電源が接続される。ま
た、Ｖｃｃ端子には、電源ノイズを除去するコンデンサＣＰが接続される。
The power supply supplied to the I 2 CI /
Ａ０端子〜Ａ３端子は、Ｉ2ＣＩ／Ｏエクスパンダ６１５に固有のアドレスを設定する
ための端子である。なお、通常Ｉ2ＣＩ／Ｏエクスパンダ６１５のアドレスは、４ビット
で表現され、この端子にＩ2ＣＩ／Ｏエクスパンダ６１５の電源が印加されている場合に
はバスコントローラ６３４に「１」が設定され、この端子がグランドに接続されている場
合にはバスコントローラ６３４に「０」が設定される。
Terminals A0 to A3 are terminals for setting an address unique to the I 2 CI /
したがって、図８Ａに示すＩ2ＣＩ／Ｏエクスパンダ６１５のアドレスは「０１００」
であり、図８Ｂに示すＩ2ＣＩ／Ｏエクスパンダ６１５のアドレスは「０１１０」である
。ＧＮＤ端子は、電圧をグランドするための端子である。
Therefore, the address of the I 2 CI /
The address of the I 2 CI /
各ＰＯＲＴ０端子〜ＰＯＲＴ１５端子は、電流制限抵抗Ｒ０〜Ｒ１５を介して各ＬＥＤ
０〜ＬＥＤ１５からなる装飾装置６２０に接続される。なお、ＰＯＲＴ０にように、ポー
ト１個に対して１個のＬＥＤを接続してもよいが、ＰＯＲＴ１〜１５のように、ポート１
個に対して複数個のＬＥＤを接続してもよい。
The PORT0 to PORT15 terminals are connected to the LEDs via the current limiting resistors R0 to R15.
It is connected to a
A plurality of LEDs may be connected to each.
全てのポートにＬＥＤを１個ずつ設ける場合は、１個のＩ2ＣＩ／Ｏエクスパンダ６１
５によって、最大で１６個のＬＥＤを制御できることになる。また、各ポートに接続され
るＬＥＤの個数が異なる場合は、１個のポートに直列に接続された全てのＬＥＤを１種類
のＬＥＤということにすれば、１個のＩ2ＣＩ／Ｏエクスパンダ６１５によって、最大で
１６種類のＬＥＤを制御できることになる。
If one LED is provided for every port, one I 2 CI / O expander 61
5 will allow up to 16 LEDs to be controlled. In addition, when the number of LEDs connected to each port is different, if all LEDs connected in series to one port are one type of LED, one I 2 CI / O expander With 615, up to 16 types of LEDs can be controlled.
ＰＯＲＴ０端子〜ＰＯＲＴ１５端子に接続されるトランジスタ６３８Ａ〜６３８Ｐ（図
７参照）のゲートに対してドライバ６３７から電圧が印加されると、電圧が印加されたト
ランジスタ６３８Ａ〜６３８Ｐのドレインからソースへ電流が流れることが可能になり、
ＰＯＲＴ０端子〜ＰＯＲＴ１５端子に接続されるＬＥＤ０〜ＬＥＤ１５に電流が流れ、各
ＬＥＤ０〜ＬＥＤ１５は点灯する。
When a voltage is applied from the
A current flows through the
一方、ドライバ６３７がトランジスタ６３８Ａ〜６３８Ｐのゲートに電圧を印加しなけ
れば、各ＬＥＤ０〜ＬＥＤ１５に電流が流れない状態になり、各ＬＥＤ０〜ＬＥＤ１５は
点灯しない。
On the other hand, if the
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５のＰＯＲＴ０端子〜ＰＯＲＴ１５端子には、Ｌ
ＥＤの代わりに、モータやソレノイドを接続することも可能であるので、Ｉ2ＣＩ／Ｏエ
クスパンダ６１５を用いて、モータやソレノイドを駆動する場合について説明する。
Note that the PORT0 to PORT15 terminals of the I 2 CI /
Since a motor or a solenoid can be connected instead of the ED, a case where the motor or the solenoid is driven using the I 2 CI /
図８Ｂは、本発明の第１の実施形態の役物駆動ＭＯＴ５６１及び役物駆動ＳＯＬ５６０
を制御する装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５周辺の回路図である。
FIG. 8B shows the
FIG. 16 is a circuit diagram of the periphery of the I 2 CI /
役物駆動ＭＯＴ５６１はステッピングモータにより構成され、ステッピングモータを駆
動する各相の信号端子に、所定の電圧を順次印加することで回動する。本実施形態では、
役物駆動ＭＯＴ５６１の各相の信号端子が、ＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続され
る。
The
The signal terminals of each phase of the
役物駆動ＭＯＴ５６１に接続されているＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続される
トランジスタ６３８Ａ〜６３８Ｄのいずれかのゲートに対してドライバ６３７から電圧が
印加されると、電圧が印加されたトランジスタ６３８Ａ〜６３８Ｄのドレインからソース
へ電流が流れることが可能になり、ＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続される役物駆
動ＭＯＴ５６１に電流が流れ、役物駆動ＭＯＴ５６１が駆動する。
When a voltage is applied from the
なお、各ＰＯＲＴ０端子〜ＰＯＲＴ３端子と役物駆動ＭＯＴ５６１とを接続する接続線
は分岐し、分岐した一方の接続線は、役物駆動ＭＯＴ５６１に供給される電源にダイオー
ドＤ及びツェナダイオードＺＤを介して接続される。
The connection line connecting the PORT0 terminals to the PORT3 terminals to the
また、ＰＯＲＴ端子１５は、役物駆動ＳＯＬ５６０に接続される。役物駆動ＳＯＬ５６
０に接続されているＰＯＲＴ１５端子に接続されるトランジスタ６３８Ｐのゲートに対し
てドライバ６３７から電圧が印加されると、電圧が印加されたトランジスタ６３８Ｐのド
レインからソースへ電流が流れることが可能になり、ＰＯＲＴ１５端子に接続される役物
駆動ＳＯＬ５６０に電流が流れ、役物駆動ＳＯＬ５６０が駆動する。
In addition, the
When a voltage is applied from the
なお、図８Ｂでは、Ｉ2ＣＩ／Ｏエクスパンダ６１５に役物駆動ＭＯＴ５６１及び役物
駆動ＳＯＬ５６０の双方が接続されているが、一つのＩ2ＣＩ／Ｏエクスパンダ６１５に
対して、役物駆動ＭＯＴ５６１及び役物駆動ＳＯＬ５６０の少なくとも一方だけを接続し
た構成でもよい。
In FIG. 8B, with respect to I 2 CI / O Aix although both character object drive MOT561 and character object
例えば、ステッピングモータだけを制御するグループとしてのＩ2ＣＩ／Ｏエクスパン
ダ６１５を専用に設けたり、ソレノイドだけを制御するグループとしてのＩ2ＣＩ／Ｏエ
クスパンダ６１５を専用に設けるようにしてもよい。このような構成により、同一グルー
プに属する演出装置を同じタイミングで制御することが可能となるので、高速処理が必要
な演出装置だけをグループ化して効率よく制御することも可能となる。
For example, the I 2 CI /
図９は、本発明の第１実施形態の中継基板６００の入出力に関する接続線の回路図であ
る。
FIG. 9 is a circuit diagram of connection lines related to input and output of the
中継基板６００は、上流コネクタ６０１、二つの下流コネクタ６０２Ａ、６０２Ｂ、及
びＩ2ＣＩ／Ｏエクスパンダ６１５を備える。
The
上流コネクタ６０１は中継基板６００よりも上流のマスタＩＣ５７０に接続されるコネ
クタであり、コネクタ６０２Ａ、６０２Ｂは、中継基板６００よりも下流の装飾制御装置
６１０に接続される。
The
二つの下流コネクタ６０２Ａ、６０２Ｂに接続線ＳＤＡを接続するために、上流コネク
タ６０１から延びる内部接続線ＳＤＡ９１１は分岐９０１で第１接続線ＳＤＡ９２１と第
２接続線ＳＤＡ９３１とに分岐する。第１接続線ＳＤＡ９２１は下流コネクタ６０２Ａに
接続され、第２接続線ＳＤＡ９３１は下流コネクタ６０２Ｂに接続される。
In order to connect the connection line SDA to the two
同じく、上流コネクタ６０１から延びる内部接続線ＳＣＬ９１２は分岐９０２で第１接
続線ＳＣＬ９２２と第２接続線ＳＣＬ９３２とに分岐する。第１接続線ＳＣＬ９２２は下
流コネクタ６０２Ａに接続され、第２接続線ＳＣＬ９３２は下流コネクタ６０２Ｂに接続
される。
Similarly, the internal
接続線ＳＤＡをＩ2ＣＩ／Ｏエクスパンダ６１５に接続するために、第２接続線ＳＤＡ
９３１は分岐９０３で分岐し、分岐した第２接続線ＳＤＡ９３１はＩ2ＣＩ／Ｏエクスパ
ンダ６１５の図８Ａ及び図８に示すＳＤＡ端子に接続される。また、接続線ＳＣＬをＩ2
ＣＩ／Ｏエクスパンダ６１５に接続するために、第２接続線ＳＣＬ９３２は分岐９０４で
分岐し、分岐した第２接続線ＳＣＬ９３２はＩ2ＣＩ／Ｏエクスパンダ６１５の図８Ａ及
び図８Ｂに示すＳＣＬ端子に接続される。
In order to connect the connection line SDA to the I 2 CI /
The
In order to connect to the CI /
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５には、Ｉ2ＣＩ／Ｏエクスパンダ６１５の電源電
圧となる電圧Ｖｃｃが供給されている。また、図９では図示されていないが、Ｉ2ＣＩ／
Ｏエクスパンダ６１５からは、中継基板６００に設けたＬＥＤ（装飾装置２００）を駆動
する各ポート０〜１５の信号線（図８Ａ参照）が出力されている。
The I 2 CI /
The O expander 615 outputs signal lines (see FIG. 8A) of
また、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、第２接続線ＳＤＡ９３１及び第２接続線Ｓ
ＣＬ９３２が接続されるとしたが、第１接続線ＳＤＡ９２１及び第１接続線ＳＣＬ９２２
に接続されてもよい。
In addition, the I 2 CI /
Although it is assumed that the
It may be connected to
Ｉ2ＣＩ／Ｏエクスパンダ６１５が上流のマスタＩＣ５７０に接続線ＳＤＡを介して出
力する信号、及び上流のマスタＩＣ５７０から中継基板６００のＩ2ＣＩ／Ｏエクスパン
ダ６１５へ接続線ＳＤＡを介して入力される信号のノイズを除去するために、内部接続線
ＳＤＡ９１１にはツェナダイオードＺＤ９４１が接続されている。
A signal that the I 2 CI /
具体的には、内部接続線ＳＤＡ９１１は分岐９０５で分岐し、分岐した内部接続線ＳＤ
Ａ９１１はツェナダイオードＺＤ９４１のカソード側に接続され、ツェナダイオードＺＤ
９４１のアノード側は接地されている。
Specifically, internal connection line SDA 911 is branched at
A 911 is connected to the cathode side of zener diode ZD 941 and zener diode ZD
The anode side of 941 is grounded.
このため、内部接続線ＳＤＡ９１１に印加された所定以上の電圧（例えば、パルス性の
ノイズ信号）は、ツェナダイオードＺＤ９４１によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SDA 911 is released by the Zener diode ZD 941.
また、上流のマスタＩＣ５７０から中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５
へ接続線ＳＣＬを介して入力される信号のノイズを除去するために、内部接続線ＳＣＬ９
１２にはツェナダイオードＺＤ９４２が接続されている。
Also, the I 2 CI /
In order to eliminate noise on the signal input through connection line SCL, internal connection line SCL9
The
具体的には、内部接続線ＳＣＬ９１２は分岐９０６で分岐し、分岐した内部接続線ＳＣ
Ｌ９１２はツェナダイオードＺＤ９４２のカソード側に接続され、ツェナダイオードＺＤ
９４２のアノード側は接地されている。
Specifically, internal
The anode side of 942 is grounded.
このため、内部接続線ＳＣＬ９１２に印加された所定以上の電圧（例えば、パルス性の
ノイズ信号）は、ツェナダイオードＺＤ９４２によって逃がされる。
For this reason, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SCL912 is released by the Zener diode ZD942.
中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５が下流コネクタ６０２Ａに接続され
た装飾制御装置６１０に接続線ＳＤＡを介して出力する信号、及び下流コネクタ６０２Ａ
に接続された装飾制御装置６１０から中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５
へ接続線ＳＤＡを介して入力される信号のノイズを除去するために、第１接続線ＳＤＡ９
２１にはツェナダイオードＺＤ９４３が接続されている。
A signal output from the I 2 CI /
The I 2 CI /
In order to remove noise of the signal input through connection line SDA, first connection line SDA9
The Zener diode ZD943 is connected to the
具体的には、第１接続線ＳＤＡ９２１は分岐９０７で分岐し、分岐した第１接続線ＳＤ
Ａ９２１はツェナダイオードＺＤ９４３のカソード側に接続され、ツェナダイオードＺＤ
９４３のアノード側は接地されている。
Specifically, the first connection line SDA 921 branches at a
A 921 is connected to the cathode side of zener diode ZD943, zener diode ZD
The anode side of 943 is grounded.
このため、内部接続線ＳＤＡ９２１に印加された所定以上の電圧（例えば、パルス性の
ノイズ信号）は、ツェナダイオードＺＤ９４３によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SDA 921 is released by the
また、第１接続線ＳＤＡ９２１に接続されるツェナダイオードＺＤ９４３と同じく、第
２接続線ＳＤＡ９３１にもツェナダイオード９４５が接続される。
Further, similarly to the Zener diode ZD943 connected to the first connection line SDA921, the
また、中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５から下流コネクタ６０２Ａに
接続された装飾制御装置６１０へ接続線ＳＣＬを介して入力される信号のノイズを除去す
るために、第１接続線ＳＣＬ９２２にはツェナダイオードＺＤ９４４が接続されている。
In addition, in order to remove noise of a signal input from the I 2 CI /
具体的には、第１接続線ＳＣＬ９２２は分岐９０８で分岐し、分岐した第１接続線ＳＣ
Ｌ９２２はツェナダイオードＺＤ９４４のカソード側に接続され、ツェナダイオードＺＤ
９４４のアノード側は接地されている。
Specifically, the first connection line SCL 922 branches at a
L 922 is connected to the cathode side of
The anode side of 944 is grounded.
このため、内部接続線ＳＣＬ９２２に印加された所定以上の電圧（例えば、パルス性の
ノイズ信号）は、ツェナダイオードＺＤ９４４によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SCL 922 is dissipated by the
また、第１接続線ＳＣＬ９２２に接続されるツェナダイオードＺＤ９４４と同じく、第
２接続線ＳＣＬ９３２にもツェナダイオードＺＤ９４６が接続される。
Further, similarly to the
また、マスタＩＣ５７０に接続される上流側の接続線ＳＤＡ、及び装飾制御装置６１０
に接続される下流側の接続線ＳＤＡの電圧をプルアップするためのプルアップ抵抗Ｒ９５
１が、第１接続線ＳＤＡ９２１に接続される。同じく、マスタＩＣ５７０に接続される上
流側の接続線ＳＣＬ、及び装飾制御装置６１０に接続される下流側の接続線ＳＣＬの電圧
をプルアップするためのプルアップ抵抗Ｒ９５２が、第１接続線ＳＤＡ９２２に接続され
る。
Also, the upstream connection line SDA connected to the
Pull-up resistor R95 for pulling up the voltage of the downstream connection line SDA connected to
1 is connected to the first connection line SDA 921. Similarly, a pull-up resistor R952 for pulling up the voltage of the upstream connection line SCL connected to the
具体的には、第１接続線ＳＤＡ９２１は分岐９０９で分岐し、分岐した第１接続線ＳＤ
Ａ９２１はプルアップ抵抗Ｒ９５１に接続される。同じく第１接続線ＳＣＬ９２２は分岐
９１０で分岐し、分岐した第１接続線ＳＣＬ９２２はプルアップ抵抗Ｒ９５２に接続され
る。
Specifically, the first connection line SDA 921 branches at a branch 909, and the branched first connection line SD
A 921 is connected to pull-up
なお、接続線ＳＤＡ及び接続線ＳＣＬの電圧をプルアップするプルアップ抵抗９５１、
９５２は、中継基板６００が備えなくてもよく、マスタＩＣ５７０が備えてもよいし、中
継基板６００以外の装飾制御装置６１０が備えてもよい。要するに、接続線ＳＤＡ及び接
続線ＳＣＬを駆動するトランジスタのドレインの端子に、電圧Ｖｃｃを供給できる箇所で
あれば、どこでもよい。
Note that a pull-up
The
中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５に電源電圧を供給する接続線Ｖｃｃ
に接続される上流コネクタ６０１のＶｃｃ端子から延びる内部接続線Ｖｃｃ９７１と、上
流コネクタ６０１のＧＮＤ端子から延び、接地されている内部接続線ＧＮＤ９７２とは、
平滑コンデンサＣ９６１及びバイパスコンデンサ９６２を介して接続されている。
Connection line Vcc that supplies power supply voltage to I 2 CI /
The internal
It is connected via the smoothing capacitor C 961 and the
平滑コンデンサＣ９６１は、電源の電圧波形を滑らかにするためのコンデンサであり、
バイパスコンデンサＣＰ９６２は、電源の電圧のノイズを除去するためのコンデンサであ
る。
The smoothing capacitor C961 is a capacitor for smoothing the voltage waveform of the power supply,
The bypass capacitor CP962 is a capacitor for removing noise of the voltage of the power supply.
このため、中継基板６００のＩ2ＣＩ／Ｏエクスパンダ６１５に供給される電源電圧は
、平滑コンデンサＣ９６１により電圧が平滑化され、バイパスコンデンサ９６２によりノ
イズが除去されて、Ｉ2ＣＩ／Ｏエクスパンダ６１５に供給される。
For this reason, the power supply voltage supplied to the I 2 CI /
同じく、下流コネクタ６０２Ａ、６０２ＢのＶｃｃ端子から延びる内部接続線Ｖｃｃ９
７３と、ＧＮＤ端子から延びる内部接続線ＧＮＤ９７４とは、平滑コンデンサＣ９６１及
びバイパスコンデンサ９６２を介して接続されている。これによって、平滑化され、ノイ
ズが除去された電圧が下流の装飾制御装置６１０に接続される接続線Ｖｃｃに印加される
。
Similarly, internal connection line Vcc9 extending from the Vcc terminal of
73 and the internal
図１０は、本発明の第１実施形態の装飾制御装置６１０の入出力に関する接続線の回路
図である。
FIG. 10 is a circuit diagram of connection lines regarding input and output of the
装飾制御装置６１０は、上流コネクタ６１１、Ｉ2ＣＩ／Ｏエクスパンダ６１５、及び
下流コネクタ６１２を備える。
The
上流コネクタ６１１には、中継基板６００又は上流側の装飾制御装置６１０からバスが
接続される。下流コネクタ６１２には、下流側の装飾制御装置６１０に接続するバスが接
続される。
A bus is connected to the
上流コネクタ６１１のＳＤＡ端子と下流コネクタ６１２のＳＤＡ端子とは、内部接続線
ＳＤＡ１０１１によって接続されている。また、上流コネクタ６１１のＳＣＬ端子と下流
コネクタ６１２のＳＣＬ端子とは、内部接続線ＳＣＬ１０１２によって接続されている。
The SDA terminal of the
接続線ＳＤＡをＩ2ＣＩ／Ｏエクスパンダ６１５に接続するために、内部接続線ＳＤＡ
１０１１は分岐１００１で分岐し、分岐した内部接続線ＳＤＡ１０１１はＩ2ＣＩ／Ｏエ
クスパンダ６１５の図８Ａ及び図８に示すＳＤＡ端子に接続される。また、接続線ＳＣＬ
をＩ2ＣＩ／Ｏエクスパンダ６１５に接続するために、内部接続線ＳＣＬ１０１２は分岐
１００２で分岐し、分岐した内部接続線ＳＣＬ１０１２はＩ2ＣＩ／Ｏエクスパンダ６１
５の図８Ａ及び図８Ｂに示すＳＣＬ端子に接続される。
In order to connect connection line SDA to I 2 CI /
1011 is branched at
In order to connect the I 2 CI /
5 is connected to the SCL terminal shown in FIGS. 8A and 8B.
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５には、Ｉ2ＣＩ／Ｏエクスパンダ６１５の電源電
圧となる電圧Ｖｃｃが供給されている。また、図１０では図示されていないが、Ｉ2ＣＩ
／Ｏエクスパンダ６１５からは、当該装飾制御装置６１０に係わるＬＥＤ（装飾装置２０
０）を駆動する各ポート０〜１５の信号線（図８Ａ参照）が出力されている。
The I 2 CI /
LED relating to the decoration control device 610 (decorative device 20)
Signal lines (see FIG. 8A) of
図１０に示す装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５が上流コネクタ６
１１に接続された上流の装飾制御装置６１０又は中継基板６００に接続線ＳＤＡを介して
出力する信号、及び上流コネクタ６１１に接続された上流の装飾制御装置６１０又は中継
基板６００から図１０に示す装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５へ接
続線ＳＤＡを介して入力される信号のノイズを除去するために、内部接続線ＳＤＡ１０１
１にはツェナダイオードＺＤ１０４１が接続されている。
The I 2 CI /
A signal shown in FIG. 10 from an upstream
The Zener diode ZD1041 is connected to 1.
具体的には、内部接続線ＳＤＡ１０１１は分岐１００３で分岐し、分岐した内部接続線
ＳＤＡ１０１１はツェナダイオードＺＤ１０４１のカソード側に接続され、ツェナダイオ
ードＺＤ１０４１のアノード側は接地されている。
Specifically, the internal connection line SDA1011 branches at a branch 1003, the branched internal connection line SDA1011 is connected to the cathode side of the Zener diode ZD1041, and the anode side of the Zener diode ZD1041 is grounded.
このため、内部接続線ＳＤＡ１０１１に印加された所定以上の電圧（例えば、パルス性
のノイズ信号）は、ツェナダイオードＺＤ１０４１によって逃がされる。
For this reason, a voltage (for example, a pulsating noise signal) applied to the internal connection line SDA1011 is exceeded by the Zener diode ZD1041.
また、上流コネクタ６１１に接続される上流の装飾制御装置６１０又は中継基板６００
から図１０に示す装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５へ接続線ＳＣＬ
を介して入力される信号のノイズを除去するために、内部接続線ＳＣＬ１０１２にはツェ
ナダイオードＺＤ９４２が接続されている。
Also, the upstream
10 to the I 2 CI /
The Zener diode ZD942 is connected to the internal connection line SCL1012 in order to remove noise of the signal input via the.
具体的には、内部接続線ＳＣＬ１０１２は分岐１００４で分岐し、分岐した内部接続線
ＳＣＬ１０１２はツェナダイオードＺＤ１０４２のカソード側に接続され、ツェナダイオ
ードＺＤ１０４２のアノード側は接地されている。
Specifically, the internal connection line SCL1012 branches at a branch 1004, the branched internal connection line SCL1012 is connected to the cathode side of the Zener diode ZD1042, and the anode side of the Zener diode ZD1042 is grounded.
このため、内部接続線ＳＣＬ１０１２に印加された所定以上の電圧（例えば、パルス性
のノイズ信号）は、ツェナダイオードＺＤ１０４２によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SCL1012 is released by the Zener diode ZD1042.
図１０に示す装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５が下流コネクタ６
１２に接続された下流の装飾制御装置６１０に接続線ＳＤＡを介して出力する信号、及び
下流コネクタ６１２に接続された下流の装飾制御装置６１０から図１０に示す装飾制御装
置のＩ2ＣＩ／Ｏエクスパンダ６１５へ接続線ＳＤＡを介して入力される信号のノイズを
除去するために、内部接続線ＳＤＡ１０１１にはツェナダイオードＺＤ１０４３が接続さ
れている。
The I 2 CI /
A signal output to the downstream
具体的には、内部接続線ＳＤＡ１０１１は分岐１００５で分岐し、分岐した内部接続線
ＳＤＡ１０１１はツェナダイオードＺＤ１０４３のカソード側に接続され、ツェナダイオ
ードＺＤ１０４３のアノード側は接地されている。
Specifically, the internal connection line SDA1011 branches at a
このため、内部接続線ＳＤＡ１０１１に印加された所定以上の電圧（例えば、パルス性
のノイズ信号）は、ツェナダイオードＺＤ１０４３によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SDA1011 is released by the Zener diode ZD1043.
また、図１０に示す装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５から下流コ
ネクタ６１２に接続された下流の装飾制御装置６１０へ接続線ＳＣＬを介して入力される
信号のノイズを除去するために、内部接続線ＳＣＬ１０１２にはツェナダイオードＺＤ１
０４４が接続されている。
Also, in order to remove noise of a signal input via connection line SCL from I 2 CI /
044 is connected.
具体的には、内部接続線ＳＣＬ１０１２は分岐１００６で分岐し、分岐した内部接続線
ＳＣＬ１０１２はツェナダイオードＺＤ１０４４のカソード側に接続され、ツェナダイオ
ードＺＤ１０４４のアノード側は接地されている。
Specifically, the internal connection line SCL1012 branches at a
このため、内部接続線ＳＣＬ１０１２に印加された所定以上の電圧（例えば、パルス性
のノイズ信号）は、ツェナダイオードＺＤ１０４４によって逃がされる。
Therefore, a voltage (for example, a pulse noise signal) higher than a predetermined voltage applied to the internal connection line SCL1012 is released by the Zener diode ZD1044.
装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５に電源電圧を供給する接続線Ｖ
ｃｃに接続される上流コネクタ６１１のＶｃｃ端子から延びる内部接続線Ｖｃｃ１０７１
と、上流コネクタ６１１のＧＮＤ端子から延び、接地されている内部接続線ＧＮＤ１０７
２とは、平滑コンデンサＣ１０６１及びバイパスコンデンサ１０６２を介して接続されて
いる。
Connection V for supplying power supply voltage to the I 2 CI /
Internal connection line Vcc1071 extending from the Vcc terminal of the
And the internal connection line GND 107 extending from the GND terminal of the
2 is connected via the smoothing capacitor C1061 and the
平滑コンデンサＣ１０６１は図９に示す平滑コンデンサＣ９６１と同じコンデンサであ
り、バイパスコンデンサＣＰ１０６２は図９に示すバイパスコンデンサ９６２と同じコン
デンサである。
The smoothing capacitor C1061 is the same as the smoothing capacitor C961 shown in FIG. 9, and the bypass capacitor CP1062 is the same as the
また、下流コネクタ６１２のＶｃｃ端子から延びる内部接続線Ｖｃｃ１０７３と、ＧＮ
Ｄ端子から延びる内部接続線ＧＮＤ１０７４とは、平滑コンデンサＣ１０６１及びバイパ
スコンデンサ１０６２を介して接続されている。
Also, an internal
The internal
図１１は、本発明の第１の実施形態の演出制御装置５５０から装飾制御装置６１０に出
力されるデータに含まれるスレーブアドレス１１００の説明図である。
FIG. 11 is an explanatory diagram of a
スレーブアドレス１１００は、上位３ビットからなる固定アドレス部１１０１及び下位
５ビットからなる可変アドレス部１１０２を含む。
The
固定アドレス部１１０１は、「１１０」が予め設定されていて、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５が変更できないアドレスである。
The fixed
可変アドレス部１１０２は、Ｉ2ＣＩ／Ｏエクスパンダ６１５に設定可能なアドレスで
あり、制御対象となるＩ2ＣＩ／Ｏエクスパンダ６１５のＡ０〜Ａ３の端子に設定されて
いるパターンに対応した４ビットのＩ2ＣＩ／Ｏエクスパンダアドレス１１０３と、当該
データが読み出し要求であるのか書き込み要求であるのかを示す１ビットのＲ／Ｗ識別デ
ータ１１０４と、が含まれる。
演出制御装置５５０から装飾制御装置６１０に出力される演出制御データは、書き込み
要求であるので、Ｒ／Ｗ識別データ１１０４には、通常「０」が登録される。
Since the effect control data output from the
図１２は、本発明の第１の実施形態のＩ2ＣＩ／Ｏエクスパンダアドレステーブル１２
００の説明図である。
FIG. 12 shows the I 2 CI / O expander address table 12 according to the first embodiment of this invention.
FIG.
Ｉ2ＣＩ／Ｏエクスパンダアドレステーブル１２００は、マスタＩＣ５７０によって管
理されるテーブルである。Ｉ2ＣＩ／Ｏエクスパンダアドレステーブル１２００は、スレ
ーブアドレス１２０１とＩ2ＣＩ／Ｏエクスパンダアドレス１２０２との対応関係を示し
ている。
The I 2 CI / O expander address table 1200 is a table managed by the
スレーブアドレス１２０１には、演出制御装置５５０により送受信の対象として指定さ
れる装飾制御装置６１０のスレーブアドレスが格納されている。スレーブアドレスは、図
１３で前述したように、上位３ビットからなる固定アドレス部と、４ビットのＩ2ＣＩ／
Ｏエクスパンダアドレスと、１ビットのＲ／Ｗ識別データとを組み合わせて構成される。
The
It is configured by combining the O expander address and 1-bit R / W identification data.
Ｉ2ＣＩ／Ｏエクスパンダアドレス１２０２には、図８Ａや図８Ｂで前述したように、
各スレーブアドレスに対応する４ビットのＩ2ＣＩ／Ｏエクスパンダアドレスが登録され
る。
As described above with reference to FIGS. 8A and 8B, the I 2 CI /
A 4-bit I 2 CI / O expander address corresponding to each slave address is registered.
ただし、Ｉ2ＣＩ／Ｏエクスパンダアドレスのうち、アドレス「１０００」及びアドレ
ス「１０１１」は、各Ｉ2ＣＩ／Ｏエクスパンダ６１５を相互に識別するための固有のア
ドレスとしては使用できない。
However, among the I 2 CI / O expander addresses, the address “1000” and the address “1011” can not be used as unique addresses for mutually identifying the respective I 2 CI /
「１０００」は、すべての装飾制御装置６１０に対する指令を出力する場合に指定され
るアドレス（オールコールアドレス）の電源投入時のデフォルト値として用いられる。「
１０１１」はソフトウェアによって、マスタＩＣ５７０に接続されている全ての装飾制御
装置６１０を無条件にリセットする場合に用いられる共通アドレスである。
“1000” is used as a power-on default value of an address (all call address) specified when outputting a command to all the
1011 "is a common address used when software unconditionally resets all
このように、装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５に設定可能な固有
アドレスは１４個であるために、演出制御装置５５０は、１４個のＩ2ＣＩ／Ｏエクスパ
ンダ６１５を制御できる。また、一つの装飾制御装置６１０は、ＰＯＲＴ０〜ＰＯＲＴ１
５を備えるので、１６個（言い換えれば１６種類）のＬＥＤを制御できる。よって、演出
制御装置５５０は、２２４個（言い換えれば２２４種類）のＬＥＤを制御できる。
Thus, since there are 14 unique addresses that can be set in the I 2 CI /
Since 5 is provided, 16 (16 in other words) LEDs can be controlled. Thus, the
図１３は、本発明の第１の実施形態のＩ2ＣＩ／Ｏエクスパンダ６１５に備わる出力設
定レジスタ６３５（図７参照）に割り当てられたワークレジスタを説明するための図であ
る。
FIG. 13 is a diagram for describing a work register assigned to the output setting register 635 (see FIG. 7) provided in the I 2 CI /
Ｉ2ＣＩ／Ｏエクスパンダ６１５の出力設定レジスタ６３５には、ワークレジスタ（デ
バイスレジスタ）と、コントロールレジスタ（制御レジスタ）とが割り当てられている。
ワークレジスタは、Ｉ2ＣＩ／Ｏエクスパンダ６１５に対して予め定義されている設定を
行うための情報や、Ｉ2ＣＩ／Ｏエクスパンダ６１５に接続されている演出装置（例えば
、ＬＥＤ）の出力態様を特定するための情報を記憶するものである。また、コントロール
レジスタは、ワークレジスタへのデータ書き込み手順を規定する情報を記憶するものであ
る。
A work register (device register) and a control register (control register) are assigned to the
Work register, and information for setting the predefined relative I 2 CI /
なお、図１３に示すように、ワークレジスタは、複数の情報を異なる記憶領域に分散し
て記憶する構成となっており、各記憶領域毎に異なるレジスタ番号が付与されている。
As shown in FIG. 13, the work register is configured to distribute and store a plurality of pieces of information in different storage areas, and different register numbers are assigned to the respective storage areas.
レジスタ番号が「００ｈ」となる記憶領域には、「ＭＯＤＥ１」というレジスタ名が付
与されており、また、レジスタ番号が「０１ｈ」となる記憶領域には、「ＭＯＤＥ２」と
いうレジスタ名が付与されている。レジスタ番号「００ｈ」及び「０１ｈ」の記憶領域に
値が書き込まれると、書き込まれた値に基づいて、Ｉ2ＣＩ／Ｏエクスパンダ６１５の初
期設定が行われる。
A register name "MODE1" is assigned to the storage area where the register number is "00h", and a register name "MODE2" is assigned to the storage area where the register number is "01h" There is. When values are written to the storage areas of register numbers “00h” and “01h”, initialization of the I 2 CI /
レジスタ番号が「０２ｈ」〜「１１ｈ」となる記憶領域には、「ＰＷＭ０」〜「ＰＷＭ
１５」というレジスタ名が付与されている。レジスタ番号「０２ｈ」〜「１１ｈ」の記憶
領域のいずれかに値が書き込まれると、Ｉ2ＣＩ／Ｏエクスパンダ６１５に接続される発
光装置を構成する１６個のＬＥＤのうち、値が書き込まれたレジスタ番号に対応するＬＥ
Ｄの輝度が、書き込まれた値に基づいて調整される。例えば、レジスタ番号「０２ｈ」の
記憶領域に値が書き込まれた場合には、図８Ａに示すポート０に接続されたＬＥＤ０の輝
度が調整される。
In the storage area where the register number is “02h” to “11h”, “
The register name "15" is given. When a value is written to any of the storage areas of register numbers “02h” to “11h”, the value is written out of the 16 LEDs constituting the light emitting device connected to I 2 CI /
The brightness of D is adjusted based on the written value. For example, when a value is written to the storage area of the register number “02h”, the brightness of the
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５に役物駆動ＳＯＬ５６０が接続される場合には
、役物駆動ＳＯＬ５６０が接続されるポートに対応するレジスタ番号の記憶領域には、役
物駆動ＳＯＬ５６０を通電して作動するか、通電せずに未作動状態にするかを示す値が書
き込まれる。
When the
また、Ｉ2ＣＩ／Ｏエクスパンダ６１５に役物駆動ＭＯＴ５６１が接続される場合には
、役物駆動ＭＯＴ５６１が接続されるポートに対応するレジスタ番号の記憶領域には、役
物駆動ＭＯＴ５６１の目標回転位置を示す値が書き込まれる。
When the
レジスタ番号が「１２ｈ」となる記憶領域には、「ＧＲＰＰＷＭ」というレジスタ名が
付与され、レジスタ番号が「１３ｈ」となる記憶領域には、「ＧＲＰＦＲＥＱ」というレ
ジスタ名が付与されている。レジスタ番号「１２ｈ」及び「１３ｈ」の記憶領域に値が書
き込まれると、書き込まれた値に基づいて、全体のＬＥＤ（１６個のＬＥＤ）の点滅パタ
ーンが設定される。
A register name "GRPPWM" is given to the storage area having the register number "12h", and a register name "GRPFREQ" is given to the storage area having the register number "13h". When values are written in the storage areas of the register numbers “12h” and “13h”, the blinking patterns of the entire LEDs (16 LEDs) are set based on the written values.
具体的には、レジスタ番号「１２ｈ」の記憶領域に値が書き込まれた場合には、全体の
ＬＥＤのオン・オフ比率であるデューティサイクルが設定され、レジスタ番号「１３ｈ」
の記憶領域に値が書き込まれた場合には、全体のＬＥＤの点滅周期が設定される。
Specifically, when a value is written in the storage area of the register number "12h", the duty cycle which is the on / off ratio of the entire LED is set, and the register number "13h"
When a value is written to the storage area of the above, the blinking cycle of the entire LED is set.
レジスタ番号が「１４ｈ」となる記憶領域には、「ＬＥＤＯＵＴ０」というレジスタ名
が付与されている。レジスタ番号「１４ｈ」の記憶領域に値が書き込まれると、書き込ま
れた値に基づいて、ＬＥＤ０〜ＬＥＤ３の出力状態が設定される。
The register name "LEDOUT0" is assigned to the storage area where the register number is "14h". When a value is written to the storage area of the register number "14h", the output states of LED0 to LED3 are set based on the written value.
レジスタ番号が「１５ｈ」となる記憶領域には、「ＬＥＤＯＵＴ１」というレジスタ名
が付与されている。レジスタ番号「１５ｈ」の記憶領域に値が書き込まれると、書き込ま
れた値に基づいて、ＬＥＤ４〜ＬＥＤ７の出力状態が設定される。
The register name "LEDOUT1" is assigned to the storage area where the register number is "15h". When a value is written to the storage area of the register number "15h", the output states of the LED4 to LED7 are set based on the written value.
レジスタ番号が「１６ｈ」となる記憶領域には、「ＬＥＤＯＵＴ２」というレジスタ名
が付与されている。レジスタ番号「１６ｈ」の記憶領域に値が書き込まれると、書き込ま
れた値に基づいて、ＬＥＤ８〜ＬＥＤ１１の出力状態が設定される。
The register name "LEDOUT2" is assigned to the storage area where the register number is "16h". When a value is written to the storage area of the register number "16h", the output states of the
レジスタ番号が「１７ｈ」となる記憶領域には、「ＬＥＤＯＵＴ３」というレジスタ名
が付与されている。レジスタ番号「１７ｈ」の記憶領域に値が書き込まれると、書き込ま
れた値に基づいて、ＬＥＤ１２〜ＬＥＤ１５の出力状態が設定される。
The register name "LEDOUT3" is assigned to the storage area where the register number is "17h". When a value is written to the storage area of the register number "17h", the output states of the
レジスタ番号が「１８ｈ」〜「１Ａｈ」となる記憶領域には、「ＳＵＢＡＤＲ１」〜「
ＳＵＢＡＤＲ３」というレジスタ名が付与されている。レジスタ番号「１８ｈ」〜「１Ａ
ｈ」の記憶領域に値が書き込まれると、書き込まれた値に基づいて、第１サブアドレス〜
第３サブアドレスが設定される。
In the storage area where the register number is “18h” to “1Ah”, “SUBADR1” to
The register name "SUBADR3" is given. Register number “18h” to “1A
When a value is written to the storage area “h”, the first sub-address
The third subaddress is set.
レジスタ番号が「１Ｂｈ」となる記憶領域には、「ＡＬＬＣＡＬＬＡＤＲ」というレジ
スタ名が付与されている。レジスタ番号「１Ｂｈ」の記憶領域に値が書き込まれると、書
き込まれた値に基づいて、オールコールアドレスが設定される。
The register name "ALLCALLADR" is assigned to the storage area where the register number is "1 Bh". When the value is written to the storage area of the register number "1Bh", the all-call address is set based on the written value.
図１４は、本発明の第１の実施形態のマスタＩＣ５７０が接続線ＳＤＡ及び接続線ＳＣ
Ｌを介して出力するデータのスタート条件及びストップ条件の説明図である。
FIG. 14 shows that the
It is explanatory drawing of the start condition and stop condition of the data output via L. FIG.
接続線ＳＣＬは、データの非送信時に信号レベルがＨＩＧＨになっており、マスタＩＣ
５７０は、装飾制御装置６１０にデータを出力する際に、接続線ＳＣＬの信号レベルをＬ
ＯＷからＨＩＧＨに変化させ、装飾制御装置６１０が接続線ＳＤＡのデータを取り込むた
めのストローブ信号として作用させる。
Connection line SCL has a signal level of HIGH when data is not transmitted, and the master IC
570 outputs the signal level of connection line SCL to L when outputting data to
It changes from OW to HIGH, and the
接続線ＳＤＡは、データの非送信時に信号レベルがＨＩＧＨになっており、接続線ＳＣ
Ｌのクロック信号に合わせて接続線ＳＤＡからデータが出力される。
Connection line SDA has a signal level HIGH when data is not transmitted, and connection line SC
Data is output from the connection line SDA in accordance with the L clock signal.
マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＨＩＧＨに維持したまま、接続線Ｓ
ＤＡの信号レベルをＨＩＧＨからＬＯＷに変化させることで、データの出力が開始するこ
とを示すスタート条件となる信号を出力する。
By changing the signal level of DA from HIGH to LOW, a signal serving as a start condition indicating that data output starts is output.
装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５は、接続線ＳＤＡ及び接続線Ｓ
ＣＬからスタート条件となる信号が入力されると、データの出力が開始することを把握す
る。
The I 2 CI /
When a signal serving as a start condition is input from CL, it is understood that data output starts.
マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＨＩＧＨに維持したまま、接続線Ｓ
ＤＡの信号レベルをＬＯＷからＨＩＧＨに変化させることで、データの出力が終了するこ
とを示すストップ条件を示す信号を出力する。
By changing the signal level of DA from LOW to HIGH, a signal indicating a stop condition indicating that the output of data ends is output.
装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５は、ストップ条件が入力される
と、データの出力が終了することを把握する。
When the stop condition is input, the I 2 CI /
図１５は、本発明の第１の実施形態のマスタＩＣ５７０から出力されたデータが入力さ
れた装飾制御装置６１０が返答信号を出力するタイミングチャートである。
FIG. 15 is a timing chart in which the
装飾制御装置６１０は、スタート条件が成立してから接続線ＳＣＬの信号レベルの変化
回数を計数し、接続線ＳＣＬのクロック信号に合わせて接続線ＳＤＡから入力されるデー
タを取り込む。
The
そして、装飾制御装置６１０は、スタート条件が成立してから接続線ＳＣＬの信号レベ
ルの変化回数が９回に達する直前に、返答信号をマスタＩＣ５７０に接続線ＳＤＡを介し
て出力する。換言すると、装飾制御装置６１０は、接続線ＳＤＡから８ビット目のデータ
を取り込んだ後に、接続線ＳＣＬの信号レベルがＨＩＧＨからＬＯＷに変化することを契
機に、返答信号を当該接続線ＳＤＡを介して出力する。
Then, the
なお、図に示すように、データの受信に成功したことを示す返答信号（ＡＣＫの返答信
号）はＬＯＷレベルによって示され、データの受信に失敗したことを示す返答信号（ＮＡ
ＣＫの返答信号、図ではＡＣＫ出力なしに相当）はＨＩＧＨレベルによって示される。
As shown in the figure, a response signal (ACK response signal) indicating that data reception was successful is indicated by a LOW level, and a response signal (NA) indicates that data reception failed.
The CK response signal (corresponding to no ACK output in the figure) is indicated by the HIGH level.
また、マスタＩＣ５７０は、スタート条件が成立してから接続線ＳＣＬの信号レベルが
８回変化すると、接続線ＳＤＡを解放することによって、装飾制御装置６１０から返答信
号の入力を待機する。そして、マスタＩＣ５７０は、接続線ＳＤＡを解放したまま、接続
線ＳＣＬの信号レベルを変化させて、装飾制御装置６１０からの返答信号を取り込む。
Further, when the signal level of the connection line SCL changes eight times after the start condition is satisfied, the
図１６は、本発明の第１の実施形態のマスタＩＣ５７０が演出制御データを出力する場
合の接続線ＳＤＡ及び接続線ＳＣＬの信号レベルのタイミングチャートである。
FIG. 16 is a timing chart of signal levels of the connection line SDA and the connection line SCL when the
まず、マスタＩＣ５７０は、データの出力を開始する場合には、接続線ＳＣＬの信号レ
ベルをＨＩＧＨに維持したまま、接続線ＳＤＡの信号レベルをＨＩＧＨからＬＯＷに変化
させることによって、スタート条件を示す信号を出力し、これからデータを出力すること
を装飾制御装置６１０に通知する。
First, when starting to output data,
次に、マスタＩＣ５７０は、合計７ビットからなる制御対象となる装飾制御装置６１０
のスレーブアドレスを出力する。次に、マスタＩＣ５７０は、読み出し要求である書き込
み要求であるかを示すデータを８ビット目に出力する。
Next, the
Output slave address of Next, the
そして、マスタＩＣ５７０は、接続線ＳＣＬの信号レベルが９回目にＨＩＧＨになると
きに、装飾制御装置６１０から返答信号が入力されるので、ＡＣＫの返答信号であれば接
続線ＳＤＡの信号レベルがＬＯＷに変化し、ＮＡＣＫの返答信号であれば接続線ＳＤＡの
信号レベルがＨＩＧＨに変化する。
Then, the
次に、マスタＩＣ５７０は、アドレスデータの出力後、データを、８の倍数となるビッ
ト数で出力する。マスタＩＣ５７０は、データの８ビット目を出力した後、ＡＣＫの返答
信号が入力されるのを待ってデータの９ビット目を出力する。以降、８の倍数番目に相当
するビットのデータを出力すると、ＡＣＫの返答信号が入力されるのを確認してから、（
８の倍数＋１）番目のビットを出力し、全データが出力されるまで繰り返す。
Next, after the output of the address data, the
Output a multiple of 8 plus 1) th bit and repeat until all data is output.
なお、マスタＩＣ５７０は、データの８の倍数番目となるビットを出力した後、所定時
間経過してもＡＣＫの返答信号が入力されない場合には、データの送信に失敗したものと
みなして、再度スタート条件を送信する。次いで、接続線ＳＤＡを介して、再度アドレス
データを出力し、ＡＣＫの返答信号を確認しながら、もう一度、データを１ビット目から
出力する。
Note that after the
また、マスタＩＣ５７０は、データの最後のビットのデータを出力した後、ＡＣＫの返
答信号が入力されるのを待って、ストップ条件を示す信号を出力する。
Further, after outputting the data of the last bit of data, the
なお、図１６では、スタート条件を示す信号を出力してからストップ条件を示す信号を
出力するまでの間に、合計２４ビット（スレーブアドレス８ビット、データ１６ビット）
のデータを出力しているが、２４ビット以上であってもよいし、２４ビット以下であって
もよい。
Note that, in FIG. 16, a total of 24 bits (
However, the data may be 24 bits or more, or 24 bits or less.
図１７は、本発明の第１の実施形態のマスタＩＣ５７０が、スレーブの個別アドレスを
指定して装飾制御装置６１０に演出制御データを設定する場合において、マスタＩＣ５７
０とＩ2ＣＩ／Ｏエクスパンダ６１５との間で授受されるデータのフォーマットを説明す
る図である。
FIG. 17 shows a case where the
FIG. 10 is a diagram for explaining the format of data exchanged between 0 and the I 2 CI /
はじめに出力される８ビットのデータ１８０１には、データ送信の対象となる装飾制御
装置６１０のアドレス「Ａ０〜Ａ６」と、当該データが読み出し要求であるのか書き込み
要求であるのかを示す１ビットのＲ／Ｗ識別データとが含まれる。このアドレス「Ａ０〜
Ａ６」のうち、「Ａ４〜Ａ６」は値「１１０」となる固定アドレス部であり、「Ａ０〜Ａ
３」はＩ2ＣＩ／Ｏエクスパンダ６１５のＡ０〜Ａ３の端子に設定されているアドレスに
相当する（図８参照）。なお、このデータ１８０１は、図１６における「ＡＤＲＥＳＳ」
及び「Ｒ／Ｗ」に対応するものである。
The 8-
Of A6, "A4 to A6" is a fixed address portion having a value "110", and "A0 to A
“3” corresponds to the address set to the terminals A0 to A3 of the I 2 CI / O expander 615 (see FIG. 8). This
And “R / W”.
次に、出力される８ビットのデータ１８０２には、Ｉ2ＣＩ／Ｏエクスパンダ６１５の
出力設定レジスタ６３５（図７参照）に割り当てられているコントロールレジスタへの設
定データが含まれる。このデータ１８０２は、図１６において１番目に送信される「ＤＡ
ＴＡ」に対応するものである。
Next, 8-
Corresponds to “TA”.
ここで、コントロールレジスタについて説明する。コントロールレジスタは８ビットか
らなり、上位３ビット「ＡＩ０〜ＡＩ２」が出力設定レジスタ６３５のワークレジスタへ
の書き込み又は読み出し方法を指定する自動書込パラメータであり、下位５ビット「Ｄ０
〜Ｄ４」がワークレジスタにおけるアクセス開始位置（書き込みを開始する先頭位置、又
は読み出しを開始する先頭位置）を指定するレジスタアドレスである。
Here, the control register will be described. The control register consists of 8 bits, and the upper 3 bits "AI0 to AI2" are automatic write parameters that specify the method of writing to or reading from the work register of the
".About.D4" is a register address specifying the access start position (the start position to start writing or the start position to start reading) in the work register.
自動書込パラメータは、マスタＩＣ５７０によって、レジスタアドレスが指定するアク
セス開始位置の領域のみをアクセス（オートインクリメントを禁止）するのか、指定する
アクセス開始位置の領域に隣接する領域も含んでアクセス（オートインクリメントを許可
）するのかを指定するパラメータであり、具体的には「０００」、「１００」、「１０１
」、「１１０」、「１１１」の何れかの値を設定することができる。
The automatic writing parameter is accessed by the
“110” or “111” can be set.
自動書込パラメータに「０００」の値を設定すると、オートインクリメントが禁止され
、レジスタアドレスが指定するアクセス開始位置の領域のみにアクセスし、開始位置以外
の領域にはアクセスしない。例えば、レジスタアドレスが「１０１００」であれば、レジ
スタ番号が「１４ｈ」となる記憶領域のみにアクセスし、他の記憶領域にはアクセスしな
い。
When the value of "000" is set to the automatic writing parameter, auto-increment is inhibited, only the area of the access start position designated by the register address is accessed, and the area other than the start position is not accessed. For example, if the register address is "10100", only the storage area whose register number is "14h" is accessed, and other storage areas are not accessed.
自動書込パラメータに「１００」の値を設定すると、オートインクリメントが許可され
、レジスタアドレスが指定するアクセス開始位置の領域にアクセスした後は、レジスタ番
号が増加する方向に領域を移動しながら順にアクセスを繰り返す。そして、レジスタ番号
が最終の「１Ｂｈ」となる記憶領域にアクセスした後は、レジスタ番号が「００ｈ」とな
る記憶領域にアクセスし、再度、レジスタ番号が増加する方向に領域を移動しながら順に
アクセスを繰り返す。例えば、レジスタアドレスが「１０１００」であれば、レジスタ番
号が「１４ｈ」となる記憶領域にアクセスした後は、レジスタ番号が「１５ｈ」→「１６
ｈ」→・・→「１Ｂｈ」→「００ｈ」→「０１ｈ」→・・となる領域（即ち、全ての領域
）に、繰り返しアクセスする。
When the value of "100" is set in the automatic write parameter, auto-increment is permitted, and after accessing the area of the access start position specified by the register address, the area is moved in the direction of increasing the register number and accessed in order repeat. Then, after accessing the last storage area where the register number is “1 Bh”, the storage area where the register number is “00 h” is accessed, and the area is moved again in the direction in which the register number increases. repeat. For example, if the register address is "10100", after accessing the storage area where the register number is "14h", the register number is "15h" → "16".
h "→ to ·· →" 1Bh "→" 00h "→" 01h "→ ·· and a region (that is, all of the area), repeatedly access.
自動書込パラメータに「１０１」の値を設定すると、自動書込パラメータに「１００」
の値を設定した場合と同様に、レジスタアドレスが指定するアクセス開始位置の領域にア
クセスした後は、レジスタ番号が増加する方向に領域を移動しながら順にアクセスを繰り
返す。但し、一旦、レジスタ番号が「１１ｈ」となる記憶領域にアクセスした後は、レジ
スタ番号が「０２ｈ」となる記憶領域にアクセスし、以降、レジスタ番号が「０２ｈ」〜
「１１ｈ」となる区間の記録領域（ＬＥＤの輝度調整に関する領域）に繰り返しアクセス
する。例えば、レジスタアドレスが「１０１００」であれば、レジスタ番号が「１４ｈ」
となる記憶領域にアクセスした後は、レジスタ番号が「１５ｈ」→「１６ｈ」→・・→「
１Ｂｈ」→「００ｈ」→「０１ｈ」→・・となる領域に、順にアクセスする。そして、レ
ジスタ番号が「１１ｈ」となる記憶領域にアクセスした後は、レジスタ番号が「０２ｈ」
→「０３ｈ」→・・→「１１ｈ」→「０２ｈ」→「０３ｈ」→・・となる領域に、繰り返
しアクセスする。
When the value of "101" is set in the automatic writing parameter, "100" is set in the automatic writing parameter.
As in the case where the value of is set, after accessing the area of the access start position designated by the register address, the access is repeated in order while moving the area in the direction of increasing the register number. However, once the storage area having the register number "11h" is accessed, the storage area having the register number "02h" is accessed, and thereafter, the register number "02h" to
The recording area (area related to the brightness adjustment of the LED) of the section to be “11h” is repeatedly accessed. For example, if the register address is "10100", the register number is "14h"
Register number is “15h” → “16h” →.
The areas are sequentially accessed as follows: 1Bh → 00h → 01h →. Then, after accessing the storage area where the register number is "11h", the register number is "02h"
→ Repeatedly access the area where "03h" → · · · "11h" → "02h" → "03h" →.
自動書込パラメータに「１１０」の値を設定すると、自動書込パラメータに「１００」
の値を設定した場合と同様に、レジスタアドレスが指定するアクセス開始位置の領域にア
クセスした後は、レジスタ番号が増加する方向に領域を移動しながら順にアクセスを繰り
返す。但し、一旦、レジスタ番号が「１３ｈ」となる記憶領域にアクセスした後は、レジ
スタ番号が「１２ｈ」となる記憶領域にアクセスし、以降、レジスタ番号が「１２ｈ」〜
「１３ｈ」となる区間の記録領域（ＬＥＤの点滅周期に関する領域）を繰り返しアクセス
する。例えば、レジスタアドレスが「１０１００」であれば、レジスタ番号が「１４ｈ」
となる記憶領域にアクセスした後は、レジスタ番号が「１５ｈ」→「１６ｈ」→・・→「
１Ｂｈ」→「００ｈ」→「０１ｈ」→・・となる領域に、順にアクセスする。そして、レ
ジスタ番号が「１３ｈ」となる記憶領域にアクセスした後は、レジスタ番号が「１２ｈ」
→「１３ｈ」→「１２ｈ」→「１３ｈ」→・・となる領域に、繰り返しアクセスする。
When the value of "110" is set in the automatic writing parameter, "100" in the automatic writing parameter
As in the case where the value of is set, after accessing the area of the access start position designated by the register address, the access is repeated in order while moving the area in the direction of increasing the register number. However, once the storage area having the register number “13h” is accessed, the storage area having the register number “12h” is accessed, and thereafter, the register number “12h” to
The recording area (area related to the blinking cycle of the LED) of the section of “13h” is repeatedly accessed. For example, if the register address is "10100", the register number is "14h"
Register number is “15h” → “16h” →.
The areas are sequentially accessed as follows: 1Bh → 00h → 01h →. Then, after accessing the storage area where the register number is "13h", the register number is "12h"
→ Repeatedly access the area where “13h” → “12h” → “13h” →.
自動書込パラメータに「１１１」の値を設定すると、自動書込パラメータに「１００」
の値を設定した場合と同様に、レジスタアドレスが指定するアクセス開始位置の領域にア
クセスした後は、レジスタ番号が増加する方向に領域を移動しながら順にアクセスを繰り
返す。但し、一旦、レジスタ番号が「１３ｈ」となる記憶領域にアクセスした後は、レジ
スタ番号が「０２ｈ」となる記憶領域にアクセスし、以降、レジスタ番号が「０２ｈ」〜
「１３ｈ」となる区間の記録領域（ＬＥＤの輝度及び点滅周期に関する領域）に繰り返し
アクセスする。例えば、レジスタアドレスが「１０１００」であれば、レジスタ番号が「
１４ｈ」となる記憶領域にアクセスした後は、レジスタ番号が「１５ｈ」→「１６ｈ」→
・・→「１Ｂｈ」→「００ｈ」→「０１ｈ」→・・となる領域に、順にアクセスする。そ
して、レジスタ番号が「１３ｈ」となる記憶領域にアクセスした後は、レジスタ番号が「
０２ｈ」→「０３ｈ」→・・→「１３ｈ」→「０２ｈ」→「０３ｈ」→・・となる領域に
、繰り返しアクセスする。
When the value of "111" is set to the automatic writing parameter, "100" to the automatic writing parameter
As in the case where the value of is set, after accessing the area of the access start position designated by the register address, the access is repeated in order while moving the area in the direction of increasing the register number. However, once the storage area having the register number “13h” is accessed, the storage area having the register number “02h” is accessed, and thereafter, the register number “02h” to
The recording area (area related to the brightness of the LED and the blinking cycle) of the section “13h” is repeatedly accessed. For example, if the register address is "10100", the register number is "
After accessing the storage area of 14h, the register number is “15h” → “16h” →
·· → "1Bh" → to "00h" → the "01h" → ·· area, in order to access. Then, after accessing the storage area where the register number is "13h", the register number is "
02h ”→“ 03h ”→... →“ 13h ”→“ 02h ”→“ 03h ”→...
図１７に戻り、コントロールレジスタへの設定データ１８０２に続いて、ワークレジス
タへの設定データ１８０３が出力される。この設定データ１８０３は、図１６において２
番目以降に送信される「ＤＡＴＡ」に対応するものである。
Referring back to FIG. 17, following the
Corresponds to “DATA” transmitted after the
自動書込パラメータを「０００」とした場合には、この設定データ１８０３は、レジス
タアドレスが指定する１箇所の記憶領域を更新するために必要な８ビットのデータとなる
。自動書込パラメータを「０００」以外の値とした場合には、この設定データ１８０３は
、レジスタアドレスが指定する記憶領域を先頭に、複数の領域を繰り返し更新するために
必要な８の倍数となるビットのデータとなる。
When the automatic writing parameter is set to "000", the setting
図１８は、本発明の第１の実施形態のマスタＩＣ５７０が、スレーブの個別アドレスを
指定して装飾制御装置６１０に演出制御データを設定する場合において、マスタＩＣ５７
０とＩ2ＣＩ／Ｏエクスパンダ６１５との間で授受される演出制御データに具体的な数値
を適用したものである。本図では、オートインクリメントを禁止して、ワークレジスタの
１箇所の記憶領域だけを更新する演出制御データを例示しており、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５のＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続されるＬＥＤの発光状態を更新する
場合を想定している。
FIG. 18 shows a case where the
A specific numerical value is applied to effect control data exchanged between 0 and the I 2 CI /
まず、はじめに出力される８ビットのデータ１９０１には、送信先の装飾制御装置６１
０のＩ2ＣＩ／Ｏエクスパンダ６１５のスレーブアドレスを示す「１１０１１００」が割
り当てられている。
First, the decoration control device 61 of the transmission destination is used for the 8-
“1101100” is assigned to indicate the slave address of the 0 I 2 CI /
次に出力される８ビットのデータ１９０２には、自動書込パラメータ、及びＬＥＤの出
力データを設定するために割り当てられているＩ2ＣＩ／Ｏエクスパンダ６１５の出力設
定レジスタ６３５のコントロールレジスタに設定される値が含まれる。
The next output 8-
ここでは、Ｉ2ＣＩ／Ｏエクスパンダ６１５のＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続
されるＬＥＤの発光状態を設定するので、レジスタアドレスにはＬＥＤＯＵＴ０（アドレ
ス＝１０１００）を指定することにする。
Here, since the light emission state of the LED connected to the PORT0 terminal to the PORT3 terminal of the I 2 CI /
なお、自動書込パラメータには、オートインクリメントを禁止するために「０００」が
指定されている。
Note that "000" is designated as the automatic writing parameter in order to inhibit auto-increment.
次に、出力される８ビットのデータ１９０３には、送信先の装飾制御装置６１０によっ
て制御される装飾装置６２０の発光態様を設定するデータが含まれる。具体的には、ＬＥ
ＤＯＵＴ０レジスタに設定されるデータが割り当てられている。これにより、Ｉ2ＣＩ／
Ｏエクスパンダ６１５のＰＯＲＴ０端子〜ＰＯＲＴ３端子に接続されるＬＥＤの発光状態
（点灯、消灯、点滅など）が指定され、指定された状態でＬＥＤが発光する。
Next, the output 8-
Data to be set in the DOUT0 register is allocated. This makes I 2 CI /
The light emission state (on, off, blink, etc.) of the LED connected to the PORT0 terminal to the PORT3 terminal of the
このようにして、Ｉ2ＣＩ／Ｏエクスパンダ６１５のＰＯＲＴ０端子〜ＰＯＲＴ３端子
のＬＥＤの発光状態が制御されるが、Ｉ2ＣＩ／Ｏエクスパンダ６１５の他のＰＯＲＴ端
子（ＰＯＲＴ４〜ＰＯＲＴ１５）も、コントロールレジスタに書き込むデータ１９０２の
値を指定して、出力データ１９０３を設定することで制御可能である。ＰＯＲＴ端子に、
モータやソレノイドが接続されていても、同様に制御される。
In this way, the light emission state of the LED PORT0 terminal ~PORT3 terminal I 2 CI /
Even if a motor or solenoid is connected, it is similarly controlled.
図１９は、本発明の第１の実施形態の演出制御データの別の形態を説明する図である。
本図では、オートインクリメントを許可して、ワークレジスタの全ての記憶領域を更新す
る場合を想定しており、演出制御データに含まれる各データの送信順序を規定している。
FIG. 19 is a diagram for explaining another form of effect control data according to the first embodiment of the present invention.
In this figure, it is assumed that auto-increment is permitted and all storage areas of the work register are updated, and the transmission order of each data included in the effect control data is defined.
まず、マスタＩＣ５７０は、制御対象となる装飾制御装置６１０の個別アドレスを特定
可能な８ビットのデータ（図１８のデータ１９０１と同一フォーマットのデータ）を送信
する。
First,
次に、マスタＩＣ５７０は、制御対象のＩ2ＣＩ／Ｏエクスパンダ６１５の出力設定レ
ジスタ６３５のコントロールレジスタに設定されるデータ（図１８のデータ１９０２と同
一フォーマットのデータ）を送信する。本図においては、オートインクリメントを許可し
てワークレジスタの全ての記憶領域を更新するため、自動書込パラメータには「１００」
が指定され、書き込み先又は読み出しの開始位置を指定するレジスタアドレスには、ワー
クレジスタの先頭領域となる「００ｈ」が指定される。
Next,
Is designated, and "00h" which is the head area of the work register is designated as the register address which designates the write destination or the start position of the read.
このため、コントロールレジスタ設定値を受信した後の制御対象となる装飾制御装置６
１０のＩ2ＣＩ／Ｏエクスパンダ６１５においては、レジスタ番号が「００ｈ」の記憶領
域（ＭＯＤＥ１レジスタ）が最初に更新されることになる。
Therefore, the
In the 10 I 2 CI /
次いで、マスタＩＣ５７０は、コントロールレジスタ設定値の送信後、ＭＯＤＥ１レジ
スタに書き込む値（合計８ビット）を送信する。Ｉ2ＣＩ／Ｏエクスパンダ６１５は、当
該書き込み値を受信するとＭＯＤＥ１レジスタの値を更新し、レジスタ番号をインクリメ
ントして次の「０１ｈ」の記憶領域（ＭＯＤＥ２レジスタ）を更新するための準備をする
。
Next, after transmitting the control register set value, the
次いで、マスタＩＣ５７０は、ＭＯＤＥ２レジスタに書き込む値（合計８ビット）を送
信し、以降、レジスタ番号が「０２ｈ」〜「１Ｂｈ」となる残りの記憶領域のレジスタに
対して、順に設定値を送信する。Ｉ2ＣＩ／Ｏエクスパンダ６１５は、当該書き込み値を
受信する毎に対応するレジスタの値を更新し、レジスタ番号をインクリメントして次の記
憶領域を更新するための準備を繰り返すことで、ワークレジスタに割り当てられた「００
ｈ」〜「１Ｂｈ」の全てのレジスタの値が更新される。
Next,
The values of all the registers h "to" 1 Bh "are updated.
なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、ワークレジスタの最終となる「１Ｂｈ」の
記憶領域を更新すると、レジスタ番号は「００ｈ」に変更して、ＭＯＤＥ１レジスタの更
新を待つ状態となる。
When the I 2 CI /
図２０は、本発明の第１の実施形態のマスタＩＣ５７０がＩ2ＣＩ／Ｏエクスパンダ６
１５を初期化するときに、マスタＩＣ５７０からＩ2ＣＩ／Ｏエクスパンダ６１５へ送信
される初期化指示データのデータフォーマットを説明する図である。
FIG. 20 shows the
15 is a diagram for explaining a data format of initialization instruction data transmitted from a
演出制御装置５５０のＣＰＵ５５１がマスタＩＣ５７０に対して装飾制御装置６１０の
初期化を行うように指示すると、マスタＩＣ５７０は、配下に接続している全ての装飾制
御装置６１０に初期化指示データを送信する。
When the
はじめに出力される８ビットのデータ２００１には、図１８に示す固定アドレス「１１
０」と、共通アドレスであるリセットアドレス「１０１１」（図１２参照）とが含まれる
。なお、このデータ２００１は、図１６における「ＡＤＲＥＳＳ」に対応するものであり
、「Ｒ／Ｗ」のビットには、書き込みを示す「０」が設定される。
The 8-bit data 2001 output first has the fixed address “11” shown in FIG.
0 "and a reset address" 1011 "(see FIG. 12) which is a common address. Note that this data 2001 corresponds to "ADRESS" in FIG. 16, and "0" representing writing is set to the bit of "R / W".
次に出力される８ビットのデータ２００２では、第１所定値「１０１００１０１」が出
力さて、次に出力される８ビットのデータ２００３では、第２所定値「０１０１１０１０
」が出力される。なお、このデータ２００２は、図１６において１番目に送信される「Ｄ
ＡＴＡ」に対応し、データ２００３は、図１６において２番目に送信される「ＤＡＴＡ」
に対応する。
Next, in the 8-
"Is output. Note that this
The
Corresponds to
マスタＩＣ５７０に接続されるすべてのＩ2ＣＩ／Ｏエクスパンダ６１５は、リセット
アドレス、第１所定値、及び第２所定値から構成される初期化指示データを受信すると、
自身の初期化を行う。
When all the I 2 CI /
Initialize itself.
リセットアドレスの出力後に、第１所定値及び第２所定値を出力するようにしたのは、
マスタＩＣ５７０がリセットアドレス「１０１１」を送信していないにもかかわらず、ノ
イズなどの影響で、Ｉ2ＣＩ／Ｏエクスパンダ６１５が誤ってリセットアドレス「１０１
１」を取り込んでしまい、誤ったタイミングで初期化が行われることを防止するためであ
る。
The first predetermined value and the second predetermined value are outputted after the output of the reset address.
Even though the
This is to prevent the initialization process from being performed at an incorrect timing.
また、リセットアドレスは、個別アドレスとは異なって、全て（換言すれば複数）のＩ
2ＣＩ／Ｏエクスパンダ６１５に共通なアドレスである。そのため、リセットアドレスを
含んだ初期化指示データを１回送信するだけで、全て（複数）のＩ2ＣＩ／Ｏエクスパン
ダ６１５を選択して初期化することになるので、Ｉ2ＣＩ／Ｏエクスパンダ６１５を個別
に選択して初期化を指示する方法と比較すると、高速に初期化を指示することが可能とな
る。
Also, unlike the individual addresses, the reset addresses are all (in other words, plural) I
2 This is an address common to the CI /
なお、図２０では、第１所定値と第２所定値とを異なる値としたが、同じ値であっても
よい。また、第１所定値及び第２所定値のいずれかが１回送信されるようにしてもよい。
In FIG. 20, although the first predetermined value and the second predetermined value are different values, they may be the same value. Alternatively, one of the first predetermined value and the second predetermined value may be transmitted once.
図２１は、本発明の第１の実施形態の異常判定テーブル２１００を説明する図である。 FIG. 21 is a diagram for explaining the abnormality determination table 2100 according to the first embodiment of this invention.
異常判定テーブル２１００は、演出制御装置５５０のＲＡＭ５５３に格納される。異常
判定テーブル２１００は、演出制御装置５５０のマスタＩＣ５７０と当該マスタＩＣ５７
０に接続されるＩ2ＣＩ／Ｏエクスパンダ６１５との接続状態を監視するものであり、接
続状態の確認結果に対応して、該当するＩ2ＣＩ／Ｏエクスパンダ６１５に対応した後述
のエラーフラグ２１０５が設定される。
The abnormality determination table 2100 is stored in the
It monitors the connection status with the I 2 CI /
異常判定テーブル２１００は、Ｉ／Ｏエクスパンダアドレス２１０１、スレーブアドレ
ス２１０２、エラーカウンタ２１０３、比較値２１０４、及びエラーフラグ２１０５を含
む。
The abnormality determination table 2100 includes an I /
Ｉ／Ｏエクスパンダアドレス２１０１は、マスタＩＣ５７０に接続されるＩ2ＣＩ／Ｏ
エクスパンダ６１５のＡ０〜Ａ３の端子に設定されているアドレス（図８参照）に対応し
ている。
The I /
It corresponds to the address (see FIG. 8) set to the terminals A0 to A3 of the
スレーブアドレス２１０２には、図１２に示すＩ2ＣＩ／Ｏエクスパンダアドレステー
ブル１２００に登録されているスレーブアドレスが登録される。
The slave address registered in the I 2 CI / O expander address table 1200 shown in FIG. 12 is registered in the
エラーカウンタ２１０３は、マスタＩＣ５７０からＩ2ＣＩ／Ｏエクスパンダ６１５へ
の演出制御データの送信に対して、Ｉ2ＣＩ／Ｏエクスパンダ６１５からのＡＣＫが受信
できたか否かを監視した際に、このＡＣＫの受信に２回連続して失敗するとインクリメン
トされるものである。
When the
比較値２１０４には所定値が登録される。エラーフラグ２１０５には、当該エントリの
Ｉ2ＣＩ／Ｏエクスパンダ６１５との接続状態に異常が発生したか否かを示すエラーフラ
グが登録される。
A predetermined value is registered as the
具体的には、インクリメントされたエラーカウンタ２１０３の値が、比較値２１０４に
登録された所定値に達した場合に、エラーフラグ２１０５にＯＮが設定されて当該エント
リのＩ2ＣＩ／Ｏエクスパンダ６１５に異常が発生したことが登録される。
Specifically, when the value of the incremented
なお、Ｉ／Ｏエクスパンダアドレス２１０１に登録された「０１１０」のＩ2ＣＩ／Ｏ
エクスパンダ６１５は、図８Ｂに示すように、役物駆動ＳＯＬ５６０や役物駆動ＭＯＴ５
６１といった可動装置を制御している。そこで、このＩ2ＣＩ／Ｏエクスパンダ６１５を
備える装飾制御装置６１０を、可動制御装置（可動グループ単位制御手段）ということに
する。
In addition, the I 2 CI / O of “0110” registered in the I /
The
It controls mobile devices such as 61. Therefore, the
一方、Ｉ／Ｏエクスパンダアドレス２１０１に登録された「０１１０」以外のＩ2ＣＩ
／Ｏエクスパンダ６１５は、図８Ａに示すように、ＬＥＤ等の発光装置を制御している。
そのため、このＩ2ＣＩ／Ｏエクスパンダ６１５を備える装飾制御装置６１０を、前述の
可動制御装置と区別するために、発光制御装置（発光グループ単位制御手段）ということ
にする。
On the other hand, I 2 CIs other than “0110” registered in the I /
The /
Therefore, the
図２１では、可動制御装置（Ｉ／Ｏエクスパンダアドレス２１０１に登録された値が「
０１１０」）のエントリが存在せず、発光制御装置のエントリのみが登録されている。
In FIG. 21, the value registered in the movable control device (I /
There is no entry of “0110”, and only the entry of the light emission control device is registered.
可動制御装置に異常が発生している場合には、役物駆動ＭＯＴ５６１が回転しすぎて、
可動役物６０が動作可能な範囲を超えて可動してしまい、可動役物６０及び可動役物付近
の部材を破損してしまうことを防止するため、発光制御装置よりも短時間で異常判定する
必要がある。そのため、可動制御装置の接続監視タイミングと発光制御装置の接続監視タ
イミングとが異なるので、換言すると、可動制御装置の接続監視の構成と発光制御装置の
接続監視の構成とが異なるので、異常判定テーブル２１００から可動制御装置のエントリ
が除外されているのである。
If an abnormality occurs in the movable control device, the
In order to prevent the
具体的には、本実施形態では、後述するように、発光制御装置のデータ出力処理（図２
２参照）は、ＶＤＰ割込（約３３．３ｍｓ周期）に同期して実行されるようし、可動制御
装置のデータ出力処理をタイマ割込（２ｍｓ周期）に同期して実行されるようにしている
。
Specifically, in the present embodiment, as described later, data output processing of the light emission control device (FIG.
2) is to be executed in synchronization with the VDP interrupt (about 33.3 ms cycle) and to execute data output processing of the mobile control device in synchronization with the timer interrupt (2 ms cycle) There is.
前述したように、マスタＩＣ５７０から、発光制御装置に備えられるＩ2ＣＩ／Ｏエク
スパンダ６１５への２回目の演出制御データの送信に対して、当該Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５からのＡＣＫが受信できなければ、エラーカウンタ２１０３がインクリメント
される。
As described above, in response to the second transmission of presentation control data from the
したがって、発光制御装置に異常が発生している場合には、データ出力処理の実行周期
が３３ｍｓで、比較値２１０４が「３００」であるので、３３．３ｍｓ×３００≒１０ｓ
で発光制御装置に異常が発生したことを検出する。
Therefore, when an abnormality occurs in the light emission control device, the execution period of data output processing is 33 ms, and the
Detects that an abnormality has occurred in the light emission control device.
なお、可動制御装置に異常が発生している場合には、データ出力処理の実行周期が２ｍ
ｓであり、後述するように、次の実行周期を待つことなく、異常が発生したことを検出す
るので、極めて短時間（２ｍｓ程度の時間）で可動制御装置に異常が発生したことを検出
できる。
When an abnormality occurs in the movable control device, the execution cycle of data output processing is 2 m
s, and as described later, since occurrence of abnormality is detected without waiting for the next execution cycle, occurrence of abnormality in the movable control device can be detected in a very short time (a time of about 2 ms). .
このため、可動制御装置のエラー判定が発光制御装置のエラー判定よりも頻繁に行われ
、可動制御装置に異常が発生したことを発光制御装置に異常が発生したことよりも早く検
出することができるので、可動役物６０が動作可能な範囲を超えて可動してしまい、可動
役物６０及び可動役物付近の部材を破損してしまうことを防止できる。
For this reason, the error determination of the movable control device is performed more frequently than the error determination of the light emission control device, and the occurrence of an abnormality in the movable control device can be detected earlier than the occurrence of an abnormality in the light emission control device. Therefore, it is possible to prevent the
これに対して、ＬＥＤ等の発光装置は、誤動作によって破損する恐れが少ないため、発
光制御装置に関する異常判定に時間を要しても問題が生じることはない。
On the other hand, since the light emitting device such as the LED is less likely to be damaged due to a malfunction, the problem does not occur even if it takes time to determine the abnormality regarding the light emission control device.
従って、異常判定を短時間で行う必要がある装飾制御装置６１０に限定して判定の周期
を短縮し、他の装飾制御装置６１０の異常判定を余裕のある周期で行うので、処理負担の
バランスを考慮した異常判定処理を実行することが可能となる。
Therefore, the cycle of determination is shortened by limiting to the
また、Ｉ／Ｏエクスパンダアドレス２１０１には「０１１１」が登録されていない。ア
ドレス「０１１１」を装飾制御装置６１０に付与することも可能であるが、本実施形態で
は、この「０１１１」のアドレスは使用しないため、Ｉ／Ｏエクスパンダアドレス２１０
１に登録されない。
Further, “0111” is not registered in the I /
Not registered in 1.
一つのマスタＩＣ５７０には、１４個のＩ2ＣＩ／Ｏエクスパンダ６１５が接続可能で
あるが、一つのマスタＩＣ５７０には１４個すべてのＩ2ＣＩ／Ｏエクスパンダ６１５が
接続されなくてもよい。例えば、本実施形態では、上述したように、図２０に示す異常判
定テーブル２１００に対応するマスタＩＣ５７０には、１３個のＩ2ＣＩ／Ｏエクスパン
ダ６１５が接続されるようになっている。
Although 14 I 2 CI /
このように、アドレスが付与されるＩ2ＣＩ／Ｏエクスパンダ６１５は、マスタＩＣ５
７０に接続可能なＩ2ＣＩ／Ｏエクスパンダ６１５であり、かつ遊技の演出を行う可能性
のある装飾装置６２０を制御する装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５
である。
Thus, the I 2 CI /
An I 2 CI /
It is.
このため、異常判定テーブル２１００のＩ／Ｏエクパンダアドレス２１０１には、マス
タＩＣ５７０に接続可能なＩ2ＣＩ／Ｏエクスパンダ６１５であって、かつ、遊技の演出
を行う可能性のある装飾装置６２０を制御する装飾制御装置６１０のＩ2ＣＩ／Ｏエクス
パンダ６１５のアドレスが登録される。
Therefore, the I /
なお、Ｉ／Ｏエクスパンダアドレス２１０１に登録されたすべてのアドレスのＩ2ＣＩ
／Ｏエクスパンダ６１５がマスタＩＣ５７０に実際に接続されておらず、一部のアドレス
のＩ2ＣＩ／Ｏエクスパンダ６１５のみがマスタＩＣ５７０に接続されている。
The I 2 CIs of all the addresses registered in the I /
The /
図２１においては、例えば、アドレスが「００００」のＩ2ＣＩ／Ｏエクスパンダ６１
５がマスタＩＣ５７０に接続されていなく、その他のアドレスのＩ2ＣＩ／Ｏエクスパン
ダ６１５はマスタＩＣ５７０に接続されているものとする。
In FIG. 21, for example, the I 2 CI / O expander 61 whose address is “0000”.
It is assumed that 5 is not connected to the
図２５で説明するように、マスタＩＣ５７０は、Ｉ／Ｏエクスパンダアドレス２１０１
に登録されたすべてのアドレスに対して、装飾制御データを送信するので、Ｉ／Ｏエクス
パンダアドレス２１０１に登録されたアドレスのＩ2ＣＩ／Ｏエクスパンダ６１５であれ
ば、マスタＩＣ５７０に接続されても、接続されなくても、同じ制御プログラムで、マス
タＩＣ５７０に接続されたＩ2ＣＩ／Ｏエクスパンダ６１５を制御できる。
As described in FIG. 25,
Since the decoration control data is transmitted to all the addresses registered in, if it is the I 2 CI /
なお、遊技の演出を行う可能性のある装飾装置６２０を制御する装飾制御装置６１０の
Ｉ2ＣＩ／Ｏエクスパンダ６１５が１４個存在すれば、当該１４個のＩ2ＣＩ／Ｏエクスパ
ンダ６１５にアドレスが付与され、当該マスタＩＣ５７０に１４個のＩ2ＣＩ／Ｏエクス
パンダ６１５が接続されてもよい。
In addition, if there are 14 I 2 CI /
図２２は、本発明の第１実施形態の演出制御装置５５０による処理のフローチャートで
ある。
FIG. 22 is a flowchart of processing by the
図２２に示す演出制御装置５５０の処理は、演出制御装置５５０のＣＰＵ５５１によっ
て実行される。
The processing of the
演出制御装置５５０は、演出制御装置５５０に電源が投入されると、まずステップ２２
０１〜２２１０の処理を実行した後、ＶＤＰ５５６から画像更新周期と同期する同期信号
（例えば、３３ｍｓ秒周期の同期信号）がＣＰＵ５５１に入力されるまで待機する。そし
て、以降は、ＶＤＰ５５６から画像更新周期と同期する同期信号がＣＰＵ５５１に入力さ
れる毎に、ステップ２２０４〜２２１０の処理を繰り返し実行する。
When the
After the processes of 01 to 2210 are executed, the process waits until a synchronization signal (for example, a synchronization signal having a cycle of 33 ms seconds) synchronized with the image update cycle is input to the
まず、演出制御装置５５０は、演出制御装置５５０のＲＡＭ５５３を初期化する（２２
０１）。このとき、当該演出制御装置５５０への電源投入時を基点として、ＣＰＵ５５１
からＶＤＰ５５６や音ＬＳＩ５５７に出力される、初回の制御データも生成される。
First, the
01). At this time, with the power on to the
The first control data to be output to the
次に、演出制御装置５５０は、マスタＩＣ５７０、及びマスタＩＣ５７０に接続された
装飾制御装置６１０、を初期化するＩ2Ｃ初期リセット処理を実行する（２２０２）。Ｉ2
Ｃ初期リセット処理は、図２３で詳細を説明する。このＩ2Ｃ初期リセット処理が実行さ
れると、役物駆動ＭＯＴ５６１、及び役物駆動ＳＯＬ５６０の初期化動作も開始される。
Next, the
The C initial reset process will be described in detail with reference to FIG. When this I 2 C initial reset process is executed, initialization operations of the
そして、演出制御装置５５０は、ＶＤＰ５５６から画像更新周期と同期する同期信号（
ＶＤＰ割込）、及びタイマ割込の受け入れを許可する（２２０３）。
Then, the
VDP interrupt) and timer interrupt acceptance are permitted (2203).
そして、演出制御装置５５０は、表示装置５３に画像を表示するために、ＶＤＰ５５６
に画像を表示させる指令となるデータを出力し（２２０４）、スピーカ３０から音を遊技
状態に応じて出力させるために、音制御データを音ＬＳＩ５５７に出力し、音ＬＳＩ５５
７に音制御データに基づいてスピーカ３０から音を出力させる（２２０５）。
Then, the
The sound control data is output to the sound LSI 557 in order to output the data to be an instruction to display the image on the screen (2204), and to output the sound from the
7 makes the
次に、演出制御装置５５０は、発光制御装置に演出制御データをマスタＩＣ５７０から
出力する発光制御スレーブ出力処理を実行する（２２０６）。発光制御スレーブ出力処理
は、図２５で詳細を説明する。
Next, the
そして、演出制御装置５５０は、ＶＤＰ５５６に次に出力されるデータを編集し（２２
０７）、音ＬＳＩ５５７に次に出力される音制御データを編集し（２２０８）、各グルー
プの発光制御装置に次に出力される演出制御データを編集する（２２０９）。
Then, the
07) Edit the sound control data to be output next to the sound LSI 557 (2208), and edit the effect control data to be output next to the light emission control device of each group (2209).
次に、演出制御装置５５０は、異常判定テーブル２１００を参照して、すべての発光制
御装置のエラーフラグ２１０５がＯＮになっている場合にリセット条件が成立したとみな
し、マスタＩＣ５７０、役物駆動ＭＯＴ５６１、マスタＩＣ５７０に接続されたすべての
Ｉ2ＣＩ／Ｏエクスパンダ６１５、及び役物駆動ＳＯＬ５６０の初期化を指示するＩ2Ｃ随
時リセット処理を実行し（２２１０）、その後、ＶＤＰ５５６から同期信号がＣＰＵ５５
１に入力されるまで待機する。Ｉ2Ｃ随時リセット処理は、図２７で詳細を説明する。
Next, referring to the abnormality determination table 2100, the
Wait until 1 is entered. The I 2 C random reset process will be described in detail with reference to FIG.
図２２による処理では、表示装置５３の画像を更新する周期と同期して、演出制御装置
５５０のマスタＩＣ５７０から装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５へ
演出制御データを送信し、Ｉ2ＣＩ／Ｏエクスパンダ６１５は受信した演出制御データに
基づいて装飾装置６２０を制御するので、表示装置５３における演出と装飾装置６２０に
おける演出とが調和し、遊技者に違和感を与えないので、興趣を高めることができる。
In the process according to FIG. 22, in synchronization with the cycle of updating the image of the
また、表示装置５３の画像を更新する周期と同期してマスタＩＣ５７０から送信された
演出制御データが装飾制御装置６１０で受信されると、その都度、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５によってワークレジスタの値が更新される。そのため、毎回ワークレジスタの
値が最新の状態に更新されるので、ノイズ等でワークレジスタの値が破壊されても、正常
な値に復帰することが可能である。
Also, each time the
また、表示装置５３の画像を更新する周期と同期して、ステップ２２１１の処理で実行
されるエラー判定処理を実行するので、エラー判定の実行頻度を適切にできる、つまり、
エラー判定処理の実行頻度が高すぎる（単位時間当たりの実行回数が多すぎる）と、演出
制御装置５５０のＣＰＵ５５１の処理負荷が増大してしまい、逆に、エラー判定処理の実
行頻度が低すぎる（単位時間当たりの実行回数が少なすぎる）と、異常が発生したことを
適切に検出できなくなってしまうことになるので、適度な頻度でエラー判定を行うことに
より処理の不具合を防止することができる。
Further, since the error determination process executed in the process of step 2211 is performed in synchronization with the cycle of updating the image of the
If the execution frequency of the error judgment processing is too high (the number of executions per unit time is too high), the processing load of the
図２３は、本発明の第１実施形態のＩ2Ｃ初期リセット処理のフローチャートである。 FIG. 23 is a flowchart of I 2 C initial reset processing according to the first embodiment of this invention.
Ｉ2Ｃ初期リセット処理は、演出制御装置５５０への電源投入の直後に、マスタＩＣ５
７０、マスタＩＣ５７０に接続されたすべてのＩ2ＣＩ／Ｏエクスパンダ６１５の初期化
を指示する処理であり、図２２に示すステップ２２０２の処理で実行される。なお、当該
処理中にて、役物駆動ＭＯＴ５６１、及び役物駆動ＳＯＬ５６０の初期化動作の開始が指
示される。
The I 2 C initial reset process is performed immediately after the
70, processing for instructing initialization of all the I 2 CI /
まず、演出制御装置５５０のＣＰＵ５５１は、初期化中であることを示すリセット要求
フラグを設定し（２３０１）、入出力Ｉ／Ｆ５５８とＮＯＲゲート回路５９０とを介して
リセットパルスをマスタＩＣ５７０へ入力し、マスタＩＣ５７０をハード的に初期化（ハ
ードリセット）する（２３０２）。
First, the
ハードリセットとは、マスタＩＣ５７０の図示しないリセット回路にマスタＩＣ５７０
のＲＥＳＥＴ端子が接続されており、ＲＥＳＥＴ端子に印加される電圧が所定時間ロウレ
ベルに保持されることによって、マスタＩＣ５７０のリセット回路がマスタＩＣ５７０自
身をリセットすることをいう。なお、このＲＥＳＥＴ端子は、本実施形態における初期化
信号入力指示端子として機能している。
The hard reset refers to the
The RESET terminal is connected, and the reset circuit of the
本実施形態では、このＲＥＳＥＴ端子に印加されるリセット信号が、前述したように、
演出制御装置５５０に備わっている他の回路にも接続されている。この他の回路とは、例
えば、ＶＤＰ５５６や音ＬＳＩ５５７などであり、演出制御装置５５０に電源が投入され
て起動したときに、ＣＰＵ５５１により初期化されるものである。従って、電源投入時に
は、ハードリセットによって、マスタＩＣ５７０とともに、これらの回路もあわせて初期
化できるため、処理の高速化が期待できる。
In the present embodiment, the reset signal applied to the RESET terminal is, as described above,
It is also connected to other circuits provided in the
次に、演出制御装置５５０は、マスタＩＣ５７０に接続されたすべての装飾制御装置６
１０のＩ2ＣＩ／Ｏエクスパンダ６１５を初期化するために、マスタＩＣ５７０から初期
化指示データを出力するスレーブリセット処理を実行する（２３０３）。スレーブリセッ
ト処理は、図２４で詳細を説明する。
Next, the
In order to initialize the 10 I 2 CI /
次に、演出制御装置５５０は、ステップ２３０２の処理、及びステップ２３０３の処理
でマスタＩＣ５７０及びＩ2ＣＩ／Ｏエクスパンダ６１５の初期化が完了したので、リセ
ット要求フラグを解除する（２３０４）。そして、演出制御装置５５０は、役物駆動ＭＯ
Ｔ５６１が初期化中であることを示すモータ初期化フラグを設定する（２３０５）。なお
、役物駆動ＭＯＴ５６１の初期化とは、役物駆動ＭＯＴ５６１の回転軸を初期位置に戻す
処理であり、図２８に示すタイマ割込処理で行われる。
Next, since the initialization of the
A motor initialization flag indicating that T561 is being initialized is set (2305). The initialization of the
次に、演出制御装置５５０は、役物駆動ＭＯＴ５６１を初期化する場合に役物駆動ＭＯ
Ｔ５６１に出力されるモータ出力データをＲＡＭ５５３に設定する（２３０６）。そして
、演出制御装置５５０は、役物駆動ＳＯＬ５６０を初期化するために、役物駆動ＳＯＬ５
６０の通電状態を非通電状態にするオフデータを役物駆動ＳＯＬ５６０に出力し（２３０
７）、図２２に示すステップ２２０３の処理に進む。なお、役物駆動ＳＯＬ５６０の初期
化とは、役物駆動ＳＯＬ５６０の通電状態を非通電状態にすることである。
Next, when the
The motor output data output to T561 is set in the RAM 553 (2306). Then, the
Output OFF data to turn off the 60 energized states to the non-energized state to the bonus drive SOL 560 (230
7) Go to the processing of
なお、ＣＰＵ５５１は、入出力Ｉ／Ｆ５５８とＮＯＲゲート回路５９０とを介してリセ
ットパルスをマスタＩＣ５７０へ入力し、マスタＩＣ５７０をハード的にリセットすると
したが、ＣＰＵ５５１から、バス５６３を介してリセットレジスタ５７３に情報を書き込
むことにより、マスタＩＣ５７０をソフト的にリセットしてもよい。
Although the
図２４は、本発明の第１実施形態のスレーブリセット処理のフローチャートである。 FIG. 24 is a flowchart of slave reset processing according to the first embodiment of this invention.
スレーブリセット処理は、Ｉ2ＣＩ／Ｏエクスパンダ６１５を初期化するための初期化
指示データをＩ2ＣＩ／Ｏエクスパンダ６１５に送信する処理であり、図２３に示すステ
ップ２３０３の処理、及び図２７に示すステップ２７０６の処理で実行される。
Slave reset process is a process of transmitting an initialization instruction data for initializing the I 2 CI /
初期化指示データは、マスタＩＣ５７０からバイトモードで送信される。バイトモード
では、マスタＩＣ５７０は、Ｉ2ＣＩ／Ｏエクスパンダ６１５へデータを１バイト送信す
る毎に、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＡＣＫ又はＮＡＣＫを受信し、ＡＣＫ及び
ＮＡＣＫの何れを受信した場合でも、割込信号をＣＰＵ５５１に出力する。つまり、マス
タＩＣ５７０からＩ2ＣＩ／Ｏエクスパンダ６１５へ１バイトのデータを送信することが
完了すれば、ＡＣＫ／ＮＡＣＫの受信に拘らず、必ず、マスタＩＣ５７０からＣＰＵ５５
１へ割込信号が出力される。
The initialization instruction data is transmitted from
An interrupt signal is output to 1.
まず、マスタＩＣ５７０は、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを、スタート
条件を示す信号レベルに変化させる（２４０１）。
First, the
次に、ＣＰＵ５５１は、リセットアドレス（図２０参照）を示す１バイト分のデータを
出力用ＢＵＦ５７２に設定する（２４０２）。
Next, the
そして、ＣＰＵ５５１は、マスタＩＣ５７０へデータ送信の開始を指示した時点から、
マスタＩＣ５７０がＣＰＵ５５１へ割込信号を伝達させるまでの時間を監視するために、
バイトモード用の監視タイマの起動を開始する（２４０３）。以降、この監視時間をバイ
トモード監視時間ということにする。
Then, from the time when the
In order to monitor the time until
The start of the monitoring timer for the byte mode is started (2403). Hereinafter, this monitoring time will be referred to as a byte mode monitoring time.
ＣＰＵ５５１は、バイトモード時間の監視を開始してから所定時間経過しても、マスタ
ＩＣ５７０から割込信号を受け付けていない場合には、タイムアウトが発生したとして、
データ送信を中断するために、マスタＩＣ５７０にストップ条件を出力させ（２４１５）
、その後、ステップ２４０１の処理に戻り、再度マスタＩＣ５７０にスタート条件を出力
させてから、初期化指示データを初めのデータから送信する。
If the
In order to interrupt data transmission, the
After that, the process returns to step 2401 to make the
次に、マスタＩＣ５７０は、ステップ２４０２の処理で出力用バッファ５７２に設定さ
れたリセットアドレスをＩ2ＣＩ／Ｏエクスパンダ６１５に出力する（２４０４）。マス
タＩＣ５７０は、このリセットアドレスを出力する際に、一旦、ドライバ５７６Ａをオフ
させて接続線ＳＤＡを解放する（ハイレベルに変化させる）動作を行う。そして、接続線
ＳＤＡが解放されていない場合（ドライバ５７６Ａをオフしても、接続線ＳＤＡがハイレ
ベルにならずロウレベルのままで維持されているとき）には、このリセットアドレスの出
力は、接続線ＳＤＡが開放される（接続線ＳＤＡがハイレベルになる）まで待機する。
Next, the
次に、マスタＩＣ５７０は、１バイト分のデータ出力完了から、所定時間（前述したバ
イトモード監視時間よりも短い監視時間となっている）以内にＡＣＫの返答信号がマスタ
ＩＣ５７０に入力されたか否かを確認する（２４０５）。
Next, the
そして、マスタＩＣ５７０は、ステップ２４０５の処理の確認結果に基づいて、データ
が出力されてから所定時間以内にＡＣＫの返答信号が入力されているか否かを判定する（
２４０６）。
Then, based on the confirmation result of the process of
2406).
ステップ２４０６の処理で、データが出力されてから所定時間以内にＡＣＫの返答信号
が入力されていないと判定された場合、マスタＩＣ５７０は、ステータスＲＥＧ５７９に
返答信号がＮＡＣＫであった旨の情報を設定したうえで、割込信号を発生させる。これに
より、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＮＡＣＫの返答信号を受信したことが、ＣＰ
Ｕ５５１に通知される。このとき、ＣＰＵ５５１はバイトモードの時間監視を終了する（
２４０７）。
If it is determined in the process of
It is notified to U551. At this time, the
2407).
次いで、ＣＰＵは、データ送信を中断するために、マスタＩＣ５７０にストップ条件を
出力させ（２４１５）、その後、ステップ２４０１の処理に戻り、再度マスタＩＣ５７０
にスタート条件を出力させてから、初期化指示データを再度出力する。
Next, the CPU causes the
After making the start condition output, the initialization instruction data is output again.
ステップ２４０６の処理で、データが出力されてから所定時間以内にＡＣＫの返答信号
が入力されたと判定された場合、マスタＩＣ５７０は、ステータスＲＥＧ５７９に返答信
号がＡＣＫであった旨の情報を設定したうえで、割込信号を発生させる。これにより、Ｉ
2ＣＩ／Ｏエクスパンダ６１５からＡＣＫの返答信号を受信したことが、ＣＰＵ５５１に
通知される。このとき、ＣＰＵ５５１はバイトモードの時間監視を終了する（２４０８）
。
If it is determined in the process of
The
.
そして、ＣＰＵ５５１は、初期化指示データを構成する３種類のデータ（図２０に示す
、リセットアドレスを含むデータ２００１、第１所定値のデータ２００２、及び第２所定
値のデータ２００３）をすべて出力したか否かを判定する（２４０９）。なお、これらの
データは出力順序が予め定められているので、ステップ２４０９の処理では、第２所定値
のデータ２００３が出力された直後か否かを判定すればよい。
Then,
ステップ２４０９の処理で、初期化指示データを構成するすべてのデータを出力したと
判定された場合、つまり、図２０に示す第２所定値を示すデータを出力した場合には、マ
スタＩＣ５７０は、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを、ストップ条件を示す
信号レベルに変化させ（２４１０）、スレーブリセット処理を終了する。
If it is determined in the process of
ステップ２４０９の処理で、初期化指示データ構成するすべてのデータ出力していない
と判定された場合には、ＣＰＵ５５１は、次に送信される１バイトのデータを出力用ＢＵ
Ｆ５７２に設定する（２４１１）。リセットアドレスを出力した直後に実行されるステッ
プ２４１１の処理では、出力用ＢＵＦ５７２には、図２０に示す第１所定値のデータ２０
０２が設定され、第１所定値のデータを出力した直後に実行されるステップ２４１１の処
理では、出力用ＢＵＦ５７２には、図２０に示す第２所定値のデータ２００２が設定され
る。
If it is determined in the process of
It sets to F572 (2411). In the process of
In the process of
そして、ＣＰＵ５５１は、マスタＩＣ５７０へデータ送信の開始を指示した時点から、
マスタＩＣ５７０がＣＰＵ５５１へ割込信号を伝達させるまでの時間を監視するために、
バイトモード用の監視タイマの起動を開始する（２４１２）。
Then, from the time when the
In order to monitor the time until
The start of the monitoring timer for the byte mode is started (2412).
次に、マスタＩＣ５７０は、接続線ＳＤＡの電圧レベルを監視し、接続線ＳＤＡが解放
されていることを確認してから（２４１３）、出力用ＢＵＦ５７２に設定された１バイト
のデータを出力し（２４１４）、ステップ２４０５の処理に進む。ステップ２４１３の処
理は、グループ単位制御手段からの返答信号の出力が終了するまでは、接続線ＳＤＡが返
答信号により占有されているので、マスタＩＣ５７０は、グループ単位制御手段からの返
答信号の出力が終了し、接続線ＳＤＡが解放されるまで待機する処理である。
Next,
以上より、初期化指示データは、１バイトのデータを出力するごとに（つまり、３バイ
トの初期化指示データを送信する途中で）、出力した１バイトのデータに対する返答信号
が否かを示す割込信号が出力されるか否かを監視するバイトモードで送信される。
From the above, each time the initialization instruction data outputs 1 byte of data (that is, while sending 3 bytes of initialization instruction data), it indicates whether the response signal to the 1 byte data that has been output indicates no or not. It is transmitted in a byte mode to monitor whether or not a load signal is output.
なお、ステップ２４０３の処理、及びステップ２４１２の処理において、１バイトのデ
ータを送信してからマスタＩＣ５７０から割込信号が出力されるまでの時間の監視は、Ｃ
ＰＵ５５１が行ったが、マスタＩＣ５７０自身が、１バイトのデータを送信してからマス
タＩＣ５７０から割込信号を出力するまでの時間を監視してもよい。
In the process of
Although performed by the
図２５は、本発明の第１実施形態の発光制御スレーブ出力処理のフローチャートである
。
FIG. 25 is a flowchart of light emission control slave output processing according to the first embodiment of this invention.
発光制御スレーブ出力処理は、発光装置に接続されるＩ2ＣＩ／Ｏエクスパンダ６１５
（発光制御装置）に発行制御データを送信する処理であり、図２２に示すステップ２２０
６の処理で実行される。
Light emission control slave output processing, I 2 CI /
22 is a process of transmitting issue control data to the (light emission control device), and step 220 shown in FIG.
It is executed in the process of 6.
まず、演出制御装置５５０は、時分割カウンタをインクリメントする（２５０１）。時
分割カウンタは、０〜３までの整数をカウントするカウンタである。
First, the
後述するように、本実施形態の遊技機では、図２１に示す異常判定テーブル２１００に
より、マスタＩＣ５７０に接続されていることが確定したＩ2ＣＩ／Ｏエクスパンダ６１
５に対して、定期的にマスタＩＣ５７０からデータを送信するのはもちろんのこと、マス
タＩＣ５７０に接続されていないＩ2ＣＩ／Ｏエクスパンダ６１５にも、一定の間隔でマ
スタＩＣ５７０からデータを送信している。
As described later, in the gaming machine of this embodiment, the I 2 CI / O expander 61 determined to be connected to the
5, the
これは、現時点では接続されていないＩ2ＣＩ／Ｏエクスパンダ６１５が、遊技店の営
業中にマスタＩＣ５７０と接続を再開したような場合を想定しているからである。但し、
接続が確定しているＩ2ＣＩ／Ｏエクスパンダ６１５よりもデータ送信頻度を低くするた
めに、時分割カウンタが０である場合にのみマスタＩＣ５７０からデータ送信を行うよう
にしている。
This is because it is assumed that the I 2 CI /
In order to make the data transmission frequency lower than that of the I 2 CI /
次に、演出制御装置５５０は、ステップ２５０１の処理でインクリメントされた時分割
カウンタの値が最大値よりも大きいか否かを判定する（２５０２）。
Next, the
ステップ２５０２の処理で、時分割カウンタの値が最大値よりも大きいと判定された場
合、時分割カウンタの値を０に設定する（２５０３）。
If it is determined in the process of
ここで、時分割カウンタの最大値は３に設定されるので、時分割カウンタの値が３より
も大きくなると、つまり、時分割カウンタの値が４になると、時分割カウンタの値が０に
設定される。したがって、時分割カウンタは発光制御装置スレーブ処理が実行されるたび
にインクリメントされ、０→１→２→３→０→・・・と変化する。
Here, since the maximum value of the time division counter is set to 3, when the value of the time division counter becomes larger than 3, that is, when the value of the time division counter becomes 4, the value of the time division counter is set to 0 Be done. Therefore, the time division counter is incremented each time the light emission control device slave process is executed, and changes as 0 → 1 → 2 → 3 → 0 →...
ステップ２５０２の処理で、時分割カウンタの値が最大値以下であると判定された場合
、又は、ステップ２５０３の処理の実行後、演出制御装置５５０は、図２１に示す異常判
定テーブル２１００から一つのアドレスを選択し、送信先となるＩ2ＣＩ／Ｏエクスパン
ダ６１５を選択する（２５０４）。
If it is determined in the process of
具体的には、演出制御装置５５０は、図２１に示す異常判定テーブル２１００のＩ／Ｏ
エクスパンダアドレス２１０１に登録されたアドレスから一つのアドレスを選択する。ス
テップ２５０４の処理で選択されたアドレスのＩ2ＣＩ／Ｏエクスパンダ６１５が送信先
のＩ2ＣＩ／Ｏエクスパンダ６１５となる。
Specifically, the
One address is selected from the addresses registered in the
次に、演出制御装置５５０は、ステップ２５０４の処理で選択されたＩ2ＣＩ／Ｏエク
スパンダ６１５が当該マスタＩＣ５７０に接続されているか否かを判定するめに、図２１
に示す異常判定テーブル２１００を参照し、ステップ２５０４の処理で選択されたアドレ
スのエントリに含まれるエラーフラグ２１０５がＯＮとなっているか否かを判定する（２
５０５）。
Next, the
It is determined whether the
505).
ステップ２５０４の処理で選択されたアドレスのエントリに含まれるエラーフラグ２１
０５がオンであるとステップ２５０５の処理で判定された場合には、当該アドレスへのデ
ータ送信が比較値２１０４に登録された値まで連続して失敗しているので、当該アドレス
のＩ2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ５７０に接続されていないと判定する。
そして、演出制御装置５５０は、ＲＰに０を設定する（２５０６）。
If 05 is determined in the processing in
Then, the
ＲＰは、図２６で詳細を説明するが、マスタＩＣ５７０から送信先となるＩ2ＣＩ／Ｏ
エクスパンダ６１５へのデータ送信が失敗した場合（マスタＩＣ５７０がＩ2ＣＩ／Ｏエ
クスパンダ６１５からＡＣＫの返答信号を受信できなかった場合、又は、ＣＰＵ５５１に
データ送信開始から所定時間経過してもマスタＩＣ５７０から割込信号が入力されなかっ
た場合）に、当該データの再送信回数を決定するものである。
RP is described in detail with reference to FIG 26, the transmission destination by the master IC570 I 2 CI / O
If data transmission to the
したがって、ステップ２５０６の処理では、ＲＰに０を設定するので、マスタＩＣ５７
０にＩ2ＣＩ／Ｏエクスパンダ６１５が接続されていない場合には、当該Ｉ2ＣＩ／Ｏエク
スパンダ６１５へのデータ送信が失敗しても再送信は行わないように設定される。
Therefore, in the process of
When the I 2 CI /
次に、演出制御装置５５０は、時分割カウンタの値が０であるか否かを判定する（２５
０７）。
Next, the
07).
ステップ２５０７の処理で、時分割カウンタの値が０であると判定された場合、演出制
御装置５５０は、スレーブ連続出力処理を実行して、送信先となるＩ2ＣＩ／Ｏエクスパ
ンダ６１５にデータを送信する（２５０８）。
If it is determined in the process of
一方、ステップ２５０７の処理で、時分割カウンタの値が０でないと判定された場合、
スレーブ連続出力処理を実行せずに、ステップ２５０９の処理に進む。
On the other hand, if it is determined in the process of
The process proceeds to step 2509 without executing the slave continuous output process.
したがって、マスタＩＣ５７０に接続されていないＩ2ＣＩ／Ｏエクスパンダ６１５へ
のデータ送信は、発光制御スレーブ出力処理が４回実行されると１回の頻度で行われる。
Therefore, data transmission to the I 2 CI /
なお、スレーブ連続出力処理は、図２６で詳細を説明する。 The slave continuous output processing will be described in detail with reference to FIG.
ステップ２５０８の処理で実行されるスレーブ連続処理が終了した場合、又はステップ
２５０７の処理で時分割カウンタが０でないと判定された場合、演出制御装置５５０は、
図２１に示す異常判定テーブル２１００に登録されたすべてのアドレスに対してデータ送
信が終了したか否かを判定する（２５０９）。
When the slave continuous process executed in the process of
It is determined whether data transmission has ended for all addresses registered in the abnormality determination table 2100 shown in FIG. 21 (2509).
ステップ２５０９の処理で、図２１に示す異常判定テーブル２１００に登録されたすべ
てのアドレスに対してデータ送信が終了していないと判定された場合、演出制御装置５５
０は、図２１に示す異常判定テーブル２１００に登録されたアドレスのうち、まだデータ
送信が行われていないアドレスを選択して（２５１０）、ステップ２５０５の処理に戻る
。ステップ２５０９の処理で、図２１に示す異常判定テーブル２１００に登録されたすべ
てのアドレスに対してデータ送信が終了していると判定された場合は、ストップコンディ
ションを出力して（２５１２）、呼び出し元の処理に戻る。
If it is determined in the process of
0 selects an address for which data transmission has not been performed yet among addresses registered in the abnormality determination table 2100 shown in FIG. 21 (2510), and returns to the process of
一方、ステップ２５０４の処理で選択されたアドレスのエントリに含まれるエラーフラ
グ２１０５がオフであるとステップ２５０５の処理で判定された場合には、当該アドレス
のＩ2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ５７０に接続されていると判定する。そ
して、演出制御装置５５０は、ＲＰに２を設定し（２５１１）、ステップ２５０８の処理
に進む。
On the other hand, when it is determined in the process of
ステップ２５１１の処理では、ＲＰに２を設定するので、マスタＩＣ５７０にＩ2ＣＩ
／Ｏエクスパンダ６１５が接続されている場合には、当該Ｉ2ＣＩ／Ｏエクスパンダ６１
５へのデータ送信が失敗した場合の再送信回数は２回である。
In the process of
If the I /
If data transmission to 5 fails, the number of retransmissions is two.
図２５の処理では、マスタＩＣ５７０は、図２１に示す異常判定テーブル２１００に登
録されたすべてアドレスのＩ2ＣＩ／Ｏエクスパンダ６１５に対してデータ送信を行う。
つまり、マスタＩＣ５７０に接続可能なすべてのＩ2ＣＩ／Ｏエクスパンダ６１５のアド
レスに対して、データ送信を行う。
In the process of FIG. 25, the
That is, data transmission is performed on the addresses of all the I 2 CI /
ここで、本実施形態では、図２１に示す異常判定テーブル２１００に登録されたすべて
のアドレスのＩ2ＣＩ／Ｏエクスパンダ６１５のうち、一部のＩ2ＣＩ／Ｏエクスパンダ６
１５のみがマスタＩＣ５７０に接続されている。
Here, in the present embodiment, a part of the I 2 CI /
Only 15 is connected to the
このため、図２１に示す異常判定テーブル２１００にアドレスが登録されていれば、Ｉ
2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ５７０に接続されてなくても、マスタＩＣ５
７０はデータを送信する。
Therefore, if the address is registered in the abnormality determination table 2100 shown in FIG.
2
70 sends data.
これにより、異常判定テーブル２１００に登録されたアドレスのＩ2ＣＩ／Ｏエクスパ
ンダ６１５であれば、いずれのアドレスのＩ2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ
５７０に接続された場合であっても、接続されたＩ2ＣＩ／Ｏエクスパンダ６１５を正確
に制御できる。
Thereby, abnormality determining if I 2 CI /
Even when connected to 570, the connected I 2 CI /
例えば、設けられる演出装置の種類が互いに異なる第１仕様の遊技機と第２仕様の遊技
機（ともに後述）を開発する場合を想定する。設けられる演出装置の種類が異なれば、必
然的に設けられるＩ／Ｏエクスパンダ６１５の種類も異なることになる。この場合であっ
ても、異常判定テーブル２１００に登録されたすべてのＩ2ＣＩ／Ｏエクスパンダ６１５
のアドレスに対してデータを送信するプログラムを１種類作成するだけで、第１仕様の遊
技機と第２仕様の遊技機の両方に適用が可能となる。よって、第１仕様の遊技機用のプロ
グラム及び第２仕様の遊技機用のプログラムを、各々作成する必要がなくなり、遊技機の
製造コストを削減できる。
For example, it is assumed that a game machine of the first specification and a game machine of the second specification (both described later) having different types of effect devices to be provided are developed. If the type of rendering device provided differs, the type of I /
The present invention can be applied to both the first specification gaming machine and the second specification gaming machine by creating only one type of program for transmitting data to the address of. Therefore, it is not necessary to create the program for the gaming machine of the first specification and the program for the gaming machine of the second specification, respectively, and the manufacturing cost of the gaming machine can be reduced.
図２５の処理では、マスタＩＣ５７０に接続されていると判定されたＩ2ＣＩ／Ｏエク
スパンダ６１５へは、発光制御スレーブ出力処理が実行されるごとにデータが出力される
ようにし、一方、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエクス
パンダ６１５へは、発光制御スレーブ出力処理が４回実行されると１回の割合でデータが
出力される。
In the process of FIG. 25, data is output to the I 2 CI /
このように、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエクスパ
ンダ６１５へのデータ送信頻度を、マスタＩＣ５７０に接続されていると判定されたＩ2
ＣＩ／Ｏエクスパンダ６１５へのデータ送信頻度よりも低くする（単位時間当たりの送信
回数を少なくする）ので、マスタＩＣ５７０とＩ2ＣＩ／Ｏエクスパンダ６１５との間の
全体的なデータ通信量を減少させることができる。
Thus, I 2 of the data transmission frequency to the I 2 CI /
Since the frequency of data transmission to the CI /
また、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエクスパンダ６
１５は、所定回数連続してデータ送信が失敗したと判定されたＩ2ＣＩ／Ｏエクスパンダ
６１５であるので、一時的に当該Ｉ2ＣＩ／Ｏエクスパンダ６１５に異常（遊技店の営業
中に通信不能となった場合など）が発生している可能性も考えられる。またＩ2ＣＩ／Ｏ
エクスパンダ６１５の発生した異常において、何らかの事情（故障したＩ2ＣＩ／Ｏエク
スパンダ６１５を交換して通信状態が復帰した場合など）により、時間が経過すると当該
異常が解消している場合がある。
Also, the I 2 CI /
15, because it is I 2 CI / O expander 615 a predetermined number of times continuously transmitting data is determined to have failed, the abnormality (in the gaming facility serves temporarily the I 2 CI /
In an abnormality that occurs in the
ここで、本実施形態では、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ
／Ｏエクスパンダ６１５へはデータ送信を中止するわけではなく、４回に１回の頻度でデ
ータ送信を行う。このため、異常が発生しているＩ2ＣＩ／Ｏエクスパンダ６１５へもデ
ータ送信が行われる。
Here, in the present embodiment, the I 2 CI determined not to be connected to the
The data transmission to the /
上述したように、発生した異常が何らかの事情で解消されたＩ2ＣＩ／Ｏエクスパンダ
６１５は、１バイトのデータを受信すると、返答信号をマスタＩＣ５７０に出力する。当
該返答信号をマスタＩＣ５７０が受信すると、マスタＩＣ５７０とＩ2ＣＩ／Ｏエクスパ
ンダ６１５との間でデータ送信が正常に行われているので、図２１に示す異常判定テーブ
ル２１００のエントリのうち、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５のアドレスのエント
リに含まれるエラーカウンタ２１０３には初期値が設定され（図２６に示すステップ２６
２０の処理参照）、また、当該エントリに含まれるエラーフラグ２１０６にオフが登録さ
れる。
As described above, when the I 2 CI /
20) and “off” is registered in the error flag 2106 included in the entry.
したがって、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエクスパ
ンダ６１５へのデータ送信を中止しないので、マスタＩＣ５７０に接続されていないと判
定されたＩ2ＣＩ／Ｏエクスパンダ６１５に異常が発生している場合であっても、当該Ｉ2
ＣＩ／Ｏエクスパンダ６１５の異常が解消すると、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５
にいち早く制御を行わせることができる。
Therefore, it does not stop sending data to I 2 CI /
When the abnormality of the CI /
Control can be performed quickly.
図２６は、本発明の第１実施形態のスレーブ連続処理のフローチャートである。 FIG. 26 is a flowchart of slave continuous processing according to the first embodiment of this invention.
スレーブ連続処理は、発光装置に接続されるＩ2ＣＩ／Ｏエクスパンダ６１５に演出制
御データである発光制御データを送信する処理であり、図２５に示すステップ２５０８の
処理で実行される。
The slave continuous process is a process of transmitting light emission control data, which is effect control data, to the I 2 CI /
なお、発光制御データは、マスタＩＣ５７０からバッファモードで送信される。バッフ
ァモードでは、マスタＩＣ５７０は、出力用ＢＵＦ５７２に格納された複数バイトのデー
タを、Ｉ2ＣＩ／Ｏエクスパンダ６１５へ１バイト毎送信し、その送信の都度、Ｉ2ＣＩ／
Ｏエクスパンダ６１５からＡＣＫ又はＮＡＣＫを受信する。そして、ＮＡＣＫを受信した
場合には、その時点で、割込信号をＣＰＵ５５１に出力する。
The light emission control data is transmitted from the
The ACK or NACK is received from the
但し、ＡＣＫを受信した場合には、出力用ＢＵＦ５７２に格納されたすべてのデータが
送信完了となった場合にのみ、割込信号をＣＰＵ５５１に出力する。マスタＩＣ５７０は
、出力用ＢＵＦ５７２に未送信のデータが残っている状態でＩ2ＣＩ／Ｏエクスパンダ６
１５からＡＣＫを受信したときには、割込信号をＣＰＵ５５１に出力せずに、出力用ＢＵ
Ｆ５７２から次の送信すべきデータを取り出して、Ｉ2ＣＩ／Ｏエクスパンダ６１５へ出
力する。
However, when an ACK is received, an interrupt signal is output to the
When an ACK is received from No. 15, the output BU is not output without outputting an interrupt signal to the
The next data to be transmitted is taken out from
つまり、バッファモードの場合には、マスタＩＣ５７０は、出力用ＢＵＦ５７２に格納
されたデータがＩ2ＣＩ／Ｏエクスパンダ６１５にすべて送信されるまでの間は、Ｉ2ＣＩ
／Ｏエクスパンダ６１５からＡＣＫを受信し続けている限り、ＣＰＵ５５１に処理を引き
渡すことなく、処理を継続することとなる。
That is, in the buffer mode, the
As long as the ACK is continuously received from the /
図２６に戻って、まず、ＣＰＵ５５１は、ＡＣＫの返答信号の受信に失敗したことを計
数するＡＣＫカウンタに０を設定する（２６０１）。
Returning to FIG. 26, first, the
次に、ＣＰＵ５５１は、選択されている装飾制御装置６１０に出力するデータを生成す
る（２６０２）。
Next, the
そして、ＣＰＵ５５１は、ステップ２６０２の処理で生成されたデータを出力用ＢＵＦ
５７２に設定するバッファ設定処理を実行する（２６０３）。設定されるデータは、図１
９に示す演出制御データのフォーマットとなっており、図に示した送信順序に従って、1
バイト毎に区切られながら、Ｉ2ＣＩ／Ｏエクスパンダ６１５へ送信される。
Then, the
The buffer setting process set to 572 is executed (2603). The data to be set is shown in Figure 1
The format of the effect control data shown in FIG. 9 is 1 according to the transmission order shown in the figure.
The data is sent to the I 2 CI /
そして、マスタＩＣ５７０は、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを、スター
ト条件を示す信号レベルに変化させる（２６０４）。
Then, the
具体的には、マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＨＩＧＨに維持したま
ま、接続線ＳＤＡの信号レベルをＨＩＧＨからＬＯＷに変化させることよってスタート条
件を示す信号を出力する。
Specifically, the
なお、マスタＩＣ５７０は、スタート条件を示す信号を出力後、制御対象となる装飾制
御装置６１０へデータを送るために、接続線ＳＣＬのレベルをＬＯＷに変更する。
After outputting a signal indicating the start condition, the
次に、ＣＰＵ５５１は、マスタＩＣ５７０へデータ送信の開始を指示した時点から、マ
スタＩＣ５７０がＣＰＵ５５１へ割込信号を伝達させるまでの時間を監視するために、バ
ッファモード用の監視タイマの起動を開始する（２６０５）。以降、この監視時間をバッ
ファモード監視時間ということにする。
Next,
そして、マスタＩＣ５７０は、出力用ＢＵＦ５７２に設定されているデータの先頭から
、制御対象となる装飾制御装置６１０のスレーブアドレスに相当する８ビット分のデータ
を取得し、このアドレスの値を、接続線ＳＣＬの信号レベルを変化させながら、接続線Ｓ
ＤＡを介して出力する（２６０６）。
The
Output via DA (2606).
ステップ２６０６の処理で出力されるアドレスデータは８ビットのデータ列であるため
、１回の出力処理（接続線ＳＣＬが８回ＨＩＧＨに変化する間の出力）でアドレスデータ
が出力される。
Since the address data output in the process of step 2606 is a data string of 8 bits, the address data is output in one output process (output while the connection line SCL changes to HIGH eight times).
なお、マスタＩＣ５７０は、このスレーブアドレスを出力する際に、一旦、ドライバ５
７６Ａをオフさせて接続線ＳＤＡを解放する（ハイレベルに変化させる）動作を行う。そ
して、接続線ＳＤＡが解放されていない場合には、このスレーブアドレスの出力は、接続
線ＳＤＡが開放されるまで待機する。
When the
An operation is performed to turn off the connection 76A and release the connection line SDA (change it to a high level). When the connection line SDA is not released, the output of the slave address waits until the connection line SDA is released.
ステップ２６０６の処理で出力されたアドレスデータがＩ2ＣＩ／Ｏエクスパンダ６１
５に入力された場合、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、入力されたアドレスデータと
自身に設定されているアドレスとが一致するか否かを判定する。
The address data output in the process of step 2606 is the I 2 CI / O expander 61
When it is input to 5, the I 2 CI /
入力されたアドレスデータと一致するアドレスが設定されているＩ2ＣＩ／Ｏエクスパ
ンダ６１５は、接続線ＳＣＬのＬＯＷからＨＩＧＨへの変更回数が８回目になった直後で
あって、そのＨＩＧＨレベルとなっている接続線ＳＣＬがＬＯＷレベルへと変化すること
を契機として、返答信号を接続線ＳＤＡからマスタＩＣ５７０に出力する。
The I 2 CI /
次に、マスタＩＣ５７０は、ステップ２６０５の処理でアドレスデータが出力されてか
ら所定時間以内にＡＣＫの返答信号がマスタＩＣ５７０に入力されたか否かを確認する（
２６０７）。
Next, the
2607).
次に、マスタＩＣ５７０は、ステップ２６０６の処理の確認結果に基づいて、ステップ
２６０２の処理でアドレスデータが出力されてから所定時間以内にＡＣＫの返答信号が入
力されているか否かを判定する（２６０８）。
Next, based on the confirmation result of the process of step 2606,
ステップ２６０５の処理でアドレスデータが出力されてから所定時間以内にＡＣＫの返
答信号が入力されていないと、ステップ２６０８の処理で判定された場合には、マスタＩ
Ｃ５７０は、ステータスＲＥＧ５７９に返答信号がＮＡＣＫであった旨の情報を設定した
うえで、割込信号を発生させる。これにより、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＮＡ
ＣＫの返答信号を受信したことが、ＣＰＵ５５１に通知される。このとき、ＣＰＵ５５１
は、バイトモードの時間監視を終了する（２６０９）。
If it is determined in the process of step 2608 that the ACK response signal is not input within a predetermined time after the address data is output in the process of step 2605, the master I
The
Ends the time monitoring in byte mode (2609).
ＣＰＵ５５１は、ステップ２６０９で割込信号を受けつけると、マスタＩＣ５７０に対
して、指示されたマスタＩＣ５７０は、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを制
御して、ストップ条件を発行する（２６１０）。その後、ＡＣＫカウンタがＲＰ以上であ
るか否かを判定する（２６１１）。
When the
ステップ２６１１の処理で、ＡＣＫカウンタがＲＰよりも小さいと判定された場合、Ａ
ＣＫの返答信号の受信に失敗したことを計数するためにＡＣＫカウンタを＋１更新し（２
６１２）、同じデータを当該装飾制御装置６１０に再度送信するために、ステップ２６０
２の処理に戻る。
If it is determined in the process of step 2611 that the ACK counter is smaller than RP, then A
The ACK counter is updated by +1 to count the failure to receive the CK reply signal (2
612), to send the same data again to the
Return to processing of 2.
一方、ステップ２６１１の処理で、ＡＣＫカウンタがＲＰ以上であると判定された場合
、ＣＰＵ５５１は、異常判定テーブル２１００に登録されたエントリのうち、Ｉ／Ｏエク
スパンダアドレス２１０１が選択された装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ
６１５のアドレスと一致するエントリを選択し、選択されたエントリのエラーカウンタ２
１０３をインクリメントする（２６１３）。
On the other hand, if it is determined in the process of step 2611 that the ACK counter is equal to or greater than RP, the
103 is incremented (2613).
ここで、ＲＰには、０又は２の値が設定され得る。Ｉ2ＣＩ／Ｏエクスパンダ６１５が
マスタＩＣ５７０に接続されていないと判定された場合、ＲＰには０が設定されるので、
ステップ２６１１の処理でＡＣＫカウンタがＲＰよりも少ないと判定されることはない。
よって、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエクスパンダ６
１５へのデータ送信が失敗しても、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５へのデータの再
送信を行わない。
Here, a value of 0 or 2 may be set to RP. When it is determined that the I 2 CI /
In the process of step 2611, it is not determined that the ACK counter is smaller than RP.
Therefore, the I 2 CI /
Even if the data transmission to 15 fails, the data is not retransmitted to the I 2 CI /
一方、Ｉ2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ５７０に接続されていないと判定
された場合、ＲＰには２が設定されるので、Ｉ2ＣＩ／Ｏエクスパンダ６１５へのデータ
の再送信を最大２回行う。
On the other hand, when it is determined that the I 2 CI /
なお、本実施形態では、Ｉ2ＣＩ／Ｏエクスパンダ６１５がマスタＩＣ５７０に接続さ
れていないと判定された場合、当該Ｉ2ＣＩ／Ｏエクスパンダ６１５へのデータ再送信が
行わないとしたが、マスタＩＣ５７０に接続されていないと判定されたＩ2ＣＩ／Ｏエク
スパンダ６１５へのデータの再送信回数が、マスタＩＣ５７０に接続されていると判定さ
れたＩ2ＣＩ／Ｏエクスパンダ６１５へのデータの再送信回数よりも少なくなるようにす
ればよい。
In this embodiment, when it is determined that the I 2 CI /
このように、図２６の処理では、マスタＩＣ５７０に接続されていないと判定されたＩ
2ＣＩ／Ｏエクスパンダ６１５へのデータの再送信回数が、マスタＩＣ５７０に接続され
ていると判定されたＩ2ＣＩ／Ｏエクスパンダ６１５へのデータの再送信回数よりも少な
くなるので、マスタＩＣ５７０とＩ2ＣＩ／Ｏエクスパンダ６１５との間のデータ通信量
を全体的に減少させることができる。
Thus, in the process of FIG. 26, it is determined that I is not connected to master
2 Since the number of times of data retransmission to the CI /
ステップ２６１２の処理の実行後、ＣＰＵ５５１は、ステップ２６１２の処理でインク
リメントされたエラーカウンタ２１０３の値が比較値２１０４に達しているか否かを判定
する（２６１４）。
After executing the processing of step 2612, the
ステップ２６１３の処理でインクリメントされたエラーカウンタ２１０３の値が比較値
２１０４に達していると、ステップ２６１４の処理で判定された場合、ＣＰＵ５５１は、
異常判定テーブル２１００に登録されたエントリのうち、選択された装飾制御装置６１０
のエントリのエラーフラグをＯＮに設定し（２６１５）、スレーブ連続出力処理を終了す
る。
If it is determined in the process of step 2614 that the value of the
The
The error flag of the entry is set to ON (2615), and the slave continuous output processing is ended.
一方、ステップ２６１３の処理でインクリメントされたエラーカウンタ２１０３の値が
比較値２１０４に達していないと、ステップ２６１３の処理で判定された場合、スレーブ
連続出力処理を終了する。
On the other hand, if it is determined in the process of step 2613 that the value of the
一方、ステップ２６０２の処理でアドレスデータが出力されてから所定時間以内にＡＣ
Ｋの返答信号が入力されたと、ステップ２６０８の処理で判定された場合には、マスタＩ
Ｃ５７０は、出力用ＢＵＦ５７２に記憶されているすべてのデータを出力したか否かを判
定する（２６１６）。
On the other hand, within the predetermined time after the address data is output in the process of step 2602, the AC
If it is determined in the process of step 2608 that the response signal of K is input, the master I
The
ステップ２６１６の処理で、出力用ＢＵＦ５７２に記憶されているすべてのデータを出
力したと判定された場合には、マスタＩＣ５７０は、ステータスＲＥＧ５７９に返答信号
がＡＣＫであった旨の情報を設定したうえで、割込信号を発生させる。これにより、Ｉ2
ＣＩ／Ｏエクスパンダ６１５への全バイトデータの送信を完了したことが、ＣＰＵ５５１
に通知される。このとき、ＣＰＵ５５１は、バッファモードの時間監視を終了する（２６
１９）。
If it is determined in the process of step 2616 that all the data stored in
Having completed the transmission of all byte data to CI /
Will be notified. At this time, the
19).
そして、ＣＰＵ５５１は、ステップ２６１９の処理の実行後に、異常判定テーブル２１
００に登録されたエントリのうち、Ｉ／Ｏエクスパンダアドレス２１０１が選択された装
飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５のアドレスと一致するエントリを選
択し、選択されたエントリのエラーカウンタ２１０３をゼロに初期化し（２６２０）、当
該エントリのエラーフラグ２１０５をオフに設定し（２６２１）、スレーブ連続出力処理
を終了する。
Then, after execution of the processing of step 2619, the
Among the entries registered in 00, select the entry that matches the address of the I 2 CI /
一方、ステップ２６１６の処理で、出力用ＢＵＦ５７２に記憶されているすべてのデー
タを出力していないと判定された場合には、マスタＩＣ５７０は、接続線ＳＤＡの電圧レ
ベルを監視し、接続線ＳＤＡが開放されていることを確認してから（２６１７）、出力用
ＢＵＦ５７２に記憶されたデータのうち次に送信すべき１バイトのデータを送信し（２６
１８）、ステップ２６０７の処理に進む。
On the other hand, when it is determined in the process of step 2616 that not all the data stored in
18) Go to the processing of step 2607.
以上より、発光制御データは、１バイトのデータを出力するごとに（つまり、発光制御
データを送信する途中で）、返答信号の受信が監視されるものの、マスタＩＣ５７０へＡ
ＣＫの返答信号が入力されている限り、出力用ＢＵＦ５７２に記憶されている全てのデー
タが送信完了となるまでマスタＩＣ５７０からＣＰＵ５５１へ処理を引き渡さない構成と
なっているバッファモードで送信される。
As described above, although the light emission control data is monitored to receive the reply signal every time it outputs 1-byte data (that is, while the light emission control data is transmitted)
As long as the CK response signal is input, all data stored in the
ここで、共通アドレスを含む初期化指示データは、バイトモードで送信されており、図
２４に示すように１バイトのデータの送信を開始するごとに、その都度、マスタＩＣ５７
０からＣＰＵ５５１へ割込信号が返ってくるまでの時間（バイトモード監視時間）が監視
されている。
Here, the initialization instruction data including the common address is transmitted in the byte mode, and as shown in FIG. 24, each time one byte of data transmission is started, the master IC 57 is used each time.
The time from 0 to the return of the interrupt signal to the CPU 551 (byte mode monitoring time) is monitored.
一方、個別アドレスとなるスレーブアドレスを含む発光制御データは、バッファモード
で送信されており、図２６に示すように、出力用ＢＵＦ５７２に保存されている、先頭バ
イトのデータ送信の開始から、最終バイトのデータ送信の終了までの時間（バッファモー
ド監視時間）が監視されている。
On the other hand, the light emission control data including the slave address serving as the individual address is transmitted in the buffer mode, and as shown in FIG. 26, from the start of data transmission of the first byte stored in the
本実施形態では、演出制御装置５５０から装飾制御装置６１０へデータを送信する場合
に、前述したバイトモード若しくはバッファモードの何れかのモードを選択する。ここで
、バイトモード及びバッファモードの特徴について説明する。
In the present embodiment, when data is transmitted from the
バイトモードでは、マスタＩＣ５７０から送信された１バイトのデータに対して、装飾
制御装置６１０から如何なる返答信号が入力されても（ＡＣＫでもＮＡＣＫでも）、直ち
に割込信号がマスタＩＣ５７０からＣＰＵ５５１へ伝達される。このとき、バイトモード
監視時間には、１バイトのデータ送信と返答信号の受信に要する時間に合わせた時間値が
設定されている。
In the byte mode, an interrupt signal is immediately transmitted from the
ＣＰＵ５５１は、装飾制御装置６１０からマスタＩＣ５７０へＡＣＫの返答信号が伝達
された場合に、１バイトのデータ送信が成功したと判断して、次の処理を行う。一方で、
ＣＰＵ５５１は、装飾制御装置６１０からマスタＩＣ５７０へＮＡＣＫの返答信号が伝達
された場合に、或いは、バイトモード監視時間がタイムアウトした場合に、データ送信に
異常が発生したものと判断して、必要な処理を行う。
When a response signal of ACK is transmitted from the
The
これに対して、バッファモードでは、マスタＩＣ５７０から送信された１バイトのデー
タに対して、装飾制御装置６１０からＮＡＣＫの返答信号が入力された場合に限り、直ち
に割込信号がマスタＩＣ５７０からＣＰＵ５５１へ伝達される。しかしながら、装飾制御
装置６１０からＡＣＫの返答信号が入力された場合には、出力用ＢＵＦ５７２に保存され
ているデータが全て送信されたタイミングでないと、割込信号がマスタＩＣ５７０からＣ
ＰＵ５５１へ伝達されず、マスタＩＣ５７０は、出力用ＢＵＦ５７２に保存されているデ
ータを次々と送信する処理を行うことになる。
On the other hand, in the buffer mode, an interrupt signal is sent immediately from the
The
そのため、バッファモードによるデータ送信では、バイトモードのときと比較して、割
込信号がマスタＩＣ５７０からＣＰＵ５５１へ伝達される回数が少なくなるため、マスタ
ＩＣ５７０からＣＰＵ５５１へ処理を引き渡す回数が少なくなり、複数バイトのデータを
送信するときの全体的な送信時間を短縮することができる。
Therefore, in the data transmission in the buffer mode, the number of times the interrupt signal is transmitted from the
その一方で、バッファモードでは、装飾制御装置６１０からＡＣＫの返答信号が入力さ
れ続ける限り、送信すべきデータの全てが送信完了となるまで、マスタＩＣ５７０からＣ
ＰＵ５５１へ処理が引き渡されない。そのため、データ送信中に、何らかの理由で、接続
線ＳＤＡを用いてデータ送信ができない状態が発生すると、その都度、マスタＩＣ５７０
によってデータ送信が中断され、マスタＩＣ５７０からＣＰＵ５５１へ処理が引き渡され
るまでの時間が、非常に長くなってしまう恐れもあり得る。
On the other hand, in the buffer mode, as long as the response signal of ACK continues to be input from
Processing is not delivered to PU551. Therefore, during data transmission, if a state where data transmission can not be performed using connection line SDA occurs for any reason,
May interrupt the data transmission, and the time taken for the processing to be handed over from the
なお、マスタＩＣ５７０からＣＰＵ５５１へ処理が引き渡されるまでの時間を監視する
ために、前述のバッファモード監視時間には、送信する全バイトのデータ送信と返答信号
の受信に要する時間に合わせた時間値が設定されている。必然的に、このバッファモード
監視時間は、前述のバイトモード監視時間よりも長い時間が設定されることになる。
In addition, in order to monitor the time until the process is handed over from the
ＣＰＵ５５１は、装飾制御装置６１０からマスタＩＣ５７０へＡＣＫの返答信号が伝達
された場合に、送信すべき全バイトのデータ送信が成功したと判断して、次の処理を行う
。一方で、ＣＰＵ５５１は、装飾制御装置６１０からマスタＩＣ５７０へＮＡＣＫの返答
信号が伝達された場合に、或いは、バッファモード監視時間がタイムアウトした場合に、
データ送信に異常が発生したものと判断して、必要な処理を行う。
When a response signal of ACK is transmitted from the
It is determined that an error has occurred in data transmission, and necessary processing is performed.
以上のことから、データ送信に関して全く異常が発生しないという前提であれば、複数
バイトのデータ（必然的に送信単位である８ビットよりも長いビット数のデータとなる）
を送信する場合には、バッファモードを用いたデータ送信の方が、バイトモードを用いた
データ送信よりも高速な処理を行えるのは確かである。しかしながら、データ送信時に異
常が発生する可能性を考慮すると、バイトモードにはデータ送信の完了を１バイト毎に確
認しながら処理を行えるという利点を有するので、どちらのモードが優れているのかは単
純には比較できない。
From the above, if it is premised that no abnormality occurs in data transmission, multi-byte data (the data will inevitably be data with a bit number longer than 8 bits which is the transmission unit)
In the case of transmitting data, it is true that data transmission using buffer mode can perform processing faster than data transmission using byte mode. However, in consideration of the possibility of occurrence of an abnormality at the time of data transmission, byte mode has the advantage that processing can be performed while confirming completion of data transmission in units of one byte, so which mode is superior is simple It can not be compared to
本実施形態では、初期化指示データをバイトモードで送信し、発光制御データをバッフ
ァモードで送信しており、そのような構成により奏する効果について説明する。
In this embodiment, the initialization instruction data is transmitted in the byte mode, and the light emission control data is transmitted in the buffer mode, and the effects achieved by such a configuration will be described.
まず、共通アドレスを含む初期化指示データに対しては、共通アドレスが予め割り当て
られたすべての装飾制御装置６１０からＡＣＫの返答信号が出力される。一方、個別アド
レスを含む発光制御データに対しては、個別アドレスが予め割り当てられた一つの装飾制
御装置６１０からＡＣＫの返答信号が出力される。
First, in response to the initialization instruction data including the common address, ACK response signals are output from all the
このため、初期化指示データを送信した場合には複数の装飾制御装置６１０から返答信
号が出力されるので、初期化指示データの１バイトのデータを送信した後の接続線ＳＤＡ
が解放されるまでの待機時間は、当該複数の装飾制御装置６１０の全てが接続線ＳＤＡを
開放するまでの時間に依存する。これに対して、発光制御データの１バイトのデータを送
信した後の接続線ＳＤＡが解放されるまでの待機時間は、送信対象の一つの装飾制御装置
６１０のみが接続線ＳＤＡを開放するまでの時間に依存する。従って、前者の方が接続線
ＳＤＡが解放されるまでの待機時間が長くなる。
For this reason, when initialization instruction data is transmitted, since a plurality of
The waiting time until the release of the second function depends on the time until all the plurality of
なお、初期化指示データは、共通アドレスのデータ２００１、第１所定値のデータ２０
０２、及び第２所定値のデータ２００３というように３回に分けて送信される。さらに、
この３種類の初期化指示データが正確に装飾制御装置６１０に伝達されない場合には、装
飾制御装置６１０を確実に初期化するために、何度でも初期化指示データの送信を繰り返
す処理が行われる。
The initialization instruction data is data 2001 of the common address and
The data is transmitted in three steps such as 02 and second
If the three types of initialization instruction data are not correctly transmitted to
ここで、バッファモードを用いて初期化指示データを送信した場合と、バイトモードを
用いて初期化指示データを送信した場合とを比較する。それぞれのモードにおいて、最初
の共通アドレスのデータ２００１の送信後、又は次の第１所定値のデータ２００２の送信
後に、何らかの理由によって、接続線ＳＤＡが解放されない異常状態が発生した場合を想
定するとどうなるかを説明する。
Here, the case where the initialization instruction data is transmitted using the buffer mode and the case where the initialization instruction data is transmitted using the byte mode are compared. In each mode, after transmission of the data 2001 of the first common address or transmission of the
初期化指示データがバッファモードで送信されると、バッファモード監視時間には、共
通アドレスのデータ２００１の送信開始から第２所定値のデータ２００３の送信によるＡ
ＣＫの受信までの、少なくとも３バイト分のデータ送信に必要な時間が設定されなければ
ならない。このため、初期化指示データをバッファモードで送信するようにした場合には
、接続線ＳＤＡが解放されない異常が発生すると、ＣＰＵ５５１は、バッファモード監視
時間のタイムアップを待つことになる。
When the initialization instruction data is transmitted in the buffer mode, the buffer mode monitoring time starts with the transmission of the data 2001 of the common address and the transmission of the
The time required for data transmission of at least 3 bytes must be set until reception of CK. Therefore, when the initialization instruction data is transmitted in the buffer mode, if an abnormality that the connection line SDA is not released occurs, the
一方、初期化指示データがバイトモードで送信されると、バイトモード監視時間には、
少なくとも１バイト分のデータ送信に必要な時間が設定されなければならない。このため
、初期化指示データをバイトモードで送信するようにした場合には、接続線ＳＤＡが解放
されない異常が発生すると、ＣＰＵ５５１は、バイトモード監視時間のタイムアップを待
つことになる。
On the other hand, if initialization instruction data is sent in byte mode, byte mode monitoring time is
The time required to transmit at least one byte of data must be set. Therefore, when the initialization instruction data is transmitted in the byte mode, if an abnormality that the connection line SDA is not released occurs, the
このため、初期化指示データをバッファモードで送信するようにした場合には、接続線
ＳＤＡが解放されない異常が発生すると、ＣＰＵ５５１は、長いタイムアップ時間の経過
を待ってから異常解除をすることになるので、却って非効率なデータ送信を行うことにな
ってしまう。
Therefore, when the initialization instruction data is transmitted in the buffer mode, if an abnormality that the connection line SDA is not released occurs, the
一方、初期化指示データをバイトモードで送信するようにした場合には、接続線ＳＤＡ
が解放されない異常が発生しても、ＣＰＵ５５１は、短いタイムアップ時間の経過を待っ
てから異常解除をするとになるので、無駄な時間を抑制でき、効率的なデータ送信を行う
ことができる。
On the other hand, when the initialization instruction data is transmitted in the byte mode, connection line SDA is
Even if an abnormality occurs that is not released, the
このため、本実施形態では、初期化指示データをバイトモードで送信するようにしたの
で、接続線ＳＤＡが解放されない異常をいち早く検出できるようにしたので、結果として
データ送信の時間を短縮できる。
Therefore, in the present embodiment, the initialization instruction data is transmitted in the byte mode, so that the abnormality that the connection line SDA is not released can be detected promptly, and as a result, the data transmission time can be shortened.
特に、前述したように、初期化指示データは複数の装飾制御装置６１０に送信され、こ
れらの装飾制御装置６１０から全ての返答信号が出力されることを監視するので、接続線
ＳＤＡが解放されるまでの待機時間が長くなる傾向にあり、監視時間自体を長めに設定す
る必要があることから、バイトモードを用いて時間監視を行うことが好ましい。
In particular, as described above, since initialization instruction data is transmitted to a plurality of
一方で、本実施形態では、発光制御データはバッファモードで送信される。これは、上
述したように、バッファモードによるデータ送信では、バイトモードのときと比較して、
割込信号がマスタＩＣ５７０からＣＰＵ５５１へ伝達される回数が少なくなるため、マス
タＩＣ５７０からＣＰＵ５５１へ処理を引き渡す回数が少なくなり、複数バイトのデータ
を送信するときの全体的な送信時間を短縮することができるからである。
On the other hand, in the present embodiment, the light emission control data is transmitted in the buffer mode. This is because, as described above, in data transmission in buffer mode, as compared with byte mode,
Since the number of times the interrupt signal is transmitted from the
なお、発光制御データをバッファモードで送信し、何らかの理由によって、接続線ＳＤ
Ａが解放されない異常状態が発生した場合には、バッファモード監視時間のタイムアップ
を待って異常を解除し、１回だけ装飾制御装置６１０へ発光制御データを再送する。もし
、２回連続して発光制御データの送信異常が発生した場合には、発光制御データの送信を
中止する。
In addition, the light emission control data is transmitted in the buffer mode, and for some reason, the connection line SD
When an abnormal state in which A is not released occurs, the abnormal state is canceled after the buffer mode monitoring time is up and the light emission control data is retransmitted to the
したがって、発光制御データを送信する場合には、接続線ＳＤＡが解放されない異常を
検出するまでの無駄な時間を減少させるよりも割込信号が出力される回数を減少させてＣ
ＰＵ５５１にかかる処理負荷を軽減させたほうがデータ送信の時間が短縮できるので、発
光制御データは割込信号が出力される回数がバイトモードよりも少ないバッファモードで
送信されるようにしている。
Therefore, in the case of transmitting the light emission control data, the number of times the interrupt signal is output can be reduced by reducing the time required to detect an abnormality that the connection line SDA is not released.
Since the data transmission time can be shortened by reducing the processing load on the
また、図２４に示すように、初期化指示データにおいては、接続線ＳＤＡが解放されず
タイムアウトが発生した場合、又は、１バイトのデータに対する返答信号がマスタＩＣ５
７０に入力されなかった場合には、初期化指示データの最初のデータ（共通アドレスを含
むデータ２００１）から再送信を行い、初期化指示データがＩ2ＣＩ／Ｏエクスパンダ６
１５によって受信されるまで当該再送信が繰り返し行われるので、初期化指示データは正
確にＩ2ＣＩ／Ｏエクスパンダ６１５に受信されるので、正確にＩ2ＣＩ／Ｏエクスパンダ
６１５を初期化できる。また、図２６に示すように、発光制御データにおいては、接続線
ＳＤＡが解放されずタイムアウトが発生した場合、又は、１バイトのデータに対する返答
信号がマスタＩＣ５７０に入力されなかった場合には、発光制御データの最初のデータか
ら再送信を１回のみ行うので、高速なデータ送信が可能となる。
Also, as shown in FIG. 24, in the initialization instruction data, when the connection line SDA is not released and a timeout occurs, or a response signal for 1 byte data is the master IC5.
If it is not input to 70, re-transmission is performed from the first data (data 2001 including the common address) of the initialization instruction data, and the initialization instruction data is the I 2 CI /
Since the retransmitted until received is repeatedly performed by 15, since the initialization command data is correctly received I 2 CI /
Ｉ2ＣＩ／Ｏエクスパンダ６１５の初期化は異常発生時において発生した異常を解消す
るために行う処理であるため、確実に初期化が行われるように、初期化指示データがＩ2
ＣＩ／Ｏエクスパンダ６１５に確実に受信されるまで再送信を繰り返し行うようにしてい
る。これに対して、発光制御データはＩ2ＣＩ／Ｏエクスパンダ６１５に受信されなくと
も発光装置の出力態様が前回の出力態様で停止するのみであるので、データ送信の高速性
を重視して、１回のみ再送信を行うようにしている。
Since initialization of the I 2 CI /
Retransmission is repeated until it is received by the CI /
図２７は、本発明の第１実施形態のＩ2Ｃ随時リセット処理のフローチャートである。 FIG. 27 is a flowchart of I 2 C occasional reset processing according to the first embodiment of this invention.
Ｉ2Ｃ随時リセット処理は、マスタＩＣ５７０、役物駆動ＭＯＴ５６１、マスタＩＣ５
７０に接続されたすべてのＩ2ＣＩ／Ｏエクスパンダ６１５、及び役物駆動ＳＯＬ５６０
の初期化を指示する処理であり、図２２に示すステップ２２１０の処理である。
I 2 C occasional reset processing,
All I 2 CI /
Is a process of instructing initialization of the process, and is a process of
まず、演出制御装置５５０は、リセット要求フラグがオンであるか否かを判定する（２
７０１）。
First, the
701).
ステップ２７０１の処理でリセット要求フラグがオンでないと判定された場合、演出制
御装置５５０は、リセットを指示する条件が成立しているか否かを判定するために、異常
判定テーブル２１００を参照して、マスタＩＣ５７０に接続されるＩ2ＣＩ／Ｏエクスパ
ンダ６１５のうち、装飾装置が接続されたすべてのＩ2ＣＩ／Ｏエクスパンダ６１５から
所定回数連続してＡＣＫの返答信号を受信できなかったか否かを確認する（２７０２）。
If it is determined in the process of
具体的には、演出制御装置５５０は、異常判定テーブル２１００に登録されたすべての
エントリのエラーフラグ２１０５にオンが登録されているか否かを判定する。
Specifically, the
次に、演出制御装置５５０は、ステップ２７０２の処理の確認結果に基づいて、リセッ
ト条件が成立しているか否かを判定する（２７０３）。
Next, the
具体的には、ステップ２７０２の処理の時点ですべてのエラーフラグ２１０５がＯＮに
なっている場合（エラーフラグ２１０５がＯＦＦとなっている発光制御装置が存在しない
場合）には、ステップ２７０３の処理でリセット条件が成立しているとみなされる。その
他の場合は、ステップ２７０３の処理でリセット条件が成立していないとみなされる。
Specifically, when all the error flags 2105 are ON at the time of the process of step 2702 (when there is no light emission control device in which the
ステップ２７０３の処理で、リセット条件が成立しているとみなされた場合、演出制御
装置５５０は、初期化中であることを示すリセット要求フラグを設定する（２７０４）。
If it is determined in the processing of
そして、演出制御装置５５０は、マスタＩＣ５７０をソフトリセットする（２７０５）
。具体的には、ＣＰＵ５５１が、データバスを介してマスタＩＣ５７０に備わるリセット
ＲＥＧ５７３に所定の値を書き込む。マスタＩＣ５７０に備わるリセットＲＥＧ５７３に
所定の値が書き込まれると、マスタＩＣ５７０のコントローラは、入力用ＢＵＦ５７１、
出力用ＢＵＦ５７２、リセットＲＥＧ５７３、及び送信モードＲＥＧ５７４の値を初期値
に設定し、マスタＩＣ５７０を初期化する。ＣＰＵ５５１がデータバスを介してマスタＩ
Ｃ５７０に備わるリセットＲＥＧ５７３に所定の値を書き込むことによって、マスタＩＣ
５７０を初期化することをソフトリセットという。
Then, the
. Specifically, the
The values of the
By writing a predetermined value to the
Initializing the 570 is called soft reset.
本実施形態では、マスタＩＣ５７０をハードリセットすると、前述したように、演出制
御装置５５０に備わっている他の回路（ＶＤＰ５５６や音ＬＳＩ５５７などの電源投入時
に初期化される回路）も初期化してしまうが、マスタＩＣ５７０に異常が発生したと判定
された場合には、このようなソフトリセットを行うことで、異常が発生したマスタＩＣの
みに対してリセットを行い、マスタＩＣ５７０と直接関係のない回路までもリセットして
しまうことを防止する。
In the present embodiment, when the
次に、演出制御装置５５０は、マスタＩＣ５７０に接続されたすべての装飾制御装置６
１０のＩ2ＣＩ／Ｏエクスパンダ６１５を初期化するために、マスタＩＣ５７０からリセ
ット信号を出力する図２４に示すスレーブリセット処理を実行する（２７０６）。
Next, the
In order to initialize the 10 I 2 CI /
このように、マスタＩＣ５７０が初期化されると、当該マスタＩＣ５７０に接続された
すべてのＩ2ＣＩ／Ｏエクスパンダ６１５に対して初期化指示データを送信するので、確
実に遊技機１を初期化することができる。
In this manner, when the
そして、演出制御装置５５０は、役物駆動ＭＯＴ５６１が初期化中であることを示すモ
ータ初期化フラグを設定し（２７０７）、役物駆動ＭＯＴ５６１を初期化する場合に役物
駆動ＭＯＴ５６１に出力されるモータ出力データをＲＡＭ５５３に設定する（２７０８）
。そして、演出制御装置５５０は、役物駆動ＳＯＬ５６０を初期化するために、役物駆動
ＳＯＬ５６０の通電状態を非通電状態にするオフデータをＲＡＭ５５３に設定し（２７０
９）、リセット要求フラグを解除して（２７１０）、Ｉ2Ｃ随時リセット処理を終了する
。
Then, the
. Then, in order to initialize the
9) The reset request flag is released (2710), and the I 2 C arbitrary reset processing is ended.
ステップ２７０１の処理で、リセット要求フラグが設定されていると判定された場合に
は、初期化をすぐに実行しなければならないので、リセット条件が成立しているか否かを
判定せずに、ステップ２７０５の処理に進む。
If it is determined in the process of
また、ステップ２７０４の処理で、リセット条件が成立していないと判定された場合、
初期化を行う必要はないので、ステップ２７１０の処理に進み、リセット要求フラグを解
除し、Ｉ2Ｃ随時リセット処理を終了する。
If it is determined in the process of
Since it is not necessary to perform initialization, the process proceeds to step 2710, the reset request flag is released, and the I 2 C arbitrary reset process is ended.
このように、リセット条件が成立したと判定された場合には、ステップ２７０６の処理
で、マスタＩＣ５７０に接続されるすべてのＩ2ＣＩ／Ｏエクスパンダ６１５に対して、
同時に初期化を指示するので、言い換えれば、すべてのＩ2ＣＩ／Ｏエクスパンダ６１５
を同時に選択して初期化することになるので、Ｉ2ＣＩ／Ｏエクスパンダ６１５を個別に
選択して初期化を指示する方法と比較すると、高速に初期化を行うことができ、Ｉ2ＣＩ
／Ｏエクスパンダ６１５を正常な状態へ高速に復帰させることができる。
As described above, when it is determined that the reset condition is satisfied, the process of
Since initialization is simultaneously instructed, in other words, all the I 2 CI /
Since the I 2 CI /
The /
なお、すべてのＩ2ＣＩ／Ｏエクスパンダ６１５へ入力されるＲＥＳＥＴ端子（図７参
照）とＣＰＵ５５１とを電気的に接続し、ＣＰＵ５５１から一斉に、全てのＩ2ＣＩ／Ｏ
エクスパンダ６１５のＲＥＳＥＴ端子へリセット信号を送信する構成としても、全てのＩ
2ＣＩ／Ｏエクスパンダ６１５を同時に選択して初期化することは可能である。
Note that the RESET terminal (see FIG. 7) input to all the I 2 CI /
Even when the reset signal is transmitted to the RESET terminal of
It is possible to simultaneously select and initialize the 2 CI /
なお、ステップ２７０２の処理でリセット条件成立とみなされた場合は、マスタＩＣ５
７０において異常が発生していることが考えられるので、ステップ２７０５の処理でマス
タＩＣ５７０も初期化するようにしている。
If it is determined in
Since it is conceivable that an abnormality occurs at 70, the
マスタＩＣ５７０は、ＣＰＵ５５１からの指令によって、接続線ＳＤＡ及び接続線ＳＣ
Ｌの信号レベルを制御する信号レベル制御手段として機能しているので、すべての発光制
御装置にてデータ送信に関する異常が発生している場合には、マスタＩＣ５７０自身に異
常が発生していることも考えられる。
Since it functions as a signal level control means for controlling the signal level of L, when an abnormality related to data transmission occurs in all the light emission control devices, an abnormality may also occur in the
そのため、すべての装飾制御装置６１０にてデータ送信に関する異常が発生している場
合には、念のために、ＣＰＵ５５１（演算処理手段）によりマスタＩＣ５７０が初期化さ
れる。これにより、マスタＩＣ５７０で異常が発生している場合であっても確実にマスタ
ＩＣ５７０を制御可能にすることができる。
Therefore, when an abnormality related to data transmission occurs in all the
また、図２２に示すように、表示装置５３の画像を更新する周期と同期して、演出制御
装置５５０のマスタＩＣ５７０からＩ2ＣＩ／Ｏエクスパンダ６１５へ発光制御データを
送信し、Ｉ2ＣＩ／Ｏエクスパンダ６１５は受信した発光制御に基づいて発光装置を制御
するので、表示装置５３における演出と発光装置における演出とが調和し、遊技者に違和
感を与えないので、興趣を高めることができる。
Further, as shown in FIG. 22, in synchronization with the cycle of updating the image of the
また、表示装置５３の画像を更新する周期と同期してマスタＩＣ５７０から送信された
発光制御データが装飾制御装置６１０で受信されると、その都度、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５によってワークレジスタの値が更新される。そのため、毎回ワークレジスタの
値が最新の状態に更新されるので、ノイズ等でワークレジスタの値が破壊されても、正常
な値に復帰することが可能である。
In addition, whenever the light emission control data transmitted from the
また、表示装置５３の画像を更新する周期と同期して、エラー判定処理を実行するので
、エラー判定の実行頻度を適切にできる、つまり、エラー判定処理の実行頻度が高すぎる
（単位時間当たりの実行回数が多すぎる）と、演出制御装置５５０のＣＰＵ５５１の処理
負荷が増大してしまい、逆に、エラー判定処理の実行頻度が低すぎる（単位時間当たりの
実行回数が少なすぎる）と、異常が発生したことを適切に検出できなくなってしまうこと
になるので、適度な頻度でエラー判定を行うことにより処理の不具合を防止することがで
きる。
Moreover, since the error determination process is performed in synchronization with the cycle of updating the image of the
図２８は、本発明の第１実施形態のタイマ割込が発生した場合に実行されるタイマ割込
処理のフローチャートである。
FIG. 28 is a flowchart of timer interrupt processing executed when a timer interrupt occurs according to the first embodiment of this invention.
タイマ割込は、タイマ割込が許可されているという条件の下で、２ｍｓ周期で発生する
タイマ割込をＣＰＵ５５１が受け付けた場合に、図２２に示す処理に割り込む形態で実行
される。
The timer interrupt is executed in a form of interrupting the process shown in FIG. 22 when the
タイマ割込処理は、役物駆動ＭＯＴ５６１及び役物駆動ＳＯＬ５６０（可動物）に接続
されたＩ2ＣＩ／Ｏエクスパンダ６１５（可動制御装置）へ制御データを出力し、可動物
を制御する処理である。
The timer interrupt process is a process of outputting control data to the I 2 CI / O expander 615 (movable control device) connected to the product driven
まず、演出制御装置５５０は、リセット要求フラグが設定されているか否かを判定する
（２８０１）。
First, the
ステップ２８０１の処理で、リセット要求フラグが設定されていると判定された場合に
は、可動制御装置を含む装飾制御装置６００のリセット処理が開始するのを待機している
状態であるので、タイマ割込処理を終了する。
If it is determined in the process of
一方、ステップ２８０１の処理で、リセット要求フラグが設定されていないと判定され
た場合には、制御対象となる可動制御装置を選択し（２８０２）、ステップ２８０２の処
理で選択された可動制御装置へ、演出制御データである可動制御データを送信するスレー
ブ単発出力処理を実行する（２８０３）。スレーブ単発出力処理は、図２９で詳細を説明
する。
On the other hand, if it is determined in the process of
次に、演出制御装置５５０は、ステップ２８０３の処理で実行されたスレーブ単発出力
処理が正常に終了したか否かを判定する（２８０４）。スレーブ単発出力処理では、ステ
ップ２８０２の処理で選択された可動制御装置へ１回目のデータ出力が失敗し、さらに２
回目のデータ出力も失敗した場合には、異常終了する。
Next, the
If the second data output also fails, it terminates abnormally.
ステップ２８０４の処理で、スレーブ単発出力処理が正常に終了していないと判定され
た場合、つまり、スレーブ単発出力処理が異常終了したと判定された場合、演出制御装置
５５０は、役物駆動ＭＯＴ５６１が初期化中であることを示すモータ初期化フラグを設定
し（２８０５）、装飾制御装置６００のリセット処理を開始するためにリセット要求フラ
グを設定する（２８０６）。
If it is determined in the process of
そして、演出制御装置５５０は、役物駆動ＭＯＴ５６１を初期化する場合に可動制御装
置に出力されるモータ出力データをＲＡＭ５５３に設定し（２８０７）、役物駆動ＳＯＬ
５６０を初期化する場合に可動制御装置に出力される、役物駆動ＳＯＬ５６０の通電状態
を非通電状態にするオフデータをＲＡＭ５５３に設定し（２８０８）、タイマ割込処理を
終了する。
Then, the
The off data, which is output to the movable control device when initializing 560, is set in the
一方、ステップ２８０４の処理で、スレーブ単発出力処理が正常に終了したと判定され
た場合、役物駆動ＭＯＴ５６１の初期化を実行するか否かを判定するために、モータ初期
化フラグが設定されているか否かを判定する（２８０９）。
On the other hand, when it is determined in the processing of
ステップ２８０９の処理で、モータ初期化フラグが設定されていると判定された場合に
は、モータ位置検出センサ５１０が役物駆動ＭＯＴ５６１の回転軸が初期位置に戻ったこ
とを検出したか否かを判定する（２８１０）。
If it is determined in the process of
ステップ２８１０の処理で、モータ位置検出センサ５１０が役物駆動ＭＯＴ５６１の回
転軸が初期位置に戻ったことを検出していないと判定された場合、ステップ２８０７の処
理に進み、役物駆動ＭＯＴ５６１を初期化する場合に可動制御装置に出力されるモータ出
力データをＲＡＭ５５３に設定する。
If it is determined in the process of
一方、ステップ２８１０の処理で、モータ位置検出センサ５１０が役物駆動ＭＯＴ５６
１の回転軸が初期位置に戻ったことを検出したと判定された場合、役物駆動ＭＯＴ５６１
の回転を停止させる停止データを可動制御装置に出力するために、ＲＡＭ５５３に設定し
（２８１１）、役物駆動ＭＯＴ５６１の初期化が完了したので、モータ初期化フラグを解
除し（２８１２）、タイマ割込処理を終了する。
On the other hand, in the process of
If it is determined that it has detected that the rotation axis of 1 has returned to the initial position, the
In order to output stop data to stop the rotation of the motor to the movable control device, it is set in the RAM 553 (2811), and initialization of the
ステップ２８０９の処理で、モータ初期化フラグが設定されていないと判定された場合
には、演出制御装置５５０は、役物駆動ＭＯＴ５６１で動作異常が検出されたか否かを判
定する（２８１３）。
If it is determined in the process of
ステップ２８１３の処理で、役物駆動ＭＯＴ５６１で動作異常が検出されたと判定され
た場合には、役物駆動ＭＯＴ５６１を初期化するために、ステップ２８０５の処理に進む
。
If it is determined in the process of
一方、ステップ２８１３の処理で、役物駆動ＭＯＴ５６１で動作異常が検出されていな
いと判定された場合には、演出制御装置５５０は、役物駆動ＭＯＴ５６１の回転軸を目標
値まで回転させるための制御データを可動制御装置に出力するために、ＲＡＭ５５３に設
定し（２８１４）、役物駆動ＳＯＬ５６０を通電状態にするか非通電状態にするかを示す
ソレノイド出力データを可動制御装置に出力するために、ＲＡＭ５５３に設定し（２８１
５）、タイマ割込処理を終了する。
On the other hand, if it is determined in the process of
5) End the timer interrupt process.
図２９は、本発明の第１実施形態のスレーブ単発出力処理のフローチャートである。 FIG. 29 is a flowchart of slave single output processing of the first embodiment of the present invention.
スレーブ単発出力処理は、可動制御装置に可動制御データを送信する処理であり、図２
８に示すステップ２８０３の処理で実行される。
The slave single-shot output process is a process of transmitting movable control data to the movable control device, as shown in FIG.
It is executed in the process of
可動制御データは、マスタＩＣ５７０からバイトモードで送信される。バイトモードで
は、マスタＩＣ５７０は、Ｉ2ＣＩ／Ｏエクスパンダ６１５へデータを１バイト送信する
毎に、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＡＣＫ又はＮＡＣＫを受信し、ＡＣＫ及びＮ
ＡＣＫの何れを受信した場合でも、割込信号をＣＰＵ５５１に出力する。つまり、マスタ
ＩＣ５７０からＩ2ＣＩ／Ｏエクスパンダ６１５へ１バイトのデータを送信することが完
了すれば、ＡＣＫ／ＮＡＣＫの受信に拘らず、必ず、マスタＩＣ５７０からＣＰＵ５５１
へ割込信号が出力される。
The movable control data is transmitted from the
The interrupt signal is output to the
Interrupt signal is output.
まず、ＣＰＵ５５１は、ＡＣＫの返答信号の受信に失敗したことを計数するＡＣＫカウ
ンタに０を設定する（２９０１）。
First, the
そして、マスタＩＣ５７０は、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを、スター
ト条件を示す信号レベルに変化させる（２９０２）。
Then, the
具体的には、マスタＩＣ５７０は、接続線ＳＣＬの信号レベルをＨＩＧＨに維持したま
ま、接続線ＳＤＡの信号レベルをＨＩＧＨからＬＯＷに変化させることよってスタート条
件を示す信号を出力する。
Specifically, the
なお、マスタＩＣ５７０は、スタート条件を示す信号を出力後、制御対象となる装飾制
御装置６１０へデータを送るために、接続線ＳＣＬのレベルをＬＯＷに変更する。
After outputting a signal indicating the start condition, the
次に、ＣＰＵ５５１は、送信対象として選択されている可動制御装置のアドレスデータ
を出力用ＢＵＦ５７２に設定する（２９０３）。
Next, the
そして、ＣＰＵ５５１は、マスタＩＣ５７０へデータ送信の開始を指示した時点から、
マスタＩＣ５７０がＣＰＵ５５１へ割込信号を伝達させるまでの時間を監視するために、
バイトモード用の監視タイマの起動を開始する（２９０４）。
Then, from the time when the
In order to monitor the time until
The start of the monitoring timer for the byte mode is started (2904).
ＣＰＵ５５１は、バイトモード時間の監視を開始してから所定時間経過しても、割込信
号を受け付けていない場合には、データ送信を中断するために、マスタＩＣ５７０にスト
ップ条件を出力させ（２９１２）、その後、ＡＣＫカウンタの値を一つ加算して、ステッ
プ２９０２の処理に戻り、再度マスタＩＣ５７０にスタート条件を出力させてから、可動
制御データを初めのデータ（可動制御装置のアドレス）から送信する。ただし、ＡＣＫカ
ウンタの値がステップ２９１３の時点で所定値（例えば「１」）となっている場合には、
処理を終了する。
The
End the process.
そして、ＣＰＵ５５１は、ステップ２９０２の処理で出力用ＢＵＦ５７２に設定された
アドレスデータを送信する指令をマスタＩＣ５７に出力し、マスタＩＣ５７０は、当該指
令を受け付けると、ステップ２９０２の処理で出力用ＢＵＦ５７２に設定されたアドレス
データを、接続線ＳＣＬの信号レベルを変化させながら、接続線ＳＤＡを介してＩ2ＣＩ
／Ｏエクスパンダ６１５に送信する（２９０５）。マスタＩＣ５７０は、このアドレスデ
ータを出力する際に、一旦、ドライバ５７６Ａをオフさせて接続線ＳＤＡを解放する（ハ
イレベルに変化させる）動作を行う。そして、接続線ＳＤＡが解放されていない場合（ド
ライバ５７６Ａをオフしても、接続線ＳＤＡがハイレベルにならずロウレベルのままで維
持されているとき）には、このアドレスデータの出力は、接続線ＳＤＡが開放される（接
続線ＳＤＡがハイレベルになる）まで待機する。
Then,
It transmits to the / O expander 615 (2905). When outputting the address data,
ステップ２９０５の処理で出力されるアドレスデータは８ビットのデータ列であるため
、１回の出力処理（接続線ＳＣＬが８回ＨＩＧＨに変化する間の出力）でアドレスデータ
が出力される。
Since the address data output in the process of
ステップ２９０５の処理で出力されたアドレスデータがＩ2ＣＩ／Ｏエクスパンダ６１
５に入力された場合、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、入力されたアドレスデータと
自身に設定されているアドレスとが一致するか否かを判定する。
The address data output in the process of
When it is input to 5, the I 2 CI /
入力されたアドレスデータと一致するアドレスが設定されているＩ2ＣＩ／Ｏエクスパ
ンダ６１５は、接続線ＳＣＬのＬＯＷからＨＩＧＨへの変更回数が８回目になった直後で
あって、そのＨＩＧＨレベルとなっている接続線ＳＣＬがＬＯＷレベルへと変化すること
を契機として、返答信号を接続線ＳＤＡからマスタＩＣ５７０に出力する。
The I 2 CI /
次に、マスタＩＣ５７０は、１バイト分のデータ出力完了から、所定時間（前述したバ
イトモード監視時間よりも短い監視時間となっている）以内にＡＣＫの返答信号がマスタ
ＩＣ５７０に入力されたか否かを確認する（２９０６）。
Next, the
次に、マスタＩＣ５７０は、ステップ２９０６の処理の確認結果に基づいて、ステップ
２９０５の処理でアドレスデータが出力されてから所定時間以内にＡＣＫの返答信号が入
力されているか否かを判定する（２９０７）。
Next, the
ステップ２９０５の処理でアドレスデータが出力されてから所定時間以内にＡＣＫの返
答信号が入力されていないと、ステップ２９０７の処理で判定された場合には、マスタＩ
Ｃ５７０は、ステータスＲＥＧ５７９に返答信号がＮＡＣＫであった旨の情報を設定した
うえで、割込信号を発生させる。これにより、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＮＡ
ＣＫの返答信号を受信したことが、ＣＰＵ５５１に通知される。このとき、ＣＰＵ５５１
はバイトモードの時間監視を終了する（２９１１）。
If it is determined in the process of
The
Ends the time monitoring of the byte mode (2911).
次いで、ＣＰＵ５５１は、データ送信を中断するために、マスタＩＣ５７０にストップ
条件を出力させ（２９１２）、ＡＣＫカウンタが所定値であるか否かを判定する（２９１
３）。
Subsequently, the
3).
ステップ２９１２の処理で、ＡＣＫカウンタが所定値であると判定された場合、スレー
ブ単発出力処理を異常終了する。
If it is determined in the process of
一方、ステップ２９１３の処理で、ＡＣＫカウンタが所定値でないと判定された場合、
ＡＣＫカウンタをインクリメントし、ステップ２９０２の処理に戻り、再度マスタＩＣ５
７０にスタート条件を出力させてから、再度同じ可動制御データを出力する（可動制御装
置のアドレスから再出力する）。
On the other hand, when it is determined in the process of
The ACK counter is incremented, and the process returns to step 2902 and the
After the start condition is output to 70, the same movable control data is output again (re-output from the address of the movable control device).
一方、ステップ２９０５の処理で、１バイト分のデータ出力完了から、所定時間以内に
ＡＣＫの返答信号が入力されたと、ステップ２９０７の処理で判定された場合には、マス
タＩＣ５７０は、ステータスＲＥＧ５７９に返答信号がＡＣＫであった旨の情報を設定し
たうえで、割込信号を発生させる。これにより、Ｉ2ＣＩ／Ｏエクスパンダ６１５からＡ
ＣＫの返答信号を受信したことが、ＣＰＵ５５１に通知される。このとき、ＣＰＵ５５１
はバイトモードの時間監視を終了する（２９０８）。
On the other hand, if it is determined in the process of
The
Ends the time monitoring in byte mode (2908).
次に、ＣＰＵ５５１は、可動制御装置に出力すべきデータをすべて出力したか否かを判
定する（２９０９）。
Next, the
ステップ２９０９の処理で、可動制御装置に出力すべきデータをすべて出力したと判定
された場合、接続線ＳＤＡ及び接続線ＳＣＬの信号レベルを、ストップ条件を示す信号レ
ベルに変化させて（２９１０）、スレーブ単発出力処理を正常終了する。
If it is determined in the process of
一方、ステップ２９０９の処理で、可動制御装置に出力すべきデータを未だ出力してい
ないと判定された場合、ＣＰＵ５５１は、可動制御装置に出力すべき次の１バイト分のデ
ータを出力用ＢＵＦ５７２に設定する（２９１５）。
On the other hand, if it is determined in the process of
次に、ＣＰＵ５５１は、マスタＩＣ５７０へデータ送信の開始を指示した時点から、マ
スタＩＣ５７０がＣＰＵ５５１へ割込信号を伝達させるまでの時間を監視するために、バ
イトモード用の監視タイマの起動を開始する（２９１６）。
Next,
１バイトのデータを送信してからマスタＩＣ５７０から当該１バイトのデータに対する
ＡＣＫである返答信号が入力されたか否かを通知するための割込が発行されるまでの時間
（バイトモード時間）の監視を開始する（２９１６）。
Monitoring of time (byte mode time) from transmission of 1-byte data to issuance of an interrupt for notifying whether or not a reply signal which is an ACK to the 1-byte data is input from
前述したように、ＣＰＵ５５１は、バイトモード時間の監視を開始してから所定時間経
過しても、割込信号を受け付けていない場合には、データ送信を中断するために、マスタ
ＩＣ５７０にストップ条件を出力させ（２９１２）、その後、ＡＣＫカウンタの値を1つ
加算して、ステップ２９０２の処理に戻り、再度マスタＩＣ５７０にスタート条件を出力
させてから、可動制御データを初めのデータ（可動制御装置のアドレス）から送信する。
ただし、ＡＣＫカウンタの値がステップ２９１３の時点で所定値となっている場合には、
処理を終了する。
As described above, when the
However, if the value of the ACK counter is a predetermined value at the time of
End the process.
次に、マスタＩＣ５７０は、接続線ＳＤＡの電圧レベルを監視し、接続線ＳＤＡが解放
されていることを確認してから（２９１７）、出力用ＢＵＦ５７２に設定された１バイト
のデータを出力し（２９１８）、ステップ２９０６の処理に進む。ステップ２９１７の処
理は、グループ単位制御手段からの返答信号の出力が終了するまでは、接続線ＳＤＡが返
答信号により占有されているので、マスタＩＣ５７０は、グループ単位制御手段からの返
答信号の出力が終了し、接続線ＳＤＡが解放されるまで待機する処理である。Ｉ2Ｃ
以後、可動制御データを順に送信し、全ての可動制御データの送信が完了すると、前述し
たようにステップ２９１０の処理を経て、正常終了する。
Next, the
Thereafter, the movable control data is sequentially transmitted, and when the transmission of all the movable control data is completed, the processing of
送信される可動動制御データの順序は、発光制御データと同様に図１９に示すフォーマ
ットとなっているが、可動動制御データはバイトモードで送信されるため、図１９に示す
フォーマットの全データを、一度に出力用ＢＵＦ５７２に設定するのではなく、先頭から
１バイト毎に区切って、出力用ＢＵＦ５７２に設定しながら、データの送信を行う。その
ため、図１９に示すフォーマットの全データ（モータやソレノイドの制御データを含んで
いる）は、ＲＡＭ５５３に一時的に記憶されることになる。
The order of the movable movement control data to be transmitted is in the format shown in FIG. 19 as in the case of the light emission control data, but since the movable movement control data is transmitted in the byte mode, all the data in the format shown in FIG. Instead of setting the
これにより、Ｉ2Ｃ可動制御装置が制御する役物駆動ＭＯＴ５６１及び役物駆動ＳＯＬ
５６０は、ＶＤＰ割込（約３３．３ｍｓ周期）に同期して可動制御データを出力するので
は、演出に合わせて可動部材を制御できないため、ＶＤＰ割込よりも周期の短いタイマ割
込（２ｍｓ周期）に同期して可動制御データが出力されるようにしている。これによって
、遊技状態に合わせた可動部材による演出を行うことができる。
Thus, the
In 560, if the movable control data is output in synchronization with the VDP interrupt (about 33.3 ms cycle), it is not possible to control the movable member according to the effect, so the timer interrupt (2 ms) whose cycle is shorter than the VDP interrupt The movement control data is output in synchronization with the cycle). As a result, it is possible to produce effects by the movable members adapted to the gaming state.
また、可動制御データは、図２９に示すように、バイトモードで送信される。これは、
接続線ＳＤＡが解放されない異常が発生した場合には可動制御装置が制御できなくなり、
役物駆動ＭＯＴ５６１が予め設定されている可動部材の可動可能な範囲を超えて可動部材
を可動させるおそれがあるので、バイトモード監視時間による短時間のタイムアップ監視
を行って、接続線ＳＤＡが解放されない異常を即座に検出するためである。
The movable control data is transmitted in byte mode as shown in FIG. this is,
If an abnormality occurs in which the connection line SDA is not released, the mobile control device can not be controlled,
Since there is a possibility that the movable member can be moved beyond the movable range of the movable member set in advance by the
図２６、及び図２９による処理では、マスタＩＣ５７０は、８ビットのデータを出力後
に、装飾制御装置６１０からの返答信号を取り込むことにより、データ転送の成否を判定
し、データ転送が失敗している場合（つまり、ＮＡＣＫの返答信号がマスタＩＣ５７０に
入力された場合）、出力したデータを１回だけ再度出力するので、装飾制御装置６１０に
データを可能な限り確実に出力することができ、演出装置の誤動作を防止できる。
In the processing according to FIGS. 26 and 29, after outputting 8-bit data,
なお、マスタＩＣ５７０がスタート条件を送信する際には、接続線ＳＤＡがＨＩＧＨに
なっている必要があるが、ノイズ等の影響によって、接続線ＳＤＡがＬＯＷとなったまま
変化しない状態が発生する場合がある。
When
本実施形態では、マスタＩＣ５７０が装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ
６１５に送信するスレーブアドレスには、Ｒ／Ｗ識別データが「０」（書き込みを意味す
る）となっているものだけを用いている（図１１参照）が、ノイズ等の影響によって、Ｒ
／Ｗ識別データが「１」（読み出しを意味する）となった状態で、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５へ伝わることがある。
In this embodiment, the slave address transmitted by the
It may be transmitted to the I 2 CI /
この場合、Ｉ2ＣＩ／Ｏエクスパンダ６１５は読み出しモードとなり、マスタＩＣ５７
０によって接続線ＳＣＬの信号レベルが変化することに対応して、Ｉ2ＣＩ／Ｏエクスパ
ンダ６１５からマスタＩＣ５７０へ、接続線ＳＤＡを介してデータを１ビットごと伝送す
る処理を行う。
In this case, the I 2 CI /
In response to the change of the signal level of the connection line SCL due to 0, processing of transmitting data bit by bit via the connection line SDA from the I 2 CI /
このとき、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、８ビットのデータを伝送するごとに、
マスタＩＣ５７０から接続線ＳＤＡを介してアクノリッジ信号を受信する処理を行い、ア
クノリッジ信号を受信するとさらに８ビットのデータ伝送を行い、以後、この８ビットの
データ伝送とアクノリッジ信号の確認を繰り返すが、この間は、接続線ＳＤＡがＩ2ＣＩ
／Ｏエクスパンダ６１５によって専有されている状態となる。
At this time, every time the I 2 CI /
An acknowledge signal is received from
/
一方で、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、８ビットのデータ伝送後に、マスタＩＣ
５７０から接続線ＳＤＡを介してアクノリッジ信号を受信できないときは、接続線ＳＤＡ
を解放してデータ伝送を中止する。なお、Ｉ2ＣＩ／Ｏエクスパンダ６１５は、マスタＩ
Ｃ５７０から接続線ＳＤＡを介してアクノリッジ信号を受信する際には、接続線ＳＤＡが
ＬＯＷレベルであればアクノリッジ信号を受信したと解釈し、接続線ＳＤＡがＨＩＧＨレ
ベルであればアクノリッジ信号を受信しないと解釈する。
On the other hand, the I 2 CI /
If the acknowledge signal can not be received from 570 through connection line SDA, connection line SDA
To release data transmission. The I 2 CI /
When an acknowledge signal is received from C570 via connection line SDA, it is interpreted that an acknowledge signal is received if connection line SDA is at a LOW level, and that an acknowledge signal is not received if connection line SDA is at a HIGH level. Interpret.
よって、マスタＩＣ５７０からのデータがノイズ等の影響により変化し、この変化した
データを勝手に受信して読み出しモードとなったＩ2ＣＩ／Ｏエクスパンダ６１５が発生
してしまうと、接続線ＳＤＡがいつまでも解放されないことになる。
Therefore, when the data from the
このような場合に、接続線ＳＤＡの信号レベルはＬＯＷに維持されたままになり、マス
タＩＣ５７０と、本来送信を行うことを意図していた装飾制御装置６１０のＩ2ＣＩ／Ｏ
エクスパンダ６１５との間で接続線ＳＤＡを介した通信が行えなくなる。
In such a case, the signal level of the connection line SDA remains LOW, and the
Communication with the
そこで、マスタＩＣ５７０は、スタート条件を示す信号を出力する前に、接続線ＳＤＡ
からデータが出力できる状態であるか否かを判定するために、接続線ＳＤＡの信号レベル
がＨＩＧＨであるか否かを判定する。
Therefore, before the
It is determined whether the signal level of the connection line SDA is HIGH or not in order to determine whether or not the data can be output.
接続線ＳＤＡの信号レベルがＨＩＧＨでないと判定された場合、接続線ＳＤＡからデー
タが出力できないので、ドライバ５７６Ａによりトランジスタ５７８Ａに動作可能な電圧
を印加しないことによってトランジスタ５７８Ａをオンさせずに（接続線ＳＤＡを解放し
た状態で）、接続ＳＣＬの信号レベルを少なくとも９回変化させる。
If it is determined that the signal level of the connection line SDA is not HIGH, data can not be output from the connection line SDA, and the
このような処理を行うことで、読み出しモードとなったＩ2ＣＩ／Ｏエクスパンダ６１
５は、接続ＳＣＬの信号レベルの変化に合わせて接続線ＳＤＡにデータを出力するが、接
続ＳＣＬの信号レベルの変化が少なくとも９回行われる途中において、マスタＩＣ５７０
からのアクノリッジ信号を確認するタイミングが発生する。このとき、接続線ＳＤＡは解
放されているのでＨＩＧＨレベルとなり、読み出しモードとなったＩ2ＣＩ／Ｏエクスパ
ンダ６１５は、アクノリッジ信号を受信しなかったと判断するので、データ伝送をやめて
接続線ＳＤＡを解放することになる。
By performing such processing, the I 2 CI / O expander 61 that has become the read mode
5 outputs data to the connection line SDA in accordance with the change of the signal level of the connection SCL, but the
Timing to confirm the acknowledge signal from At this time, since the connection line SDA is released, it becomes high level, and the I 2 CI /
なお、この処理は、スタート条件を示す信号を出力する前だけでなく、マスタＩＣ５７
０が装飾制御装置６１０へ実際のデータを出力する前に行われるようにしてもよい。
This process is not only performed before the signal indicating the start condition is output, but also the master IC 57.
0 may be performed before outputting actual data to the
このようにして、読み出しモードとなった装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパ
ンダ６１５から強制的に接続線ＳＤＡを解放させるので、接続線ＳＤＡの信号レベルはＨ
ＩＧＨに維持されるようになる。
In this manner, since the connection line SDA is forcibly released from the I 2 CI /
Be maintained in IGH.
図３０は、本発明の第１の実施形態の遊技機全体に設けられる装飾制御装置６１０の接
続形態を示す図であり、特に前面枠３に設けられる装飾制御装置６１０について説明する
図である。
FIG. 30 is a view showing a connection form of the
装飾制御装置６１０は、主に、遊技盤１０及び前面枠３に取り付けられている。前面枠
３に取り付けられた装飾制御装置６１０が制御するＬＥＤは、装飾部材９、照明ユニット
１１、及び異常報知ＬＥＤ２９を照射するものである。
The
遊技機には複数の仕様があり、通常版遊技機１（第１仕様の遊技機）と廉価版遊技機１
（第２仕様の遊技機）とがある。通常版遊技機１は、標準仕様の装飾部材９を備える前面
枠３（通常版前面枠、第１の遊技枠）を備えている。廉価版遊技機１は、標準仕様の装飾
部材９よりも廉価なコストで構成された装飾部材９'を備える前面枠３（廉価版前面枠、
第２の遊技枠）を備えている。
The game machine has a plurality of specifications, and the normal version game machine 1 (the first specification game machine) and the low price
(The game machine of the second specification). The normal
The second game slot is provided.
通常版前面枠３と廉価版前面枠３とは、装飾部材９を照射するために取り付けられる装
飾制御装置６１０の数が相違する。具体的には、通常版前面枠３の装飾部材９は四つの装
飾制御装置６１０により照射され、廉価版前面枠３の装飾部材９'は二つの装飾制御装置
６１０により照射される。装飾部材９は最大６０個のＬＥＤによって照射されるのに対し
て、装飾部材９'は最大３０個のＬＥＤによって照射されるので、装飾部材９のほうが装
飾部材９'よりも明るくなる。このため、通常版前面枠３が取り付けられた場合の装飾制
御装置６１０の制御と、廉価版前面枠３が取り付けられた場合の装飾制御装置６１０の制
御とが異なる。
The number of
通常版前面枠３に取り付けられる装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１
５のアドレスと廉価版前面枠３に取り付けられる装飾制御装置６１０のＩ2ＣＩ／Ｏエク
スパンダ６１５の固有アドレスとが同じであると、通常版前面枠３が取り付けられた場合
の制御を行う通常版用の演出制御装置５５０と、廉価版前面枠３が取り付けられた場合の
制御を行う廉価版用の演出制御装置５５０と、を用意して、取り付けられる前面枠３に対
応して演出制御装置５５０を取り換えなければならない。したがって、製造メーカーが遊
技機１を出荷する場合に、通常版用の演出制御装置５５０と廉価版用の演出制御装置５５
０とを用意しなければならず、製造コストが高くなってしまう。
I 2 CI / O Expander 61 of
If the address of No. 5 and the unique address of the I 2 CI /
It is necessary to prepare 0, which increases the manufacturing cost.
このため、本実施形態では、通常版前面枠３と廉価版前面枠３とで制御が異なる装飾制
御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５の個別アドレスには、異なるアドレスを
割り当て、一つの演出制御装置５５０が通常版用の制御と廉価版用の制御とを行えるよう
にした。これによって、通常版用の演出制御装置５５０と廉価版用の演出制御装置５５０
とを用意する必要がなくなり、製造コストを削減できる。
For this reason, in this embodiment, different addresses are assigned to the individual addresses of the I 2 CI /
There is no need to prepare and manufacturing costs can be reduced.
具体的には、通常版前面枠３の装飾部材９を照射するＬＥＤに接続される四つの装飾制
御装置６１０（第１の仕様依存型グループ単位制御手段）のＩ2ＣＩ／Ｏエクスパンダ６
１５の固有アドレスには、「１００１」、「１０１０」、「１１００」、及び「１１０１
」が割り当てられる。
Specifically, the I 2 CI /
The 15 unique addresses are "1001", "1010", "1100", and "1101".
Is assigned.
一方、廉価版前面枠３の装飾部材９'を照射するＬＥＤに接続される二つの装飾制御装
置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５（第２の仕様依存型グループ単位制御手段）
のアドレスには、通常版前面枠３の装飾部材９を照射するＬＥＤに接続される四つの装飾
制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５の固有アドレスと異なる「１１１０」
及び「１１１１」が割り当てられる。
On the other hand, the I 2 CI / O expander 615 (second specification dependent group unit control means) of the two
Address different from the unique address of the I 2 CI /
And "1111" are assigned.
そして、通常版前面枠３と廉価版前面枠３の何れに使用される場合であっても、演出制
御装置５５０からは、装飾部材９、９'のＩ2ＣＩ／Ｏエクスパンダ６１５に割り当てられ
た固有アドレスである「１００１」、「１０１０」、「１１００」、「１１０１」、「１
１１０」及び「１１１１」の全てを含んだ演出制御データが、装飾制御装置６１０に送信
される。
And, even in the case of being used for any of the normal
The presentation control data including all of 110 "and" 1111 "is transmitted to the
したがって、通常版用の制御と廉価版用の制御とを行えるようにした一つの演出制御装
置５５０で通常版前面枠３の装飾制御装置６１０と廉価版用の装飾制御装置６１０とを制
御できるので、製造コストを削減できる。
Therefore, since one
また、通常版前面枠３と廉価版前面枠３とで同じ制御をする照明ユニット１１及び異常
報知ＬＥＤ２９を照射するＬＥＤに接続された装飾制御装置６１０のＩ2ＣＩ／Ｏエクス
パンダ６１５には、通常版前面枠３と廉価版前面枠３とで異なるアドレスにする必要はな
く、同じアドレスが割り当てられる。
In addition, the I 2 CI /
なお、廉価版前面枠３では、固有アドレスが「１００１」、「１０１０」、「１１００
」、「１１０１」となるＩ2ＣＩ／Ｏエクスパンダ６１５は使用されず、通常版前面枠３
では、固有アドレスが「１１１０」、「１１１１」となるＩ2ＣＩ／Ｏエクスパンダ６１
５は使用されない。そのため、何れの仕様の前面枠３であっても、異常判定テーブル２１
００（図２１）において、接続されないＩ2ＣＩ／Ｏエクスパンダ６１５が存在すること
になるが、前述したように、異常判定テーブル２１００に登録されているＩ2ＣＩ／Ｏエ
クスパンダ６１５の一つと、マスタＩＣ５７０との間でデータ送受信が行われれば、正常
な状態として処理されるので問題はない。
In the low
, “1101” will not be used and the I 2 CI /
Then, the I 2 CI / O expander 61 with unique addresses “1110” and “1111”.
5 is not used. Therefore, even if the
At 00 (FIG. 21), there is an I 2 CI /
（第２実施形態）
本発明の第２実施形態を図３１〜図３４を用いて説明する。
Second Embodiment
A second embodiment of the present invention will be described with reference to FIGS.
本発明の第２実施形態は、演出制御装置５５０が複数のマスタＩＣ５７０を備える場合
の実施形態である。
The second embodiment of the present invention is an embodiment in which the
図３１は、本発明の第２実施形態の複数のマスタＩＣ５７０とＩ2ＣＩ／Ｏエクスパン
ダ６１５との接続の説明図である。
FIG. 31 is an explanatory diagram of connection between a plurality of
演出制御装置５５０は、二つのマスタＩＣ５７０Ａ及び５７０Ｂを備える。
The
マスタＩＣ５７０Ａには、遊技盤１０を装飾する７個の装飾制御装置６１０（中継基板
６００Ａ、及び装飾制御装置６１０Ａ〜６１０Ｆ）が接続される。
To the
中継基板６００ＡはＩ2ＣＩ／Ｏエクスパンダ６１５を備えるので、装飾制御装置６１
０の一種であり、遊技盤１０に取り付けられた装飾制御装置６１０の中で最も上流に位置
する。中継基盤６００Ａには、直接に接続された装飾制御装置６１０Ａ〜６１０Ｃと直接
に接続された装飾制御装置６１０Ｄ〜６１０Ｆとが並列に接続される。
Since relay board 600A includes I 2 CI /
It is a type of 0, and is positioned most upstream in the
マスタＩＣ５７０Ｂには、通常版前面枠３に取り付けられる７個の装飾制御装置６００
Ｂ及び６１０Ｇ〜６１０Ｌ、又は、廉価版前面枠３に取り付けられる４個の装飾制御装置
６００Ｂ及び６１０Ｍ〜６１０Ｏが接続される。
In
B and 610G to 610L, or four
装飾制御装置６００Ｂは、遊技機１に通常版前面枠３及び廉価版前面枠３のいずれが取
り付けられも、マスタＩＣ５７０Ｂに接続される装飾制御装置６１０の中で最も上流に位
置する装飾制御装置６１０であるため、中継基板６００としても機能する。このため、装
飾制御装置６００Ｂと記載している。
The
装飾制御装置６００Ｂは、照明ユニット１１及び異常報知ＬＥＤ２９を照射するＬＥＤ
を制御するものである。照明ユニット１１及び異常報知ＬＥＤ２９の照射態様は、通常版
前面枠３であっても廉価版前面枠３であっても同じである。このため、通常版前面枠３及
び廉価版前面枠３には、同じアドレスが付与された装飾制御装置６１０Ｂが取り付けられ
ている。
The
Control. The irradiation mode of the
遊技機１に通常版前面枠３が取り付けられる場合には、装飾制御装置６００Ｂには、直
列に接続された装飾制御装置６１０Ｇ〜６１０Ｉと直列に接続された装飾制御装置６１０
Ｊ〜６１０Ｌとが並列に接続される。一方、遊技機１に廉価版前面枠３が取り付けられる
場合には、装飾制御装置６００Ｂには、直列に接続された装飾制御装置６１０Ｍ〜６１０
Ｏが接続される。
When the normal
J to 610L are connected in parallel. On the other hand, when the low priced
O is connected.
通常版前面枠３の装飾部材９を照射するＬＥＤは、６個の装飾制御装置６１０Ｇ〜６１
０Ｌによって制御される。廉価版前面枠３の装飾部材９'を照射するＬＥＤは、３個の装
飾制御装置６１０Ｍ〜６１０Ｏによって制御される。
The LEDs that illuminate the
It is controlled by 0L. The LEDs that illuminate the decorative member 9 'of the inexpensive
このため、装飾部材９のほうが装飾部材９'よりも明るくなる。このため、通常版前面
枠３が取り付けられた場合の装飾制御装置６１０の制御と、廉価版前面枠３が取り付けら
れた場合の装飾制御装置６１０の制御とが異なる。
Therefore, the
なお、各マスタＩＣ５７０に接続される装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパン
ダ６１５のアドレスは、接続されているマスタＩＣ５７０内で一意であるように付与され
る。図３０で説明したように、マスタＩＣ５７０Ｂに接続される装飾制御装置６１０Ｇ〜
６１０Ｌと装飾制御装置６１０Ｍ〜６１０とは異なるアドレスが付与される。
The address of the I 2 CI /
Different addresses are given to 610L and
通常版前面枠３及び廉価版前面枠３のいずれが遊技機１に取り付けられても、装飾部材
９、９'を照射するＬＥＤを制御する装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６１
５に割り当てられたすべての固有アドレスに対して演出制御データがマスタＩＣ５７０Ｂ
から送信される。
The I 2 CI / O expander 61 of the
Production control data is
Sent from
したがって、通常版用の制御と廉価版用の制御とを行えるようにした一つの演出制御装
置５５０で通常版前面枠３の装飾制御装置６１０と廉価版用の装飾制御装置６１０とを制
御できるので、製造コストを削減できる。
Therefore, since one
また、遊技盤１０に取り付けられる装飾制御装置６１０のＩ2ＣＩ／Ｏエクスパンダ６
１５が接続されるマスタＩＣ５７０と、通常版前面枠３に取り付けられる装飾制御装置６
１０のＩ2ＣＩ／Ｏエクスパンダ６１５又は廉価版前面枠３に取り付けられる装飾制御装
置６１０のＩ2ＣＩ／Ｏエクスパンダ６１５が接続されるマスタＩＣ５７０と、を分離し
ている。
In addition, the I 2 CI /
15 is connected to the
The
これによって、１個のマスタＩＣ５７０で制御できるＩ2ＣＩ／Ｏエクスパンダ６１５
の数の制限（図１２に示すように１４個を上限とする）がなくなり、多彩な演出制御を可
能とすることが期待できる。
This allows the I 2 CI /
There is no limitation of the number of (14 as an upper limit as shown in FIG. 12), and it can be expected to enable a variety of effect control.
本実施形態でも、異常判定テーブル２１００（図３２参照）に登録されたＩ2ＣＩ／Ｏ
エクスパンダ６１５のうちの一つのＩ2ＣＩ／Ｏエクスパンダ６１５とマスタＩＣ５７０
との間でデータ送受信が行われれば、正常な状態として処理が行われるが、異常の判定、
並びに、Ｉ2ＣＩ／Ｏエクスパンダ６１５及びマスタＩＣ５７０の初期化の処理を、各系
統毎に独立して行う点が第１の実施形態とは異なっている。
Also in this embodiment, the I 2 CI / O registered in the abnormality determination table 2100 (see FIG. 32)
I 2 CI /
If the data transmission and reception are performed between them, the processing is performed as a normal state, but determination of abnormality,
Also, this embodiment differs from the first embodiment in that the process of initializing the I 2 CI /
本実施形態では、図３２に示すように、異常判定テーブル２１００が各系統毎に用意さ
れている。換言すると、各マスタＩＣ５７０に対応する異常判定テーブル２１００が演出
制御装置５５０のＲＡＭ５５３に記憶されている。
In the present embodiment, as shown in FIG. 32, an abnormality determination table 2100 is prepared for each system. In other words, the abnormality determination table 2100 corresponding to each
これらの異常判定テーブル２１００について具体的に説明する。図３２は、本発明の第
２実施形態の異常判定テーブル２１００の説明図である。
These abnormality determination tables 2100 will be specifically described. FIG. 32 is an explanatory diagram of the abnormality determination table 2100 according to the second embodiment of this invention.
マスタＩＣ５７０Ａと中継基板６００Ａ、装飾制御装置６１０Ａ〜６１０Ｆとの間で行
われるデータ送受信の異常を装飾制御装置毎に判定する第１異常判定テーブル２１００Ａ
、及び、マスタＩＣ５７０Ｂと通常版遊技枠３に取り付けられた装飾制御装置６００Ｂ、
６１０Ｇ〜６１０Ｌ、又は廉価版遊技枠３に取り付けられた装飾制御装置６００Ｂ、６１
０Ｍ〜６１０Ｏとの間で行われるデータ送受信の異常を装飾制御装置毎に判定する第２異
常判定テーブル２１００Ｂの２種類のテーブルが存在する。
First abnormality determination table 2100A for determining, for each decoration control device, an abnormality in data transmission and reception performed between
, And the
610G to 610L, or the
There are two types of tables of a second abnormality determination table 2100B that determines, for each decoration control device, an abnormality in data transmission and reception performed between 0M and 610O.
そして、何れかの異常判定テーブルにて、すべてのＩ2ＣＩ／Ｏエクスパンダ６１５に
関してデータ送受信異常が発生したと判定された場合には、当該異常判定テーブルに属す
るすべての装飾制御装置６１０を初期化し、あわせて対応するマスタＩＣ５７０も初期化
する。但し、他の異常判定テーブルに属する装飾制御装置６１０やマスタＩＣ５７０は初
期化しない。
When it is determined in any of the abnormality determination tables that a data transmission / reception abnormality has occurred for all of the I 2 CI /
例えば、前述した第１の異常判定テーブルにて、全てのＩ2ＣＩ／Ｏエクスパンダ６１
５に関してデータ送受信異常が発生したと判定された場合には、マスタＩＣ５７０Ａ及び
中継基板６００Ａ、装飾制御装置６１０Ａ〜６１０Ｆのみを初期化し、他の、マスタＩＣ
５７０Ｂ、及び装飾制御装置６００Ｂ、装飾制御装置６１０Ｇ〜６１０Ｏは初期化しない
。
For example, in the first abnormality determination table described above, all I 2 CI / O expanders 61
If it is determined that a data transmission / reception abnormality has occurred with respect to No. 5, only the
The 570 B, the
このため、データ送信異常が発生したマスタＩＣ５７０及びデータ送信異常が発生した
マスタＩＣ５７０に接続される装飾制御装置６１０が初期化中であっても、異常が発生し
ていないマスタＩＣ５７０と装飾制御装置６１０との間で、装飾制御データが送受信でき
るので、遊技の途中で装飾装置６２０による演出が突然一時停止してしまうことを防止で
きる。
Therefore, even if the
なお、各マスタＩＣ５７０Ａ、５７０Ｂを初期化する方法として、ソフトリセットとハ
ードリセットとがある。
There are soft reset and hard reset as a method of initializing each
ソフトリセットでは、ＣＰＵ５５１によって各マスタＩＣ５７０Ａ、５７０Ｂのうちの
一つが初期化される。
In soft reset, one of the
具体的には、各マスタＩＣ５７０Ａ、５７０Ｂには、各々リセットＲＥＧ５７３（図４
参照）を備えている。ＣＰＵ５５１がバス５６３を介してこのリセットレジスタ５７３に
特定値（初期化指示情報）を書き込むと、特定値を書き込まれたリセットＲＥＧ５７３を
備えるマスタＩＣ５７０だけが初期化される。この場合、リセットＲＥＧ５７３は、初期
化指示情報記憶領域となる。
Specifically, each
See). When the
ハードリセットでは、入出力Ｉ／Ｆ５５８及び電源投入検出回路５５９に接続されるＮ
ＯＲゲート回路５９０に各マスタＩＣ５７０Ａ、５７０ＢのＲＥＳＥＴ端子が接続されて
おり、ＮＯＲゲート回路５９０に印加される電圧が所定時間ローに保持されると、ＲＥＳ
ＥＴ端子に印加される電圧（初期化信号）も所定時間ローに保持され、全てのマスタＩＣ
５７０Ａ、５７０Ｂが初期化される。この場合、ＲＥＳＥＴ端子は、初期化信号入力端子
となる。
In hard reset, N connected to input / output I /
When the RESET terminal of each of the
The voltage (initialization signal) applied to the ET terminal is also held low for a predetermined time, and all master ICs are
570A and 570B are initialized. In this case, the RESET terminal is an initialization signal input terminal.
ＮＯＲゲート回路５９０は、すべてのマスタＩＣ５７０のＲＥＳＥＴ端子に接続されて
おり、ＮＯＲゲート回路５９０に印加される電圧が所定時間ローに保持されると、すべて
のマスタＩＣ５７０のＲＥＳＥＴ端子に印加される電圧も所定時間ローになり、すべての
マスタＩＣ５７０に初期化信号として取り込まれる。
The NOR
なお、ＮＯＲゲート回路５９０とマスタＩＣ５７０のＲＥＳＥＴ端子とを接続する線は
、バス５６３とは別個の線（バスを介さない信号線）である。
The line connecting the NOR
本実施形態では、電源投入時には、ハードリセットによって、全てのマスタＩＣ５７０
Ａ、５７０Ｂを初期化し、合せて対応する装飾制御装置６１０を初期化する。そして、何
れかの異常判定テーブルにて、全てのＩ2ＣＩ／Ｏエクスパンダ６１５に関してデータ送
受信異常が発生したと判定された場合には、当該異常判定テーブルに属するマスタＩＣの
みをソフトリセットにより初期化し、合わせて対応する装飾制御装置６１０を初期化する
が、他のマスタＩＣや装飾制御装置６１０はリセットしない。
In the present embodiment, when the power is turned on, all the
A, 570 B are initialized, and the corresponding
このように、演出制御装置５５０に複数のマスタＩＣ５７０が備わる場合に、異常が発
生したマスタＩＣのみに対してリセットを行うので、遊技機１全体の装飾が一時停止する
ことなく、遊技者に違和感を与えることを抑制できる。また、すべてのマスタＩＣ５７０
を同時に高速にリセットしたい場合には、ハードリセットによりリセットが行えるので、
様々な態様のリセット処理を実施することができる。
As described above, when the
If you want to reset at the same time fast, you can reset by hard reset.
Various aspects of the reset process can be implemented.
第２実施形態では、第１実施形態と同じ処理を実行するが、第１実施形態と異なる処理
のみ、図３３及び図３４で詳細を説明する。
In the second embodiment, the same processing as that of the first embodiment is performed, but only processing different from that of the first embodiment will be described in detail with reference to FIGS. 33 and 34.
図３３は、本発明の第２実施形態のＩ2Ｃ初期リセット処理のフローチャートである。
図３３では、図２３に示すＩ2Ｃ初期リセット処理と同じ処理は同じ符号を付与し、説明
を省略する。
FIG. 33 is a flowchart of an I 2 C initial reset process of the second embodiment of the present invention.
In FIG. 33, the same processes as the I 2 C initial reset process shown in FIG. 23 carry the same reference numerals, and the description thereof is omitted.
Ｉ2Ｃ初期リセット処理は電源投入時に実行される処理であり、第２実施形態のＩ2Ｃ初
期リセット処理では、各マスタＩＣ５７０に接続される装飾制御装置６１０に初期化指示
データを送信する。
I 2 C initial reset process is a process executed when the power is turned, in I 2 C initial reset process of the second embodiment transmits an initialization instruction data to the
具体的には、ステップ２３０２の処理ですべてのマスタＩＣ５７０がハードリセットさ
れた後、ＣＰＵ５５１は、第１のマスタＩＣ５７０Ａを選択して（３３０１）、ステップ
３３０１の処理で選択されたマスタＩＣ５７０Ａに接続される中継基板６００Ａ、装飾制
御装置６１０Ａ〜６１０Ｆに初期化指示データを送信するスレーブリセット処理を実行し
（２３０３）、第１のマスタＩＣ５７０Ａに接続される中継基板６００Ａ、装飾制御装置
６１０Ａ〜６１０Ｆを初期化する。
Specifically, after all the
そして、ＣＰＵ５５１は、第２のマスタＩＣ５７０Ｂを選択して（３３０２）、ステッ
プ３３０２の処理で選択されたマスタＩＣ５７０Ｂに接続される装飾制御装置６１０Ｇ〜
６１０Ｌに初期化指示データを送信するスレーブリセット処理を実行し（２３０３）、マ
スタＩＣ５７０Ｂに接続される装飾制御装置６００Ｂ、装飾制御装置６１０Ｇ〜６１０Ｏ
を初期化する。
Then, the
A slave reset process for transmitting initialization instruction data to 610L is executed (2303), and the
Initialize
図３４は、本発明の第２実施形態のＩ2Ｃ随時リセット処理のフローチャートである。
図３４では、図２７に示すＩ2Ｃ随時リセット処理と同じ処理は同じ符号を付与し、説明
を省略する。
FIG. 34 is a flowchart of I 2 C occasional reset processing according to the second embodiment of this invention.
In FIG. 34, the same processing as the I 2 C occasional reset processing shown in FIG. 27 is denoted by the same reference numeral, and the description will be omitted.
ステップ２７０１の処理でリセット要求フラグが設定されていると判定された場合、又
は、ステップ２７０３の処理でリセット条件が成立していると判定された場合、ＣＰＵ５
５１は、リセット条件が成立したマスタＩＣ５７０を選択し（３４０１）、ステップ３４
０１の処理でマスタＩＣ５７０に備わるリセットＲＥＧ５７３に所定の値を書き込み、当
該マスタＩＣ５７０をソフトリセットする（３４０２）。
If it is determined that the reset request flag is set in the process of
51 selects the
In the processing of 01, a predetermined value is written in the
そして、ＣＰＵ５５１は、ステップ３４０１の処理で選択されたマスタＩＣ５７０に接
続されるすべての装飾制御装置６１０に初期化指示データを送信するスレーブリセット処
理を実行する（２７０６）。
Then, the
次に、ＣＰＵ５５１は、リセット条件が成立したマスタＩＣ５７０が可動制御装置に接
続されたマスタＩＣ５７０であるか否かを判定する（３４０３）。
Next, the
ステップ３４０３の処理で、リセット条件が成立したマスタＩＣ５７０が可動制御装置
に接続されたマスタＩＣ５７０であると判定された場合、可動制御装置が制御する役物駆
動ＭＯＴ５６１及び役物駆動ＳＯＬ５６０を初期位置に戻す初期化処理を実行するので、
ステップ２７０７の処理に進む。
When it is determined in the process of
The process proceeds to step 2707.
一方、ステップ３４０３の処理で、リセット条件が成立したマスタＩＣ５７０が可動制
御装置に接続されたマスタＩＣ５７０でないと判定された場合、ステップ２７１０の処理
に進む。
On the other hand, if it is determined in
このように、本実施形態では、異常が検出されたマスタＩＣ５７０のみをソフトリセッ
トするので、異常が検出されていないマスタＩＣ５７０を初期化しなくてもよいので、遊
技中に出力が一時停止する装飾装置の数を最小限に抑えることができ、遊技者に与える違
和感を減少させることができる。
As described above, in the present embodiment, since only the
また、ハードリセット又はソフトリセットによってマスタＩＣ５７０が初期化されると
、初期化されるマスタＩＣ５７０に接続されるすべての装飾制御装置６１０も初期化され
るので、確実に異常を解消できる。
In addition, when the
なお、本明細書に開示されている実施の形態は、パチンコ機のみならずパチスロ機等の
他の遊技機でも適用可能であることは当然意図されるものである。
The embodiment disclosed in this specification is naturally intended to be applicable not only to pachinko machines but also to other gaming machines such as pachislot machines.
また、実施の形態として、変動表示ゲームの結果に対応して特別遊技状態を発生するパ
チンコ機が開示されているが、変動表示ゲームに限らず、他の補助遊技の結果に対応して
特別遊技状態を発生する遊技機であっても構わないことは当然意図されるものである。
Although a pachinko machine that generates a special gaming state corresponding to the result of the variable display game is disclosed as an embodiment, the present invention is not limited to the variable display game, but a special game corresponding to the results of other auxiliary games. It is naturally intended that the gaming machine may generate a state.
例えば、所定条件の成立によって特定の入賞装置の入口が開口し（特定入賞装置の可動
部材が作動して入口が開口し）、入賞装置内部へ取り込まれた遊技球が、入賞装置内部に
設けられた何れの入賞領域（特定入賞領域と一般入賞領域とがある）に入賞するかを抽選
する遊技を補助遊技としてもよい。この場合、入賞装置内部へ取り込まれた遊技球が特定
入賞領域に入賞することで、特別遊技状態が発生することになる。
For example, the entrance of a specific winning device is opened (the movable member of the specific winning device is activated and the inlet is opened) when the predetermined condition is met, and the gaming ball taken into the winning device is provided inside the winning device. A game in which lottery is performed in which prize area (having a specific prize area and a general prize area) may be used as the auxiliary game. In this case, the special gaming state is generated by the game ball taken into the inside of the winning device winning in the specific winning area.
また、実施の形態として、特図変動表示ゲームの結果に対応して特別遊技状態を発生す
るパチンコ機が開示されているが、普図変動表示ゲームの結果に対応して（或いは、普図
変動表示ゲームの結果に起因して）、特別遊技状態を発生する様なパチンコ機であっても
、本発明が適用可能であることは当然意図されるものである。例えば、普図変動表示ゲー
ムの結果により特定の入賞装置の入口が開口し、入賞装置内部へ取り込まれた遊技球が特
定入賞領域へ入賞した場合に特別遊技状態を発生するパチンコ機であっても、本発明は適
用可能である。
In addition, as an embodiment, a pachinko machine that generates a special gaming state corresponding to the result of the special figure fluctuation display game is disclosed, but in response to the result of the common drawing fluctuation display game (or Naturally, it is intended that the present invention is applicable even to a pachinko machine that generates a special game state) (due to the result of the display game). For example, even if it is a pachinko machine that generates a special gaming state when the entrance of a specific winning device is opened according to the result of the common view variation display game and the gaming ball taken into the winning device reaches a specific winning region. The invention is applicable.
また、実施の形態として、遊技制御装置と演出制御装置とが分離されている構成が開示
されているが、遊技制御装置と演出制御装置とが一体となって１つの制御装置を構成して
いても差し支えないものであり、或いは、遊技制御装置自身がグループ統括制御手段とし
て構成されていても差し支えないことは当然意図されることである。
Moreover, although the structure by which the game control apparatus and the presentation control apparatus were isolate | separated is disclosed as embodiment, the game control apparatus and the presentation control apparatus are unitedly, and one control apparatus is comprised, and Naturally, it is naturally intended that the game control device itself may be configured as a group general control means.
なお、今回開示した実施の形態は、全ての点で例示であって制限的なものではない。ま
た、本発明の範囲は前述した発明の説明ではなくて特許請求の範囲によって示され、特許
請求の範囲と均等の意味及び内容の範囲での全ての変更が含まれることが意図される。
The embodiment disclosed this time is illustrative in all points and not restrictive. Further, the scope of the present invention is indicated not by the description of the invention described above but by the scope of claims, and is intended to include all modifications within the scope of meaning and contents equivalent to the scope of claims.
また、特許請求の範囲に記載した以外の本発明の観点の代表的なものとして、次のもの
があげられる。
Moreover, the following are mentioned as a typical thing of the viewpoint of this invention except having described in the claim.
（１）遊技領域に設けた所定の始動入賞領域を遊技球が通過すると、複数の識別情報を
変動表示する変動表示ゲームが実行され、該変動表示ゲームの結果に対応して遊技者に特
典を付与する特別遊技状態を発生可能な遊技機において、前記遊技領域における遊技を統
括的に制御する遊技制御手段と、遊技の演出を行う複数の演出装置と、前記遊技制御手段
からの指令に対応して、前記複数の演出装置を制御する演出制御手段と、を備え、前記複
数の演出装置を複数グループに分割し、該分割されたグループに属する演出装置を制御す
るためのグループ単位制御手段を各グループ毎に設け、前記演出制御手段を、前記グルー
プ単位制御手段の各々を統括的に制御するグループ統括制御手段として構成するとともに
、前記グループ統括制御手段から前記グループ単位制御手段へタイミング信号を伝達する
タイミング信号線と、前記グループ統括制御手段と前記グループ単位制御手段との間でデ
ータ信号を授受するデータ線と、を備えることによって、前記グループ統括制御手段と前
記グループ単位制御手段との間で相互にデータ通信を可能とし、前記グループ統括制御手
段に前記タイミング信号線及び前記データ線を介して接続可能な前記各グループ単位制御
手段には個別のアドレスが設定され、前記グループ統括制御手段は、前記各グループ単位
制御手段から送信先となるグループ単位制御手段を選択し、前記選択されたグループ単位
制御手段に設定されたアドレスを指定するアドレス指定手段と、前記データ線の信号レベ
ルを送信データに対応する信号レベルに設定しながら、前記タイミング信号線の信号レベ
ルを繰り返し変化させることによって、前記アドレス指定手段によって指定された送信先
のグループ単位制御手段のアドレスを含むデータを順次送信する送信手段と、前記送信手
段による所定のビット数のデータ送信が終了する毎に、前記グループ単位制御手段からの
返答信号を取り込む返答信号取込手段と、前記返答信号取込手段によって取り込まれた返
答信号によってデータ送信の成否を判定する判定手段と、を備え、前記グループ単位制御
手段は、前記送信手段によって送信されたデータに含まれるアドレスが自宛のアドレスを
示す場合に、該送信手段によってデータが送信された前記データ線を介して、前記返答信
号を前記グループ統括制御手段へ出力する返答信号出力手段を備え、前記アドレス指定手
段が前記グループ統括制御手段に接続可能なすべてのグループ単位制御手段を前記送信先
として選択することによって、前記送信手段を介して、前記グループ統括制御手段に接続
可能なすべてのグループ単位制御手段に設定されたアドレスに対して前記データが送信さ
れる一方で、前記グループ統括制御手段には、前記グループ統括制御手段に接続可能なす
べてのグループ単位制御手段のうち、一部のグループ単位制御手段だけが接続されること
を特徴とする遊技機。
(1) When the game ball passes through a predetermined start-up winning area provided in the game area, a variable display game in which a plurality of identification information is variably displayed is executed, and the player is given a privilege corresponding to the result of the variable display game. In a gaming machine capable of generating a special gaming state to be granted, corresponding to a command from the game control means for controlling the game in the game area in an integrated manner, a plurality of effect devices for effecting a game, and the game control means Group control means for dividing the plurality of effect devices into a plurality of groups, and controlling the effect devices belonging to the divided groups. While providing the group effect control means provided for each group, the effect control means integrally controlling each of the group unit control means, The group general control means includes a timing signal line for transmitting a timing signal to the group unit control means, and a data line for exchanging data signals between the group general control means and the group unit control means. It is possible to mutually communicate data between the group unit control means and each group unit control means connectable to the group general control means via the timing signal line and the data line. Address setting means for selecting the group unit control means to be the transmission destination from each of the group unit control means, and specifying the address set in the selected group unit control means; While setting the signal level of the data line to the signal level corresponding to transmission data, Transmitting means for sequentially transmitting data including the address of the group unit control means of the transmission destination designated by the addressing means by repeatedly changing the signal level of the imme signal line, and a predetermined number of bits of the transmission means A response signal taking-in means for taking in a response signal from the group unit control means every time data transmission is completed, and a judging means for judging success or failure of data transmission according to the response signal taken in by the response signal taking-in means, And the group unit control means, when the address included in the data transmitted by the transmission means indicates an address addressed to the self, transmits the response via the data line to which the data is transmitted by the transmission means. A response signal output unit for outputting a signal to the group general control unit, the address specification unit By selecting all group unit control means connectable to the group general control means as the destination, all group unit control means connectable to the group general control means via the transmission means are set. While the data is transmitted to the stored address, the group general control means includes only some of the group unit control means among all the group unit control means connectable to the group general control means. A gaming machine characterized by being connected.
（２）設けられる前記演出装置の組み合わせによって、予め定めされた複数種類の仕様
の中から当該遊技機の仕様が選択的に特定されるとともに、該複数種類の仕様として第１
仕様遊技機と第２仕様遊技機とが含まれており、前記グループ統括制御手段に接続可能な
すべてのグループ単位制御手段には、前記第１仕様遊技機にのみ設けられて前記第２仕様
遊技機には設けられない演出装置を制御する第１グループ単位制御手段と、前記第２仕様
遊技機にのみ設けられて前記第１仕様遊技機には設けられない演出装置を制御する第２グ
ループ単位制御手段と、が含まれ、前記アドレス指定手段は、当該遊技機の仕様に拘らず
、前記第１グループ単位制御手段に設定されたアドレスと、前記第２グループ単位制御手
段に設定されたアドレスとを、ともに指定し、前記送信手段は、前記アドレス指定手段が
指定したアドレスが設定されているすべてのグループ単位制御手段に対して前記データを
送信することを特徴とする（１）に記載の遊技機。
(2) According to the combination of the rendering devices provided, the specification of the gaming machine is selectively specified from among a plurality of types of specifications determined in advance, and
A specification game machine and a second specification game machine are included, and all the group unit control means connectable to the group general control means are provided only for the first specification game machine and the second specification game machine is provided. First group unit control means for controlling a rendering device not provided on the game machine, and a second group unit for controlling a rendering device provided only on the second specification gaming machine and not provided on the first specification gaming machine A control unit is included, and the address specification unit sets the address set in the first group unit control unit and the address set in the second group unit control unit regardless of the specification of the game machine. Are specified together, and the transmission means is characterized in that the data is transmitted to all the group unit control means in which the address specified by the addressing means is set. The gaming machine according to).
（３）遊技球を発射して遊技が行われる遊技領域が形成された遊技盤と、前記遊技盤が
着脱可能に取り付けられる前面枠と、を備え、前記前面枠には遊技の演出を行う前記演出
装置が備えられるとともに、該前面枠は、該演出装置の種類が互いに異なる第１遊技枠若
しくは第２遊技枠として、複数の仕様の何れかが設定され、前記遊技盤は前記第１遊技枠
及び第２遊技枠の何れにも取り付けられ、前記遊技盤に設けられる演出装置は、前記第１
グループ単位制御手段及び前記第２グループ単位制御手段とは異なる第３グループ単位制
御手段によって制御され、前記グループ統括制御手段には、前記第１グループ単位制御手
段及び前記第２グループ単位制御手段のいずれか一方が接続される第１グループ統括制御
手段と、前記第３グループ単位制御手段が接続される第２グループ統括制御手段と、を備
えることを特徴とする（２）に記載の遊技機。
(3) A game board provided with a game area in which a game area is to be played by firing a game ball, and a front frame to which the game board is detachably mounted, the front frame performing a game effect A rendering device is provided, and the front frame is set to one of a plurality of specifications as a first gaming slot or a second gaming slot different in type of the rendering device, and the gaming board is the first gaming slot. And the second game slot, the effect device provided on the game board is the
The group unit control unit and the second group unit control unit are controlled by a third group unit control unit different from the second group unit control unit, and the group general control unit is any of the first group unit control unit and the second group unit control unit. The gaming machine according to (2), further comprising: first group general control means to which one side is connected; and second group general control means to which the third group unit control means is connected.
（４）前記演出制御手段は、前記判定手段の判定結果に基づいて、前記グループ統括制
御手段に接続可能なすべてのグループ単位制御手段に対して、前記グループ統括制御手段
との接続状態を判定する接続判定手段を備え、前記送信手段は、前記接続判定手段によっ
て前記グループ統括制御手段に接続されていると判定された前記グループ単位制御手段と
、前記接続判定手段によって前記グループ統括制御手段に接続されていないと判定された
前記グループ単位制御手段とで、前記データ送信の態様を変更することを特徴とする（１
）〜（３）のいずれか一つに記載の遊技機。
(4) The effect control means determines the connection state with the group general control means with respect to all group unit control means connectable to the group general control means based on the judgment result of the judgment means. Connection determination means, the transmission means being connected to the group unit control means determined by the connection determination means to be connected to the group general control means, and connected by the connection determination means Changing the mode of the data transmission with the group unit control means determined not to be
) The gaming machine according to any one of (3) to (3).
（５）前記判定手段によって、前記グループ単位制御手段への前記データ送信が所定回
数連続して失敗したと判定された場合には、前記接続判定手段は、当該グループ単位制御
手段が前記グループ統括制御手段に接続されていないと判定することを特徴とする（４）
に記載の遊技機。
(5) When it is determined by the determination means that the data transmission to the group unit control means has failed a predetermined number of times in a row, the connection determination means determines that the group unit control means controls the group general control It is characterized by determining that it is not connected to the means (4)
The gaming machine described in.
（６）前記送信手段は、前記接続判定手段によって前記グループ統括制御手段に接続さ
れていると判定された前記グループ単位制御手段への前記データ送信の頻度を、前記接続
判定手段によって前記グループ統括制御手段に接続されていないと判定された前記グルー
プ単位制御手段への前記データ送信の頻度よりも高くすることを特徴とする（４）又は（
５）に記載の遊技機。
(6) The transmission means controls the frequency of the data transmission to the group unit control means judged to be connected to the group general control means by the connection judgment means by the connection judgment means. Making the frequency higher than the frequency of the data transmission to the group unit control means determined not to be connected to the means (4) or (4)
The gaming machine described in 5).
（７）前記送信手段には、前記判定手段によって前記グループ単位制御手段への前記デ
ータ送信が失敗したと判定された場合に、当該データを再送する再送手段が備えられ、
前記接続判定手段によって前記グループ統括制御手段に接続されていると判定された前記
グループ単位制御手段に対して前記再送手段がデータを再送する回数を、前記接続判定手
段によって前記グループ統括制御手段に接続されていないと判定された前記グループ単位
制御手段に対して前記再送手段がデータを再送する回数よりも、多く設定したことを特徴
とする（４）〜（６）のいずれか一つに記載の遊技機。
(7) The transmitting means is provided with a resending means for resending the data when it is determined by the determining means that the data transmission to the group unit control means has failed.
The connection judging means connects the number of times the retransmission means retransmits data to the group general control means with respect to the group unit control means judged to be connected to the group general control means by the connection judgment means The number of times the retransmission unit retransmits the data is set to the group unit control unit determined not to be more frequently than the number of times of retransmission of data as described in any one of (4) to (6). Gaming machine.
（１）の発明によると、グループ統括手段からグループ単位制御手段へ１本のデータ線
を介してデータ送信ができるので、基板間の配線を少なくすることができる。また、グル
ープ単位制御手段からグループ統括手段へも同じデータ線を用いて返答信号が送信される
ので、データ送信が行われたかを確認できる構成となって、誤作動を防止することができ
る。また、グループ統括制御手段からグループ単位制御手段へデータを送信した直後に、
グループ単位制御手段からグループ統括手段へ返答信号を返す構成なので、高速なデータ
通信が可能となる。さらに、グループ統括制御手段に接続可能なグループ単位制御手段に
は固有のアドレスが付与され、当該すべてのグループ単位制御手段に対してデータが送信
されるので、グループ統括制御手段に個別のアドレスが付与されたグループ単位制御手段
のいずれが接続されても、当該接続されたグループ単位制御手段は正確に動作し、グルー
プ統括制御手段の動作プログラムを共通化できる。
According to the invention of (1), since data transmission can be performed from the group generalization means to the group unit control means via one data line, the wiring between the substrates can be reduced. In addition, since the response signal is transmitted from the group unit control means to the group general control means using the same data line, it is possible to confirm whether the data transmission has been performed, thereby preventing a malfunction. Also, immediately after transmitting data from the group general control means to the group unit control means,
Since the group unit control means returns a response signal to the group control means, high-speed data communication is possible. Furthermore, since a unique address is given to the group unit control means connectable to the group general control means, and data is transmitted to all the group unit control means, an individual address is given to the group general control means Regardless of which of the group unit control means is connected, the connected group unit control means operates correctly, and the operation program of the group general control means can be made common.
（２）の発明によると、遊技機の仕様が、第１仕様遊技機と第２仕様遊技機の何れであ
っても、グループ統括制御手段の動作プログラムを変更せずに、遊技機に設けた演出装置
を制御して装飾を行うことができる。
According to the invention of (2), even if the specification of the gaming machine is either the first specification gaming machine or the second specification gaming machine, the gaming machine is provided without changing the operation program of the group general control means. The decoration can be performed by controlling the rendering device.
（３）の発明によると、遊技盤を、第１遊技枠と第２遊技枠のいずれに取り付けた場合
であっても、グループ統括制御手段の動作プログラムを変更せずに、遊技機に設けた演出
装置を制御して装飾を行うことができる。さらに、グループ統括制御手段に接続可能なグ
ループ単位制御手段の数が制限されていても、遊技盤に設けた演出装置を制御するグルー
プ単位制御手段が接続されるグループ統括制御手段と、第１遊技枠に設けた演出装置を制
御するグループ単位制御手段又は第２遊技枠に設けた演出装置を制御するグループ単位制
御手段が接続されるグループ統括制御手段と、の各々が備わるようにしたので、遊技機全
体で制御可能なグループ単位制御手段の数を増加させることができる。
According to the invention of (3), even when the gaming board is attached to either the first gaming slot or the second gaming slot, the gaming machine is provided in the gaming machine without changing the operation program of the group general control means. The decoration can be performed by controlling the rendering device. Furthermore, even if the number of group unit control means that can be connected to the group general control means is limited, the group general control means to which the group unit control means for controlling the rendering device provided on the game board is connected; Each of the group unit control means for controlling the effect device provided in the frame and the group general control means connected to the group unit control means for controlling the effect device provided in the second game frame is provided. It is possible to increase the number of group unit control means that can be controlled throughout the machine.
（４）の発明によると、グループ統括制御手段に接続されているグループ単位制御手段
と、グループ統括制御手段に接続されていないグループ単位制御手段とで、データ送信の
態様を変更するので、適切なデータ送信を行うことができる。
According to the invention of (4), the mode of data transmission is changed by the group unit control means connected to the group general control means and the group unit control means not connected to the group general control means. Data can be transmitted.
（５）の発明によると、判定手段によって所定回数連続してデータ送信が失敗したと判
定されたグループ単位制御手段をグループ統括制御手段に接続されていないと判定するの
で、グループ統括制御手段に接続されているか否かの誤判定を防止できる。
According to the invention of (5), since it is determined that the group unit control means determined to have failed data transmission continuously a predetermined number of times by the determination means is not connected to the group general control means, it is connected to the group general control means It is possible to prevent an erroneous determination as to whether or not it has been done.
（６）の発明によると、グループ統括制御手段に接続されていないグループ単位制御手
段へのデータ再送信の頻度を、グループ統括制御手段に接続されているグループ単位制御
手段へのデータ再送信の頻度よりも低くするので、グループ統括制御手段とグループ単位
制御手段との間のデータ送信量を全体的に減少させることができる。また、グループ統括
制御手段に接続されていないグループ単位制御手段に対するデータ送信を行わないわけで
はないので、グループ単位制御手段に一時的な故障などが発生した場合であってもいち早
く一時的な故障が発生したグループ単位制御手段を復帰できる。
According to the invention of (6), the frequency of data retransmission to the group unit control means not connected to the group general control means is set to the frequency of data retransmission to the group unit control means connected to the group general control means. Since it is lower than the above, the amount of data transmission between the group general control means and the group unit control means can be reduced overall. Also, since data transmission to the group unit control means not connected to the group general control means is not necessarily performed, even if a temporary failure or the like occurs in the group unit control means, a temporary failure occurs quickly. The generated group unit control means can be restored.
（７）の発明によると、グループ統括制御手段に接続されていないグループ単位制御手
段へのデータの再送回数を、グループ統括制御手段に接続されているグループ単位制御手
段へのデータの再送回数よりも少なくするので、グループ統括制御手段とグループ単位制
御手段との間のデータ送信量を全体的に減少させることができる。
According to the invention of (7), the number of retransmissions of data to the group unit control means not connected to the group general control means is greater than the number of retransmissions of data to the group unit control means connected to the group general control means. Since the number is reduced, the amount of data transmission between the group general control means and the group unit control means can be reduced overall.
以上のように、本発明は、演出制御装置が装飾制御装置を制御する遊技機に適用可能で
ある。
As described above, the present invention is applicable to a game machine in which the effect control device controls the decoration control device.
１ 遊技機
２ 本体枠（外枠）
３ 前面枠
４ ヒンジ
１０ 遊技盤
１１ 照明ユニット
１７ 演出ボタン
１８ ガラス枠
３４ 普図始動ゲート
３６ 普通変動入賞装置
４２ 特別変動入賞装置
４４ 一般入賞口
４５ 第１始動入賞口
５１ センターケース
５２ 窓部
５３ 表示装置
５５ 振動センサ
６０ 可動役物
５００ 遊技制御装置
５５０ 演出制御装置
５６０ 役物駆動ＳＯＬ
５６１ 役物駆動ＭＯＴ
５７０ マスタＩＣ
５７３ リセットＲＥＧ
５７４ 送信モードＲＥＧ
５８０ 払出制御装置
６００ 中継基板（装飾制御装置）
６１０ 装飾制御装置
６２０ 装飾装置
２１００ 異常判定テーブル
1
3
561 Feature Drive MOT
570 Master IC
573 reset REG
574 Send mode REG
580
610
Claims (1)
前記複数の演出装置を複数グループに分割し、該分割されたグループに属する演出装置を制御するためのグループ単位制御手段をグループ毎に設けるとともに、
前記グループ単位制御手段の各々を統括的に制御するグループ統括制御手段を設け、
前記グループ単位制御手段と前記グループ統括制御手段との間を、前記グループ統括制御手段から前記グループ単位制御手段にタイミング信号を伝達するタイミング信号線と、データ信号を伝達するデータ線と、前記グループ単位制御手段に電源電圧を供給する電源線と、を含むハーネスによりコネクタを介して接続し、
前記グループ統括制御手段が前記グループ単位制御手段に伝達するデータには、前記グループ単位制御手段に設けられた記憶領域のうちの所定のアドレスを示すアドレス情報と、複数の制御データと、前記記憶領域の範囲内においてアドレスを更新する際の上限アドレスと戻りアドレスを特定可能なアドレス更新情報と、が含まれ、
前記グループ統括制御手段は、当該グループ統括制御手段に電源供給が開始されると、当該グループ統括制御手段自身を電源供給による電圧上昇に基づいて初期化可能であり、
前記グループ単位制御手段は、
前記ハーネスの再接続により当該グループ単位制御手段に電源供給が開始されると、当該グループ単位制御手段自身を電源供給による電圧上昇に基づいて初期化可能であり、
前記アドレス情報が示すアドレスを記憶先の開始アドレスとして、伝達された制御データを記憶し、制御データを記憶する毎に記憶先のアドレスを順次更新し、
前記上限アドレスが示す記憶領域に制御データを記憶した場合は、前記戻りアドレスに戻るように記憶先のアドレスを更新することを特徴とする遊技機。 In a gaming machine provided with a plurality of effect devices for effecting a game,
The plurality of effect devices are divided into a plurality of groups, and group unit control means for controlling the effect devices belonging to the divided groups is provided for each group.
A group general control means is provided which comprehensively controls each of the group unit control means,
A timing signal line for transmitting a timing signal from the group general control means to the group unit control means between the group unit control means and the group general control means, a data line for transmitting data signals, and the group unit Connected through a connector by a harness including a power supply line for supplying a power supply voltage to the control means;
The data transmitted to the group unit control means by the group general control means includes address information indicating a predetermined address in the storage area provided in the group unit control means, a plurality of control data, and the storage area Address update information that can specify the upper limit address and the return address when updating the address within the range of
When power supply to the group general control means is started, the group general control means can initialize the group general control means itself based on a voltage rise due to the power supply,
The group unit control means
When the power supply to the group-unit control unit is started by the re-connection of the harness, Ri initializability der based the group-unit control unit itself to the voltage rise due to the power supply,
The transmitted control data is stored with the address indicated by the address information as the start address of the storage destination, and the storage destination address is sequentially updated each time the control data is stored,
When control data is stored in a storage area indicated by the upper limit address, a storage destination address is updated so as to return to the return address .
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