JP5856580B2 - 信号処理装置、及び信号処理方法 - Google Patents
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Description
図1は、本発明に係る第1の実施形態におけるサンプリングレート変換装置10の構成例を示すブロック図である。信号処理装置としてのサンプリングレート変換装置10は、例えば、デジタルコヒーレント技術を適用した光通信システムにおけるデジタル信号処理に用いられる。サンプリングレート変換装置10は、専用の半導体回路として実装してもよいし、プログラマブルロジックデバイスにおいて構成してもよし、DSP等の汎用演算装置においてソフトウエアを実行させることにより実現してもよい。サンプリングレート変換装置10は、x(sample/s)のサンプリングレートの入力データを、y(sample/s)のサンプリングレートのデータに変換して出力する。
なお、サンプリングレート変換装置10は、サンプリングレート変換部12から出力されるアップサンプリングされた出力データを一定間隔で間引くことにより、出力データをダウンサンプリングするダウンサンプリング部を具備するようにしてもよい。
図8は、第2の実施形態におけるサンプリングレート変換装置20の構成例を示すブロック図である。サンプリングレート変換装置20は、第1の実施形態におけるサンプリングレート変換装置10と同様に、x(sample/s)のサンプリングレートの入力データを、y(sample/s)のサンプリングレートのデータに変換して出力する。サンプリングレート変換装置20は、係数設定部21、及び、サンプリングレート変換部12を具備している。以下、サンプリングレート変換装置20において、第1の実施形態におけるサンプリングレート変換装置10が具備する機能部と同じ機能部に対しては同じ符号を付してその説明を省略する。
図10は、第3の実施形態におけるサンプリングレート変換装置30の構成を示すブロック図である。サンプリングレート変換装置30は、第1の実施形態におけるサンプリングレート変換装置10と同様に、x(sample/s)のサンプリングレートの入力データを、y(sample/s)のサンプリングレートのデータに変換して出力する。サンプリングレート変換装置30は、係数設定部31、及び、サンプリングレート変換部12を具備している。以下、サンプリングレート変換装置30において、第1の実施形態におけるサンプリングレート変換装置10が具備する機能部と同じ機能部に対しては同じ符号を付してその説明を省略する。
図12は、第4の実施形態におけるサンプリングレート変換装置40の構成を示すブロック図である。サンプリングレート変換装置40は、第1の実施形態におけるサンプリングレート変換装置10と同様に、x(sample/s)のサンプリングレートの入力データを、y(sample/s)のサンプリングレートのデータに変換して出力する。サンプリングレート変換装置40は、係数設定部41、及び、サンプリングレート変換部12を具備している。以下、サンプリングレート変換装置40において、第1、第2、及び第3の実施形態における各サンプリングレート変換装置が具備する機能部と同じ機能部に対しては同じ符号を付してその説明を省略する。
の機能を実現するためのプログラムをコンピュータ又はプログラマブルロジックデバイスが読み取り可能な記録媒体に記録して、この記録媒体に記録されたプログラムをコンピュータシステム又はプログラマブルロジックデバイスに読み込ませ、実行することによりサンプリングレート変換処理を行ってもよい。なお、ここでいう「コンピュータシステム」とは、OSや周辺機器等のハードウェアを含むものとする。また、「コンピュータシステム」は、ホームページ提供環境(あるいは表示環境)を備えたWWWシステムも含むものとする。また、「コンピュータ読み取り可能な記録媒体」とは、フレキシブルディスク、光磁気ディスク、ROM、CD−ROM等の可搬媒体、コンピュータシステムに内蔵されるハードディスク等の記憶装置のことをいう。更に「コンピュータ読み取り可能な記録媒体」とは、インターネット等のネットワークや電話回線等の通信回線を介してプログラムが送信された場合のサーバやクライアントとなるコンピュータシステム内部の揮発性メモリ(RAM)のように、一定時間プログラムを保持しているものも含むものとする。
11、11A、21、31、41…係数設定部
12…サンプリングレート変換部
111、211、311、411…外部インタフェース部
112…係数テーブル部
113…係数選択部
114…係数算出部
212…乗算部
312…加算部
a0、a1、a2、a3、a4…加算部
c0、c1、c2、c3、c4、c5、c6、c7、c8、c9、c10、c11、c2、c13、c14、c15、c16、c17、c18、c19…乗算部
d0、d1、d2…遅延部
Claims (7)
- 所定のサンプリングレートの入力データに対して低域通過フィルタ処理を施して異なるサンプリングレートのデータに変換するサンプリングレート変換部と、
前記入力データに対してスキュー補償を行う際に与えられるスキュー補償量に基づいて、前記サンプリングレート変換部における低域通過フィルタ処理に用いるフィルタ係数を定める係数設定部と、
を具備し、
前記サンプリングレート変換部は、入力データを一つ入力するごとに、サンプリングレートを変更する倍率に応じた数のデータを同時に出力し、
前記倍率は、入力データのサンプリングレートに対する出力するデータのサンプリングレートの比である、
ことを特徴とする信号処理装置。 - 請求項1に記載の信号処理装置において、
前記係数設定部は、
前記低域通過フィルタ処理に用いるフィルタ特性に基づいて予め定められたフィルタ係数が異なるスキュー補償量ごとに記憶されている係数テーブル部と、
前記入力データに対して定められるスキュー補償量に対応するフィルタ係数を前記係数テーブル部から読み出し、読み出したフィルタ係数を前記サンプリングレート変換部に出力する係数選択部とを備える
ことを特徴とする信号処理装置。 - 請求項1に記載の信号処理装置において、
前記係数設定部は、
前記低域通過フィルタ処理に用いるフィルタ特性を示す関数に、前記入力データに対して定められるスキュー補償量を与えて算出した値をフィルタ係数として前記サンプリングレート変換部に出力する係数算出部を備える
ことを特徴とする信号処理装置。 - 請求項2又は請求項3のいずれかに記載の信号処理装置において、
前記係数設定部は、
前記入力データに対して振幅補償をする際に与えられる振幅補償量をフィルタ係数に乗じて前記サンプリングレート変換部に出力する乗算部を更に備える
ことを特徴とする信号処理装置。 - 請求項2又は請求項3のいずれかに記載の信号処理装置において、
前記係数設定部は、
前記入力データに対してDCオフセット補償をする際に与えられるオフセット補償量をフィルタ係数に加算して前記サンプリングレート変換部に出力する加算部を更に備える
ことを特徴とする信号処理装置。 - 請求項2又は請求項3のいずれかに記載の信号処理装置において、
前記係数設定部は、
前記入力データに対してDCオフセット補償をする際に与えられるオフセット補償量をフィルタ係数に加算して出力する加算部と、
前記入力データに対して振幅補償をする際に与えられる振幅補償量を前記加算部が出力するフィルタ係数に乗じて前記サンプリングレート変換部に出力する乗算部とを更に備える
ことを特徴とする信号処理装置。 - 所定のサンプリングレートの入力データに対して処理を施す信号処理装置における信号処理方法であって、
前記入力データに対してスキュー補償を行う際に与えられるスキュー補償量に基づいて、低域通過フィルタ処理におけるフィルタ係数を定める係数設定ステップと、
前記係数設定ステップにおいて定められたフィルタ係数を用いて、前記入力データに対して低域通過フィルタ処理を施して異なるサンプリングレートのデータに変換するサンプリングレート変換ステップと、
を有し、
前記サンプリングレート変換ステップでは、入力データを一つ入力するごとに、サンプリングレートを変更する倍率に応じた数のデータを同時に出力し、
前記倍率は、入力データのサンプリングレートに対する出力するデータのサンプリングレートの比である、
ことを特徴とする信号処理方法。
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JP2013052354A JP5856580B2 (ja) | 2013-03-14 | 2013-03-14 | 信号処理装置、及び信号処理方法 |
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