JP5721970B2 - リアルタイムストリーミングを行う装置及びバス制御方法 - Google Patents
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Description
半導体記憶素子群のアレイにリアルタイムストリーミングを行う装置であって、該半導体記憶素子群の各々は、n個の並列的なアドレス指定可能な半導体記憶素子を有し、該半導体記憶素子各々は1つ以上の半導体メモリユニットを有し、該半導体メモリユニットはページ受信機間t_rの間に或るデータ量pをバッファリングするページバッファを有し、該半導体メモリユニット各々は、前記データ量pを前記ページバッファから前記半導体記憶素子へページ書き込み時間wrt_tmの間に書き込み、リアルタイムストリーミングを行う当該装置は、
各自のデータレートとともに受信される高々k個のデータストリームから並列的にデータを受信する受信手段と、
受信したデータをバッファリングする入力バッファを有し、
前記入力バッファから、前記半導体記憶素子群へデータを転送するn個の並列バスを有するバスシステムと、
前記バスシステムを制御するコントローラと
を有し、前記コントローラにより、第1のデータストリームから受信したデータは、前記半導体記憶素子群のアレイ内の第1部分をなす半導体記憶素子群のみに転送され、少なくとも第2のデータストリームから受信したデータは、前記半導体記憶素子群のアレイ内の別の第2部分をなす半導体記憶素子群のみに転送され、
前記コントローラは、前記ページ受信期間t_r、前記ページ書き込み期間wrt_tm、前記データ量p及び各自のデータレートを利用して、前記バスシステムがデータをどの半導体記憶素子群へ転送するかを動的に制御する、装置である。
Claims (2)
- 半導体記憶素子群のアレイにデータをリアルタイムストリーミングするための装置であって、半導体記憶素子群の各々は、N個の並列的なアドレス指定可能な半導体記憶素子を有し、半導体記憶素子の各々はページ受信期間t_rの間に或るデータ量pをバッファリングするように形成されたページバッファを有し、前記データ量pを前記ページバッファから前記半導体記憶素子へページ書き込み時間wrt_tmの間に書き込むように形成され、リアルタイムストリーミングするための当該装置は、
複数のデータストリームから並列的に各自のデータレートでデータを受信する受信手段であって、受信したデータストリームをバッファリングする入力キャッシュを含む受信手段と、
前記入力キャッシュから、前記半導体記憶素子群へデータを転送するように形成されたN個の並列的なバスを有するバスシステムであって、前記バスの各々は複数の半導体記憶素子に接続され、該複数の半導体記憶素子はそれぞれ何れかの前記半導体記憶素子群に属しており、前記N個の並列的なバスの各々が、半導体記憶素子群のうちの何れかの半導体記憶素子に接続されている、バスシステムと、
第1のデータストリームから受信したデータは、前記半導体記憶素子群のアレイ内の第1のメモリ部分をなす1つ以上の半導体記憶素子群のみに転送され、第2のデータストリームから受信したデータは、前記半導体記憶素子群のアレイ内の別の第2のメモリ部分をなす1つ以上の半導体記憶素子群のみに転送されるように、前記バスシステムを制御するコントローラであって、前記ページ受信期間t_r、前記ページ書き込み期間wrt_tm、前記データ量p及び各自のデータレートを利用して、前記バスシステムがデータをどの半導体記憶素子群へ転送するかを動的に制御するように形成されるコントローラとを有し、
前記バスシステムは、
前記半導体記憶素子群に連続的にアクセスするように構築されており、前記コントローラは、現在アクセスしている半導体記憶素子群について、現在アクセスしている半導体記憶素子群へ最後にデータを転送して以来、ページ書き込み時間が経過しているか否かを判別し、経過していた場合、現在アクセスしている半導体記憶素子群が前記第1又は第2のメモリ部分に属するか否かを判別し、
判別された前記メモリ部分に対応する前記データストリームから受信され前記入力キャッシュに蓄積されたデータ量が、少なくとも1ページ分に達するか否かを判定し、
達していた場合、前記コントローラは、前記入力キャッシュに蓄積された1ページ分のデータを、対応するデータストリームから現在アクセスしている半導体記憶素子群へ、前記バスシステムが転送することを引き起こし、
達していなかった場合、前記コントローラは、シーケンスにおける次の半導体記憶素子群に前記バスシステムがアクセスすることを引き起こす、装置。 - リアルタイムストリーミング装置のバスシステムを制御するバス制御方法であって、前記バスシステムは、半導体記憶素子群のアレイへ2つ以上のデータストリームをストリーミングするために、入力キャッシュから半導体記憶素子群のアレイへデータを転送し、前記半導体記憶素子群は前記バスシステムにより連続的にアクセスされ、
半導体記憶素子群の各々は、N個の並列的なアドレス指定可能な半導体記憶素子を有し、半導体記憶素子の各々はページ受信期間t_rの間に或るデータ量pをバッファリングするように形成されたページバッファを有し、前記データ量pを前記ページバッファから前記半導体記憶素子へページ書き込み時間wrt_tmの間に書き込むように形成され、
前記バスの各々は複数の半導体記憶素子に接続され、該複数の半導体記憶素子はそれぞれ何れかの前記半導体記憶素子群に属しており、前記N個の並列的なバスの各々が、半導体記憶素子群のうちの何れかの半導体記憶素子に接続されており、当該バス制御方法は、
現在アクセスしている半導体記憶素子群について、アクセスしている半導体記憶素子群へ最後にデータを転送して以来、ページ書き込み時間が経過しているか否かを判別するステップと、
経過していた場合、現在アクセスしている半導体記憶素子群が、前記半導体記憶素子群のアレイにおける第1又は第2の部分に属するか否かを判別するステップであって、該第1の部分は第1のデータストリームを保存するように指定され、該第2の部分は少なくとも第2のデータストリームを保存するように指定されている、ステップと、
判別された部分に指定されているデータストリームから受信され前記入力キャッシュに蓄積されたデータ量が、少なくとも1ページ分に達するか否かを判定するステップと、
達していた場合にのみ、前記判別された部分に指定されているデータストリームのうち前記入力キャッシュに蓄積された少なくとも1ページ分のデータを、現在アクセスしている半導体記憶素子群へ、前記バスシステムが転送することを引き起こすステップと、
次の半導体記憶素子群に前記バスシステムがアクセスすることを引き起こすステップと
を有するバス制御方法。
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