JP5712386B2 - 画像表示処理方法及び画像表示処理装置 - Google Patents
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Description
図1は、本発明の画像表示処理装置の一実施形態を含む画像処理装置の構成ブロック図である。図1に示した画像処理装置は、概して、画像表示プロセッサ1、画像データROM(Read Only Memory)2、表示部3、プログラムROM4、及びCPU(Central Processing Unit)を備えている。なお、この画像処理装置は、典型的には、表示部3の表示画面において、大きな画像、特に動画、による多彩な演出が行われるパチンコ機、ゲーム機等の遊技機に搭載される。
図3は、CPU5の特定の処理手順を示すフローチャートである。CPU5は、基本的には、プログラムROM4に格納された指令に基づいて各種制御を行うものであるが、特定の指令、すなわち新規にあるセグメントの拡大表示指令があった場合、又はスクロールにより隣接するセグメントを表示する必要が生じた場合(ステップS1において肯定判定)、画像表示プロセッサ1に対して、セグメントを指定して拡大表示の指令を行う(ステップS2)。
11 画像デコーダ
12 VRAM
13 描画回路
131 補間回路
1311 三角形分割補間部
2 画像データROM
3 表示部
4 プログラムROM
5 CPU
p 画素
ip 補間すべき画素
Claims (5)
- デコーダと、補間回路を有する描画回路とを備えた画像表示処理装置による、画像を拡大して表示するための画素の補間処理を伴う画像表示処理方法であって、
前記デコーダが、圧縮符号化された画像データの中から、一のセグメントに係る圧縮画像データと、加えて、当該一のセグメントセグメントが他のセグメントに接する全境界に渡って、他のセグメントに入り込んだ所定幅分の圧縮画像データとを伸長処理し、
前記補間回路が、前記画素の補間処理を三角形分割手法に基づき行うに際し、前記伸長処理により得られた伸長画像データに基づいて、補間により求めるべき画素に係る格子の分割パターンを決定し、
前記補間回路が、前記伸長画像データ及び前記分割パターンに基づいて、前記補間により求めるべき画素の値を算出し、
前記描画回路が、前記伸長画像データから前記所定幅分の伸長画像データを除いて得られた画像データと、前記補間により求められた各画素の画像データとで画像表示を行い、
前記伸長処理において、前記所定幅は、前記三角形分割手法に要求される精度に応じて決定されることを特徴とする画像表示処理方法。 - 前記伸長処理の後、前記伸長処理により得られた伸長画像データを画像メモリに格納することを特徴とする請求項1に記載の画像表示処理方法。
- 前記圧縮符号化された画像データは、遊技機に表示される画像に係るデータであることを特徴とする請求項1又は2に記載の画像表示処理方法。
- 圧縮符号化された画像データの中から、一のセグメントに係る圧縮画像データと、加えて、当該一のセグメントセグメントが他のセグメントに接する全境界に渡って、他のセグメントに入り込んだ所定幅分の圧縮画像データとを伸長処理するデコーダと、
前記伸長処理により得られた伸長画像データを格納する画像メモリと、
画像の拡大に伴う画素の補間処理を行うに際し、前記画像メモリに格納された伸長画像データに基づいて、補間により求めるべき画素に係る格子について、三角形分割手法における分割パターンを決定し、前記伸長画像データ及び前記分割パターンに基づいて、前記補間により求めるべき画素の値を算出する補間回路と、
前記伸長画像データから前記所定幅分の伸長画像データを除いて得られた画像データと、前記補間により求められた各画素の画像データとで画像表示を行う描画回路と、
を備え、
前記デコーダは、前記三角形分割手法に要求される精度に応じ、前記所定幅を決定して前記伸長処理を行うことを特徴とする画像表示処理装置。 - 前記圧縮符号化された画像データが、予め格納される画像データ読出し専用メモリと、
前記デコーダに前記伸長処理の指令を与える制御部と、
を更に備え、
前記制御部が与える指令には、前記画像データ読出し専用メモリから読み出すべきセグメントに係る情報が含まれ、前記デコーダは、そのセグメントに係る情報に基づき、前記画像データ読出し専用メモリからの読出しを行うことを特徴とする請求項4に記載の画像表示処理装置。
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