JP5593373B2 - 液晶表示装置 - Google Patents
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Description
置されることにより、その間にセルギャップが定義される。液晶層は、第1の基板と第2の基板との間におけるセルギャップに配置され、且つこの液晶層は、複数の液晶セルが定
義されている。画素アレイは、複数の画素を有する。これらの画素は、第1の基板に形成されている。各画素は、対応する液晶セルに接続され、且つ第1の画素電極と、第2の画
素電極とを含む。第1の画素電極は、複数の第1の画素電極ストリップを有する。第2の画素電極は、複数の第2の画素電極ストリップを有する。これらの第1の画素電極ストリップと第2の画素電極ストリップとは、交互に並ぶように配置されることにより、その間に複数の電極間隔が定義され、各電極間隔は、隣り合った第1の画素電極ストリップと第2の画素電極ストリップとによって定義されており、且つ所定の幅を有する。基準線が2つの隣り合った第1の画素電極ストリップと第2の画素電極ストリップとの間に位置され、隣り合った第1の画素電極ストリップと第2の画素電極ストリップとは、基準線に対して対称となり、各電極間隔の所定の幅は、隣り合った第1の画素電極ストリップと第2の画素電極ストリップとの間おける基準線の延設方向に沿って変化する。一実施形態では、各画素は、対向電極を含んでもよい。この対向電極は、第2の基板上に形成されるとともに、第2の画素電極と電気的に接続される。もう1つの実施形態では、対向電極は、第1の画素電極と電気的に接続されてもよい。別の実施形態では、交流電圧又は直流電圧を対向電極に印加してもよい。
の間にセルギャップが定義される。液晶層は、第1の基板と第2の基板との間におけるセルギャップに配置され、且つこの液晶層は、複数の液晶セルが定義されている。画素アレ
イは、複数の画素を有する。これらの画素は、第1の基板に形成されている。各画素は、対応する液晶セルに接続され、且つ第1の画素電極と、第2の画素電極とを含む。第1の画素電極は、複数の第1の画素電極ストリップを有する。第2の画素電極は、複数の第2
の画素電極ストリップを有する。第1の画素電極ストリップと第2の画素電極ストリップとは、交互に並ぶように配置されることにより、その間に複数の電極間隔が定義されている。各電極間隔は、隣り合った第1の画素電極ストリップと第2の画素電極ストリップとによって定義されており、且つ所定の幅を有し、各電極間隔のうち少なくとも1つの幅は、その他の電極間隔の幅と異なっている。一実施形態では、各画素は、対向電極を含んでもよい。この対向電極は、第2の基板上に形成されている。一実施形態では、対向電極は、第2の画素電極と電気的に接続されている。もう1つの実施形態では、対向電極は、第1の画素電極と電気的に接続されてもよい。別の実施形態では、交流電圧又は直流電圧を対向電極に印加してもよい。
110 第1の基板
120 第2の基板
130 液晶層
132 液晶
140 絶縁層
150 保護層
162,163,164 第2の画素電極ストリップ
172,173 第1の画素電極ストリップ
260 第2の画素電極
261,262,263,264,265,261,262a,263a,264a,265a 第2の画素電極ストリップ
266 頂部
266a 底部
270 第1の画素電極
271,272,273,274,271a,272a,273a,274a 第1の画素電極ストリップ
275 リッジ部
301 第1の方向
302 第2の方向
360 第2の画素電極
361,362,363,364,365 第2の画素電極ストリップ
370 第1の画素電極
371,372,373,374 第1の画素電極ストリップ
401 第1の方向
402 第2の方向
460 第2の画素電極
461,462,463,464 第2の画素電極ストリップ
470 第1の画素電極
471,472,473 第1の画素電極ストリップ
560 第2の画素電極
561,562,563,564,565 第2の画素電極ストリップ
570 第1の画素電極
571,572,573,574 第1の画素電極ストリップ
660 第2の画素電極
661,662,663,664,665,666,667,668 第2の画素電極ストリップ
670 第1の画素電極
671,672,673,675,676,677 第1の画素電極ストリップ
760 第2の画素電極
761,762,763,764,765,766,767,768 第2の画素電極ストリップ
770 第1の画素電極
771,772,773,775,776,777 第1の画素電極ストリップ
860 第2の画素電極
861,862,863,864,865,866,867,868,861a、862a、863a、864a、865a、866a、867a、868a 第2の画素電極ストリップ
869b 側部
869a 底部
869 頂部
870 第1の画素電極
871,872,873,874,875,876,877,878,871a,872a,873a,874a,875a,876a,877a,878a 第1の画素電極ストリップ
879 リッジ部
879b 側部
970 第1の画素電極
971,972,973 第1の画素電極ストリップ
960 第2の画素電極
961,962 第2の画素電極ストリップ
1000 液晶表示装置
1010 第1の基板
1020 第2の基板
1030 液晶層
1032 液晶
1040 絶縁層
1050 保護層
1062,1063,1064 第2の画素電極ストリップ
1072,1073 第1の画素電極ストリップ
1080 対向電極
1110 垂直画素構造
1120 ゲート線
1130 信号線
1140 薄膜トランジスタ
1161 第2の画素電極ストリップ
1171 第1の画素電極ストリップ
1210 垂直画素構造
1220 ゲート線
1230 信号線
1240 薄膜トランジスタ
1261 第2の画素電極ストリップ
1271 第1の画素電極ストリップ
A,B,C,D セグメント
d 距離
P,P1,P2,P3,P4,P5,P6,P7,P8 電極間隔
R 基準線
S 傾斜部
a1 第1の角度
a2 第2の角度
θ,θ1,θ2 鋭角
Claims (3)
- 液晶表示装置であって、
互いに対向して配置されて間にセルギャップを定義する第1の基板及び第2の基板と、
前記セルギャップ内に配置され、複数の液晶セルが定義されている液晶層と、
前記第1の基板に形成され且つ各々が対応する前記液晶セルと接続している複数の画素を有する画素アレイと、
を含み、
各画素は、複数の第1の画素電極ストリップを有する第1の画素電極と、複数の第2の画素電極ストリップを有する第2の画素電極とを含み、
前記複数の第1の画素電極ストリップと前記複数の第2の画素電極ストリップとが交互に並ぶように配置されて間に複数の電極間隔を定義し、
各電極間隔は、隣り合った前記第1の画素電極ストリップと前記第2の画素電極ストリップとによって定義されて所定の幅を有しており、
隣り合った前記第1の画素電極ストリップと前記第2の画素電極ストリップとの間に基準線が位置され、隣り合った前記第1の画素電極ストリップと前記第2の画素電極ストリップとは前記基準線に対して対称となり、
前記第1の画素電極ストリップ及び前記第2の画素電極ストリップは、鋸歯状のストリップであり、
前記所定の幅は、隣り合った前記第1の画素電極ストリップと前記第2の画素電極ストリップとの間における前記基準線の延伸方向に沿って変化することを特徴とする液晶表示装置。 - 前記各画素が対向電極を更に含み、前記対向電極は、前記第2の基板上に形成され、前記第1の画素電極と、前記第2の画素電極と、交流電圧又は直流電圧と電気的に接続されることを特徴とする請求項1に記載の液晶表示装置。
- 複数のゲート線と、複数の信号線とを更に含み、前記複数のゲート線と前記複数の信号線は、前記複数の画素に対応して電気的に接続されることを特徴とする請求項1に記載の液晶表示装置。
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2012
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