JP5590215B2 - 終端回路、半導体装置および試験システム - Google Patents
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Description
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- 伝送信号を出力または入力する信号端子にソースが接続され、ドレインが接地線に接続され、ゲートで制御信号を受け、特性インピーダンスの整合機能を有効にするときにオンされ、前記整合機能を無効にするときにオフされるpMOSトランジスタと、
特性インピーダンスを整合するために、前記信号端子に接続されるインダクタおよびキャパシタと
を備え、前記pMOSトランジスタのバックゲートは、前記伝送信号の最大電圧から前記pMOSトランジスタのpn接合がオンする順方向電圧を差し引いた電圧より高い電圧を受けることを特徴とする終端回路。 - 伝送信号を出力または入力する信号端子にソースが接続され、ドレインが接地線に接続され、ゲートで制御信号を受け、特性インピーダンスの整合機能を有効にするときにオンされ前記整合機能を無効にするときにオフされるpMOSトランジスタと、特性インピーダンスを整合するために前記信号端子に接続されるインダクタおよびキャパシタとを有する終端回路と、
前記終端回路の前記信号端子に接続され、前記信号端子から出力される前記伝送信号を発生する発生回路と、
前記制御信号を受ける制御端子と、
前記信号端子に接続され、前記伝送信号の電力をモニターし、モニターした電力の値を示す信号値を出力するパワー検出回路と、
を備えていることを特徴とする半導体装置。 - 第1電圧を有する第1電圧線と前記制御端子との間に配置される抵抗素子を備え、
前記pMOSトランジスタは、前記制御端子がオープン状態のときに、前記ゲートで前記第1電圧を受けてオフすること
を特徴とする請求項2に記載の半導体装置。 - 試験信号を受ける試験端子を備え、
前記パワー検出回路は、前記試験端子で活性化状態の前記試験信号を受けているときに前記伝送信号の電力をモニターし、前記試験端子で非活性化状態の前記試験信号を受けているときに電力のモニターを禁止すること
を特徴とする請求項2または請求項3に記載の半導体装置。 - 伝送信号を出力または入力する信号端子にソースが接続され、ドレインが接地線に接続され、ゲートで制御信号を受け、特性インピーダンスの整合機能を有効にするときにオンされ前記整合機能を無効にするときにオフされるpMOSトランジスタと、特性インピーダンスを整合するために前記信号端子に接続されるインダクタおよびキャパシタとを有する終端回路と、
前記終端回路の前記信号端子に接続され、前記信号端子に入力される前記伝送信号を処理する処理回路と、
前記制御信号を受ける制御端子と、
試験信号を受ける試験端子と、
前記試験端子で活性化状態の前記試験信号を受けているときに試験用の伝送信号を生成し、前記試験端子で非活性化状態の前記試験信号を受けているときに前記試験用の伝送信号の生成を禁止する試験信号発生回路と
を備えていることを特徴とする半導体装置。 - 請求項2ないし請求項4のいずれか1項に記載の半導体装置と、
特性インピーダンスの整合機能を有効にするために前記制御信号を前記半導体装置に供給し、前記パワー検出回路から出力される電力値を示す信号を受け、前記発生回路の動作の良否を判定する試験装置と
を備えていることを特徴とする試験システム。 - 請求項5に記載の半導体装置と、
特性インピーダンスの整合機能を有効にするために前記制御信号を前記半導体装置に供給し、前記処理回路を試験する前記試験用の伝送信号を生成するために前記試験信号を前記半導体装置に供給する試験装置と
を備えていることを特徴とする試験システム。
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