JP5473388B2 - 半導体装置および半導体装置の製造方法 - Google Patents

半導体装置および半導体装置の製造方法 Download PDF

Info

Publication number
JP5473388B2
JP5473388B2 JP2009106906A JP2009106906A JP5473388B2 JP 5473388 B2 JP5473388 B2 JP 5473388B2 JP 2009106906 A JP2009106906 A JP 2009106906A JP 2009106906 A JP2009106906 A JP 2009106906A JP 5473388 B2 JP5473388 B2 JP 5473388B2
Authority
JP
Japan
Prior art keywords
semiconductor chip
semiconductor device
bonding material
plating layer
solid plate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2009106906A
Other languages
English (en)
Other versions
JP2010258231A (ja
Inventor
基治 ▲芳▼我
尚司 安永
泰正 糟谷
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Rohm Co Ltd
Original Assignee
Rohm Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Rohm Co Ltd filed Critical Rohm Co Ltd
Priority to JP2009106906A priority Critical patent/JP5473388B2/ja
Priority to CN201010170101.5A priority patent/CN101872748B/zh
Priority to US12/662,572 priority patent/US8350371B2/en
Publication of JP2010258231A publication Critical patent/JP2010258231A/ja
Application granted granted Critical
Publication of JP5473388B2 publication Critical patent/JP5473388B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495—Lead-frames or other flat leads
    • H01L23/49503—Lead-frames or other flat leads characterised by the die pad
    • H01L23/49513—Lead-frames or other flat leads characterised by the die pad having bonding material between chip and die pad
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495—Lead-frames or other flat leads
    • H01L23/49579—Lead-frames or other flat leads characterised by the materials of the lead frames or layers thereon
    • H01L23/49582—Metallic layers on lead frames
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29075—Plural core members
    • H01L2224/2908—Plural core members being stacked
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29075—Plural core members
    • H01L2224/2908—Plural core members being stacked
    • H01L2224/29083—Three-layer arrangements
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/29111—Tin [Sn] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/29113—Bismuth [Bi] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/2919—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/45099—Material
    • H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805—Shape
    • H01L2224/4809—Loop shape
    • H01L2224/48091—Arched
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481—Disposition
    • H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73251—Location after the connecting process on different surfaces
    • H01L2224/73265—Layer and wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
    • H01L2224/83399—Material
    • H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/83439—Silver [Ag] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838—Bonding techniques
    • H01L2224/83801—Soldering or alloying
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92—Specific sequence of method steps
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92—Specific sequence of method steps
    • H01L2224/922—Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
    • H01L2224/9222—Sequential connecting processes
    • H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
    • H01L2224/92247—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73—Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001—Technical content checked by a classifier
    • H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01005—Boron [B]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01006—Carbon [C]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01019—Potassium [K]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01027—Cobalt [Co]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01029—Copper [Cu]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/0103—Zinc [Zn]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01033—Arsenic [As]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01047—Silver [Ag]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/0105—Tin [Sn]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01074—Tungsten [W]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01078—Platinum [Pt]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01079—Gold [Au]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01—Chemical elements
    • H01L2924/01082—Lead [Pb]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013—Alloys
    • H01L2924/0132—Binary Alloys
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013—Alloys
    • H01L2924/014—Solder alloys
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/06—Polymers
    • H01L2924/0665—Epoxy resin
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/10251—Elemental semiconductors, i.e. Group IV
    • H01L2924/10253—Silicon [Si]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151—Die mounting substrate
    • H01L2924/156—Material
    • H01L2924/157—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2924/15738—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950 C and less than 1550 C
    • H01L2924/15747—Copper [Cu] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181—Encapsulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Die Bonding (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Description

本発明は、半導体装置およびその製造方法に関する。
従来、環境負荷の観点から、半導体装置における鉛の使用量の低減が要求されている。たとえば、２００６年７月施行のＲｏＨＳ（Restriction of Hazardous Substances）指令などによって提唱されている。
半導体装置では、たとえば、ＳＯＰ（Small Outline Package）、ＱＦＰ（Quad Flat Package）におけるアウターリードの外装めっき、ＢＧＡ（Ball Grid Array）における半田ボールなど、装置外部で使用される外部構成材、およびパッケージ内部における半導体チップの接合材など、装置内部で使用される内部構成材に鉛が使用されている。
外部構成材については、鉛の含有量を一定比率以下とする鉛フリー化が、代替材料の研究によってほぼ達成されている。これに対し、内部構成材については、代替に適した材料がない。そのため、たとえば、９５Ｐｂ−５Ｓｎ（鉛含有量９５ｗｔ％）など、鉛含有率の高い金属が使用されている。
特開２００７−６７１５８号公報
様々な組成の金属材料を、内部構成材の代替材料として評価する過程において、環境負荷の小さいビスマスが、代替材料の選択肢として着目される。ビスマスは、たとえば、装置内部で使用される接合材に要求される融点や接合性、さらには環境負荷の諸特性を満たす。
しかし、ビスマスの熱伝導率（約９Ｗ／ｍ・Ｋ）は、鉛の熱伝導率（約３５Ｗ／ｍ・Ｋ）に比べて低い。そのため、ビスマスを単に使用したのでは、半導体チップで生じる熱が放散されにくいといった不具合を生じる。
本発明の目的は、半導体チップの放熱性を十分に確保できながら、半導体チップの接合材の鉛フリー化を達成することができる半導体装置およびその製造方法を提供することにある。
上記目的を達成するための請求項１記載の発明は、半導体チップおよびその半導体チップが接合される固体板を備える半導体装置の製造方法であって、前記半導体チップおよび前記固体板の少なくとも一方における他方との接合面に、Ａｇからなるめっき層を形成する工程と、前記めっき層形成後、前記半導体チップと前記固体板との間に、Ｓｎの含有量が０ｗｔ％を超過し、４ｗｔ％以下であるＢｉＳｎからなる接合材を挟む工程と、熱処理により、前記半導体チップと前記固体板とを前記接合材を介して接合することによって、前記半導体チップにおける前記固体板との対向面に対して垂直方向に延びる熱伝導経路を前記接合材内に形成する工程とを含み、前記めっき層を形成する工程が、前記半導体チップにおける前記接合面および前記固体板における前記接合面の両方に前記めっき層を形成する工程である、半導体装置の製造方法である。
この方法によれば、半導体チップにおける接合面および／または固体板における接合面にＡｇからなるめっき層が形成された後、半導体チップと固体板との間に、Ｓｎの含有量が０ｗｔ％を超過し、４ｗｔ％以下であるＢｉＳｎからなる接合材が挟まれ、その後、熱処理される。上記の工程が実行されることによって、めっき層から他方の接合面に達するＡｇネットワーク（網状組織）を接合材に形成することができる。このＡｇネットワークによって、半導体チップと固体板との間の熱伝導性を向上させることができる。
これにより、半導体チップと、前記半導体チップが接合される固体板と、前記半導体チップと前記固体板との間に介在され、ＢｉＳｎ系材料からなる接合材とを含み、前記接合材は、前記半導体チップと前記固体板との間の熱伝導性を向上させるためのＡｇからなる熱伝導経路を有しており、前記熱伝導経路は、前記半導体チップにおける前記固体板との対向面に対して垂直方向に延びている、半導体装置を製造することができる。
そして、この製造方法によって得られる半導体装置によれば、接合材がＢｉＳｎ系材料からなるので、接合材の鉛フリー化を達成することができる。
さらに、半導体チップと固体板との間がＡｇネットワークによって接続されるため、これらの間を熱が伝達しやすくなる。そのため、半導体チップで発生する熱を、Ａｇネットワークを介してＡｇの熱伝導率で固体板に逃がすことができる。したがって、半導体チップの放熱性を十分に確保することができる。
また、この方法では、半導体チップにおける接合面および固体板における接合面の両方にめっき層が形成される。そのため、いずれか一方の接合面にのみめっき層が形成される場合よりも、Ａｇネットワークの密度を大きくすることができる。その結果、半導体チップの放熱性を向上させることができる。
また、本発明の製造方法によって得られる半導体装置では、前記接合材における前記半導体チップおよび／または前記固体板との界面近傍には、Ｓｎ−Ａｇ合金からなる金属層が形成されていることが好ましい。
この構成では、接合材における半導体チップおよび／または固体板との界面近傍に、Ｓｎ−Ａｇ合金からなる金属層が形成されている。金属に対するＳｎ−Ａｇ合金の濡れ性は、ＢｉＳｎ系材料の濡れ性よりも優れている。そのため、この金属層によって、接合材と、半導体チップおよび／または固体板との接合強度を向上させることができる。
また、本発明の製造方法によって得られる半導体装置では、前記接合材におけるＳｎの含有量が、０ｗｔ％を超過し、４ｗｔ％以下であることが好ましい。
ＳｎはＡｇと合金化し易い金属であるが、上記のように、接合材におけるＳｎの含有量が上記範囲であれば、熱伝導経路の形成に寄与するＡｇの不要な合金化を抑制することができる。その結果、熱伝導経路を効率よく形成することができる。
また、Ｂｉ（融点：約２７０℃）がＳｎ（融点：約２３２℃）よりも多量に含有されるため、接合材に比較的高い融点を保持させることができる。そのため、半導体装置を実装するときのリフロー時において、優れた耐リフロー性を発揮することができる。
また、本発明の製造方法によって得られる半導体装置では、前記固体板が金属からなるリードフレームのアイランドであることが好ましい。
この構成では、固体板が金属からなるアイランドなので、Ａｇめっきを容易に施すことができ、そのＡｇめっきから熱伝導経路を形成することができる。
また、本発明の製造方法によって得られる半導体装置では、前記熱伝導経路は、少なくとも前記半導体チップと前記固体板との間の距離の３０％を超える長さで形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記熱伝導経路は、前記半導体チップから前記固体板に達するように形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記半導体チップと前記固体板との間は、前記熱伝導経路によって、Ａｇの熱伝導率で熱伝導可能に接続されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記固体板は、Ｃｕからなることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記半導体チップは、３００〜４００μｍ厚の四角板状に形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記接合材は、ＢｉＳｎを主として含有することが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記半導体チップにおける前記接合材との接合面には、Ａｕ、Ｎｉ、Ａｇを含有する裏面メタルが形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記裏面メタル上に、Ａｇからなるチップめっき層が形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記チップめっき層の厚さは、０．１〜２．０μｍであることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記固体板が、前記半導体チップをダイボンディングするダイパッドであり、前記ダイパッド上には、１．０〜１０．０μｍの厚さを有するパッドめっき層が形成されていることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記接合材は、ＳｎよりもＢｉを多く含有していることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記接合材は、Ａｇ、Ｓｎ、Ｃｏ、Ｃｕ、Ａｕ、Ｎｉ、Ｚｎの少なくとも一種からなる副成分を含有していることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記接合材の融点が、２６０〜２７０℃であることが好ましい。
また、本発明の製造方法によって得られる半導体装置では、前記接合材の融点が、２６０〜２６３℃であることが好ましい。
本発明の一実施形態に係る半導体装置の模式断面図である。 図１に示す半導体装置の製造方法を工程順に示す図である。 本発明の変形例に係る半導体装置（ＱＦＮタイプ）の模式断面図である。 実施例１の半導体装置のＳＥＭ写真である。 実施例２の半導体装置のＳＥＭ写真である。 実施例３の半導体装置のＳＥＭ写真である。 実施例４の半導体装置のＳＥＭ写真である。 比較例１の半導体装置のＳＥＭ写真である 比較例２の半導体装置のＳＥＭ写真である。 比較例３の半導体装置のＳＥＭ写真である。
以下では、本発明の実施の形態を、添付図面を参照して詳細に説明する。
図１は、本発明の一実施形態に係る半導体装置の模式断面図である。
半導体装置１は、ＱＦＰが適用された半導体装置１である。半導体装置１は、半導体チップ２と、半導体チップ２に接合される固体板としてのダイパッド３と、半導体チップ２と電気的に接続される複数のリード４と、これらを封止する樹脂パッケージ５とを備えている。
半導体チップ２は、その内部に複数の機能素子を搭載している。半導体チップ２は、たとえば、３００〜４００μｍ厚の四角板状に形成され、機能素子と電気的に接続された配線パッド（図示せず）が厚さ方向一方面２１に露出している。一方、半導体チップ２の他方面２２には、たとえば、Ａｕ、Ｎｉ、Ａｇなどを含有する裏面メタル（図示せず）が形成されている。
その裏面メタル上には、Ａｇからなるチップめっき層６が形成されている。チップめっき層６の厚さは、たとえば、０．１〜２．０μｍである。
ダイパッド３は、たとえば、０．１〜５．０ｍｍ厚のＣｕ薄板からなり、四角状に形成されている。ダイパッド３の厚さ方向一方面３１には、Ａｇからなるパッドめっき層７が形成されている。パッドめっき層７の厚さは、たとえば、１．０〜１０．０μｍである。
そして、半導体チップ２およびダイパッド３は、他方面２２および一方面３１が接合面として互いに対向した状態で、他方面２２と一方面３１との間に接合材８が介在することによって、互いに接合されている。すなわち、半導体チップ２は、一方面２１を上方に向けた姿勢でダイパッド３に支持される。
接合材８は、ＢｉＳｎ系材料からなる。ＢｉＳｎ系材料は、ＢｉＳｎを主として含有する材料である。ＢｉＳｎ系材料は、主成分ＢｉＳｎの他に、たとえば、半導体チップ２ダイパッド３間の熱の伝達、接合材８の機械的物性の向上、接合材８の融点調節および接合材８の濡れ性の向上などといった目的で、Ａｇ、Ｓｎ、Ｃｏ、Ｃｕ、Ａｕ、Ｎｉ、Ｚｎなどの副成分を含有することができる。これら副成分は、単独で含有されていてもよいし、複数の金属が合金化した状態で含有されていてもよい。
上記のように、接合材８にはＳｎが必ず含有され、ＢｉＳｎ成分におけるＳｎの含有量は、たとえば、０ｗｔ％を超過し、４ｗｔ％以下、好ましくは、１〜３ｗｔ％、さらに好ましくは、１．５〜２．５ｗｔ％である。
上記した副成分として、接合材８は、チップめっき層６およびパッドめっき層７の両方に接触する熱伝導経路としてのＡｇネットワーク９を有している。Ａｇネットワーク９は、多数のＡｇ細線が蜘蛛の巣状に広がってなり、接合材８のほぼ全域に達している。このＡｇネットワーク９によって、半導体チップ２とダイパッド３との間は理想的には、Ａｇの熱伝導率（約４２５Ｗ／ｍ・Ｋ）で熱伝導可能に接続されている。
また、接合材８は、副成分として、チップめっき層６およびパッドめっき層７との界面近傍にＳｎ−Ａｇ合金からなる合金層１０を有している。合金層１０は、チップめっき層６およびパッドめっき層７の両方との界面近傍全域にわたって形成されていてもよいし、部分的に形成されていてもよい。
そして、上記のような接合材８の融点は、たとえば、２６０〜２７０℃、好ましくは、２６０〜２６３℃である。
リード４は、ダイパッド３と同じＣｕ薄板（たとえば、０．１〜５．０ｍｍ厚）からなり、ダイパッド３の各側面と直交する各方向における両側に、それぞれ同数ずつ設けられている。ダイパッド３の各側面に対向するリード４は、その対向する側面と平行な方向に等間隔に配置されている。各リード４は、樹脂パッケージ５によって封止されたインナーリード４１と、樹脂パッケージ５から露出したアウターリード４２とを一体的に備えている。
インナーリード４１は、ダイパッド３と同一平面上に配置され、ダイパッド３との対向方向に長尺な矩形状に形成されている。インナーリード４１は、金属ワイヤ１１を介して半導体チップ２の配線パッドと電気的に接続されている。
アウターリード４２は、下方へ屈曲する屈曲部を有する略クランク形状に形成されている。アウターリード４２は、半導体装置１をプリント配線基板に実装するときの外部接続部として機能する。
樹脂パッケージ５としては、エポキシ樹脂など公知の材料を適用することができる。
上記のような半導体装置１は、その許容損失が、たとえば、１〜１０Ｗ、好ましくは、４〜１０Ｗである。許容損失は、半導体装置１の放熱性の指標とされる。また、半導体装置１は、プリント配線基板のランドにアウターリード４２がはんだ接合され、たとえば、２４０〜２６０℃でリフローすることによって、実装することができる。
図２は、図１に示す半導体装置１の製造方法を工程順に示す図である。
半導体装置１の製造工程では、図２（ａ）に示すように、半導体チップ２およびリードフレーム１２が用意される。
リードフレーム１２は、Ｃｕ薄板を加工することにより形成される。このリードフレーム１２は、格子状のフレーム部（図示せず）と、フレーム部に取り囲まれる各矩形領域内に配置されるアイランドとしてのダイパッド３と、ダイパッド３の周囲に配置される複数のリード４と、フレーム部とダイパッド３との間に架設された吊りリード（図示せず）とを一体的に備えている。
続いて、めっき法によって、半導体チップ２の他方面２２（裏面メタル）およびダイパッド３の一方面３１の両方にＡｇめっきが施される。これにより、チップめっき層６およびパッドめっき層７が形成される。なお、これらのめっき工程は、同じ工程で行なってもよいし、別工程で行なってもよい。
次いで、図２（ｂ）に示すように、ＢｉＳｎからなる接合材８をパッドめっき層７上に塗布し、その接合材８に対してチップめっき層６を対向させた姿勢で、半導体チップ２およびダイパッド３によって接合材８を挟み込む。
次いで、図２（ｃ）に示すように、たとえば、２８０〜３００℃でリフロー（熱処理）が行なわれる。これによって、接合材８にＡｇネットワーク９および合金層１０が形成されて、半導体チップ２とダイパッド３とが接合される。
次いで、図２（ｄ）に示すように、金属ワイヤ１１の一端が半導体チップ２の配線パッドに接続され、金属ワイヤ１１の他端がリード４のインナーリード４１に接続される。
続いて、リードフレーム１２が成形金型にセットされ、半導体チップ２、ダイパッド３、インナーリード４１、金属ワイヤ１１および吊りリードの一部が、樹脂パッケージ５によって封止される。
その後、リードフレーム１２の不要部分（たとえば、吊りリードにおける樹脂パッケージ５から露出する部分など）が切断される。こうして、図１に示す構造の半導体装置１の個片が得られる。
上記の方法によれば、半導体チップ２の他方面２２およびダイパッド３の一方面３１の両方にＡｇめっき層（チップめっき層６およびパッドめっき層７）が形成された後、半導体チップ２とダイパッド３との間にＢｉＳｎからなる接合材８が挟まれ、その後、リフローされる。上記の工程が実行されることによって、各めっき層６，７から他方のめっき層６，７に達するＡｇネットワーク９を接合材８に形成することができる。このＡｇネットワーク９によって、半導体チップ２とダイパッド３との間の熱伝導性をさらに向上させることができる。
そして、得られる半導体装置１によれば、接合材８がＢｉＳｎ系材料からなるので、接合材８の鉛フリー化を達成することができる。
さらに、半導体チップ２とダイパッド３との間がＡｇネットワーク９によって接続されるため、これらの間を熱が伝達可能となる。そのため、半導体チップ２で発生する熱を、Ａｇネットワーク９を介して、理想的にはＡｇの熱伝導率（約４２５Ｗ／ｍ・Ｋ）でダイパッド３に逃がすことができる。したがって、半導体チップ２の放熱性を十分に確保することができる。
また、半導体チップ２の他方面２２およびダイパッド３の一方面３１の両方にＡｇからなるめっき層（チップめっき層６およびパッドめっき層７）が形成され、各めっき層６，７のＡｇによって蜘蛛の巣状のＡｇネットワーク９が形成される。そのため、いずれか一方の接合面（他方面２２もしくは一方面３１）にのみめっき層が形成される場合よりも、Ａｇネットワーク９の密度を大きくすることができる。その結果、半導体チップ２の放熱性を向上させることができる。
また、チップめっき層６およびパッドめっき層７との界面近傍に、Ｓｎ−Ａｇ合金からなる合金層１０が形成される。チップめっき層６およびパッドめっき層７に対するＳｎ−Ａｇ合金の濡れ性は、ＢｉＳｎの濡れ性よりも優れる。そのため、この合金層１０によって、接合材８と、半導体チップ２およびダイパッド３との接合強度を向上させることができる。
また、ＳｎはＡｇと合金化し易い金属であるが、接合材８におけるＳｎの含有量が０ｗｔ％を超過し、４ｗｔ％以下であれば、Ａｇネットワーク９の形成に寄与するＡｇの不要な合金化を抑制することができる。その結果、各めっき層６，７のＡｇを有効活用できるので、Ａｇネットワーク９を効率よく形成することができる。
また、Ｂｉ（融点：約２７０℃）がＳｎ（融点：約２３２℃）よりも多量に含有されるため、接合材８に比較的高い融点（たとえば、２６０〜２７０℃）を保持させることができる。そのため、半導体装置１を実装するときのリフロー時において、優れた耐リフロー性を発揮することができる。
以上、本発明の実施形態について説明したが、本発明は他の形態で実施することもできる。
たとえば、ＱＦＰが適用された半導体装置１を取り上げたが、本発明は、たとえば、図３に示すようなＱＦＮが適用された半導体装置５１（図３において、５２および５３は、たとえば、錫（Ｓｎ）、錫−銀合金（Ｓｎ−Ａｇ）などの金属からなるめっき層）、その他には、ＢＧＡ、ＳＯＰなどといった他の種類のパッケージが適用された半導体装置に適用することもできる。
その他、特許請求の範囲に記載された事項の範囲で種々の設計変更を施すことが可能である。
次に、本発明を実施例および比較例に基づいて説明するが、この発明は下記の実施例によって限定されるものではない。
実施例１〜４および比較例１〜３
上述した製造方法に基づき、図１に示した構造の半導体装置を作製した。ただし、各実施例および比較例における接合材の組成は、以下の通りに設計した。なお、下記の組成において、Ｓｎの直前に記載される数字は、接合材におけるＳｎの含有量（ｗｔ％）を表わしている。
（接合材の組成）
実施例１：Ｂｉ−１Ｓｎ 実施例２：Ｂｉ−２Ｓｎ 実施例３：Ｂｉ−３Ｓｎ
実施例４：Ｂｉ−４Ｓｎ 比較例１：Ｂｉ−５Ｓｎ 比較例２：Ｂｉ−６Ｓｎ
比較例３：Ｂｉ−１０Ｓｎ
評価試験
（１）ＳＥＭ画像の撮影
実施例１〜４および比較例１〜３で得られた半導体装置の接合材に対して、走査型電子顕微鏡（ＳＥＭ）を用いて電子ビームを照射し、それによって作り出される像を撮影した。撮影された写真を図４〜図１０に示す。
図４〜図１０によると、Ｓｎの含有量が１〜４ｗｔ％（実施例１〜４）の接合材には、半導体チップとダイパッドとを接続するＡｇネットワークが形成されていることが確認できた。それに対し、Ｓｎの含有量が４ｗｔ％を超える（比較例１〜３）接合材には、Ａｇネットワークが形成されず、ＳｎがＢｉ中に分散していることが確認された。
（２）融点の測定
実施例１〜４および比較例１〜３で得られた半導体装置の接合材に対して、示差走査型熱量計（セイコーインスツルメンツ社製 ＤＳＣ６２００）を用いて融点測定した。なお、測定条件は、昇温速度：５℃／分、温度範囲：１１５〜３００℃とした。これにより、各接合材について、以下のことが確認された。
実施例１（Ｂｉ−１Ｓｎ）：接合材の全てが２６３℃で溶融する。
実施例２（Ｂｉ−２Ｓｎ）：接合材の全てが２６４．１℃で溶融する。
実施例３（Ｂｉ−３Ｓｎ）：接合材の全体積中１３．２％が１３９℃で溶融する。
実施例４（Ｂｉ−４Ｓｎ）：接合材の全体積中４８．０％が１３９℃で溶融する。
比較例１（Ｂｉ−５Ｓｎ）：接合材の全体積中８１．７％が１３９℃で溶融する。
比較例２（Ｂｉ−６Ｓｎ）：接合材の全体積中９３．２％が１３９℃で溶融する。
比較例３（Ｂｉ−１０Ｓｎ）：接合材の全てが１３９℃で溶融する。
実施例５および比較例４〜５
ＪＥＤＥＣ標準基板（１１４．３×７６．２×１．６ｍｍ３）上に、表１に示す組成の接合材を用いてトランジスタを搭載した半導体装置を実装した。ただし、ＪＥＤＥＣ標準基板は、７４．２ｍｍ角の銅箔を３層重ねることによって、全体として４層構造とした。また、各銅箔間は、サーマルビアで接続されている。
評価試験
（１）許容損失の測定
実施例５および比較例４〜５の半導体装置について、桑野電機社製ＴＨ−１５６を用いて許容損失を測定した。結果を表１に示す。
表１によると、接合材にＢｉ−２Ｓｎを用いた実施例５の許容損失は、Ｐｂ含有接合材を用いた比較例４に及ばないものの、理想的ではないが、Ａｇペーストを用いた比較例５よりも高いことが確認された。これにより、実施例５が十分な放熱性を確保していることが確認された。
１ 半導体装置
２ 半導体チップ
３ ダイパッド
６ チップめっき層
７ パッドめっき層
８ 接合材
９ Ａｇネットワーク
１０ 合金層
１２ リードフレーム
２２ 他方面
３１ 一方面

Claims (1)

  1. 半導体チップおよびその半導体チップが接合される固体板を備える半導体装置の製造方法であって、
    前記半導体チップおよび前記固体板の少なくとも一方における他方との接合面に、Ａｇからなるめっき層を形成する工程と、
    前記めっき層形成後、前記半導体チップと前記固体板との間に、Ｓｎの含有量が０ｗｔ％を超過し、４ｗｔ％以下であるＢｉＳｎからなる接合材を挟む工程と、
    熱処理により、前記半導体チップと前記固体板とを前記接合材を介して接合することによって、前記半導体チップにおける前記固体板との対向面に対して垂直方向に延びる熱伝導経路を前記接合材内に形成する工程とを含み、
    前記めっき層を形成する工程が、前記半導体チップにおける前記接合面および前記固体板における前記接合面の両方に前記めっき層を形成する工程である、半導体装置の製造方法。
JP2009106906A 2009-04-24 2009-04-24 半導体装置および半導体装置の製造方法 Active JP5473388B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2009106906A JP5473388B2 (ja) 2009-04-24 2009-04-24 半導体装置および半導体装置の製造方法
CN201010170101.5A CN101872748B (zh) 2009-04-24 2010-04-21 半导体装置以及半导体装置的制造方法
US12/662,572 US8350371B2 (en) 2009-04-24 2010-04-23 Semiconductor device and method of manufacturing semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2009106906A JP5473388B2 (ja) 2009-04-24 2009-04-24 半導体装置および半導体装置の製造方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2013229518A Division JP5852080B2 (ja) 2013-11-05 2013-11-05 半導体装置

Publications (2)

Publication Number Publication Date
JP2010258231A JP2010258231A (ja) 2010-11-11
JP5473388B2 true JP5473388B2 (ja) 2014-04-16

Family

ID=42991376

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2009106906A Active JP5473388B2 (ja) 2009-04-24 2009-04-24 半導体装置および半導体装置の製造方法

Country Status (3)

Country Link
US (1) US8350371B2 (ja)
JP (1) JP5473388B2 (ja)
CN (1) CN101872748B (ja)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012109163A (ja) 2010-11-18 2012-06-07 Yazaki Corp 電子部品の接続構造
JP2015056638A (ja) * 2013-09-13 2015-03-23 株式会社東芝 半導体装置およびその製造方法
JP5852080B2 (ja) * 2013-11-05 2016-02-03 ローム株式会社 半導体装置
JP2022146271A (ja) * 2021-03-22 2022-10-05 ローム株式会社 半導体装置

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6184475B1 (en) * 1994-09-29 2001-02-06 Fujitsu Limited Lead-free solder composition with Bi, In and Sn
JP4569423B2 (ja) 2005-08-31 2010-10-27 株式会社日立製作所 半導体装置の製造方法
US7829989B2 (en) * 2005-09-07 2010-11-09 Alpha & Omega Semiconductor, Ltd. Vertical packaged IC device modules with interconnected 3D laminates directly contacts wafer backside
TWI459512B (zh) * 2005-12-22 2014-11-01 Alpha & Omega Semiconductor 使用相互連接的三維層片將垂直封裝的ｍｏｓｆｅｔ和積體電路功率器件構建成集成模組
JP4961165B2 (ja) * 2006-06-02 2012-06-27 日立協和エンジニアリング株式会社 電子部品搭載用基板、電子部品および電子装置
JP2007327447A (ja) * 2006-06-09 2007-12-20 Toyota Motor Corp ブローバイガス処理装置
US9214442B2 (en) * 2007-03-19 2015-12-15 Infineon Technologies Ag Power semiconductor module, method for producing a power semiconductor module, and semiconductor chip

Also Published As

Publication number Publication date
US8350371B2 (en) 2013-01-08
CN101872748A (zh) 2010-10-27
CN101872748B (zh) 2015-10-07
US20100270666A1 (en) 2010-10-28
JP2010258231A (ja) 2010-11-11

Similar Documents

Publication Publication Date Title
JP4428448B2 (ja) 鉛フリーはんだ合金
US7224066B2 (en) Bonding material and circuit device using the same
KR20070086809A (ko) 솔더 페이스트, 및 전자장치
JP5724411B2 (ja) はんだ、はんだ付け方法及び半導体装置
JP5578326B2 (ja) リード部品及びその製造方法、並びに半導体パッケージ
KR20180130002A (ko) 면 실장 부품의 솔더링 방법 및 면 실장 부품
US9142493B2 (en) Semiconductor device
JPWO2009157130A1 (ja) 接合構造および電子部品
JP5473388B2 (ja) 半導体装置および半導体装置の製造方法
JP5169871B2 (ja) はんだ、はんだ付け方法及び半導体装置
US20150258636A1 (en) Solder alloy for low-temperature processing
JP2005340268A (ja) トランジスタパッケージ
US9018761B2 (en) Semiconductor device
JP2020518461A (ja) はんだ材及びダイアタッチメント方法
JP2017107955A (ja) 電子装置及び電子装置の製造方法
JP5852080B2 (ja) 半導体装置
JP2017126689A (ja) 電子装置及び電子機器
JP2019188456A (ja) はんだ合金、ソルダペースト、成形はんだ、及びはんだ合金を用いた半導体装置
JP5630060B2 (ja) はんだ接合方法、半導体装置及びその製造方法
KR20090086741A (ko) 무연 솔더 및 이를 포함하는 반도체 패키지
JP2011060926A (ja) 半導体装置
JP6543890B2 (ja) 高温はんだ合金
US20230387062A1 (en) Semiconductor device
KR100706574B1 (ko) 무연 솔더볼을 갖는 반도체 패키지 및 그 제조방법
JP2008141220A (ja) 半導体装置

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20120402

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20121030

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20130314

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130508

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20130815

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20131105

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20131112

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20140130

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20140204

R150 Certificate of patent or registration of utility model

Ref document number: 5473388

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250