JP5380041B2 - マルチフェーズ型dc/dcコンバータ - Google Patents
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Description
20 制御回路
21 コンパレータ
22 パルス信号生成部
23 パルス分配部
231、232 論理積演算器
233、234 論理和演算器
24 負荷状態検出部
DRV1〜DRVm ドライバ
NH1〜NHm Nチャネル型MOS電界効果トランジスタ(ハイサイド)
NL1〜NLm Nチャネル型MOS電界効果トランジスタ(ローサイド)
L1〜Lm インダクタ
C1 キャパシタ
Claims (4)
- 出力を共通に接続された複数のDC/DCコンバータ回路と、
前記複数のDC/DCコンバータ回路から電力の供給を受ける負荷の状態を検出し、負荷状態検出信号を出力する負荷状態検出部と、
前記複数のDC/DCコンバータ回路を用いて生成される出力電圧と所定の基準電圧とを比較して比較信号を出力するコンパレータと、
前記比較信号に基づいてオン時間が固定されたパルス信号を生成するパルス信号生成部と、
前記負荷状態検出信号に基づいて、前記複数のDC/DCコンバータ回路の出力位相を互いにずらして駆動するか、互いに揃えて駆動するかを切り替えるように、前記パルス信号のパルスを前記複数のDC/DCコンバータ回路の駆動信号として順次分配するパルス分配部と、
を有し、
前記パルス分配部の出力段は、
前記負荷状態検出信号と第2駆動信号との第1論理積演算信号を出力する第1論理積演算器と、
前記負荷状態検出信号と第1駆動信号との第2論理積演算信号を出力する第2論理積演算器と、
前記第1駆動信号と前記第1論理積演算信号との第1論理和演算信号を出力する第1論理和演算器と、
前記第2駆動信号と前記第2論理積演算信号との第2論理和演算信号を出力する第2論理和演算器と、
を含み、
前記第1駆動信号及び前記第2駆動信号は、それぞれ、前記パルス信号のパルスを順次分配して生成され、
前記第1論理和演算信号及び前記第2論理和演算信号は、それぞれ、前記第1駆動信号及び前記第2駆動信号に代えて前記複数のDC/DCコンバータ回路に出力される、
ことを特徴とするマルチフェーズ型DC/DCコンバータ。 - 前記負荷状態検出部は、前記負荷に供給される出力電流を監視し、
前記パルス分配部は、前記負荷状態検出信号に応じて、前記出力電流の急激な増大を検出したときに、前記複数のDC/DCコンバータ回路の出力位相を互いに揃えて駆動するように、前記パルス信号のパルス分配処理を行うことを特徴とする請求項1に記載のマルチフェーズ型DC/DCコンバータ。 - 前記負荷状態検出部は、前記負荷に供給される出力電圧を監視し、
前記パルス分配部は、前記負荷状態検出信号に応じて、前記出力電圧の急激な低下を検出したときに、前記複数のDC/DCコンバータ回路の出力位相を互いに揃えて駆動するように、前記パルス信号のパルス分配処理を行うことを特徴とする請求項1に記載のマルチフェーズ型DC/DCコンバータ。 - 前記負荷状態検出部は、前記負荷の動作モードを切り替えるための制御信号を監視し、
前記パルス分配部は、前記負荷状態検出信号に応じて、前記負荷が重負荷状態とされたことを検出したときに、前記複数のDC/DCコンバータ回路の出力位相を互いに揃えて駆動するように、前記パルス信号のパルス分配処理を行うことを特徴とする請求項1に記載のマルチフェーズ型DC/DCコンバータ。
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