JP5282750B2 - 時間計測装置およびセンサ装置 - Google Patents
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Description
図4に示すように、第1のパルス位相差符号化回路72は、主に複数の信号遅延回路(以下、ゲートディレイまたは遅延素子という)を持ったリング遅延パルス発生回路81,カウンター82,パルスセレクター83,エンコーダー84の各ブロックから構成されるもので、入力端子86に第1のパルスP1aが与えられると、リング遅延パルス発生回路81の途中から、その第1のパルスP1aが通過したゲートディレイの個数(段数)によって遅延時間が決まるところの複数の遅延パルスが出力され、パルスセレクター83に入力される。なお、リング遅延パルス発生回路81を構成するゲートディレイは、特許請求の範囲に記載の「遅延素子」の一例に相当し得る。
T=(D1/D2)×To ・・・(1)
なお、演算回路74は、特許請求の範囲に記載の「演算手段」の一例に相当し、入力時間差T(後述する計測時間T)は、特許請求の範囲に記載の「任意の時間」の一例に相当し得る。
e1=To/(2n−1) ・・・(2)
e2=(Ts×Tr2)/To ・・・(3)
まず、図7のステップS101にて基準時間設定処理がなされ、上記式(2),(3)等に基づいて計測誤差eを小さくするような基準時間Toが設定される。次に、ステップS103にて第1のパルス位相差取得処理がなされ、第1のパルス位相差符号化回路72により、レーザ光線の照射タイミングに応じた第1のパルスP1aの入力からレーザ光線の検出タイミングに応じた第2のパルスP1bの入力までの時間に相当するデジタル値D1が演算されて取得される。続いて、ステップS105にて第2のパルス位相差取得処理がなされ、第2のパルス位相差符号化回路73により、第1のパルスP2aの入力からステップS101にて設定された基準時間To後に入力される第2のパルスP2bの入力までの時間に相当するデジタル値D2が演算されて取得される。
K=To/(Tr1×D2) ・・・(4)
この式(4)において、ステップS107にて設定された時間分解能Tr1を用いることで、補正係数Kの演算時の演算誤差、すなわち、比率演算時の演算誤差を小さくすることができる。
T=D1×K×Tr1 ・・・(5)
ここで、式(5)に式(4)を代入することにより、上記式(1)が得られることがわかる。すなわち、本時間計測処理により、外乱の影響が抑制されるとともに、計測時間の計測精度の低下が抑制される。
まず、ステップS101の設定処理では、例えば、予定される計測時間Tsが200nsであり、ゲートディレイの時間分解能Tr2が100psであり、時間計測データのデータ幅が16ビットであるとすると、上記式(2),(3)等により、基準時間Toが1200nsに設定される。次に、ステップS103の第1のパルス位相差取得処理により、例えば、デジタル値D1が1538として取得されるとともに、ステップS105の第2のパルス位相差取得処理により、例えば、デジタル値D2が9230として取得される。続いて、ステップS107の設定処理では、比率演算時の時間分解能Tr1が、上記式(2)により演算される比率演算時の演算誤差e1に等しくなるように、例えば、20psに設定される。次に、ステップS109の補正係数演算処理にて、上記式(4)により、補正係数Kが6.5として演算される。そして、ステップS111の計測時間演算処理にて、上記式(5)により、計測時間Tが199.94nsとして演算されることとなる。
(1)比率演算時の時間分解能Tr1は、上記式(2)により演算される比率演算時の演算誤差e1に等しくなるように設定されることに限らず、デジタル値D2および基準時間Toから導き出される遅延素子の時間分解能よりも細かく設定されればよい。このようにしても、上記比率演算時の演算誤差e1が小さくなるので、計測時間Tの計測精度の低下を抑制することができる。
10…レーザダイオード
20…フォトダイオード
70…制御回路(時間計測装置)
71…時間計測回路(時間計測装置)
72…第1のパルス位相差符号化回路(第1のパルス位相差符号化手段)
73…第2のパルス位相差符号化回路(第2のパルス位相差符号化手段)
74…演算回路(演算手段)
D1…デジタル値(第1のパルス位相差)
D2…デジタル値(第2のパルス位相差)
K…補正係数
P1a…第1のパルス(第1のパルス信号)
P1b…第2のパルス(第2のパルス信号)
T…計測時間(任意の時間)
To…基準時間
Tr1…比率演算時の時間分解能
Claims (2)
- 第1のパルス信号を入力してこの第1のパルス信号を複数の遅延素子を通過させるとともに、当該第1のパルス信号に対して任意の時間だけ遅延した第2のパルス信号を入力して、その第2のパルス信号の入力タイミングにおける前記第1のパルス信号の前記複数ある遅延素子の通過位置を特定することにより、前記任意の時間を前記第1のパルス信号の通過した遅延素子の個数に基づいて第1のパルス位相差として符号化する第1のパルス位相差符号化手段と、
前記第1のパルス信号と異なるパルス信号を入力してこの異なるパルス信号を前記第1のパルス位相差符号化手段と同構成とされた複数の遅延素子を通過させるとともに、当該異なるパルス信号に対して基準時間だけ遅延したパルス信号を入力して、前記基準時間だけ遅延したパルス信号の入力タイミングにおける前記異なるパルス信号の前記複数ある遅延素子の通過位置を特定することにより、前記基準時間を前記異なるパルス信号の通過した遅延素子の個数に基づいて第2のパルス位相差として符号化する第2のパルス位相差符号化手段と、
前記任意の時間を、前記第1のパルス位相差および前記第2のパルス位相差の比率と前記基準時間とに基づいて求める演算手段と、を備えてなり、
前記演算手段は、前記基準時間を、前記比率を演算する際の分解能に応じて設定し、前記比率演算時の時間分解能を、前記第2のパルス位相差および前記基準時間から導き出される前記遅延素子の時間分解能よりも細かく設定することを特徴とする時間計測装置。 - 請求項1に記載の時間計測装置を備え、
レーザ光を照射しこのレーザ光が検出物体にて反射した反射光を検出することで照射タイミングから検出タイミングまでの時間差に応じて前記検出物体の位置を検出するセンサ装置であって、
前記時間差は、前記照射タイミングに応じて前記第1のパルス信号を前記時間計測装置に入力するとともに前記検出タイミングに応じて前記第2のパルス信号を前記時間計測装置に入力することで、前記演算手段により求められる前記任意の時間に基づいて計測されることを特徴とするセンサ装置。
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