JP5110864B2 - インクジェット記録ヘッドおよび該記録ヘッドの記録素子基板 - Google Patents
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Description
を備えることを特徴とする。
102 インク吐出口
104 ベースプレート
105 フレキシブル回路基板
106 支持部材
107 電気回路基板
108 電気コネクタ
110 インク供給口
111 ヒータ
113 ノズル材
114a ノズル列
117 インク共通液室
118 梁構造
120 インクジェット記録ヘッド
401 駆動トランジスタ領域
402 レベルコンバータ
403 ANDゲート領域
404 シフトレジスタ領域
405 ラッチレジスタ領域
406 デコーダ回路領域
407 温度検知素子領域
413 取り出し電極
414 信号配線
415 バッファ素子領域
421 シフトレジスタ領域
422 ラッチレジスタ領域
601 駆動トランジスタ
603 AND回路
604 シフトレジスタ
605 ラッチレジスタ
606 デコーダ回路
704 記録データ格納シフトレジスタ
705 記録データ格納ラッチレジスタ
706 デコーダ回路
707 デコーダシフトレジスタ
708 デコーダラッチレジスタ
Claims (6)
- 基板の表面に設けられ、記録信号に応じて供給された電圧パルスを熱エネルギに変換するヒータを第1の方向に複数配列して構成されるヒータ群と、
前記表面から該表面とは反対側にある裏面に貫通し、前記ヒータ群に隣接して配置され、複数の前記ヒータにインクを供給するインク供給口と、
前記ヒータ群の複数のヒータのいずれか1つに対応し、前記電圧パルスの供給をオン/オフするスイッチングトランジスタを前記第1の方向に複数配列して構成されるトランジスタ群と、
前記トランジスタ群の複数のスイッチングトランジスタのいずれか1つに対応し、記録データと時分割駆動のためのブロックデータとに応じた前記記録信号を前記スイッチングトランジスタに出力するAND回路を前記第1の方向に複数配列して構成されるAND回路群と、を含み、
前記インク供給口と前記ヒータ群と前記トランジスタ群と前記AND回路群とを、前記表面にこの順に並行して配置した組を複数備え、
複数の前記組は、一定量の隙間を隔てて前記第1の方向に沿った一直線上に配置され、隣り合う前記組の間の隙間領域のそれぞれには、該隙間領域に接する2つの前記AND回路群のいずれかに対応し、前記AND回路群の複数の前記AND回路に転送する前記記録データと前記ブロックデータとを一時的に記憶するレジスタが設けられていることを特徴とする記録素子基板。 - 前記レジスタに入力される信号の波形を整えるバッファ素子を、前記複数の組のそれぞれに対応するように複数有し、前記バッファ素子は、対応する前記レジスタの設けられた前記隙間領域に配置されていることを特徴とする請求項1に記載の記録素子基板。
- 前記隙間領域の前記記録素子基板の温度を検知するための温度検知素子を、前記隙間領域のそれぞれに対応するように複数備えることを特徴とする請求項1または請求項2に記載の記録素子基板。
- 隣り合う前記インク供給口の間に対応する前記裏面には、隣り合う前記インク供給口を互いに分断するように前記記録素子基板の梁構造が設けられていることを特徴とする請求項1乃至請求項3のいずれか1項に記載の記録素子基板。
- 前記第1の方向における前記一定量の隙間の幅と前記ヒータ群の幅とは、等しいことを特徴とする請求項1乃至請求項4のいずれか1項に記載の記録素子基板。
- 前記第1の方向において、それぞれ記録素子基板の複数の前記ヒータ群が互い違い位置するように、前記第1の方向とは交差する第2の方向に並列して配置される、請求項1乃至5のいずれかに記載の2枚の記録素子基板と、
前記2枚の記録素子基板のそれぞれの前記表面に設けられ、前記インク供給口から供給されたインクを前記複数のヒータのそれぞれに導いて、前記ヒータの発熱から生じる発泡エネルギによりインクを吐出するための複数の液路が形成されたノズル材と、
外部から受信した前記ヒータを駆動するための電気信号を前記2枚の記録素子基板に伝達するための電気回路基板と、
前記裏面から、前記2枚の記録素子基板の前記複数のインク供給口に共通してインクを供給するためのインク共通液室と、
を備えることを特徴とするインクジェット記録ヘッド。
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