JP5069208B2 - 光干渉変調器をアドレシングする方法及び光干渉変調器をアドレシングするためのドライバ回路 - Google Patents
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[1] 下記を具備する、ディスプレイ:
少なくともいくつかがアドレシング・パルス幅に対して異なる値の撓みを有する複数の光変調素子;及び
前記アドレシング・パルスの幅に応じて、素子の異なる組み合わせが選択可能な方式で切り替えるように、複数の素子に変化する幅のアドレシング・パルスを供給するように構成されたアドレシング回路系、
ここで、前記アドレシング回路系は、前記複数の素子の全ての素子が応答する第1のパルス及び全てより少ない前記複数の素子が応答する少なくとも1つの第2のパルスを供給するように構成される。
[2] 前記アレイの少なくとも複数の異なる素子は、前記アドレシング・パルス幅に対して異なる値の撓みをもたらすように異なる機械的構造を有する、[1]のディスプレイ。
[3] 前記複数のうちの少なくともいくつかの異なる素子が、前記素子の撓むことが可能な部分に関して異なるバネ定数を有する、[2]のディスプレイ。
[4] 前記複数のうちの少なくともいくつかの異なる素子が、前記アドレシング・パルス幅に対して異なる値の撓みをもたらすように異なる抵抗器−キャパシタ(RC)時定数を有する、[1]のディスプレイ。
[5] 前記複数のうちの少なくともいくつかの異なる素子が、前記アドレシング・パルス幅に対して異なる値の撓みをもたらすように異なるフィルム厚さを有する、[1]のディスプレイ。
[6] 少なくとも1つのアドレシング配線と直列の少なくとも1つの抵抗器又はキャパシタをさらに具備する、[1]のディスプレイ。
[7] 下記を具備する、ディスプレイ:
印加電圧に対して異なる値の撓みを有する複数の光変調素子;及び
アドレシング・パルスの電圧レベルに応じて、素子の異なる組み合わせが選択可能な方式で切り替えるように、複数の素子に変化する電圧レベルのアドレシング・パルスを供給するように構成されたアドレシング回路系、
ここで、前記アドレシング回路系は、前記複数の素子の全ての素子が応答する第1のパルス及び全てより少ない前記複数の素子が応答する少なくとも1つの第2のパルスを供給するように構成される。
[8] 前記アレイの少なくとも複数の異なる素子は、前記印加電圧に対して異なる値の撓みをもたらすように異なる機械的構造を有する、[7]のディスプレイ。
[9] 前記アレイの少なくとも複数の異なる素子は、前記印加電圧に対して異なる値の撓みをもたらすように異なる膜厚を有する、[7]のディスプレイ。
[10] 前記異なる膜厚は、撓み電極と非撓み電極との間の絶縁体層の異なる厚さを具備する、[9]のディスプレイ。
[11] 前記複数の光変調素子と電気的に通信するプロセッサ、前記プロセッサは画像データを処理するために構成される;及び
前記プロセッサと電気的に通信するメモリ・デバイス、
をさらに具備する、[7]のディスプレイ。
[12] 前記アドレシング回路系に前記画像データの少なくとも一部分を送るために構成されたコントローラをさらに具備する、[11]のディスプレイ。
[13] 前記プロセッサに前記画像データを送るために構成された画像ソース・モジュールをさらに具備する、[11]のディスプレイ。
[14] 前記画像ソース・モジュールは、受信機、トランシーバ、及び送信機のうちの少なくとも1つを具備する、[13]のディスプレイ。
[15] 入力データを受信するため及び前記プロセッサに前記入力データを通信するために構成された入力デバイスをさらに具備する、[11]のディスプレイ。
[16] 下記を具備する、ディスプレイ:
複数の行に配置された複数のMEMS素子、ここで、前記複数の行の各々の前記MEMS素子は、複数の下位行にさらに配置され、及びここで、各行の前記複数の下位行は、電気的に接続される;及び
複数の抵抗器、前記抵抗器の各々は、前記複数の下位行のそれぞれ1つに接続され、各行の前記複数の下位行の各々に対する前記抵抗器のそれぞれ1つは前記行の他の下位行に接続された前記抵抗器とは異なる抵抗を有する。
[17] 前記複数のMEMS素子は、複数の光干渉変調器を具備する、[16]のディスプレイ。
[18] 少なくとも第1のディスプレイ素子及び第2のディスプレイ素子を有し且つそれぞれの応答しきい値により特徴付けられる複数のディスプレイ素子をアドレシングする方法、前記方法は下記を具備する:
前記複数のディスプレイ素子の全ての前記応答しきい値よりも大きな値を有するパラメータにより特徴付けられる第1のパルスを発生すること;
前記複数のディスプレイ素子に前記第1のパルスを印加すること;
前記第1のディスプレイ素子の前記応答しきい値よりも大きく且つ前記第2のディスプレイ素子の前記応答しきい値より小さな値を有するパラメータにより特徴付けられる第2のパルスを発生すること;及び
前記複数のディスプレイ素子に前記第2のパルスを印加すること。
[19] 前記パラメータは、パルス継続時間を具備し、そして前記応答しきい値は、それぞれの前記ディスプレイ素子の応答時間を具備する、[18]の方法。
[20] 前記パラメータは、電圧の大きさを具備し、そして前記応答しきい値は、それぞれの前記ディスプレイ素子のアクチュエーション電圧を具備する、[18]の方法。
[21] 前記第2の素子の状態は、維持される、[18]の方法。
[22] 画像データ信号を受信すること;及び
前記画像データ信号に少なくとも部分的に基づいて前記第1のディスプレイ素子及び前記第2のディスプレイ素子の各々の状態を設定すること、
をさらに具備する、[18]の方法。
[23] 第3のディスプレイ素子の応答しきい値よりも大きなパラメータの第3の値の第3のパルスを発生すること、ここで、前記第3の値は前記第1のディスプレイ素子及び前記第2のディスプレイ素子の前記応答しきい値より小さい;及び
前記複数のディスプレイ素子に前記第3のパルスを印加すること、
をさらに具備する、[18]の方法。
[24] 前記複数のディスプレイ素子に前記第1のパルスを印加することは、複数の光干渉変調器に前記第1のパルスを印加することを具備する、[18]の方法。
[25] 前記複数のディスプレイ素子は、それぞれの抵抗器−キャパシタ(RC)時定数により特徴付けられる、[18]の方法。
[26] 前記複数のディスプレイ素子の前記それぞれの応答時間は、前記それぞれのRC時定数に少なくとも部分的に基づく、及びここで、前記第1のディスプレイ素子及び前記第2のディスプレイ素子は、異なるRC時定数により特徴付けられる、[25]の方法。
[27] 前記複数のディスプレイ素子は、それぞれの物理特性により特徴付けられる、[26]の方法。
[28] 前記複数のディスプレイ素子の前記それぞれの応答時間は、それぞれのバネ定数に少なくとも部分的に基づく、及びここで、前記第1のディスプレイ素子及び前記第2のディスプレイ素子は、異なるバネ定数により特徴付けられる、[27]の方法。
[29] 前記複数の光干渉変調器の各々は、空気中を動く時にそれぞれの抵抗により特徴付けられる可動鏡を具備する、[24]の方法。
[30] 前記複数の光干渉変調器の前記それぞれの応答時間は、前記可動鏡のそれぞれの空気抵抗に少なくとも部分的に基づく、及びここで、前記第1のディスプレイ素子及び前記第2のディスプレイ素子は、空気中の動きに対する異なる抵抗により特徴付けられる、[24]の方法。
[31] 前記複数のディスプレイ素子に前記第1のパルスを印加することは、視覚ディスプレイの画素に前記第1のパルスを印加することを具備する、[28]の方法。
[32] 前記画素は、前記複数のディスプレイ素子を具備する、[31]の方法。
[33] 前記複数のディスプレイ素子に前記第1のパルスを印加することは、電圧パルスを印加することを具備する、[18]の方法。
[34] 前記複数のディスプレイ素子に前記第1のパルスを印加することは、前記ディスプレイ素子の行に第1の電圧パルスを印加すること、及び前記ディスプレイ素子の列に第2の電圧パルスを印加することを具備する、及びここで、前記第1のディスプレイ素子及び前記第2のディスプレイ素子の各々は、前記行及び前記列に関係付けられる、[18]の方法。
[35] 少なくとも第1のディスプレイ素子及び第2のディスプレイ素子を有し且つそれぞれの応答しきい値により特徴付けられる複数のディスプレイ素子をアドレシングするためのドライバ回路、前記ドライバ回路は下記を具備する:
前記複数のディスプレイ素子の全ての前記応答しきい値よりも大きな値を有するパラメータにより特徴付けられる第1のパルスを発生するための手段;
前記複数のディスプレイ素子に前記第1のパルスを印加するための第1の手段;
前記第1のディスプレイ素子の前記応答しきい値よりも大きく且つ前記第2のディスプレイ素子の前記応答しきい値より小さな値を有するパラメータにより特徴付けられる第2のパルスを発生するための手段;及び
前記複数のディスプレイ素子に前記第2のパルスを印加するための第2の手段。
[36] 前記発生する手段は、パルス発生器行ドライバ回路を具備する、[35]のドライバ回路。
[37] 前記パラメータは、パルス継続時間を具備し、そして前記応答しきい値は、それぞれの前記ディスプレイ素子の応答時間を具備する、[35]のドライバ回路。
[38] 前記パラメータは、電圧の大きさを具備し、そして前記応答しきい値は、それぞれの前記ディスプレイ素子のアクチュエーション電圧を具備する、[35]のドライバ回路。
[39] 前記第2の素子の状態は、維持される、[35]のドライバ回路。
[40] 第3のディスプレイ素子の応答しきい値よりも大きな前記パラメータの第3の値の第3のパルスを発生するための手段、ここで、前記第3の値は、前記第1のディスプレイ素子及び前記第2のディスプレイ素子の前記応答しきい値より小さい;及び
前記複数のディスプレイ素子に前記第3のパルスを印加するための第3の手段、
をさらに具備する、[35]のドライバ回路。
[41] 前記発生する手段は、行ドライバ回路を具備する、[40]のドライバ回路。
[42] 前記第3の印加する手段は、行ドライバ回路を具備する、[40]のドライバ回路。
[43] 前記第1の印加する手段は、複数の光干渉変調器に前記第1のパルスを印加するための手段を具備する、[30]のドライバ回路。
[44] 前記第1の印加する手段は、視覚ディスプレイの画素に前記第1のパルスを印加するための手段を具備する、[30]のドライバ回路。
[45] 前記第1の印加する手段は、電圧パルスを印加するための手段を具備する、[30]のドライバ回路。
[46] 前記第1の印加する手段は、前記ディスプレイ素子の行に第1の電圧パルスを印加し、且つ前記ディスプレイ素子の列に第2の電圧パルスを印加するための手段を具備する、及びここで、前記第1のディスプレイ素子及び前記第2のディスプレイ素子の各々は、前記行及び前記列に関係付けられる、[30]のドライバ回路。
[47] 下記を具備する、デバイス:
光を変調するための複数の手段、前記変調する手段は選択された印加電圧に対して異なる撓みの値を有する;及び
アドレシング・パルスの電圧レベルに応じて、前記変調する手段の異なる組み合わせが選択可能な方法で切り替るように、前記複数の変調する手段に変化する電圧レベルのアドレシング・パルスを供給するためのアドレシングする手段、
ここで、前記アドレシングする手段は、前記複数の素子の全ての前記変調する手段が応答する第1のパルス及び全てより少ない前記変調する手段が応答する少なくとも1つの第2のパルスを供給するように構成される。
[48] 前記変調する手段のうちの少なくとも1つは、光干渉変調器を具備する、[47]のデバイス。
[49] 前記アドレシングする手段は、回路ドライバを具備する、[47]のデバイス。
[50] 下記を具備する、ディスプレイを製造する方法:
複数の行に配置された複数のMEMS素子を提供すること、ここで、前記各行の前記MEMS素子は、複数の下位行にさらに配置され、そしてここで、各行の前記複数の下位行は、電気的に接続される;及び
前記複数のMEMS素子に複数の抵抗器を接続すること、前記抵抗器の各々は前記複数の下位行のそれぞれ1つに接続され、各行の前記複数の下位行の各々に対する前記複数の抵抗器のそれぞれ1つは前記行の他の下位行に接続された前記抵抗器とは異なる抵抗を有する。
[51] 下記を具備する、ディスプレイ:
複数の行に配置された画像データを表示するための複数の手段、ここで、前記複数の行の各々を前記表示する手段は、複数の下位行にさらに配置され、そしてここで、各行の前記複数の下位行は、電気的に接続される;及び
電流に抵抗するための複数の手段、前記抵抗する手段の各々は前記複数の下位行のそれぞれ1つに接続され、各行の前記複数の下位行の各々に対する前記抵抗する手段のそれぞれ1つは前記行の他の下位行に接続された前記抵抗する手段とは異なる抵抗を有する。
[52] 少なくとも1つの前記抵抗する手段は、抵抗器を具備する、[51]のディスプレイ。
[53] 少なくとも1つの前記表示する手段は、光干渉変調器を具備する、[51]若しくは[52]のディスプレイ。
上記の詳細な説明は、種々の実施形態に適用されたものとして本発明の新規な特徴を示し、説明し、そして指摘してきているが、説明された装置又はプロセスの形式及び詳細における種々の省略、置き換え、及び変更が、本発明の精神から逸脱することなく当業者により行い得ることが、理解される。本発明の範囲は、前述の明細書によるよりは添付された特許請求の範囲により指示される。特許請求の範囲に等価な趣旨及び範囲内になる全ての変更は、その範囲内に包含されるべきである。
Claims (25)
- 複数の光干渉変調器のうちの少なくともいくつかがアドレシング・パルス継続時間及び/または電圧の大きさに対して異なる値の撓みを有し、前記複数の光干渉変調器は、お互いに電気的に接続される、少なくとも第1の光干渉変調器及び第2の光干渉変調器を有し且つそれぞれの応答しきい値により特徴付けられる複数の光干渉変調器をアドレシングする方法、前記方法は下記を具備する:
前記複数の光干渉変調器の全ての前記応答しきい値よりも大きな値を有するパラメータにより特徴付けられる第1のパルスを発生すること;
前記複数の光干渉変調器に前記第1のパルスを印加すること;
前記第1の光干渉変調器の前記応答しきい値よりも大きく且つ前記第2の光干渉変調器の前記応答しきい値より小さな値を有するパラメータにより特徴付けられる第2のパルスを発生すること;
前記複数の光干渉変調器に前記第2のパルスを印加すること;
第3の光干渉変調器の応答しきい値よりも大きなパラメータの第3の値の第3のパルスを発生すること、ここで、前記第3の値は前記第1の光干渉変調器及び前記第2の光干渉変調器の前記応答しきい値より小さい;及び
前記複数の光干渉変調器に前記第3のパルスを印加すること
ここにおいて、前記パラメータは、パルス継続時間及び/または電圧の大きさを具備する。 - 前記それぞれの応答しきい値は、それぞれの前記光干渉変調器のそれぞれの応答時間を具備する、請求項1の方法。
- 前記応答しきい値は、それぞれの前記光干渉変調器のアクチュエーション電圧を具備する、請求項1の方法。
- 前記第2の光干渉変調器の状態は、維持される、請求項1の方法。
- 画像データ信号を受信すること;及び
前記画像データ信号に少なくとも部分的に基づいて前記第1の光干渉変調器及び前記第2の光干渉変調器の各々の状態を設定すること、
をさらに具備する、請求項1の方法。 - 前記複数の光干渉変調器は、それぞれの抵抗器−キャパシタ時定数により特徴付けられる、請求項2の方法。
- 前記複数の光干渉変調器の前記それぞれの応答時間は、前記それぞれの抵抗器−キャパシタ時定数に少なくとも部分的に基づく、及びここで、前記第1の光干渉変調器及び前記第2の光干渉変調器は、異なる抵抗器−キャパシタ時定数により特徴付けられる、請求項6の方法。
- 前記複数の光干渉変調器は、それぞれの物理特性により特徴付けられる、請求項7の方法。
- 前記複数の光干渉変調器の前記それぞれの応答時間は、それぞれのバネ定数に少なくとも部分的に基づく、及びここで、前記第1の光干渉変調器及び前記第2の光干渉変調器は、異なるバネ定数により特徴付けられる、請求項8の方法。
- 前記複数の光干渉変調器の各々は、空気中を動く時にそれぞれの抵抗により特徴付けられる可動鏡を具備する、請求項2の方法。
- 前記複数の光干渉変調器の前記それぞれの応答時間は、前記可動鏡のそれぞれの空気抵抗に少なくとも部分的に基づく、及びここで、前記第1の光干渉変調器及び前記第2の光干渉変調器は、空気中の動きに対する異なる抵抗により特徴付けられる、請求項10の方法。
- 前記複数の光干渉変調器に前記第1のパルスを印加することは、視覚ディスプレイの画素に前記第1のパルスを印加することを具備する、請求項9の方法。
- 前記画素は、前記複数の光干渉変調器を具備する、請求項12の方法。
- 前記複数の光干渉変調器に前記第1のパルスを印加することは、電圧パルスを印加することを具備する、請求項1の方法。
- 前記複数の光干渉変調器に前記第1のパルスを印加することは、前記光干渉変調器の行に第1の電圧パルスを印加すること、及び前記光干渉変調器の列に第2の電圧パルスを印加することを具備する、及びここで、前記第1の光干渉変調器及び前記第2の光干渉変調器の各々は、前記行及び前記列に関係付けられる、請求項1の方法。
- 複数の光干渉変調器のうちの少なくともいくつかがアドレシング・パルス継続時間及び/または電圧の大きさに対して異なる値の撓みを有し、前記複数の光干渉変調器は、お互いに電気的に接続される、少なくとも第1の光干渉変調器及び第2の光干渉変調器を有し且つそれぞれの応答しきい値により特徴付けられる複数の光干渉変調器をアドレシングするためのドライバ回路、前記ドライバ回路は下記を具備する:
前記複数の光干渉変調器の全ての前記応答しきい値よりも大きな値を有するパラメータにより特徴付けられる第1のパルスを発生するための手段;
前記複数の光干渉変調器に前記第1のパルスを印加するための第1の手段;
前記第1の光干渉変調器の前記応答しきい値よりも大きく且つ前記第2の光干渉変調器の前記応答しきい値より小さな値を有するパラメータにより特徴付けられる第2のパルスを発生するための手段;
前記複数の光干渉変調器に前記第2のパルスを印加するための第2の手段、ここにおいて、前記パラメータは、パルス継続時間及び/または電圧の大きさを具備する;
第3の光干渉変調器の応答しきい値よりも大きな前記パラメータの第3の値の第3のパルスを発生するための手段、ここで、前記第3の値は、前記第1の光干渉変調器及び前記第2の光干渉変調器の前記応答しきい値より小さい;及び
前記複数の光干渉変調器に前記第3のパルスを印加するための第3の手段。 - 前記発生する手段は、パルス発生器行ドライバ回路を具備する、請求項16のドライバ回路。
- 前記応答しきい値は、それぞれの前記光干渉変調器の応答時間を具備する、請求項16のドライバ回路。
- 前記応答しきい値は、それぞれの前記光干渉変調器のアクチュエーション電圧を具備する、請求項16のドライバ回路。
- 前記第2の光干渉変調器の状態は、維持される、請求項16のドライバ回路。
- 前記発生する手段は、行ドライバ回路を具備する、請求項16のドライバ回路。
- 前記第3のパルスを印加するための第3の手段は、行ドライバ回路を具備する、請求項16のドライバ回路。
- 前記第1のパルスを印加するための第1の手段は、視覚ディスプレイの画素に前記第1のパルスを印加するための手段を具備する、請求項16のドライバ回路。
- 前記第1のパルスを印加するための第1の手段は、電圧パルスを印加するための手段を具備する、請求項16のドライバ回路。
- 前記第1のパルスを印加するための第1の手段は、前記光干渉変調器の行に第1の電圧パルスを印加し、且つ前記光干渉変調器の列に第2の電圧パルスを印加するための手段を具備する、及びここで、前記第1の光干渉変調器及び前記第2の光干渉変調器の各々は、前記行及び前記列に関係付けられる、請求項16のドライバ回路。
Applications Claiming Priority (8)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US60489604P | 2004-08-27 | 2004-08-27 | |
US60/604,896 | 2004-08-27 | ||
US60622304P | 2004-08-31 | 2004-08-31 | |
US60/606,223 | 2004-08-31 | ||
US61345804P | 2004-09-27 | 2004-09-27 | |
US60/613,458 | 2004-09-27 | ||
US11/051,251 US7142346B2 (en) | 2003-12-09 | 2005-02-04 | System and method for addressing a MEMS display |
US11/051,251 | 2005-02-04 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005243697A Division JP4422659B2 (ja) | 2004-08-27 | 2005-08-25 | Memsディスプレイをアドレシングするためのシステム及び方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2009163230A JP2009163230A (ja) | 2009-07-23 |
JP5069208B2 true JP5069208B2 (ja) | 2012-11-07 |
Family
ID=40965855
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008313378A Expired - Fee Related JP5043812B2 (ja) | 2004-08-27 | 2008-12-09 | Memsディスプレイをアドレシングするためのシステム及び方法 |
JP2008313379A Expired - Fee Related JP5069208B2 (ja) | 2004-08-27 | 2008-12-09 | 光干渉変調器をアドレシングする方法及び光干渉変調器をアドレシングするためのドライバ回路 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008313378A Expired - Fee Related JP5043812B2 (ja) | 2004-08-27 | 2008-12-09 | Memsディスプレイをアドレシングするためのシステム及び方法 |
Country Status (2)
Country | Link |
---|---|
JP (2) | JP5043812B2 (ja) |
CN (1) | CN101694767B (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20110164068A1 (en) * | 2010-01-06 | 2011-07-07 | Qualcomm Mems Technologies, Inc. | Reordering display line updates |
KR101136820B1 (ko) * | 2010-05-28 | 2012-04-19 | 주식회사 넥스비보 | 미소기계 구동기 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH087343B2 (ja) * | 1989-05-26 | 1996-01-29 | 松下電器産業株式会社 | 液晶素子とその駆動法 |
JPH0823500A (ja) * | 1994-07-11 | 1996-01-23 | Canon Inc | 空間光変調素子および該素子を用いた投影型表示装置 |
JP3824290B2 (ja) * | 1998-05-07 | 2006-09-20 | 富士写真フイルム株式会社 | アレイ型光変調素子、アレイ型露光素子、及び平面型ディスプレイ、並びにアレイ型光変調素子の駆動方法 |
JP2003295074A (ja) * | 2002-01-31 | 2003-10-15 | Ricoh Co Ltd | 光変調装置 |
-
2005
- 2005-08-26 CN CN200910129348XA patent/CN101694767B/zh not_active Expired - Fee Related
-
2008
- 2008-12-09 JP JP2008313378A patent/JP5043812B2/ja not_active Expired - Fee Related
- 2008-12-09 JP JP2008313379A patent/JP5069208B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2009163230A (ja) | 2009-07-23 |
JP2009175710A (ja) | 2009-08-06 |
CN101694767B (zh) | 2012-07-18 |
CN101694767A (zh) | 2010-04-14 |
JP5043812B2 (ja) | 2012-10-10 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A711 | Notification of change in applicant |
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A131 | Notification of reasons for refusal |
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A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20111108 |
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A131 | Notification of reasons for refusal |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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R150 | Certificate of patent or registration of utility model |
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LAPS | Cancellation because of no payment of annual fees |