JP5028304B2 - 仮想計算機システム及びその制御方法 - Google Patents
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- CPUと主記憶装置とI/Oデバイスを制御するI/O制御装置とを資源として含む計算機を論理区画に割り当てて制御するハイパバイザ、及び前記I/Oデバイスから前記主記憶装置へのデータ転送を前記ハイパバイザからの指示に応答して記録するロギング回路を有し、
前記ハイパザイザは、前記論理区画に割り当てられた主記憶装置の記憶領域である論理記憶領域に格納されているデータを、他の計算機の他のハイパバイザが制御する他の論理区画の論理記憶領域へ移動する第一の移動を行い、
前記ロギング回路は、前記第一の移動中に、前記論理区画の上で動作するOSによって制御された前記I/Oデバイスから前記主記憶装置へのデータ転送によって前記主記憶装置に格納されているデータが書き換えられると、書き換えられたデータが格納されている格納位置を示すアドレス及び格納データ量を示すサイズを所定のエントリに記録し、
前記ハイパバイザは、前記論理区画に割り当てられたCPUである論理CPUを停止し、
前記ハイパバイザは、前記ロギング回路により前記エントリに記録された前記アドレス及び前記サイズで示される前記主記憶装置のデータを、前記他の論理区画の論理記憶領域へ移動する第二の移動を行う
ことを特徴とする仮想計算機システム。 - 前記エントリに記録された、前記I/Oデバイスから前記主記憶装置へのデータ転送は、DMA転送であることを特徴とする請求項1記載の仮想計算機システム。
- 前記エントリに記録されたデータ転送のエントリ数が所定数を超えているときの、前記ハイパバイザによる前記移動する処理の再実行に伴い、前記ハイパバイザは前記指示を再発行することを特徴とする請求項2記載の仮想計算機システム。
- CPUと主記憶装置とI/Oデバイスを制御するI/O制御装置とを資源として含む計算機を論理区画に割り当て、前記論理区画に割り当てた前記資源を制御し、前記論理区画で動作するOSからの指示に基づいて、前記計算機は、前記I/Oデバイスから前記主記憶装置へのデータ転送の記録をロギング回路へ指示する仮想計算機システムの制御方法であって、
前記計算機は、前記論理区画に割り当てられた主記憶装置の記憶領域である論理記憶領域に格納されているデータを、他の計算機の他の計算機が制御する他の論理区画の論理記憶領域へ移動する第一の移動を行い、
前記ロギング回路は、前記第一の移動中に、前記論理区画の上で動作するOSによって制御された前記I/Oデバイスから前記主記憶装置へのデータ転送によって前記主記憶装置に格納されているデータが書き換えられると、書き換えられたデータが格納されている格納位置を示すアドレス及び格納データ量を示すサイズを所定のエントリに記録し、
前記計算機は、前記論理区画に割り当てられたCPUである論理CPUを停止し、
前記計算機は、前記ロギング回路により前記エントリに記録された前記アドレス及び前記サイズで示される前記主記憶装置のデータを、前記他の論理区画の論理記憶領域へ移動する第二の移動を行う
ことを特徴とする仮想計算機システムの制御方法。 - 前記エントリに記録された、前記I/Oデバイスから前記主記憶装置へのデータ転送は、DMA転送であることを特徴とする請求項4記載の仮想計算機システムの制御方法。
- 前記エントリに記録されたデータ転送のエントリ数が所定数を超えているとき、前記移動する処理を再実行し、前記ロギング回路への指示を再発行することを特徴とする請求項5記載の仮想計算機システムの制御方法。
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