JP5010733B2 - 情報スキューおよび冗長制御情報によるデータ送信装置および方法 - Google Patents
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Description
Claims (30)
- 差動データ送信回路であって、
前記差動データ送信回路は複数の差動レーン送信回路を備えており、
前記複数の差動レーン送信回路は、複数の冗長制御シンボルおよび複数の冗長制御データのうちの少なくとも1つを複数の差動レーンの各々に供給するように動作するとともに、非冗長データを供給するように動作し、
前記複数の差動レーン送信回路は、前記複数の冗長制御シンボルおよび前記複数の冗長制御データのうちの前記少なくとも1つが前記複数の差動レーン送信回路間で時間的にスキューされるように、動作することを特徴とする差動データ送信回路。 - 前記差動データ送信回路はレーンスキュー回路を備えており、
前記複数の差動レーン送信回路のうちの少なくとも1つには、前記複数の差動レーンのうちの1つの差動レーンに対応するパラレル−シリアル変換部が設けられており、
前記パラレル−シリアル変換部の前の線路には、前記1つの差動レーンに隣接する差動レーンに対する遅延部が挿入されており、
前記レーンスキュー回路は前記遅延段から成る請求項1に記載の差動データ送信回路。 - 前記差動データ送信回路はレーンスキュー回路を備えており、
前記レーンスキュー回路は、
前記複数の差動レーン送信回路のうちの少なくとも1つの差動レーン送信回路の線路に挿入されている第1の遅延部と、
前記少なくとも1つの差動レーン送信回路とは別の差動レーン送信回路の線路に挿入されている第2の遅延部と、
を備えており、
前記第1の遅延部および前記第2の遅延部は、前記複数の冗長制御シンボルおよび前記複数の制御データの互いに異なる遅延を生じさせる請求項1に記載の差動データ送信回路。 - 前記差動データ送信回路は、プログラム可能な遅延回路から成るレーンスキュー回路を備えており、
前記プログラム可能な遅延回路は、前記複数の差動レーンにおける互いに隣接する差動レーン間で前記複数の冗長制御シンボルおよび前記複数制御データの互いに異なる遅延を生じさせるように動作する請求項1に記載の差動データ送信回路。 - 差動受信回路であって、
前記差動受信回路は複数の差動レーン受信機回路を備えており、
前記複数の差動レーン受信機回路は、複数の冗長制御シンボルおよび複数の冗長制御データのうちの少なくとも1つを複数の差動レーンの各々から受信するように動作するとともに、非冗長データを受信するように動作し、
前記複数の差動レーン受信機回路は、前記複数の冗長制御シンボルおよび前記複数の冗長制御データのうちの前記少なくとも1つが前記複数の差動レーン受信機回路間で時間的にデスキューされるように動作することを特徴とする差動受信回路。 - 前記差動受信回路はレーンデスキュー回路を備えており、
前記複数の差動レーン受信機回路の少なくとも1つには、前記複数の差動レーンのうちの1つの差動レーンに対応するシリアル−パラレル変換部が設けられており、
前記シリアル−パラレル変換部の後の線路には、前記1つの差動レーンに隣接する差動レーンに対する遅延部が挿入されており、
前記レーンデスキュー回路は前記遅延部から成る請求項5に記載の差動受信回路。 - 前記差動データ受信回路はレーンデスキュー回路を備えており、
前記レーンデスキュー回路は、
前記複数の差動レーン受信機回路の少なくとも1つの差動レーン受信機回路の線路に挿入されている第1の遅延部と、
前記少なくとも1つの差動レーン受信機回路とは別の差動レーン受信機回路の線路に挿入されている第2の遅延部と、
を備えており、
前記第1の遅延部および前記第2の遅延部は、前記複数の冗長制御シンボルおよび前記複数の制御データの互いに異なる遅延を生じさせる請求項5に記載の差動データ受信機回路。 - 前記差動データ受信機回路は、プログラム可能な遅延回路から成るレーンデスキュー回路を備えており、
前記プログラム可能な遅延回路は、前記複数の差動レーンにおける互いに隣接する差動レーン間で前記複数の冗長制御シンボルおよび前記複数の制御データの互いに異なる遅延を生じさせるように動作する請求項5に記載の差動データ受信機回路。 - 前記差動データ受信機回路は、前記複数の冗長制御シンボルおよび前記複数の制御データに基づいて表示するためにピクセル情報を生成するように動作する冗長情報ベースのエラー訂正・回復ロジックを備える請求項5に記載の差動データ受信機回路。
- 差動データ送信回路であって、
複数の差動レーン送信回路に通信するためにビデオデータストリームを供給するように動作するビデオストリーム処理回路と、
前記複数の差動レーン送信回路の各々に対して、複数の冗長ビデオ制御シンボル、複数の冗長制御データ、および関係する複数のビデオデータの非冗長パケットを出力するように動作するデータパッキング回路と、
複数の遅延回路と、
を備えており、
前記複数の遅延回路の各遅延回路は、異なる差動レーン送信回路と関係づけられており、
前記各遅延回路は、前記複数の冗長ビデオ制御シンボルおよび前記複数の冗長制御データが前記複数の複数の差動レーン送信回路間で時間的にスキューされるように動作することを特徴とする差動データ送信回路。 - 前記複数の制御シンボルは、垂直表示期間中の最後のアクティブピクセルおよび垂直表示期間中のラインの最初のアクティブピクセルを表すデータから成り、
前記複数の制御データは、ビデオストリームが垂直表示期間にあるのか又は垂直帰線消去期間にあるのか、及び、ビデオストリームがインタレースビデオの奇数フィールドにあるのか又は偶数フィールドにあるのかを表すデータから成る請求項10に記載の差動データ送信回路。 - 装置であって、
ディスプレイと、
差動受信回路と、
ビデオ処理回路と、
を備えており、
前記差動受信回路は複数の差動レーン受信機回路を備えており、
前記複数の差動レーン受信機回路は、複数の冗長制御シンボルおよび複数の冗長制御データのうちの少なくとも1つを複数の差動レーンの各々から受信し、
前記複数の差動レーン受信機回路は、前記複数の冗長制御シンボルおよび前記複数の冗長制御データのうちの前記少なくとも1つが前記複数の差動レーン受信機回路間で時間的にデスキューされるように動作し、
前記複数の差動レーン受信機回路は、前記複数の冗長制御シンボルおよび前記複数の制御データとパックで非冗長ビデオデータを受信するように動作し、
前記ビデオ処理回路はディスプレイに動作可能に結合されており、
前記ビデオ処理回路は、前記複数の冗長制御シンボルおよび前記複数の制御データとパックされた前記非冗長ビデオデータから、前記ディスプレイで表示するためにピクセルを生成するように動作することを特徴とする装置。 - 前記差動受信回路はレーンデスキュー回路を備えており、
前記複数の差動レーン受信回路の少なくとも1つには、前記複数の差動レーンのうちの1つの差動レーンに対応するシリアル−パラレル変換部が設けられており、
前記シリアル−パラレル変換部の後の線路には、前記1つの差動レーンに隣接する差動レーンに対する遅延部が挿入されており、
前記レーンデスキュー回路は前記遅延部から成る請求項12に記載の装置。 - 前記差動受信回路はレーンデスキュー回路を備えており、
前記レーンデスキュー回路は、
前記複数の差動レーン受信機回路の少なくとも1つの差動レーン受信機回路の線路に挿入されている第1の遅延部と、
前記少なくとも1つの差動レーン受信機回路とは別の差動レーン受信機回路の線路に挿入されている第2の遅延部と、
を備えており、
前記第1の遅延部及び前記第2の遅延部は、前記複数の冗長制御シンボルおよび前記複数の制御データの互いに異なる遅延を生じさせる請求項12に記載の装置。 - 前記差動受信回路は、プログラム可能な遅延回路から成るレーンデスキュー回路を備えており、
前記プログラム可能な遅延回路は、前記複数の差動レーンにおける互いに隣接する差動レーン間で前記複数の冗長制御シンボルおよび前記複数の制御データの互いに異なる遅延を生じさせるように動作する請求項12に記載の装置。 - 前記差動受信回路は、前記複数の冗長制御シンボルおよび前記複数の制御データに基づいて表示するためにピクセル情報を生成するように動作する冗長情報ベースのエラー訂正・回復ロジックを備える請求項12に記載の装置。
- システムであって、
第1の装置と、
第2の装置と、
を備え、
前記第1の装置は複数の差動レーン送信回路を備えており、
前記複数の差動レーン送信回路は、複数の冗長制御シンボルおよび複数の冗長制御データのうちの少なくとも1つを複数の差動レーンの各々に供給するように動作するとともに、非冗長データを供給するように動作し、
前記複数の差動レーン送信回路は、前記複数の冗長制御シンボルおよび前記複数の冗長制御データのうちの前記少なくとも1つが前記複数の差動レーン送信回路間で時間的にスキューされるように動作し、
前記第2の装置は複数の差動レーン受信機回路を備えており、
前記複数の差動レーン受信機回路は、前記複数の差動レーンの各々に供給された複数の冗長制御シンボルおよび複数の冗長制御データと前記非冗長データとを受信し、
前記差動レーン受信機回路は、前記供給された複数の冗長制御シンボルおよび複数の冗長制御データのうちの前記少なくとも1つが前記複数の差動レーン受信機回路間で時間的にデスキューされるように動作することを特徴とするシステム。 - 前記差動データ送信回路はレーンスキュー回路を備えており、
前記レーンスキュー回路は、
前記複数の差動レーン送信回路のうちの少なくとも1つの差動レーン送信回路の線路に挿入された第1の遅延部と、
前記少なくとも1つの差動レーン送信回路とは別の差動レーン送信回路の線路に挿入された第2の遅延部と、
を備えており、
前記第1の遅延部および前記第2の遅延部は、前記複数の冗長制御シンボルおよび複数の制御データの互いに異なる遅延を生じさせる請求項17に記載のシステム。 - ビデオを処理するための方法であって、
複数の制御シンボル、複数の制御データおよび複数のビデオデータのうちの少なくとも1つを生成するためにビデオストリームを処理することと、
時間的にスキューされた複数の冗長制御シンボルおよび複数の冗長制御データのうちの少なくとも1つを、関係する非冗長ビデオデータとともに複数の差動レーンの各々に送信することと、
を含む方法。 - 前記方法は、更に、
前記複数の冗長制御シンボルおよび複数の制御データならびに関係するビデオデータのうちの少なくとも1つを前記複数の差動レーンの各々から受信することと、
前記複数の冗長制御シンボルおよび複数の制御データを時間的にデスキューすることと、
を含む請求項19に記載の方法。 - 前記方法は、更に、
前記複数の冗長制御シンボルおよび制御データに基づいて表示するためにピクセル情報を生成することと、
前記生成されたピクセル情報に基づくピクセルをディスプレイで表示すること、
とを含む請求項20に記載の方法。 - データ送信回路であって、
前記データ送信回路は複数の送信回路を備えており、
前記複数の送信回路は、少なくとも同じ冗長制御情報と非冗長データとを複数のチャネルの各々に供給するように動作し、
前記複数の送信回路は、前記同じ冗長制御情報が前記複数の送信回路間で時間的にスキューされるように動作することを特徴とするデータ送信回路。 - 前記データ送信回路はチャネルスキュー回路を備えており、
前記複数のチャネル送信回路のうちの少なくとも1つには、別のチャネルに対する遅延部が設けられており、
前記チャネルスキュー回路は前記遅延部から成る請求項22に記載のデータ送信回路。 - 前記データ送信回路はチャネルスキュー回路を備えており、
前記チャネルスキュー回路は、
前記複数のチャネル送信回路のうちの少なくとも1つのチャネル送信回路の線路に挿入された第1の遅延部と、
前記少なくとも1つのチャネル送信回路とは別のチャネル送信回路の線路に挿入された第2の遅延部と、
を備えており、
前記第1の遅延部および前記第2の遅延部は、前記冗長制御情報の互いに異なる遅延を生じさせる請求項22に記載のデータ送信回路。 - 前記データ送信回路は、プログラム可能な遅延回路から成るチャネルスキュー回路を備えており、
前記プログラム可能な遅延回路は、前記複数のチャネル間で前記冗長制御情報の互いに異なる遅延を生じさせるように動作する請求項22に記載のデータ送信回路。 - 受信回路であって、
前記受信回路は複数の受信機回路を備えており、
前記複数の受信機回路は、同じ冗長制御情報と非冗長データとを複数のチャネルの各々から受信し、
前記複数の受信機回路は、前記同じ冗長制御情報が前記複数の受信機回路間で時間的にデスキューされるように動作することを特徴とする受信回路。 - 前記受信回路はチャネルデスキュー回路を備えており、
前記複数の受信機回路の少なくとも1つには、別のチャネルに対する遅延部が設けられており、
前記チャネルデスキュー回路は前記遅延部から成る請求項26に記載の受信回路。 - 前記受信回路はレーンデスキュー回路を備えており、
前記レーンデスキュー回路は、
複数の差動レーン受信機回路の少なくとも1つの差動レーン受信機回路の線路に挿入された第1の遅延部と、
前記少なくとも1つの差動レーン受信機回路とは別の差動レーン受信機回路の線路に挿入された第2の遅延部と、
を備えており、
前記第1の遅延部および前記第2の遅延部は、前記冗長制御情報の互いに異なる遅延を生じさせる請求項27に記載の受信回路。 - 前記受信回路は、プログラム可能な遅延回路から成るレーンデスキュー回路を備えており、
前記プログラム可能な遅延回路は、前記複数のチャネル間で前記冗長制御情報の互いに異なる遅延を生じさせるように動作する請求項26に記載の受信回路。 - 前記受信回路は、前記冗長制御情報に基づいて表示するためにピクセル情報を生成するように動作する冗長情報ベースのエラー訂正・回復ロジックを備える請求項26に記載の受信回路。
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