JP4932853B2 - フォールドバックのない、容量デジタル変調器 - Google Patents
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Description
同一出願人により同日に出願がなされ、共に係属中である、「差圧検出器のための、容量デジタルインターフェース回路」とタイトルが付された出願を参照する。
本発明は、測定システムに関する。より詳細には、本発明は、容量式差圧検出器と共に使用するための容量デジタル変調器に関する。
容量デジタル(CD)変調器が、圧力検出器の容量を、パルス符号変調出力信号へと変換する。CD変調器における第1段階は、積分器入力ノードと増幅器入力部との間に接続された自動ゼロ(auto−zero)キャパシタを有する、シグマ−デルタ積分器である。自動ゼロフェーズの間、フィードバックキャパシタは増幅器の入出力部の間に接続されており、そして自動ゼロキャパシタは、積分器入力ノードに接続された検出器キャパシタの漏れ抵抗の関数である、電圧を記憶する。積分フェーズの間、フィードバックキャパシタは積分器入力ノードに接続される。過度の圧力/短絡という状態が存在するとき、自動ゼロキャパシタへの記憶された電圧が電流を誘導し、その電流はフィードバックキャパシタへと流れて、積分器を飽和へとドライブし、そしてフォールドバック異常を抑制する。
図1において圧力トランスミッタ10を示す。それは、主検出器キャパシタCMX及びCMYと、線形補償キャパシタCLX及びCLYと、抵抗器RX及びRYと、アナログ区域12(2次容量デジタル(CD)変調器14と、1次電圧デジタル(VD)変調器16と、そしてデジタルインターフェースユニット18とが含まれる)と、デジタル区域20と、マイクロプロセッサ22と、そしてインターフェース24とを備える、容量ベースの差圧トランスミッタである。トランスミッタ10とコントロールルームとの通信は、インターフェース24を介して提供される。通信は、2ワイヤループを介しても、アナログ、デジタル、又はアナログ及びデジタルを組み合わせての信号が伝送されるようなネットワークを介しても、又は無線伝送を介してもよい。
CX=CMX−CLX
CY=CMY−CLY
差分容量比ηP は、以下の通りである。
CD変調器14に対する伝達関数は、以下の通りである。
ηP=2・DP−1
ここでDPはPCMP信号のパルス密度である。通常動作に対して、比ηPのダイナミックレンジは以下の通りである。
−0.8≦ηP≦0.8
ここでCX及びCYが到達可能な最大実効容量は、各々について約100pFである。CD変調器14は、短絡して過度の圧力が生じている場合においてフォールドバックしないに違いない。
N0・CX・ΔVEX−N1・CY・ΔVEX=0
これにより、要求されている測定関係が得られる。
ここにおいて比N1/Nは、PCMP信号のパルス密度である。
負荷抵抗RLがR0よりも小さい領域では、バッファ出力電圧VOUTは、負荷抵抗が減少するにつれて減少する。
特性抵抗値R0は、
によって見積もることができる。
Claims (16)
- 検出器励起ノードと、
積分器入力ノードと、
第1の入力部と第2の入力部と出力部とを有する増幅器と、
前記積分器入力ノードと前記増幅器における前記第1の入力部との間に接続された自動ゼロキャパシタと、
前記増幅器における前記出力部に接続された第1の端部と、自動ゼロフェーズの間は前記増幅器における前記第1の入力部に接続され積分フェーズの間は前記積分器入力ノードに接続される第2の端部と、を有するフィードバックキャパシタと、
検出器通電ノードに接続され、前記積分器入力ノードに選択的に接続された第1の検出器キャパシタと、
前記自動ゼロフェーズの間は第1の供給電圧レベルを有し前記積分フェーズの間は第2の供給電圧レベルを有する検出器励起信号を前記第1の検出器キャパシタに与えるための検出器励起ノードに接続された検出器励起信号源と、
前記自動ゼロフェーズの間、前記第1の検出器キャパシタにおける漏れ抵抗の関数である電圧を、前記積分器入力ノードに対して与えるための回路と、
を含む、シグマデルタ積分器。 - 前記回路は演算相互コンダクタンス増幅器(OTA)バッファを含む、請求項1に記載のシグマデルタ積分器。
- 前記OTAバッファは、前記第2の供給電圧レベルを受けるための第1の入力部と、出力部に接続された第2の入力部と、を有する、請求項2に記載のシグマデルタ積分器。
- 前記回路は更に、前記自動ゼロフェーズの間は前記OTAバッファの前記出力部と前記積分器入力ノードとを接続し、前記積分フェーズの間は前記積分器入力ノードから前記OTAバッファの前記出力部への接続を断つ、ためのスイッチを含む、請求項3に記載のシグマデルタ積分器。
- 前記増幅器における前記第2の入力部は前記第2の供給電圧レベルに接続される、請求項1に記載のシグマデルタ積分器。
- 前記自動ゼロフェーズの間、前記自動ゼロキャパシタは、前記増幅器の前記第1の入力部における電圧と前記積分器入力ノードにおける電圧との間の差を表す電圧を記憶する、請求項1に記載のシグマデルタ積分器。
- 前記自動ゼロフェーズの間、前記増幅器の前記第1の入力部における電圧は、前記フィードバックキャパシタの電圧の関数である、請求項6に記載のシグマデルタ積分器。
- 前記検出器励起ノードに接続され、前記積分器入力ノードに選択的に接続された第2の検出器キャパシタ、
を更に含み、
前記検出器励起信号源は、前記自動ゼロフェーズの間は前記第2の供給電圧レベルを、前記積分フェーズの間は前記第1の供給電圧レベルを、前記第2の検出器キャパシタに与える、
請求項1に記載のシグマデルタ積分器。 - 前記第1の供給電圧レベルは前記第2の供給電圧レベルよりも低い、請求項1に記載のシグマデルタ積分器。
- 積分器入力ノードと、
第1の入力部と第2の入力部と出力部とを有する増幅器と、
前記増幅器の前記出力部に接続されたフィードバックキャパシタと、
自動ゼロフェーズの間、検出器漏れ抵抗の関数である電圧を記憶するための、前記積分器入力ノードに接続された自動ゼロキャパシタと、
を含む、
自動ゼロフェーズの間は検出器容量の関数として電荷を選択的に形成し、積分フェーズの間は積分器出力電圧を生み出すために該電荷を積分する、ためのシグマデルタ積分器。 - 過度の圧力及び短絡の状態下において、前記自動ゼロフェーズの間に前記自動ゼロキャパシタによって記憶された電圧は、前記積分フェーズの間、前記積分器の飽和を引き起こす、請求項10に記載のシグマデルタ積分器。
- 第2の供給電圧レベルを受けるための第1の入力部と、出力部に接続された第2の入力部と、を有する、演算相互コンダクタンス増幅器(OTA)バッファと、
前記自動ゼロフェーズの間は前記OTAバッファの前記出力部と前記積分器入力ノードとを接続し、前記積分フェーズの間は前記積分器入力ノードから前記OTAバッファの前記出力部への接続を断つ、ためのスイッチと、
を更に含む、請求項10に記載のシグマデルタ積分器。 - 第1の容量圧力検出器と、
第2の容量圧力検出器と、
第1フェーズの間は前記第1の容量圧力検出器及び前記第2の容量圧力検出器のうちの1つにおける容量の関数として電荷を選択的に形成し、積分器出力電圧を生み出すために第2フェーズの間は電荷を積分するための、第1の積分器と、
積分器入力ノードと、
第1の入力部と第2の入力部と出力部とを有する増幅器と、
前記増幅器における前記出力部に接続されたフィードバックキャパシタと、
前記第1の容量圧力検出器と前記第2の容量圧力検出器とを前記積分器入力ノードに選択的に接続するための、前記第1フェーズの間は前記フィードバックキャパシタを前記第1の入力部に接続するための、前記第2フェーズの間は前記フィードバックキャパシタを前記積分器入力ノードに接続するための、スイッチング回路と、
前記積分器入力ノードと前記増幅器における前記第1の入力部との間に接続された自動ゼロキャパシタと、
を含み、
前記第1フェーズの間、前記自動ゼロキャパシタは、検出器漏れ抵抗の関数である電圧を記憶する、
容量デジタル変調器。 - 前記第1フェーズ及び前記第2フェーズの関数として、励起信号が中間レベル供給電圧と低レベル供給電圧との間での切り替えを行う、請求項13に記載の容量デジタル変調器。
- 前記増幅器における前記第2の入力部は前記中間レベル供給電圧を受けるよう接続される、請求項14に記載の容量デジタル変調器。
- 過度の圧力及び短絡状態が存在する場合、前記自動ゼロキャパシタによって記憶される電圧は、積分フェーズの間、前記増幅器の飽和を引き起こすような前記フィードバックキャパシタへの電流を誘導する、請求項13に記載の容量デジタル変調器。
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