JP4590203B2 - 遊技機制御用チップセット及び遊技機制御用チップ間の通信方法 - Google Patents
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Description
<遊技機の開発>各チップのインターフェイスは、各チップのアプリケーションプログラムが互いに通信を行う手段で行っているため、回路設計及びプログラム開発に負担がかかり遊技機制御プログラムの一部にインターフェイス制御用プログラムを記述する必要がある。
<不正の虞れ>各デバイス間が暗号化されないパラレル通信又はシリアル通信で行っているため、不正者が介在する虞れがある。
<不正監視に関する従来技術>遊技場内に複数設けられ遊技機器を監視する装置が特許文献1に開示されている。
I/Oチップは、遊技機を構成するパチンコではスタート検出スイッチからの入力、大入賞口の開閉出力、ランプ出力、パチスロではスタートレバーの検出入力、リールの回転出力などの制御に対する入出力を行うチップである。
サブ基板は、サブCPUを搭載しパチンコでは玉の払い出し等、メインCPUより受けたコマンドにより既定の動作を行う。サブCPUはユーザの作成した制御プログラムの改ざんを防止するセキュリティ機能が搭載されている。
各チップはシリアル通信で接続され、内蔵のメモリを共有する構造となっている。シリアル通信の制御方法は、BSC方式のほかにシリアルバス方式として、CAN、LIN、I2C(アイスクエアシー)などの方法がある。実施例では、BSC方式による二点間の到達確認にACK/NAKで応答する方式(通信プロトコル1)と、シリアルバス方式として、時間を分割しパケット内のデータが正常な場合のみ受信する方式(通信プロトコル2)について説明する。実施例では、メインチップをマスター(主局)、その他をスレーブ(従局)として説明しているがマスターになるのは、どのチップでもよい。また、マスターとなったチップはその系に接続される全チップのID番号、通信の状態などを外部の照合装置又は監視ネットワークへ伝えることができる。
セキュリティチェックが正常である場合は、エラー制限回数、制限時間の設定をし(s1660)、エラー発生回数カウンタ制限時間タイマーの初期化をする(s1680)。次に周辺チップの初期化処理を実行する(s1700)。この周辺チップの初期化処理の詳細については、図17を参照しつつ後述する。初期化が正常になされない(s2195でNo)と、エラー発生カウンタを更新し(s2693)、エラー判定を行う(s2694)。一定時間内に定められた回数以内(エラー許容内)であればs1700に戻る。一定時間内に定められた回数以内でなければ遊技用CPU停止(s2695)し、一連の処理をストップする(s2696)。
周辺チップの初期化処理が正常とみなされる(s2195でYes)と、遊技用CPUの動作を開始する(s2196)。そして、遊技プログラムが動作するバックグラウンドにおいて共有RAMのデータ更新処理(s2200)を実行する。この処理の詳細については図22を参照しつつ後述する。データ更新が正常に行われると(s2691)、エラー発生回数カウンタ制限時間タイマーの初期化を実行し(s2692)、共有RAMデータ更新処理に戻る(s2200)。このデータ更新が正常に行われない場合は、エラー発生カウンタ更新(s2693)に進み、エラーが許容内ならs1700に戻り、エラーが許容内でなければ遊技用CPU停止(s2695)し一連の処理をストップする(s2696)。
したがって、遊技用CPUが正常に動作している間は共有RAMのデータ更新処理が繰り返しなされ続けて他のチップとの通信が正常に行われていることを確認し続けることとなる。共有RAMデータは、ユーザROMに書き込まれた遊技機制御用プログラムよりアクセスされ、周辺チップとのインターフェイスが行われる。
s2330における送信異常、又はs2350における受信異常は、NAK再送リトライアウト、タイムアウト、無応答などにより認められ、異常終了(s2385)として終了する(s2390)。また、s2360にてID照合が正常になされない場合も異常終了(s2385)となる。なお、ここで正常に終了したか、異常に終了したかは、図22のs2395にて改めてきかれて、その結果により分岐する。
IDの照合が正常ならば(s2740でYes)、WD1のデータをI/Oチップ1出力エリアに格納する(s2745)。そして自身の乱数発生回路から乱数R2を取得し、I/Oチップ1の入力エリアに格納されている更新データRD1、IDi1、R2を共通鍵k1で暗号化してメインCPUに更新応答電文を送信する(s2755)。送信が正常になされたか否かをチェックし、異常があればI/Oチップ1の動作停止をし(s2765)、正常ならばs2735に戻る。I/Oチップ1での入出力エリアに格納されたデータは、入出力制御回路により入力ポート、出力ポートへ入出力される。
I/Oチップ1の初期化データ受信(IDi1とR2の取得)、I/Oチップ2の初期化データ受信(IDi2とR3の取得)、サブCPU1の初期化データ受信(IDs1とR4の取得)、サブCPU2の初期化データ受信(IDs2とR5の取得)のすべてが正常になされた場合にのみ、共通鍵kcの算出をする(s3655)。この共通鍵kcは、5個のチップのID(IDm、IDi1、IDi2、IDs1、IDs2)及びそれぞれのチップが発生した合計5個の乱数(R1、R2、R3、R4、R5)とから生成され、これら5個のチップ間の通信に共通で用いられる暗号鍵kcである。
61、62 I/0チップ
63、64 サブCPU
100 ホストコンピュータ
200 データベース
300 公衆回線
400 ホールコンピュータ
Claims (16)
- 遊技機を動作させる制御プログラムが格納されており該遊技機制御のメイン処理を行うメインCPUと、
前記遊技機の周辺デバイスの入出力を制御する一つ又は複数のI/Oチップと、
前記メインCPUより受けたコマンドにより既定の動作の処理を実行する一つ又は複数のサブCPUと
のうちの二つ以上のチップの組み合わせからなり、
前記遊技機内部の基板上に搭載されて、前記遊技機を制御する遊技機制御用チップセットであって、
前記遊技機制御用チップセットを構成するそれぞれのチップの内部に、
前記遊技機を動作させる制御プログラムの格納領域・作業領域とは独立して設けられ、前記遊技機制御用チップセットを構成する他チップとの間でデータを共有するデータ書き込み及び読み込みが可能な共有記憶領域と、
前記遊技機を動作させる制御プログラムの実行手段とは独立して設けられ、他のチップとの間で前記共有記憶領域のデータを共有するための通信を実行するとともにチップ間を相互監視するための相互認証を実行するデータ通信手段と
を有し、
前記遊技機制御用チップセットを構成するチップのうちの一つの内部の共有記憶領域には、前記遊技機制御用チップセットのうちの他のチップ内部の共有記憶領域に対応付けられる記憶領域が設けられ、前記遊技機を制御する動作のバックグラウンドにおいて各チップ間の当該共有記憶領域に記憶されたデータのデータ通信を実行し、各チップ間で当該共有記憶領域に記憶されたデータが共有されることを特徴とする遊技機制御用チップセット。 - 請求項1に記載した遊技機制御用チップセットであって、
前記遊技機制御用チップセットを構成するそれぞれのチップが、他のチップとの通信が正規のチップ同士の通信でない場合には、当該自身のチップの動作を停止する動作停止手段をさらに有する遊技機制御用チップセット。 - 請求項2に記載した遊技機制御用チップセットであって、
前記他のチップとの間で共有するデータには各チップ固有のID情報を含むことを特徴とする遊技機制御用チップセット。 - 請求項1,2又は3のいずれかに記載した遊技機制御用チップセットであって、
前記データ通信手段による通信は、暗号化されたデータで行うことを特徴とする遊技機制御用チップセット。 - 請求項4に記載した遊技機制御用チップセットであって、
前記データ通信手段による通信は、各チップ固有のID情報により算出した暗号鍵により暗号化して実行することを特徴とする遊技機制御用チップセット。 - 請求項4又は5のいずれかに記載した遊技機制御用チップセットであって、
前記データ通信手段によりなされる前記チップ間の通信は、チップの組み合わせごとに異なる暗号により暗号化された通信であることを特徴とする遊技機制御用チップセット。 - 請求項4,5又は6のいずれかに記載した遊技機制御用チップセットであって、
前記データ通信手段には、乱数発生回路を含み、前記データ内に乱数を含むことを特徴とする遊技機制御用チップセット。 - 請求項1,2,3,4,5,6又は7のいずれかに記載した遊技機制御用チップセットであって、
前記データ通信手段によるデータ通信はシリアル通信で行われることを特徴とする遊技機制御用チップセット。 - 遊技機を動作させる制御プログラムの格納領域・作業領域とは独立して設けられた、データ書き込み及び読み込みが可能な共有記憶領域と、前記遊技機を動作させる制御プログラムの実行とは独立して設けられた、他のチップとの間で前記共有記憶領域のデータを共有するための通信を実行するとともにチップ間を相互監視するための相互認証を実行するデータ通信手段とを有する遊技機制御用チップの組み合わせであって、前記遊技機を動作させる制御プログラムが格納されており遊技機制御のメイン処理を行うメインCPUと、前記遊技機の周辺デバイスの入出力を制御する一つ又は複数のI/Oチップと、前記メインCPUより受けたコマンドにより既定の動作の処理を実行する一つ又は複数のサブCPUとのうちの二つ以上のチップの組み合わせである遊技機制御用チップセットを設けた遊技機制御用基板において、前記メインCPUが前記遊技機を動作させる際にバックグラウンドで、前記遊技機制御用チップセットを構成するチップのうちの一つが、前記遊技機制御用チップセットのうちの他のチップとの間のデータ通信を実行する遊技機制御用チップ間の通信方法であって、
前記一つのチップが他のチップとの間での初期化処理を行う初期化ステップと、
前記一つのチップが該遊技用CPU動作開始ステップにて開始された遊技用プログラムの動作のバックグラウンドで他のチップの共有記憶領域へのデータ更新処理を行うデータ更新ステップと、
該データ更新ステップにてなされたデータ更新の過程におけるプロトコル通信に異常が生じた場合またはチップ間の相互認証が異常の場合に、前記一つのチップが当該チップの動作を停止するチップ停止ステップと
を有する遊技機制御用チップ間の通信方法。 - 請求項9に記載した遊技機制御用チップ間の通信方法であって、
前記初期化ステップ及びデータ更新ステップにおける通信においてやり取りされ、前記共有記憶領域に記憶されるデータには、前記複数の遊技機制御用チップ間の他のチップとの間で共有するデータを含むことを特徴とする遊技機制御用チップ間の通信方法。 - 請求項10に記載した遊技機制御用チップ間の通信方法であって、
前記他のチップとの間で共有するデータには、各チップ固有のID情報を含むことを特徴とする遊技機制御用チップ間の通信方法。 - 請求項9,10又は11のいずれかに記載した遊技機制御用チップ間の通信方法であって、
前記初期化ステップ及びデータ更新ステップにおける通信においてやり取りされるデータは、暗号化されたデータであることを特徴とする遊技機制御用チップ間の通信方法。 - 請求項12に記載した遊技機制御用チップ間の通信方法であって、
前記初期化ステップ及びデータ更新ステップにおける通信は、各チップ固有のID情報により算出した暗号鍵により暗号化して実行することを特徴とする遊技機制御用チップ間の通信方法。 - 請求項13に記載した遊技機制御用チップ間の通信方法であって、
前記初期化ステップ及びデータ更新ステップにおける通信は、チップの組み合わせごとに異なる暗号により暗号化された通信であることを特徴とする遊技機制御用チップ間の通信方法。 - 請求項12,13又は14のいずれかに記載した遊技機制御用チップ間の通信方法であって、
前記データ通信手段には乱数発生回路を含み、
前記初期化ステップ及びデータ更新ステップにおける通信においてやり取りされるデータは該乱数発生回路にて発生させた乱数を含むことを特徴とする遊技機制御用チップ間の通信方法。 - 請求項9,10,11,12,13,14又は15のいずれかに記載した遊技機制御用チップ間の通信方法であって、
前記初期化ステップ及びデータ更新ステップにおける通信は、シリアル通信で行われることを特徴とする遊技機制御用チップ間の通信方法。
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